JP3015781B2 - 半導体素子のインダクタ製造方法 - Google Patents
半導体素子のインダクタ製造方法Info
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Description
し、特にセル領域を含む半導体基板に形成されるインダ
クタの製造方法に関する。
現するためのいくつかの方法が提示されているが、トラ
ンジスタと共に同一の基板上に製造し難いという工程上
の制約及び充分なインダクタンスを具現することができ
ないという構造的な制約に起因して実際に量産には適用
されていない。
ダクタを説明する。図1は一般的なインダクタの構成図
であり、図2a及び図2bは従来の技術のインダクタの
構成図である。
成を示す。インダクタは、コア部分10とコア部分10
に巻かれたコイル12とからなり、構成自体が3次元的
である。
インダクタをシリコンボディに具現したものであり、こ
の構成は次の通りである( このインダクタは米国特許第
3,988,764 号に開示されている) 。
ィ1にシリコンボディ1を貫通して構成される複数個の
シリコンボディ1とは反対導電型の円筒状の拡散層2
と、拡散層2の下部に構成され、対応する2つの拡散層
2を互いに連結する下部連結層3と、下部連結層3によ
り互いに連結された2つの拡散層2のうち何れか一つの
拡散層2とそれに隣り合う何れか一つの拡散層2(別の
下部連結層3により連結された何れか一つの拡散層2)
とを互いに連結する上部連結層4とから大きく構成され
る。
ンダクタは、一連の電気回路に電気的に連結され、イン
ダクタコイルとして機能を果たすようになる。
インダクタ製造工程はディープトレンチ食刻(deep tren
ch etch)、エピタキシャル成長、再結晶化、高温工程を
含んでなるため、製造工程が複雑で且つ実用性に劣る。
このため、実際にULSI(Ultra Large ScaledIntegra
ted) チップ等の量産に適用できないという問題点があ
った。
ダクタ製造方法の問題点を解決するためになされたもの
であり、その目的は、半導体素子の製造工程と連関性が
ある工程で具現可能にして、素子との同一の基板上にイ
ンダクタを構成することを可能にした半導体素子のイン
ダクタ製造方法を提供することにある。
に適用可能な本発明の半導体素子のインダクタ製造方法
が提供される。請求項1に記載の発明は、半導体基板の
表面内に一定の拡散深さを有して一定の間隙に分離され
ている不純物拡散領域を形成する工程と、選択酸化工程
で前記不純物拡散領域を横切る方向に半導体基板を選択
的に酸化させてインダクタコア層を形成する工程と、前
記インダクタコア層を含む全面にポリシリコン層を形成
し、そのポリシリコン層の一部を選択的にパターニング
して、何れか一つの不純物拡散領域の表面の一側の領域
とそれに隣り合う不純物拡散領域の表面の他側の領域と
にコンタクトされるポリシリコンパターン層を複数個形
成して、全ての不純物拡散領域をポリシリコンパターン
層を介して電気的に連結させるインダクタコイル層を形
成する工程とを備えることを要旨とする。請求項2に記
載の発明は、請求項1記載の発明において、それぞれの
不純物拡散領域は長軸と短軸を有する長方形状であり、
全ての不純物拡散領域は同じ形状及びサイズを有するよ
うに形成されることを要旨とする。
発明において、ポリシリコンパターン層は不純物拡散領
域と同じ幅を有し、それぞれの不純物拡散領域の長軸方
向に対して角度を45゜±15゜に振って形成すること
を要旨とする。
酸化膜層、第1フォトレジスト層を順次に形成し、前記
第1フォトレジスト層が選択的に除去されるようにパタ
ーニングする工程と、前記パターニングされた第1フォ
トレジスト層をマスクとして用いて半導体基板の表面内
に不純物拡散領域を形成する工程と、前記酸化膜層上に
窒化膜層を形成し、その窒化膜層の一部を選択的に除去
した後、酸化工程を施してインダクタコア層を形成する
工程と、前記インダクタコア層を含む全面に第2フォト
レジスト層を形成し、その第2フォトレジスト層の一部
が選択的に除去されるように第2のフォトレジストをパ
ターニングした後、それぞれの不純物拡散領域の表面が
露出するようにそのパターニングされた第2フォトレジ
スト層をマスクとして用いて酸化膜層の一部を選択的に
除去する工程と、前記第2フォトレジスト層を除去し、
全面に高濃度の不純物がドープされたポリシリコン層、
第3フォトレジスト層を順次に形成する工程と、前記第
3フォトレジスト層の一部が選択的に除去されるように
その第3フォトレジスタをパターニングし、そのパター
ニングされた第3フォトレジスタをマスクとして用いて
露出されたポリシリコン層の一部を選択的に食刻してポ
リシリコンパターン層を形成する工程と、を備えること
を要旨とする。
発明において、第1フォトレジスト層が除去される領域
は、インダクタが形成される全体領域の長さ方向に一定
の間隙に分離された同一のサイズを有する長方形状をな
し、それぞれの除去領域は、インダクタが形成される全
体領域の長さ方向に水平な幅Wよりその長さ方向に直交
する長さLが2倍以上になるようにすることを要旨とす
る。請求項6に記載の発明は、請求項4記載の発明にお
いて、それぞれのポリシリコンパターン層は、インダク
タコア層の下側に形成された不純物拡散領域のうち何れ
か一つの不純物拡散領域の表面の一側の領域とそれに隣
り合う他の不純物拡散領域の表面の反対側の領域とに連
結されるように形成されることを要旨とする。
半導体素子のインダクタ製造工程を説明する。図4A、
図4Bは本発明のインダクタのレイアウト図及び構造断
面図であり、図5A〜図9Cは図4AのI−I’、II−
II’、及びIII −III ’線上の本発明のインダクタの工
程断面図及び平面構成図である。
工程断面図であり、図7A〜図9Aは図4AのII−II’
線上の工程断面図である。そして、図9B〜図9Cは図
4AのIII −III ’線上の工程断面図である。図5A〜
図9Cは連続する工程段階を示し、工程上の特徴が表れ
る部分を強調するべく90゜又は45゜に振って示す断
面図である。
タを具現するべくコア部分を酸化膜で形成し、半導体素
子が形成された同一基板に構成できるようにしたもので
あり、その製造方法は以下の通りである。
1導電型の半導体基板30上に酸化膜31を形成する。
そして、図5C及び図5Dに示すように、酸化膜31上
に第1フォトレジスト層32を形成し、インダクタのコ
イル層が形成される領域32Aのみが除去されるように
フォトリソグラフィ工程で第1フォトレジスト層32を
パターニングする。この際、第1フォトレジスト層32
の除去領域32aは、インダクタが形成される全体領域
の長さ方向に一定の間隙をおいて分離されるとともに、
各領域32aは同一形状で同一サイズとなっている。除
去領域32aは長方形状であり、インダクタが形成され
る全体領域の長さ方向に水平な幅(短軸幅)Wよりそれ
に垂直な長さ(長軸幅)Lが2倍以上大きい。次いで、
パターニングされた第1フォトレジスト層32をマスク
にして半導体基板30に第2導電型の不純物イオン(P
又はB等)を注入してインダクタの下側連結層として用
いられる不純物拡散領域33を形成する。
工程でマスクとして用いられた第1フォトレジスト層3
2を除去し、酸化膜層31上に窒化膜層34を形成す
る。次いで、図6Bに示すように、窒化膜層34の一部
を選択的に除去してインダクタのコア部分が形成される
部分34aのみをオープンする。この際、窒化膜層34
は、トランジスタの隔離層として用いられる素子隔離領
域を形成するためのフィールド酸化マスク層である。そ
して、窒化膜層34が除去される部分34aは、不純物
拡散領域33の中央を横切る長方形状である。
パターニングされた窒化膜層34をマスクにしてフィー
ルド酸化工程を施して酸化膜からなるインダクタコア層
35を形成する。 そして、図7B及び図7Cに示すよ
うに、フィールド酸化工程でマスクとして用いられた窒
化膜層34を除去し、全面に第2フォトレジスト層36
を形成する。
に分離された不純物拡散領域33を有するインダクタコ
ア層35を中心にして層35より広い幅を有する溝36
aが形成されるように第2フォトレジスト層36をパタ
ーニングする。
グされた第2フォトレジスト層36をマスクにして溝3
6aによって露出された酸化膜31の一部を選択的に除
去して、それぞれの不純物拡散領域33の表面が露出す
るようにする。この際、インダクタコア層35の一部も
除去されるが、この除去量が極めて微量なので基本的な
インダクタコア層35の形状には影響を与えない。
酸化膜除去工程でマスクとして用いられた第2フォトレ
ジスト層36を除去し、露出されたインダクタコア層3
5を含む酸化膜31の全面に高濃度の不純物がドープさ
れたポリシリコン層37を蒸着により形成する。そし
て、ポリシリコン層37の全面に第3フォトレジスト層
38を形成する。
レジスト層38の一部を選択的に除去してインダクタコ
イル層を形成するためのマスクを形成する。この際、第
3フォトレジスト層38は、インダクタコア層35の下
部の不純物拡散領域33が形成される方向の対角線方向
(45゜±15゜)に不純物拡散領域33と同じ幅とな
るように形成される。すなわち、フォトレジスト層38
は不純物拡散領域33の形成方向に対して45゜±15
゜傾斜した方向に沿って形成される。次いで、図9Cに
示すように、パターニングされた第3フォトレジスト層
38をマスクとして用いて露出されたポリシリコン層3
7の一部を選択的に食刻してポリシリコンパターン層3
7aを形成する。ポリシリコンパターン層37aはイン
ダクタコア層35の下側に形成された不純物拡散領域3
3にそれぞれ連結される。すなわち、インダクタコア層
35の対角方向に形成されるポリシリコンパターン層3
7aの一端は、一つの不純物拡散領域33の表面の一側
の先端領域に連結され、ポリシリコンパターン層37a
の他端は、その領域33に隣り合う不純物拡散領域33
の表面の他側の先端に連結される。すなわち、ポリシリ
コンパターン層37aは、インダクタコア層35を跨い
で隣接する不純物拡散領域33に連結されている。
クタコア層に拡散層及びポリシリコン層がコイル状に巻
かれて、フィールド酸化マスクの形状を適宜設定するこ
とにより充分に同一の基板上にインダクタを形成するこ
とができる。
域のトランジスタを形成する工程と別途に進行せず、互
いに連係して進行する。
インダクタ製造方法は以下のような効果がある。
なMOS、バイポーラトランジスタの製造工程に容易な
追加工程で形成できるため、インダクタをチップの外部
に構成せずに、MOSキャパシタと同一の基板上に構成
することができる。このため、実際に量産に適用して使
用することができ、製造費用の節減、集積回路から構成
されるボードのサイズを減少させることができるという
効果がある。
拡散領域を同一の幅にするため、インダクタンスのサイ
ズを容易に調節することができ、後続工程でインダクタ
コイル層を容易に形成することができる効果がある。
で形成された不純物拡散層を連結する工程で、ポリシリ
コン層が露出された不純物拡散領域に正確にコンタクト
されるようにして、インダクタコア層に巻かれる形状の
インダクタコイル層を容易に形成する効果がある。
ア層に拡散層及びポリシリコン層がコイル状に巻かれる
構造になって、高性能のインダクタンスを具現すること
ができる効果がある。
び構造断面図。
ンダクタの工程断面図及び平面構成図。
ンダクタの工程断面図及び平面構成図。
ンダクタの工程断面図及び平面構成図。
ンダクタの工程断面図及び平面構成図。
クタの工程断面図及び平面構成図、B及びCは図4Aの
III −III ’線上の本発明のインダクタの工程断面図及
び平面構成図。
領域 34…窒化膜層 35…インダクタ
コア層 36…第2フォトレジスト 37…ポリシリコ
ン層 37a…ポリシリコンパターン層 38…第3フォト
レジスト 39…インダクタコイル層
Claims (6)
- 【請求項1】 半導体基板の表面内に一定の拡散深さを
有して一定の間隙に分離される不純物拡散領域を形成す
る工程と、 選択酸化工程で前記不純物拡散領域を横切る方向に半導
体基板を選択的に酸化させてインダクタコア層を形成す
る工程と、 前記インダクタコア層を含む全面にポリシリコン層を形
成し、そのポリシリコン層の一部を選択的にパターニン
グして、何れか一つの不純物拡散領域の表面の一側の領
域とそれに隣り合う不純物拡散領域の表面の他側の領域
とにコンタクトされるポリシリコンパターン層を複数個
形成して、全ての不純物拡散領域を前記ポリシリコンパ
ターン層を介して電気的に連結させるインダクタコイル
層を形成する工程と、を備えることを特徴とする半導体
素子のインダクタ製造方法。 - 【請求項2】 それぞれの不純物拡散領域は長軸と短軸
を有する長方形状であり、全ての不純物拡散領域は同じ
形状及びサイズを有するように形成されることを特徴と
する請求項1記載の半導体素子のインダクタ製造方法。 - 【請求項3】 ポリシリコンパターン層は不純物拡散領
域と同じ幅を有し、それぞれの不純物拡散領域の長軸方
向に対して角度を45゜±15゜に振って形成すること
を特徴とする請求項1記載の半導体素子のインダクタ製
造方法。 - 【請求項4】 半導体基板上に酸化膜層、第1フォトレ
ジスト層を順次に形成し、前記第1フォトレジスト層が
選択的に除去されるようにパターニングする工程と、 前記パターニングされた第1フォトレジスト層をマスク
として用いて半導体基板の表面内に不純物拡散領域を形
成する工程と、 前記酸化膜層上に窒化膜層を形成し、その窒化膜層の一
部を選択的に除去した後、酸化工程を施してインダクタ
コア層を形成する工程と、 前記インダクタコア層を含む全面に第2フォトレジスト
層を形成し、その第2フォトレジスト層の一部が選択的
に除去されるように第2のフォトレジストをパターニン
グした後、それぞれの不純物拡散領域の表面が露出する
ようにそのパターニングされた第2フォトレジスト層を
マスクとして用いて酸化膜層の一部を選択的に除去する
工程と、 前記第2フォトレジスト層を除去し、全面に高濃度の不
純物がドープされたポリシリコン層、第3フォトレジス
ト層を順次に形成する工程と、 前記第3フォトレジスト層の一部が選択的に除去される
ようにその第3フォトレジスタをパターニングし、その
パターニングされた第3フォトレジスタをマスクとして
用いて露出されたポリシリコン層の一部を選択的に食刻
してポリシリコンパターン層を形成する工程と、を備え
ることを特徴とする半導体素子のインダクタ製造方法。 - 【請求項5】 第1フォトレジスト層が除去される領域
は、インダクタが形成される全体領域の長さ方向に一定
の間隙に分離された同一のサイズを有する長方形状をな
し、それぞれの除去領域は、インダクタが形成される全
体領域の長さ方向に水平な幅Wよりその長さ方向に直交
する長さLが2倍以上になるようにすることを特徴とす
る請求項4記載の半導体素子のインダクタ製造方法。 - 【請求項6】 それぞれのポリシリコンパターン層は、
インダクタコア層の下側に形成された不純物拡散領域の
うち何れか一つの不純物拡散領域の表面の一側の領域と
それに隣り合う他の不純物拡散領域の表面の反対側の領
域とに連結されるように形成されることを特徴とする請
求項4記載の半導体素子のインダクタ製造方法。
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