JP2897679B2 - ディジタル信号記録装置 - Google Patents
ディジタル信号記録装置Info
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- circuit
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/76—Television signal recording
- H04N5/91—Television signal processing therefor
- H04N5/92—Transformation of the television signal for recording, e.g. modulation, frequency changing; Inverse transformation for playback
- H04N5/926—Transformation of the television signal for recording, e.g. modulation, frequency changing; Inverse transformation for playback by pulse code modulation
- H04N5/9261—Transformation of the television signal for recording, e.g. modulation, frequency changing; Inverse transformation for playback by pulse code modulation involving data reduction
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
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-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/18—Error detection or correction; Testing, e.g. of drop-outs
- G11B20/1833—Error detection or correction; Testing, e.g. of drop-outs by adding special lists or symbols to the coded information
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- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Multimedia (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
- Television Signal Processing For Recording (AREA)
- Digital Magnetic Recording (AREA)
Description
【０００１】
【産業上の利用分野】本発明は、ディジタル信号を記録
するディジタル信号記録装置に関し、特にパーシャルレ
スポンス検出のためのプリコード処理を行って記録する
記録装置に関するものである。
するディジタル信号記録装置に関し、特にパーシャルレ
スポンス検出のためのプリコード処理を行って記録する
記録装置に関するものである。
【０００２】
【従来の技術】スクランブル処理を行った後にパーシャ
ルレスポンス検出のためのプリコード処理を行って磁気
テープ上にディジタル信号を記録するディジタル信号記
録装置が、特開平４−２１６３０５号に記載されてい
る。
ルレスポンス検出のためのプリコード処理を行って磁気
テープ上にディジタル信号を記録するディジタル信号記
録装置が、特開平４−２１６３０５号に記載されてい
る。
【０００３】
【発明が解決しようとする課題】しかしながら、スクラ
ンブルはブロック単位で固定のパターンを使用している
ため、ディジタル信号が固定、例えば全て０の場合には
スクランブル処理を行ってもブロック単位で固定パター
ンが繰り返すという問題については考慮されていない。
特に、ランレングスの長いパターンが繰り返し発生した
場合には、再生時に誤りが増加してしまう。この問題を
解決する方法としては、ブロックアドレス等を基準とし
てブロック毎に異なるスクランブル処理を行う方法があ
るが、この場合にはブロックアドレスの部分にスクラン
ブルがかけらず、この部分でランレングスの長いパター
ンが発生しやすくなるという問題がある。ブロックアド
レスは、ブロック再生の基準となる信号であり、この情
報に誤りが増加すると、再生時の信頼性が著しく低下す
る。
ンブルはブロック単位で固定のパターンを使用している
ため、ディジタル信号が固定、例えば全て０の場合には
スクランブル処理を行ってもブロック単位で固定パター
ンが繰り返すという問題については考慮されていない。
特に、ランレングスの長いパターンが繰り返し発生した
場合には、再生時に誤りが増加してしまう。この問題を
解決する方法としては、ブロックアドレス等を基準とし
てブロック毎に異なるスクランブル処理を行う方法があ
るが、この場合にはブロックアドレスの部分にスクラン
ブルがかけらず、この部分でランレングスの長いパター
ンが発生しやすくなるという問題がある。ブロックアド
レスは、ブロック再生の基準となる信号であり、この情
報に誤りが増加すると、再生時の信頼性が著しく低下す
る。
【０００４】本発明の目的は、プリコード処理を行った
後に、ランレングスの長いパターンが発生することの少
ない記録装置を提供することにある。
後に、ランレングスの長いパターンが発生することの少
ない記録装置を提供することにある。
【０００５】
【課題を解決するための手段】上記目的は、ディジタル
信号を所定のバイト数に分割し、同期信号、ブロックア
ドレス情報を含む制御情報及び誤り検出訂正符号を付加
してブロック形式とし、パーシャルレスポンス検出のた
めのプリコード処理を行って記録媒体上に記録するディ
ジタル信号記録装置において、ディジタル信号及び誤り
検出訂正符号には制御情報を基準としたスクランブル処
理を行い、制御情報は反転させた後にプリコード処理を
行って記録することにより達成できる。
信号を所定のバイト数に分割し、同期信号、ブロックア
ドレス情報を含む制御情報及び誤り検出訂正符号を付加
してブロック形式とし、パーシャルレスポンス検出のた
めのプリコード処理を行って記録媒体上に記録するディ
ジタル信号記録装置において、ディジタル信号及び誤り
検出訂正符号には制御情報を基準としたスクランブル処
理を行い、制御情報は反転させた後にプリコード処理を
行って記録することにより達成できる。
【０００６】
【作用】ディジタル信号及び誤り検出訂正符号には前記
制御情報を基準としたスクランブル処理を行うことによ
りブロック単位で固定のパターンが繰り返すことを防止
することができ、制御情報は反転させた後にプリコード
処理を行うことにより、プリコード後にランレングスの
長いパターンが発生する可能性を低減することができ
る。
制御情報を基準としたスクランブル処理を行うことによ
りブロック単位で固定のパターンが繰り返すことを防止
することができ、制御情報は反転させた後にプリコード
処理を行うことにより、プリコード後にランレングスの
長いパターンが発生する可能性を低減することができ
る。
【０００７】
【実施例】以下、本発明の実施例を図面を用いて説明す
る。
る。
【０００８】図１は、ディジタル信号記録装置の構成で
ある。１００は回転ヘッド、１０１はキャプスタン、１
０２は記録時の記録信号の生成を行う記録信号処理回
路、１０４は記録モード等の制御を行う、例えば、マイ
クロプロセッサのような制御回路、１０５は回転ヘッド
１００の回転等の基準となるタイミング信号を生成する
タイミング生成回路、１０６は回転ヘッド及びテープの
送り速度を制御するサーボ回路、１０７は記録信号の入
力を行う入力回路、１０９は記録時のタイミングを制御
するタイミング制御回路、１１０は基準クロックを生成
する発振回路、１１１はテープ、１１２は記録信号の変
調回路である。
ある。１００は回転ヘッド、１０１はキャプスタン、１
０２は記録時の記録信号の生成を行う記録信号処理回
路、１０４は記録モード等の制御を行う、例えば、マイ
クロプロセッサのような制御回路、１０５は回転ヘッド
１００の回転等の基準となるタイミング信号を生成する
タイミング生成回路、１０６は回転ヘッド及びテープの
送り速度を制御するサーボ回路、１０７は記録信号の入
力を行う入力回路、１０９は記録時のタイミングを制御
するタイミング制御回路、１１０は基準クロックを生成
する発振回路、１１１はテープ、１１２は記録信号の変
調回路である。
【０００９】入出力端子１０８からパケット形式の記録
データが任意の時間間隔で入力される。入出力端子１０
８より入力されたパケットデータの一部は、入出力回路
１０７を介して制御回路１０４に入力される。制御回路
１０４では、パケットデータに付加されている情報ある
いはパケットデータとは別に送られてきた情報によりパ
ケットデータの種類、最大伝送レート等を検出し、検出
結果によって記録モードを判断し、記録信号処理回路１
０２及びサーボ回路１０６の動作モードを設定する。入
力回路１０７では、記録するパケットデータを検出し、
記録信号処理回路１０２に出力する。記録信号処理回路
１０２では、制御回路１０４で判断された記録モードに
応じて、１トラックに記録するパケット数を判断し、誤
り検出訂正符号等の生成を行い、記録信号を生成し、変
調回路１１２において変調処理を行って回転ヘッド１０
０によりテープ１１１に記録する。
データが任意の時間間隔で入力される。入出力端子１０
８より入力されたパケットデータの一部は、入出力回路
１０７を介して制御回路１０４に入力される。制御回路
１０４では、パケットデータに付加されている情報ある
いはパケットデータとは別に送られてきた情報によりパ
ケットデータの種類、最大伝送レート等を検出し、検出
結果によって記録モードを判断し、記録信号処理回路１
０２及びサーボ回路１０６の動作モードを設定する。入
力回路１０７では、記録するパケットデータを検出し、
記録信号処理回路１０２に出力する。記録信号処理回路
１０２では、制御回路１０４で判断された記録モードに
応じて、１トラックに記録するパケット数を判断し、誤
り検出訂正符号等の生成を行い、記録信号を生成し、変
調回路１１２において変調処理を行って回転ヘッド１０
０によりテープ１１１に記録する。
【００１０】図２は、１トラックの記録パターンであ
る。３は音声信号等の付加情報記録領域、７はディジタ
ル圧縮映像信号を記録するデータ記録領域、１２は時間
情報、プログラム情報等のサブコードを記録するサブコ
ード記録領域、２、６及び１１はそれぞれの記録領域の
プリアンブル、４、８及び１３はそれぞれの記録領域の
ポストアンブル、５及び９はそれぞれの記録領域の間の
ギャップ、１及び１４はトラック端のマージンである。
このように、各記録領域にポストアンブル、プリアンブ
ル及びギャップを設けておくことにより、それぞれの領
域を独立にアフレコを行うことができる。もちろん、記
録領域３及び７にはディジタル圧縮映像信号、音声信号
以外のディジタル信号を記録してもよい。また、領域７
にディジタル圧縮映像信号と共にディジタル圧縮音声信
号を記録してもよい。
る。３は音声信号等の付加情報記録領域、７はディジタ
ル圧縮映像信号を記録するデータ記録領域、１２は時間
情報、プログラム情報等のサブコードを記録するサブコ
ード記録領域、２、６及び１１はそれぞれの記録領域の
プリアンブル、４、８及び１３はそれぞれの記録領域の
ポストアンブル、５及び９はそれぞれの記録領域の間の
ギャップ、１及び１４はトラック端のマージンである。
このように、各記録領域にポストアンブル、プリアンブ
ル及びギャップを設けておくことにより、それぞれの領
域を独立にアフレコを行うことができる。もちろん、記
録領域３及び７にはディジタル圧縮映像信号、音声信号
以外のディジタル信号を記録してもよい。また、領域７
にディジタル圧縮映像信号と共にディジタル圧縮音声信
号を記録してもよい。
【００１１】図３は各領域のブロック構成である。図２
（ａ）は、付加情報記録領域３及びデータ記録領域７の
ブロック構成である。２０は同期信号、２１はＩＤ情
報、２２はデータ、２３は第１の誤り検出訂正のための
パリティ（Ｃ１パリティ）である。例えば、同期信号２
０は２バイト、ＩＤ情報２１は３バイト、データ２２は
９９バイト、パリティ２３は８バイトで構成されてお
り、１ブロックは１１２バイトで構成されている。図２
（ｂ）は、サブコード記録領域１２のブロック構成であ
る。サブコード記録領域のブロックでは、同期信号２０
及びＩＤ情報２１は図２（ａ）と同一にし、データ２２
は１９バイト、パリティ２３は４バイトで構成されてお
り、１ブロックは図２（ａ）のブロックの１／４の２８
バイトで構成されている。このように、１ブロックのバ
イト数も整数比となるようにし、さらに全ての領域で同
期信号１１及びＩＤ情報１２の構成を同一とすることに
より、記録時のブロックの生成及び記録時の同期信号、
ＩＤ情報の検出等の処理を同一の回路で処理することが
できる。
（ａ）は、付加情報記録領域３及びデータ記録領域７の
ブロック構成である。２０は同期信号、２１はＩＤ情
報、２２はデータ、２３は第１の誤り検出訂正のための
パリティ（Ｃ１パリティ）である。例えば、同期信号２
０は２バイト、ＩＤ情報２１は３バイト、データ２２は
９９バイト、パリティ２３は８バイトで構成されてお
り、１ブロックは１１２バイトで構成されている。図２
（ｂ）は、サブコード記録領域１２のブロック構成であ
る。サブコード記録領域のブロックでは、同期信号２０
及びＩＤ情報２１は図２（ａ）と同一にし、データ２２
は１９バイト、パリティ２３は４バイトで構成されてお
り、１ブロックは図２（ａ）のブロックの１／４の２８
バイトで構成されている。このように、１ブロックのバ
イト数も整数比となるようにし、さらに全ての領域で同
期信号１１及びＩＤ情報１２の構成を同一とすることに
より、記録時のブロックの生成及び記録時の同期信号、
ＩＤ情報の検出等の処理を同一の回路で処理することが
できる。
【００１２】図４は、ＩＤ情報２１の構成である。３１
はシーケンス番号、３２はトラックアドレス、３３は１
トラック内のブロックアドレス、３５はシーケンス番号
３１、トラックアドレス３２及びブロックアドレス３３
の誤りを検出するためのパリティである。ブロックアド
レス３３は、各記録領域でのブロックの識別を行うため
のアドレスである。例えば、データ記録領域７では０〜
３３５、付加情報記録領域３では０〜１３、サブコード
記録領域１２では０〜１５とする。トラックアドレス３
２は、トラックの識別を行うためのアドレスであり、例
えば、１トラックまたは２トラック単位でアドレスを変
化させ、０〜５または０〜２とすることにより、６トラ
ックを識別することができる。シーケンス番号３１は、
例えば、トラックアドレス３２で識別する６トラック単
位で変化させ、０〜１１とすることにより、７２トラッ
クを識別することができる。トラックアドレスは、後述
する第２の誤り訂正符号の周期、と同期させておけば、
記録時の処理及び再生時の識別を容易にすることができ
る。
はシーケンス番号、３２はトラックアドレス、３３は１
トラック内のブロックアドレス、３５はシーケンス番号
３１、トラックアドレス３２及びブロックアドレス３３
の誤りを検出するためのパリティである。ブロックアド
レス３３は、各記録領域でのブロックの識別を行うため
のアドレスである。例えば、データ記録領域７では０〜
３３５、付加情報記録領域３では０〜１３、サブコード
記録領域１２では０〜１５とする。トラックアドレス３
２は、トラックの識別を行うためのアドレスであり、例
えば、１トラックまたは２トラック単位でアドレスを変
化させ、０〜５または０〜２とすることにより、６トラ
ックを識別することができる。シーケンス番号３１は、
例えば、トラックアドレス３２で識別する６トラック単
位で変化させ、０〜１１とすることにより、７２トラッ
クを識別することができる。トラックアドレスは、後述
する第２の誤り訂正符号の周期、と同期させておけば、
記録時の処理及び再生時の識別を容易にすることができ
る。
【００１３】図５は、データ記録領域７における１トラ
ックのデータの構成である。なお、同期信号２０および
ＩＤ情報２１は省略している。データ記録領域７は、例
えば、３３６ブロックで構成されており、最初の３０６
ブロックにデータ４１を、次の３０ブロックに第２の誤
り訂正符号（Ｃ２パリティ）４３を記録する。
ックのデータの構成である。なお、同期信号２０および
ＩＤ情報２１は省略している。データ記録領域７は、例
えば、３３６ブロックで構成されており、最初の３０６
ブロックにデータ４１を、次の３０ブロックに第２の誤
り訂正符号（Ｃ２パリティ）４３を記録する。
【００１４】Ｃ２パリティ４３は、例えば、６トラック
単位で、３０６ブロック×６トラックのデータを１８分
割し、それぞれの１０２ブロックに１０ブロックのＣ２
パリティを付加する。誤り訂正符号は、例えばリードソ
ロモン符号を用いればよい。
単位で、３０６ブロック×６トラックのデータを１８分
割し、それぞれの１０２ブロックに１０ブロックのＣ２
パリティを付加する。誤り訂正符号は、例えばリードソ
ロモン符号を用いればよい。
【００１５】各ブロック９９バイトのデータは、３バイ
トのヘッダ４４と９６バイトのデータ４１により構成さ
れている。
トのヘッダ４４と９６バイトのデータ４１により構成さ
れている。
【００１６】図６は、変調回路１１２の構成である。３
００はプリコード回路、３０１は反転回路、３０２は切
換回路、３０３はスクランブル回路、３０４はＩＤ信号
生成回路２１の、３０５は同期信号２０の生成回路であ
る。入力端子３０６より入力されたデータ２２及びＣ１
パリティ２３は、スクランブル回路３０３によりスクラ
ンブル処理が行われた後に切換回路３０２に入力され
る。切換回路３０２では、入力端子３０７より入力され
たタイミング生成回路１０５で生成された所定のタイミ
ングによってスクランブル回路３０３の出力、ＩＤ信号
生成回路３０４で生成されたＩＤ信号及び同期信号生成
回路３０５で生成された同期信号を切り換えて出力する
ことにより図３のブロック形式の信号を生成する。ブロ
ック形式の信号は、反転回路３０１において、ＩＤ信号
の反転が行われた後にプリコード回路３００でプリコー
ド処理が行われ、出力端子３０８より出力されて回転ヘ
ッド１００により記録される。
００はプリコード回路、３０１は反転回路、３０２は切
換回路、３０３はスクランブル回路、３０４はＩＤ信号
生成回路２１の、３０５は同期信号２０の生成回路であ
る。入力端子３０６より入力されたデータ２２及びＣ１
パリティ２３は、スクランブル回路３０３によりスクラ
ンブル処理が行われた後に切換回路３０２に入力され
る。切換回路３０２では、入力端子３０７より入力され
たタイミング生成回路１０５で生成された所定のタイミ
ングによってスクランブル回路３０３の出力、ＩＤ信号
生成回路３０４で生成されたＩＤ信号及び同期信号生成
回路３０５で生成された同期信号を切り換えて出力する
ことにより図３のブロック形式の信号を生成する。ブロ
ック形式の信号は、反転回路３０１において、ＩＤ信号
の反転が行われた後にプリコード回路３００でプリコー
ド処理が行われ、出力端子３０８より出力されて回転ヘ
ッド１００により記録される。
【００１７】図７は、スクランブル回路３０３の構成で
ある。３１０は排他的論理和回路、３１１は例えばＭ系
列信号のような乱数の発生回路である。スクランブル処
理は、ＩＤ信号生成回路２１で生成されたブロックアド
レス３３やトラックアドレス３３を初期値として発生さ
れた乱数をデータ２２及びＣ１パリティ２３に加えるこ
とにより、ディジタル信号が固定、例えば全て０の場合
にもブロック単位で固定パターンが繰り返すことを防止
することができる。
ある。３１０は排他的論理和回路、３１１は例えばＭ系
列信号のような乱数の発生回路である。スクランブル処
理は、ＩＤ信号生成回路２１で生成されたブロックアド
レス３３やトラックアドレス３３を初期値として発生さ
れた乱数をデータ２２及びＣ１パリティ２３に加えるこ
とにより、ディジタル信号が固定、例えば全て０の場合
にもブロック単位で固定パターンが繰り返すことを防止
することができる。
【００１８】図８は、プリコード回路３００の構成であ
る。３２０は１ビットの遅延回路である。プリコード処
理は、２ビット遅延した信号との排他的論理和をとるこ
とにより行われる。したがって、遅延回路３２０の値が
両方とも０の時に入力データが０の連続の場合には、出
力も０の連続となる。一方、入力に１があれば、必ず出
力は反転する。例えば、入力が１の連続の場合には、出
力は１１００の繰り返しとなる。
る。３２０は１ビットの遅延回路である。プリコード処
理は、２ビット遅延した信号との排他的論理和をとるこ
とにより行われる。したがって、遅延回路３２０の値が
両方とも０の時に入力データが０の連続の場合には、出
力も０の連続となる。一方、入力に１があれば、必ず出
力は反転する。例えば、入力が１の連続の場合には、出
力は１１００の繰り返しとなる。
【００１９】ＩＤ信号２１はスクランブル処理が行われ
ない。したがって、シーケンスの先頭では、全て０とな
る。パリティ３５として単純パリティを用いた場合には
２４ビットの０の連続、パリティ３５に特殊なものを用
いた場合でも１６ビットの０の連続となる。また、シー
ケンス番号３１が０でない場合でも、トラックアドレス
３２やブロックアドレス３３は周期的に０となる。一
方、前述のように、シーケンス番号３１、トラックアド
レス３２及びブロックアドレス３３をフルに使わなけれ
ば、全てのビットが１になることはない。したがって、
ＩＤ信号をそのままプリコード処理した場合には、遅延
回路３２０の値によって最大２４ビットのランレングス
が記録信号中に発生する可能性があるが、ＩＤ信号を反
転した後にプリコード処理を行えば、このような長いラ
ンレングスが発生することはない。もちろん、ＩＤ信号
以外のスクランブル処理された信号もどうように反転し
た後にプリコード処理を行って記録してもよい。
ない。したがって、シーケンスの先頭では、全て０とな
る。パリティ３５として単純パリティを用いた場合には
２４ビットの０の連続、パリティ３５に特殊なものを用
いた場合でも１６ビットの０の連続となる。また、シー
ケンス番号３１が０でない場合でも、トラックアドレス
３２やブロックアドレス３３は周期的に０となる。一
方、前述のように、シーケンス番号３１、トラックアド
レス３２及びブロックアドレス３３をフルに使わなけれ
ば、全てのビットが１になることはない。したがって、
ＩＤ信号をそのままプリコード処理した場合には、遅延
回路３２０の値によって最大２４ビットのランレングス
が記録信号中に発生する可能性があるが、ＩＤ信号を反
転した後にプリコード処理を行えば、このような長いラ
ンレングスが発生することはない。もちろん、ＩＤ信号
以外のスクランブル処理された信号もどうように反転し
た後にプリコード処理を行って記録してもよい。
【００２０】
【発明の効果】本発明によれば、スクランブル処理を行
わない情報は反転させた後にプリコード処理を行うこと
により、記録信号中にランレングスの長いパターンが発
生する可能性を低減することができる。
わない情報は反転させた後にプリコード処理を行うこと
により、記録信号中にランレングスの長いパターンが発
生する可能性を低減することができる。
【図１】ディジタル信号記録装置の構成図である。
【図２】１トラックの記録パターン図である。
【図３】各領域のブロック構成図である。
【図４】ＩＤ情報２１の構成図である。
【図５】データ記録領域７における１トラックのデータ
の構成図である。
の構成図である。
【図６】変調回路１１２の構成図である。
【図７】スクランブル回路３０３の構成図である。
【図８】プリコード回路３００の構成図である。
７…データ記録領域、２０…同期信号、２１…ＩＤ情
報、２２…データ、２３…Ｃ１パリティ、１００…回転
ヘッド、１０２…記録信号処理回路、１０４…制御回
路、１０５…タイミング生成回路、１０６…サーボ回
路、１０７…入力回路、１０９…タイミング制御回路、
１１０…発振回路、１１２…変調回路、３００…プリコ
ード回路、３０１…反転回路、３０２…切換回路、３０
３…スクランブル回路、３０４…ＩＤ信号生成回路、３
０５…同期信号生成回路、３１０…排他的論理和回路、
３１１…乱数発生回路、３２０遅延回路。
報、２２…データ、２３…Ｃ１パリティ、１００…回転
ヘッド、１０２…記録信号処理回路、１０４…制御回
路、１０５…タイミング生成回路、１０６…サーボ回
路、１０７…入力回路、１０９…タイミング制御回路、
１１０…発振回路、１１２…変調回路、３００…プリコ
ード回路、３０１…反転回路、３０２…切換回路、３０
３…スクランブル回路、３０４…ＩＤ信号生成回路、３
０５…同期信号生成回路、３１０…排他的論理和回路、
３１１…乱数発生回路、３２０遅延回路。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 尾鷲 仁朗 茨城県ひたちなか市稲田1410番地株式会 社日立製作所パーソナルメディア機器事 業部内 (72)発明者 野口 敬治 茨城県ひたちなか市稲田1410番地株式会 社日立製作所パーソナルメディア機器事 業部内 (58)調査した分野(Int.Cl.6，ＤＢ名) G11B 20/10 G11B 20/12
Claims (3)
- 【請求項１】ディジタル信号を所定のバイト数に分割
し、同期信号、ブロックアドレス情報を含む制御情報及
び誤り検出訂正符号を付加してブロック形式とし、パー
シャルレスポンス検出のためのプリコード処理を行って
記録媒体上に記録するディジタル信号記録装置におい
て、前記制御情報を反転させた後に前記プリコード処理
を行って記録する記録手段を設けたことを特徴とするデ
ィジタル信号記録装置。 - 【請求項２】 前記記録手段は、前記ディジタル信号及び
前記誤り検出訂正符号にスクランブル処理を行って記録
する請求項１記載のディジタル信号記録装置。 - 【請求項３】 前記スクランブルのパターンは、前記制御
情報または制御情報の一部の値が初期値として発生され
ている請求項２記載のディジタル信号記録装置。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7069141A JP2897679B2 (ja) | 1995-03-28 | 1995-03-28 | ディジタル信号記録装置 |
| US08/620,687 US5815331A (en) | 1995-03-28 | 1996-03-21 | Digital signal recording method and apparatus involving precode processing for partial response detection |
| EP96104729A EP0735536B1 (en) | 1995-03-28 | 1996-03-25 | Digital signal recording method and apparatus |
| DE69611564T DE69611564T2 (de) | 1995-03-28 | 1996-03-25 | Verfahren und Gerät zur Aufnahme von Digitalsignalen |
| KR1019960008487A KR100204722B1 (ko) | 1995-03-28 | 1996-03-27 | 디지탈신호기록방법 및 장치 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7069141A JP2897679B2 (ja) | 1995-03-28 | 1995-03-28 | ディジタル信号記録装置 |
Publications (2)
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