JP2686909B2 - 半導体集積回路 - Google Patents
半導体集積回路Info
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Description
【0001】
【産業上の利用分野】本発明は、半導体集積回路の構造
の改良に関する発明である。
の改良に関する発明である。
【0002】
【従来の技術】従来の半導体集積回路は、1個の半導体
にシリコンチップが1枚のみ存在する構造である。
にシリコンチップが1枚のみ存在する構造である。
【0003】
【発明が解決しようとする課題】しかしながら、従来の
半導体技術では、電子ビーム、X線等でシリコンチップ
上にパターンを描いたとしても、限界があるために超L
SI以上の半導体を作ることが無理であった。また、現
在開発中であるLSIの立体化(3次元)は大量生産に
対応できない。更に、従来のような1枚のシリコンチッ
プの構造の半導体集積回路では、容量が少ないとの欠点
があった。
半導体技術では、電子ビーム、X線等でシリコンチップ
上にパターンを描いたとしても、限界があるために超L
SI以上の半導体を作ることが無理であった。また、現
在開発中であるLSIの立体化(3次元)は大量生産に
対応できない。更に、従来のような1枚のシリコンチッ
プの構造の半導体集積回路では、容量が少ないとの欠点
があった。
【0004】本発明は、上記の課題を解決するるため
に、従来の半導体集積回路に比し、超LSI以上に容量
が大きく、しかも一気にハンダ付けでき、今までのハン
ダ付機でも対応可能となり、大量生産に対応可能となる
半導体集積回路を提供することを目的とするものであ
る。
に、従来の半導体集積回路に比し、超LSI以上に容量
が大きく、しかも一気にハンダ付けでき、今までのハン
ダ付機でも対応可能となり、大量生産に対応可能となる
半導体集積回路を提供することを目的とするものであ
る。
【0005】
【課題を解決するための手段】本発明は、表面に突出部
を形成した下シリコンチップ上に、表面及び裏面に嵌合
溝が形成されているとともに前記下シリコンチップより
小さく形成された絶縁体を、前記下シリコンチップに形
成されている突出部を前記絶縁体の裏面に形成されてい
る嵌合溝に嵌合させて固定し、前記絶縁体上に前記絶縁
体より小さく形成された上シリコンチップの下面に形成
されている突出部を前記絶縁体の表面に形成されている
嵌合溝に嵌合させ固定し、前記上シリコンチップと下シ
リコンチップをリード線により接続したことを特徴とす
る半導体集積回路の構成とした。
を形成した下シリコンチップ上に、表面及び裏面に嵌合
溝が形成されているとともに前記下シリコンチップより
小さく形成された絶縁体を、前記下シリコンチップに形
成されている突出部を前記絶縁体の裏面に形成されてい
る嵌合溝に嵌合させて固定し、前記絶縁体上に前記絶縁
体より小さく形成された上シリコンチップの下面に形成
されている突出部を前記絶縁体の表面に形成されている
嵌合溝に嵌合させ固定し、前記上シリコンチップと下シ
リコンチップをリード線により接続したことを特徴とす
る半導体集積回路の構成とした。
【0006】
【実施例】次に、本発明について図面を参照して説明す
る。図1は本発明である半導体集積回路のキャップを取
り外した状態の平面図、図2は本発明である半導体集積
回路のキャップの一部を切り欠いた斜視図である。図1
に示すように、本願発明である半導体集積回路1では、
キャップ8内に収納されている絶縁体3は、下シリコン
チップ4より両端が小さく形成されているとともに、上
シリコンチップ2は前記絶縁体3より両端が小さく形成
されている。よって、上シリコンチップ2と絶縁体3と
下シリコンチップ4との間には段差が形成されている。
る。図1は本発明である半導体集積回路のキャップを取
り外した状態の平面図、図2は本発明である半導体集積
回路のキャップの一部を切り欠いた斜視図である。図1
に示すように、本願発明である半導体集積回路1では、
キャップ8内に収納されている絶縁体3は、下シリコン
チップ4より両端が小さく形成されているとともに、上
シリコンチップ2は前記絶縁体3より両端が小さく形成
されている。よって、上シリコンチップ2と絶縁体3と
下シリコンチップ4との間には段差が形成されている。
【0007】符号1は、半導体集積回路を示し、この半
導体集積回路1はの構造は、前記図1及び図2に示すよ
うに、載置板5上には下シリコンチップ4を、前記下シ
リコンチップ4上には絶縁体3を、前記絶縁体3上には
上シリコンチップ2を固定する。
導体集積回路1はの構造は、前記図1及び図2に示すよ
うに、載置板5上には下シリコンチップ4を、前記下シ
リコンチップ4上には絶縁体3を、前記絶縁体3上には
上シリコンチップ2を固定する。
【0008】そして、上シリコンチップ2と下シリコン
チップ4とをリード線6、6、6、6・・により接続さ
せると共に、上シリコンチップ2とリード脚7、7、
7、7・・・とをリード線6、6、6、6・・・により
接続する。
チップ4とをリード線6、6、6、6・・により接続さ
せると共に、上シリコンチップ2とリード脚7、7、
7、7・・・とをリード線6、6、6、6・・・により
接続する。
【0009】上シリコンチップ2は、絶縁体3の長さよ
りやや短く形成し、絶縁体3の長さは下シリコンチップ
4よりやや短く形成する。このように、上シリコンチッ
プ2と下シリコンチップ3がリード線6、6、6、6・
・・により接続されると共に、上シリコンチップ2とリ
ード脚が接続された後にキャップ8を取り付ける。
りやや短く形成し、絶縁体3の長さは下シリコンチップ
4よりやや短く形成する。このように、上シリコンチッ
プ2と下シリコンチップ3がリード線6、6、6、6・
・・により接続されると共に、上シリコンチップ2とリ
ード脚が接続された後にキャップ8を取り付ける。
【0010】上シリコンチップ2と下シリコンチップ4
間に設けられた絶縁体3の素材としては合成樹脂を使用
したものが良いが、必ずしも合成樹脂に限定されるもの
ではなく、その他の素材を絶縁体としてもよい。
間に設けられた絶縁体3の素材としては合成樹脂を使用
したものが良いが、必ずしも合成樹脂に限定されるもの
ではなく、その他の素材を絶縁体としてもよい。
【0011】図3は本発明である半導体集積回路の一部
を切り欠いた一部縦断面図、図4は本発明である半導体
集積回路の一部拡大縦断面図である。
を切り欠いた一部縦断面図、図4は本発明である半導体
集積回路の一部拡大縦断面図である。
【0012】図3及び図4に示すように、上シリコンチ
ップ2の下面には、突出部2aが形成され、絶縁体3の
表面には前記突出部2が嵌合可能な嵌合溝3bが形成さ
れている。前記突出部2aが前記嵌合溝3bに嵌合させ
ることにより絶縁体3上の上シリコンチップ2がズレる
ことがなくなる。
ップ2の下面には、突出部2aが形成され、絶縁体3の
表面には前記突出部2が嵌合可能な嵌合溝3bが形成さ
れている。前記突出部2aが前記嵌合溝3bに嵌合させ
ることにより絶縁体3上の上シリコンチップ2がズレる
ことがなくなる。
【0013】同様に、絶縁体3の裏面には嵌合溝3aが
形成され、下シリコンチップ4の表面には、前記嵌合溝
3aに嵌合可能な突出部4aが形成されていて、突出部
4aが嵌合溝3aに嵌合することにより下シリコンチッ
プ4と絶縁体3がズレることがない。即ち、振動しても
上シリコンチップ2と絶縁体3と下シリコンチップ4が
ズレることがなくなるのである。
形成され、下シリコンチップ4の表面には、前記嵌合溝
3aに嵌合可能な突出部4aが形成されていて、突出部
4aが嵌合溝3aに嵌合することにより下シリコンチッ
プ4と絶縁体3がズレることがない。即ち、振動しても
上シリコンチップ2と絶縁体3と下シリコンチップ4が
ズレることがなくなるのである。
【0014】
【発明の効果】以上説明したように、上シリコンチップ
と下シリコンチップの間に絶縁体を設け、前記上シリコ
ンチップと下シリコンチップをリード線により接続した
構成であるので、従来の半導体回路に比較し、容量を大
幅に増加させることができるとの効果がある。また、上
シリコンチップと絶縁体と下シリコンチップにズレが生
じることがないので、故障することがなく長時間使用す
ることができるとの効果がある。
と下シリコンチップの間に絶縁体を設け、前記上シリコ
ンチップと下シリコンチップをリード線により接続した
構成であるので、従来の半導体回路に比較し、容量を大
幅に増加させることができるとの効果がある。また、上
シリコンチップと絶縁体と下シリコンチップにズレが生
じることがないので、故障することがなく長時間使用す
ることができるとの効果がある。
【図1】本発明である半導体集積回路のキャップを取り
外した状態の平面図である。
外した状態の平面図である。
【図2】本発明である半導体集積回路のキャップの一部
を切り欠いた斜視図である。
を切り欠いた斜視図である。
【図3】本発明である半導体集積回路の一部を切り欠い
た一部縦断面図である。
た一部縦断面図である。
【図4】本発明である半導体集積回路の一部拡大縦断面
図である。
図である。
1 半導体集積回路 2 上シリコンチップ 2a 突出部 3 絶縁体 3a 嵌合溝 3b 嵌合溝 4 下シリコンチップ 4a 突出部 5 載置板 6 リード線 7 リード脚 8 キャップ
Claims (1)
- 【請求項1】 表面に突出部を形成した下シリコンチッ
プ上に、表面及び裏面に嵌合溝が形成されているととも
に前記下シリコンチップより小さく形成された絶縁体
を、前記下シリコンチップに形成されている突出部を前
記絶縁体の裏面に形成されている嵌合溝に嵌合させて固
定し、前記絶縁体上に前記絶縁体より小さく形成された
上シリコンチップの下面に形成されている突出部を前記
絶縁体の表面に形成されている嵌合溝に嵌合させ固定
し、前記上シリコンチップと下シリコンチップをリード
線により接続したことを特徴とする半導体集積回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6031931A JP2686909B2 (ja) | 1994-02-03 | 1994-02-03 | 半導体集積回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6031931A JP2686909B2 (ja) | 1994-02-03 | 1994-02-03 | 半導体集積回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH06209072A JPH06209072A (ja) | 1994-07-26 |
JP2686909B2 true JP2686909B2 (ja) | 1997-12-08 |
Family
ID=12344724
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP6031931A Expired - Fee Related JP2686909B2 (ja) | 1994-02-03 | 1994-02-03 | 半導体集積回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2686909B2 (ja) |
Family Cites Families (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS61123544U (ja) * | 1985-01-23 | 1986-08-04 | ||
JP2918574B2 (ja) * | 1989-09-29 | 1999-07-12 | 株式会社日立製作所 | 半導体装置 |
-
1994
- 1994-02-03 JP JP6031931A patent/JP2686909B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JPH06209072A (ja) | 1994-07-26 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
LAPS | Cancellation because of no payment of annual fees |