JP2666588B2 - 半導体装置 - Google Patents

半導体装置

Info

Publication number
JP2666588B2
JP2666588B2 JP3053607A JP5360791A JP2666588B2 JP 2666588 B2 JP2666588 B2 JP 2666588B2 JP 3053607 A JP3053607 A JP 3053607A JP 5360791 A JP5360791 A JP 5360791A JP 2666588 B2 JP2666588 B2 JP 2666588B2
Authority
JP
Japan
Prior art keywords
integrated circuit
metal plate
circuit element
semiconductor device
ceramic base
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP3053607A
Other languages
English (en)
Other versions
JPH04273153A (ja
Inventor
昭二 橋詰
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP3053607A priority Critical patent/JP2666588B2/ja
Publication of JPH04273153A publication Critical patent/JPH04273153A/ja
Application granted granted Critical
Publication of JP2666588B2 publication Critical patent/JP2666588B2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/48227Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/49Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • H01L2224/491Disposition
    • H01L2224/49105Connecting at different heights
    • H01L2224/49109Connecting at different heights outside the semiconductor or solid-state body

Landscapes

  • Wire Bonding (AREA)
  • Lead Frames For Integrated Circuits (AREA)

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は集積回路素子を搭載した
半導体装置に関し、特に高周波で使用される複数の接地
用電極を有する集積回路素子を搭載した半導体装置に関
する。
【0002】
【従来の技術】従来の高周波用集積回路素子を搭載して
なる半導体装置の一例として、例えば図3に示すものが
ある。ここで、図3(a)はキャップ封止を行っていな
い半導体装置の上面図、同図(b)は(a)のC−C線
に沿う縦断面図、同図(c)は底面図である。これらの
図において、セラミック基台1の上面には集積回路素子
6がAu−Sn合金又は、Agペースト等のソルダ(図
示せず)により、マウント固着されている。又、セラミ
ック基台1に設けたメタライズパターン2により電極部
2aと接地部2bが形成され、これらと集積回路素子6
の電極(図示せず)とがAu,Al等からなる金属細線
7a,7bで接続されている。尚、7aは信号又は電源
用金属細線、7bは接地用金属細線である。前記メタラ
イズパターン2は導出用スルーホール3を介して底面に
まで延長され、外部導出リード4にAg−Cu合金等の
ロウ材5によりロウ接されている。
【0003】又、内部に搭載した集積回路素子6を環境
保護する目的で、ロウ接用メタライズパターンが施され
たアルミナセラミック又は、金属材料等からなるキャッ
プ10をAu−Sn合金等のロウ材11によりセラミッ
ク基台1上にロウ接封止されている。
【0004】
【発明が解決しようとする課題】この従来の半導体装置
では、セラミック基台1の上面に集積回路素子6が搭載
され、かつこれと同一平面上に設けたメタライズパター
ン2の電極部2aと接地部2bに夫々金属細線7a,7
bが接続されているために、特に接地用の金属細線7b
が長くなり、半導体装置における接地インダクタンスが
大きくなるという問題を有していた。これは、高周波
(周波数:900MHZ 以上)にて動作させるFETの多
段構成の増幅用集積回路素子を搭載した半導体装置で
は、接地インダクタンスが大きいために利得を大きく取
ることができないといった問題となる。
【0005】又、接地用の金属細線7bは集積回路素子
6の近傍に設けたメタライズパターン2の接地部2bに
接続されるが、集積回路素子6をマウント固着するソル
ダ(AgペーストあるいはAu−Snロウ材等)の広が
りにより、ソルダが接地部2bに到達され易く、この場
合には金属細線7bが接続できなくなり、或いは接続が
不十分となり、半導体装置の使用環境、特に、振動環境
下においてオープン不良となり易い等の問題を有してい
た。本発明の目的は接地用の金属細線の短縮化を図り、
かつ金属細線の接続不良を解消した半導体装置を提供す
ることにある。
【0006】
【課題を解決するための手段】本発明の半導体装置は、
集積回路素子を搭載し、かつメタライズパターンを形成
したセラミック基台の上面に、集積回路素子に近接して
その表面が集積回路素子の表面とほぼ同じ高さにされた
中実構造の接地用金属板を形成し、この接地用金属板と
集積回路素子の接地端子とを接地用の金属細線で接続し
た構成とする。又、接地用金属板に凹形状加工部を設
け、この凹形状加工部を跨ぐように集積回路素子とメタ
ライズパターンとを接続する信号又は電源用の金属細線
を延設する。
【0007】
【作用】本発明によれば、接地用金属細線を短くして接
地インダクタンスを低減できる。又、集積回路素子と接
地用金属板の表面がほぼ同じ高さにされているので、
号又は電源用金属細線が接地用金属板に接触することを
防止し、この金属細線の短縮化も実現できる。さらに、
接地用金属板が中実構造であるため、ロウ材の流動が接
地用金属板によって阻止される。
【0008】
【実施例】次に、本発明について図面を参照して説明す
る。図1は本発明の一実施例を示し、同図(a)はキャ
ップ封止前の半導体装置の上面図、同図(b)は(a)
のA−A線に沿う縦断面図である。これらの図におい
て、1はセラミック基台であり、その上面,側面及び底
面に施されたメタライズパターン2と導出用スルーホー
ル3を介して外部導出リード4がロウ材5によりロウ接
けされている。又、半導体装置内部には集積回路素子6
がマウント固着され、信号又は電源用の金属細線7aに
より前記メタライズパターン2の一部で構成された電極
部2aに接続されている。
【0009】前記セラミック基台1の上面には前記メタ
ライズパターン2を包囲するように接地用金属板8が設
けられ、その外周部は封止用金属板9として構成され
る。そして、この接地用金属板8には前記集積回路素子
6の接地端子と接続するための接地用の金属細線7bが
接続される。尚、これら接地用金属板8と封止用金属板
9とはAg−Cu合金等からなり、前記セラミック基台
1に形成されたメタライズパターン2の電極以外の部分
で構成される接地部2bの上にロウ接されており、図1
(b)から判るようにその表面が集積回路素子6の表面
とほぼ同じ高さになるような板厚の中実構造の板材から
形成されている。更に、図に破線で示すキャップ10は
ロウ材11により封止用金属板9に固着され、集積回路
素子6を気密封止している。
【0010】したがって、この構成によれば、集積回路
素子6とメタライズパターン2の電極部2aとの間に接
地用金属板8が配設され、かつこの接地用金属板8の表
面高さは電極部2aの表面高さよりも高いため、集積回
路素子6と接地用金属板8とを接続する金属細線7bの
長さを短くすることができる。これにより、接地インダ
クタンスを小さくすることができる。因みに、本発明者
による測定結果では、接地用金属板8を設けたことによ
り、これが無い場合に比べて接地インダクタンスを 1/2
〜 1/3に低減することができた。
【0011】又、接地用金属板8と封止用金属板9とを
一体構造とすることで、多数端子の接地が必要な高周波
集積回路素子においても、接地用金属板8の位置ずれを
少なくできる。更に、集積回路素子6をマウント固着す
る時用いられるロウ材(Au−Sn合金,Agペースト
等)は、接地用金属板8を厚く形成していることによ
り、接地用金属板8の外側に迄はみ出すことがなく、電
極部2aにおける金属細線7aのボンディング不良やル
ーズコンタクトによるオープン不良等を防止することも
可能となる。
【0012】図2は本発明の他の実施例を示し、同図
(a)はキャップ封止前の半導体装置の上面図、同図
(b)は(a)のB−B線に沿う縦断面図である。尚、
図1の実施例と等価な部分には同一符号を付してある。
この実施例では、接地用金属板8の複数箇所に凹形状加
工部12(図2(a)に斜線で示す領域)を形成し、こ
の凹形状加工部12をまたぐように電極部2aと集積回
路素子6を接続する信号又は電源用の金属細線7aを延
設している。この凹形状加工部12の加工方法として
は、エッチング法による片面マスキングによるハーフエ
ッチング方法と、プレス加工によるコイニング加工方法
ならびに切削加工方法等が有る。
【0013】この実施例においても、集積回路素子6の
周囲に接地用金属板8を配設することで接地用の金属細
線7bの長さを短くし、接地インダクタンスを低減する
ことができる。又、これに加えて、接地用金属板8に凹
形状加工部12を設けることで、信号又は電源用の金属
細線7aが接地用金属板8の角部と接触することが防止
でき、しかも金属細線の細径化によるコスト低減が図れ
るとともに、金属細線を短くして半導体装置の外形小型
化も実現できる。
【0014】
【発明の効果】以上説明したように本発明の半導体装置
は、セラミック基台の上面に接地用金属板を設け、この
接地用金属板上に接地用の金属細線を接続しているの
で、接地用金属板の板厚さに相当する分金属細線の長さ
を短くすることができ、接地インダクタンスを低減し、
高周波増幅用半導体装置の利得を大幅に改善することが
可能となる。特に、接地用金属板の表面は集積回路素子
の表面とほぼ同じ高さの中実構造に形成されていること
により、前記金属細線の長さを極めて短くすることがで
き、さらに集積回路素子を搭載するロウ材の流動を阻止
する。又、接地用金属板に凹形状加工部を設け、ここに
信号又は電源用の金属細線を延設することで、この金属
細線と接地用金属板との接触を防止し、この金属細線の
短縮化を図り、半導体装置の小型化を実現することもで
きる。
【図面の簡単な説明】
【図1】本発明の一実施例を示し、(a)は平面図、
(b)は(a)のA−A線に沿う縦断面図である。
【図2】本発明の他の実施例を示し、(a)は平面図、
(b)は(a)のB−B線に沿う縦断面図である。
【図3】従来の半導体装置の一例を示し、(a)は平面
図、(b)は(a)のC−C線に沿う縦断面図、(c)
は底面図である。
【符号の説明】
1 セラミック基台 2 メタラ
イズパターン 6 集積回路素子 7a,7b
金属細線 8 接地用金属板 9 封止用
金属板 10 キャップ 12 凹形
状加工部

Claims (2)

    (57)【特許請求の範囲】
  1. 【請求項1】 セラミック基台に形成したメタライズパ
    ターンと、このセラミック基台の上面に搭載した集積回
    路素子とを金属細線で接続してなる半導体装置におい
    て、前記セラミック基台の上面には前記集積回路素子に
    近接してその表面が前記集積回路素子の表面とほぼ同じ
    高さにされた中実構造の接地用金属板を形成し、この接
    地用金属板と集積回路素子の接地端子とを接地用の金属
    細線で接続したことを特徴とする半導体装置。
  2. 【請求項2】 セラミック基台に形成したメタライズパ
    ターンと、このセラミック基台の上面に搭載した集積回
    路素子とを金属細線で接続してなる半導体装置におい
    て、前記セラミック基台の上面には前記集積回路素子に
    近接してその表面が前記集積回路素子の表面とほぼ同じ
    高さにされた中実構造の接地用金属板を形成し、この
    地用金属板の表面に凹形状加工部を設け、この凹形状加
    工部を跨ぐように前記集積回路素子とメタライズパター
    ンとを接続する信号または電源端子用の金属細線を延設
    たことを特徴とする半導体装置。
JP3053607A 1991-02-27 1991-02-27 半導体装置 Expired - Fee Related JP2666588B2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP3053607A JP2666588B2 (ja) 1991-02-27 1991-02-27 半導体装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP3053607A JP2666588B2 (ja) 1991-02-27 1991-02-27 半導体装置

Publications (2)

Publication Number Publication Date
JPH04273153A JPH04273153A (ja) 1992-09-29
JP2666588B2 true JP2666588B2 (ja) 1997-10-22

Family

ID=12947581

Family Applications (1)

Application Number Title Priority Date Filing Date
JP3053607A Expired - Fee Related JP2666588B2 (ja) 1991-02-27 1991-02-27 半導体装置

Country Status (1)

Country Link
JP (1) JP2666588B2 (ja)

Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7164192B2 (en) * 2003-02-10 2007-01-16 Skyworks Solutions, Inc. Semiconductor die package with reduced inductance and reduced die attach flow out

Family Cites Families (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CH666608A5 (de) * 1985-07-15 1988-08-15 Sulzer Ag Zementfrei im becken zu verankernde hueftgelenkspfanne.
JPH04129250A (ja) * 1990-09-20 1992-04-30 Nec Corp 薄型混成集積回路基板
JP2520511B2 (ja) * 1990-10-26 1996-07-31 山形日本電気株式会社 高周波半導体装置

Also Published As

Publication number Publication date
JPH04273153A (ja) 1992-09-29

Similar Documents

Publication Publication Date Title
US4172261A (en) Semiconductor device having a highly air-tight package
US5635751A (en) High frequency transistor with reduced parasitic inductance
JPH03225854A (ja) 半導体デバイス及びその製造方法
EP2159837B1 (en) Electronic component storing package and electronic device
JPH0786460A (ja) 半導体装置
JP2728322B2 (ja) 半導体装置
JP2666588B2 (ja) 半導体装置
KR950009625B1 (ko) 유리봉지형 세라믹 패키지
JPH05347324A (ja) 半導体パッケージ
JPH083009Y2 (ja) 半導体素子収納用パッケージ
JPH08139216A (ja) 半導体装置用パッケージ
JP2509904B2 (ja) 半導体装置用パツケ−ジ
JP2663731B2 (ja) 半導体装置
JP3126503B2 (ja) 半導体装置
JP3866128B2 (ja) 配線基板
JPS6336688Y2 (ja)
JP3051225B2 (ja) 集積回路用パッケージ
JPS6365649A (ja) 半導体用パツケ−ジ
JPH0412538A (ja) 半導体装置
JP4172790B2 (ja) 配線基板
JPH083012Y2 (ja) 電子部品収納用パッケージ
JPH04162751A (ja) 高周波半導体装置
JP2798334B2 (ja) 半導体装置
JPS6236290Y2 (ja)
JPH0272654A (ja) Icパッケージ及びその接続構造

Legal Events

Date Code Title Description
R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

S111 Request for change of ownership or part of ownership

Free format text: JAPANESE INTERMEDIATE CODE: R313111

R350 Written notification of registration of transfer

Free format text: JAPANESE INTERMEDIATE CODE: R350

LAPS Cancellation because of no payment of annual fees