JP2602247B2 - 画像読取装置 - Google Patents
画像読取装置Info
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- JP2602247B2 JP2602247B2 JP62257290A JP25729087A JP2602247B2 JP 2602247 B2 JP2602247 B2 JP 2602247B2 JP 62257290 A JP62257290 A JP 62257290A JP 25729087 A JP25729087 A JP 25729087A JP 2602247 B2 JP2602247 B2 JP 2602247B2
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- JP
- Japan
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- image
- image reading
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- Prior art date
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Classifications
-
- C—CHEMISTRY; METALLURGY
- C09—DYES; PAINTS; POLISHES; NATURAL RESINS; ADHESIVES; COMPOSITIONS NOT OTHERWISE PROVIDED FOR; APPLICATIONS OF MATERIALS NOT OTHERWISE PROVIDED FOR
- C09B—ORGANIC DYES OR CLOSELY-RELATED COMPOUNDS FOR PRODUCING DYES, e.g. PIGMENTS; MORDANTS; LAKES
- C09B55/00—Azomethine dyes
- C09B55/009—Azomethine dyes, the C-atom of the group -C=N- being part of a ring (Image)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は積分型光電変換素子を用いて画像を読取る画
像読取装置に関する。
像読取装置に関する。
一般に、記録濃度の高い原稿画像を積分型画像光電変
換素子（例えば、CCD）により読取った後ディザ法によ
り階調補正を行うハーフトーンモードと、読取った原稿
画像に対して階調補正を行わずに２値化する２値モード
とを自在に切換え使用することができる画像読取装置が
知られている。従来のこの種の画像読取装置では、２値
モードの時もハーフトーンモードの時も同じ積分時間
（露光時間）で原稿の１ラインを読み取る様に構成され
ている。
換素子（例えば、CCD）により読取った後ディザ法によ
り階調補正を行うハーフトーンモードと、読取った原稿
画像に対して階調補正を行わずに２値化する２値モード
とを自在に切換え使用することができる画像読取装置が
知られている。従来のこの種の画像読取装置では、２値
モードの時もハーフトーンモードの時も同じ積分時間
（露光時間）で原稿の１ラインを読み取る様に構成され
ている。
上述の従来装置例ではハーフトーンモードにおいては
CCDの出力である光電変換信号を、複数段階のスライス
レベルの中のディザ法により定まるスライスレベルと比
較することにより階調補正を行って上記光電変換信号を
デジタルデータ化している。このため、スライスレベル
の個数も多くなるので確実な２値化を行うためには光電
変換信号出力の最大レベルを高くする必要があった。そ
の結果、従来のこの種の読取装置は充分な光量を保証す
る光源や光伝達効率の良い光学系を用いなければなら
ず、装置が大型化および高価になるという問題点があっ
た。
CCDの出力である光電変換信号を、複数段階のスライス
レベルの中のディザ法により定まるスライスレベルと比
較することにより階調補正を行って上記光電変換信号を
デジタルデータ化している。このため、スライスレベル
の個数も多くなるので確実な２値化を行うためには光電
変換信号出力の最大レベルを高くする必要があった。そ
の結果、従来のこの種の読取装置は充分な光量を保証す
る光源や光伝達効率の良い光学系を用いなければなら
ず、装置が大型化および高価になるという問題点があっ
た。
そこで、本発明の目的は、このような問題点を解決
し、ハーフトーンモードにおいてもCCDの出力レベルを
高い状態に保ち、かつ、光源の出力容量をより小さくで
きる画像読取装置を提供することにある。
し、ハーフトーンモードにおいてもCCDの出力レベルを
高い状態に保ち、かつ、光源の出力容量をより小さくで
きる画像読取装置を提供することにある。
このような目的を達成するために、本発明は、積分型
光電変換素子により原稿画像を読取り電気信号に変換す
る画像読取り手段と、画像読取り手段から得られる電気
信号のレベルと所定の基準レベルとを比較して２値化す
る２値モードと、予め定められたディザパターンにより
定まるスライスレベルと画像読取り手段から得られる電
気信号のレベルとを比較して階調補正を行うハーフトー
ンモードとを択一的に選択指示する指示手段と、ハーフ
トーンモードにおける積分型光電変換素子の積分時間が
２値モードにおける積分型光電変換素子の積分時間より
も長くなるように、積分型光電変換素子の積分時間を設
定する積分時間設定手段を具えたことを特徴とする。
光電変換素子により原稿画像を読取り電気信号に変換す
る画像読取り手段と、画像読取り手段から得られる電気
信号のレベルと所定の基準レベルとを比較して２値化す
る２値モードと、予め定められたディザパターンにより
定まるスライスレベルと画像読取り手段から得られる電
気信号のレベルとを比較して階調補正を行うハーフトー
ンモードとを択一的に選択指示する指示手段と、ハーフ
トーンモードにおける積分型光電変換素子の積分時間が
２値モードにおける積分型光電変換素子の積分時間より
も長くなるように、積分型光電変換素子の積分時間を設
定する積分時間設定手段を具えたことを特徴とする。
本発明は、ハーフトーンモード時における積分型光電
変換素子の読取り時間を２値モード時における読取り時
間より長くなるように設定手段により設定するようにし
たので、光電を小型化しても積分型光電変換素子のハー
フトーンモード時の出力レベルは２値モード時の出力レ
ベルより高くなり、ディザパタンにより定まるスライス
レベルと比較するだけの十分な出力レベルを得ることが
できる。
変換素子の読取り時間を２値モード時における読取り時
間より長くなるように設定手段により設定するようにし
たので、光電を小型化しても積分型光電変換素子のハー
フトーンモード時の出力レベルは２値モード時の出力レ
ベルより高くなり、ディザパタンにより定まるスライス
レベルと比較するだけの十分な出力レベルを得ることが
できる。
以下図面を参照して本発明の一実施例を詳細に説明す
る。
る。
第２図は本実施例の応用例としてのフアクシミリ装置
の全体構成を示す。
の全体構成を示す。
第２図において、符号１で示されているものは水晶発
振器であり、装置全体の基準クロツクを発生する。
振器であり、装置全体の基準クロツクを発生する。
水晶発振器１の出力クロツクは所望のマイクロプロセ
ッサ素子などから構成されたCPU（中央演算処理装置）
２に基準クロツクとして与えられる。CPU2はデータおよ
びアドレスバスによりROM3、RAM4、タイマ５、PPI（Pro
guramable Parallerl I/O）6,7,10およびUPI（周辺CP
U）9,11と接続されている。
ッサ素子などから構成されたCPU（中央演算処理装置）
２に基準クロツクとして与えられる。CPU2はデータおよ
びアドレスバスによりROM3、RAM4、タイマ５、PPI（Pro
guramable Parallerl I/O）6,7,10およびUPI（周辺CP
U）9,11と接続されている。
また、CPU2はデータおよびアドレスバスによりモデム
14やUPI12とも接続されている。
14やUPI12とも接続されている。
UPI12は、操作パネル33上のキーボード31のキー入力
の検出や液晶表示器（LCD）32の表示制御を行う。
の検出や液晶表示器（LCD）32の表示制御を行う。
UPI9は読取モータ34、記録モータ35の駆動制御を行
い、原稿や記録紙の搬送を制御する。
い、原稿や記録紙の搬送を制御する。
UPI11はサーマルヘツド22からなる記録系の制御を行
う。
う。
PPI10は読取り系のデータの入力を行うインターフェ
ースである。
ースである。
また、CPU2はPPI6及びPPI7を介してNCU15（網制御装
置）の制御を行う。
置）の制御を行う。
41は原稿画像を読取るCCDである。44はCCD41の出力を
２値化するアナログ処理部である。アナログ処理部44
は、アナログABC回路とコンパレータ回路により構成さ
れている。
２値化するアナログ処理部である。アナログ処理部44
は、アナログABC回路とコンパレータ回路により構成さ
れている。
45はアナログ処理部44により２値化したビデオ信号を
シリアルからパラレルの信号に変換するシリアル・パラ
レル交換部である。CCD41により読取られたビデオ信号
はアナログ処理部44、シリアルパラレル変換部45および
PPI10を介してCPU2の制御の基にRAM4に記憶され、NCU15
から外部に出力される。
シリアルからパラレルの信号に変換するシリアル・パラ
レル交換部である。CCD41により読取られたビデオ信号
はアナログ処理部44、シリアルパラレル変換部45および
PPI10を介してCPU2の制御の基にRAM4に記憶され、NCU15
から外部に出力される。
なお、上述の各部構成は従来のファクシミリ装置とし
てよく知られているのでその詳細な説明を省略する。
てよく知られているのでその詳細な説明を省略する。
第１図は第２図示のCCD41の駆動回路の構成を示す。
第１図において、48はキーボード31（第２図参照）に
設けられた２値モードを指定する２値モード指定キーで
ある。49はハーフトーンモードを指定するハーフトーン
モード指定キーである。
設けられた２値モードを指定する２値モード指定キーで
ある。49はハーフトーンモードを指定するハーフトーン
モード指定キーである。
43はCCD41の駆動するためのタイミングクロック信号
を発生するタイミングクロック発生回路である。タイミ
ングクロック発生回路43は、２値モード指定キー48によ
り２値モードが指定されたときは、PPI10からの読取り
スタート信号STAにより予め定められたCCD41の積分時間
（読取り時間TAだけ上記タイミングクロック信号を発生
し、ハーフトーンモードキー49によりハーフトーンモー
ドが指定されたときはPPI10からの読取スタート信号STB
により２値モードの積分時間の２倍の積分時間TBだけ上
記タイミングクロック信号を発生する。
を発生するタイミングクロック発生回路である。タイミ
ングクロック発生回路43は、２値モード指定キー48によ
り２値モードが指定されたときは、PPI10からの読取り
スタート信号STAにより予め定められたCCD41の積分時間
（読取り時間TAだけ上記タイミングクロック信号を発生
し、ハーフトーンモードキー49によりハーフトーンモー
ドが指定されたときはPPI10からの読取スタート信号STB
により２値モードの積分時間の２倍の積分時間TBだけ上
記タイミングクロック信号を発生する。
42はタイミングクロック発生回路43が発生するタイミ
ングクロックに同期してCCD41を駆動するクロックドラ
イバである。
ングクロックに同期してCCD41を駆動するクロックドラ
イバである。
46はハーフトーンモード時にPPI10からの動作指示に
応じて所定のディザパターンを発生する。このディザパ
ターンはアナログ処理部44へ送られ、アナログ処理部44
がこのディザパターンに応じて、CCD41の出力レベルを
比較するスライスレベルを設定する。
応じて所定のディザパターンを発生する。このディザパ
ターンはアナログ処理部44へ送られ、アナログ処理部44
がこのディザパターンに応じて、CCD41の出力レベルを
比較するスライスレベルを設定する。
第３図は２値モードおよびハーフトーンモードにおけ
るCCD41の積分時間を示す。
るCCD41の積分時間を示す。
第３図を参照して本発明に係わるCCD41の動作を説明
する。
する。
第３図において、２値モードが設定されると、PPI10
からタイミングクロック発生回路43に対して出力される
読取スタート信号STAに同期して、積分時間TAの間にCCD
41は１ライン分の原稿画像を読取る。CCD41により読取
られた画像はビデオ信号VAとしてアナログ処理部44に出
力される。アナログ処理部44は予め設定された固定のし
きい値レベルによりビデオ信号のレベルを比較してビデ
オ信号VAを２値の信号に変換し、シリアル・パラレル変
換器45を介してPPI10へ出力する。
からタイミングクロック発生回路43に対して出力される
読取スタート信号STAに同期して、積分時間TAの間にCCD
41は１ライン分の原稿画像を読取る。CCD41により読取
られた画像はビデオ信号VAとしてアナログ処理部44に出
力される。アナログ処理部44は予め設定された固定のし
きい値レベルによりビデオ信号のレベルを比較してビデ
オ信号VAを２値の信号に変換し、シリアル・パラレル変
換器45を介してPPI10へ出力する。
次に、ハーフトーンモードが指定されると、PPI10か
らタイミングクロック発生回路43に対して出力される読
取スタート信号STBに同期してCCD41が１ライン分の原稿
画像を積分時間TB＝2TAの間読取り、光電変換信号がCCD
41から出力される。ディザパターン発生回路46から指示
されるディザパターンに応じてスライスレベルがアナロ
グ処理部44において可変設定され、CCD41の出力信号す
なわちビデオ信号VBと比較され、２値化される。このよ
うにディザパターンにより階調補正された２値化信号が
シリアル−パラレル変換器45を介してPPI10に出力され
る。
らタイミングクロック発生回路43に対して出力される読
取スタート信号STBに同期してCCD41が１ライン分の原稿
画像を積分時間TB＝2TAの間読取り、光電変換信号がCCD
41から出力される。ディザパターン発生回路46から指示
されるディザパターンに応じてスライスレベルがアナロ
グ処理部44において可変設定され、CCD41の出力信号す
なわちビデオ信号VBと比較され、２値化される。このよ
うにディザパターンにより階調補正された２値化信号が
シリアル−パラレル変換器45を介してPPI10に出力され
る。
このように、本実施例においてはCCD41の積分時間を
ハーフトーンモード時は２値モード時の２倍とするよう
にしたので、光源の出力を小さくしてもCCD41はスライ
スレベルと比較するだけの従来と同じ電化を蓄積するこ
とができる。
ハーフトーンモード時は２値モード時の２倍とするよう
にしたので、光源の出力を小さくしてもCCD41はスライ
スレベルと比較するだけの従来と同じ電化を蓄積するこ
とができる。
一方、上述の画像読取装置において２値モードのとき
は、ハーフトーンモードのときに比べてCCDの光電変換
出力が低くても画質にはそれほど影響しない。さらにハ
ーフトーンモードの際はディザ法によりデータ圧縮して
も１ライン当りのデジタルデータ量が２値モードに比べ
て多量であるために、データ処理に時間（FAXの時は送
信時間）がかかるので、原稿を現在よりも遅く読んでも
特に問題はない。
は、ハーフトーンモードのときに比べてCCDの光電変換
出力が低くても画質にはそれほど影響しない。さらにハ
ーフトーンモードの際はディザ法によりデータ圧縮して
も１ライン当りのデジタルデータ量が２値モードに比べ
て多量であるために、データ処理に時間（FAXの時は送
信時間）がかかるので、原稿を現在よりも遅く読んでも
特に問題はない。
以上説明したように、本発明によれば、ハーフトーン
モード時における積分型光電変換素子の読取り時間を２
値モード時における読取り時間より長くなるように設定
手段により設定するようにしたので、光源を小型化して
も積分型光電変換素子のハーフトーンモード時の出力レ
ベルは２値モード時の出力レベルより高くなり、ディザ
パターンにより定まるスライスレベルと比較するだけの
十分な出力レベルを得ることができる。この結果、光源
の小型化に伴い廉価な画像読取装置を提供できるという
効果が得られる。
モード時における積分型光電変換素子の読取り時間を２
値モード時における読取り時間より長くなるように設定
手段により設定するようにしたので、光源を小型化して
も積分型光電変換素子のハーフトーンモード時の出力レ
ベルは２値モード時の出力レベルより高くなり、ディザ
パターンにより定まるスライスレベルと比較するだけの
十分な出力レベルを得ることができる。この結果、光源
の小型化に伴い廉価な画像読取装置を提供できるという
効果が得られる。
第１図は本発明実施例のCCD41の制御系の構成例を示す
ブロック図、 第２図は本発明実施例のシステム構成例を示すブロック
図、 第３図は本発明実施例のCCD41の読取時間例を示すタイ
ミングチャートである。 １……水晶発振器、 ２……CPU、 ３……ROM、 ４……RAM、 ５……タイマー、 ６……PPI、 ７……PPI、 ９……UPI、 10……PPI、 11……UPI、 12……UPI、 14……モデム、 13……キーボード、 32……LCD、 41……CCD、 42……クロックドライバー、 43……タイミングクロック発生回路、 44……アナログ処理部、 45……シリアル−パラレル、 46……ディザパターン変換回路、発生回路、 48……２値化モード指定キー、 49……ハーフトーンモード指定キー。
ブロック図、 第２図は本発明実施例のシステム構成例を示すブロック
図、 第３図は本発明実施例のCCD41の読取時間例を示すタイ
ミングチャートである。 １……水晶発振器、 ２……CPU、 ３……ROM、 ４……RAM、 ５……タイマー、 ６……PPI、 ７……PPI、 ９……UPI、 10……PPI、 11……UPI、 12……UPI、 14……モデム、 13……キーボード、 32……LCD、 41……CCD、 42……クロックドライバー、 43……タイミングクロック発生回路、 44……アナログ処理部、 45……シリアル−パラレル、 46……ディザパターン変換回路、発生回路、 48……２値化モード指定キー、 49……ハーフトーンモード指定キー。
Claims (1)
- 【請求項１】積分型光電変換素子により原稿画像を読取
り電気信号に変換する画像読取り手段と、 該画像読取り手段から得られる前記電気信号のレベルと
所定の基準レベルとを比較して２値化する２値モード
と、予め定められたディザパターンにより定まるスライ
スレベルと前記画像読取り手段から得られる前記電気信
号のレベルとを比較して階調補正を行うハーフトーンモ
ードとを択一的に選択指示する指示手段と、 前記ハーフトーンモードにおける前記積分型光電変換素
子の積分時間が前記２値モードにおける前記積分型光電
変換素子の積分時間よりも長くなるように、前記積分型
光電変換素子の積分時間を設定する積分時間設定手段を
具えたことを特徴とする画像読取装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62257290A JP2602247B2 (ja) | 1987-10-14 | 1987-10-14 | 画像読取装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62257290A JP2602247B2 (ja) | 1987-10-14 | 1987-10-14 | 画像読取装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01101067A JPH01101067A (ja) | 1989-04-19 |
| JP2602247B2 true JP2602247B2 (ja) | 1997-04-23 |
Family
ID=17304319
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62257290A Expired - Fee Related JP2602247B2 (ja) | 1987-10-14 | 1987-10-14 | 画像読取装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2602247B2 (ja) |
-
1987
- 1987-10-14 JP JP62257290A patent/JP2602247B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH01101067A (ja) | 1989-04-19 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |