JP2023037627A - アレイ基板及び表示装置 - Google Patents
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Abstract
Description
前記負電源補助線は、電気的に接続されている、負電源補助線第1サブ層と、負電源補助線第2サブ層とを含み、前記負電源線第1サブ層及び前記負電源補助線第1サブ層はいずれも前記ソース又は前記ドレインと同一層に位置し、前記負電源線第2サブ層及び前記負電源補助線第2サブ層はいずれも前記接続電極と同一層に位置する。
前記正電源バス第1サブ層は前記ソース又は前記ドレインと同一層に位置し、前記正電源バス第2サブ層は前記接続電極と同一層に位置する。
前記負電源補助線は、電気的に接続されている、負電源補助線第1サブ層と、負電源補助線第2サブ層とを含み、
前記負電源線第1サブ層及び前記負電源補助線第1サブ層はいずれも前記ソース又は前記ドレインと同一層に位置し、前記負電源線第2サブ層及び前記負電源補助線第2サブ層はいずれも前記接続電極と同一層に位置する。
第1境界、第2境界、第3境界、及び第4境界を含む表示領域と、少なくとも一部が前記表示領域を取り囲む周辺領域とを含むベース基板と、
前記表示領域に位置する複数のサブ画素であって、前記複数のサブ画素のうちの少なくとも1つが発光素子を含み、前記発光素子が積層される第1電極、発光層、及び第2電極を含む複数のサブ画素と、
前記表示領域に位置し、前記複数のサブ画素に電気的に接続される複数の正電源線と、
前記周辺領域に位置しかつ前記第1境界に沿って延びており、前記複数の正電源線に電気的に接続される正電源バスと、
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置する第1正電源アクセス端子、第2正電源アクセス端子、及び第3正電源アクセス端子であって、前記第2正電源アクセス端子が前記第1正電源アクセス端子と前記第3正電源アクセス端子との間に位置し、前記第1正電源アクセス端子、前記第2正電源アクセス端子、及び前記第3正電源アクセス端子がそれぞれ前記正電源バスに電気的に接続される第1正電源アクセス端子、第2正電源アクセス端子、及び第3正電源アクセス端子と、
前記周辺領域に位置しかつ少なくとも一部が前記第2境界、前記第3境界、及び前記第4境界を取り囲む負電源線と、
前記周辺領域に位置しかつ少なくとも一部が前記第1境界、前記第2境界、前記第3境界、及び前記第4境界を取り囲み、前記負電源線及び前記第2電極にそれぞれ電気的に接続される補助電極と、
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置する第1負電源アクセス端子、第2負電源アクセス端子、第3負電源アクセス端子及び第4負電源アクセス端子であって、前記第1負電源アクセス端子が前記第1正電源アクセス端子の前記第2正電源アクセス端子から離れた側に位置し、前記第2負電源アクセス端子が前記第1正電源アクセス端子と前記第3正電源アクセス端子との間に位置し、前記第3負電源アクセス端子が前記第3正電源アクセス端子の前記第2正電源アクセス端子から離れた側に位置し、前記第4負電源アクセス端子が前記第2負電源アクセス端子と前記第3正電源アクセス端子の間に位置し、前記第1負電源アクセス端子及び前記第3負電源アクセス端子がそれぞれ前記負電源線に電気的に接続される第1負電源アクセス端子、第2負電源アクセス端子、第3負電源アクセス端子及び第4負電源アクセス端子と、
前記周辺領域に位置し、第1方向に沿って前記第2負電源アクセス端子と前記第4負電源アクセス端子との間に位置し、第2方向に沿って前記正電源バスと前記第2負電源アクセス端子との間に位置する負電源補助線とを含み、
前記負電源補助線、前記第2負電源アクセス端子、及び前記第4負電源アクセス端子は一体となっている構造であり、前記第1方向と前記第2方向とが交差し、
前記負電源補助線は、前記補助電極に電気的に接続され、前記負電源補助線の前記ベース基板での正投影と前記補助電極の前記ベース基板での正投影は、少なくとも一部が重なる、アレイ基板。
前記第1負電源アクセス端子と前記第3負電源アクセス端子は、前記負電源線と前記補助電極を介して負電圧信号を前記発光素子の前記第2電極に伝送するように構成され、
前記第2負電源アクセス端子と前記第4負電源アクセス端子は、前記負電源補助線と前記補助電極を介して負電圧信号を前記発光素子の前記第2電極に伝送するように構成される。
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置しかつ前記第4負電源アクセス端子と前記第3正電源アクセス端子との間に位置し、前記正電源バスに電気的に接続される第4正電源アクセス端子をさらに含み、
前記第4正電源アクセス端子は、前記正電源バスと前記正電源線を介して前記発光素子の前記第1電極に正電圧信号を伝送するように構成される。
前記第1負電源アクセス端子と前記第3負電源アクセス端子は、前記負電源補助線に対して対称に設けられ、及び/または、
前記第2正電源アクセス端子と前記第4正電源アクセス端子は、前記負電源補助線に対して対称に設けられ、及び/または、
前記第2負電源アクセス端子と前記第4負電源アクセス端子は、前記負電源補助線に対して対称に設けられる。
前記薄膜トランジスタは、前記ベース基板上に位置する活性層と、前記活性層の前記ベース基板から離れた側に位置するゲートと、前記ゲートの前記ベース基板から離れた側に位置するソース及びドレインとを含む。
前記正電源バス第1サブ層は前記ソース又は前記ドレインと同一層に位置し、前記正電源バス第2サブ層は前記接続電極と同一層に位置する。
前記負電源補助線は、電気的に接続されている、負電源補助線第1サブ層と、負電源補助線第2サブ層とを含み、
前記負電源線第1サブ層及び前記負電源補助線第1サブ層はいずれも前記ソース又は前記ドレインと同一層に位置し、前記負電源線第2サブ層及び前記負電源補助線第2サブ層はいずれも前記接続電極と同一層に位置する。
前記薄膜トランジスタは、前記ベース基板上に位置する活性層と、前記活性層の前記ベース基板から離れた側に位置するゲートと、前記ゲートの前記ベース基板から離れた側に位置するソース及びドレインとを含み、
前記第1正電源アクセス端子、前記第2正電源アクセス端子、前記第3正電源アクセス端子、及び前記第4正電源アクセス端子は、いずれも前記ソース又は前記ドレインと同一層に位置する。
前記薄膜トランジスタは、前記ベース基板上に位置する活性層と、前記活性層の前記ベース基板から離れた側に位置するゲートと、前記ゲートの前記ベース基板から離れた側に位置するソース及びドレインとを含み、
前記第1負電源アクセス端子、前記第2負電源アクセス端子、前記第3負電源アクセス端子、及び前記第4負電源アクセス端子は、いずれも前記ソース又は前記ドレインと同一層に位置する。
前記第2負電源アクセス端子、前記第4負電源アクセス端子、及び前記負電源補助線第1サブ層は一体となっている構造である。
前記第1正電源アクセス端子、前記第2正電源アクセス端子、前記第3正電源アクセス端子、前記第4正電源アクセス端子、前記第1負電源アクセス端子、前記第2負電源アクセス端子、前記第3負電源アクセス端子、及び前記第4負電源アクセス端子の、前記表示領域から離れた側の前記周辺領域に位置する回路基板であって、前記第1正電源アクセス端子、前記第2正電源アクセス端子、前記第3正電源アクセス端子、前記第4正電源アクセス端子、前記第1負電源アクセス端子、前記第2負電源アクセス端子、前記第3負電源アクセス端子、及び前記第4負電源アクセス端子がそれぞれ電気的に接続される回路基板をさらに含む。
前記表示領域に位置する複数のサブ画素であって、前記複数のサブ画素のうちの少なくとも1つが発光素子を含み、前記発光素子が積層される第1電極、発光層、及び第2電極を含む複数のサブ画素と、
前記表示領域に位置し、前記複数のサブ画素に電気的に接続される複数の正電源線と、
前記周辺領域に位置しかつ前記第1境界に沿って延びており、前記複数の正電源線に電気的に接続される正電源バスと、
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置する第1正電源アクセス端子、第2正電源アクセス端子、及び第3正電源アクセス端子であって、前記第2正電源アクセス端子が前記第1正電源アクセス端子と前記第3正電源アクセス端子との間に位置し、前記第1正電源アクセス端子、前記第2正電源アクセス端子、及び前記第3正電源アクセス端子がそれぞれ前記正電源バスに電気的に接続される第1正電源アクセス端子、第2正電源アクセス端子、及び第3正電源アクセス端子と、
前記周辺領域に位置しかつ少なくとも一部が前記第2境界、前記第3境界、及び前記第4境界を取り囲む負電源線と、
前記周辺領域に位置しかつ少なくとも一部が前記第1境界、前記第2境界、前記第3境界、及び前記第4境界を取り囲み、前記負電源線及び前記第2電極にそれぞれ電気的に接続される補助電極と、
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置する第1負電源アクセス端子、第2負電源アクセス端子、第3負電源アクセス端子及び第4負電源アクセス端子であって、前記第1負電源アクセス端子が前記第1正電源アクセス端子の前記第2正電源アクセス端子から離れた側に位置し、前記第2負電源アクセス端子が前記第1正電源アクセス端子と前記第3正電源アクセス端子との間に位置し、前記第3負電源アクセス端子が前記第3正電源アクセス端子の前記第2正電源アクセス端子から離れた側に位置し、前記第4負電源アクセス端子が前記第2負電源アクセス端子と前記第3正電源アクセス端子の間に位置し、前記第1負電源アクセス端子及び前記第3負電源アクセス端子がそれぞれ前記負電源線に電気的に接続される第1負電源アクセス端子、第2負電源アクセス端子、第3負電源アクセス端子及び第4負電源アクセス端子と、
前記周辺領域に位置し、第1方向に沿って前記第2負電源アクセス端子と前記第4負電源アクセス端子との間に位置し、第2方向に沿って前記正電源バスと前記第2負電源アクセス端子との間に位置する負電源補助線とを含み、
前記負電源補助線、前記第2負電源アクセス端子、及び前記第4負電源アクセス端子は一体となっている構造であり、前記第1方向と前記第2方向とが交差し、
前記負電源補助線は、前記補助電極に電気的に接続され、前記負電源補助線の前記ベース基板での正投影と前記補助電極の前記ベース基板での正投影は、少なくとも一部が重なる。
前記第1負電源アクセス端子と前記第3負電源アクセス端子は、前記負電源線と前記補助電極を介して負電圧信号を前記発光素子の前記第2電極に伝送するように構成され、
前記第2負電源アクセス端子と前記第4負電源アクセス端子は、前記負電源補助線と前記補助電極を介して負電圧信号を前記発光素子の前記第2電極に伝送するように構成される。
ベース基板10は、表示領域B1と、少なくとも一部が表示領域B1を取り囲む周辺領域B2とを含むベース基板10であって、表示領域B1は、第1境界(図1~図4には図示せず)、第2境界(図1~図4には図示せず)、第3境界(図1~図4には図示せず)、及び第4境界(図1~図4には図示せず)を含む。なお、本願の実施例では、周辺領域B2が表示領域B1の4辺の周りを取り込む場合を例として説明し、周辺領域B2は、表示領域B1を取り囲む閉リングであってもよい。
複数のサブ画素11は、表示領域B1に位置する複数のサブ画素11であって、該複数のサブ画素11のうちの少なくとも1つは発光素子(図1~図4には図示せず)を含み、該発光素子は、積層される第1電極(図1~図4には図示せず)、発光層(図1~図4には図示せず)、及び第2電極(図1~図4には図示せず)を含み、例えば、該発光素子は、順に積層される第1電極、発光層、及び第2電極を含む。該複数のサブ画素11は、表示機能を実現するように発光することができる。
複数の正電源線12は、表示領域B1に位置しかつサブ画素11に電気的に接続され、例えば、該複数の正電源線12は、該サブ画素11における発光素子の第1電極に接続される。
正電源バス13は、周辺領域B2に位置しかつ表示領域B1の第1境界に沿って延びており、上記複数の正電源線12に電気的に接続される。
第1正電源アクセス端子14、第2正電源アクセス端子15、及び第3正電源アクセス端子16は、正電源バス13の表示領域B1から離れた側の周辺領域B2に位置する第1正電源アクセス端子14、第2正電源アクセス端子15、及び第3正電源アクセス端子16であって、第2正電源アクセス端子15が第1正電源アクセス端子14と第3正電源アクセス端子16との間に位置し、第1正電源アクセス端子14、第2正電源アクセス端子15、及び第3正電源アクセス端子16がそれぞれ正電源バス13に電気的に接続される。
負電源線17は、周辺領域B2に位置しかつ少なくとも一部が表示領域B1の第2境界、第3境界、及び第4境界を取り囲み、例えば、負電源線17は、表示領域B1の第2境界、第3境界、及び第4境界に沿って延びる。
補助電極18は、周辺領域B2に位置しかつ少なくとも一部が表示領域B1の第1境界、第2境界、第3境界、及び第4境界を取り囲む。該補助電極18は、負電源線17及び発光素子の第2電極にそれぞれ電気的に接続され、例えば、図1~図4は、補助電極18が表示領域B1の第1境界、第2境界、第3境界、及び第4境界を取り囲むのを例として説明する。
第1負電源アクセス端子19、第2負電源アクセス端子20、第3負電源アクセス端子21、及び第4負電源アクセス端子24(図3及び図4を参考)は、正電源バス13の表示領域B1から離れた側の周辺領域B2に位置する第1負電源アクセス端子19、第2負電源アクセス端子20、及び第3負電源アクセス端子21であって、第1負電源アクセス端子19が第1正電源アクセス端子14の第2正電源アクセス端子15から離れた側に位置し、第2負電源アクセス端子20が第1正電源アクセス端子14と第3正電源アクセス端子16との間に位置し、第3負電源アクセス端子21が第3正電源アクセス端子16の第2正電源アクセス端子15から離れた側に位置し、第4負電源アクセス端子24が第2負電源アクセス端子20と第3正電源アクセス端子16との間(図3及び図4を参考)に位置し、第1負電源アクセス端子19及び第3負電源アクセス端子21がそれぞれ負電源線17に電気的に接続される。なお、本願の実施例では、第2負電源アクセス端子20が第2正電源アクセス端子15と第3正電源アクセス端子16との間に位置する場合を例として説明する。
負電源補助線22は、周辺領域B2に位置し、第1方向xに沿って第2負電源アクセス端子20と第4負電源アクセス端子24との間に位置し、第2方向yに沿って正電源バス13と第2負電源アクセス端子20との間に位置し、負電源補助線22、第2負電源アクセス端子20、及び第4負電源アクセス端子24は一体となっている構造であり、第1方向xと第2方向yとが交差し、例えば、第1方向xと第2方向yとが直交である。
負電源補助線22は、補助電極18に電気的に接続され、負電源補助線22のベース基板10での正投影と補助電極18のベース基板10での正投影は、少なくとも一部が重なる。
図1~図4は、単なる本願の例示的な実施形態であり、いくつかの実施形態において、アレイ基板は、第4負電源アクセス端子24を含まず、第2負電源アクセス端子20を介して中央領域の発光素子に負電圧信号を伝送してもよい。例えば、図1及び図2に示すアレイ基板は、第4負電源アクセス端子24を含まず、第2負電源アクセス端子20を介して中央領域の発光素子に負電圧信号を伝送する。
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置しかつ前記第1正電源アクセス端子と前記第3正電源アクセス端子との間に位置し、前記正電源バスに電気的に接続される第4正電源アクセス端子をさらに含み、例えば、前記第4正電源アクセス端子は、前記第2負電源アクセス端子と前記第3正電源アクセス端子との間に位置し、そして、前記第4正電源アクセス端子は、前記第4負電源アクセス端子と前記第3正電源アクセス端子との間に位置し、
前記第4正電源アクセス端子は、前記正電源バス、及び前記正電源線を介して前記発光素子の前記第1電極に正電圧信号を伝送するように構成される。
正電源バス13の表示領域B1から離れた側の周辺領域B2に位置しかつ第2負電源アクセス端子20と第3正電源アクセス端子16との間に位置し、該第4正電源アクセス端子23は、正電源バス13に電気的に接続され、第4正電源アクセス端子23は、正電源バス13、及び正電源線12を介して正電圧信号を発光素子の第1電極に伝送するように構成される。
正電源バス13の表示領域B1から離れた側の周辺領域B2、且つ第4負電源アクセス端子24と第3正電源アクセス端子16との間に位置し、する第4正電源アクセス端子23且つ正電源バス13に電気的に接続される第4正電源アクセス端子23をさらに含み、
第4正電源アクセス端子23は、正電源バス13、及び正電源線12を介して正電圧信号を発光素子の第1電極に伝送するように構成される。
例示的に、図1及び図2に示すように、第1正電源アクセス端子14と第3正電源アクセス端子16は、負電源補助線22に対して対称に設けられ、第2正電源アクセス端子15と第4正電源アクセス端子23は、負電源補助線22に対して対称に設けられ、第1負電源アクセス端子19と第3負電源アクセス端子21は、負電源補助線22に対して対称に設けられる。図3に示すように、第1正電源アクセス端子14と第3正電源アクセス端子16は、負電源補助線22に対して対称に設けられ、第1負電源アクセス端子19と第3負電源アクセス端子21は、負電源補助線22に対して対称に設けられる。第2負電源アクセス端子20と第4負電源アクセス端子24は、負電源補助線22に対して対称に設けられる。図4に示すように、第1正電源アクセス端子14と第3正電源アクセス端子16は、負電源補助線22に対して対称に設けられ、第2正電源アクセス端子15と第4正電源アクセス端子23は、負電源補助線22に対して対称に設けられ、第1負電源アクセス端子19と第3負電源アクセス端子21は、負電源補助線22に対して対称に設けられ、第2負電源アクセス端子20と第4負電源アクセス端子24は、負電源補助線22に対して対称に設けられる。
前記正電源バス第1サブ層は前記ソース又は前記ドレインと同一層に位置し、前記正電源バス第2サブ層は前記接続電極と同一層に位置する。
前記負電源補助線は、電気的に接続されている、負電源補助線第1サブ層と、負電源補助線第2サブ層とを含み、
前記負電源線第1サブ層及び前記負電源補助線第1サブ層はいずれも前記ソース又は前記ドレインと同一層に位置し、前記負電源線第2サブ層及び前記負電源補助線第2サブ層はいずれも前記接続電極と同一層に位置する。
Claims (17)
- アレイ基板であって、
第1境界、第2境界、第3境界及び第4境界を含む表示領域と、前記表示領域を取り囲む周辺領域とを含むベース基板と、
前記表示領域に位置する複数のサブ画素であって、前記複数のサブ画素のうちの少なくとも1つが発光素子を含み、前記発光素子が順に積層される第1電極、発光層、及び第2電極を含む複数のサブ画素と、
前記表示領域に位置し、前記第1電極に電気的に接続される複数の正電源線と、
前記周辺領域に位置しかつ前記第1境界に沿って分布しており、前記複数の正電源線に電気的に接続される正電源バスと、
前記正電源バスの前記表示領域から離れた側に位置する第1正電源アクセス端子、第2正電源アクセス端子、及び第3正電源アクセス端子であって、前記第2正電源アクセス端子が前記第1正電源アクセス端子と前記第3正電源アクセス端子との間に位置し、前記第1正電源アクセス端子、前記第2正電源アクセス端子、及び前記第3正電源アクセス端子がそれぞれ前記正電源バスに電気的に接続される第1正電源アクセス端子、第2正電源アクセス端子、及び第3正電源アクセス端子と、
前記周辺領域に位置しかつ前記第2境界、前記第3境界、及び前記第4境界を取り囲む負電源線と、
前記周辺領域に位置しかつ前記第1境界、前記第2境界、前記第3境界、及び前記第4境界を取り囲み、前記負電源線及び前記第2電極にそれぞれ電気的に接続される補助電極と、
前記正電源バスの前記表示領域から離れた側に位置する第1負電源アクセス端子、第2負電源アクセス端子、及び第3負電源アクセス端子であって、前記第1負電源アクセス端子が前記第1正電源アクセス端子の前記第2正電源アクセス端子から離れた側に位置し、前記第2負電源アクセス端子が前記第1正電源アクセス端子と前記第3正電源アクセス端子との間に位置し、前記第3負電源アクセス端子が前記第3正電源アクセス端子の前記第2正電源アクセス端子から離れた側に位置し、前記第1負電源アクセス端子及び前記第3負電源アクセス端子がそれぞれ前記負電源線に電気的に接続される第1負電源アクセス端子、第2負電源アクセス端子、及び第3負電源アクセス端子と、
前記周辺領域に位置し、前記第1正電源アクセス端子と前記第3正電源アクセス端子との間に位置しかつ前記正電源バスと前記第2負電源アクセス端子との間に位置し、前記第2負電源アクセス端子及び前記補助電極にそれぞれ電気的に接続される負電源補助線とを含む、アレイ基板。 - 前記第1正電源アクセス端子、前記第2正電源アクセス端子、及び前記第3正電源アクセス端子は、前記正電源バス、前記正電源線、及び前記第1電極を介して前記発光素子に正電圧信号を伝送するように構成され、
前記第1負電源アクセス端子、前記第2負電源アクセス端子、及び前記第3負電源アクセス端子は、前記負電源線、前記負電源補助線、前記補助電極、及び前記第2電極を介して負電圧信号を前記発光素子に伝送するように構成される、請求項1に記載のアレイ基板。 - 前記正電源バスの前記表示領域から離れた側に位置しかつ前記第1正電源アクセス端子と前記第3正電源アクセス端子との間に位置し、前記正電源バスに電気的に接続される第4正電源アクセス端子をさらに含み、
前記第4正電源アクセス端子は、前記正電源バス、前記正電源線、及び前記第1電極を介して前記発光素子に正電圧信号を伝送するように構成される、請求項1に記載のアレイ基板。 - 前記正電源バスの前記表示領域から離れた側に位置しかつ前記第1正電源アクセス端子と前記第3正電源アクセス端子との間に位置し、前記負電源補助線に電気的に接続される第4負電源アクセス端子をさらに含み、
前記第4負電源アクセス端子は、前記負電源補助線、前記補助電極、及び前記第2電極を介して負電圧信号を前記発光素子に伝送するように構成される、請求項1に記載のアレイ基板。 - 前記第2負電源アクセス端子は、前記第2正電源アクセス端子と前記第3正電源アクセス端子との間に位置し、前記アレイ基板は、
前記正電源バスの前記表示領域から離れた側に位置する第4正電源アクセス端子及び第4負電源アクセス端子であって、前記第4正電源アクセス端子が前記第2負電源アクセス端子と前記第3正電源アクセス端子との間に位置しかつ前記正電源バスに電気的に接続され、前記第4負電源アクセス端子が前記第2負電源アクセス端子と前記第4正電源アクセス端子との間に位置しかつ前記負電源補助線に電気的に接続される第4正電源アクセス端子及び第4負電源アクセス端子をさらに含み、
前記第4正電源アクセス端子は、前記正電源バス、前記正電源線、及び前記第1電極を介して前記発光素子に正電圧信号を伝送するように構成され、前記第4負電源アクセス端子は、前記負電源補助線、前記補助電極、及び前記第2電極を介して負電圧信号を前記発光素子に伝送するように構成される、請求項1に記載のアレイ基板。 - 前記複数のサブ画素のうちの少なくとも1つは、薄膜トランジスタ及び接続電極を含み、
前記薄膜トランジスタは、前記ベース基板上に位置する活性層と、前記活性層の前記ベース基板から離れた側に位置するゲートと、前記ゲートの前記ベース基板から離れた側に位置するソース及びドレインとを含む、請求項1~5のいずれか一項に記載のアレイ基板。 - 前記正電源バスは、電気的に接続されている、正電源バス第1サブ層と、正電源バス第2サブ層とを含み、
前記正電源バス第1サブ層は前記ソース又は前記ドレインと同一層に位置し、前記正電源バス第2サブ層は前記接続電極と同一層に位置する、請求項6に記載のアレイ基板。 - 前記正電源バス第1サブ層と前記正電源バス第2サブ層は、正電源バスのビアを介して電気的に接続される、請求項7に記載のアレイ基板。
- 前記負電源線は、電気的に接続されている、負電源線第1サブ層と、負電源線第2サブ層とを含み、
前記負電源補助線は、電気的に接続されている、負電源補助線第1サブ層と、負電源補助線第2サブ層とを含み、
前記負電源線第1サブ層及び前記負電源補助線第1サブ層はいずれも前記ソース又は前記ドレインと同一層に位置し、前記負電源線第2サブ層及び前記負電源補助線第2サブ層はいずれも前記接続電極と同一層に位置する、請求項6に記載のアレイ基板。 - 前記負電源線第1サブ層と前記負電源線第2サブ層は、負電源線ビアを介して電気的に接続され、前記負電源補助線第1サブ層と前記負電源補助線第2サブ層は負電源補助線ビアを介して電気的に接続される、請求項9に記載のアレイ基板。
- 前記複数のサブ画素のうちの少なくとも1つは、薄膜トランジスタを含み、
前記薄膜トランジスタは、前記ベース基板上に位置する活性層と、前記活性層の前記ベース基板から離れた側に位置するゲートと、前記ゲートの前記ベース基板から離れた側に位置するソース及びドレインとを含み、
前記第1正電源アクセス端子、前記第2正電源アクセス端子、前記第3正電源アクセス端子、及び前記第4正電源アクセス端子は、いずれも前記ソース又は前記ドレインと同一層に位置する、請求項3又は5に記載のアレイ基板。 - 前記複数のサブ画素のうちの少なくとも1つは、薄膜トランジスタを含み、
前記薄膜トランジスタは、前記ベース基板上に位置する活性層と、前記活性層の前記ベース基板から離れた側に位置するゲートと、前記ゲートの前記ベース基板から離れた側に位置するソース及びドレインとを含み、
前記第1負電源アクセス端子、前記第2負電源アクセス端子、前記第3負電源アクセス端子、及び前記第4負電源アクセス端子は、いずれも前記ソース又は前記ドレインと同一層に位置する、請求項4又は5に記載のアレイ基板。 - 前記負電源補助線は、電気的に接続されている、負電源補助線第1サブ層と、負電源補助線第2サブ層とを含み、
前記第2負電源アクセス端子、前記第4負電源アクセス端子、及び前記負電源補助線第1サブ層は一体となっている構造である、請求項4又は5に記載のアレイ基板。 - 前記第1正電源アクセス端子、前記第2正電源アクセス端子、前記第3正電源アクセス端子、前記第4正電源アクセス端子、前記第1負電源アクセス端子、前記第2負電源アクセス端子、前記第3負電源アクセス端子、及び前記第4負電源アクセス端子の、前記表示領域から離れた側に位置する回路基板であって、前記第1正電源アクセス端子、前記第2正電源アクセス端子、前記第3正電源アクセス端子、前記第4正電源アクセス端子、前記第1負電源アクセス端子、前記第2負電源アクセス端子、前記第3負電源アクセス端子、及び前記第4負電源アクセス端子がそれぞれ電気的に接続される回路基板をさらに含む、請求項5に記載のアレイ基板。
- 前記補助電極は、前記負電源線の前記ベース基板から離れた側に位置し、負電源補助線ビアを介して前記負電源補助線に電気的に接続される、請求項1~14のいずれか1項に記載のアレイ基板。
- 前記発光素子は有機発光ダイオードであり、前記第1電極は陽極であり、前記第2電極は陰極である、請求項1~15のいずれか1項に記載のアレイ基板。
- 請求項1~16のいずれか1項に記載のアレイ基板を含む、表示装置。
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