JP2021510207A - 画素回路、駆動方法、電界発光表示パネル及び表示装置 - Google Patents
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Abstract
Description
発光デバイスと、
発光段階において駆動電流を生成して前記発光デバイスを駆動して発光させるように構成され、ゲートがコンデンサ回路及びデータ書き込み回路のそれぞれに結合され、第1極がリセット回路に結合され、第2極が前記リセット回路及び前記発光デバイスの第1電極のそれぞれに結合される駆動トランジスタと、
前記駆動トランジスタのゲートの電圧を蓄積するように構成されるコンデンサ回路と、
データ書き込み段階においてデータ信号を前記駆動トランジスタのゲートに供給するように構成されるデータ書き込み回路と、
リセット段階において前記駆動トランジスタの第1極及び第2極をリセットするように構成されるリセット回路と、を備える。
前記第1スイッチングトランジスタのゲートが第1走査信号ラインに結合され、前記第1スイッチングトランジスタの第1極が第1基準信号ラインに結合され、前記第1スイッチングトランジスタの第2極が前記駆動トランジスタの第2極に結合され、
前記第2スイッチングトランジスタのゲートが第2走査信号ラインに結合され、前記第2スイッチングトランジスタの第1極が第2基準信号ラインに結合され、前記第2スイッチングトランジスタの第2極が前記駆動トランジスタの第1極に結合され、
前記第3スイッチングトランジスタのゲートが第3走査信号ラインに結合され、前記第3スイッチングトランジスタの第1極が第3基準信号ラインに結合され、前記第3スイッチングトランジスタの第2極が前記駆動トランジスタのゲートに結合されるようにしてもよい。
前記第2スイッチングトランジスタのアクティブ層の材料は、低温ポリシリコン材料を含むようにしてもよい。
前記蓄積コンデンサは、前記駆動トランジスタのゲートと第1極との間に結合され、
前記分圧コンデンサは、前記駆動トランジスタの第1極と第2基準信号ラインとの間に結合されるようにしてもよい。
前記第4スイッチングトランジスタのゲートが第4走査信号ラインに結合され、前記第4スイッチングトランジスタの第1極がデータ信号ラインに結合されて前記データ信号を受信するために用いられ、前記第4スイッチングトランジスタの第2極が前記駆動トランジスタのゲートに結合されるようにしてもよい。
前記第5スイッチングトランジスタのゲートが発光制御信号ラインに結合され、前記第5スイッチングトランジスタの第1極が前記駆動トランジスタの第2極に結合され、前記第5スイッチングトランジスタの第2極が前記発光デバイスの第1電極に結合されるようにしてもよい。
発光デバイスと、
ゲートが第1走査信号ラインに結合され、第1極が第1基準信号ラインに結合され、第2極が前記駆動トランジスタの第2極に結合される第1スイッチングトランジスタと、
ゲートが第2走査信号ラインに結合され、第1極が第2基準信号ラインに結合され、第2極が前記駆動トランジスタの第1極に結合される第2スイッチングトランジスタと、
ゲートが第3走査信号ラインに結合され、第1極が第3基準信号ラインに結合され、第2極が前記駆動トランジスタのゲートに結合される第3スイッチングトランジスタと、
ゲートが第4走査信号ラインに結合され、第1極がデータ信号ラインに結合され、第2極が前記駆動トランジスタのゲートに結合される第4スイッチングトランジスタと、
ゲートが発光制御信号ラインに結合され、第1極がそれぞれ前記駆動トランジスタの第2極及び前記第1スイッチングトランジスタの第2極に結合され、第2極が前記発光デバイスの第1電極に結合される第5スイッチングトランジスタと、
前記駆動トランジスタのゲートと第1極との間に結合される蓄積コンデンサと、
前記駆動トランジスタの第1極と第2基準信号ラインとの間に結合される分圧コンデンサと、を備える画素回路。
前記第2スイッチングトランジスタ、前記第5スイッチングトランジスタ及び前記駆動トランジスタのアクティブ層の材料は、低温ポリシリコン材料を含むようにしてもよい。
前記画素回路は、第1スイッチングトランジスタ、第2スイッチングトランジスタ、第3スイッチングトランジスタ、第4スイッチングトランジスタ、第5スイッチングトランジスタ、駆動トランジスタ、蓄積コンデンサ、分圧コンデンサ及び発光デバイスを備え、
前記第1スイッチングトランジスタのゲートが、それに現在の対応信号を印加する第1走査信号ラインに結合され、前記第1スイッチングトランジスタの第1極が前記第1基準信号ラインに結合され、前記第1スイッチングトランジスタの第2極が前記駆動トランジスタの第2極に結合され、
前記第2スイッチングトランジスタのゲートが、それに現在の対応信号を印加する第2走査信号ラインに結合され、前記第2スイッチングトランジスタの第1極が前記第2基準信号ラインに結合され、前記第2スイッチングトランジスタの第2極が前記駆動トランジスタの第1極に結合され、
前記第3スイッチングトランジスタのゲートが、それに現在の対応信号を印加する第3走査信号ラインに結合され、前記第3スイッチングトランジスタの第1極が前記第3基準信号ラインに結合され、前記第3スイッチングトランジスタの第2極が前記駆動トランジスタのゲートに結合され、
前記第4スイッチングトランジスタのゲートが、それに現在の対応信号を印加する第4走査信号ラインに結合され、前記第4スイッチングトランジスタの第1極が、それに現在の対応信号を印加するデータ信号ラインに結合され、前記第4スイッチングトランジスタの第2極が前記駆動トランジスタのゲートに結合され、
前記第5スイッチングトランジスタのゲートが、それに現在の対応信号を印加する発光制御信号ラインに結合され、前記第5スイッチングトランジスタの第1極が前記駆動トランジスタの第2極及び前記第1スイッチングトランジスタの第2極のそれぞれに結合され、前記第5スイッチングトランジスタの第2極が前記発光デバイスの第1電極に結合され、
前記蓄積コンデンサは、前記駆動トランジスタのゲートと第1極との間に結合され、
前記分圧コンデンサは、前記駆動トランジスタの第1極と前記第2基準信号ラインとの間に結合されるようにしてもよい。
前記リセット回路は、前記駆動トランジスタの第1極及び第2極をリセットするリセット段階と、
前記データ書き込み回路は、前記データ信号を前記駆動トランジスタのゲートに供給するデータ書き込み段階と、
前記コンデンサ回路は、前記駆動トランジスタのゲートの電圧を蓄積して、前記駆動トランジスタは駆動電流を生成して前記発光デバイスを駆動して発光させる発光段階と、を含む。
前記リセット段階後且つ前記データ書き込み段階前に、前記方法は、前記リセット回路は、前記駆動トランジスタの閾値電圧を補償する閾値補償段階をさらに含むようにしてもよい。
前記閾値補償段階において、前記リセット回路における第2スイッチングトランジスタがオフして、第1スイッチングトランジスタがオンして前記第1基準信号ラインの信号を前記駆動トランジスタの第2極に供給し、第3スイッチングトランジスタがオンして前記第3基準信号ラインの信号を前記駆動トランジスタのゲートに供給し、前記駆動トランジスタがオンして閾値補償を行うようにそれぞれ制御を行うようにしてもよい。
発光デバイスLと、
発光段階において駆動電流を生成して発光デバイスLを駆動して発光させるように構成され、ゲートGがコンデンサ回路3及びデータ書き込み回路2に結合され、第1極Sがリセット回路1に結合され、第2極Dがリセット回路1及び発光デバイスLの第1電極のそれぞれに結合される駆動トランジスタM0と、
駆動トランジスタM0のゲートGの電圧を蓄積するように構成されるコンデンサ回路3と、
データ書き込み段階においてデータ信号(Data)を駆動トランジスタM0のゲートGに供給するように構成されるデータ書き込み回路2と、
リセット段階において駆動トランジスタM0の第1極S及び第2極Dをリセットするように構成されるリセット回路1と、を備える。
第1スイッチングトランジスタM1のゲートが第1走査信号ライン(Scan1)に結合され、第1スイッチングトランジスタM1の第1極が第1基準信号ライン(Vref1)に結合され、第1スイッチングトランジスタM1の第2極が駆動トランジスタM0の第2極Dに結合され、
第2スイッチングトランジスタM2のゲートが第2走査信号ライン(Scan2)に結合され、第2スイッチングトランジスタM2の第1極が第2基準信号ライン(Vref2)に結合され、第2スイッチングトランジスタM2の第2極が駆動トランジスタM0の第1極Sに結合され、
第3スイッチングトランジスタM3のゲートが第3走査信号ライン(Scan3)に結合され、第3スイッチングトランジスタM3の第1極が第3基準信号ライン(Vref3)に結合され、第3スイッチングトランジスタM3の第2極が駆動トランジスタM0のゲートGに結合されるものとしても構わない。
蓄積コンデンサC1は、駆動トランジスタM0のゲートGと第1極Sとの間に結合され、
分圧コンデンサC2は、駆動トランジスタM0の第1極Sと第2基準信号ラインVref2との間に結合されるものとしても構わない。
第5スイッチングトランジスタM5のゲートが発光制御信号ライン(EMIT)に結合され、第5スイッチングトランジスタM5の第1極が駆動トランジスタM0の第2極D及び第1スイッチングトランジスタの第1極のそれぞれに結合され、第5スイッチングトランジスタM5の第2極が発光デバイスLの第1電極に結合されるものとしても構わない。
リセット段階において、リセット回路は、駆動トランジスタの第1極及び第2極をリセットするステップS601と、
データ書き込み段階において、データ書き込み回路は、データ信号を駆動トランジスタのゲートに供給するステップS602と、
発光段階において、コンデンサ回路は、駆動トランジスタのゲートの電圧を蓄積し、駆動トランジスタは、駆動電流を生成して発光デバイスを駆動して発光させるステップS603と、を含む。
画素回路PXは、第1スイッチングトランジスタM1、第2スイッチングトランジスタM2、第3スイッチングトランジスタM3、第4スイッチングトランジスタM4、第5スイッチングトランジスタM5、駆動トランジスタM0、蓄積コンデンサC1、分圧コンデンサC2及び発光デバイスLを備え、
第1スイッチングトランジスタM1のゲートが、それに現在の対応信号を印加する第1走査信号ラインScan1に結合され、第1スイッチングトランジスタM1の第1極が、第1基準信号ラインVref1に結合され、第1スイッチングトランジスタM1の第2極が、駆動トランジスタM0の第2極Dに結合され、
第2スイッチングトランジスタM2のゲートが、それに現在の対応信号を印加する第2走査信号ラインScan2に結合され、第2スイッチングトランジスタM2の第1極が、第2基準信号ラインVref2に結合され、第2スイッチングトランジスタM2の第2極が、駆動トランジスタM0の第1極Sに結合され、
第3スイッチングトランジスタM3のゲートが、それに現在の対応信号を印加する第3走査信号ラインScan3に結合され、第3スイッチングトランジスタM3の第1極が、第3基準信号ラインVref3に結合され、第3スイッチングトランジスタM3の第2極が、駆動トランジスタM0のゲートGに結合され、
第4スイッチングトランジスタM4のゲートが、それに現在の対応信号を印加する第4走査信号ラインScan4に結合され、第4スイッチングトランジスタM4の第1極が、それに現在の対応信号を印加するデータ信号ラインDATAに結合され、第4スイッチングトランジスタM4の第2極が、駆動トランジスタM0のゲートGに結合され、
第5スイッチングトランジスタM5のゲートが、それに現在の対応信号を印加する発光制御信号ラインEMITに結合され、第5スイッチングトランジスタM5の第1極が、それぞれ駆動トランジスタM0の第2極D及び第1スイッチングトランジスタM1の第2極に結合され、第5スイッチングトランジスタM5の第2極が、発光デバイスLの第1電極に結合され、
蓄積コンデンサC1は、駆動トランジスタM0のゲートGと第1極Sとの間に結合され、
分圧コンデンサC2は、駆動トランジスタM0の第1極Sと第2基準信号ラインVref2との間に結合されるものとしても構わない。
Claims (28)
- 画素回路であって、
発光デバイスと、
発光段階において駆動電流を生成して前記発光デバイスを駆動して発光させるように構成され、ゲートがコンデンサ回路及びデータ書き込み回路のそれぞれに結合され、第1極がリセット回路に結合され、第2極が前記リセット回路及び前記発光デバイスの第1電極のそれぞれに結合される駆動トランジスタと、
前記駆動トランジスタのゲートの電圧を蓄積するように構成されるコンデンサ回路と、
データ書き込み段階においてデータ信号を前記駆動トランジスタのゲートに供給するように構成されるデータ書き込み回路と、
リセット段階において前記駆動トランジスタの第1極及び第2極をリセットするように構成されるリセット回路と、を備える画素回路。 - 前記リセット回路は、さらに前記駆動トランジスタのゲートに結合され、前記リセット段階において前記駆動トランジスタのゲートをリセットするとともに、閾値補償段階において前記駆動トランジスタの閾値電圧を補償するように構成される、請求項1に記載の画素回路。
- 前記リセット回路は、第1スイッチングトランジスタ、第2スイッチングトランジスタ及び第3スイッチングトランジスタを備え、
前記第1スイッチングトランジスタのゲートが第1走査信号ラインに結合され、前記第1スイッチングトランジスタの第1極が第1基準信号ラインに結合され、前記第1スイッチングトランジスタの第2極が前記駆動トランジスタの第2極に結合され、
前記第2スイッチングトランジスタのゲートが第2走査信号ラインに結合され、前記第2スイッチングトランジスタの第1極が第2基準信号ラインに結合され、前記第2スイッチングトランジスタの第2極が前記駆動トランジスタの第1極に結合され、
前記第3スイッチングトランジスタのゲートが第3走査信号ラインに結合され、前記第3スイッチングトランジスタの第1極が第3基準信号ラインに結合され、前記第3スイッチングトランジスタの第2極が前記駆動トランジスタのゲートに結合される、請求項2に記載の画素回路。 - 前記第1スイッチングトランジスタ及び前記第3スイッチングトランジスタのアクティブ層の材料は、金属酸化物半導体材料を含み、
前記第2スイッチングトランジスタのアクティブ層の材料は、低温ポリシリコン材料を含む、請求項3に記載の画素回路。 - 前記第1走査信号ラインの信号と前記第3走査信号ラインの信号は、同じである、請求項3に記載の画素回路。
- 前記第1基準信号ラインの信号と前記第3基準信号ラインの信号は、同じである、請求項3に記載の画素回路。
- 前記コンデンサ回路は、蓄積コンデンサ及び分圧コンデンサを備え、
前記蓄積コンデンサは、前記駆動トランジスタのゲートと第1極との間に結合され、
前記分圧コンデンサは、前記駆動トランジスタの第1極と第2基準信号ラインとの間に結合される、請求項1に記載の画素回路。 - 前記データ書き込み回路は、第4スイッチングトランジスタを備え、
前記第4スイッチングトランジスタのゲートが第4走査信号ラインに結合され、前記第4スイッチングトランジスタの第1極がデータ信号ラインに結合されて前記データ信号を受信するように構成され、前記第4スイッチングトランジスタの第2極が前記駆動トランジスタのゲートに結合される、請求項1に記載の画素回路。 - 前記第4スイッチングトランジスタのアクティブ層の材料は、金属酸化物半導体材料を含む、請求項8に記載の画素回路。
- 前記画素回路は、発光制御回路をさらに備え、
前記駆動トランジスタの第2極及び前記リセット回路は、それぞれ前記発光制御回路を介して前記発光デバイスの第1電極に結合され、
前記発光制御回路は、前記駆動トランジスタの第2極と前記発光デバイスの第1電極のオン又はオフを制御するように構成される、請求項1に記載の画素回路。 - 前記発光制御回路は、第5スイッチングトランジスタを備え、
前記第5スイッチングトランジスタのゲートが発光制御信号ラインに結合され、前記第5スイッチングトランジスタの第1極が前記駆動トランジスタの第2極に結合され、前記第5スイッチングトランジスタの第2極が前記発光デバイスの第1電極に結合される、請求項10に記載の画素回路。 - 前記第5スイッチングトランジスタのアクティブ層の材料は、低温ポリシリコン材料を含む、請求項11に記載の画素回路。
- 前記発光制御信号ラインの信号と第2走査信号ラインの信号は、同じである、請求項11に記載の画素回路。
- 前記駆動トランジスタのアクティブ層の材料は、低温ポリシリコン材料を含む、請求項1から13のいずれか1項に記載の画素回路。
- 画素回路であって、
発光デバイスと、
ゲートが第1走査信号ラインに結合され、第1極が第1基準信号ラインに結合され、第2極が前記駆動トランジスタの第2極に結合される第1スイッチングトランジスタと、
ゲートが第2走査信号ラインに結合され、第1極が第2基準信号ラインに結合され、第2極が前記駆動トランジスタの第1極に結合される第2スイッチングトランジスタと、
ゲートが第3走査信号ラインに結合され、第1極が第3基準信号ラインに結合され、第2極が前記駆動トランジスタのゲートに結合される第3スイッチングトランジスタと、
ゲートが第4走査信号ラインに結合され、第1極がデータ信号ラインに結合され、第2極が前記駆動トランジスタのゲートに結合される第4スイッチングトランジスタと、
ゲートが発光制御信号ラインに結合され、第1極が前記駆動トランジスタの第2極及び前記第1スイッチングトランジスタの第2極のそれぞれに結合され、前記第5スイッチングトランジスタの第2極が前記発光デバイスの第1電極に結合される第5スイッチングトランジスタと、
前記駆動トランジスタのゲートと第1極との間に結合される蓄積コンデンサと、
前記駆動トランジスタの第1極と第2基準信号ラインとの間に結合される分圧コンデンサと、を備える画素回路。 - 前記第1スイッチングトランジスタ、前記第3スイッチングトランジスタ及び前記第4スイッチングトランジスタのアクティブ層の材料は、金属酸化物半導体材料を含み、
前記第2スイッチングトランジスタ、前記第5スイッチングトランジスタ及び前記駆動トランジスタのアクティブ層の材料は、低温ポリシリコン材料を含む、請求項15に記載の画素回路。 - 前記第1走査信号ラインの信号と前記第3走査信号ラインの信号は、同じである、請求項15に記載の画素回路。
- 前記第1基準信号ラインの信号と前記第3基準信号ラインの信号は、同じである、請求項15に記載の画素回路。
- 前記発光制御信号ラインの信号と前記第2走査信号ラインの信号は、同じである、請求項15に記載の画素回路。
- 電界発光表示パネルであって、
画素回路、データ信号ライン、第1走査信号ライン、第2走査信号ライン、第3走査信号ライン、第4走査信号ライン、発光制御信号ライン、第1基準電圧ライン、第2基準電圧ライン、第3基準電圧ラインを備え、
前記画素回路は、第1スイッチングトランジスタ、第2スイッチングトランジスタ、第3スイッチングトランジスタ、第4スイッチングトランジスタ、第5スイッチングトランジスタ、駆動トランジスタ、蓄積コンデンサ、分圧コンデンサ及び発光デバイスを備え、
前記第1スイッチングトランジスタのゲートが、それに現在の対応信号を印加する第1走査信号ラインに結合され、前記第1スイッチングトランジスタの第1極が前記第1基準信号ラインに結合され、前記第1スイッチングトランジスタの第2極が前記駆動トランジスタの第2極に結合され、
前記第2スイッチングトランジスタのゲートが、それに現在の対応信号を印加する第2走査信号ラインに結合され、前記第2スイッチングトランジスタの第1極が前記第2基準信号ラインに結合され、前記第2スイッチングトランジスタの第2極が前記駆動トランジスタの第1極に結合され、
前記第3スイッチングトランジスタのゲートが、それに現在の対応信号を印加する第3走査信号ラインに結合され、前記第3スイッチングトランジスタの第1極が前記第3基準信号ラインに結合され、前記第3スイッチングトランジスタの第2極が前記駆動トランジスタのゲートに結合され、
前記第4スイッチングトランジスタのゲートが、それに現在の対応信号を印加する第4走査信号ラインに結合され、前記第4スイッチングトランジスタの第1極が、それに現在の対応信号を印加するデータ信号ラインに結合され、前記第4スイッチングトランジスタの第2極が前記駆動トランジスタのゲートに結合され、
前記第5スイッチングトランジスタのゲートが、それに現在の対応信号を印加する発光制御信号ラインに結合され、前記第5スイッチングトランジスタの第1極が前記駆動トランジスタの第2極及び前記第1スイッチングトランジスタの第2極のそれぞれに結合され、前記第5スイッチングトランジスタの第2極が前記発光デバイスの第1電極に結合され、
前記蓄積コンデンサは、前記駆動トランジスタのゲートと第1極との間に結合され、
前記分圧コンデンサは、前記駆動トランジスタの第1極と前記第2基準信号ラインとの間に結合される、電界発光表示パネル。 - 同一前記画素回路に結合される第1走査信号ラインと第3走査信号ラインの信号は、同じである、請求項20に記載の電界発光表示パネル。
- 前記第1基準信号ラインの信号と前記第3基準信号ラインの信号は、同じである、請求項20に記載の電界発光表示パネル。
- 同一前記画素回路に結合される発光制御信号ラインと第2走査信号ラインの信号は、同じである、請求項20に記載の電界発光表示パネル。
- 表示装置であって、
請求項20から23のいずれか1項に記載の電界発光表示パネルを備える、表示装置。 - 請求項1から14のいずれか1項に記載の画素回路の駆動方法であって、
前記リセット回路は、前記駆動トランジスタの第1極及び第2極をリセットするリセット段階と、
前記データ書き込み回路は、前記データ信号を前記駆動トランジスタのゲートに供給するデータ書き込み段階と、
前記コンデンサ回路は、前記駆動トランジスタのゲートの電圧を蓄積して、前記駆動トランジスタは駆動電流を生成して前記発光デバイスを駆動して発光させる発光段階と、を含む駆動方法。 - リセット段階において、前記リセット回路は、前記駆動トランジスタのゲートをリセットするステップをさらに含み、
前記リセット段階後且つ前記データ書き込み段階前に、前記リセット回路は、前記駆動トランジスタの閾値電圧を補償する閾値補償段階をさらに含む、請求項25に記載の方法。 - 前記リセット段階において、前記リセット回路における第1スイッチングトランジスタがオンして前記第1基準信号ラインの信号を前記駆動トランジスタの第2極に供給し、第2スイッチングトランジスタがオンして前記第2基準信号ラインの信号を前記駆動トランジスタの第1極に供給し、第3スイッチングトランジスタがオンして前記第3基準信号ラインの信号を前記駆動トランジスタのゲートに供給するようにそれぞれ制御を行い、
前記閾値補償段階において、前記リセット回路における第2スイッチングトランジスタがオフして、第1スイッチングトランジスタがオンして前記第1基準信号ラインの信号を前記駆動トランジスタの第2極に供給し、第3スイッチングトランジスタがオンして前記第3基準信号ラインの信号を前記駆動トランジスタのゲートに供給し、前記駆動トランジスタがオンして閾値補償を行うようにそれぞれ制御を行う、請求項26に記載の方法。 - 前記リセット段階及び前記発光段階において、前記発光制御回路は、前記駆動トランジスタの第2極と前記発光デバイスの第1電極をオンさせるステップをさらに含む、請求項25に記載の方法。
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