CN110648631A - 像素电路、方法、显示面板及装置 - Google Patents

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韩珍珍
胡思明
张元波
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Abstract

本发明公开一种像素电路、方法、显示面板及装置，该像素电路包括：第一数据写入电路连接数据信号，且分别与驱动电路及第一发光控制电路连接，并连接第二控制信号；第一发光控制电路连接第一电源信号，连接发光控制信号；驱动电路分别连接第二数据写入电路和第二发光控制电路，并连接第一电容；第二数据写入电路与第一复位电路、第一电容及驱动电路连接，并连接第二控制信号；第一复位电路与复位信号连接，并连接第一控制信号，且第一复位电路的中间节点与驱动电路及第一发光控制电路连接；第二发光控制电路连接发光控制信号。

Description

像素电路、方法、显示面板及装置
技术领域
本发明涉及显示技术领域，具体涉及了像素电路、方法、显示面板及装置。
背景技术
目前，有机发光二极管(Organic Light-Emitting Diode，OLED)显示设备相关产品(例如手机、显示器等)由于分辨率越来越高，尺寸越来越大，导致设计过程中余量(margin)不足，容易导致产品出现残影的问题，这严重影响了用户体验，故开发改善残影和对比度的像素电路成为了OLED面板行业的趋势。
发明内容
有鉴于此，本发明实施例提供了一种像素电路、方法、显示面板及装置，以解决现有OLED设备容易出现残影的问题。
根据第一方面，本发明实施例提供了一种像素电路，用于驱动发光元件，包括：驱动电路、第一数据写入电路、第二数据写入电路、第一复位电路、第一发光控制电路、第二发光控制电路、第一电容，其中，所述第一复位电路为双栅开关管，所述第一数据写入电路的第一端连接数据信号Vdata，第二端分别与所述驱动电路的第一端及第一发光控制电路的第一端连接，控制端连接第二控制信号S2；所述第一发光控制电路的第二端连接第一电源信号ELVDD，控制端连接发光控制信号EM；所述驱动电路的第二端分别连接所述第二数据写入电路的第一端和第二发光控制电路的第一端，控制端连接所述第一电容的第一端；所述第二数据写入电路的第二端与所述第一复位电路的第一端、第一电容的第一端及驱动电路的控制端连接，控制端连接所述第二控制信号S2；所述第一复位电路的第二端与所述复位信号Vref连接，控制端连接所述第一控制信号S1，且所述第一复位电路的中间节点与所述驱动电路的第一端及第一发光控制电路的第一端连接；所述第二发光控制电路的控制端连接所述发光控制信号EM。
本发明实施例的像素电路，由于第一复位电路的中间节点处与驱动电路的第一端连接，复位信号Vref能够传输至驱动电路的第一端，并且，复位信号Vref能够通过第一复位电路传输至驱动电路的控制端，能够对驱动电路的控制端及第一端进行复位，保证了屏体AA区各像素点内电场的一致性，进而消除迟滞效应，改善显示残影的问题。
结合第一方面，在第一方面第一实施方式中，所述像素电路还包括：第二电容C2，所述第二电容C2的一端连接所述第二控制信号S2，另一端连接所述驱动电路的控制端。
本发明实施例的像素电路，在第二控制信号S2信号走线与驱动电路的控制端之间增设第二电容C2，通过第二控制信号S2耦合提高驱动电路控制端的电压，进而提高产品对比度。
结合第一方面，在第一方面第二实施方式中，该像素电路还包括：第二复位电路，所述第二复位电路的第一端连接复位信号Vref及所述第一复位电路的第二端，第二端与所述第二发光控制电路的第二端连接，控制端连接第一控制信号S1。
结合第一方面第二实施方式，在第一方面第三实施方式中，所述驱动电路、第一数据写入电路、第二数据写入电路、第一复位电路、第一发光控制电路、第二发光控制电路及第二复位电路分别包括：开关管器件；所述开关管器件的栅极作为相应电路的控制端，所述开关管器件的第一极作为相应电路的第一端，开关管器件的第二极作为相应电路的第二端。
结合第一方面，在第一方面第四实施方式中，所述第二数据写入电路为双栅开关管。
结合第一方面第一实施方式，在第一方面第五实施方式中，所述开关管器件为PMOS晶体管。
根据第一方面，在第一方面第六实施例中，所述像素电路还包括：发光元件及如第一方面或第一方面中任意一种实施方式所述的像素电路，所述发光元件的一端与所述第二发光控制电路的第二端及第二复位电路的第二端连接，另一端连接第二电源信号ELVSS。
本发明实施例的像素电路，复位信号Vref能够传输至驱动电路的第一端，并且能够通过第一复位电路传输至驱动电路的控制端，能够对驱动电路的控制端及第一端进行复位，保证了屏体AA区各像素点内电场的一致性，进而消除迟滞效应，改善显示残影的问题。
根据第二方面，本发明实施例提供了一种像素电路驱动方法，应用于如第一方面或第一方面中任意一种实施方式所述的像素电路，该方法包括第一阶段、第二阶段及第三阶段，其中，在所述第一阶段中，所述第一控制信号S1输出低电平，第二控制信号S2、发光控制信号EM输出高电平，第一数据写入电路、第二数据写入电路、第一发光控制电路、第二发光控制电路关闭，第一复位电路导通，通过所述第一复位电路的中间节点将所述复位信号Vref传输至所述驱动电路；在所述第二阶段中，所述第二控制信号S2输出低电平，第一控制信号S1、发光控制信号EM输出高电平，驱动电路、第一数据写入电路、第二数据写入电路导通，第一复位电路、第一发光控制电路、第二发光控制电路关闭，所述数据信号Vdata写入所述驱动电路的控制端，并通过所述第一电容C1保持写入电压；在所述第三阶段中，所述发光控制信号EM输出低电平，所述第一控制信号S1、第二控制信号S2输出高电平，第一发光控制电路、第二发光控制电路导通，第一数据写入电路、第二数据写入电路、第一复位电路关闭；驱动电流沿第一电源ELVDD经第一发光控制电路、驱动电路和第二发光控制电路输出至与所述第二发光控制电路的第二端相连的发光元件。
本发明实施例的像素电路方法，在第一阶段复位阶段，由于第一复位电路的中间节点处与驱动电路的第一端连接，使复位信号Vref能够传输至驱动电路的第一端，并且，复位信号Vref能够通过第一复位电路传输至驱动电路的控制端，能够对驱动电路的控制端及第一端进行复位，保证了屏体AA区各像素点内电场的一致性，进而消除迟滞效应，改善显示残影的问题。
根据第三方面，本发明实施例提供了一种显示面板，包括：如第一方面所述的像素电路。
根据第四方面，本发明实施例提供了一种显示装置，包括：如第三方面所述的显示面板。
附图说明
通过参考附图会更加清楚的理解本发明的特征和优点，附图是示意性的而不应理解为对本发明进行任何限制，在附图中：
图1示出了本发明实施例的像素电路的结构示意图；
图2示出了本发明实施例的像素电路的具体示例的结构示意图；
图3示出了本发明另一实施例的像素电路的结构示意图；
图4示出了本发明另一实施例的像素电路的具体示例的结构示意图；
图5示出了本发明实施例的像素电路的时序信号的波形示意图；
图6示出了本发明再一实施例的像素电路的结构示意图；
图7示出了本发明再一实施例的像素电路的对比度的对比示意图。
具体实施方式
为使本发明实施例的目的、技术方案和优点更加清楚，下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
目前，随着用户对视觉体验的要求越来越高，OLED显示设备相关产品的分辨率越来越高，显示屏的尺寸越来越大，容易导致设计过程中的余量(margin)不足，并且，由于薄膜晶体管(Thin Film Transistor，TFT)器件采用准分子激光退火(Excimer LaserAnnealing，ELA)方式制作，故导电沟道缺陷较多将会使残影现象更加突出，因此，存在OLED显示设备相关产品残影指标不达标的问题。
因此，为了解决上述问题，本发明实施例提供了一种像素电路，用于驱动发光元件，如图1所示，该像素电路主要包括：驱动电路1、第一数据写入电路2、第二数据写入电路3、第一复位电路4、第一发光控制电路5、第二发光控制电路6及第一电容C1，其中，第一复位电路4为双栅开关管。第一数据写入电路2的第一端连接数据信号Vdata，第二端分别与驱动电路1的第一端及第一发光控制电路5的第一端连接，控制端连接第二控制信号S2；第一发光控制电路5的第二端连接第一电源信号ELVDD，控制端连接发光控制信号EM；驱动电路1的第二端分别连接第二数据写入电路3的第一端和第二发光控制电路6的第一端，控制端连接第一电容C1的第一端；第二数据写入电路3的第二端与第一复位电路4的第一端、第一电容C1的第一端及驱动电路1的控制端连接，控制端连接第二控制信号S2；第一复位电路4的第二端与复位信号Vref连接，控制端连接第一控制信号S1，且第一复位电路4的中间节点与驱动电路1的第一端及第一发光控制电路5的第一端连接；第二发光控制电路6的控制端连接发光控制信号EM。
可选地，在本发明的一些实施例中，上述的驱动电路1、第一数据写入电路2、第二数据写入电路3、第一复位电路4、第一发光控制电路5、第二发光控制电路6分别包括：开关管器件；所述开关管器件的栅极作为相应电路的控制端，所述开关管器件的第一极作为相应电路的第一端，开关管器件的第二极作为相应电路的第二端。
具体地，如图2所示，驱动电路1包括第一开关管M1，该第一开关管M1的栅极作为驱动电路1的控制端，该第一开关管M1的第一极作为驱动电路1的第一端，该第一开关管M1的第二极作为驱动电路1的第二端；第一数据写入电路2包括第二开关管M2，该第二开关管M2的栅极作为第一数据写入电路2的控制端，该第二开关管M2的第一极作为第一数据写入电路2的第一端，该第二开关管M2的第二极作为第一数据写入电路2的第二端；第二数据写入电路3包括第三开关管M3，该第三开关管M3的栅极作为第二数据写入电路3的控制端，该第三开关管M3的第一极作为第二数据写入电路3的第一端，该第三开关管M3的第二极作为第二数据写入电路3的第二端；第一复位电路4包括第四开关管M4，该第四开关管M4的栅极作为第一复位电路4的控制端，该第四开关管M4的第一极作为第一复位电路4的第一端，该第四开关管M4的第二极作为第一复位电路4的第二端；第一发光控制电路5包括第五开关管M5，该第五开关管M5的栅极作为第一发光控制电路5的控制端，该第五开关管M5的第一极作为第一发光控制电路5的第一端，该第五开关管M5的第二极作为第一发光控制电路5的第二端；第二发光控制电路6包括第六开关管M6，该第六开关管M6的栅极作为第二发光控制电路6的控制端，该第六开关管M6的第一极作为第二发光控制电路6的第一端，该第六开关管M6的第二极作为第二发光控制电路6的第二端。
可选地，在本发明的一些实施例中，结合上述对应关系，本发明实施例的像素电路可具体为如图2所示的电路结构，该像素电路主要包括：第一开关管M1、第二开关管M2、第三开关管M3、第四开关管M4、第五开关管M5、第六开关管M6、第一电容C1，其中，该第四开关管M4为双栅开关管。
该第二开关管M2的第一端连接数据信号Vdata，第二端分别与该第一开关管M1的第一端及第五开关管M5的第一端连接，控制端连接第二控制信号S2；该第五开关管M5的第二端连接第一电源信号ELVDD，控制端连接发光控制信号EM；该第一开关管M1的第二端分别连接该第三开关管M3的第一端和第六开关管M6的第一端，控制端连接该第一电容C1的第一端；该第三开关管M3的第二端与该第四开关管M4的第一端、第一电容C1的第一端及第一开关管M1的控制端连接，控制端连接该第二控制信号S2；该第四开关管M4的第二端与该复位信号Vref连接，控制端连接该第一控制信号S1，且该第四开关管M4的中间节点与该第一开关管M1的第一端及第五开关管M5的第一端连接；该第六开关管M6的控制端连接该发光控制信号EM。
可选地，在本发明的一些实施例中，第一开关管M1、第二开关管M2、第三开关管M3、第五开关管M5、第六开关管M6均为PMOS晶体管，这样仅需制备一种类型的晶体管，可以减少掩膜、光刻等工艺步骤、简化工艺流程、节约生产成本。第一开关管M1、第二开关管M2、第三开关管M3第五开关管M5、第六开关管M6的控制端分别对应各个PMOS晶体管的栅极。
在本发明的一些实施例中，为了减小第三开关管M3的漏电流以及减小像素补偿电路的面积，第三开关管M3设置为双栅晶体管；当然，在其它实施例中，第三开关管M3也可以为普通晶体管。
上述像素电路的工作原理，即像素电路驱动方法，包括第一阶段、第二阶段以及第三阶段。图5为本发明实施例的像素电路的波形图。
在此实施例中，第一开关管M1、第二开关管M2、第五开关管M5、第六开关管M6均为PMOS晶体管，第三开关管M3及第四开关管M4为双栅晶体管。
如图2所示，在第一阶段T1，是复位阶段，第一控制信号S1输出低电平，第二控制信号S2、发光控制信号EM输出高电平，第一开关管M1、第二开关管M2、第三开关管M3、第五开关管M5、第六开关管M6关闭，第四开关管M4导通，通过第四开关管M4的中间节点将复位信号Vref传输至第一开关管M1。
在第一阶段T1，由于第四开关管M4的中间节点处与第一开关管M1的第一端连接，复位信号Vref能够传输至第一开关管M1的第一端，并且，复位信号Vref能够通过第四开关管M4传输至第一开关管M1的控制端，因此，在此阶段，能够对第一开关管M1的控制端及第一端进行复位，保证了屏体AA区各像素点内电场的一致性，进而消除迟滞效应，改善显示残影的问题。
在第二阶段T2，第二控制信号S2输出低电平，第一控制信号S1、发光控制信号EM输出高电平，第一开关管M1、第二开关管M2、第三开关管M3导通，第四开关管M4、第五开关管M5、第六开关管M6关闭。在此阶段，数据信号Vdata对第一开关管M1的控制端进行数据写入，并通过第一电容C1保持写入电压，由于数据电压经过第一开关管M1写入其控制端，故阈值电压也被同时写入，此阶段同时为阈值电压补偿阶段。第一开关管M1的控制端电压值为：Vg＝Vdata+Vth，其中Vth为阈值补偿电压。
在第三阶段T3，发光控制信号EM输出低电平，第一控制信号S1、第二控制信号S2输出高电平，第一开关管M1、第五开关管M5、第六开关管M6导通，第二开关管M2、第三开关管M3、第四开关管M4关闭；驱动电流沿第一电源ELVDD经第五开关管M5、第一开关管M1和第六开关管M6输出至与第六开关管M6的第二端相连的发光元件。在此阶段，驱动电流沿第一电源ELVDD经第五开关管M5、第一开关管M1和第六开关管M6输出至与第六开关管M6的第二端相连的发光元件，用于驱动发光元件发光。第一开关管M1的控制端电压值为：Vg＝Vdata+Vth，因此，驱动电流大小为：
I＝k*(Vgs-Vth)2＝k*(Vg-ELVDD-Vth)2＝k*(ELVDD-Vdata)2，
其中，
Figure BDA0002222619480000081
μp为空穴迁移率；Cox为单位面积的电容；
Figure BDA0002222619480000082
为第一开关管M1的宽长比。
本发明实施例还提供了一种像素电路，用于驱动发光元件，如图3所示，该像素电路主要包括：驱动电路1、第一数据写入电路2、第二数据写入电路3、第一复位电路4、第一发光控制电路5、第二发光控制电路6、第二复位电路7、第一电容C1，与上述任意实施例的像素电路相比，主要区别点在于增设了第二复位电路7。
其中，第二复位电路7的第一端连接复位信号Vref及第一复位电路4的第二端，第二端与第二发光控制电路6的第二端连接，控制端连接第一控制信号S1。
可选地，在本发明的一些实施例中，该第二复位电路7包括：开关管器件；所述开关管器件的栅极作为相应电路的控制端，所述开关管器件的第一极作为相应电路的第一端，开关管器件的第二极作为相应电路的第二端。
具体地，如图4所示，第二复位电路7包括第七开关管M7，该第七开关管M7的栅极作为第二复位电路7的控制端，该第七开关管M7的第一极作为第二复位电路7的第一端，该第七开关管M7的第二极作为第二复位电路7的第二端。
可选地，在本发明的一些实施例中，结合上述对应关系，本发明实施例的像素电路可具体为如图4所示的电路结构，该像素电路主要包括：第一开关管M1、第二开关管M2、第三开关管M3、第四开关管M4、第五开关管M5、第六开关管M6、第七开关管M7、第一电容C1，其中，该第四开关管M4为双栅开关管。
该第二开关管M2的第一端连接数据信号Vdata，第二端分别与该第一开关管M1的第一端及第五开关管M5的第一端连接，控制端连接第二控制信号S2；该第五开关管M5的第二端连接第一电源信号ELVDD，控制端连接发光控制信号EM；该第一开关管M1的第二端分别连接该第三开关管M3的第一端和第六开关管M6的第一端，控制端连接该第一电容C1的第一端；该第七开关管M7的第一端连接复位信号Vref，第二端与该第六开关管M6的第二端连接，控制端连接第一控制信号S1；该第三开关管M3的第二端与该第四开关管M4的第一端、第一电容C1的第一端及第一开关管M1的控制端连接，控制端连接该第二控制信号S2；该第四开关管M4的第二端与该复位信号Vref及第七开关管M7的第一端连接，控制端连接该第一控制信号S1，且该第四开关管M4的中间节点与该第一开关管M1的第一端及第五开关管M5的第一端连接；该第六开关管M6的控制端连接该发光控制信号EM。
可选地，在本发明的一些实施例中，第一开关管M1、第二开关管M2、第三开关管M3、第五开关管M5、第六开关管M6及第七开关管M7均为PMOS晶体管，这样仅需制备一种类型的晶体管，可以减少掩膜、光刻等工艺步骤、简化工艺流程、节约生产成本。第一开关管M1、第二开关管M2、第三开关管M3第五开关管M5、第六开关管M6及第七开关管M7的控制端分别对应各个PMOS晶体管的栅极。
上述像素电路的工作原理，即像素电路驱动方法，包括第一阶段、第二阶段以及第三阶段。图5为本发明实施例的像素电路的波形图。
在此实施例中，第一开关管M1、第二开关管M2、第五开关管M5、第六开关管M6及第七开关管M7均为PMOS晶体管，第三开关管M3及第四开关管M4为双栅晶体管。
如图4所示，在第一阶段T1，是复位阶段，第一控制信号S1输出低电平，第二控制信号S2、发光控制信号EM输出高电平，第一开关管M1、第二开关管M2、第三开关管M3、第五开关管M5、第六开关管M6关闭，第四开关管M4、第七开关管M7导通，通过复位信号Vref复位与第七开关管M7的第二端连接的发光元件的阳极，并通过第四开关管M4的中间节点将复位信号Vref传输至第一开关管M1。
在第一阶段T1，由于第四开关管M4的中间节点处与第一开关管M1的第一端连接，复位信号Vref能够传输至第一开关管M1的第一端，并且，复位信号Vref能够通过第四开关管M4传输至第一开关管M1的控制端，因此，在此阶段，能够对第一开关管M1的控制端及第一端进行复位，保证了屏体AA区各像素点内电场的一致性，进而消除迟滞效应，改善显示残影的问题。并且，由于在此阶段，第七开关管M7是导通的，复位信号Vref还可通过第七开关管M7传输至与第七开关管7的第二端相连接的发光元件，以对发光元件进行复位，例如，当该发光元件为OLED时，用以对该OLED的阳极进行复位。
在第二阶段T2，第二控制信号S2输出低电平，第一控制信号S1、发光控制信号EM输出高电平，第一开关管M1、第二开关管M2、第三开关管M3导通，第四开关管M4、第五开关管M5、第六开关管M6、第七开关管M7关闭。在此阶段，数据信号Vdata对第一开关管M1的控制端进行数据写入，并通过第一电容C1保持写入电压，由于数据电压经过第一开关管M1写入其控制端，故阈值电压也被同时写入，此阶段同时为阈值电压补偿阶段。第一开关管M1的控制端电压值为：Vg＝Vdata+Vth，其中Vth为阈值补偿电压。
在第三阶段T3，发光控制信号EM输出低电平，第一控制信号S1、第二控制信号S2输出高电平，第一开关管M1、第五开关管M5、第六开关管M6导通，第二开关管M2、第三开关管M3、第四开关管M4、第七开关管M7关闭；驱动电流沿第一电源ELVDD经第五开关管M5、第一开关管M1和第六开关管M6输出至与第六开关管M6的第二端相连的发光元件。在此阶段，驱动电流沿第一电源ELVDD经第五开关管M5、第一开关管M1和第六开关管M6输出至与第六开关管M6的第二端相连的发光元件，用于驱动发光元件发光。
由此可见，本发明实施例的像素电路，在T1阶段(复位阶段)，由于第四开关管M4的中间节点处与第一开关管M1的第一端连接，复位信号Vref能够传输至第一开关管M1的第一端，并且，复位信号Vref能够通过第四开关管M4传输至第一开关管M1的控制端，因此，在复位阶段，能够对第一开关管M1的控制端及第一端进行复位，保证了屏体AA区各像素点内电场的一致性，进而消除迟滞效应，改善残影。
在实际应用中，由于OLED显示设备产品的分辨率的提升，也会导致充电时间减少(充电时间＝频率/行数，分辨率：列数RGB*行数)，而尺寸越来越大，导致RC负载增加，进而导致对比度不足。
为了解决上述问题，在本发明的一些实施例中，在像素电路中还设置有第二电容C2，如图6所示，第二电容C2的一端连接第二控制信号S2，另一端连接第一开关管M1的控制端。在本发明实施例中，该第一开关管M1是驱动管，在第二控制信号S2信号走线与第一开关管M1的控制端之间增设第二电容C2，通过第二控制信号S2耦合提高第一开关管M1控制端的电压，进而提高产品对比度。
图7是在增设第二电容C2前后，该像素电路对比度的对比示意图，图7所示的两个电流分别为增设电容C2前后的Imin值，对比度＝Lmax/Lmin≈Imax/Imin，其中，L指亮度值，亮度值与电流接近线性关系。由于产品亮度要求，所以Imax不变。可以看出，在增设电容C2前，电流值Imin为131.1pA，而在增设电容C2后，电流值Imin为1.014pA，因此，基于上述对比度的公式可知，通过增设第二电容C2，理想状态下，该像素电路对比度可以提高100倍以上，实际应用中，可以将对比度从100000:1提高到1000000:1以上。因此，通过在第二控制信号S2信号走线与第一开关管M1的控制端之间增设第二电容C2，能够有效提高产品对比度。
本发明实施例还提供一种像素电路，该像素电路主要包括发光元件及上述任意实施例所述的像素电路。该发光元件与第二发光控制电路及第二复位电路的第二端连接，发光元件的另一端连接第二电源信号ELVSS。可选地，该发光元件可以是OLED、DCEL、LED和电阻式灯泡中的任意一种，本发明并不以此为限。
本发明实施例还提供一种显示面板，包括上述任意实施例所述的像素电路。
本发明实施例还提供一种显示装置，包括上述任意实施例所述的显示面板。该显示装置及显示面板中设置了本发明实施例的像素电路，因此能够有效改善显示残影的问题；进一步地，还能够有效提高显示对比度，提升用户的使用体验。
虽然结合附图描述了本发明的实施例，但是本领域技术人员可以在不脱离本发明的精神和范围的情况下作出各种修改和变型，这样的修改和变型均落入由所附权利要求所限定的范围之内。

Claims (10)

1.一种像素电路，用于驱动发光元件，其特征在于，包括：驱动电路、第一数据写入电路、第二数据写入电路、第一复位电路、第一发光控制电路、第二发光控制电路、第一电容，其中，所述第一复位电路为双栅开关管，所述第一数据写入电路的第一端连接数据信号(Vdata)，第二端分别与所述驱动电路的第一端及第一发光控制电路的第一端连接，控制端连接第二控制信号(S2)；
所述第一发光控制电路的第二端连接第一电源信号(ELVDD)，控制端连接发光控制信号(EM)；
所述驱动电路的第二端分别连接所述第二数据写入电路的第一端和第二发光控制电路的第一端，控制端连接所述第一电容的第一端；
所述第二数据写入电路的第二端与所述第一复位电路的第一端、第一电容的第一端及驱动电路的控制端连接，控制端连接所述第二控制信号(S2)；
所述第一复位电路的第二端与所述复位信号(Vref)连接，控制端连接所述第一控制信号(S1)，且所述第一复位电路的中间节点与所述驱动电路的第一端及第一发光控制电路的第一端连接；
所述第二发光控制电路的控制端连接所述发光控制信号(EM)。
2.根据权利要求1所述的像素电路，其特征在于，还包括：第二电容(C2)，所述第二电容(C2)的一端连接所述第二控制信号(S2)，另一端连接所述驱动电路的控制端。
3.根据权利要求1所述的像素电路，其特征在于，还包括：第二复位电路，所述第二复位电路的第一端连接复位信号(Vref)及所述第一复位电路的第二端，第二端与所述第二发光控制电路的第二端连接，控制端连接第一控制信号(S1)。
4.根据权利要求3所述的像素电路，其特征在于，所述驱动电路、第一数据写入电路、第二数据写入电路、第一复位电路、第一发光控制电路、第二发光控制电路及第二复位电路分别包括：开关管器件；所述开关管器件的栅极作为相应电路的控制端，所述开关管器件的第一极作为相应电路的第一端，开关管器件的第二极作为相应电路的第二端。
5.根据权利要求1所述的像素电路，其特征在于，所述第二数据写入电路为双栅开关管。
6.根据权利要求4所述的像素电路，其特征在于，所述开关管器件为PMOS晶体管。
7.根据权利要求1-6中任一项所述的像素电路，其特征在于，还包括：发光元件，所述发光元件的一端与所述第二发光控制电路的第二端连接，另一端连接第二电源信号(ELVSS)。
8.一种像素电路驱动方法，应用于如权利要求1-7中任一项所述的像素电路，其特征在于，包括第一阶段、第二阶段及第三阶段，其中，
在所述第一阶段中，所述第一控制信号(S1)输出低电平，第二控制信号(S2)、发光控制信号(EM)输出高电平，第一数据写入电路、第二数据写入电路、第一发光控制电路、第二发光控制电路关闭，第一复位电路导通，通过所述第一复位电路的中间节点将所述复位信号(Vref)传输至所述驱动电路；
在所述第二阶段中，所述第二控制信号(S2)输出低电平，第一控制信号(S1)、发光控制信号(EM)输出高电平，驱动电路、第一数据写入电路、第二数据写入电路导通，第一复位电路、第一发光控制电路、第二发光控制电路关闭，所述数据信号(Vdata)写入所述驱动电路的控制端，并通过所述第一电容(C1)保持写入电压；
在所述第三阶段中，所述发光控制信号(EM)输出低电平，所述第一控制信号(S1)、第二控制信号(S2)输出高电平，第一发光控制电路、第二发光控制电路导通，第一数据写入电路、第二数据写入电路、第一复位电路关闭；驱动电流沿第一电源(ELVDD)经第一发光控制电路、驱动电路和第二发光控制电路输出至与所述第二发光控制电路的第二端相连的发光元件。
9.一种显示面板，其特征在于，包括如权利要求1-7中任一项所述的像素电路。
10.一种显示装置，其特征在于，包括如权利要求9所述的显示面板。
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