JP2021184487A - 実装基板及び実装基板の製造方法 - Google Patents

実装基板及び実装基板の製造方法 Download PDF

Info

Publication number
JP2021184487A
JP2021184487A JP2021127724A JP2021127724A JP2021184487A JP 2021184487 A JP2021184487 A JP 2021184487A JP 2021127724 A JP2021127724 A JP 2021127724A JP 2021127724 A JP2021127724 A JP 2021127724A JP 2021184487 A JP2021184487 A JP 2021184487A
Authority
JP
Japan
Prior art keywords
substrate
electronic component
layer
electrode
metal member
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP2021127724A
Other languages
English (en)
Other versions
JP7245452B2 (ja
Inventor
悟 倉持
Satoru Kuramochi
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Dai Nippon Printing Co Ltd
Original Assignee
Dai Nippon Printing Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Dai Nippon Printing Co Ltd filed Critical Dai Nippon Printing Co Ltd
Priority to JP2021127724A priority Critical patent/JP7245452B2/ja
Publication of JP2021184487A publication Critical patent/JP2021184487A/ja
Priority to JP2023039105A priority patent/JP7569516B2/ja
Application granted granted Critical
Publication of JP7245452B2 publication Critical patent/JP7245452B2/ja
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/18High density interconnect [HDI] connectors; Manufacturing methods related thereto

Landscapes

  • Production Of Multi-Layered Print Wiring Board (AREA)
  • Structure Of Printed Boards (AREA)
  • Cooling Or The Like Of Semiconductors Or Solid State Devices (AREA)

Abstract

【課題】半導体チップの背面に放熱用の部材を取り付けても半導体装置全体の厚みが増加しない実装基板及びその製造方法を提供する。【解決手段】実装基板10は、第1面13及び第1面13の反対側に位置する第2面14を有する基板12と、基板12の第1面側に位置し、基板12とは反対の側に露出した電極52を有する電子部品50と、電子部品50に対して基板12の第1面13と平行な方向に位置し、且つ、10μm以上の厚さを有する金属部材61と、電子部品50及び金属部材61を少なくとも部分的に覆う絶縁層34と、絶縁層上に位置する第1部分311と、絶縁層34を貫通し、第1部分311と電子部品50の電極52とを電気的に接続する第2部分312と、を有する導電層31と、を備える。【選択図】図1

Description

本開示の実施形態は、実装基板に関する。また、本開示の実施形態は、実装基板の製造方法に関する。
従来から、半導体チップなどの電子部品が搭載された実装基板に関する種々の技術が提案されている。例えば特許文献1には、回路面を下に向けたフェイスダウンの状態で半導体チップを基板上に実装したフリップチップボンディング方式の半導体装置が開示されている。特許文献1に記載の半導体装置においては、半導体チップで生じた熱を効率的に外部に放出するため、半導体チップの背面に、冷媒路が形成された冷媒路部材が取り付けられている。
特開2010−73866号公報
特許文献1のように半導体チップの背面に放熱用の部材を取り付けると、部材の分だけ半導体装置全体の厚みが増加してしまう。
本開示の実施形態は、このような課題を効果的に解決し得る実装基板を提供することを目的とする。
本開示の一実施形態は、第1面及び前記第1面の反対側に位置する第2面を有する基板と、前記基板の前記第1面側に位置し、前記基板とは反対の側に露出した電極を有する電子部品と、前記電子部品に対して前記基板の前記第1面と平行な方向に位置し、且つ10μm以上の厚さを有する金属部材と、前記電子部品及び前記金属部材を少なくとも部分的に覆う絶縁層と、前記絶縁層上に位置する第1部分と、前記絶縁層を貫通し、前記第1部分と前記電子部品の前記電極とを電気的に接続する第2部分と、を有する導電層と、を備える、実装基板である。
本開示の一実施形態による実装基板において、前記基板には、前記基板の前記第1面の法線方向に沿って見た場合に前記金属部材に重なる第1貫通孔が設けられており、前記実装基板は、前記第1貫通孔内に位置する第1金属層を更に備えてもよい。
本開示の一実施形態による実装基板において、前記基板には、前記基板の前記第1面の法線方向に沿って見た場合に前記電子部品に重なる第2貫通孔が設けられており、前記実装基板は、前記第2貫通孔内に位置する第2金属層を更に備えてもよい。
本開示の一実施形態による実装基板において、前記第1面から前記第2面まで前記基板を貫通する貫通電極と、前記絶縁層を貫通し、前記導電層の前記第1部分と前記貫通電極とを電気的に接続する接続部材と、を更に備えてもよい。
本開示の一実施形態による実装基板において、前記貫通電極は、導電性粒子とバインダとを含む導電性部材を介して、前記接続部材に電気的に接続していてもよい。
本開示の一実施形態による実装基板において、前記貫通電極は、インダクタの一部であってもよい。
本開示の一実施形態による実装基板において、前記貫通電極に電気的に接続するキャパシタを更に備えていてもよい。
本開示の一実施形態による実装基板において、前記基板は、ガラスを含有してもよい。
本開示の一実施形態は、第1面及び前記第1面の反対側に位置する第2面を有する基板を準備する工程と、前記基板の前記第1面側に、前記基板とは反対の側に露出した電極を有する電子部品、及び10μm以上の厚さを有する金属部材を配置する工程と、前記電子部品及び前記金属部材を少なくとも部分的に覆う絶縁層を形成する工程と、前記絶縁層上に位置する第1部分と、前記絶縁層を貫通し、前記第1部分と前記電子部品の前記電極とを電気的に接続する第2部分と、を有する導電層を形成する工程と、を備える、実装基板の製造方法である。
本開示の一実施形態による実装基板の製造方法において、前記基板は、前記第1面から前記第2面まで前記基板を貫通する貫通電極を備え、前記導電層を形成する工程は、前記絶縁層を貫通し、前記導電層の前記第1部分と前記貫通電極とを電気的に接続する接続部材を形成する工程を含んでもよい。
本開示の一実施形態は、支持面を有する支持基板を準備する工程と、前記支持基板の前記支持面側に、前記支持基板の側に露出した電極を有する電子部品、及び10μm以上の厚さを有する金属部材を少なくとも含む構造部を配置する工程と、前記構造部に、第1面及び前記第1面の反対側に位置する第2面を有する基板を接合する工程と、前記支持基板を前記構造部から分離する工程と、前記電子部品及び前記金属部材を少なくとも部分的に覆う絶縁層を形成する工程と、前記絶縁層上に位置する第1部分と、前記絶縁層を貫通し、前記第1部分と前記電子部品の前記電極とを電気的に接続する第2部分と、を有する導電層を形成する工程と、を備える、実装基板の製造方法である。
本開示の一実施形態による実装基板の製造方法において、前記基板は、前記第1面から前記第2面まで前記基板を貫通する貫通電極を備え、前記絶縁層を貫通し、前記貫通電極と電気的に接続する接続部材を形成する工程を更に備え、前記導電層を形成する工程は、前記接続部材と前記導電層の前記第1部分とを電気的に接続する工程を含んでもよい。
本開示の一実施形態による実装基板の製造方法において、前記基板を接合する工程は、導電性粒子とバインダとを含む導電性ペーストを介して前記貫通電極と前記接続部材とを接合する工程を含んでもよい。
本開示の一実施形態による実装基板の製造方法において、前記金属部材の配置は、前記金属部材を接着材で接着することを含んでもよい。
本開示の一実施形態による実装基板の製造方法において、前記金属部材の配置は、めっき処理により前記金属部材を形成することを含んでもよい。
本開示の一実施形態による実装基板の製造方法において、前記電子部品の配置は、前記電子部品を接着材で接着することを含んでもよい。
本開示の実施形態によれば、より放熱性に優れた実装基板を提供することができる。
一実施形態による実装基板を示す断面図である。 一実施形態の第1の変形例に係る実装基板を示す断面図である。 一実施形態の第2の変形例に係る実装基板を示す断面図である。 一実施形態の第3の変形例に係る実装基板を示す断面図である。 一実施形態の第4の変形例に係る実装基板を示す断面図である。 第1の実施の形態に係る実装基板の製造工程を示す図である。 第1の実施の形態に係る実装基板の製造工程を示す図である。 第1の実施の形態に係る実装基板の製造工程を示す図である。 第2の実施の形態に係る実装基板の製造工程を示す図である。 第2の実施の形態に係る実装基板の製造工程を示す図である。 第2の実施の形態に係る実装基板の製造工程を示す図である。 第2の実施の形態に係る実装基板の製造工程を示す図である。 第2の実施の形態に係る実装基板の製造工程を示す図である。 第2の実施の形態に係る実装基板の製造工程を示す図である。
以下、一実施形態に係る実装基板の構成及びその製造方法について、図面を参照しながら詳細に説明する。なお、以下に示す実施形態は本開示の実施形態の一例であって、本開示はこれらの実施形態に限定して解釈されるものではない。また、本明細書において、「基板」、「基材」、「シート」や「フィルム」など用語は、呼称の違いのみに基づいて、互いから区別されるものではない。例えば、「基板」や「基材」は、シートやフィルムと呼ばれ得るような部材も含む概念である。更に、本明細書において用いる、形状や幾何学的条件並びにそれらの程度を特定する、例えば、「平行」や「直交」等の用語や長さや角度の値等については、厳密な意味に縛られることなく、同様の機能を期待し得る程度の範囲を含めて解釈することとする。また、本実施形態で参照する図面において、同一部分または同様な機能を有する部分には同一の符号または類似の符号を付し、その繰り返しの説明は省略する場合がある。また、図面の寸法比率は説明の都合上実際の比率とは異なる場合や、構成の一部が図面から省略される場合がある。
実装基板
まず、図1を参照して、一実施形態に係る実装基板10の構成について説明する。図1は、本実施形態による実装基板10を示す断面図である。
図1に示すように、実装基板10は、基板12、電子部品50、絶縁層34、導電層31及び金属部材61を備える。以下、実装基板10の各構成要素について説明する。
(基板)
基板12は、当該基板の厚み方向Dにおける上側D1の第1面13、及び、第1面13の反対側すなわち下側に位置する第2面14を有する。上側D1の第1面13は、上述の電子部品50が実装される面である。なお「上側」及び「下側」という表現は、第1面13と第2面14との間の相対的な位置関係に基づく表現に過ぎず、製造時や使用時の実装基板10の姿勢などを限定するものではない。
基板12は、一定の絶縁性を有する限り、有機基板であっても無機基板であってもよいが、一定の絶縁性を有する無機材料を含有することが好ましい。例えば、基板12は、ガラス基板、石英基板、サファイア基板、樹脂基板、シリコン基板、炭化シリコン基板、アルミナ(Al2O3)基板、窒化アルミ(AlN)基板、酸化ジリコニア(ZrO2)基板など、又は、これらの基板が積層されたものである。基板12は、アルミニウム基板、ステンレス基板など、導電性を有する材料から構成された基板を部分的に含んでいてもよい。
基板12は、ガラスを含有することがより好ましく、ガラス基板であることがさらに好ましい。当該ガラスの例としては、無アルカリガラスなどのガラスを挙げることができる。無アルカリガラスとは、ナトリウムやカリウムなどのアルカリ成分を含まないガラスである。無アルカリガラスは、例えば、アルカリ成分の代わりにホウ酸を含む。また、無アルカリガラスは、例えば、酸化カルシウムや酸化バリウムなどのアルカリ土類金属酸化物を含む。無アルカリガラスの例としては、旭硝子製のEN−A1や、コーニング製のイーグルXGなどを挙げることができる。基板12がガラスを含有することにより、基板の絶縁性及び熱への安定性が向上する。
基板12の厚さは特に制限はないが、例えば、100μm以上且つ800μm以下の厚さの基板12を使用することが好ましい。より好ましくは、基板12は、200μm以上且つ600μm以下の厚さを有する。基板12の厚さを100μm以上とすることにより、基板12のたわみが大きくなることを抑制できる。このため、実装基板10の製造時における基板12のハンドリングが困難になることを抑制できる。また、基板12の厚さを800μm以下とすることにより、基板12に後述の第1貫通孔20等を形成する場合において、第1貫通孔20等の形成に要する時間が長くなって実装基板10の製造コストが上昇してしまうことを抑制できる。なお「厚さ」とは、対象となる構成要素の、基板12の第1面13の法線方向における寸法を意味する。
(電子部品)
電子部品50は、第1面13上に位置し、導電層31を通じて電気信号を送信または受信する。電子部品50は、本体部51と、本体部51の上側D1に位置する電極52と、を有する。
本体部51は、例えば、LSI(Large-Scale Integration)、MEMS(Micro Electro Mechanical Systems)およびディスクリート部品などのデバイスチップである。MEMSとは、機械要素部品、センサ、アクチュエータ、電子回路などが1つの基板上に集積化された電子デバイスである。本体部51は、シリコンなどから構成された基材を少なくとも含む。
電極52は、電子部品50の上側D1に露出している。このため、電極52は、電子部品50を他の構成要素に電気的に接続するための端子として機能することができる。
図1に示すように、電子部品50は、電子部品50の下側D2の端面(以下、「電子部品50の下端面」とも記す。)において第1面13と接していてもよい。若しくは、図示はしないが、電子部品50の下端面と第1面13との間に絶縁層などのその他の構成要素が存在していてもよい。電子部品50の下端面を第1面13に接着する場合には、例えば、ダイアタッチメント材などの図示しない接着材を介して第1面13に接着されている。
電子部品50の厚さは、特に限定されないが、例えば50μm以上100μm以下である。
(絶縁層)
絶縁層34は、電子部品50及び金属部材61を少なくとも部分的に覆い、且つ絶縁性を有する層である。絶縁層34の材料としては、絶縁性を有する限りにおいて特に限定されないが、ポリイミド、エポキシ、アクリル樹脂、ポリベンゾオキサゾール(PBO)などの有機材料を用いることができる。
(導電層)
導電層31は、絶縁層34又は電子部品50の上側D1に少なくとも部分的に位置する、導電性を有する層である。導電層31は、例えば、電子部品50などによって送信又は受信される電気信号を伝達するための配線として機能する。
導電層31は、絶縁層34の上側D1に位置する第1部分311と、電子部品50の電極52まで絶縁層34を貫通する第2部分312とを有する。厚み方向Dにおける第2部分312の一端は第1部分311に接続されており、他端は電極52に接続されている。
導電層31の構成は、導電層31が導電性を有する限りにおいて特に限定されないが、例えば、導電層31は、導電性を有する単一の層から構成されていてもよく、若しくは、導電性を有する複数の層を含んでいてもよい。例えば、導電層31は、絶縁層34上に位置するシード層と、シード層上に位置するめっき層とを有していてもよい。シード層は、電解めっき処理によってめっき層を形成する電解めっき工程の際に、めっき液中の金属イオンを析出させてめっき層を成長させるための土台となる、導電性を有する層である。シード層の材料としては、銅などの導電性を有する材料を用いることができる。シード層の材料は、めっき層の材料と同一であってもよく、異なっていてもよい。例えば、シード層は、チタンと銅を順に積層した積層膜や、クロムなどであってもよい。シード層は、例えば、スパッタリング法、蒸着法、無電解めっき法などによって形成してもよい。めっき層は、電解めっき処理によって形成される、導電性を有する層である。めっき層は、銅を含有する。めっき層は、銅と、銅以外の金属、例えば、金、銀、白金、ロジウム、スズ、アルミニウム、ニッケル、クロムとの合金を含有していてもよく、または、銅と銅以外の金属とを積層したものであってもよい。
(金属部材)
本実施の形態に係る実装基板10を基板12の第1面13の法線方向に沿って見た場合、第1面13の面内方向における実装基板10の端部10eと電子部品50の端部50eとの間には、上述の導電層31などの配線が存在する。導電層31などの配線は、半導体のウェハプロセスを用いて形成され得る配線である。このため、ワイヤボンディングやバンプなどを用いて電子部品50と他の構成要素との間の電気的な接続を実現する場合に比べて、配線の厚さや長さを低減することができる。これにより、配線の密度を高めることができる。
一方、電子部品50の端部50eよりも外側に配線が存在することは、電子部品50の端部50eから実装基板10の端部10eまでの間に領域が存在することを意味する。このため、電子部品50の端部50eが実装基板10の端部10eに近接している場合に比べて、電子部品50で生じた熱が実装基板10の端部10eから放出されにくくなる。また、本実施の形態において、基板12は、好ましくはガラスを含む。一方、ガラスの熱伝導率は、半導体ウェハで一般に用いられるシリコンの熱伝導率よりも低い。このため、第1面13の面内方向における熱伝導への基板12の寄与は小さい。この点でも、電子部品50で生じた熱が実装基板10の端部10eから放出されにくくなっている。
このような課題に鑑みて、本実施の形態においては、実装基板10に金属部材61を設けることを提案する。金属部材61は、電子部品50に対して基板12の第1面13と平行な方向に位置する。ここで、「平行な方向に位置する」とは、基板12の第1面13の面内方向に沿って見た場合に金属部材61が少なくとも部分的に電子部品50と重なっていることを意味する。
金属部材61を配置することにより、実装基板10における金属部材61を配置した部分の熱伝導性が高くなり、電子部品50の発する熱が第1面13の面内方向に逃げ易くなる。従って、実装基板の放熱性を向上させることができる。また、金属部材61を、電子部品50に対して基板12の第1面13と平行な方向に配置することにより、実装基板10の厚さが金属部材61の厚さの分だけ増加することを抑制することができる。以上より、実装基板10の全体の厚さを抑えつつ、実装基板10の放熱性を向上させることができる。
図1に示すように、金属部材61は、金属部材61の下側D2の端面(以下、「金属部材61の下端面」とも記す。)において第1面13と接していてもよい。若しくは、図示はしないが、金属部材61の下端面と第1面13との間に絶縁層などのその他の構成要素が存在していてもよい。金属部材61の下端面を第1面13に接着する場合には、例えば、ダイアタッチメント材などの図示しない接着材を介して第1面13に接着されている。
金属部材61の材料としては、絶縁層34よりも高い熱伝導率を有する材料が用いられる。例えば金属部材61は、銅、アルミニウム、銀又は鉄の少なくともいずれか一つを含むことができる。金属部材61の熱伝導率をより高めるため、金属部材61としてアルマイト処理が施されたアルミニウム箔を用いてもよい。また、例えば金属部材61は、ニッケルを含む鉄合金であってもよい。ニッケルを含む鉄合金の具体例としては、34質量%以上38質量%以下のニッケルを含む鉄合金、いわゆるインバー材や、約42質量%のニッケルを含む鉄合金、いわゆる42合金等を挙げることができる。
基板12の第1面13の面内方向における金属部材61と電子部品50との間の最短距離は、好ましくは10μm以上30μm以下である。これにより、電子部品50で生じた熱を効率的に金属部材61に伝達することができる。
金属部材61は、配線を構成する導電層の厚さよりも大きな厚さを有し、例えば10μm以上の厚さを有する。より好ましくは、金属部材61は、50μm以上の厚さを有する。金属部材61が上記の厚さを有することにより、金属部材61の断面積を配線に比べて顕著に大きくすることができる。これにより、基板12の第1面13の面内方向における金属部材61の熱抵抗を低くすることができる。従って、電子部品50で生じた熱を第1面13の面内方向において効率的に伝達して熱を外部へ放出することができる。
金属部材61の厚さは、電子部品50の厚さを大きく超えないことが好ましい。金属部材61の厚さは、例えば150μm以下であり、100μm以下であってもよい。また、好ましくは、金属部材61の厚さは、電子部品50の厚さ以下である。これにより、金属部材61を設けることに起因して実装基板10全体の厚さが増大してしまうことを抑制することができる。
(第1貫通孔及び第1金属層)
基板12には、基板12の第1面13の法線方向に沿って見た場合に金属部材61に重なる第1貫通孔20が設けられていてもよい。この場合、好ましくは、第1貫通孔20内に、基板12よりも高い熱伝導率を有する部材が設けられる。例えば、第1貫通孔20内に第1金属層62が位置していてもよい。これにより、例えば基板12がガラスを含む場合等、基板12の熱伝導率が低い場合であっても、電子部品50から金属部材61に伝わった熱を、第1金属層62を介して基板12の厚み方向Dに逃がすことができる。このため、実装基板10の放熱性をより向上させることができる。
第1貫通孔20の形状について説明する。第1貫通孔20の側壁は、基板12の第1面13の法線方向に沿って広がっていてもよい。若しくは、側壁が、基板12の第1面13の法線方向からずれた方向で広がっていてもよく、また、側壁の一部が湾曲していてもよい。
次に、第1貫通孔20の寸法について説明する。第1貫通孔20の長さ、すなわち第1面13の法線方向における第1貫通孔20の寸法は、基板12の厚みに等しい。第1貫通孔20の幅、すなわち第1面13と平行な方向における第1貫通孔20の寸法は、例えば40μm以上且つ150μm以下である。また、第1貫通孔20の幅に対する長さの比、すなわち第1貫通孔20のアスペクト比は、例えば4以上且つ10以下である。
金属部材61と重なるよう配置される第1貫通孔20の個数は、実装基板10が適切な放熱性を有することができるよう決定される。例えば、基板12の第1面13のうち金属部材61と重なる領域において、第1貫通孔20の密度が9個/mm2以上であることが好ましい。また、基板12の強度を確保し、かつ実装基板10の製造にかかる時間及びコストを抑えるためには、基板12の第1面13のうち金属部材61と重なる領域において、第1貫通孔20の密度が50個/mm2以下であることが好ましい。
第1金属層62の形状は、実装基板10が適切な放熱性を有することができる限りにおいて特に限定されない。例えば、図1に示すように、第1貫通孔20内に第1金属層62が充填されていてもよい。すなわち、第1金属層62がいわゆるフィルドビアを構成していてもよい。また、第1金属層62の厚みが第1貫通孔20の幅よりも小さく、このため、第1貫通孔20の内部には第1金属層62が存在しない空間があってもよい。すなわち、第1金属層62は、いわゆるコンフォーマルビアを構成していてもよい。また、第1金属層62の形状をコンフォーマルビアとする場合においては、第1貫通孔20の内部の空間は、空洞であってもよいし、有機層等により充填されていてもよい。第1貫通孔20の内部の空間が有機層により充填される場合においては、絶縁層34を構成するのに用いる有機材料と同じものにより充填されていてもよい。
なお、図1に示してはいないが、第1金属層62は、第1貫通孔20の側壁から基板12の第1面13上又は第2面14上にまで広がっていてもよい。
第1金属層62は、導電層31と同様に、第1貫通孔20の側壁側から順に積層されたシード層及びめっき層を含んでいてもよい。第1金属層62を構成する材料は、導電層31の材料と同様であってもよい。
(本実施の形態の効果)
本実施の形態に係る実装基板10においては、電子部品50の端部50eから実装基板10の端部10eまでの間に、導電層や絶縁層などの構成要素が位置することができる領域が存在する。このため、電子部品50の電極52に電気的に接続された配線などを、上述の導電層31などを用いて、電子部品50の端部50eから実装基板10の端部10eまでの間の領域に設けることができる。この場合、半導体のウェハプロセスを用いて導電層31を形成することにより、配線を微細化することができる。これにより、ワイヤボンディングなどを用いて電子部品50と他の構成要素との間の電気的な接続を実現する場合に比べて、配線の密度を高めることができる。
また、本実施の形態に係る実装基板10においては、電子部品50の電極52が、電子部品50の上側D1に露出している。このため、バンプを用いることなく電子部品50の電極52を導電層31に電気的に接続することができる。このことにより、電子部品50を基板12上に簡便に搭載することができる。
また、本実施の形態に係る実装基板10は、電子部品50に対して基板12の第1面13と平行な方向に位置する金属部材61を備える。これにより、実装基板10の全体の厚さを抑えつつ、電子部品50の発する熱が第1面13の面内方向に逃げ易くすることができる。これにより、実装基板10の放熱性を向上させることができる。
また、本実施の形態に係る実装基板10によれば、金属部材61を通じて逃げる熱を、さらに第1金属層62を介して基板12の厚み方向Dにも逃がすことができる。これにより、実装基板10の放熱性をより向上させることができる。
(実装基板の第1の変形例)
次に、上述の実施の形態の第1の変形例について説明する。図2は、第1の変形例による実装基板10を示す断面図である。
図2に示すように、第1の変形例の実装基板10においては、基板12には、第1面13の法線方向に沿って見た場合に電子部品50に重なる第2貫通孔21が設けられている。第2貫通孔21内には第2金属層63が位置する。
第2貫通孔21の形状、寸法及び個数、並びに第2金属層63の形状は、それぞれ第1貫通孔20及び第1金属層62と同様であってもよい。
第2金属層63は、導電層31と同様に、第2貫通孔21の側壁側から順に積層されたシード層及びめっき層を含んでいてもよい。第2金属層63を構成する材料は、導電層31に用いることができる材料と同様であってもよい。
第1の変形例によれば、例えば基板12がガラスを含む場合等、基板12の熱伝導率が低い場合であっても、電子部品50から発された熱を、第2金属層63を介して基板12の厚み方向Dに逃がすことができる。このため、実装基板10の放熱性をより向上させることができる。
(実装基板の第2の変形例)
次に、上述の実施の形態の第2の変形例について説明する。図3は、第2の変形例による実装基板10を示す断面図である。
図3に示すように、第2の変形例の実装基板10は、基板12を貫通する貫通電極23と、絶縁層34を貫通し、導電層31の第1部分311と貫通電極23とを電気的に接続する接続部材32とを備える。
第3貫通孔22の形状及び寸法、並びに貫通電極23の形状及び材料は、貫通電極23が導電性を有する限りにおいて、特には限定されない。例えば、第3貫通孔22及び貫通電極23は、それぞれ第1貫通孔20及び第1金属層62と同様の形状及び材料を有していてもよい。
貫通電極23は、導電層31と同様に、第3貫通孔22の側壁側から順に積層されたシード層及びめっき層を含んでいてもよい。貫通電極23を構成する材料は、導電層31の材料と同様であってもよい。
接続部材32は、導電層31と同様に、絶縁層34の上側D1に順に積層されたシード層及びめっき層を含んでいてもよい。第2金属層63を構成する材料は、導電層31の材料と同様であってもよい。
貫通電極23は、図3には示していない導電性粒子とバインダとを少なくとも含む導電性部材を介して、接続部材32に電気的に接続されていてもよい。導電性部材は、後述する導電性ペーストが固化することにより形成される部材である。
(実装基板の第3の変形例)
次に、上述の実施の形態の第3の変形例として、第2の変形例において示した貫通電極23が、インダクタの一部を構成する例について説明する。図4は、第3の変形例による実装基板10を示す断面図である。図4は、図3のA−A断面に対応する断面図である。
図4に示すように、第3の変形例の実装基板10においては、導電層31、貫通電極23および基板12の第2面14側に位置する第2面第1導電層41が、らせん状の構造体を構成するように接続されている。すなわち、貫通電極23は、導電層31および基板12の第2面14側に位置する第2面第1導電層41とともに、インダクタ17を構成している。
第2面第1導電層41は、基板12の第2面14側に位置する、導電性を有する層である。第2面第1導電層41の少なくとも一部は、貫通電極23と電気的に接続している。第2面第1導電層41は、貫通電極23と電気的に接続していない部分を有していてもよい。
第2面第1導電層41は、導電層31と同様に、基板12の第2面14上に順に積層されたシード層及びめっき層を含んでいてもよい。第2面第1導電層41を構成する材料は、導電層31の材料と同様であってもよい。
第3の変形例において、金属部材61は、図4の通り、第1面13においてインダクタ17を構成する貫通電極23が位置する第3貫通孔22が並ぶ方向D5及び方向D5に直交する方向D6のそれぞれにおいて広がることが好ましい。これにより、インダクタ17の発する熱が逃げ易くなり、実装基板10の放熱性を向上させることができるためである。
第3の変形例によれば、インダクタ17と電子部品50とを導電層31を介して電気的に接続することができるため、インダクタ17を有する基板12に電子部品50を簡便に搭載することができる。また、金属部材61を備えることにより、電子部品50やインダクタ17の発する熱を第1面13の面内方向に逃げ易くすることができ、実装基板10の放熱性を向上させることができる。
(実装基板の第4の変形例)
次に、上述の実施の形態の第4の変形例について説明する。図5は、第4の変形例による実装基板10を示す断面図である。
図5に示すように、第4の変形例において、実装基板10は、貫通電極23に電気的に接続されたキャパシタ15を備える。
キャパシタ15は、基板12の第2面14側に位置している。キャパシタ15は、例えば、MIM (Metal-Insulator-Metal) 構造を有するキャパシタである。図5の例において、キャパシタ15は、基板12に対して電子部品50とほぼ正反対の位置に配置されている。キャパシタ15の位置は、図5の態様に限定されず、例えば、電子部品50の正反対の第2面14の下側D2の位置から第2面14に沿った面方向にずれた位置であってもよい。また、キャパシタ15は、基板12の第1面13側に位置していてもよい。
キャパシタ15は、例えば、貫通電極23に電気的に接続され、基板12側に位置する電極を構成する第2面第1導電層41と、絶縁体を構成する第2面無機層42と、下部電極よりも基板12から離れて位置する電極を構成する第2面第2導電層43とを有するものとすることができる。
第2面無機層42は、第2面第1導電層41に対して下側D2に位置し、無機材料を含み、且つ絶縁性を有する層である。第2面無機層42は、キャパシタ15の絶縁体以外の部分を有していてもよい。
第2面無機層42の無機材料としては、SiNなどの珪素窒化物を用いることができる。その他にも、第2面無機層42の無機材料の例として、酸化シリコン、酸化アルミ、五酸化タンタル等を挙げることができる。第2面無機層42は、単一の層から構成されていてもよく、複数の層から構成されていてもよい。
第2面無機層42は、例えば、プラズマCVDやスパッタリング等の方法によって形成してもよい。また、第2面無機層42は、例えば、反応性イオンエッチングによってキャパシタ15に適した大きさ及び形状に加工してもよい。
第2面第2導電層43は、第2面無機層42に対して下側D2に位置する、導電性を有する層である。第2面第2導電層43は、キャパシタ15の電極以外の部分を有していてもよい。
第2面第2導電層43は、導電層31と同様に、第2面無機層42の下側D2に順に積層されたシード層及びめっき層を含んでいてもよい。第2面第2導電層43を構成する材料は、導電層31の材料と同様であってもよい。
第4の変形例によれば、キャパシタ15と電子部品50とを貫通電極23や導電層31を介して電気的に接続することができるため、キャパシタ15を有する基板12に電子部品50を簡便に搭載することができる。また、金属部材61を備えることにより、電子部品50やキャパシタ15の発する熱を第1面13の面内方向に逃げ易くすることができ、実装基板10の放熱性を向上させることができる。
実装基板の製造方法
以下、実装基板10の製造方法について説明する。
第1の実施の形態に係る実装基板の製造方法
まず、図6乃至図8を参照して、第1の実施の形態に係る実装基板の製造方法について説明する。ここでは、図1に示された実装基板10を製造する例について説明する。
(基板の準備工程)
図6は、本実施形態による実装基板10の製造方法を示す断面図である。まず、基板12を準備する。ここでは、図6に示す通り、第1貫通孔20及び第1金属層62を備える基板12を準備する。第1貫通孔20及び第1金属層62は、例えば以下の方法により形成することができる。
まず、第1面13及び第2面14の少なくともいずれか一方にレジスト層を設ける。その後、レジスト層のうち第1貫通孔20に対応する位置に開口を設ける。
次に、レジスト層の開口において基板12を加工することにより、図6に示すように、基板12に第1貫通孔20を形成することができる。基板12を加工する方法としては、反応性イオンエッチング法、深掘り反応性イオンエッチング法などのドライエッチング法や、ウェットエッチング法等を用いることができる。
なお、基板12にレーザを照射することによって、基板12に第1貫通孔20を形成してもよい。この場合、レジスト層は設けられていなくてもよい。レーザ加工のためのレーザとしては、エキシマレーザ、Nd:YAGレーザ、フェムト秒レーザ等を用いることができる。Nd:YAGレーザを採用する場合、波長が1064nmの基本波、波長が532nmの第2高調波、波長が355nmの第3高調波等を用いることができる。
また、レーザ照射とウェットエッチングを適宜組み合わせることもできる。具体的には、まず、レーザ照射によって基板12のうち第1貫通孔20が形成されるべき領域に変質層を形成する。続いて、基板12をフッ化水素などに浸漬して、変質層をエッチングする。これによって、基板12に第1貫通孔20を形成することができる。その他にも、基板12に研磨材を吹き付けるブラスト処理によって基板12に第1貫通孔20を形成してもよい。
第1貫通孔20を形成した後、図6に示すように、第1貫通孔20の側壁に第1金属層62を形成する。具体的には、スパッタリング法、蒸着法、無電解めっき法等によって、側壁上にシード層を形成する。シード層を形成した後、第1金属層62を設けないことを意図する領域があれば、当該領域のシード層上にレジスト層を形成する。レジスト層を形成した後、電解めっきにより、レジスト層によって覆われていないシード層上にめっき層を形成する。次に、レジスト層を除去する。その後、シード層のうちレジスト層が形成されていた部分を、ウェットエッチングにより除去する。これにより、シード層及びめっき層を含む第1金属層62を、第1貫通孔20の内部などに形成することができる。なお、電解めっき工程の後、めっき層をアニールする工程を実施してもよい。
また、図6に示してはいないが、第1金属層62は、第1貫通孔20の側壁から基板12の第1面13上又は第2面14上にまで広がっていてもよい。
また、図6に示してはいないが、第1金属層62の形状がコンフォーマルビアであってもよい。すなわち、第1貫通孔20の内部に、第1金属層62が存在しない空間があってもよい。この場合、第1貫通孔20の内部に有機層が形成されていてもよい。当該有機層は、例えば以下の工程にて形成することができる。
第1金属層62を形成した後、有機層を構成するための樹脂層を含むフィルムを、基板12の第1面13側及び第2面14側に配置する。次いで、フィルムを加圧することにより、樹脂層を第1貫通孔20の内部に押し込む。その後、第1貫通孔20の内部に押し込まれた樹脂層を、樹脂層に光を照射することなどによって硬化させる。さらに、樹脂層の不要部分を除去する。このようにして、第1貫通孔20の内部に有機層を形成することができる。なお、第1貫通孔20の内部に有機層を形成する工程は、後述する、電子部品50及び金属部材61を配置する工程の後に実施されてもよい。この場合、第1貫通孔20の内部の有機層と、電子部品50及び金属部材61を少なくとも部分的に覆う絶縁層34とを、同一の材料を用いて同時に形成してもよい。
なお、図6においては、図1に示す実装基板10の基板12を準備する例を示したが、これに限られることはなく、図2又は図3に示す実装基板10の基板12を準備してもよい。図2に示す実装基板10の第2貫通孔21及び第2金属層63、並びに図3に示す第3貫通孔22及び貫通電極23は、第1貫通孔20及び第1金属層62を形成する方法と同様の方法によって形成され得る。
(電子部品及び金属部材の配置工程)
図7は、図6に続く本実施形態による実装基板10の製造方法を示す断面図である。第1金属層62を形成した後、図7に示すように、基板12の第1面13上に電子部品50及び金属部材61を配置する。
〔電子部品の配置〕
電子部品50の配置の方法は、特に限定されないが、電子部品50を接着材で接着する工程を含んでいてもよい。
例えば、まず、電子部品50の配置位置に、接着剤として、例えばフィルム状のダイアタッチメント材を配置する。次に、電子部品50を、その電極52を含む回路面を上側D1に向けたフェイスアップの状態で、配置位置に載置する。これにより、ダイアタッチメント材の粘着力によって電子部品50を第1面13上に仮止めすることができる。
〔金属部材の配置〕
金属部材61の配置の方法は、特に限定されないが、金属部材61を接着材で接着する工程を含んでいてもよく、めっき処理により金属部材61を形成する工程を含んでいてもよい。
金属部材61を接着材で基板12に接着する場合、あらかじめ厚さを調整した金属部材を用いることができるので、金属部材の厚さが設計からずれることを抑制することができる。
めっき処理により金属部材61を形成する場合、金属部材61と同時に第1面13上に配線などの別部材を形成してもよい。
(絶縁層の形成工程)
電子部品50及び金属部材61を配置した後、図8に示すように、第1面13上、電子部品50上又は金属部材61上に、絶縁層34を形成する。また、電子部品50の電極52まで厚み方向Dに絶縁層34を貫通する第1絶縁層貫通孔34aを形成する。
絶縁層34及び第1絶縁層貫通孔34aは、例えば以下の方法によって形成することができる。まず、有機材料を含む感光層と、基材とを有するフィルムを、基板12の第1面13側に貼り付ける。次いで、フィルムに露光処理及び現像処理を施す。これによって、フィルムの感光層からなり、第1絶縁層貫通孔34aが形成された絶縁層34を、基板12の第1面13側に形成することができる。
(導電層の形成工程)
絶縁層34を形成した後、図1に示すように、絶縁層34上に位置する第1部分311及び絶縁層34を貫通する第2部分312を含む導電層31を形成する。導電層31は、第1金属層62の形成に用いられる方法と同様の方法でシード層及びめっき層を積層することによって形成してもよい。
なお、図3に示すように基板12が貫通電極を備える場合は、絶縁層34を貫通し、導電層31の第1部分311と貫通電極とを電気的に接続する接続部材を、導電層31の一部として第1部分311及び第2部分312と同時に形成してもよい。
以上の工程により、図1に示した実装基板10が得られる。本実施形態の実装基板の製造方法によれば、金属部材61を設けることにより、電子部品50の発する熱が第1面13の面内方向に逃げ易くなり、より放熱性に優れた実装基板10を提供することができる。
第2の実施の形態に係る実装基板の製造方法
上述の第1の実施の形態に係る実装基板の製造方法としては、基板12の第1面13上に、電子部品50及び金属部材61、絶縁層34、並びに導電層31を順に配置していく例を示した。第2の実施の形態に係る実装基板の製造方法においては、まず、電子部品50及び金属部材61を支持基板71の支持面73上に形成し、続いて、電子部品50及び金属部材61を支持基板71から基板12に転移させることで、基板12、電子部品50及び金属部材61を備えた実装基板10を得る。以下、本実施の形態に係る実装基板の製造方法について、図9乃至図14を参照して説明する。ここでは、図3に示された実装基板10を製造する例について説明する。
(支持基板の準備工程)
図9は、本実施形態による実装基板10の製造方法を示す断面図である。まず、支持面73を有する支持基板71を準備する。電子部品50及び金属部材61を適切に支持することができる限りにおいて、支持基板71の材料は任意である。例えば、支持基板71の材料は、基板12の材料と同様であってもよい。
(構造部の形成工程)
支持基板71を準備した後、図9に示すように、支持基板71の支持面73側に、支持基板71の側に露出した電極52を有する電子部品50及び金属部材61を配置する。
支持基板71の支持面73側に、電子部品50及び金属部材61以外の構成要素を更に設けてもよい。例えば、電子部品50及び金属部材61を少なくとも部分的に覆う絶縁層34の一部を支持基板71の支持面73側に形成してもよい。また、図10に示すように、電子部品50と金属部材61との間隙を充填するように絶縁層34を形成してもよい。以下の説明において、支持基板71の支持面73側に設けられる、少なくとも電子部品50及び金属部材61を含む複数の構成要素であって、後に支持基板71側から基板12側へ転移する複数の構成要素のことを、構造部60とも称する。
構造部60が、電子部品50と金属部材61との間隙に位置する絶縁層34を含む場合、構造部60を基板12に接合する後述する工程において、構造部60と基板12との接合面が広くなるので、構造部60に対して基板12をより強固に接合することができる。また、図示はしないが、電子部品50と金属部材61との厚さが異なる場合であっても、電子部品50又は金属部材61に対して上側D3に絶縁層34を形成することにより、構造部60の上側D3の面を平面化することができ、基板12を接合する工程において、構造部60に対して基板12をより強固に接合することができる。
絶縁層34の一部を支持基板71の支持面73側に形成する方法としては、第1の実施の形態に係る実装基板の製造方法における、絶縁層34を基板12の第1面13上、電子部品50上又は金属部材61上に形成する方法と同様の方法を用いることができる。
(接続部材の形成工程)
また、電子部品50及び金属部材61を配置する工程の前後において、または当該工程と同時に、図9に示すように接続部材32を形成する。例えば、第1の実施の形態に係る実装基板の製造方法における、第1金属層62を第1貫通孔20の側壁に形成する方法と同様の方法によって、接続部材32を支持基板71の支持面73上に形成することができる。
(基板の準備工程)
また、図10に示すような、第1面13及び前記第1面の反対側に位置する第2面14を有する基板12を準備する。基板12は、基板12の第1面13の法線方向に沿って見た場合に金属部材61に重なるよう、第1貫通孔20及び第1金属層62を備えていてもよい。また、基板12は、第3貫通孔22及び第1面13から第2面14まで基板12を貫通する貫通電極23を備えていてもよい。
(基板の接合工程)
基板12を準備した後、図11及び図12に示すように、構造部60に基板12を接合する接合工程を実施する。
接合工程は、図11に示す通り、導電性粒子とバインダとを含む導電性ペースト81を介して貫通電極23と接続部材32とを接合する工程を含んでもよい。当該工程を含むことにより、構造部60に基板12を接合しつつ、導電性ペースト81により導電性部材を形成し、当該導電性部材を介して貫通電極23を接続部材32に電気的に接続することができる。
導電性ペーストは、導電性粒子及びバインダを少なくとも含み、必要に応じて溶媒、添加剤等を含んでもよい。導電性粒子は、導電性を有していればよく、具体的には、金属粒子を使用することができる。金属粒子に用いられる金属としては、銅、銀、またはこれらを用いた合金等を挙げることができる。導電性粒子は、複数種類の金属粒子を組み合わせて使用してもよい。また、バインダには、樹脂を用いることができる。バインダに用いられる樹脂としては、エポキシ樹脂等を挙げることができる。
(支持基板の分離工程)
基板12の接合工程の後、図13に示すように、支持基板71を構造部60から分離する。ここで、図13以降の図については、図12とは図の上下を逆転させて表示する。支持基板71を分離する具体的な方法については特に限定されないが、例えば、構造部60と支持基板71との接着力を、構造部60と基板12との接着力よりも低くした上で、支持基板71を引き剥がすことにより、分離することができる。具体的には、支持基板71上に構造部60を形成する工程において、支持基板71と構造部60との間に熱剥離性の仮粘着シートを介在させておき、分離工程において仮粘着シートを剥離温度まで加熱し、構造部60と支持基板71との接着力を低下させた上で、支持基板71を引き剥がすことにより、分離することができる。この場合において、剥離温度は、接続部材32等の構造部60の構成要素が損傷しないように設定される。
(絶縁層の形成工程)
支持基板71の分離工程の後、図14に示すように、電子部品50及び金属部材61を少なくとも部分的に覆う絶縁層34を形成する。例えば、第1の実施の形態に係る実装基板の製造方法における、絶縁層34を形成する方法と同様の方法により、絶縁層34を形成することができる。
なお、図13に示すように、構造部60が絶縁層34の一部を含んでいる場合は、図14に示すように、構造部60の絶縁層34、電子部品50及び金属部材61の上側D1に、さらに絶縁層34を形成する。
(導電層の形成工程)
絶縁層34を形成した後、図3に示すように、絶縁層34上に位置する第1部分311及び絶縁層34を貫通する第2部分312を含む導電層31を形成する。導電層31は、第1の実施の形態に係る実装基板の製造方法における第1金属層62を形成する方法と同様の方法でシード層及びめっき層を積層することによって形成してもよい。
以上の工程により、図3に示した実装基板10が得られる。本実施形態の実装基板の製造方法においても、金属部材61を設けることにより、電子部品50の発する熱が第1面13の面内方向に逃げ易くなり、より放熱性に優れた実装基板10を提供することができる。
なお、上述した実施の形態に対するいくつかの変形例を説明してきたが、当然に、複数の変形例を適宜組み合わせて適用することも可能である。
10 実装基板
12 基板
13 第1面
14 第2面
15 キャパシタ
17 インダクタ
20 第1貫通孔
21 第2貫通孔
22 第3貫通孔
23 貫通電極
31 導電層
311 第1部分
312 第2部分
32 接続部材
34 絶縁層
34a 第1絶縁層貫通孔
34b 第2絶縁層貫通孔
41 第2面第1導電層
42 第2面無機層
43 第2面第2導電層
50 電子部品
51 本体部
52 電極
60 構造部
61 金属部材
62 第1金属層
63 第2金属層
71 支持基板
73 支持面
81 導電性ペースト

Claims (16)

  1. 第1面及び前記第1面の反対側に位置する第2面を有する基板と、
    前記基板の前記第1面側に位置し、前記基板とは反対の側に露出した電極を有する電子部品と、
    前記電子部品に対して前記基板の前記第1面と平行な方向に位置し、且つ10μm以上の厚さを有する金属部材と、
    前記電子部品及び前記金属部材を少なくとも部分的に覆う絶縁層と、
    前記絶縁層上に位置する第1部分と、前記絶縁層を貫通し、前記第1部分と前記電子部品の前記電極とを電気的に接続する第2部分と、を有する導電層と、を備える、実装基板。
  2. 前記基板には、前記基板の前記第1面の法線方向に沿って見た場合に前記金属部材に重なる第1貫通孔が設けられており、
    前記実装基板は、前記第1貫通孔内に位置する第1金属層を更に備える、請求項1に記載の実装基板。
  3. 前記基板には、前記基板の前記第1面の法線方向に沿って見た場合に前記電子部品に重なる第2貫通孔が設けられており、
    前記実装基板は、前記第2貫通孔内に位置する第2金属層を更に備える、請求項1又は2に記載の実装基板。
  4. 前記第1面から前記第2面まで前記基板を貫通する貫通電極と、
    前記絶縁層を貫通し、前記導電層の前記第1部分と前記貫通電極とを電気的に接続する接続部材と、を更に備える、請求項1乃至3のいずれか一項に記載の実装基板。
  5. 前記貫通電極は、導電性粒子とバインダとを含む導電性部材を介して、前記接続部材に電気的に接続する、請求項4に記載の実装基板。
  6. 前記貫通電極は、インダクタの一部である、請求項4又は5に記載の実装基板。
  7. 前記貫通電極に電気的に接続するキャパシタを更に備える、請求項4乃至6のいずれか一項に記載の実装基板。
  8. 前記基板は、ガラスを含有する、請求項1乃至7のいずれか一項に記載の実装基板。
  9. 第1面及び前記第1面の反対側に位置する第2面を有する基板を準備する工程と、
    前記基板の前記第1面側に、前記基板とは反対の側に露出した電極を有する電子部品、及び10μm以上の厚さを有する金属部材を配置する工程と、
    前記電子部品及び前記金属部材を少なくとも部分的に覆う絶縁層を形成する工程と、
    前記絶縁層上に位置する第1部分と、前記絶縁層を貫通し、前記第1部分と前記電子部品の前記電極とを電気的に接続する第2部分と、を有する導電層を形成する工程と、を備える、実装基板の製造方法。
  10. 前記基板は、前記第1面から前記第2面まで前記基板を貫通する貫通電極を備え、
    前記導電層を形成する工程は、前記絶縁層を貫通し、前記導電層の前記第1部分と前記貫通電極とを電気的に接続する接続部材を形成する工程を含む、請求項9に記載の実装基板の製造方法。
  11. 支持面を有する支持基板を準備する工程と、
    前記支持基板の前記支持面側に、前記支持基板の側に露出した電極を有する電子部品、及び10μm以上の厚さを有する金属部材を少なくとも含む構造部を配置する工程と、
    前記構造部に、第1面及び前記第1面の反対側に位置する第2面を有する基板を接合する工程と、
    前記支持基板を前記構造部から分離する工程と、
    前記電子部品及び前記金属部材を少なくとも部分的に覆う絶縁層を形成する工程と、
    前記絶縁層上に位置する第1部分と、前記絶縁層を貫通し、前記第1部分と前記電子部品の前記電極とを電気的に接続する第2部分と、を有する導電層を形成する工程と、を備える、実装基板の製造方法。
  12. 前記基板は、前記第1面から前記第2面まで前記基板を貫通する貫通電極を備え、
    前記絶縁層を貫通し、前記貫通電極と電気的に接続する接続部材を形成する工程を更に備え、
    前記導電層を形成する工程は、前記接続部材と前記導電層の前記第1部分とを電気的に接続する工程を含む、請求項11に記載の実装基板の製造方法。
  13. 前記基板を接合する工程は、導電性粒子とバインダとを含む導電性ペーストを介して前記貫通電極と前記接続部材とを接合する工程を含む、請求項12に記載の実装基板の製造方法。
  14. 前記金属部材の配置は、前記金属部材を接着材で接着することを含む、請求項9乃至13のいずれか一項に記載の実装基板の製造方法。
  15. 前記金属部材の配置は、めっき処理により前記金属部材を形成することを含む、請求項9乃至13のいずれか一項に記載の実装基板の製造方法。
  16. 前記電子部品の配置は、前記電子部品を接着材で接着することを含む、請求項9乃至15のいずれか一項に記載の実装基板の製造方法。
JP2021127724A 2017-07-05 2021-08-03 実装基板及び実装基板の製造方法 Active JP7245452B2 (ja)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP2021127724A JP7245452B2 (ja) 2017-07-05 2021-08-03 実装基板及び実装基板の製造方法
JP2023039105A JP7569516B2 (ja) 2017-07-05 2023-03-13 構造体

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2017132166A JP6928896B2 (ja) 2017-07-05 2017-07-05 実装基板及び実装基板の製造方法
JP2021127724A JP7245452B2 (ja) 2017-07-05 2021-08-03 実装基板及び実装基板の製造方法

Related Parent Applications (1)

Application Number Title Priority Date Filing Date
JP2017132166A Division JP6928896B2 (ja) 2017-07-05 2017-07-05 実装基板及び実装基板の製造方法

Related Child Applications (1)

Application Number Title Priority Date Filing Date
JP2023039105A Division JP7569516B2 (ja) 2017-07-05 2023-03-13 構造体

Publications (2)

Publication Number Publication Date
JP2021184487A true JP2021184487A (ja) 2021-12-02
JP7245452B2 JP7245452B2 (ja) 2023-03-24

Family

ID=65359413

Family Applications (3)

Application Number Title Priority Date Filing Date
JP2017132166A Active JP6928896B2 (ja) 2017-07-05 2017-07-05 実装基板及び実装基板の製造方法
JP2021127724A Active JP7245452B2 (ja) 2017-07-05 2021-08-03 実装基板及び実装基板の製造方法
JP2023039105A Active JP7569516B2 (ja) 2017-07-05 2023-03-13 構造体

Family Applications Before (1)

Application Number Title Priority Date Filing Date
JP2017132166A Active JP6928896B2 (ja) 2017-07-05 2017-07-05 実装基板及び実装基板の製造方法

Family Applications After (1)

Application Number Title Priority Date Filing Date
JP2023039105A Active JP7569516B2 (ja) 2017-07-05 2023-03-13 構造体

Country Status (1)

Country Link
JP (3) JP6928896B2 (ja)

Families Citing this family (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN113366628B (zh) 2019-03-12 2022-09-30 爱玻索立克公司 封装基板及包括其的半导体装置
CN113424304B (zh) 2019-03-12 2024-04-12 爱玻索立克公司 装载盒及对象基板的装载方法
EP3916772A4 (en) 2019-03-12 2023-04-05 Absolics Inc. PACKAGING SUBSTRATE AND SEMICONDUCTOR DEVICE WITH IT
CN114678344A (zh) 2019-03-29 2022-06-28 爱玻索立克公司 半导体用封装玻璃基板、半导体封装基板及半导体装置
JP7104245B2 (ja) 2019-08-23 2022-07-20 アブソリックス インコーポレイテッド パッケージング基板及びこれを含む半導体装置
CN114038760A (zh) * 2021-09-17 2022-02-11 珠海越亚半导体股份有限公司 一种基于模制成型制程的封装基板及其制造方法

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2004241660A (ja) * 2003-02-06 2004-08-26 Nec Electronics Corp 半導体装置及び半導体装置の製造方法
WO2008056499A1 (en) * 2006-11-06 2008-05-15 Nec Corporation Semiconductor device and method for manufacturing same
JP2013038374A (ja) * 2011-01-20 2013-02-21 Ibiden Co Ltd 配線板及びその製造方法
JP5462404B1 (ja) * 2013-09-12 2014-04-02 太陽誘電株式会社 部品内蔵基板及び部品内蔵基板用コア基材

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4967946U (ja) * 1972-09-25 1974-06-13
JP2002170921A (ja) 2000-12-01 2002-06-14 Matsushita Electric Ind Co Ltd 半導体装置およびその製造方法
JP3547423B2 (ja) 2000-12-27 2004-07-28 松下電器産業株式会社 部品内蔵モジュール及びその製造方法
JP5286072B2 (ja) 2008-12-25 2013-09-11 日本特殊陶業株式会社 配線基板及びその製造方法
JP5493660B2 (ja) * 2009-09-30 2014-05-14 日本電気株式会社 機能素子内蔵基板及びその製造方法、並びに電子機器
JP5729290B2 (ja) 2011-12-16 2015-06-03 富士通株式会社 半導体装置の製造方法、電子装置の製造方法及び基板
JP2016086082A (ja) 2014-10-27 2016-05-19 パナソニックIpマネジメント株式会社 電子部品パッケージおよびその製造方法
JP6620989B2 (ja) 2015-05-25 2019-12-18 パナソニックIpマネジメント株式会社 電子部品パッケージ

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2004241660A (ja) * 2003-02-06 2004-08-26 Nec Electronics Corp 半導体装置及び半導体装置の製造方法
WO2008056499A1 (en) * 2006-11-06 2008-05-15 Nec Corporation Semiconductor device and method for manufacturing same
JP2013038374A (ja) * 2011-01-20 2013-02-21 Ibiden Co Ltd 配線板及びその製造方法
JP5462404B1 (ja) * 2013-09-12 2014-04-02 太陽誘電株式会社 部品内蔵基板及び部品内蔵基板用コア基材

Also Published As

Publication number Publication date
JP7245452B2 (ja) 2023-03-24
JP2019016672A (ja) 2019-01-31
JP2023072028A (ja) 2023-05-23
JP7569516B2 (ja) 2024-10-18
JP6928896B2 (ja) 2021-09-01

Similar Documents

Publication Publication Date Title
JP6928896B2 (ja) 実装基板及び実装基板の製造方法
CN107112297B (zh) 配线电路基板、半导体装置、配线电路基板的制造方法、半导体装置的制造方法
JP5808586B2 (ja) インターポーザの製造方法
JP7363972B2 (ja) 貫通電極基板及びその製造方法、並びに実装基板
JP4787559B2 (ja) 半導体装置およびその製造方法
JP5248084B2 (ja) シリコンインターポーザとこれを用いた半導体装置用パッケージおよび半導体装置
US10157753B2 (en) Wiring board, electronic device, and electronic module
WO2019111966A1 (ja) 配線基板、半導体装置、及び配線基板の製造方法
US8777638B2 (en) Wiring board and method of manufacturing the same
JP2007157844A (ja) 半導体装置、および半導体装置の製造方法
CN107567651B (zh) 具有贯通电极的布线基板及其制造方法
TWI380419B (en) Integrated circuit package and the method for fabricating thereof
JP2012248754A (ja) 半導体装置の製造方法、及び半導体装置
JP2016092018A (ja) 配線基板、電子装置および電子モジュール
JP7437627B2 (ja) 貫通電極基板およびその製造方法
JP2015225963A (ja) 配線基板、電子装置および電子モジュール
TWI816267B (zh) 內埋式封裝結構
KR101101432B1 (ko) 반도체 디바이스의 제조 방법 및 이를 이용한 반도체 디바이스
JP7405183B2 (ja) 配線基板及び配線基板を備える実装基板並びに配線基板の製造方法
JP2019029541A (ja) 電子部品搭載基板およびその製造方法
KR101011931B1 (ko) 반도체 디바이스 및 그 제조 방법
JP2016157900A (ja) 電子装置

Legal Events

Date Code Title Description
A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20210804

A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20210804

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20220819

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20221013

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20230210

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20230223

R150 Certificate of patent or registration of utility model

Ref document number: 7245452

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150