JP2017514393A - スキュー補正を有するserdes電圧モードドライバ - Google Patents
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- 238000012937 correction Methods 0.000 title description 7
- 238000004891 communication Methods 0.000 claims abstract description 26
- 238000000034 method Methods 0.000 claims description 23
- 238000005259 measurement Methods 0.000 claims description 13
- 230000003111 delayed effect Effects 0.000 claims description 6
- 238000012986 modification Methods 0.000 abstract description 3
- 230000004048 modification Effects 0.000 abstract description 3
- 230000003750 conditioning effect Effects 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 8
- 230000008569 process Effects 0.000 description 7
- 238000005516 engineering process Methods 0.000 description 4
- 230000008859 change Effects 0.000 description 3
- 230000000295 complement effect Effects 0.000 description 3
- 238000012360 testing method Methods 0.000 description 2
- 230000005540 biological transmission Effects 0.000 description 1
- 238000011065 in-situ storage Methods 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
- 230000002093 peripheral effect Effects 0.000 description 1
- 238000005070 sampling Methods 0.000 description 1
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Abstract
Description
以下に本願発明の当初の特許請求の範囲に記載された発明を付記する。
[C1]
正の出力ノード及び負の出力ノードを含む差動出力上でデータ値をドライブするためのドライバ回路であって、
電圧モードドライバモジュールの入力上の値に基づいて、前記正の出力ノード及び前記負の出力ノード上で電圧をドライブするように構成された前記電圧モードドライバモジュールと、
第1の電流モードドライバモジュールと
を備え、前記第1の電流モードドライバモジュールは、
第1の電流を供給するように動作可能なヘッド電流源と、
第2の電流を吸収するように動作可能なテール電流源と
前記第1の電流モードドライバモジュールの入力上の値に基づいて、前記正の出力ノード及び前記負の出力ノードに前記ヘッド電流源及び前記テール電流源を選択的に結合するように構成されたスイッチと
を含み、
前記第1の電流及び前記第2の電流の前記大きさは、独立して選択可能である、ドライバ回路。
[C2]
前記第1の電流及び前記第2の電流の前記大きさは、前記ドライバ回路の前記出力上のスキューを補正することに少なくとも部分的に基づいて選択される、C1に記載のドライバ回路。
[C3]
前記第1の電流及び前記第2の電流の前記大きさは、前記ドライバ回路の出力振幅を調整することに少なくとも部分的に基づいて更に選択される、C2に記載のドライバ回路。
[C4]
前記ヘッド電流源は、前記第1の電流を決定するためのデジタル/アナログ変換器を含み、前記テール電流源は、前記第2の電流を決定するためのデジタル/アナログ変換器を含む、C1に記載のドライバ回路。
[C5]
前記ドライバ回路の前記出力に結合され、前記ドライバ回路の前記差動出力上のスキューを測定することと、前記測定されたスキューに少なくとも部分的に基づいて前記ヘッド電流源の前記デジタル/アナログ変換器及び前記テール電流源の前記デジタル/アナログ変換器を制御することとを行うように構成された、スキュー測定モジュールを更に備える、C4に記載のドライバ回路。
[C6]
前記電圧モードドライバモジュールの前記入力は、前記第1の電流モードドライバ回路の前記入力に結合される、C1に記載のドライバ回路。
[C7]
前記第1の電流モードドライバモジュールの前記入力は、正の入力ノード及び負の入力ノードを含み、前記第1の電流モードドライバモジュールの前記スイッチは、
前記負の入力ノードに結合されたゲートと、前記正の出力ノードに結合されたドレインと、前記ヘッド電流源に結合されたソースとを有する第1のp型トランジスタ、
前記負の入力ノードに結合されたゲートと、前記正の出力ノードに結合されたドレインと、前記テール電流源に結合されたソースとを有する第1のn型トランジスタ、
前記正の入力ノードに結合されたゲートと、前記負の出力ノードに結合されたドレインと、前記ヘッド電流源に結合されたソースとを有する第2のp型トランジスタ、及び
前記正の入力ノードに結合されたゲートと、前記負の出力ノードに結合されたドレインと、前記テール電流源に結合されたソースとを有する第2のn型トランジスタ、
を含む、C1に記載のドライバ回路。
[C8]
第3の電流を供給するように動作可能な第2のヘッド電流源と、
第4の電流を吸収するように動作可能な第2のテール電流源と、
第2の電流モードドライバモジュールの入力上の値に基づいて、前記正の出力ノード及び前記負の出力ノードに前記第2のヘッド電流源及び前記第2のテール電流源を選択的に結合するように構成されたスイッチと
を含む前記第2の電流モードドライバモジュール
を更に備え、
前記第3の電流及び前記第4の電流の前記大きさは、前記ドライバ回路の前記出力に対してかけるべきプリエンファシスに少なくとも部分的に基づいて選択される、
C1に記載のドライバ回路。
[C9]
前記第2の電流モードドライバモジュールの前記入力上の前記値は、前記電圧モードドライバモジュールの前記入力上の前記値の遅延されたコピーである、C8に記載のドライバ回路。
[C10]
前記ドライバ回路の入力に基づいて、前記電圧モードドライバモジュールへの前記入力及び前記第1の電流モードドライバモジュールへの前記入力を供給するように構成されたプリドライバモジュールを更に備える、C1に記載のドライバ回路。
[C11]
前記電圧モードドライバモジュールは、並列して結合されたソース及びドレインを有する複数のトランジスタと、前記電圧モードドライバの選択された出力インピーダンスを生成するために前記複数のトランジスタのゲートを駆動するための信号を供給するように構成された電圧モードプリドライバモジュールとを含む、C1に記載のドライバ回路。
[C12]
通信リンク上でシリアルデータ信号をドライブするための方法であって、
正の出力ノード及び負の出力ノードに結合された差動出力を有する電圧モードドライバモジュールを使用して前記通信リンクを駆動することと、ここにおいて、前記電圧モードドライバモジュールは、前記電圧モードドライバモジュールの入力上の値に基づいて前記出力上で電圧をドライブするように構成され、
前記正の出力ノード及び前記負の出力ノードに結合された出力を有する電流モードドライバモジュールを使用して前記通信リンクを駆動することと、ここにおいて、前記電流モードドライバモジュールは、前記正の出力ノード及び前記負の出力ノードにヘッド電流源及びテール電流源を選択的に結合するように動作可能であり、
前記正の出力ノード及び前記負の出力ノード上のスキューを補正することに少なくとも部分的に基づいて前記ヘッド電流源及び前記テール電流源の電流を選択することと
を備える、方法。
[C13]
前記ヘッド電流源の前記電流及び前記テール電流源の前記電流は異なる、C12に記載の方法。
[C14]
前記正の出力ノード及び前記負の出力ノードの出力振幅を調整することに少なくとも部分的に基づいて、前記ヘッド電流源及び前記テール電流源の前記電流を選択することを更に備える、C12に記載の方法。
[C15]
前記正の出力ノード及び前記負の出力ノード上の前記スキューを測定することを更に備え、ここにおいて、スキューを補正することに少なくとも部分的に基づいて前記ヘッド電流源及び前記テール電流源の電流を選択することは、前記測定されたスキューを使用する、C12に記載の方法。
[C16]
前記正の出力ノード及び前記負の出力ノードに結合された出力を有する第2の電流モードドライバモジュールを使用して前記通信リンクを駆動することと、ここにおいて、前記第2の電流モードドライバモジュールは、前記正の出力ノード及び前記負の出力ノードに第2のヘッド電流源及び第2のテール電流源を選択的に結合するように動作可能であり、
前記正の出力ノード及び前記負の出力ノードに対してかけるべきプリエンファシスに少なくとも部分的に基づいて前記第2のヘッド電流源及び前記第2のテール電流源の電流を選択することと
を更に備える、C12に記載の方法。
[C17]
ドライバ回路であって、
正の出力ノード及び負の出力ノードを含む差動出力上で電圧をドライブするための手段と、ここにおいて、前記駆動された電圧は、電圧回路を駆動するための前記手段の入力上の値に基づく、
前記差動出力上で電流を駆動するための手段と
を備え、前記差動出力上で電流を駆動するための前記手段は、
第1の電流を供給するように動作可能なヘッド電流源、
第2の電流を吸収するように動作可能なテール電流源、及び
電流をドライブするための前記手段の入力上の値に基づいて、前記正の出力ノード及び前記負の出力ノードに前記ヘッド電流源及び前記テール電流源を選択的に結合するように構成されたスイッチ
を含み、
前記第1の電流及び前記第2の電流の前記大きさは、独立して選択可能である、ドライバ回路。
[C18]
前記第1の電流の前記大きさ及び前記第2の電流の前記大きさは、前記ドライバ回路の前記出力上のスキューを補正することに少なくとも部分的に基づいて選択される、C17に記載のドライバ回路。
[C19]
前記第1の電流及び前記第2の電流の前記大きさは、前記ドライバ回路の出力振幅を調整することに少なくとも部分的に基づいて更に選択される、C18に記載のドライバ回路。
[C20]
前記ヘッド電流源は、前記第1の電流を供給するためのデジタル/アナログ変換器を含み、前記テール電流源は、前記第2の電流を吸収するためのデジタル/アナログ変換器を含む、C17に記載のドライバ回路。
[C21]
前記ドライバ回路の前記出力に結合され、前記ドライバ回路の前記出力上のスキューを測定することと、前記測定されたスキューに少なくとも部分的に基づいて前記ヘッド電流源の前記デジタル/アナログ変換器及び前記テール電流源の前記デジタル/アナログ変換器を制御することとを行うための、スキューを測定するための手段を更に備える、C20に記載のドライバ回路。
[C22]
電圧を駆動するための前記手段の前記入力は、電流をドライブするための前記手段の前記入力に結合される、C17に記載のドライバ回路。
[C23]
電流をドライブするための前記手段の前記入力は、正の入力ノード及び負の入力ノードを含み、電流をドライブするための前記手段の前記スイッチは、
前記負の入力ノードに結合されたゲートと、前記正の出力ノードに結合されたドレインと、前記ヘッド電流源に結合されたソースとを有する第1のp型トランジスタ、
前記負の入力ノードに結合されたゲートと、前記正の出力ノードに結合されたドレインと、前記テール電流源に結合されたソースとを有する第1のn型トランジスタ、
前記正の入力ノードに結合されたゲートと、前記負の出力ノードに結合されたドレインと、前記ヘッド電流源に結合されたソースとを有する第2のp型トランジスタ、及び
前記正の入力ノードに結合されたゲートと、前記負の出力ノードに結合されたドレインと、前記テール電流源に結合されたソースとを有する第2のn型トランジスタ
を含む、C17に記載のドライバ回路。
[C24]
前記差動出力上で電流をドライブするための第2の手段
を更に備え、電流をドライブするための前記第2の手段は、
第3の電流を供給するように動作可能な第2のヘッド電流源と、
第4の電流を吸収するように動作可能な第2のテール電流源と、
電流をドライブするための前記第2の手段の入力上の値に基づいて、前記正の出力ノード及び前記負の出力ノードに前記第2のヘッド電流源及び前記第2のテール電流源を選択的に結合するように構成されたスイッチと
を含み、
前記第3の電流及び前記第4の電流の前記大きさは、前記ドライバ回路の前記出力に対してかけられるべきプリエンファシスに少なくとも部分的に基づいて選択される、
C17に記載のドライバ回路。
[C25]
電流を駆動するための前記第2の手段の前記入力上の前記値は、電圧を駆動するための前記手段の前記入力上の前記値の遅延されたコピーである、C24に記載のドライバ回路。
[C26]
前記ドライバ回路の入力に基づいて、電圧をドライブするための前記手段及び電流をドライブするための前記手段に前記入力を供給するように構成されたプリドライバモジュールを更に備える、C17に記載のドライバ回路。
[C27]
電圧をドライブするための前記手段は、並列して結合されたソース及びドレインを有する複数のトランジスタと、前記電圧モードドライバの選択された出力インピーダンスを生成するために前記複数のトランジスタの前記ゲートを駆動するために信号を供給するように構成された電圧モードプリドライバモジュールとを含む、C17に記載のドライバ回路。
Claims (27)
- 正の出力ノード及び負の出力ノードを含む差動出力上でデータ値をドライブするためのドライバ回路であって、
電圧モードドライバモジュールの入力上の値に基づいて、前記正の出力ノード及び前記負の出力ノード上で電圧をドライブするように構成された前記電圧モードドライバモジュールと、
第1の電流モードドライバモジュールと
を備え、前記第1の電流モードドライバモジュールは、
第1の電流を供給するように動作可能なヘッド電流源と、
第2の電流を吸収するように動作可能なテール電流源と
前記第1の電流モードドライバモジュールの入力上の値に基づいて、前記正の出力ノード及び前記負の出力ノードに前記ヘッド電流源及び前記テール電流源を選択的に結合するように構成されたスイッチと
を含み、
前記第1の電流及び前記第2の電流の前記大きさは、独立して選択可能である、ドライバ回路。 - 前記第1の電流及び前記第2の電流の前記大きさは、前記ドライバ回路の前記出力上のスキューを補正することに少なくとも部分的に基づいて選択される、請求項1に記載のドライバ回路。
- 前記第1の電流及び前記第2の電流の前記大きさは、前記ドライバ回路の出力振幅を調整することに少なくとも部分的に基づいて更に選択される、請求項2に記載のドライバ回路。
- 前記ヘッド電流源は、前記第1の電流を決定するためのデジタル/アナログ変換器を含み、前記テール電流源は、前記第2の電流を決定するためのデジタル/アナログ変換器を含む、請求項1に記載のドライバ回路。
- 前記ドライバ回路の前記出力に結合され、前記ドライバ回路の前記差動出力上のスキューを測定することと、前記測定されたスキューに少なくとも部分的に基づいて前記ヘッド電流源の前記デジタル/アナログ変換器及び前記テール電流源の前記デジタル/アナログ変換器を制御することとを行うように構成された、スキュー測定モジュールを更に備える、請求項4に記載のドライバ回路。
- 前記電圧モードドライバモジュールの前記入力は、前記第1の電流モードドライバ回路の前記入力に結合される、請求項1に記載のドライバ回路。
- 前記第1の電流モードドライバモジュールの前記入力は、正の入力ノード及び負の入力ノードを含み、前記第1の電流モードドライバモジュールの前記スイッチは、
前記負の入力ノードに結合されたゲートと、前記正の出力ノードに結合されたドレインと、前記ヘッド電流源に結合されたソースとを有する第1のp型トランジスタ、
前記負の入力ノードに結合されたゲートと、前記正の出力ノードに結合されたドレインと、前記テール電流源に結合されたソースとを有する第1のn型トランジスタ、
前記正の入力ノードに結合されたゲートと、前記負の出力ノードに結合されたドレインと、前記ヘッド電流源に結合されたソースとを有する第2のp型トランジスタ、及び
前記正の入力ノードに結合されたゲートと、前記負の出力ノードに結合されたドレインと、前記テール電流源に結合されたソースとを有する第2のn型トランジスタ、
を含む、請求項1に記載のドライバ回路。 - 第3の電流を供給するように動作可能な第2のヘッド電流源と、
第4の電流を吸収するように動作可能な第2のテール電流源と、
第2の電流モードドライバモジュールの入力上の値に基づいて、前記正の出力ノード及び前記負の出力ノードに前記第2のヘッド電流源及び前記第2のテール電流源を選択的に結合するように構成されたスイッチと
を含む前記第2の電流モードドライバモジュール
を更に備え、
前記第3の電流及び前記第4の電流の前記大きさは、前記ドライバ回路の前記出力に対してかけるべきプリエンファシスに少なくとも部分的に基づいて選択される、
請求項1に記載のドライバ回路。 - 前記第2の電流モードドライバモジュールの前記入力上の前記値は、前記電圧モードドライバモジュールの前記入力上の前記値の遅延されたコピーである、請求項8に記載のドライバ回路。
- 前記ドライバ回路の入力に基づいて、前記電圧モードドライバモジュールへの前記入力及び前記第1の電流モードドライバモジュールへの前記入力を供給するように構成されたプリドライバモジュールを更に備える、請求項1に記載のドライバ回路。
- 前記電圧モードドライバモジュールは、並列して結合されたソース及びドレインを有する複数のトランジスタと、前記電圧モードドライバの選択された出力インピーダンスを生成するために前記複数のトランジスタのゲートを駆動するための信号を供給するように構成された電圧モードプリドライバモジュールとを含む、請求項1に記載のドライバ回路。
- 通信リンク上でシリアルデータ信号をドライブするための方法であって、
正の出力ノード及び負の出力ノードに結合された差動出力を有する電圧モードドライバモジュールを使用して前記通信リンクを駆動することと、ここにおいて、前記電圧モードドライバモジュールは、前記電圧モードドライバモジュールの入力上の値に基づいて前記出力上で電圧をドライブするように構成され、
前記正の出力ノード及び前記負の出力ノードに結合された出力を有する電流モードドライバモジュールを使用して前記通信リンクを駆動することと、ここにおいて、前記電流モードドライバモジュールは、前記正の出力ノード及び前記負の出力ノードにヘッド電流源及びテール電流源を選択的に結合するように動作可能であり、
前記正の出力ノード及び前記負の出力ノード上のスキューを補正することに少なくとも部分的に基づいて前記ヘッド電流源及び前記テール電流源の電流を選択することと
を備える、方法。 - 前記ヘッド電流源の前記電流及び前記テール電流源の前記電流は異なる、請求項12に記載の方法。
- 前記正の出力ノード及び前記負の出力ノードの出力振幅を調整することに少なくとも部分的に基づいて、前記ヘッド電流源及び前記テール電流源の前記電流を選択することを更に備える、請求項12に記載の方法。
- 前記正の出力ノード及び前記負の出力ノード上の前記スキューを測定することを更に備え、ここにおいて、スキューを補正することに少なくとも部分的に基づいて前記ヘッド電流源及び前記テール電流源の電流を選択することは、前記測定されたスキューを使用する、請求項12に記載の方法。
- 前記正の出力ノード及び前記負の出力ノードに結合された出力を有する第2の電流モードドライバモジュールを使用して前記通信リンクを駆動することと、ここにおいて、前記第2の電流モードドライバモジュールは、前記正の出力ノード及び前記負の出力ノードに第2のヘッド電流源及び第2のテール電流源を選択的に結合するように動作可能であり、
前記正の出力ノード及び前記負の出力ノードに対してかけるべきプリエンファシスに少なくとも部分的に基づいて前記第2のヘッド電流源及び前記第2のテール電流源の電流を選択することと
を更に備える、請求項12に記載の方法。 - ドライバ回路であって、
正の出力ノード及び負の出力ノードを含む差動出力上で電圧をドライブするための手段と、ここにおいて、前記駆動された電圧は、電圧回路を駆動するための前記手段の入力上の値に基づく、
前記差動出力上で電流を駆動するための手段と
を備え、前記差動出力上で電流を駆動するための前記手段は、
第1の電流を供給するように動作可能なヘッド電流源、
第2の電流を吸収するように動作可能なテール電流源、及び
電流をドライブするための前記手段の入力上の値に基づいて、前記正の出力ノード及び前記負の出力ノードに前記ヘッド電流源及び前記テール電流源を選択的に結合するように構成されたスイッチ
を含み、
前記第1の電流及び前記第2の電流の前記大きさは、独立して選択可能である、ドライバ回路。 - 前記第1の電流の前記大きさ及び前記第2の電流の前記大きさは、前記ドライバ回路の前記出力上のスキューを補正することに少なくとも部分的に基づいて選択される、請求項17に記載のドライバ回路。
- 前記第1の電流及び前記第2の電流の前記大きさは、前記ドライバ回路の出力振幅を調整することに少なくとも部分的に基づいて更に選択される、請求項18に記載のドライバ回路。
- 前記ヘッド電流源は、前記第1の電流を供給するためのデジタル/アナログ変換器を含み、前記テール電流源は、前記第2の電流を吸収するためのデジタル/アナログ変換器を含む、請求項17に記載のドライバ回路。
- 前記ドライバ回路の前記出力に結合され、前記ドライバ回路の前記出力上のスキューを測定することと、前記測定されたスキューに少なくとも部分的に基づいて前記ヘッド電流源の前記デジタル/アナログ変換器及び前記テール電流源の前記デジタル/アナログ変換器を制御することとを行うための、スキューを測定するための手段を更に備える、請求項20に記載のドライバ回路。
- 電圧を駆動するための前記手段の前記入力は、電流をドライブするための前記手段の前記入力に結合される、請求項17に記載のドライバ回路。
- 電流をドライブするための前記手段の前記入力は、正の入力ノード及び負の入力ノードを含み、電流をドライブするための前記手段の前記スイッチは、
前記負の入力ノードに結合されたゲートと、前記正の出力ノードに結合されたドレインと、前記ヘッド電流源に結合されたソースとを有する第1のp型トランジスタ、
前記負の入力ノードに結合されたゲートと、前記正の出力ノードに結合されたドレインと、前記テール電流源に結合されたソースとを有する第1のn型トランジスタ、
前記正の入力ノードに結合されたゲートと、前記負の出力ノードに結合されたドレインと、前記ヘッド電流源に結合されたソースとを有する第2のp型トランジスタ、及び
前記正の入力ノードに結合されたゲートと、前記負の出力ノードに結合されたドレインと、前記テール電流源に結合されたソースとを有する第2のn型トランジスタ
を含む、請求項17に記載のドライバ回路。 - 前記差動出力上で電流をドライブするための第2の手段
を更に備え、電流をドライブするための前記第2の手段は、
第3の電流を供給するように動作可能な第2のヘッド電流源と、
第4の電流を吸収するように動作可能な第2のテール電流源と、
電流をドライブするための前記第2の手段の入力上の値に基づいて、前記正の出力ノード及び前記負の出力ノードに前記第2のヘッド電流源及び前記第2のテール電流源を選択的に結合するように構成されたスイッチと
を含み、
前記第3の電流及び前記第4の電流の前記大きさは、前記ドライバ回路の前記出力に対してかけられるべきプリエンファシスに少なくとも部分的に基づいて選択される、
請求項17に記載のドライバ回路。 - 電流を駆動するための前記第2の手段の前記入力上の前記値は、電圧を駆動するための前記手段の前記入力上の前記値の遅延されたコピーである、請求項24に記載のドライバ回路。
- 前記ドライバ回路の入力に基づいて、電圧をドライブするための前記手段及び電流をドライブするための前記手段に前記入力を供給するように構成されたプリドライバモジュールを更に備える、請求項17に記載のドライバ回路。
- 電圧をドライブするための前記手段は、並列して結合されたソース及びドレインを有する複数のトランジスタと、前記電圧モードドライバの選択された出力インピーダンスを生成するために前記複数のトランジスタの前記ゲートを駆動するために信号を供給するように構成された電圧モードプリドライバモジュールとを含む、請求項17に記載のドライバ回路。
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US14/257,848 US9264263B2 (en) | 2014-04-21 | 2014-04-21 | Serdes voltage-mode driver with skew correction |
US14/257,848 | 2014-04-21 | ||
PCT/US2015/019915 WO2015163986A1 (en) | 2014-04-21 | 2015-03-11 | Serdes voltage-mode driver with skew correction |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2017514393A true JP2017514393A (ja) | 2017-06-01 |
JP6250839B2 JP6250839B2 (ja) | 2017-12-20 |
Family
ID=52780577
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2016563427A Active JP6250839B2 (ja) | 2014-04-21 | 2015-03-11 | スキュー補正を有するserdes電圧モードドライバ |
Country Status (7)
Country | Link |
---|---|
US (1) | US9264263B2 (ja) |
EP (1) | EP3134969B1 (ja) |
JP (1) | JP6250839B2 (ja) |
KR (1) | KR101759340B1 (ja) |
CN (1) | CN106233627B (ja) |
BR (1) | BR112016024452B1 (ja) |
WO (1) | WO2015163986A1 (ja) |
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2015
- 2015-03-11 WO PCT/US2015/019915 patent/WO2015163986A1/en active Application Filing
- 2015-03-11 BR BR112016024452-4A patent/BR112016024452B1/pt active IP Right Grant
- 2015-03-11 CN CN201580020496.1A patent/CN106233627B/zh active Active
- 2015-03-11 EP EP15713353.9A patent/EP3134969B1/en active Active
- 2015-03-11 JP JP2016563427A patent/JP6250839B2/ja active Active
- 2015-03-11 KR KR1020167028899A patent/KR101759340B1/ko active IP Right Grant
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CN106233627A (zh) | 2016-12-14 |
EP3134969B1 (en) | 2019-11-06 |
BR112016024452A2 (pt) | 2017-08-15 |
JP6250839B2 (ja) | 2017-12-20 |
KR101759340B1 (ko) | 2017-07-18 |
WO2015163986A1 (en) | 2015-10-29 |
BR112016024452B1 (pt) | 2022-09-20 |
EP3134969A1 (en) | 2017-03-01 |
KR20160127141A (ko) | 2016-11-02 |
US9264263B2 (en) | 2016-02-16 |
CN106233627B (zh) | 2019-02-22 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A975 | Report on accelerated examination |
Free format text: JAPANESE INTERMEDIATE CODE: A971005 Effective date: 20170303 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20170523 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20170718 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20171024 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20171122 |
|
R150 | Certificate of patent or registration of utility model |
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|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |