JP2017054124A - 表示装置およびその作製方法 - Google Patents

表示装置およびその作製方法 Download PDF

Info

Publication number
JP2017054124A
JP2017054124A JP2016176344A JP2016176344A JP2017054124A JP 2017054124 A JP2017054124 A JP 2017054124A JP 2016176344 A JP2016176344 A JP 2016176344A JP 2016176344 A JP2016176344 A JP 2016176344A JP 2017054124 A JP2017054124 A JP 2017054124A
Authority
JP
Japan
Prior art keywords
film
oxide semiconductor
transistor
insulating film
conductive film
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Withdrawn
Application number
JP2016176344A
Other languages
English (en)
Inventor
欣聡 及川
Yoshiaki Oikawa
欣聡 及川
純一 肥塚
Junichi Hizuka
純一 肥塚
岡崎 健一
Kenichi Okazaki
健一 岡崎
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Semiconductor Energy Laboratory Co Ltd
Original Assignee
Semiconductor Energy Laboratory Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Semiconductor Energy Laboratory Co Ltd filed Critical Semiconductor Energy Laboratory Co Ltd
Publication of JP2017054124A publication Critical patent/JP2017054124A/ja
Withdrawn legal-status Critical Current

Links

Classifications

    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F3/00Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
    • G06F3/01Input arrangements or combined input and output arrangements for interaction between user and computer
    • G06F3/03Arrangements for converting the position or the displacement of a member into a coded form
    • G06F3/041Digitisers, e.g. for touch screens or touch pads, characterised by the transducing means
    • G06F3/0412Digitisers structurally integrated in a display
    • GPHYSICS
    • G02OPTICS
    • G02FOPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F1/00Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
    • G02F1/01Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
    • G02F1/13Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour  based on liquid crystals, e.g. single liquid crystal display cells
    • G02F1/133Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
    • G02F1/1333Constructional arrangements; Manufacturing methods
    • GPHYSICS
    • G02OPTICS
    • G02FOPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F1/00Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
    • G02F1/01Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
    • G02F1/13Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour  based on liquid crystals, e.g. single liquid crystal display cells
    • G02F1/133Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
    • G02F1/1333Constructional arrangements; Manufacturing methods
    • G02F1/1335Structural association of cells with optical devices, e.g. polarisers or reflectors
    • G02F1/133553Reflecting elements
    • G02F1/133555Transflectors
    • GPHYSICS
    • G02OPTICS
    • G02FOPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F1/00Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
    • G02F1/01Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
    • G02F1/13Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour  based on liquid crystals, e.g. single liquid crystal display cells
    • G02F1/133Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
    • G02F1/1333Constructional arrangements; Manufacturing methods
    • G02F1/1335Structural association of cells with optical devices, e.g. polarisers or reflectors
    • G02F1/1336Illuminating devices
    • GPHYSICS
    • G02OPTICS
    • G02FOPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F1/00Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
    • G02F1/01Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
    • G02F1/13Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour  based on liquid crystals, e.g. single liquid crystal display cells
    • G02F1/133Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
    • G02F1/136Liquid crystal cells structurally associated with a semi-conducting layer or substrate, e.g. cells forming part of an integrated circuit
    • G02F1/1362Active matrix addressed cells
    • G02F1/1368Active matrix addressed cells in which the switching element is a three-electrode device
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/12Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body
    • H01L27/1214Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs
    • H01L27/1222Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs with a particular composition, shape or crystalline structure of the active layer
    • H01L27/1225Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs with a particular composition, shape or crystalline structure of the active layer with semiconductor materials not belonging to the group IV of the periodic table, e.g. InGaZnO
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/12Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body
    • H01L27/1214Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs
    • H01L27/1251Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs comprising TFTs having a different architecture, e.g. top- and bottom gate TFTs
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/78Field effect transistors with field effect produced by an insulated gate
    • H01L29/786Thin film transistors, i.e. transistors with a channel being at least partly a thin film
    • H01L29/78645Thin film transistors, i.e. transistors with a channel being at least partly a thin film with multiple gate
    • H01L29/78648Thin film transistors, i.e. transistors with a channel being at least partly a thin film with multiple gate arranged on opposing sides of the channel
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05BELECTRIC HEATING; ELECTRIC LIGHT SOURCES NOT OTHERWISE PROVIDED FOR; CIRCUIT ARRANGEMENTS FOR ELECTRIC LIGHT SOURCES, IN GENERAL
    • H05B33/00Electroluminescent light sources
    • H05B33/12Light sources with substantially two-dimensional radiating surfaces
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10KORGANIC ELECTRIC SOLID-STATE DEVICES
    • H10K59/00Integrated devices, or assemblies of multiple devices, comprising at least one organic light-emitting element covered by group H10K50/00
    • H10K59/10OLED displays
    • H10K59/12Active-matrix OLED [AMOLED] displays
    • H10K59/121Active-matrix OLED [AMOLED] displays characterised by the geometry or disposition of pixel elements
    • H10K59/1213Active-matrix OLED [AMOLED] displays characterised by the geometry or disposition of pixel elements the pixel elements being TFTs
    • GPHYSICS
    • G02OPTICS
    • G02FOPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F1/00Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
    • G02F1/01Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
    • G02F1/13Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour  based on liquid crystals, e.g. single liquid crystal display cells
    • G02F1/133Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
    • G02F1/1333Constructional arrangements; Manufacturing methods
    • G02F1/133305Flexible substrates, e.g. plastics, organic film
    • GPHYSICS
    • G02OPTICS
    • G02FOPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F1/00Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
    • G02F1/01Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
    • G02F1/13Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour  based on liquid crystals, e.g. single liquid crystal display cells
    • G02F1/133Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
    • G02F1/1333Constructional arrangements; Manufacturing methods
    • G02F1/133357Planarisation layers
    • GPHYSICS
    • G02OPTICS
    • G02FOPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F1/00Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
    • G02F1/01Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
    • G02F1/13Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour  based on liquid crystals, e.g. single liquid crystal display cells
    • G02F1/133Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
    • G02F1/1333Constructional arrangements; Manufacturing methods
    • G02F1/13336Combining plural substrates to produce large-area displays, e.g. tiled displays
    • GPHYSICS
    • G02OPTICS
    • G02FOPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F1/00Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
    • G02F1/01Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
    • G02F1/13Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour  based on liquid crystals, e.g. single liquid crystal display cells
    • G02F1/133Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
    • G02F1/1333Constructional arrangements; Manufacturing methods
    • G02F1/133368Cells having two substrates with different characteristics, e.g. different thickness or material
    • GPHYSICS
    • G02OPTICS
    • G02FOPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F1/00Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
    • G02F1/01Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
    • G02F1/13Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour  based on liquid crystals, e.g. single liquid crystal display cells
    • G02F1/133Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
    • G02F1/1333Constructional arrangements; Manufacturing methods
    • G02F1/13338Input devices, e.g. touch panels
    • GPHYSICS
    • G02OPTICS
    • G02FOPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F1/00Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
    • G02F1/01Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
    • G02F1/13Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour  based on liquid crystals, e.g. single liquid crystal display cells
    • G02F1/133Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
    • G02F1/1333Constructional arrangements; Manufacturing methods
    • G02F1/1335Structural association of cells with optical devices, e.g. polarisers or reflectors
    • G02F1/133553Reflecting elements
    • GPHYSICS
    • G02OPTICS
    • G02FOPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F1/00Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
    • G02F1/01Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
    • G02F1/13Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour  based on liquid crystals, e.g. single liquid crystal display cells
    • G02F1/133Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
    • G02F1/136Liquid crystal cells structurally associated with a semi-conducting layer or substrate, e.g. cells forming part of an integrated circuit
    • G02F1/1362Active matrix addressed cells
    • G02F1/1368Active matrix addressed cells in which the switching element is a three-electrode device
    • G02F1/13685Top gates
    • GPHYSICS
    • G02OPTICS
    • G02FOPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F2201/00Constructional arrangements not provided for in groups G02F1/00 - G02F7/00
    • G02F2201/12Constructional arrangements not provided for in groups G02F1/00 - G02F7/00 electrode
    • G02F2201/123Constructional arrangements not provided for in groups G02F1/00 - G02F7/00 electrode pixel
    • GPHYSICS
    • G02OPTICS
    • G02FOPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F2202/00Materials and properties
    • G02F2202/10Materials and properties semiconductor
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F1/00Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
    • G06F1/16Constructional details or arrangements
    • G06F1/1613Constructional details or arrangements for portable computers
    • G06F1/1633Constructional details or arrangements of portable computers not specific to the type of enclosures covered by groups G06F1/1615 - G06F1/1626
    • G06F1/1637Details related to the display arrangement, including those related to the mounting of the display in the housing
    • G06F1/1652Details related to the display arrangement, including those related to the mounting of the display in the housing the display being flexible, e.g. mimicking a sheet of paper, or rollable
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F2203/00Indexing scheme relating to G06F3/00 - G06F3/048
    • G06F2203/041Indexing scheme relating to G06F3/041 - G06F3/045
    • G06F2203/04103Manufacturing, i.e. details related to manufacturing processes specially suited for touch sensitive devices
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F3/00Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
    • G06F3/01Input arrangements or combined input and output arrangements for interaction between user and computer
    • G06F3/03Arrangements for converting the position or the displacement of a member into a coded form
    • G06F3/041Digitisers, e.g. for touch screens or touch pads, characterised by the transducing means
    • G06F3/044Digitisers, e.g. for touch screens or touch pads, characterised by the transducing means by capacitive means
    • G06F3/0445Digitisers, e.g. for touch screens or touch pads, characterised by the transducing means by capacitive means using two or more layers of sensing electrodes, e.g. using two layers of electrodes separated by a dielectric layer

Landscapes

  • Physics & Mathematics (AREA)
  • Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Power Engineering (AREA)
  • Nonlinear Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • Chemical & Material Sciences (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • Computer Hardware Design (AREA)
  • Optics & Photonics (AREA)
  • Mathematical Physics (AREA)
  • Theoretical Computer Science (AREA)
  • General Engineering & Computer Science (AREA)
  • Human Computer Interaction (AREA)
  • Ceramic Engineering (AREA)
  • Geometry (AREA)
  • Thin Film Transistor (AREA)
  • Liquid Crystal (AREA)
  • Electroluminescent Light Sources (AREA)
  • Devices For Indicating Variable Information By Combining Individual Elements (AREA)

Abstract

【課題】利便性または信頼性に優れた新規な表示装置を提供する。または、消費電力が低く、表示品質が高い表示装置を提供する。【解決手段】第1の表示素子と、第2の表示素子と、第1のトランジスタと、第2のトランジスタと、を有する表示装置であって、第1の表示素子は、第1の画素電極と、液晶層と、を有し、第2の表示素子は、第2の画素電極と、発光層と、を有し、第1のトランジスタは、第1の画素電極と電気的に接続され、第2のトランジスタは、第2の画素電極と電気的に接続され、第1のトランジスタ及び第2のトランジスタは、酸化物半導体膜を有し、第1の画素電極及び第2の画素電極は、酸化物半導体膜が有する金属元素を、少なくとも1以上有する。【選択図】図6

Description

本発明の一態様は、表示装置およびその作製方法に関する。
なお、本発明の一態様は、上記の技術分野に限定されない。本明細書等で開示する発明の一態様の技術分野は、物、方法、または、製造方法に関するものである。または、本発明の一態様は、プロセス、マシン、マニュファクチャ、または、組成物(コンポジション・オブ・マター)に関するものである。そのため、より具体的に本明細書で開示する本発明の一態様の技術分野としては、半導体装置、表示装置、発光装置、蓄電装置、記憶装置、それらの駆動方法、または、それらの製造方法を一例として挙げることができる。
バックライトとして面発光を行う光源を用い、透過型の液晶表示装置を組み合わせることで消費電力の低減と表示品質の低下の抑制を両立する液晶表示装置が知られている(特許文献1参照)。
特開2011−248351号公報
本発明の一態様は、利便性または信頼性に優れた新規な表示装置を提供することを課題の一とする。
または、本発明の一態様は、消費電力が低く、表示品質が高い表示装置を提供することを課題の一とする。または、本発明の一態様は、表示装置の駆動回路の幅を狭くして、さらなる狭額縁化を図れる構成を提供することを課題の一とする。または、本発明の一態様は、新規な表示装置を提供することを課題の一とする。
なお、これらの課題の記載は、他の課題の存在を妨げるものではない。なお、本発明の一態様は、これらの課題の全てを解決する必要はないものとする。なお、これら以外の課題は、明細書、図面、請求項などの記載から、自ずと明らかとなるものであり、明細書、図面、請求項などの記載から、これら以外の課題を抽出することが可能である。
本発明の一態様は、第1の表示素子と、第2の表示素子と、第1のトランジスタと、第2のトランジスタと、を有する表示装置であって、第1の表示素子は、第1の画素電極と、液晶層と、を有し、第2の表示素子は、第2の画素電極と、発光層と、を有し、第1のトランジスタは、第1の画素電極と電気的に接続され、第2のトランジスタは、第2の画素電極と電気的に接続され、第1のトランジスタ及び第2のトランジスタは、酸化物半導体膜を有し、第1の画素電極及び第2の画素電極は、酸化物半導体膜が有する金属元素を、少なくとも1以上有する表示装置である。
また、上記態様において、第1の表示素子は、さらに、反射膜を有し、反射膜は、第1の画素電極と電気的に接続され、且つ入射する光を反射する機能を有し、反射膜には、入射する光を透過する開口部が設けられ、第2の表示素子は、開口部に向けて光を射出する機能を有すると好ましい。
また、上記態様において、酸化物半導体膜は、Inと、Znと、M(MはAl、Ga、Y、またはSn)と、を有すると好ましい。また、上記態様において、酸化物半導体膜は、結晶部を有し、結晶部は、c軸配向性を有すると好ましい。
また、上記態様において、第1のトランジスタ、及び第2のトランジスタのいずれか一方または双方は、スタガ型構造を有すると好ましい。
また、上記態様において、第1のトランジスタ及び第2のトランジスタのいずれか一方または双方は、第1の導電膜と、第1の導電膜上の第1の絶縁膜と、第1の絶縁膜上の第1の酸化物半導体膜と、第1の酸化物半導体膜上の第2の絶縁膜と、第2の絶縁膜上の第2の酸化物半導体膜と、を有し、第2の酸化物半導体膜は、チャネル幅方向の断面において、第2の絶縁膜を介して第1の酸化物半導体膜の側面を覆い、第1の酸化物半導体膜は、チャネル幅方向の断面において、第1の導電膜と、第2の酸化物半導体膜とで、囲まれた構造を有すると好ましい。
本発明の一態様により、利便性または信頼性に優れた新規な表示装置を提供できる。または、本発明の一態様により、消費電力が低く、表示品質が高い表示装置を提供できる。または、本発明の一態様により、表示装置の駆動回路の幅を狭くして、さらなる狭額縁化を図れる構成を提供できる。または、本発明の一態様により、新規な表示装置を提供できる。
なお、これらの効果の記載は、他の効果の存在を妨げるものではない。なお、本発明の一態様は、必ずしも、これらの効果の全てを有する必要はない。なお、これら以外の効果は、明細書、図面、請求項などの記載から、自ずと明らかとなるものであり、明細書、図面、請求項などの記載から、これら以外の効果を抽出することが可能である。
表示装置を説明するブロック図及び回路図。 画素回路を説明する回路図。 表示素子の表示領域を説明する模式図。 表示装置及び画素回路を説明する上面図。 表示装置を説明する断面図。 表示装置を説明する断面図。 表示装置を説明する断面図。 表示装置を説明する断面図。 表示装置の作製工程を説明する断面図。 表示装置の作製工程を説明する断面図。 表示装置の作製工程を説明する断面図。 表示装置の作製工程を説明する断面図。 表示装置の作製工程を説明する断面図。 表示装置の作製工程を説明する断面図。 表示装置を説明する断面図。 表示装置を説明する断面図。 表示装置を説明する断面図。 表示装置を説明する断面図。 半導体装置を説明する上面図及び断面図。 半導体装置を説明する上面図及び断面図。 半導体装置を説明する断面図。 半導体装置を説明する断面図。 半導体装置を説明する断面図。 半導体装置を説明する断面図。 半導体装置を説明する断面図。 半導体装置を説明する断面図。 半導体装置を説明する断面図。 半導体装置を説明する断面図。 半導体装置を説明する断面図。 バンド構造を説明する図。 半導体装置の作製方法を説明する断面図。 半導体装置の作製方法を説明する断面図。 半導体装置の作製方法を説明する断面図。 半導体装置の作製方法を説明する断面図。 半導体装置の作製方法を説明する断面図。 半導体装置の作製方法を説明する断面図。 CAAC−OSおよび単結晶酸化物半導体のXRDによる構造解析を説明する図、ならびにCAAC−OSの制限視野電子回折パターンを示す図。 CAAC−OSの断面TEM像、ならびに平面TEM像およびその画像解析像。 nc−OSの電子回折パターンを示す図、およびnc−OSの断面TEM像。 a−like OSの断面TEM像。 In−Ga−Zn酸化物の電子照射による結晶部の変化を示す図。 表示モジュールを説明する図。 電子機器を説明する図。 表示装置を説明する斜視図。 表示装置を説明する斜視図。 情報処理装置の構成を説明する図。
以下、実施の形態について図面を参照しながら説明する。ただし、実施の形態は多くの異なる態様で実施することが可能であり、趣旨及びその範囲から逸脱することなくその形態及び詳細を様々に変更し得ることは当業者であれば容易に理解される。従って、本発明は、以下の実施の形態の記載内容に限定して解釈されるものではない。
また、図面において、大きさ、層の厚さ、又は領域は、明瞭化のために誇張されている場合がある。よって、必ずしもそのスケールに限定されない。なお図面は、理想的な例を模式的に示したものであり、図面に示す形状又は値などに限定されない。
また、本明細書にて用いる「第1」、「第2」、「第3」という序数詞は、構成要素の混同を避けるために付したものであり、数的に限定するものではないことを付記する。
また、本明細書において、「上に」、「下に」などの配置を示す語句は、構成同士の位置関係を、図面を参照して説明するために、便宜上用いている。また、構成同士の位置関係は、各構成を描写する方向に応じて適宜変化するものである。従って、明細書で説明した語句に限定されず、状況に応じて適切に言い換えることができる。
また、本明細書等において、トランジスタとは、ゲートと、ドレインと、ソースとを含む少なくとも三つの端子を有する素子である。そして、ドレイン(ドレイン端子、ドレイン領域またはドレイン電極)とソース(ソース端子、ソース領域またはソース電極)の間にチャネル領域を有しており、ドレインとチャネル領域とソースとを介して電流を流すことができるものである。なお、本明細書等において、チャネル領域とは、電流が主として流れる領域をいう。
また、ソースやドレインの機能は、異なる極性のトランジスタを採用する場合や、回路動作において電流の方向が変化する場合などには入れ替わることがある。このため、本明細書等においては、ソースやドレインの用語は、入れ替えて用いることができるものとする。
また、本明細書等において、「電気的に接続」には、「何らかの電気的作用を有するもの」を介して接続されている場合が含まれる。ここで、「何らかの電気的作用を有するもの」は、接続対象間での電気信号の授受を可能とするものであれば、特に制限を受けない。例えば、「何らかの電気的作用を有するもの」には、電極や配線をはじめ、トランジスタなどのスイッチング素子、抵抗素子、インダクタ、キャパシタ、その他の各種機能を有する素子などが含まれる。
また、本明細書等において、「平行」とは、二つの直線が−10°以上10°以下の角度で配置されている状態をいう。したがって、−5°以上5°以下の場合も含まれる。また、「垂直」とは、二つの直線が80°以上100°以下の角度で配置されている状態をいう。したがって、85°以上95°以下の場合も含まれる。
また、本明細書等において、「膜」という用語と、「層」という用語とは、互いに入れ替えることが可能である。例えば、「導電層」という用語を、「導電膜」という用語に変更することが可能な場合がある。または、例えば、「絶縁膜」という用語を、「絶縁層」という用語に変更することが可能な場合がある。
また、本明細書等において、特に断りがない場合、オフ電流とは、トランジスタがオフ状態(非導通状態、遮断状態、ともいう)にあるときのドレイン電流をいう。オフ状態とは、特に断りがない場合、nチャネル型トランジスタでは、ゲートとソースの間の電圧Vgsがしきい値電圧Vthよりも低い状態、pチャネル型トランジスタでは、ゲートとソースの間の電圧Vgsがしきい値電圧Vthよりも高い状態をいう。例えば、nチャネル型のトランジスタのオフ電流とは、ゲートとソースの間の電圧Vgsがしきい値電圧Vthよりも低いときのドレイン電流を言う場合がある。
トランジスタのオフ電流は、Vgsに依存する場合がある。従って、トランジスタのオフ電流がI以下である、とは、トランジスタのオフ電流がI以下となるVgsの値が存在することを言う場合がある。トランジスタのオフ電流は、所定のVgsにおけるオフ状態、所定の範囲内のVgsにおけるオフ状態、または、十分に低減されたオフ電流が得られるVgsにおけるオフ状態、等におけるオフ電流を指す場合がある。
一例として、しきい値電圧Vthが0.5Vであり、Vgsが0.5Vにおけるドレイン電流が1×10−9Aであり、Vgsが0.1Vにおけるドレイン電流が1×10−13Aであり、Vgsが−0.5Vにおけるドレイン電流が1×10−19Aであり、Vgsが−0.8Vにおけるドレイン電流が1×10−22Aであるようなnチャネル型トランジスタを想定する。当該トランジスタのドレイン電流は、Vgsが−0.5Vにおいて、または、Vgsが−0.5V乃至−0.8Vの範囲において、1×10−19A以下であるから、当該トランジスタのオフ電流は1×10−19A以下である、と言う場合がある。当該トランジスタのドレイン電流が1×10−22A以下となるVgsが存在するため、当該トランジスタのオフ電流は1×10−22A以下である、と言う場合がある。
また、本明細書等では、チャネル幅Wを有するトランジスタのオフ電流を、チャネル幅Wあたりを流れる電流値で表す場合がある。また、所定のチャネル幅(例えば1μm)あたりを流れる電流値で表す場合がある。後者の場合、オフ電流の単位は、電流/長さの次元を持つ単位(例えば、A/μm)で表される場合がある。
トランジスタのオフ電流は、温度に依存する場合がある。本明細書において、オフ電流は、特に記載がない場合、室温、60℃、85℃、95℃、または125℃におけるオフ電流を表す場合がある。または、当該トランジスタが含まれる半導体装置等の信頼性が保証される温度、または、当該トランジスタが含まれる半導体装置等が使用される温度(例えば、5℃乃至35℃のいずれか一の温度)におけるオフ電流、を表す場合がある。トランジスタのオフ電流がI以下である、とは、室温、60℃、85℃、95℃、125℃、当該トランジスタが含まれる半導体装置の信頼性が保証される温度、または、当該トランジスタが含まれる半導体装置等が使用される温度(例えば、5℃乃至35℃のいずれか一の温度)、におけるトランジスタのオフ電流がI以下となるVgsの値が存在することを指す場合がある。
トランジスタのオフ電流は、ドレインとソースの間の電圧Vdsに依存する場合がある。本明細書において、オフ電流は、特に記載がない場合、Vdsが0.1V、0.8V、1V、1.2V、1.8V、2.5V、3V、3.3V、10V、12V、16V、または20Vにおけるオフ電流を表す場合がある。または、当該トランジスタが含まれる半導体装置等の信頼性が保証されるVds、または、当該トランジスタが含まれる半導体装置等において使用されるVdsにおけるオフ電流、を表す場合がある。トランジスタのオフ電流がI以下である、とは、Vdsが0.1V、0.8V、1V、1.2V、1.8V、2.5V、3V、3.3V、10V、12V、16V、20V、当該トランジスタが含まれる半導体装置の信頼性が保証されるVds、または、当該トランジスタが含まれる半導体装置等において使用されるVds、におけるトランジスタのオフ電流がI以下となるVgsの値が存在することを指す場合がある。
上記オフ電流の説明において、ドレインをソースと読み替えてもよい。つまり、オフ電流は、トランジスタがオフ状態にあるときのソースを流れる電流を言う場合もある。
また、本明細書等では、オフ電流と同じ意味で、リーク電流と記載する場合がある。また、本明細書等において、オフ電流とは、例えば、トランジスタがオフ状態にあるときに、ソースとドレインとの間に流れる電流を指す場合がある。
また、本明細書等において、「半導体」と表記した場合であっても、例えば、導電性が十分に低い場合は、「絶縁体」としての特性を有する場合がある。また、「半導体」と「絶縁体」とは境界が曖昧であり、厳密に区別できない場合がある。したがって、本明細書等に記載の「半導体」は、「絶縁体」に言い換えることが可能な場合がある。同様に、本明細書等に記載の「絶縁体」は、「半導体」に言い換えることが可能な場合がある。または、本明細書等に記載の「絶縁体」を「半絶縁体」に言い換えることが可能な場合がある。
また、本明細書等において、「半導体」と表記した場合であっても、例えば、導電性が十分に高い場合は、「導電体」としての特性を有する場合がある。また、「半導体」と「導電体」とは境界が曖昧であり、厳密に区別できない場合がある。したがって、本明細書等に記載の「半導体」は、「導電体」に言い換えることが可能な場合がある。同様に、本明細書等に記載の「導電体」は、「半導体」に言い換えることが可能な場合がある。
また、本明細書等において、半導体の不純物とは、半導体を構成する主成分以外をいう。例えば、濃度が0.1原子%未満の元素は不純物である。不純物が含まれることにより、半導体にDOS(Density of States)が形成されることや、キャリア移動度が低下することや、結晶性が低下することなどが起こる場合がある。半導体が酸化物半導体を有する場合、半導体の特性を変化させる不純物としては、例えば、第1族元素、第2族元素、第14族元素、第15族元素、主成分以外の遷移金属などがあり、特に、水素(水にも含まれる)、リチウム、ナトリウム、シリコン、ホウ素、リン、炭素、窒素などがある。酸化物半導体の場合、例えば水素などの不純物の混入によって酸素欠損を形成する場合がある。また、半導体がシリコンを有する場合、半導体の特性を変化させる不純物としては、例えば、酸素、水素を除く第1族元素、第2族元素、第13族元素、第15族元素などがある。
(実施の形態1)
本実施の形態では、本発明の一態様の表示装置について、図1乃至図14を用いて説明を行う。
<1−1.表示装置の構成>
まず、表示装置の構成について、図1を用いて説明する。図1に示す表示装置500は、画素部502と、画素部502の外側に配置されるゲートドライバ回路部504a、504bと、画素部502の外側に配置されるソースドライバ回路部506と、を有する。
[画素部]
画素部502は、X行(Xは2以上の自然数)、Y列(Yは2以上の自然数)に配置される画素回路501(X,Y)を有する。また、画素回路501(X,Y)は、2つの表示素子を有し、当該2つの表示素子は、それぞれ異なる機能を有する。2つの表示素子の一方は、入射する光を反射する機能を有し、2つの表示素子の他方は、光を射出する機能を有する。なお、当該2つの表示素子の詳細については、後述する。
[ゲートドライバ回路部]
ゲートドライバ回路部504a、504b及びソースドライバ回路部506の一部または全部は、画素部502と同一基板上に形成されていることが望ましい。これにより、部品数や端子数を減らすことが出来る。ゲートドライバ回路部504a、504b及びソースドライバ回路部506の一部または全部が画素部502と同一基板上に形成されない場合には、COG(Chip On Glass)またはTAB(Tape Automated Bonding)によって、別途用意された駆動回路基板(例えば、単結晶半導体膜または多結晶半導体膜で形成された駆動回路基板)を、表示装置500に形成してもよい。
また、ゲートドライバ回路部504a、504bは、画素回路501(X,Y)を選択する信号(走査信号)を出力する機能を有し、ソースドライバ回路部506は、画素回路501(X,Y)が有する表示素子を駆動するための信号(データ信号)を供給する機能を有する。
また、ゲートドライバ回路部504aは、走査信号が与えられる配線(以下、走査線GE_1乃至GE_Xという)の電位を制御する機能、または初期化信号を供給する機能を有する。また、ゲートドライバ回路部504bは、走査信号が与えられる配線(以下、走査線GL_1乃至GL_Xという)の電位を制御する機能、または初期化信号を供給する機能を有する。ただし、これに限定されず、ゲートドライバ回路部504a、504bは、別の信号を制御または供給することも可能である。
なお、図1においては、ゲートドライバ回路部として、ゲートドライバ回路部504aと、ゲートドライバ回路部504bと、2つ設ける構成について例示したが、これに限定されず、1つのゲートドライバ回路部、または3つ以上のゲートドライバ回路部を設ける構成としてもよい。
[ソースドライバ回路部]
ソースドライバ回路部506は、画像信号を元に画素回路501(X,Y)に書き込むデータ信号を生成する機能、データ信号が与えられる配線(以下、信号線SL_1乃至SL_Y及び信号線SE_1乃至SE_Yという)の電位を制御する機能、または初期化信号を供給する機能を有する。ただし、これに限定されず、ソースドライバ回路部506は、別の信号を生成、制御、または供給する機能を有していてもよい。
また、ソースドライバ回路部506は、複数のアナログスイッチなどを用いて構成される。ソースドライバ回路部506は、複数のアナログスイッチを順次オン状態にすることにより、画像信号を時分割した信号をデータ信号として出力できる。
なお、図1においては、ソースドライバ回路部506を1つ設ける構成について例示したが、これに限定されず、表示装置500には、複数のソースドライバ回路部を設けてもよい。例えば、2つのソースドライバ回路部を設け、一方のソースドライバ回路部により信号線SL_1乃至SL_Yを制御し、他方のソースドライバ回路部により信号線SE_1乃至SE_Yを制御してもよい。
[画素回路]
また、画素回路501(X,Y)は、走査線GL_1乃至GL_X及び走査線GE_1乃至GE_Xの一つを介してパルス信号が入力され、信号線SL_1乃至SL_Y及び信号線SE_1乃至SE_Yの一つを介してデータ信号が入力される。
例えば、m行n列目(mはX以下の自然数を表し、nはY以下の自然数を表す)の画素回路501(m,n)は、走査線GL_m及び走査線GE_mを介してゲートドライバ回路部504aからパルス信号が入力され、走査線GL_m及び走査線GE_mの電位に応じて信号線SL_n及び信号線SE_nを介してソースドライバ回路部506からデータ信号が入力される。
また、画素回路501(m,n)は、先の説明の通り、2つの表示素子を有する。走査線GL_1乃至GL_Xは、2つの表示素子の一方に与えられるパルス信号の電位を制御する配線であり、走査線GE_1乃至GE_Xは、2つの表示素子の他方に与えられるパルス信号の電位を制御する配線である。
また、信号線SL_1乃至SL_Yは、2つの表示素子の一方に与えられるデータ信号の電位を制御する配線であり、信号線SE_1乃至SE_Yは、2つの表示素子の他方に与えられるデータ信号の電位を制御する配線である。
[外部回路]
表示装置500には、外部回路508a、508bが接続される。なお、外部回路508a、508bを、表示装置500に形成する構成としてもよい。
また、外部回路508aは、図1に示すように、アノード電位が与えられる配線(以下、アノード線ANO_1乃至ANO_xという)と電気的に接続されており、外部回路508bは、共通電位が与えられる配線(以下、コモン線COM_1乃至COM_Xという)と、電気的に接続されている。
<1−2.画素回路の構成例>
次に、画素回路501(m,n)の構成について、図2を用いて説明する。
図2は、本発明の一態様の表示装置500が有する画素回路501(m,n)と、画素回路501(m,n)の列方向に隣接した画素回路501(m,n+1)と、を説明する回路図である。なお、本明細書等においては、列方向とは信号線SL_n(または信号線SE_n)のnの数値が増減する方向であり、行方向とは走査線GL_m(または走査線GE_m)のmの数値が増減する方向である。
画素回路501(m,n)は、トランジスタTr1と、トランジスタTr2と、トランジスタTr3と、容量素子C1と、容量素子C2と、表示素子430と、表示素子630と、を有する。なお、画素回路501(m,n+1)も同様の構成を有する。
また、画素回路501(m,n)は、信号線SL_n、信号線SE_n、走査線GL_m、走査線GE_m、コモン線COM_m、コモン線VCOM1、コモン線VCOM2、及びアノード線ANO_mと、電気的に接続されている。また、画素回路501(m,n+1)は、信号線SL_n+1、信号線SE_n+1、走査線GL_m、走査線GE_m、コモン線COM_m、コモン線VCOM1、コモン線VCOM2、及びアノード線ANO_mと、電気的に接続されている。
なお、信号線SL_n、信号線SL_n+1、走査線GL_m、コモン線COM_m、及びコモン線VCOM1は、それぞれ表示素子430を駆動するための配線であり、信号線SE_n、信号線SE_n+1、走査線GE_m、コモン線VCOM2、及びアノード線ANO_mは、それぞれ表示素子630を駆動するための配線である。
また、信号線SE_n及び信号線SE_n+1に供給される電位と、信号線SL_n及び信号線SL_n+1に供給される電位と、が異なる場合、図2に示すように、信号線SE_nと信号線SL_n+1とを離間して配置すると好ましい。別言すると、信号線SE_nと信号線SE_n+1とを隣接するように配置すると好ましい。このような配置とすることで、信号線SL_n及び信号線SL_n+1と、信号線SE_n及び信号線SE_n+1と、の間に生じる電位差の影響を低減することができる。
<1−3.第1の表示素子の構成例>
表示素子430は、光の反射または光の透過を制御する機能を有する。特に、表示素子430を光の反射を制御する、所謂反射型の表示素子とすると好適である。表示素子430を反射型の表示素子とすることで、外光を用いて表示を行うことが可能となるため、表示装置の消費電力を抑制することができる。例えば、表示素子430としては、反射膜と液晶素子と偏光板とを組み合わせた構成、またはマイクロ・エレクトロ・メカニカル・システム(MEMS)を用いる構成等とすればよい。
<1−4.第2の表示素子の構成例>
表示素子630は、光を射出する機能、すなわち発光する機能を有する。よって、表示素子630を、発光素子として読み替えてもよい。例えば、表示素子630としては、エレクトロルミネッセンス素子(EL素子ともいう)を用いる構成、または発光ダイオードを用いる構成等とすればよい。
このように、本発明の一態様の表示装置では、表示素子430及び表示素子630に示すように、異なる機能を有する表示素子を用いる。例えば、表示素子の一方を反射型の液晶素子とし、他方を透過型のEL素子を用いることで、利便性または信頼性に優れた新規な表示装置を提供することができる。また、外光が明るい環境下においては、反射型の液晶素子を利用し、外光が暗い環境下においては、透過型のEL素子を用いることで、消費電力が低く、表示品位の高い表示装置を提供することができる。
<1−5.表示素子の駆動方法>
次に、表示素子430及び表示素子630の駆動方法について説明する。なお、以下の説明においては、表示素子430に液晶素子を用い、表示素子630に発光素子を用いる構成とする。
[第1の表示素子の駆動方法]
画素回路501(m,n)において、トランジスタTr1のゲート電極は、走査線GL_mに電気的に接続される。また、トランジスタTr1のソース電極またはドレイン電極の一方は、信号線SL_nに電気的に接続され、他方は表示素子430の一対の電極の一方に電気的に接続される。トランジスタTr1は、オン状態またはオフ状態になることにより、データ信号のデータの書き込みを制御する機能を有する。
また、表示素子430の一対の電極の他方は、コモン線VCOM1と電気的に接続される。
また、容量素子C1の一対の電極の一方は、コモン線COM_mに電気的に接続され、他方は、トランジスタTr1のソース電極またはドレイン電極の他方、及び表示素子430の一対の電極の一方に電気的に接続される。容量素子C1は、画素回路501(m,n)に書き込まれたデータを保持する機能を有する。
例えば、図1に示すゲートドライバ回路部504bにより、各行の画素回路を順次選択し、トランジスタTr1をオン状態にしてデータ信号のデータを書き込む。データが書き込まれた画素回路501(m,n)は、トランジスタTr1がオフ状態になることで保持状態になる。これを行毎に順次行うことにより、画像を表示できる。
[第2の表示素子の駆動方法]
画素回路501(m,n)において、トランジスタTr2のゲート電極は、走査線GE_mに電気的に接続される。また、トランジスタTr2のソース電極またはドレイン電極の一方は、信号線SE_nに電気的に接続され、他方はトランジスタTr3のゲート電極に電気的に接続される。トランジスタTr2は、オン状態またはオフ状態になることにより、データ信号のデータの書き込みを制御する機能を有する。
容量素子C2の一対の電極の一方は、アノード線ANO_mに電気的に接続され、他方は、トランジスタTr2のソース電極及びドレイン電極の他方に電気的に接続される。容量素子C2は、画素回路501(m,n)に書き込まれたデータを保持する機能を有する。
また、トランジスタTr3のゲート電極は、トランジスタTr2のソース電極及びドレイン電極の他方に電気的に接続される。また、トランジスタTr3のソース電極及びドレイン電極の一方は、アノード線ANO_mに電気的に接続され、他方は、表示素子630の一対の電極の一方に電気的に接続される。また、トランジスタTr3には、バックゲート電極が設けられ、当該バックゲート電極は、トランジスタTr3のゲート電極と、電気的に接続される。
また、表示素子630の一対の電極の他方は、コモン線VCOM2に電気的に接続される。
例えば、図1に示すゲートドライバ回路部504aにより、各行の画素回路を順次選択し、トランジスタTr2をオン状態にしてデータ信号のデータを書き込む。データが書き込まれた画素回路501(m,n)は、トランジスタTr2がオフ状態になることで保持状態になる。さらに、書き込まれたデータ信号の電位に応じてトランジスタTr3のソース電極とドレイン電極の間に流れる電流量が制御され、表示素子630は、流れる電流量に応じた輝度で発光する。これを行毎に順次行うことにより、画像を表示できる。
このように、本発明の一態様の表示装置においては、2つの表示素子を、異なるトランジスタを用いて、それぞれ独立に制御することができる。よって、表示品位の高い表示装置を提供することができる。
また、本発明の一態様の表示装置に用いるトランジスタ(トランジスタTr1及びトランジスタTr2)は、酸化物半導体膜を有する。酸化物半導体膜を有するトランジスタは、比較的高い電界効果移動度が得られるため、高速駆動が可能となる。また、酸化物半導体膜を有するトランジスタのオフ電流は、極めて小さい。したがって、表示装置のリフレッシュレートを下げても、表示装置の輝度の維持が可能となり、消費電力を抑制することができる。
また、表示素子430及び表示素子630の表示方式としては、プログレッシブ方式やインターレース方式等を用いることができる。また、カラー表示する際に画素で制御する色要素としては、RGB(Rは赤、Gは緑、Bは青を表す)が挙げられる。ただし、色要素としては、RGBの三色に限定されない。例えば、RGBに、イエロー、シアン、マゼンタ、ホワイト等を一色以上追加してもよい。また、色要素のドット毎にその表示領域の大きさが異なっていてもよい。ただし、本発明の一態様の表示装置は、カラー表示の表示装置に限定されるものではなく、モノクロ表示の表示装置に適用することもできる。
<1−6.表示素子の表示領域>
ここで、表示素子430及び表示素子630の画素回路501(m,n)における表示領域について、図3(A)(B)を用いて説明する。
図3(A)は、画素回路501(m,n)と、画素回路501(m,n)の列方向に隣接する画素回路501(m,n−1)及び画素回路501(m,n+1)との表示領域を説明する模式図である。
図3(A)に示す、画素回路501(m,n)、画素回路501(m,n−1)、及び画素回路501(m,n+1)のそれぞれは、表示素子430の表示領域として機能する表示領域430dと、表示素子630の表示領域として機能する表示領域630dと、を有する。
例えば、表示領域430dとしては、光を反射する領域を有し、表示領域630dとしては、光を透過する領域を有する。また、図3(A)に示すように、画素回路501(m,n)の列方向に隣接する、画素回路501(m,n−1)及び画素回路501(m,n+1)は、画素回路501(m,n)と異なる位置に、表示領域630dを有すると好ましい。
図3(A)に示すような、表示領域630dの配置とすることで、表示素子630を作り分ける場合の製造歩留まりを高めることができる、または隣接する画素回路間での表示素子630から射出される光の干渉を抑制することができる。
なお、図3(A)においては、画素回路501(m,n−1)、画素回路501(m,n)、及び画素回路501(m,n+1)の配置を、列方向のストライプ配列について例示したが、これに限定されない。例えば、図3(B)に示すような行方向のストライプ配列としてもよい。あるいは、図示しないが、デルタ配列、またはペンタイル配列としてもよい。なお、図3(B)は、画素回路501(m,n)と、画素回路501(m,n)の行方向に隣接する画素回路501(m−1,n)及び画素回路501(m+1,n)との表示領域を説明する模式図である。
図3(B)に示す、画素回路501(m,n)、画素回路501(m−1,n)、及び画素回路501(m+1,n)のそれぞれは、表示素子430の表示領域として機能する表示領域430dと、表示素子630の表示領域として機能する表示領域630dと、を有する。表示領域430dと、表示領域630dの構成としては、図3(A)に示す構成と同様とすればよい。
<1−7.表示装置の構成例(上面)>
次に、図1に示す表示装置500の具体的な構成例について、図4及び図5を用いて説明を行う。
図4(A)は、表示装置500の上面図である。先の説明の通り、表示装置500は、画素部502と、画素部502の外側に配置されるゲートドライバ回路部504a、504bと、画素部502の外側に配置されるソースドライバ回路部506と、を有する。また、図4(A)では、画素部502が有する画素回路501(m,n)を模式的に表している。また、図4(A)では、表示装置500には、FPC(Flexible Printed Circuit)が電気的に接続されている。
また、図4(B)は、図4(A)に示す画素回路501(m,n)と、画素回路501(m,n)に隣接して配置される、画素回路501(m,n+1)を模式的に表した上面図である。図4(B)に示す信号線SL_n、SL_n+1、SE_n、SE_n+1、走査線GL_m、GE_m、コモン線COM_m、及びトランジスタTr1、Tr2、Tr3は、図2に示す符号にそれぞれ対応する。また、図4(B)において、表示領域430dと、表示領域630dは、図3(A)に示す符号にそれぞれ対応する。また、図4(B)に示すコモン線COM_m+1は、画素回路501(m,n)に隣接して配置される、画素回路501(m,n+1)が有するコモン線を表している。
<1−8.表示装置の構成例(断面)>
次に、表示装置500の断面構造について、図5を用いて説明する。
図5は、図4(A)(B)に示す、一点鎖線A1−A2、A3−A4、A5−A6、A7−A8、A9−A10、A11−A12の切断面に相当する断面図である。
なお、一点鎖線A1−A2の断面は、表示装置500にFPCが取り付けられた領域に、一点鎖線A3−A4の断面は、ゲートドライバ回路部504aが設けられた領域に、一点鎖線A5−A6の断面は、表示素子430及び表示素子630が設けられた領域に、一点鎖線A7−A8の断面は、表示素子430が設けられた領域に、一点鎖線A9−A10の断面は、表示装置500の接続領域に、一点鎖線A11−A12の断面は、表示装置500の端部近傍の領域に、それぞれ相当する。
図5において、表示装置500は、基板452と、基板652との間に、表示素子430と、表示素子630と、トランジスタTr1と、トランジスタTr3と、トランジスタTr4と、を有する。
なお、先の説明の通り、表示素子430は、入射する光を反射する機能を有し、表示素子630は、光を射出する機能を有する。図5において、表示素子430に入射する光と反射する光を破線の矢印で模式的に表している。また、表示素子630が射出する光を二点鎖線の矢印で模式的に表している。
[画素回路]
まず、図5に示す一点鎖線A5−A6の断面、及び一点鎖線A7−A8の断面の詳細について、図6を用いて説明する。図6は、図5に示す一点鎖線A5−A6及び一点鎖線A7−A8の断面の一部の構成要素を拡大し、且つ上下を反転した断面図に相当する。なお、図6において、図面の煩雑さを避けるため、構成要素の一部を省略して図示する場合がある。
表示素子430は、導電膜403bと、液晶層620と、導電膜608と、を有する。なお、導電膜403bは画素電極としての機能を有し、導電膜608は対向電極としての機能を有する。また、導電膜403bは、トランジスタTr1と、電気的に接続されている。
また、表示素子430は、導電膜403bと電気的に接続される導電膜405b、405cを有する。導電膜405b、405cは、入射する光を反射する機能を有する。すなわち、導電膜405b、405cは、反射膜として機能する。また、当該反射膜には、入射する光を透過する開口部450が設けられる。図6においては、開口部450によって、反射膜として機能する導電膜が島状に分離され、トランジスタTr1の下方には導電膜405cが、トランジスタTr3の下方には導電膜405bが配置される。なお、開口部450から表示素子630の光が射出されるため、開口部450が図5に示す表示領域630dに相当する。
また、表示素子630は、開口部450に向けて光を射出する機能を有する。図6において表示素子630は、所謂下方射出型(ボトムエミッション型)の発光素子となる。
また、表示素子630は、導電膜417と、EL層419と、導電膜420と、を有する。なお、導電膜417は、画素電極及びアノード電極としての機能を有し、導電膜420は対向電極及びカソード電極としての機能を有する。なお、本実施の形態においては、導電膜417がアノード電極として機能し、導電膜420がカソード電極としての機能を有する構成について説明するが、これに限定されない。例えば、導電膜417がカソード電極として機能し、導電膜420がアノード電極として機能してもよい。
また、導電膜417は、トランジスタTr3と、電気的に接続されている。
トランジスタTr1及びトランジスタTr3は、酸化物半導体膜を有する。また、画素電極として機能する導電膜403b、417は、トランジスタTr1、Tr3に含まれる酸化物半導体膜が有する金属元素を、少なくとも1以上有する。
例えば、トランジスタTr1及びトランジスタTr3のチャネル領域に酸化物半導体膜を用い、画素電極として機能する導電膜403b、417にチャネル領域に用いる酸化物半導体膜と同じ組成の酸化物半導体膜を用いることで、製造コストを低減することが可能となる。図6に示すように、複数の表示素子、及び複数のトランジスタを有する表示装置においては、絶縁膜、導電膜、または半導体膜等が複数必要となるため、異なる工程で材料を共通して用いることが重要となる。
また、トランジスタTr1及びトランジスタTr3は、図6に示すように、スタガ型(トップゲート構造ともいう)であると好ましい。スタガ型構造のトランジスタとすることで、ゲート電極とソース電極及びドレイン電極との間に生じうる寄生容量を低減することができる。
また、トランジスタTr1は、絶縁膜406及び絶縁膜408上に形成され、絶縁膜408上の酸化物半導体膜409cと、酸化物半導体膜409c上の絶縁膜410cと、絶縁膜410c上の酸化物半導体膜411cと、を有する。絶縁膜410cは、ゲート絶縁膜としての機能を有し、酸化物半導体膜411cはゲート電極としての機能を有する。
また、酸化物半導体膜409c及び酸化物半導体膜411c上には、絶縁膜412、413が設けられる。また、絶縁膜412、413には、酸化物半導体膜409cに達する開口部が設けられ、当該開口部を介して、導電膜414f、414gが酸化物半導体膜409cに電気的に接続される。導電膜414f、414gは、それぞれトランジスタTr1のソース電極及びドレイン電極としての機能を有する。
また、トランジスタTr1上には、絶縁膜416、418が設けられる。
また、トランジスタTr3は、絶縁膜406上に形成され、絶縁膜406上の導電膜407bと、導電膜407b上の絶縁膜408と、絶縁膜408上の酸化物半導体膜409bと、酸化物半導体膜409b上の絶縁膜410bと、絶縁膜410b上の酸化物半導体膜411bと、を有する。導電膜407bは、第1のゲート電極としての機能を有し、絶縁膜408は、第1のゲート絶縁膜としての機能を有する。また、絶縁膜410bは、第2のゲート絶縁膜としての機能を有し、酸化物半導体膜411bは第2のゲート電極としての機能を有する。
また、酸化物半導体膜409b及び酸化物半導体膜411b上には、絶縁膜412、413が設けられる。また、絶縁膜412、413には、酸化物半導体膜409bに達する開口部が設けられ、当該開口部を介して、導電膜414d、414eが酸化物半導体膜409bに電気的に接続される。導電膜414d、414eは、それぞれトランジスタTr3のソース電極及びドレイン電極としての機能を有する。
また、導電膜414eは、絶縁膜406、408、412、413に設けられた開口部を介して導電膜407fと電気的に接続される。なお、導電膜407fは、導電膜407bと同じ工程で作製され、接続電極としての機能を有する。
また、トランジスタTr3上には、絶縁膜416及び導電膜417が設けられる。なお、絶縁膜416には、導電膜414dに達する開口部が設けられ、当該開口部を介して、導電膜414dと導電膜417とが電気的に接続される。
また、導電膜417上には、絶縁膜418、EL層419、及び導電膜420が設けられる。なお、絶縁膜418には、導電膜417に達する開口部が設けられ、当該開口部を介して導電膜417と、EL層419とが電気的に接続される。
また、導電膜420は、封止材454を介して、基板452と接着されている。
また、基板452と対向する基板652上には、着色膜604、絶縁膜606、及び導電膜608が設けられる。また、基板652の下方には、機能膜626が設けられる。なお、表示素子430にて反射される光、及び表示素子630から射出される光は、着色膜604、機能膜626等を介して取り出される。
また、図6に示すように、表示素子430は、液晶層620に接する配向膜618a、618bを有する。なお、配向膜618a、618bは、設けない構成としてもよい。
また、図6に示すように、トランジスタTr1と、トランジスタTr3との構造を変えることで、回路面積を縮小させることができる。具体的には、トランジスタTr1においては、ゲート電極として機能する酸化物半導体膜411cが設けられたシングルゲートのトランジスタである。一方で、トランジスタTr3においては、第1のゲート電極として機能する導電膜407bと、第2のゲート電極として機能する酸化物半導体膜411bが設けられたマルチゲートのトランジスタである。なお、本発明の一態様の表示装置に用いるトランジスタ構造としては、上記に限定されない。例えば、トランジスタTr1及びトランジスタTr3ともに、シングルゲート構造またはマルチゲート構造としてもよい。
[FPC及びゲートドライバ回路部]
次に、図5に示す一点鎖線A1−A2の断面、及び一点鎖線A3−A4の断面の詳細について、図7を用いて説明する。図7は、図5に示す一点鎖線A1−A2及び一点鎖線A3−A4の断面の構成要素を拡大し、且つ上下を反転した断面図に相当する。なお、図7において、図面の煩雑さを避けるため、構成要素の一部を省略して図示する場合がある。
図7に示すFPCは、ACF(異方性導電フィルム(Anisotropic Conductive Film))を介して導電膜403aと電気的に接続されている。また、導電膜403a上には、絶縁膜404が設けられる。なお、絶縁膜404には、導電膜403aに達する開口部が設けられ、当該開口部を介して導電膜403aと、導電膜405aとが電気的に接続されている。
また、導電膜405a上には絶縁膜406が設けられる。なお、絶縁膜406には、導電膜405aに達する開口部が設けられ、当該開口部を介して、導電膜405aと、導電膜407aとが電気的に接続されている。また、導電膜407a上には、絶縁膜408、412、413が設けられる。なお、絶縁膜408、412、413には、導電膜407aに達する開口部が設けられ、当該開口部を介して導電膜407aと導電膜414aとが電気的に接続されている。
また、絶縁膜413及び導電膜414a上には、絶縁膜416、418が設けられる。絶縁膜418は、封止材454を介して基板452と接着されている。
図7に示すトランジスタTr4は、ゲートドライバ回路部504aが有するトランジスタに相当する。
トランジスタTr4は、絶縁膜406上に形成され、絶縁膜406上の導電膜407eと、導電膜407e上の絶縁膜408と、絶縁膜408上の酸化物半導体膜409aと、酸化物半導体膜409a上の絶縁膜410aと、絶縁膜410a上の酸化物半導体膜411aと、を有する。導電膜407eは、第1のゲート電極としての機能を有する。また、絶縁膜410aは、第2のゲート絶縁膜としての機能を有し、酸化物半導体膜411aは第2のゲート電極としての機能を有する。
また、酸化物半導体膜409a及び酸化物半導体膜411a上には、絶縁膜412、413が設けられる。また、絶縁膜412、413には、酸化物半導体膜409aに達する開口部が設けられ、当該開口部を介して、導電膜414b、414cが酸化物半導体膜409aに電気的に接続される。導電膜414b、414cは、それぞれトランジスタTr4のソース電極及びドレイン電極としての機能を有する。
また、トランジスタTr4は、先に説明したトランジスタTr3と同様にマルチゲート構造のトランジスタである。ゲートドライバ回路部504aにマルチゲート構造のトランジスタを用いることで、電流駆動能力を向上させることができるため好適である。また、マルチゲート構造のトランジスタを用いることで、電流駆動能力が向上するため、駆動回路の幅を狭くすることが可能となる。
また、トランジスタTr4上には、絶縁膜416、418が設けられる。また、絶縁膜418は、封止材454を介して、基板452と接着されている。
また、基板452と対向する、基板652上には、遮光膜602、絶縁膜606、及び導電膜608が設けられる。
また、導電膜608上のトランジスタTr4と重畳する位置に、構造体610aが形成されている。なお、構造体610aは、液晶層620の厚さを制御する機能を有する。また、図7においては、構造体610aと絶縁膜404との間に、配向膜618a、618bを有する。ただし、構造体610aと絶縁膜404との間に、配向膜618a、618bが形成されなくてもよい。
また、基板652の端部には、シール材622が設けられる。なお、シール材622は、基板652と、導電膜403aとの間に設けられる。
[接続領域及び端部近傍の領域]
次に、図5に示す一点鎖線A9−A10の断面、及び一点鎖線A11−A12の断面の詳細について、図8を用いて説明する。図8は、図5に示す一点鎖線A9−A10及び一点鎖線A11−A12の断面の構成要素を拡大し、且つ上下を反転した断面図に相当する。なお、図8において、図面の煩雑さを避けるため、構成要素の一部を省略して図示する場合がある。
図8において、導電膜608と、導電膜403cとは、導電体624を介して電気的に接続されている。なお、導電体624は、シール材622中に含まれる。また、導電膜608は、基板652、遮光膜602、及び絶縁膜606上に設けられる。
また、導電膜403c上には、絶縁膜404が設けられる。絶縁膜404には、導電膜403cに達する開口部が設けられ、当該開口部を介して、導電膜403cと導電膜405dとが電気的に接続されている。また、導電膜405d上には、絶縁膜406が設けられる。絶縁膜406には、導電膜405dに達する開口部が設けられ、当該開口部を介して、導電膜405dと導電膜407dとが電気的に接続されている。
また、導電膜407d上には、絶縁膜408、412、413が設けられる。絶縁膜408、412、413には、導電膜407dに達する開口部が設けられ、当該開口部を介して、導電膜407dと導電膜414hとが電気的に接続されている。また、導電膜414h上には、絶縁膜416、418が設けられる。また、絶縁膜418は、封止材454を介して基板452と接着される。
また、基板452、652の端部には、シール材622が設けられる。なお、シール材622は、基板652と、絶縁膜404との間に設けられる。
<1−9.表示装置の作製方法>
次に、図5に示す表示装置500の作製方法について、図9乃至図14を用いて説明する。なお、図9乃至図14は、表示装置500の作製方法を説明する断面図である。
まず、基板401上に導電膜402を形成する。その後、導電膜402上に導電膜を成膜し、当該導電膜を島状に加工することで、導電膜403a、403b、403cを形成する(図9(A)参照)。
導電膜402は、剥離層としての機能を有し、導電膜403a、403cは、接続電極としての機能を有し、導電膜403bは、画素電極としての機能を有する。なお、本実施の形態においては、導電膜402には、タングステン膜を用い、導電膜403a、403b、403cには、In−Ga−Zn酸化物を用いる。また、当該In−Ga−Zn酸化物としては、IGZO(In:Ga:Zn=4:2:4.1[原子数比])膜を用いる。
次に、導電膜402、及び導電膜403a、403b、403c上に絶縁膜を成膜し、当該絶縁膜の所望の領域に開口部を形成することで、絶縁膜404を形成する。続いて、導電膜403a、403b、403c、及び絶縁膜404上に導電膜を成膜し、当該導電膜を島状に加工することで、導電膜405a、405b、405c、405dを形成する(図9(B)参照)。
絶縁膜404としては、導電膜403a、403b、403cが重なる位置に開口部を有する。また、当該開口部を介して、導電膜403a、403b、403cと、導電膜405a、405b、405c、405dとが、電気的に接続される。なお、本実施の形態においては、絶縁膜404には、酸化窒化シリコン膜を用い、導電膜405a、405b、405c、405dには、銀、パラジウム、及び銅の合金膜を用いる。このように、導電膜405a、405b、405dとしては、反射膜として機能するため、反射率の高い金属膜(例えば、銀を含む膜)を用いると好適である。
次に、絶縁膜404、及び導電膜405a、405b、405c、405d上に絶縁膜を成膜し、当該絶縁膜の所望の領域に開口部を形成することで、絶縁膜406を形成する。続いて、導電膜405a、405b、405c、405d及び絶縁膜406上に導電膜を成膜し、当該導電膜を島状に加工することで、導電膜407a、407b、407c、407d、407e、407f、407gを形成する(図9(C)参照)。
絶縁膜406としては、導電膜405a、405c、405dが重なる位置に開口部を有する。また、当該開口部を介して、導電膜405a、405c、405dと、導電膜407a、407c、407dとが、電気的に接続される。なお、本実施の形態においては、絶縁膜406には、酸化窒化シリコン膜を用い、導電膜407a、407b、407c、407d、407e、407f、407gには、窒化タンタル膜と、銅膜との積層膜を用いる。
次に、絶縁膜406、及び導電膜407a、407b、407c、407d、407e、407f、407g上に絶縁膜408を形成する。続いて、絶縁膜408上に酸化物半導体膜を成膜し、当該酸化物半導体膜を島状に加工することで、酸化物半導体膜409a、409b、409cを形成する(図10(A)参照)。
本実施の形態においては、絶縁膜408には、酸化窒化シリコン膜を用い、酸化物半導体膜409a、409b、409cには、In−Ga−Zn酸化物を用いる。なお、当該In−Ga−Zn酸化物としては、導電膜403a、403b、403cに用いる酸化物半導体膜と同一の組成であると好適である。酸化物半導体膜409a、409b、409c、及び導電膜403a、403b、403cに同一の組成の酸化物半導体膜を用いることで、製造コストを抑制することができる。
次に、絶縁膜408、及び酸化物半導体膜409a、409b、409c上に絶縁膜及び酸化物半導体膜を成膜し、当該絶縁膜及び当該酸化物半導体膜を所望の形状に加工することで、島状の絶縁膜410a、410b、410cと、島状の酸化物半導体膜411a、411b、411cと、を形成する(図10(B)参照)。
本実施の形態においては、絶縁膜410a、410b、410cには、酸化窒化シリコン膜を用い、酸化物半導体膜411a、411b、411cには、In−Ga−Zn酸化物を用いる。なお、当該In−Ga−Zn酸化物としては、導電膜403a、403b、403c及び酸化物半導体膜409a、409b、409cに用いる酸化物半導体膜と同一の組成であると好適である。酸化物半導体膜411a、411b、411c、酸化物半導体膜409a、409b、409c、及び導電膜403a、403b、403cに同一の組成の酸化物半導体膜を用いることで、製造コストを抑制することができる。
次に、絶縁膜408、酸化物半導体膜409a、409b、409c上に絶縁膜を成膜し、当該絶縁膜の所望の領域に開口部を形成することで、絶縁膜412、413を形成する(図10(C)参照)。
なお、図10(C)においては、絶縁膜412と、絶縁膜413との2層の積層構造について例示したが、これに限定されない。例えば、絶縁膜412の単層構造、絶縁膜413の単層構造、または絶縁膜412、413と、他の絶縁膜が積層された3層以上の積層構造としてもよい。なお、本実施の形態においては、絶縁膜412には窒化シリコン膜を用い、絶縁膜413には窒化酸化シリコン膜を用いる。
また、絶縁膜412、413に開口部を設ける際に、絶縁膜408の一部にも開口部が設けられる。なお、絶縁膜408、412、413に設けられる開口部は、導電膜407a、407c、407d、407fに達する。
次に、絶縁膜413上に導電膜を成膜し、当該導電膜を所望の形状に加工することで、導電膜414a、414b、414c、414d、414e、414f、414g、414hを形成する(図11(A)参照)。
導電膜414b、414cは、トランジスタTr4のソース電極及びドレイン電極として機能する。また、導電膜414d、414eは、トランジスタTr3のソース電極及びドレイン電極として機能する。また、導電膜414f、414gは、トランジスタTr1のソース電極及びドレイン電極として機能する。
なお、トランジスタTr1において、導電膜414gは、導電膜407c及び導電膜405cを介して、導電膜403bと電気的に接続される。トランジスタTr1により、導電膜403bの電位を制御することができる。
また、本実施の形態においては、導電膜414a、414b、414c、414d、414e、414f、414g、414hには、窒化タンタルと、銅との積層膜を用いる。なお、導電膜407a、407b、407c、407d、407e、407f、407g、及び導電膜414a、414b、414c、414d、414e、414f、414g、414hに用いる導電膜を同じ材料とすることで製造コストを抑制できるため好適である。また、当該導電膜が銅を含む構成とすることで、大面積(例えば、マザーガラスのサイズが、第8世代(2160mm×2460mm)、第9世代(2400mm×2800mm、または2450mm×3050mm)、第10世代(2950mm×3400mm)等)の基板を用いた場合においても信号の遅延等を抑制することができるため好適である。
次に、トランジスタTr1、Tr3、Tr4を覆うように絶縁膜416を形成する。なお、絶縁膜416は、導電膜414dと重なる領域に開口部を有する。続いて、絶縁膜416及び導電膜414d上に導電膜を成膜し、当該導電膜を所望の形状に加工することで、導電膜417を形成する。続いて、絶縁膜416及び導電膜417上の所望の領域に絶縁膜418を形成する(図11(B)参照)。
なお、絶縁膜418は、導電膜417と重なる領域に開口部を有する。また、本実施の形態においては、絶縁膜416には、アクリル樹脂膜を用い、導電膜417には、In−Sn−Si酸化物(ITSOともいう)を用い、絶縁膜418には、ポリイミド樹脂膜を用いる。
次に、導電膜417、及び絶縁膜418上にEL層419を形成し、続けてEL層419上に導電膜420を形成する(図11(C)参照)。
導電膜417、EL層419、及び導電膜420により、表示素子630が形成される。なお、導電膜417が表示素子630の一対の電極の一方として機能し、導電膜420が表示素子630の一対の電極の他方として機能する。また、図示しないが、EL層419は、色要素(RGB)ごとに作り分ける。本実施の形態においては、R及びGには、発光層に燐光材料を用い、Bには発光層に蛍光材料を用いる。また、本実施の形態においては、導電膜420には、銀とマグネシウムの合金膜を用いる。
以上の工程で、基板401上に形成される素子を作製することができる。
次に、基板452と対向して配置される基板652の作製方法について、図12(A)(B)(C)を用いて以下説明する。
まず、基板652上に遮光膜602を形成する。その後、基板652及び遮光膜602上に着色膜604を形成する(図12(A)参照)。
本実施の形態においては、遮光膜602にはチタン膜を用い、着色膜604には、顔料を含んだアクリル樹脂膜を用いる。
次に、遮光膜602及び着色膜604上に絶縁膜606を形成する。その後、絶縁膜606上に導電膜608を形成する(図12(B)参照)。
本実施の形態においては、絶縁膜606には、アクリル樹脂膜を用い、導電膜608にはITSO膜を用いる。
次に、導電膜608上の所望の領域に構造体610a、610bを形成する。その後、導電膜608及び構造体610a、610b上に配向膜618bを形成する(図12(C)参照)。
なお、配向膜618bは、設けない構成としてもよい。なお、本実施の形態においては、構造体610a、610bには、アクリル樹脂膜を用い、配向膜618bには、ポリイミド樹脂膜を用いる。また、本実施の形態においては、構造体610a、610bを基板652上に形成する構成について例示したが、これに限定されない。例えば、先に示す基板401上に形成される素子上に構造体610a、610bを形成してもよい。
以上の工程で、基板652上に形成する素子を作製することができる。
次に、基板401上に形成された素子を、基板401から剥離する。具体的には、基板401上に形成された導電膜402と、導電膜402上に形成された導電膜403a、403b、403c及び絶縁膜404との界面で剥離する。当該剥離の方法としては、基板401上に形成された素子上に封止材454を形成する。その後、封止材454上に基板452を貼り合わせ、導電膜402の界面から素子を剥離する(図13(A)参照)。
導電膜402の界面から素子を剥離した際に、導電膜403a、403b、403cの表面(図13(A)においては、導電膜403a、403b、403cの裏面)が露出する。なお、導電膜403a、403b、403cの表面に、絶縁膜または異物等が付着している場合においては、洗浄処理、アッシング処理、またはエッチング処理等を行い、当該絶縁膜及び当該異物等を除去すると好ましい。
また、導電膜402の界面から素子を剥離する際に、導電膜402と、導電膜402上に形成された導電膜403a、403b、403c及び絶縁膜404との界面に極性溶媒(代表的には水)または非極性溶媒等を添加すると好ましい。例えば、導電膜402の界面から素子を剥離する際に、水を用いることで、剥離帯電に伴うダメージを軽減することができるため好適である。
なお、導電膜402としては、例えば、以下の材料を用いることができる。導電膜402としては、タングステン、モリブデン、チタン、タンタル、ニオブ、ニッケル、コバルト、ジルコニウム、亜鉛、ルテニウム、ロジウム、パラジウム、オスミウム、イリジウム、シリコンから選択された元素、該元素を含む合金材料、または該元素を含む化合物材料を含み、単層または積層された構造を用いることができる。また、シリコンを含む層の場合、該シリコンを含む層の結晶構造としては、非晶質、微結晶、多結晶、単結晶のいずれでもよい。
また、導電膜402として、タングステンを含む層とタングステンの酸化物を含む層の積層構造を形成する場合、タングステンを含む層を形成し、その上層に酸化物で形成される絶縁層を形成することで、タングステン層と絶縁層との界面に、タングステンの酸化物を含む層が形成されることを活用してもよい。また、タングステンを含む層の表面を、熱酸化処理、酸素プラズマ処理、一酸化二窒素(NO)プラズマ処理、またはオゾン水等の酸化力の強い溶液での処理等を行ってタングステンの酸化物を含む層を形成してもよい。またプラズマ処理や加熱処理は、酸素、窒素、一酸化二窒素単独、あるいは当該ガスとその他のガスとの混合気体雰囲気下で行ってもよい。上記プラズマ処理や加熱処理により、導電膜402の表面状態を変えることにより、導電膜402と後に形成される導電膜403a、403b、403c及び絶縁膜404との密着性を制御することが可能である。
なお、本実施の形態においては、導電膜402を設ける構成について例示したが、これに限定されない。例えば、導電膜402を設けない構成としてもよい。この場合、導電膜402が形成される位置に、有機樹脂膜を形成すればよい。当該有機樹脂膜としては、例えば、ポリイミド樹脂膜、ポリアミド樹脂膜、アクリル樹脂膜、エポキシ樹脂膜、またはフェノール樹脂膜等が挙げられる。
また、導電膜402の代わりに上記有機樹脂膜を用いる場合、基板401上に形成される素子の剥離方法としては、基板401の下方側から、レーザ光を照射することで、当該有機樹脂膜が脆弱化し、基板401と有機樹脂膜との界面、または有機樹脂膜と導電膜403a、403b、403c及び絶縁膜404との界面で剥離することができる。
また、上記レーザ光を照射する場合、レーザ光の照射エネルギー密度を調整することで、基板401と導電膜403a、403b、403c及び絶縁膜404との間に、密着性が高い領域と、密着性が弱い領域と、を作り分けることができる。当該密着性が高い領域と、密着性が弱い領域を作り分けたのち、密着性が弱い領域を剥離してもよい。
次に、素子を反転して、基板452を下方に配置し、絶縁膜404及び導電膜403b上に配向膜618aを形成する(図13(B)参照)。
なお、配向膜618aとしては、配向膜618bと同じ材料を用いればよい。
次に、基板452上の素子と、基板652上の素子とを貼り合わせ、シール材622を用いて封止する。その後、基板452と、基板652との間に液晶層620を形成し、表示素子430を形成する(図14参照)。
なお、導電膜403c上のシール材622中には、導電体624が設けられる。導電体624としては、ディスペンサ法等を用いてシール材622中の所望の領域に、導電性の粒子を形成すればよい。なお、導電体624を介して、導電膜403cと導電膜608とが電気的に接続される。
次に、基板652上に機能膜626を形成する(図14参照)。
なお、機能膜626は、形成しなくてもよい。
その後、導電膜403aにACFを介してFPCを接着する。なお、ACFの代わりにACP(異方性導電ペースト(Anisotropic Conductive Paste))を用いてもよい。
以上の工程で、図5に示す表示装置500を作製することができる。
<1−10.表示装置の変形例1>
また、図5に示す表示装置500に、タッチパネルを設ける構成としてもよい。当該タッチパネルとしては、静電容量方式(表面型静電容量方式、投影型静電容量方式等)を好適に用いることができる。
表示装置500にタッチパネルを設ける構成について、図15乃至図17を用いて説明する。
図15は表示装置500にタッチパネル691を設ける構成の断面図であり、図16は表示装置500にタッチパネル692を設ける構成の断面図であり、図17は表示装置500にタッチパネル693を設ける構成の断面図である。
図15に示すタッチパネル691は、基板652と着色膜604との間に設けられる、所謂インセル型である。タッチパネル691は、遮光膜602、及び着色膜604を形成する前に、基板652上に形成すればよい。
なお、タッチパネル691は、遮光膜662と、絶縁膜663と、導電膜664と、導電膜665と、絶縁膜666と、導電膜667と、絶縁膜668と、を有する。例えば、指やスタイラスなどの被検知体が近接することで、導電膜664と、導電膜665との相互容量の変化を検知することができる。
また、図15に示すトランジスタTr4の上方においては、導電膜664と、導電膜665との交差部を明示している。導電膜667は、絶縁膜666に設けられた開口部を介して、導電膜665を挟む2つの導電膜664と電気的に接続されている。なお、図15においては、導電膜667が設けられる領域をゲートドライバ回路部504aに相当する領域に設ける構成を例示したが、これに限定されず、例えば、画素回路501(m,n)が設けられる領域に形成してもよい。
導電膜664、及び導電膜665は、遮光膜662と重なる領域に設けられる。また、図15に示すように、導電膜664は、表示素子630と重ならないように設けられると好ましい。別言すると、導電膜664は、表示素子630と重なる領域に開口部を有する。すなわち、導電膜664はメッシュ形状を有する。このような構成とすることで、導電膜664は、表示素子630が射出する光を遮らない構成とすることができる。したがって、タッチパネル691を配置することによる輝度の低下が極めて少ないため、視認性が高く、且つ消費電力が低減された表示装置を実現できる。なお、導電膜665も同様の構成とすればよい。
また、導電膜664及び導電膜665が表示素子630と重ならないため、導電膜664及び導電膜665には、可視光の透過率が低い金属材料を用いることができる。そのため、可視光の透過率が高い酸化物材料を用いる場合と比較して、導電膜664及び導電膜665の抵抗を低くすることが可能となり、タッチパネルのセンサ感度を向上させることができる。
なお、遮光膜662には、後述する遮光膜602に用いることのできる材料を適用できる。また、絶縁膜663、666、668には、後述する絶縁膜404、406、408、410a、410b、410c、412、413、416、418、606に用いることのできる材料を適用できる。また、導電膜664、665、667には、後述する導電膜402、403a、403b、403c、405a、405b、405c、405d、407a、407b、407c、407d、407e、414a、414b、414c、414d、414e、414f、414g、414h、417、420、608と酸化物半導体膜411a、411b、411cに用いることのできる材料を適用できる。
また、導電膜664、665、667には、導電性のナノワイヤを用いてもよい。当該ナノワイヤは、直径の平均値が1nm以上100nm以下、好ましくは5nm以上50nm以下、より好ましくは5nm以上25nm以下の大きさとすればよい。また、上記ナノワイヤとしては、Agナノワイヤ、Cuナノワイヤ、またはAlナノワイヤ等の金属ナノワイヤ、あるいは、カーボンナノチューブなどを用いればよい。例えば、導電膜664、665、667のいずれか一つあるいは全部にAgナノワイヤを用いる場合、可視光における光透過率を89%以上、シート抵抗値を40Ω/□以上100Ω/□以下とすることができる。
図16に示すタッチパネル692は、基板652の上方に設けられる、所謂オンセル型である。タッチパネル692は、タッチパネル691と同様の構成を有する。
図17に示すタッチパネル693は、基板672上に設けられ、接着材674を介して基板652と接着されている。タッチパネル693は、所謂アウトセル型(外付け型ともいう)である。タッチパネル693は、タッチパネル691と同様の構成を有する。このように、本発明の一態様の表示装置は、様々な形態のタッチパネルと組み合わせて用いることができる。
<1−11.表示装置の変形例2>
また、図5に示す表示装置500の液晶素子を、横電界方式、ここではFFSモードの液晶素子とする構成の一例を図18に示す。
図18に示す表示装置500は、先の説明の構成に加え、導電膜403b、403c上の絶縁膜681と、絶縁膜681上の導電膜682と、を有する。
また、一点鎖線A9−A10に示す接続領域において、絶縁膜681は開口部を有し、当該開口部を介して、導電膜682と、導電膜403cとが電気的に接続されている。また、図18においては、シール材622中に含まれる導電体624が、設けられない構成である。
導電膜682は、共通電極としての機能を有する。また、導電膜682は、上面形状において、スリットを有する形状または櫛歯形状とすればよい。また、図18に示す表示装置500においては、導電膜682を設ける構成のため、基板652側に設けられる導電膜608が設けられない構成である。なお、導電膜682を設け、さらに基板652側に導電膜608を設ける構成としてもよい。
なお、絶縁膜681には、後述する絶縁膜404、406、408、410a、410b、410c、412、413、416、418、606に用いることのできる材料を適用できる。また、導電膜682には、後述する導電膜402、403a、403b、403c、405a、405b、405c、405d、407a、407b、407c、407d、407e、414a、414b、414c、414d、414e、414f、414g、414h、417、420、608と酸化物半導体膜411a、411b、411cに用いることのできる材料を適用できる。
なお、導電膜682を、透光性を有する材料にて形成することで、透光性を有する容量素子を形成することができる。当該透光性を有する容量素子は、導電膜682と、導電膜682と重なる絶縁膜681と、導電膜403cと、により構成される。このような構成とすることで、容量素子に蓄積される電荷量を大きくすることができるため好適である。
<1−12.表示装置の構成要素>
次に、図5乃至図14に例示した表示装置500及び表示装置500の作製方法に記載の各構成要素について、以下説明を行う。
[基板]
基板401、452、652として、作製工程中の熱処理に耐えうる程度の耐熱性を有する材料を用いることができる。
具体的には、無アルカリガラス、ソーダ石灰ガラス、カリガラス、クリスタルガラス、石英またはサファイア等を用いることができる。また、無機絶縁膜を用いてもよい。当該無機絶縁膜としては、例えば、酸化シリコン膜、窒化シリコン膜、酸化窒化シリコン膜、アルミナ膜等が挙げられる。
また、上記無アルカリガラスとしては、例えば、0.2mm以上0.7mm以下の厚さとすればよい。または、無アルカリガラスを研磨することで、上記の厚さとしてもよい。
また、基板401、452、652として、第6世代(1500mm×1850mm)、第7世代(1870mm×2200mm)、第8世代(2200mm×2400mm)、第9世代(2400mm×2800mm)、第10世代(2950mm×3400mm)等の面積が大きなガラス基板を用いることができる。これにより、大型の表示装置を作製することができる。
また、基板401、452、652として、シリコンや炭化シリコンからなる単結晶半導体基板、多結晶半導体基板、シリコンゲルマニウム等の化合物半導体基板、SOI基板等を用いてもよい。
また、基板401、452、652として、金属等の無機材料を用いてもよい。金属等の無機材料としては、ステンレススチールまたはアルミニウム等が挙げられる。
また、基板401、452、652として、樹脂、樹脂フィルムまたはプラスチック等の有機材料を用いてもよい。当該樹脂フィルムとしては、ポリエステル、ポリオレフィン、ポリアミド(ナイロン、アラミド等)、ポリイミド、ポリカーボネート、ポリウレタン、アクリル樹脂、エポキシ樹脂、ポリエチレンテレフタレート(PET)、ポリエチレンナフタレート(PEN)、ポリエーテルサルフォン(PES)、またはシロキサン結合を有する樹脂等が挙げられる。
また、基板401、452、652として、無機材料と有機材料とを組み合わせた複合材料を用いてもよい。当該複合材料としては、金属板または薄板状のガラス板と、樹脂フィルムとを貼り合わせた材料、繊維状の金属、粒子状の金属、繊維状のガラス、または粒子状のガラスを樹脂フィルムに分散した材料、もしくは繊維状の樹脂、粒子状の樹脂を無機材料に分散した材料等が挙げられる。
[導電膜]
導電膜402、403a、403b、403c、405a、405b、405c、405d、407a、407b、407c、407d、407e、414a、414b、414c、414d、414e、414f、414g、414h、417、420、608と酸化物半導体膜411a、411b、411cとしては、導電性を有する金属膜、可視光を反射する機能を有する導電膜、または可視光を透過する機能を有する導電膜を用いればよい。
導電性を有する金属膜として、アルミニウム、金、白金、銀、銅、クロム、タンタル、チタン、モリブデン、タングステン、ニッケル、鉄、コバルト、パラジウムまたはマンガンから選ばれた金属元素を含む材料を用いることができる。または、上述した金属元素を含む合金を用いてもよい。
上述の導電性を有する金属膜として、具体的には、チタン膜上に銅膜を積層する二層構造、窒化チタン膜上に銅膜を積層する二層構造、窒化タンタル膜上に銅膜を積層する二層構造、チタン膜上に銅膜を積層し、さらにその上にチタン膜を形成する三層構造等を用いればよい。特に、銅元素を含む導電膜を用いることで、抵抗を低くすることが出来るため好適である。また、銅元素を含む導電膜としては、銅とマンガンとを含む合金膜が挙げられる。当該合金膜は、ウエットエッチング法を用いて加工できるため好適である。
また、上述の導電性を有する金属膜として、導電性高分子または導電性ポリマーを用いてもよい。
また、上述の可視光を反射する機能を有する導電膜としては、金、銀、銅、またはパラジウムから選ばれた金属元素を含む材料を用いることができる。特に、銀元素を含む導電膜を用いることで、可視光における反射率を高めることができるため好適である。
また、上述の可視光を透過する機能を有する導電膜としては、インジウム、錫、亜鉛、ガリウム、またはシリコンから選ばれた元素を含む材料を用いることができる。具体的には、In酸化物、Zn酸化物、In−Sn酸化物(ITOともいう)、In−Sn−Si酸化物(ITSOともいう)、In−Zn酸化物、In−Ga−Zn酸化物等が挙げられる。
また、上述の可視光を透過する機能を有する導電膜としては、グラフェンまたはグラファイトを含む膜を用いてもよい。グラフェンを含む膜としては、酸化グラフェンを含む膜を形成し、酸化グラフェンを含む膜を還元することにより、グラフェンを含む膜を形成することができる。還元する方法としては、熱を加える方法や還元剤を用いる方法等が挙げられる。
なお、画素電極としての機能を有する、導電膜403c及び導電膜417は、酸化物半導体膜409a、409b、409cが有する金属元素を、少なくとも1以上有する。例えば、酸化物半導体膜409a、409b、409cが、In−M−Zn酸化物等の(MはAl、Ga、Y、またはSn)の金属酸化物で構成される場合、導電膜403c及び導電膜417は、In、M(MはAl、Ga、Y、またはSn)、Znのいずれか一つを有する。
[絶縁膜]
絶縁膜404、406、408、410a、410b、410c、412、413、416、418、606としては、絶縁性の無機材料、絶縁性の有機材料、または絶縁性の無機材料と絶縁性の有機材料とを含む絶縁性の複合材料を用いることができる。
上述の絶縁性の無機材料としては、酸化シリコン膜、窒化シリコン膜、酸化窒化シリコン膜、窒化酸化シリコン膜、酸化アルミニウム膜等が挙げられる。また、上述の無機材料を複数積層してもよい。
また、上述の絶縁性の有機材料としては、例えば、ポリエステル、ポリオレフィン、ポリアミド(ナイロン、アラミド等)、ポリイミド、ポリカーボネート、ポリウレタン、アクリル樹脂、エポキシ樹脂、もしくはシロキサン結合を有する樹脂を含む材料が挙げられる。また、上述の絶縁性の有機材料としては、感光性を有する材料を用いてもよい。
[酸化物半導体膜]
酸化物半導体膜409a、409b、409cは、In−M−Zn酸化物(MはAl、Ga、Y、またはSn)等の金属酸化物で形成される。また、酸化物半導体膜409a、409b、409cとして、In−Ga酸化物、In−Zn酸化物を用いてもよい。
なお、酸化物半導体膜409a、409b、409cがIn−M−Zn酸化物の場合、InとMの原子数比率は、In及びMの和を100atomic%としたときInが25atomic%より高く、Mが75atomic%未満、またはInが34atomic%より高く、Mが66atomic%未満とする。
また、酸化物半導体膜409a、409b、409cは、エネルギーギャップが2eV以上、または2.5eV以上、または3eV以上であると好ましい。
酸化物半導体膜409a、409b、409cの厚さは、3nm以上200nm以下、好ましくは3nm以上100nm以下、さらに好ましくは3nm以上60nm以下である。
酸化物半導体膜409a、409b、409cがIn−M−Zn酸化物の場合、In−M−Zn酸化物を成膜するために用いるスパッタリングターゲットの金属元素の原子数比は、In≧M、Zn≧Mを満たすことが好ましい。このようなスパッタリングターゲットの金属元素の原子数比として、In:M:Zn=1:1:1、In:M:Zn=1:1:1.2、In:M:Zn=2:1:1.5、In:M:Zn=2:1:2.3、In:M:Zn=2:1:3、In:M:Zn=3:1:2、In:M:Zn=4:2:4.1、In:M:Zn=5:1:7等が好ましい。なお、成膜される酸化物半導体膜108の原子数比はそれぞれ、上記のスパッタリングターゲットに含まれる金属元素の原子数比のプラスマイナス40%程度変動することがある。例えば、スパッタリングターゲットとして、原子数比がIn:Ga:Zn=4:2:4.1を用いる場合、成膜される酸化物半導体膜の原子数比は、In:Ga:Zn=4:2:3近傍となる場合がある。また、スパッタリングターゲットとして、原子数比がIn:Ga:Zn=5:1:7を用いる場合、成膜される酸化物半導体膜の原子数比は、In:Ga:Zn=5:1:6近傍となる場合がある。
また、酸化物半導体膜409a、409b、409cにおいて、第14族元素の一つであるシリコンや炭素が含まれると、酸素欠損が増加し、n型となる場合がある。このため、酸化物半導体膜108、特にチャネル領域108iにおいて、シリコンあるいは炭素の濃度を、2×1018atoms/cm以下、または2×1017atoms/cm以下とすることができる。この結果、トランジスタは、しきい値電圧がプラスとなる電気特性(ノーマリーオフ特性ともいう。)を有する。なお、上述のシリコンまたは炭素の濃度としては、例えば、二次イオン質量分析法(SIMS:Secondary Ion Mass Spectrometry)により測定することができる。
また、酸化物半導体膜409a、409b、409cにおいて、SIMSにより得られるアルカリ金属またはアルカリ土類金属の濃度を、1×1018atoms/cm以下、または2×1016atoms/cm以下とすることができる。アルカリ金属及びアルカリ土類金属は、酸化物半導体と結合するとキャリアを生成する場合があり、トランジスタのオフ電流が増大してしまうことがある。このため、酸化物半導体膜409a、409b、409cのアルカリ金属またはアルカリ土類金属の濃度を低減することが好ましい。この結果、トランジスタは、しきい値電圧がプラスとなる電気特性(ノーマリーオフ特性ともいう。)を有する。
また、酸化物半導体膜409a、409b、409cに窒素が含まれていると、キャリアである電子が生じ、キャリア密度が増加し、n型となる場合がある。この結果、窒素が含まれている酸化物半導体膜を用いたトランジスタはノーマリーオン特性となりやすい。従って、酸化物半導体膜409a、409b、409cにおいて、窒素はできる限り低減されていることが好ましい。例えば、SIMSにより得られる窒素濃度を、5×1018atoms/cm以下とすればよい。
また、酸化物半導体膜409a、409b、409cにおいて、不純物元素を低減することで、酸化物半導体膜のキャリア密度を低減することができる。このため、酸化物半導体膜409a、409b、409cにおいては、キャリア密度を1×1017cm−3以下、または1×1015cm−3以下、または1×1013cm−3以下、または1×1011cm−3以下とすることができる。
酸化物半導体膜409a、409b、409cとして、不純物濃度が低く、欠陥準位密度の低い酸化物半導体膜を用いることで、さらに優れた電気特性を有するトランジスタを作製することができる。ここでは、不純物濃度が低く、欠陥準位密度の低い(酸素欠損の少ない)ことを高純度真性または実質的に高純度真性と呼ぶ。あるいは、真性、または実質的に真性と呼ぶ。高純度真性または実質的に高純度真性である酸化物半導体は、キャリア発生源が少ないため、キャリア密度を低くすることができる場合がある。従って、当該酸化物半導体膜にチャネル領域が形成されるトランジスタは、しきい値電圧がプラスとなる電気特性(ノーマリーオフ特性ともいう。)になりやすい。また、高純度真性または実質的に高純度真性である酸化物半導体膜は、欠陥準位密度が低いため、トラップ準位密度も低くなる場合がある。また、高純度真性または実質的に高純度真性である酸化物半導体膜は、オフ電流が著しく小さい特性を得ることができる。従って、当該酸化物半導体膜にチャネル領域が形成されるトランジスタは、電気特性の変動が小さく、信頼性の高いトランジスタとなる場合がある。
また、酸化物半導体膜409a、409b、409cは、非単結晶構造でもよい。非単結晶構造は、例えば、後述するCAAC−OS(C Axis Aligned Crystalline Oxide Semiconductor)、多結晶構造、後述する微結晶構造、または非晶質構造を含む。非単結晶構造において、非晶質構造は最も欠陥準位密度が高く、CAAC−OSは最も欠陥準位密度が低い。
なお、酸化物半導体膜409a、409b、409cが、非晶質構造の領域、微結晶構造の領域、多結晶構造の領域、CAAC−OSの領域、及び単結晶構造の領域の二種以上を有する単層膜、あるいはこの膜が積層された構造であってもよい。
[液晶層]
液晶層620としては、サーモトロピック液晶、低分子液晶、高分子液晶、高分子分散型液晶、強誘電性液晶、反強誘電性液晶等が挙げられる。または、コレステリック相、スメクチック相、キュービック相、カイラルネマチック相、等方相等を示す液晶材料を用いてもよい。または、ブルー相を示す液晶材料を用いてもよい。
また、液晶層620の駆動方法としては、IPS(In−Plane−Switching)モード、TN(Twisted Nematic)モード、FFS(Fringe Field Switching)モード、ASM(Axially Symmetric aligned Micro−cell)モード、OCB(Optically Compensated Birefringence)モード、FLC(Ferroelectric Liquid Crystal)モード、AFLC(AntiFerroelectric Liquid Crystal)モードなどが挙げられる。また、垂直配向(VA)モード、具体的には、MVA(Multi−Domain Vertical Alignment)モード、PVA(Patterned Vertical Alignment)モード、ECB(Electrically Controlled Birefringence)モード、CPA(Continuous Pinwheel Alignment)モード、ASV(Advanced Super−View)モードなどの駆動方法を用いてもよい。
[EL層]
EL層419としては、少なくとも発光材料を有する。当該発光材料としては、有機化合物、または量子ドットなどの無機化合物が挙げられる。
上述の有機化合物、及び無機化合物としては、例えば、蒸着法(真空蒸着法を含む)、インクジェット法、塗布法、グラビア印刷法等の方法を用いて形成することができる。
有機化合物に用いることのできる材料としては、蛍光材料または燐光材料が挙げられる。寿命の観点からは、蛍光材料を用いればよく、効率の観点からは燐光材料を用いればよい。または、蛍光材料及び燐光材料の双方を有する構成としてもよい。
また、量子ドットは、数nmサイズの半導体ナノ結晶であり、1×10個から1×10個程度の原子から構成されている。量子ドットはサイズに依存してエネルギーシフトするため、同じ物質から構成される量子ドットであっても、サイズによって発光波長が異なり、用いる量子ドットのサイズを変更することによって容易に発光波長を調整することができる。
また、量子ドットは、発光スペクトルのピーク幅が狭いため、色純度のよい発光を得ることができる。さらに、量子ドットの理論的な内部量子効率はほぼ100%であると言われており、蛍光発光を呈する有機化合物の25%を大きく上回り、燐光発光を呈する有機化合物と同等となっている。このことから、量子ドットを発光材料として用いることによって発光効率の高い発光素子を得ることができる。その上、無機化合物である量子ドットはその本質的な安定性にも優れているため、寿命の観点からも好ましい発光素子を得ることができる。
量子ドットを構成する材料としては、周期表第14族元素、周期表第15族元素、周期表第16族元素、複数の周期表第14族元素からなる化合物、周期表第4族から周期表第14族に属する元素と周期表第16族元素との化合物、周期表第2族元素と周期表第16族元素との化合物、周期表第13族元素と周期表第15族元素との化合物、周期表第13族元素と周期表第17族元素との化合物、周期表第14族元素と周期表第15族元素との化合物、周期表第11族元素と周期表第17族元素との化合物、酸化鉄類、酸化チタン類、カルコゲナイドスピネル類、各種半導体クラスターなどを挙げることができる。
具体的には、セレン化カドミウム、硫化カドミウム、テルル化カドミウム、セレン化亜鉛、酸化亜鉛、硫化亜鉛、テルル化亜鉛、硫化水銀、セレン化水銀、テルル化水銀、砒化インジウム、リン化インジウム、砒化ガリウム、リン化ガリウム、窒化インジウム、窒化ガリウム、アンチモン化インジウム、アンチモン化ガリウム、リン化アルミニウム、砒化アルミニウム、アンチモン化アルミニウム、セレン化鉛、テルル化鉛、硫化鉛、セレン化インジウム、テルル化インジウム、硫化インジウム、セレン化ガリウム、硫化砒素、セレン化砒素、テルル化砒素、硫化アンチモン、セレン化アンチモン、テルル化アンチモン、硫化ビスマス、セレン化ビスマス、テルル化ビスマス、ケイ素、炭化ケイ素、ゲルマニウム、錫、セレン、テルル、ホウ素、炭素、リン、窒化ホウ素、リン化ホウ素、砒化ホウ素、窒化アルミニウム、硫化アルミニウム、硫化バリウム、セレン化バリウム、テルル化バリウム、硫化カルシウム、セレン化カルシウム、テルル化カルシウム、硫化ベリリウム、セレン化ベリリウム、テルル化ベリリウム、硫化マグネシウム、セレン化マグネシウム、硫化ゲルマニウム、セレン化ゲルマニウム、テルル化ゲルマニウム、硫化錫、セレン化錫、テルル化錫、酸化鉛、フッ化銅、塩化銅、臭化銅、ヨウ化銅、酸化銅、セレン化銅、酸化ニッケル、酸化コバルト、硫化コバルト、四酸化三鉄、硫化鉄、酸化マンガン、硫化モリブデン、酸化バナジウム、酸化タングステン、酸化タンタル、酸化チタン、酸化ジルコニウム、窒化ケイ素、窒化ゲルマニウム、酸化アルミニウム、チタン酸バリウム、セレンと亜鉛とカドミウムの化合物、インジウムと砒素とリンの化合物、カドミウムとセレンと硫黄の化合物、カドミウムとセレンとテルルの化合物、インジウムとガリウムと砒素の化合物、インジウムとガリウムとセレンの化合物、インジウムとセレンと硫黄の化合物、銅とインジウムと硫黄の化合物およびこれらの組合せなどを挙げることができるが、これらに限定されるものではない。また、組成が任意の比率で表される、いわゆる合金型量子ドットを用いても良い。例えば、カドミウムとセレンと硫黄の合金型量子ドットは、元素の含有比率を変化させることで発光波長を変えることができるため、青色発光を得るには有効な手段の一つである。
量子ドットの構造としては、コア型、コア−シェル型、コア−マルチシェル型などがあり、そのいずれを用いても良いが、コアを覆ってより広いバンドギャップを持つ別の無機材料でシェルを形成することによって、ナノ結晶表面に存在する欠陥やダングリングボンドの影響を低減することができる。これにより、発光の量子効率が大きく改善するためコア−シェル型やコア−マルチシェル型の量子ドットを用いることが好ましい。シェルの材料の例としては、硫化亜鉛や酸化亜鉛が挙げられる。
また、量子ドットは、表面原子の割合が高いことから、反応性が高く、凝集が起こりやすい。そのため、量子ドットの表面には保護剤が付着している又は保護基が設けられていることが好ましい。当該保護剤が付着している又は保護基が設けられていることによって、凝集を防ぎ、溶媒への溶解性を高めることができる。また、反応性を低減させ、電気的安定性を向上させることも可能である。保護剤(又は保護基)としては、例えば、ポリオキシエチレンラウリルエーテル、ポリオキシエチレンステアリルエーテル、ポリオキシエチレンオレイルエーテル等のポリオキシエチレンアルキルエーテル類、トリプロピルホスフィン、トリブチルホスフィン、トリヘキシルホスフィン、トリオクチルホスフィン等のトリアルキルホスフィン類、ポリオキシエチレンn−オクチルフェニルエーテル、ポリオキシエチレンn−ノニルフェニルエーテル等のポリオキシエチレンアルキルフェニルエーテル類、トリ(n−ヘキシル)アミン、トリ(n−オクチル)アミン、トリ(n−デシル)アミン等の第3級アミン類、トリプロピルホスフィンオキシド、トリブチルホスフィンオキシド、トリヘキシルホスフィンオキシド、トリオクチルホスフィンオキシド、トリデシルホスフィンオキシド等の有機リン化合物、ポリエチレングリコールジラウレート、ポリエチレングリコールジステアレート等のポリエチレングリコールジエステル類、また、ピリジン、ルチジン、コリジン、キノリン類等の含窒素芳香族化合物等の有機窒素化合物、ヘキシルアミン、オクチルアミン、デシルアミン、ドデシルアミン、テトラデシルアミン、ヘキサデシルアミン、オクタデシルアミン等のアミノアルカン類、ジブチルスルフィド等のジアルキルスルフィド類、ジメチルスルホキシドやジブチルスルホキシド等のジアルキルスルホキシド類、チオフェン等の含硫黄芳香族化合物等の有機硫黄化合物、パルミチン酸、ステアリン酸、オレイン酸等の高級脂肪酸、アルコール類、ソルビタン脂肪酸エステル類、脂肪酸変性ポリエステル類、3級アミン変性ポリウレタン類、ポリエチレンイミン類等が挙げられる。
量子ドットは、サイズが小さくなるに従いバンドギャップが大きくなるため、所望の波長の光が得られるようにそのサイズを適宜調節する。結晶サイズが小さくなるにつれて、量子ドットの発光は青色側へ、つまり、高エネルギー側へとシフトするため、量子ドットのサイズを変化させることにより、紫外領域、可視領域、赤外領域のスペクトルの波長領域にわたって、その発光波長を調節することができる。量子ドットのサイズ(直径)は0.5nm乃至20nm、好ましくは1nm乃至10nmの範囲のものが通常良く用いられる。なお、量子ドットはそのサイズ分布が狭いほど、より発光スペクトルが狭線化し、色純度の良好な発光を得ることができる。また、量子ドットの形状は特に限定されず、球状、棒状、円盤状、その他の形状であってもよい。なお、棒状の量子ドットである量子ロッドはc軸方向に偏光した指向性を有する光を呈するため、量子ロッドを発光材料として用いることにより、より外部量子効率が良好な発光素子を得ることができる。
また、EL素子では多くの場合、発光材料をホスト材料に分散することによって発光効率を高めるが、ホスト材料は発光材料以上の一重項励起エネルギー又は三重項励起エネルギーを有する物質であることが必要である。特に青色の燐光材料を用いる場合においては、それ以上の三重項励起エネルギーを有する材料であり、且つ、寿命の観点で優れたホスト材料の開発は困難を極めている。一方で、量子ドットはホスト材料を用いずに量子ドットのみで発光層を構成しても発光効率を保つことができるため、この点でも寿命という観点から好ましい発光素子を得ることができる。量子ドットのみで発光層を形成する場合には、量子ドットはコア−シェル構造(コア−マルチシェル構造を含む)であることが好ましい。
[配向膜]
配向膜618a、618bとしては、ポリイミド等を含む材料を用いることができる。具体的には、ポリイミド等を含む材料が、所定の方向に配向するようにラビング処理または光配向処理を行えばよい。
[遮光膜]
遮光膜602は、所謂ブラックマトリクスとしての機能を有する。遮光膜602としては、光の透過を妨げる材料を用いればよい。当該光の透過を妨げる材料としては、金属材料、または黒色顔料を含んだ有機樹脂材料等が挙げられる。
[着色膜]
着色膜604は、所謂カラーフィルタとしての機能を有する。着色膜604としては、所定の色の光を透過する材料(例えば、青色の光を透過する材料、緑色の光を透過する材料、赤色の光を透過する材料、黄色の光を透過する材料または白色の光を透過する材料など)を用いればよい。
[構造体]
構造体610a、610bは、構造体610a、610bを挟む構成の間に所定の間隙を設ける機能を有する。構造体610a、610bとしては、有機材料、無機材料、または有機材料と無機材料との複合材料を用いることができる。当該無機材料及び当該有機材料としては、絶縁膜404、406、408、410a、410b、410c、412、413、416、418、606に列挙した材料を用いることができる。
[機能膜]
機能膜626としては、偏光板、位相差板、拡散フィルム、反射防止フィルムまたは集光フィルム等を用いることができる。また、機能膜626として、ゴミの付着を抑制する帯電防止膜、汚れを付着しにくくする撥水性の膜、使用に伴う傷の発生を抑制するハードコート膜など用いてもよい。
[封止材]
封止材454としては、無機材料、有機材料、または無機材料と有機材料との複合材料等を用いることができる。上述の有機材料としては、例えば、熱溶融性の樹脂または硬化性の樹脂を含む有機材料が挙げられる。また、封止材454としては、樹脂材料を含む接着剤(反応硬化型の接着剤、光硬化型接着剤、熱硬化型接着剤、嫌気型接着剤等)を用いてもよい。また、上述の樹脂材料としては、エポキシ樹脂、アクリル樹脂、シリコーン樹脂、フェノール樹脂、ポリイミド樹脂、イミド樹脂、PVC(ポリビニルクロライド)樹脂、PVB(ポリビニルブチラル)樹脂、EVA(エチレンビニルアセテート)樹脂等が挙げられる。
[シール材]
シール材622としては、封止材454に列挙した材料を用いることができる。また、シール材622としては、上述の材料に加え、ガラスフリット等の材料を用いてもよい。シール材622に用いる材料としては、水分や酸素を透過しない材料を用いると好適である。
以上の説明のように、本発明の一態様の表示装置は、2つの表示素子を有する。また、当該2つの表示素子を駆動するための2つのトランジスタを有する。表示素子の一方を反射型の液晶素子とし、他方を透過型のEL素子とすることで、利便性または信頼性に優れた新規な表示装置を提供することができる。また、上記表示素子を駆動するためのトランジスタのチャネル領域と、2つの表示素子が有する一方の電極とに、酸化物半導体膜を用いることで、製造コストの抑制された新規な表示装置を提供することができる。また、トランジスタの構造をスタガ型構造とすることで、ゲート電極とソース電極及びドレイン電極との間の寄生容量を低減することができるため、消費電力が抑制された新規な表示装置を提供することができる。
なお、本実施の形態に示す構成は、他の実施の形態に示す構成と適宜組み合わせて用いることができる。
(実施の形態2)
本実施の形態では、本発明の一態様の表示装置に用いることのできるトランジスタ、及び当該トランジスタの作製方法について、図19乃至図36を用いて説明する。
<2−1.トランジスタの構成例1>
図19(A)(B)(C)に、トランジスタの一例を示す。なお、図19(A)(B)(C)に示すトランジスタは、スタガ型(トップゲート構造)である。
図19(A)は、トランジスタ100の上面図であり、図19(B)は図19(A)の一点鎖線X1−X2間の断面図であり、図19(C)は図19(A)の一点鎖線Y1−Y2間の断面図である。なお、図19(A)では、明瞭化のため、絶縁膜110などの構成要素を省略して図示している。なお、トランジスタの上面図においては、以降の図面においても図19(A)と同様に、構成要素の一部を省略して図示する場合がある。また、一点鎖線X1−X2方向をチャネル長(L)方向、一点鎖線Y1−Y2方向をチャネル幅(W)方向と呼称する場合がある。
図19(A)(B)(C)に示すトランジスタ100は、基板102上の絶縁膜104と、絶縁膜104上の酸化物半導体膜108と、酸化物半導体膜108上の絶縁膜110と、絶縁膜110上の導電膜112と、絶縁膜104、酸化物半導体膜108、及び導電膜112上の絶縁膜116と、を有する。なお、酸化物半導体膜108は、導電膜112と重なるチャネル領域108iと、絶縁膜116と接するソース領域108sと、絶縁膜116と接するドレイン領域108dと、を有する。
また、絶縁膜116は、窒素または水素を有する。絶縁膜116と、ソース領域108s及びドレイン領域108dと、が接することで、絶縁膜116中の窒素または水素がソース領域108s及びドレイン領域108d中に添加される。ソース領域108s及びドレイン領域108dは、窒素または水素が添加されることで、キャリア密度が高くなる。
また、トランジスタ100は、絶縁膜116上の絶縁膜118と、絶縁膜116、118に設けられた開口部141aを介して、ソース領域108sに電気的に接続される導電膜120aと、絶縁膜116、118に設けられた開口部141bを介して、ドレイン領域108dに電気的に接続される導電膜120bと、を有していてもよい。
なお、本明細書等において、絶縁膜104を第1の絶縁膜と、絶縁膜110を第2の絶縁膜と、絶縁膜116を第3の絶縁膜と、絶縁膜118を第4の絶縁膜と、それぞれ呼称する場合がある。また、導電膜112は、ゲート電極としての機能を有し、導電膜120aは、ソース電極としての機能を有し、導電膜120bは、ドレイン電極としての機能を有する。
また、絶縁膜110は、ゲート絶縁膜としての機能を有する。また、絶縁膜110は、過剰酸素領域を有する。絶縁膜110が過剰酸素領域を有することで、酸化物半導体膜108が有するチャネル領域108i中に過剰酸素を供給することができる。よって、チャネル領域108iに形成されうる酸素欠損を過剰酸素により補填することができるため、信頼性の高い半導体装置を提供することができる。
なお、酸化物半導体膜108中に過剰酸素を供給させるためには、酸化物半導体膜108の下方に形成される絶縁膜104に過剰酸素を供給してもよい。ただし、この場合、絶縁膜104中に含まれる過剰酸素は、酸化物半導体膜108が有するソース領域108s、及びドレイン領域108dにも供給されうる。ソース領域108s、及びドレイン領域108d中に過剰酸素が供給されると、ソース領域108s、及びドレイン領域108dの抵抗が高くなる場合がある。
一方で、酸化物半導体膜108の上方に形成される絶縁膜110に過剰酸素を有する構成とすることで、チャネル領域108iにのみ選択的に過剰酸素を供給させることが可能となる。あるいは、チャネル領域108i、ソース領域108s、及びドレイン領域108dに過剰酸素を供給させたのち、ソース領域108s及びドレイン領域108dのキャリア密度を選択的に高めることで、ソース領域108s、及びドレイン領域108dの抵抗が高くなることを抑制することができる。
また、酸化物半導体膜108が有するソース領域108s及びドレイン領域108dは、それぞれ、酸素欠損を形成する元素、または酸素欠損と結合する元素を有すると好ましい。当該酸素欠損を形成する元素、または酸素欠損と結合する元素としては、代表的には水素、ホウ素、炭素、窒素、フッ素、リン、硫黄、塩素、チタン、希ガス等が挙げられる。また、希ガス元素の代表例としては、ヘリウム、ネオン、アルゴン、クリプトン、及びキセノン等がある。上記酸素欠損を形成する元素が、絶縁膜116中に1つまたは複数含まれる場合、絶縁膜116からソース領域108s、及びドレイン領域108dに拡散する。および/または、上記酸素欠損を形成する元素は、不純物添加処理によりソース領域108s、及びドレイン領域108d中に添加される。
不純物元素が酸化物半導体膜に添加されると、酸化物半導体膜中の金属元素と酸素の結合が切断され、酸素欠損が形成される。または、不純物元素が酸化物半導体膜に添加されると、酸化物半導体膜中の金属元素と結合していた酸素が不純物元素と結合し、金属元素から酸素が脱離され、酸素欠損が形成される。これらの結果、酸化物半導体膜においてキャリア密度が増加し、導電性が高くなる。
次に、図19(A)(B)(C)に示す半導体装置の構成要素の詳細について説明する。
[基板]
基板102としては、様々な基板を用いることができ、特定のものに限定されることはない。基板102に用いることの材料としては、実施の形態1に示す基板401、452、652と同様の材料を用いることができる。
[第1の絶縁膜]
絶縁膜104としては、スパッタリング法、CVD法、蒸着法、パルスレーザー堆積(PLD)法、印刷法、塗布法等を適宜用いて形成することができる。また、絶縁膜104としては、例えば、酸化物絶縁膜または窒化物絶縁膜を単層または積層して形成することができる。なお、酸化物半導体膜108との界面特性を向上させるため、絶縁膜104において少なくとも酸化物半導体膜108と接する領域は酸化物絶縁膜で形成することが好ましい。また、絶縁膜104として加熱により酸素を放出する酸化物絶縁膜を用いることで、加熱処理により絶縁膜104に含まれる酸素を、酸化物半導体膜108に移動させることが可能である。
絶縁膜104の厚さは、50nm以上、または100nm以上3000nm以下、または200nm以上1000nm以下とすることができる。絶縁膜104を厚くすることで、絶縁膜104の酸素放出量を増加させることができると共に、絶縁膜104と酸化物半導体膜108との界面における界面準位、並びに酸化物半導体膜108のチャネル領域108iに含まれる酸素欠損を低減することが可能である。
絶縁膜104として、例えば酸化シリコン、酸化窒化シリコン、窒化酸化シリコン、窒化シリコン、酸化アルミニウム、酸化ハフニウム、酸化ガリウムまたはGa−Zn酸化物などを用いればよく、単層または積層で設けることができる。本実施の形態では、絶縁膜104として、窒化シリコン膜と、酸化窒化シリコン膜との積層構造を用いる。このように、絶縁膜104を積層構造として、下層側に窒化シリコン膜を用い、上層側に酸化窒化シリコン膜を用いることで、酸化物半導体膜108中に効率よく酸素を導入することができる。
[酸化物半導体膜]
酸化物半導体膜108としては、実施の形態1に示す酸化物半導体膜409a、409b、409cと同様の材料を用いることができる。
[第2の絶縁膜]
絶縁膜110は、トランジスタ100のゲート絶縁膜として機能する。また、絶縁膜110は、酸化物半導体膜108、特にチャネル領域108iに酸素を供給する機能を有する。例えば、絶縁膜110としては、酸化物絶縁膜または窒化物絶縁膜を単層または積層して形成することができる。なお、酸化物半導体膜108との界面特性を向上させるため、絶縁膜110において、酸化物半導体膜108と接する領域は、少なくとも酸化物絶縁膜を用いて形成することが好ましい。絶縁膜110として、例えば酸化シリコン、酸化窒化シリコン、窒化酸化シリコン、窒化シリコンなどを用いればよい。
また、絶縁膜110の厚さは、5nm以上400nm以下、または5nm以上300nm以下、または10nm以上250nm以下とすることができる。
また、絶縁膜110は、欠陥が少ないことが好ましく、代表的には、電子スピン共鳴法(ESR:Electron Spin Resonance)で観察されるシグナルが少ない方が好ましい。例えば、上述のシグナルとしては、g値が2.001に観察されるE’センターに起因するシグナルが挙げられる。なお、E’センターは、シリコンのダングリングボンドに起因する。絶縁膜110としては、E’センター起因のスピン密度が、3×1017spins/cm以下、好ましくは5×1016spins/cm以下である酸化シリコン膜、または酸化窒化シリコン膜を用いればよい。
また、絶縁膜110には、上述のシグナル以外に二酸化窒素(NO)に起因するシグナルが観察される場合がある。当該シグナルは、Nの核スピンにより3つのシグナルに分裂しており、それぞれのg値が2.037以上2.039以下(第1のシグナルとする)、g値が2.001以上2.003以下(第2のシグナルとする)、及びg値が1.964以上1.966以下(第3のシグナルとする)に観察される。
例えば、絶縁膜110として、二酸化窒素(NO)に起因するシグナルのスピン密度が、1×1017spins/cm以上1×1018spins/cm未満である絶縁膜を用いると好適である。
なお、二酸化窒素(NO)を含む窒素酸化物(NO)は、絶縁膜110中に準位を形成する。当該準位は、酸化物半導体膜108のエネルギーギャップ内に位置する。そのため、窒素酸化物(NO)が、絶縁膜110及び酸化物半導体膜108の界面に拡散すると、当該準位が絶縁膜110側において電子をトラップする場合がある。この結果、トラップされた電子が、絶縁膜110及び酸化物半導体膜108界面近傍に留まるため、トランジスタのしきい値電圧をプラス方向にシフトさせてしまう。したがって、絶縁膜110としては、窒素酸化物の含有量が少ない膜を用いると、トランジスタのしきい値電圧のシフトを低減することができる。
窒素酸化物(NO)の放出量が少ない絶縁膜としては、例えば、酸化窒化シリコン膜を用いることができる。当該酸化窒化シリコン膜は、昇温脱離ガス分析法(TDS:Thermal Desorption Spectroscopy)において、窒素酸化物(NO)の放出量よりアンモニアの放出量が多い膜であり、代表的にはアンモニアの放出量が1×1018cm−3以上5×1019cm−3以下である。なお、上記のアンモニアの放出量は、TDSにおける加熱処理の温度が50℃以上650℃以下、または50℃以上550℃以下の範囲での総量である。
窒素酸化物(NO)は、加熱処理においてアンモニア及び酸素と反応するため、アンモニアの放出量が多い絶縁膜を用いることで窒素酸化物(NO)が低減される。
なお、絶縁膜110をSIMSで分析した場合、膜中の窒素濃度が6×1020atoms/cm以下であると好ましい。
また、絶縁膜110として、ハフニウムシリケート(HfSiO)、窒素が添加されたハフニウムシリケート(HfSi)、窒素が添加されたハフニウムアルミネート(HfAl)、酸化ハフニウムなどのhigh−k材料を用いてもよい。当該high−k材料を用いることでトランジスタのゲートリークを低減できる。
[第3の絶縁膜]
絶縁膜116は、窒素または水素を有する。また、絶縁膜116は、フッ素を有していてもよい。絶縁膜116としては、例えば、窒化物絶縁膜が挙げられる。該窒化物絶縁膜としては、窒化シリコン、窒化酸化シリコン、酸化窒化シリコン、窒化フッ化シリコン、フッ化窒化シリコン等を用いて形成することができる。絶縁膜116に含まれる水素濃度は、1×1022atoms/cm以上であると好ましい。また、絶縁膜116は、酸化物半導体膜108のソース領域108s、及びドレイン領域108dと接する。したがって、絶縁膜116と接するソース領域108s、及びドレイン領域108d中の不純物(窒素または水素)濃度が高くなり、ソース領域108s、及びドレイン領域108dのキャリア密度を高めることができる。
[第4の絶縁膜]
絶縁膜118としては、酸化物絶縁膜を用いることができる。また、絶縁膜118としては、酸化物絶縁膜と、窒化物絶縁膜との積層膜を用いることができる。絶縁膜118として、例えば酸化シリコン、酸化窒化シリコン、窒化酸化シリコン、酸化アルミニウム、酸化ハフニウム、酸化ガリウムまたはGa−Zn酸化物などを用いればよい。
また、絶縁膜118としては、外部からの水素、水等のバリア膜として機能する膜であることが好ましい。
絶縁膜118の厚さは、30nm以上500nm以下、または100nm以上400nm以下とすることができる。
[導電膜]
導電膜112、120a、120bとしては、スパッタリング法、真空蒸着法、パルスレーザー堆積(PLD)法、熱CVD法等を用いて形成することができる。また、導電膜112、120a、120bとしては、実施の形態1に示す導電膜402、403a、403b、403c、405a、405b、405c、405d、407a、407b、407c、407d、407e、414a、414b、414c、414d、414e、414f、414g、414h、417、420、608と酸化物半導体膜411a、411b、411cと同様の材料を用いることができる。
また、導電膜112、120a、120bは、ITO、酸化タングステンを含むインジウム酸化物、酸化タングステンを含むインジウム亜鉛酸化物、酸化チタンを含むインジウム酸化物、酸化チタンを含むインジウム錫酸化物、インジウム亜鉛酸化物、ITSO等の透光性を有する導電性材料を適用することもできる。また、上記透光性を有する導電性材料と、上記金属元素の積層構造とすることもできる。
なお、導電膜112として、In−Ga−Zn酸化物に代表される酸化物半導体を用いてよい。当該酸化物半導体は、絶縁膜116から窒素または水素が供給されることで、キャリア密度が高くなる。別言すると、酸化物半導体は、酸化物導電体(OC:Oxide Conductor)として機能する。したがって、酸化物半導体は、ゲート電極として用いることができる。
例えば、導電膜112としては、酸化物導電体(OC)の単層構造、金属膜の単層構造、または酸化物導電体(OC)と、金属膜との積層構造等が挙げられる。
なお、導電膜112として、遮光性を有する金属膜の単層構造、または酸化物導電体(OC)と遮光性を有する金属膜との積層構造を用いる場合、導電膜112の下方に形成されるチャネル領域108iを遮光することができるため、好適である。また、導電膜112として、酸化物半導体または酸化物導電体(OC)と、遮光性を有する金属膜との積層構造を用いる場合、酸化物半導体または酸化物導電体(OC)上に、金属膜(例えば、チタン膜、タングステン膜など)を形成することで、金属膜中の構成元素が酸化物半導体または酸化物導電体(OC)側に拡散し低抵抗化する、金属膜の成膜時のダメージ(例えば、スパッタリングダメージなど)により低抵抗化する、あるいは金属膜中に酸化物半導体または酸化物導電体(OC)中の酸素が拡散することで、酸素欠損が形成され低抵抗化する。
導電膜112、120a、120bの厚さとしては、30nm以上500nm以下、または100nm以上400nm以下とすることができる。
<2−2.トランジスタの構成例2>
次に、図19(A)(B)(C)に示すトランジスタと異なる構成について、図20(A)(B)(C)を用いて説明する。
図20(A)は、トランジスタ100Aの上面図であり、図20(B)は図20(A)の一点鎖線X1−X2間の断面図であり、図20(C)は図20(A)の一点鎖線Y1−Y2間の断面図である。
図20(A)(B)(C)に示すトランジスタ100Aは、基板102上の導電膜106と、導電膜106上の絶縁膜104と、絶縁膜104上の酸化物半導体膜108と、酸化物半導体膜108上の絶縁膜110と、絶縁膜110上の導電膜112と、絶縁膜104、酸化物半導体膜108、及び導電膜112上の絶縁膜116と、を有する。なお、酸化物半導体膜108は、導電膜112と重なるチャネル領域108iと、絶縁膜116と接するソース領域108sと、絶縁膜116と接するドレイン領域108dと、を有する。
トランジスタ100Aは、先に示すトランジスタ100の構成に加え、導電膜106と、開口部143と、を有する。
なお、開口部143は、絶縁膜104、110に設けられる。また、導電膜106は、開口部143を介して、導電膜112と、電気的に接続される。よって、導電膜106と導電膜112には、同じ電位が与えられる。なお、開口部143を設けずに、導電膜106と、導電膜112と、に異なる電位を与えてもよい。または、開口部143を設けずに、導電膜106を遮光膜として用いてもよい。例えば、導電膜106を遮光性の材料により形成することで、チャネル領域108iに照射される下方からの光を抑制することができる。
また、トランジスタ100Aの構成とする場合、導電膜106は、第1のゲート電極(ボトムゲート電極ともいう)としての機能を有し、導電膜112は、第2のゲート電極(トップゲート電極ともいう)としての機能を有する。また、絶縁膜104は、第1のゲート絶縁膜としての機能を有し、絶縁膜110は、第2のゲート絶縁膜としての機能を有する。
導電膜106としては、先に記載の導電膜112、120a、120bと同様の材料を用いることができる。特に導電膜106として、銅を含む材料により形成することで抵抗を低くすることができるため好適である。例えば、導電膜106を窒化チタン膜、窒化タンタル膜、またはタングステン膜上に銅膜を設ける積層構造とし、導電膜120a、120bを窒化チタン膜、窒化タンタル膜、またはタングステン膜上に銅膜を設ける積層構造とすると好適である。この場合、トランジスタ100Aを表示装置の画素トランジスタ及び駆動トランジスタのいずれか一方または双方に用いることで、導電膜106と導電膜120aとの間に生じる寄生容量、及び導電膜106と導電膜120bとの間に生じる寄生容量を低くすることができる。したがって、導電膜106、導電膜120a、及び導電膜120bを、トランジスタ100Aの第1のゲート電極、ソース電極、及びドレイン電極として用いるのみならず、表示装置の電源供給用の配線、信号供給用の配線、または接続用の配線等に用いる事も可能となる。
このように、図20(A)(B)(C)に示すトランジスタ100Aは、先に説明したトランジスタ100と異なり、酸化物半導体膜108の上下にゲート電極として機能する導電膜を有する構造である。トランジスタ100Aに示すように、本発明の一態様の半導体装置には、複数のゲート電極を設けてもよい。
また、図20(C)に示すように、酸化物半導体膜108は、第1のゲート電極として機能する導電膜106と、第2のゲート電極として機能する導電膜112のそれぞれと対向するように位置し、2つのゲート電極として機能する導電膜に挟まれている。
また、導電膜112のチャネル幅方向の長さは、酸化物半導体膜108のチャネル幅方向の長さよりも長く、酸化物半導体膜108のチャネル幅方向全体は、絶縁膜110を介して導電膜112に覆われている。また、導電膜112と導電膜106とは、絶縁膜104、及び絶縁膜110に設けられる開口部143において接続されるため、酸化物半導体膜108のチャネル幅方向の側面の一方は、絶縁膜110を介して導電膜112と対向している。
別言すると、トランジスタ100Aのチャネル幅方向において、導電膜106及び導電膜112は、絶縁膜104、及び絶縁膜110に設けられる開口部143において接続すると共に、絶縁膜104、及び絶縁膜110を介して酸化物半導体膜108を取り囲む構成である。
このような構成を有することで、トランジスタ100Aに含まれる酸化物半導体膜108を、第1のゲート電極として機能する導電膜106及び第2のゲート電極として機能する導電膜112の電界によって電気的に取り囲むことができる。トランジスタ100Aのように、第1のゲート電極及び第2のゲート電極の電界によって、チャネル領域が形成される酸化物半導体膜108を電気的に取り囲むトランジスタのデバイス構造をSurrounded channel(S−channel)構造と呼ぶことができる。
トランジスタ100Aは、S−channel構造を有するため、導電膜106または導電膜112によってチャネルを誘起させるための電界を効果的に酸化物半導体膜108に印加することができるため、トランジスタ100Aの電流駆動能力が向上し、高いオン電流特性を得ることが可能となる。また、オン電流を高くすることが可能であるため、トランジスタ100Aを微細化することが可能となる。また、トランジスタ100Aは、酸化物半導体膜108が導電膜106、及び導電膜112によって取り囲まれた構造を有するため、トランジスタ100Aの機械的強度を高めることができる。
なお、トランジスタ100Aのチャネル幅方向において、酸化物半導体膜108の開口部143が形成されていない側に、開口部143と異なる開口部を形成してもよい。
また、トランジスタ100Aに示すように、トランジスタが、半導体膜を間に挟んで存在する一対のゲート電極を有している場合、一方のゲート電極には信号Aが、他方のゲート電極には固定電位Vbが与えられてもよい。また、一方のゲート電極には信号Aが、他方のゲート電極には信号Bが与えられてもよい。また、一方のゲート電極には固定電位Vaが、他方のゲート電極には固定電位Vbが与えられてもよい。
信号Aは、例えば、導通状態または非導通状態を制御するための信号である。信号Aは、電位V1、または電位V2(V1>V2とする)の2種類の電位をとるデジタル信号であってもよい。例えば、電位V1を高電源電位とし、電位V2を低電源電位とすることができる。信号Aは、アナログ信号であってもよい。
固定電位Vbは、例えば、トランジスタのしきい値電圧VthAを制御するための電位である。固定電位Vbは、電位V1、または電位V2であってもよい。この場合、固定電位Vbを生成するための電位発生回路を、別途設ける必要がなく好ましい。固定電位Vbは、電位V1、または電位V2と異なる電位であってもよい。固定電位Vbを低くすることで、しきい値電圧VthAを高くできる場合がある。その結果、ゲート−ソース間電圧Vgsが0Vのときのドレイン電流を低減し、トランジスタを有する回路のリーク電流を低減できる場合がある。例えば、固定電位Vbを低電源電位よりも低くしてもよい。一方で、固定電位Vbを高くすることで、しきい値電圧VthAを低くできる場合がある。その結果、ゲート−ソース間電圧Vgsが高電源電位のときのドレイン電流を向上させ、トランジスタを有する回路の動作速度を向上できる場合がある。例えば、固定電位Vbを低電源電位よりも高くしてもよい。
信号Bは、例えば、導通状態または非導通状態を制御するための信号である。信号Bは、電位V3、または電位V4(V3>V4とする)の2種類の電位をとるデジタル信号であってもよい。例えば、電位V3を高電源電位とし、電位V4を低電源電位とすることができる。信号Bは、アナログ信号であってもよい。
信号Aと信号Bが共にデジタル信号である場合、信号Bは、信号Aと同じデジタル値を持つ信号であってもよい。この場合、トランジスタのオン電流を向上し、トランジスタを有する回路の動作速度を向上できる場合がある。このとき、信号Aにおける電位V1及び電位V2は、信号Bにおける電位V3及び電位V4と、異なっていても良い。例えば、信号Bが入力されるゲートに対応するゲート絶縁膜が、信号Aが入力されるゲートに対応するゲート絶縁膜よりも厚い場合、信号Bの電位振幅(V3−V4)を、信号Aの電位振幅(V1−V2)より大きくしても良い。そうすることで、トランジスタの導通状態または非導通状態に対して、信号Aが与える影響と、信号Bが与える影響と、を同程度とすることができる場合がある。
信号Aと信号Bが共にデジタル信号である場合、信号Bは、信号Aと異なるデジタル値を持つ信号であってもよい。この場合、トランジスタの制御を信号Aと信号Bによって別々に行うことができ、より高い機能を実現できる場合がある。例えば、トランジスタがnチャネル型である場合、信号Aが電位V1であり、かつ、信号Bが電位V3である場合のみ導通状態となる場合や、信号Aが電位V2であり、かつ、信号Bが電位V4である場合のみ非導通状態となる場合には、一つのトランジスタでNAND回路やNOR回路等の機能を実現できる場合がある。また、信号Bは、しきい値電圧VthAを制御するための信号であってもよい。例えば、信号Bは、トランジスタを有する回路が動作している期間と、当該回路が動作していない期間と、で電位が異なる信号であっても良い。信号Bは、回路の動作モードに合わせて電位が異なる信号であってもよい。この場合、信号Bは信号Aほど頻繁には電位が切り替わらない場合がある。
信号Aと信号Bが共にアナログ信号である場合、信号Bは、信号Aと同じ電位のアナログ信号、信号Aの電位を定数倍したアナログ信号、または、信号Aの電位を定数だけ加算もしくは減算したアナログ信号等であってもよい。この場合、トランジスタのオン電流が向上し、トランジスタを有する回路の動作速度を向上できる場合がある。信号Bは、信号Aと異なるアナログ信号であってもよい。この場合、トランジスタの制御を信号Aと信号Bによって別々に行うことができ、より高い機能を実現できる場合がある。
信号Aがデジタル信号であり、信号Bがアナログ信号であってもよい。または信号Aがアナログ信号であり、信号Bがデジタル信号であってもよい。
トランジスタの両方のゲート電極に固定電位を与える場合、トランジスタを、抵抗素子と同等の素子として機能させることができる場合がある。例えば、トランジスタがnチャネル型である場合、固定電位Vaまたは固定電位Vbを高く(低く)することで、トランジスタの実効抵抗を低く(高く)することができる場合がある。固定電位Va及び固定電位Vbを共に高く(低く)することで、一つのゲートしか有さないトランジスタによって得られる実効抵抗よりも低い(高い)実効抵抗が得られる場合がある。
なお、トランジスタ100Aのその他の構成は、先に示すトランジスタ100と同様であり、同様の効果を奏する。
<2−3.トランジスタの構成例3>
次に、図20(A)(B)(C)に示すトランジスタと異なる構成について、図21乃至図24を用いて説明する。
図21(A)(B)は、トランジスタ100Bの断面図であり、図22(A)(B)は、トランジスタ100Cの断面図であり、図23(A)(B)は、トランジスタ100Dの断面図であり、図24(A)(B)は、トランジスタ100Eの断面図である。なお、トランジスタ100B、トランジスタ100C、トランジスタ100D、及びトランジスタ100Eの上面図としては、図20(A)に示すトランジスタ100Aと同様であるため、ここでの説明は省略する。
図21(A)(B)に示すトランジスタ100Bは、先に示すトランジスタ100Aと絶縁膜110、及び導電膜112の形状が異なる。具体的には、トランジスタのチャネル長(L)方向の断面において、トランジスタ100Aは、絶縁膜110、及び導電膜112の形状が矩形状であるのに対し、トランジスタ100Bは、絶縁膜110、及び導電膜112の形状がテーパー形状である。より詳しくは、トランジスタ100Aは、トランジスタのチャネル長(L)方向の断面において、導電膜112の上端部と、絶縁膜110の下端部とが概略同じ位置に形成される。一方で、トランジスタ100Bは、トランジスタのチャネル長(L)方向の断面において、導電膜112の上端部が絶縁膜110の下端部よりも内側に形成される。別言すると、絶縁膜110の側端部は、導電膜112の側端部よりも外側に位置する。
トランジスタ100Aとしては、導電膜112と、絶縁膜110と、を同じマスクで加工し、ドライエッチング法を用いて、一括して加工することで形成できる。トランジスタ100Bとしては、導電膜112と、絶縁膜110と、を同じマスクで加工し、ウエットエッチング法及びドライエッチング法を組み合わせて加工することで形成できる。
トランジスタ100Aのような構成とすることで、ソース領域108s及びドレイン領域108dと、導電膜112との端部が概略同じ位置に形成されるため好ましい。一方で、トランジスタ100Bのような構成とすることで、絶縁膜116の被覆性が向上するため好ましい。
図22(A)(B)に示すトランジスタ100Cは、先に示すトランジスタ100Aと比較し、導電膜112、及び絶縁膜110の形状が異なる。具体的には、トランジスタ100Cは、トランジスタのチャネル長(L)方向の断面において、導電膜112の下端部と、絶縁膜110の上端部との位置が異なる。導電膜112の下端部は、絶縁膜110の上端部よりも内側に形成される。
例えば、導電膜112と、絶縁膜110と、を同じマスクで加工し、導電膜112をウエットエッチング法で、絶縁膜110をドライエッチング法で、それぞれ加工することで、トランジスタ100Cの構造とすることができる。
また、トランジスタ100Cの構造とすることで、酸化物半導体膜108中に、領域108fが形成される場合がある。領域108fは、チャネル領域108iとソース領域108sとの間、及びチャネル領域108iとドレイン領域108dとの間に形成される。
領域108fは、高抵抗領域あるいは低抵抗領域のいずれか一方として機能する。高抵抗領域とは、チャネル領域108iと同等の抵抗を有し、ゲート電極として機能する導電膜112が重畳しない領域である。領域108fが高抵抗領域の場合、領域108fは、所謂オフセット領域として機能する。領域108fがオフセット領域として機能する場合においては、トランジスタ100Cのオン電流の低下を抑制するために、チャネル長(L)方向の断面において、領域108fを1μm以下とすればよい。
また、低抵抗領域とは、チャネル領域108iよりも抵抗が低く、且つソース領域108s及びドレイン領域108dよりも抵抗が高い領域である。領域108fが低抵抗領域の場合、領域108fは、所謂、LDD(Lightly Doped Drain)領域として機能する。領域108fがLDD領域として機能する場合においては、ドレイン領域の電界緩和が可能となるため、ドレイン領域の電界に起因したトランジスタのしきい値電圧の変動を低減することができる。
なお、領域108fをLDD領域とする場合には、例えば、絶縁膜116から領域108fに窒素または水素を供給する、あるいは、導電膜112及び絶縁膜110をマスクとして、導電膜112及び絶縁膜110の上方から不純物元素を添加することで、当該不純物元素が絶縁膜110を介し、酸化物半導体膜108に添加されることで形成することができる。
図23(A)(B)に示すトランジスタ100Dは、先に示すトランジスタ100Aと比較し、導電膜112、及び絶縁膜110の形状が異なる。具体的には、トランジスタ100Dは、トランジスタのチャネル長(L)方向の断面において、導電膜112の下端部と、絶縁膜110の上端部との位置が異なる。具体的には、導電膜112の下端部は、絶縁膜110の上端部よりも外側に形成される。
例えば、導電膜112と、絶縁膜110と、を同じマスクで加工し、導電膜112をドライエッチング法で、絶縁膜110をウエットエッチング法で、それぞれ加工することで、トランジスタ100Dの構造とすることができる。
なお、トランジスタ100Dの構造とすることで、ゲート電極として機能する導電膜112よりも内側にソース領域108s及びドレイン領域108dの一部が設けられる。なお、導電膜112と、ソース領域108sとが重なる領域、及び導電膜112と、ドレイン領域108dとが重なる領域は、所謂オーバーラップ領域(Lov領域ともいう)として機能する。なお、Lov領域とは、ゲート電極として機能する導電膜112と重なり、且つチャネル領域108iよりも抵抗が低い領域である。Lov領域を有する構造とすることで、チャネル領域108iと、ソース領域108s及びドレイン領域108dとの間に高抵抗領域が形成されないため、トランジスタのオン電流を高めることが可能となる。
図24(A)(B)に示すトランジスタ100Eは、先に示すトランジスタ100Aと比較し、絶縁膜118上に平坦化膜として機能する絶縁膜122が設けられている点が異なる。それ以外の構成については、先に示すトランジスタ100Aと同様の構成であり、同様の効果を奏する。
絶縁膜122は、トランジスタ等に起因する凹凸等を平坦化させる機能を有する。絶縁膜122としては、絶縁性であればよく、無機材料または有機材料を用いて形成される。該無機材料としては、酸化シリコン膜、酸化窒化シリコン膜、窒化酸化シリコン膜、窒化シリコン膜、酸化アルミニウム膜、窒化アルミニウム膜等が挙げられる。該有機材料としては、例えば、アクリル樹脂、またはポリイミド樹脂等の感光性の樹脂材料が挙げられる。
なお、図24(A)(B)においては、絶縁膜122が有する開口部の形状は、開口部141a、141bよりも大きい形状としたが、これに限定されず、例えば、開口部141a、141bと同じ形状、または開口部141a、141bよりも小さい形状としてもよい。
また、図24(A)(B)においては、絶縁膜122上に導電膜120a、120bを設ける構成について例示したがこれに限定されず、例えば、絶縁膜118上に導電膜120a、120bを設け、導電膜120a、120b上に絶縁膜122を設ける構成としてもよい。
<2−4.トランジスタの構成例4>
次に、図20(A)(B)(C)に示すトランジスタと異なる構成について、図25乃至図30を用いて説明する。
図25(A)(B)は、トランジスタ100Fの断面図であり、図26(A)(B)は、トランジスタ100Gの断面図であり、図27(A)(B)は、トランジスタ100Hの断面図であり、図28(A)(B)は、トランジスタ100Jの断面図であり、図29(A)(B)は、トランジスタ100Kの断面図である。なお、トランジスタ100F、トランジスタ100G、トランジスタ100H、トランジスタ100J、及びトランジスタ100Kの上面図としては、図20(A)に示すトランジスタ100Aと同様であるため、ここでの説明は省略する。
トランジスタ100F、トランジスタ100G、トランジスタ100H、トランジスタ100J、及びトランジスタ100Kは、先に示すトランジスタ100Aと酸化物半導体膜108の構造が異なる。それ以外の構成については、先に示すトランジスタ100Aと同様の構成であり、同様の効果を奏する。
図25(A)(B)に示すトランジスタ100Fが有する酸化物半導体膜108は、絶縁膜104上の酸化物半導体膜108_1と、酸化物半導体膜108_1上の酸化物半導体膜108_2と、酸化物半導体膜108_2上の酸化物半導体膜108_3と、を有する。また、チャネル領域108i、ソース領域108s、及びドレイン領域108dは、それぞれ、酸化物半導体膜108_1、酸化物半導体膜108_2、及び酸化物半導体膜108_3の3層の積層構造である。
図26(A)(B)に示すトランジスタ100Gが有する酸化物半導体膜108は、絶縁膜104上の酸化物半導体膜108_2と、酸化物半導体膜108_2上の酸化物半導体膜108_3と、を有する。また、チャネル領域108i、ソース領域108s、及びドレイン領域108dは、それぞれ、酸化物半導体膜108_2、及び酸化物半導体膜108_3の2層の積層構造である。
図27(A)(B)に示すトランジスタ100Hが有する酸化物半導体膜108は、絶縁膜104上の酸化物半導体膜108_1と、酸化物半導体膜108_1上の酸化物半導体膜108_2と、を有する。また、チャネル領域108i、ソース領域108s、及びドレイン領域108dは、それぞれ、酸化物半導体膜108_1、及び酸化物半導体膜108_2の2層の積層構造である。
図28(A)(B)に示すトランジスタ100Jが有する酸化物半導体膜108は、絶縁膜104上の酸化物半導体膜108_1と、酸化物半導体膜108_1上の酸化物半導体膜108_2と、酸化物半導体膜108_2上の酸化物半導体膜108_3と、を有する。また、チャネル領域108iは、酸化物半導体膜108_1、酸化物半導体膜108_2、及び酸化物半導体膜108_3の3層の積層構造であり、ソース領域108s、及びドレイン領域108dは、それぞれ、酸化物半導体膜108_1、及び酸化物半導体膜108_2の2層の積層構造である。なお、トランジスタ100Jのチャネル幅(W)方向の断面において、酸化物半導体膜108_3が、酸化物半導体膜108_1及び酸化物半導体膜108_2の側面を覆う。
図29(A)(B)に示すトランジスタ100Kが有する酸化物半導体膜108は、絶縁膜104上の酸化物半導体膜108_2と、酸化物半導体膜108_2上の酸化物半導体膜108_3と、を有する。また、チャネル領域108iは、酸化物半導体膜108_2、及び酸化物半導体膜108_3の2層の積層構造であり、ソース領域108s、及びドレイン領域108dは、それぞれ、酸化物半導体膜108_2の単層構造である。なお、トランジスタ100Kのチャネル幅(W)方向の断面において、酸化物半導体膜108_3が、酸化物半導体膜108_2の側面を覆う。
チャネル領域108iのチャネル幅(W)方向の側面またはその近傍においては、加工におけるダメージにより欠陥(例えば、酸素欠損)が形成されやすい、あるいは不純物の付着により汚染されやすい。そのため、チャネル領域108iが実質的に真性であっても、電界などのストレスが印加されることによって、チャネル領域108iのチャネル幅(W)方向の側面またはその近傍が活性化され、低抵抗(n型)領域となりやすい。また、チャネル領域108iのチャネル幅(W)方向の側面またはその近傍がn型領域の場合、当該n型領域がキャリアのパスとなるため、寄生チャネルが形成される場合がある。
そこで、トランジスタ100J、及びトランジスタ100Kにおいては、チャネル領域108iを積層構造とし、チャネル領域108iのチャネル幅(W)方向の側面を、積層構造の一方の層で覆う構成とする。当該構成とすることで、チャネル領域108iの側面またはその近傍の欠陥を抑制する、あるいはチャネル領域108iの側面またはその近傍への不純物の付着を低減することが可能となる。
<2−5.バンド構造>
ここで、絶縁膜104、酸化物半導体膜108_1、108_2、108_3、及び絶縁膜110のバンド構造、絶縁膜104、酸化物半導体膜108_2、108_3、及び絶縁膜110のバンド構造、並びに絶縁膜104、酸化物半導体膜108_1、108_2、及び絶縁膜110のバンド構造について、図30(A)(B)(C)を用いて説明する。なお、図30(A)(B)(C)は、チャネル領域108iにおけるバンド構造である。
図30(A)は、絶縁膜104、酸化物半導体膜108_1、108_2、108_3、及び絶縁膜110を有する積層構造の膜厚方向のバンド構造の一例である。また、図30(B)は、絶縁膜104、酸化物半導体膜108_2、108_3、及び絶縁膜110を有する積層構造の膜厚方向のバンド構造の一例である。また、図30(C)は、絶縁膜104、酸化物半導体膜108_1、108_2、及び絶縁膜110を有する積層構造の膜厚方向のバンド構造の一例である。なお、バンド構造は、理解を容易にするため絶縁膜104、酸化物半導体膜108_1、108_2、108_3、及び絶縁膜110の伝導帯下端のエネルギー準位(Ec)を示す。
また、図30(A)は、絶縁膜104、110として酸化シリコン膜を用い、酸化物半導体膜108_1として金属元素の原子数比をIn:Ga:Zn=1:3:2の金属酸化物ターゲットを用いて形成される酸化物半導体膜を用い、酸化物半導体膜108_2として金属元素の原子数比をIn:Ga:Zn=4:2:4.1の金属酸化物ターゲットを用いて形成される酸化物半導体膜を用い、酸化物半導体膜108_3として金属元素の原子数比をIn:Ga:Zn=1:3:2の金属酸化物ターゲットを用いて形成される酸化物半導体膜を用いる構成のバンド図である。
また、図30(B)は、絶縁膜104、110として酸化シリコン膜を用い、酸化物半導体膜108_2として金属元素の原子数比をIn:Ga:Zn=4:2:4.1の金属酸化物ターゲットを用いて形成される酸化物半導体膜を用い、酸化物半導体膜108_3として金属元素の原子数比をIn:Ga:Zn=1:3:2の金属酸化物ターゲットを用いて形成される酸化物半導体膜を用いる構成のバンド図である。
また、図30(C)は、絶縁膜104、110として酸化シリコン膜を用い、酸化物半導体膜108_1として金属元素の原子数比をIn:Ga:Zn=1:3:2の金属酸化物ターゲットを用いて形成される酸化物半導体膜を用い、酸化物半導体膜108_2として金属元素の原子数比をIn:Ga:Zn=4:2:4.1の金属酸化物ターゲットを用いて形成される酸化物半導体膜を用いる構成のバンド図である。
図30(A)に示すように、酸化物半導体膜108_1、108_2、108_3において、伝導帯下端のエネルギー準位はなだらかに変化する。また、図30(B)に示すように、酸化物半導体膜108_2、108_3において、伝導帯下端のエネルギー準位はなだらかに変化する。また、図30(C)に示すように、酸化物半導体膜108_1、108_2において、伝導帯下端のエネルギー準位はなだらかに変化する。換言すると、連続的に変化または連続接合するともいうことができる。このようなバンド構造を有するためには、酸化物半導体膜108_1と酸化物半導体膜108_2との界面、または酸化物半導体膜108_2と酸化物半導体膜108_3との界面において、トラップ中心や再結合中心のような欠陥準位を形成するような不純物が存在しないとする。
酸化物半導体膜108_1、108_2、108_3に連続接合を形成するためには、ロードロック室を備えたマルチチャンバー方式の成膜装置(スパッタリング装置)を用いて各膜を大気に触れさせることなく連続して積層することが必要となる。
図30(A)(B)(C)に示す構成とすることで酸化物半導体膜108_2がウェル(井戸)となり、上記積層構造を用いたトランジスタにおいて、チャネル領域が酸化物半導体膜108_2に形成されることがわかる。
なお、酸化物半導体膜108_1、108_3を設けることにより、トラップ準位を酸化物半導体膜108_2より遠ざけることができる。
また、トラップ準位がチャネル領域として機能する酸化物半導体膜108_2の伝導帯下端のエネルギー準位(Ec)より真空準位から遠くなることがあり、トラップ準位に電子が蓄積しやすくなってしまう。トラップ準位に電子が蓄積されることで、マイナスの固定電荷となり、トランジスタのしきい値電圧はプラス方向にシフトしてしまう。したがって、トラップ準位が酸化物半導体膜108_2の伝導帯下端のエネルギー準位(Ec)より真空準位に近くなるような構成にすると好ましい。このようにすることで、トラップ準位に電子が蓄積しにくくなり、トランジスタのオン電流を増大させることが可能であると共に、電界効果移動度を高めることができる。
また、酸化物半導体膜108_1、108_3は、酸化物半導体膜108_2よりも伝導帯下端のエネルギー準位が真空準位に近く、代表的には、酸化物半導体膜108_2の伝導帯下端のエネルギー準位と、酸化物半導体膜108_1、108_3の伝導帯下端のエネルギー準位との差が、0.15eV以上、または0.5eV以上、かつ2eV以下、または1eV以下である。すなわち、酸化物半導体膜108_1、108_3の電子親和力と、酸化物半導体膜108_2の電子親和力との差が、0.15eV以上、または0.5eV以上、かつ2eV以下、または1eV以下である。
このような構成を有することで、酸化物半導体膜108_2が主な電流経路となる。すなわち、酸化物半導体膜108_2は、チャネル領域としての機能を有し、酸化物半導体膜108_1、108_3は、酸化物絶縁膜としての機能を有する。また、酸化物半導体膜108_1、108_3は、チャネル領域が形成される酸化物半導体膜108_2を構成する金属元素の一種以上から構成される酸化物半導体膜を用いると好ましい。このような構成とすることで、酸化物半導体膜108_1と酸化物半導体膜108_2との界面、または酸化物半導体膜108_2と酸化物半導体膜108_3との界面において、界面散乱が起こりにくい。従って、該界面においてはキャリアの動きが阻害されないため、トランジスタの電界効果移動度が高くなる。
また、酸化物半導体膜108_1、108_3は、チャネル領域の一部として機能することを防止するため、導電率が十分に低い材料を用いるものとする。そのため、酸化物半導体膜108_1、108_3を、その物性及び/または機能から、それぞれ酸化物絶縁膜とも呼べる。または、酸化物半導体膜108_1、108_3には、電子親和力(真空準位と伝導帯下端のエネルギー準位との差)が酸化物半導体膜108_2よりも小さく、伝導帯下端のエネルギー準位が酸化物半導体膜108_2の伝導帯下端エネルギー準位と差分(バンドオフセット)を有する材料を用いるものとする。また、ドレイン電圧の大きさに依存したしきい値電圧の差が生じることを抑制するためには、酸化物半導体膜108_1、108_3の伝導帯下端のエネルギー準位が、酸化物半導体膜108_2の伝導帯下端のエネルギー準位よりも真空準位に近い材料を用いると好適である。例えば、酸化物半導体膜108_2の伝導帯下端のエネルギー準位と、酸化物半導体膜108_1、108_3の伝導帯下端のエネルギー準位との差が、0.2eV以上、好ましくは0.5eV以上とすることが好ましい。
また、酸化物半導体膜108_1、108_3は、膜中にスピネル型の結晶構造が含まれないことが好ましい。酸化物半導体膜108_1、108_3の膜中にスピネル型の結晶構造を含む場合、該スピネル型の結晶構造と他の領域との界面において、導電膜120a、120bの構成元素が酸化物半導体膜108_2へ拡散してしまう場合がある。なお、酸化物半導体膜108_1、108_3が後述するCAAC−OSである場合、導電膜120a、120bの構成元素、例えば、銅元素のブロッキング性が高くなり好ましい。
また、本実施の形態においては、酸化物半導体膜108_1、108_3として、金属元素の原子数比をIn:Ga:Zn=1:3:2の金属酸化物ターゲットを用いて形成される酸化物半導体膜を用いる構成について例示したが、これに限定されない。例えば、酸化物半導体膜108_1、108_3として、In:Ga:Zn=1:1:1[原子数比]、In:Ga:Zn=1:1:1.2[原子数比]、In:Ga:Zn=1:3:4[原子数比]、In:Ga:Zn=1:3:6[原子数比]、In:Ga:Zn=1:4:5[原子数比]、In:Ga:Zn=1:5:6[原子数比]、またはIn:Ga:Zn=1:10:1[原子数比]の金属酸化物ターゲットを用いて形成される酸化物半導体膜を用いてもよい。あるいは、酸化物半導体膜108_1、108_3として、金属元素の原子数比をGa:Zn=10:1の金属酸化物ターゲットを用いて形成される酸化物半導体膜を用いてもよい。この場合、酸化物半導体膜108_2として金属元素の原子数比をIn:Ga:Zn=1:1:1の金属酸化物ターゲットを用いて形成される酸化物半導体膜を用い、酸化物半導体膜108_1、108_3として金属元素の原子数比をGa:Zn=10:1の金属酸化物ターゲットを用いて形成される酸化物半導体膜を用いると、酸化物半導体膜108_2の伝導帯下端のエネルギー準位と、酸化物半導体膜108_1、108_3の伝導帯下端のエネルギー準位との差を0.6eV以上とすることができるため好適である。
なお、酸化物半導体膜108_1、108_3として、In:Ga:Zn=1:1:1[原子数比]の金属酸化物ターゲットを用いる場合、酸化物半導体膜108_1、108_3は、In:Ga:Zn=1:β1(0<β1≦2):β2(0<β2≦2)となる場合がある。また、酸化物半導体膜108_1、108_3として、In:Ga:Zn=1:3:4[原子数比]の金属酸化物ターゲットを用いる場合、酸化物半導体膜108_1、108_3は、In:Ga:Zn=1:β3(1≦β3≦5):β4(2≦β4≦6)となる場合がある。また、酸化物半導体膜108_1、108_3として、In:Ga:Zn=1:3:6[原子数比]の金属酸化物ターゲットを用いる場合、酸化物半導体膜108_1、108_3は、In:Ga:Zn=1:β5(1≦β5≦5):β6(4≦β6≦8)となる場合がある。
<2−6.トランジスタの作製方法1>
次に、図19に示すトランジスタ100の作製方法の一例について、図31乃至図33を用いて説明する。なお、図31乃至図33は、トランジスタ100の作製方法を説明するチャネル長(L)方向及びチャネル幅(W)方向の断面図である。
まず、基板102上に絶縁膜104を形成する。続いて、絶縁膜104上に酸化物半導体膜を形成する。その後、当該酸化物半導体膜を島状に加工することで、酸化物半導体膜107を形成する(図31(A)参照)。
絶縁膜104としては、スパッタリング法、CVD法、蒸着法、パルスレーザー堆積(PLD)法、印刷法、塗布法等を適宜用いて形成することができる。本実施の形態においては、絶縁膜104として、プラズマCVD装置を用い、厚さ400nmの窒化シリコン膜と、厚さ50nmの酸化窒化シリコン膜とを形成する。なお、絶縁膜104を形成せずに、基板102上に酸化物半導体膜108を形成してもよい。
また、絶縁膜104を形成した後、絶縁膜104に酸素を添加してもよい。絶縁膜104に添加する酸素としては、酸素ラジカル、酸素原子、酸素原子イオン、酸素分子イオン等がある。また、添加方法としては、イオンドーピング法、イオン注入法、プラズマ処理法等がある。また、絶縁膜上に酸素の脱離を抑制する膜を形成した後、該膜を介して絶縁膜104に酸素を添加してもよい。
上述の酸素の脱離を抑制する膜として、インジウム、亜鉛、ガリウム、錫、アルミニウム、クロム、タンタル、チタン、モリブデン、ニッケル、鉄、コバルト、またはタングステンの1以上を有する導電膜あるいは半導体膜を用いて形成することができる。
また、プラズマ処理で酸素の添加を行う場合、マイクロ波で酸素を励起し、高密度な酸素プラズマを発生させることで、絶縁膜104への酸素添加量を増加させることができる。
酸化物半導体膜107としては、スパッタリング法、塗布法、パルスレーザー蒸着法、レーザーアブレーション法、熱CVD法等により形成することができる。なお、酸化物半導体膜107への加工には、酸化物半導体膜上にリソグラフィ工程によりマスクを形成した後、該マスクを用いて酸化物半導体膜の一部をエッチングすることで形成することができる。また、印刷法を用いて、素子分離された酸化物半導体膜107を直接形成してもよい。
スパッタリング法で酸化物半導体膜を形成する場合、プラズマを発生させるための電源装置は、RF電源装置、AC電源装置、DC電源装置等を適宜用いることができる。また、酸化物半導体膜を形成する場合のスパッタリングガスは、希ガス(代表的にはアルゴン)、酸素、希ガス及び酸素の混合ガスを適宜用いる。なお、希ガス及び酸素の混合ガスの場合、希ガスに対して酸素のガス比を高めることが好ましい。
なお、酸化物半導体膜を形成する際に、例えば、スパッタリング法を用いる場合、基板温度を150℃以上750℃以下、または150℃以上450℃以下、または200℃以上350℃以下として、酸化物半導体膜を成膜することで、結晶性を高めることができるため好ましい。
なお、本実施の形態においては、酸化物半導体膜107として、スパッタリング装置を用い、スパッタリングターゲットとしてIn−Ga−Zn金属酸化物(In:Ga:Zn=4:2:4.1[原子数比])を用いて、膜厚35nmの酸化物半導体膜を成膜する。
また、酸化物半導体膜107を形成した後、加熱処理を行い、酸化物半導体膜107の脱水素化または脱水化をしてもよい。加熱処理の温度は、代表的には、150℃以上基板歪み点未満、または250℃以上450℃以下、または300℃以上450℃以下である。
加熱処理は、ヘリウム、ネオン、アルゴン、キセノン、クリプトン等の希ガス、または窒素を含む不活性ガス雰囲気で行うことができる。または、不活性ガス雰囲気で加熱した後、酸素雰囲気で加熱してもよい。なお、上記不活性雰囲気及び酸素雰囲気に水素、水などが含まれないことが好ましい。処理時間は3分以上24時間以下とすればよい。
該加熱処理は、電気炉、RTA装置等を用いることができる。RTA装置を用いることで、短時間に限り、基板の歪み点以上の温度で熱処理を行うことができる。そのため加熱処理時間を短縮することができる。
酸化物半導体膜を加熱しながら成膜する、または酸化物半導体膜を形成した後、加熱処理を行うことで、酸化物半導体膜において、SIMSにより得られる水素濃度を5×1019atoms/cm以下、または1×1019atoms/cm以下、5×1018atoms/cm以下、または1×1018atoms/cm以下、または5×1017atoms/cm以下、または1×1016atoms/cm以下とすることができる。
次に、絶縁膜104及び酸化物半導体膜107上に絶縁膜110_0を形成する(図31(B)参照)。
絶縁膜110_0としては、酸化シリコン膜または酸化窒化シリコン膜を、プラズマ化学気相堆積装置(PECVD装置、または単にプラズマCVD装置という)を用いて形成することができる。この場合、原料ガスとしては、シリコンを含む堆積性気体及び酸化性気体を用いることが好ましい。シリコンを含む堆積性気体の代表例としては、シラン、ジシラン、トリシラン、フッ化シラン等がある。酸化性気体としては、酸素、オゾン、一酸化二窒素、二酸化窒素等がある。
また、絶縁膜110_0として、堆積性気体の流量に対する酸化性気体の流量を20倍より大きく100倍未満、または40倍以上80倍以下とし、処理室内の圧力を100Pa未満、または50Pa以下とするプラズマCVD装置を用いることで、欠陥量の少ない酸化窒化シリコン膜を形成することができる。
また、絶縁膜110_0として、プラズマCVD装置の真空排気された処理室内に載置された基板を280℃以上400℃以下に保持し、処理室に原料ガスを導入して処理室内における圧力を20Pa以上250Pa以下、さらに好ましくは100Pa以上250Pa以下とし、処理室内に設けられる電極に高周波電力を供給する条件により、絶縁膜110_0として、緻密である酸化シリコン膜または酸化窒化シリコン膜を形成することができる。
また、絶縁膜110_0を、マイクロ波を用いたプラズマCVD法を用いて形成してもよい。マイクロ波とは300MHzから300GHzの周波数域を指す。マイクロ波は、電子温度が低く、電子エネルギーが小さい。また、供給された電力において、電子の加速に用いられる割合が少なく、より多くの分子の解離及び電離に用いられることが可能であり、密度の高いプラズマ(高密度プラズマ)を励起することができる。このため、被成膜面及び堆積物へのプラズマダメージが少なく、欠陥の少ない絶縁膜110_0を形成することができる。
また、絶縁膜110_0を、有機シランガスを用いたCVD法を用いて形成することができる。有機シランガスとしては、珪酸エチル(TEOS:化学式Si(OC)、テトラメチルシラン(TMS:化学式Si(CH)、テトラメチルシクロテトラシロキサン(TMCTS)、オクタメチルシクロテトラシロキサン(OMCTS)、ヘキサメチルジシラザン(HMDS)、トリエトキシシラン(SiH(OC)、トリスジメチルアミノシラン(SiH(N(CH)などのシリコン含有化合物を用いることができる。有機シランガスを用いたCVD法を用いることで、被覆性の高い絶縁膜110_0を形成することができる。
本実施の形態では絶縁膜110_0として、プラズマCVD装置を用い、厚さ100nmの酸化窒化シリコン膜を形成する。
次に、絶縁膜110_0上に導電膜112_0を形成する。また、導電膜112_0として、例えば金属酸化膜を用いる場合、導電膜112_0の形成時に導電膜112_0から絶縁膜110_0中に酸素が添加される場合がある(図31(C)参照)。
なお、図31(C)において、絶縁膜110_0中に添加される酸素を矢印で模式的に表している。
導電膜112_0として、金属酸化膜を用いる場合、導電膜112_0の形成方法としては、スパッタリング法を用い、形成時に酸素ガスを含む雰囲気で形成することが好ましい。形成時に酸素ガスを含む雰囲気で導電膜112_0を形成することで、絶縁膜110_0中に酸素を好適に添加することができる。なお、導電膜112_0の形成方法としては、スパッタリング法に限定されず、その他の方法、例えばALD法を用いてもよい。
本実施の形態においては、導電膜112_0として、スパッタリング法を用いて、膜厚が100nmのIn−Ga−Zn酸化物であるIGZO膜(In:Ga:Zn=4:2:4.1(原子数比))を成膜する。また、導電膜112_0の形成前、または導電膜112_0の形成後に、絶縁膜110_0中に酸素添加処理を行ってもよい。当該酸素添加処理の方法としては、絶縁膜104の形成後に行うことのできる酸素の添加と同様とすればよい。
次に、導電膜112_0上の所望の位置に、リソグラフィ工程によりマスク140を形成する(図31(D)参照)。
次に、マスク140上からエッチングを行い、導電膜112_0と、絶縁膜110_0と、を加工する。その後、マスク140を除去することで、島状の導電膜112と、島状の絶縁膜110とを形成する(図32(A)参照)。
本実施の形態においては、導電膜112_0、及び絶縁膜110_0の加工としては、ドライエッチング法を用いて行う。
なお、導電膜112_0、及び絶縁膜110_0の加工の際に、導電膜112が重畳しない領域の酸化物半導体膜107の膜厚が薄くなる場合がある。または、導電膜112_0、及び絶縁膜110_0の加工の際に、酸化物半導体膜107が重畳しない領域の絶縁膜104の膜厚が薄くなる場合がある。また、導電膜112_0、及び絶縁膜110_0の加工の際に、エッチャントまたはエッチングガス(例えば、塩素など)が酸化物半導体膜107中に添加される、あるいは導電膜112_0、または絶縁膜110_0の構成元素が酸化物半導体膜107中に添加される場合がある。
次に、絶縁膜104、酸化物半導体膜107、及び導電膜112上に絶縁膜116を形成する。なお、絶縁膜116を形成することで、絶縁膜116と接する酸化物半導体膜107は、ソース領域108s及びドレイン領域108dとなる。また、絶縁膜110と接する酸化物半導体膜107はチャネル領域108iとなる。これにより、チャネル領域108i、ソース領域108s、及びドレイン領域108dを有する酸化物半導体膜108が形成される(図32(B)参照)。
絶縁膜116として、窒化酸化シリコン膜を用いることで、絶縁膜116に接するソース領域108s、及びドレイン領域108dに窒化酸化シリコン膜中の窒素または水素を供給することができる。
また、絶縁膜116の形成前に、酸化物半導体膜107に、不純物元素の添加処理を行う、または絶縁膜116の形成後に、絶縁膜116を介して、酸化物半導体膜107に、不純物元素の添加処理を行ってもよい。
上記不純物元素の添加処理としては、イオンドーピング法、イオン注入法、プラズマ処理法等がある。プラズマ処理法の場合、添加する不純物元素を含むガス雰囲気にてプラズマを発生させて、プラズマ処理を行うことによって、不純物元素を添加することができる。上記プラズマを発生させる装置としては、ドライエッチング装置、アッシング装置、プラズマCVD装置、高密度プラズマCVD装置等を用いることができる。
なお、不純物元素の原料ガスとして、B、PH、CH、N、NH、AlH、AlCl、SiH、Si、F、HF、H及び希ガスの一以上を用いることができる。または、希ガスで希釈されたB、PH、N、NH、AlH、AlCl、F、HF、及びHの一以上を用いることができる。なお、希ガス元素の代表例としては、ヘリウム、ネオン、アルゴン、クリプトン、及びキセノン等がある。
または、希ガスを添加した後、B、PH、CH、N、NH、AlH、AlCl、SiH、Si、F、HF、及びHの一以上を酸化物半導体膜107に添加してもよい。または、B、PH、CH、N、NH、AlH、AlCl、SiH、Si、F、HF、及びHの一以上を添加した後、希ガスを酸化物半導体膜107に添加してもよい。
次に、絶縁膜116上に絶縁膜118を形成する(図32(C)参照)。
絶縁膜118としては、先に記載の材料を選択することで形成できる。本実施の形態においては、絶縁膜118として、プラズマCVD装置を用い、厚さ300nmの酸化窒化シリコン膜を形成する。
次に、絶縁膜118の所望の位置に、リソグラフィによりマスクを形成した後、絶縁膜118及び絶縁膜116の一部をエッチングすることで、ソース領域108sに達する開口部141aと、ドレイン領域108dに達する開口部141bと、を形成する(図33(A)参照)。
絶縁膜118及び絶縁膜116をエッチングする方法としては、ウエットエッチング法及びドライエッチング法のいずれか一方または双方を用いればよい。本実施の形態においては、ドライエッチング法を用い、絶縁膜118、及び絶縁膜116を加工する。
次に、開口部141a、141bを覆うように、ソース領域108s、ドレイン領域108d、及び絶縁膜118上に導電膜を形成し、当該導電膜を所望の形状に加工することで、導電膜120a、120bを形成する(図33(B)参照)。
導電膜120a、120bとしては、先に記載の材料を選択することで形成できる。本実施の形態においては、導電膜120a、120bとして、スパッタリング装置を用い、厚さ50nmのタングステン膜と、厚さ400nmの銅膜との積層膜を形成する。
なお、導電膜120a、120bとなる導電膜の加工方法としては、ウエットエッチング法及びドライエッチング法のいずれか一方または双方を用いればよい。本実施の形態では、ウエットエッチング法にて銅膜をエッチングしたのち、ドライエッチング法にてタングステン膜をエッチングすることで導電膜を加工し、導電膜120a、120bを形成する。
以上の工程により、図19に示すトランジスタ100を作製することができる。
なお、トランジスタ100を構成する膜(絶縁膜、金属酸化膜、酸化物半導体膜、導電膜等)としては、上述の形成方法の他、スパッタリング法、化学気相堆積(CVD)法、真空蒸着法、パルスレーザー堆積(PLD)法、ALD法を用いて形成することができる。あるいは、塗布法や印刷法で形成することができる。成膜方法としては、スパッタリング法、プラズマ化学気相堆積(PECVD)法が代表的であるが、熱CVD法でもよい。熱CVD法の例として、有機金属化学気相堆積(MOCVD)法が挙げられる。
熱CVD法は、チャンバー内を大気圧または減圧下とし、原料ガスと酸化剤を同時にチャンバー内に送り、基板近傍または基板上で反応させて基板上に堆積させることで成膜を行う。このように、熱CVD法は、プラズマを発生させない成膜方法であるため、プラズマダメージにより欠陥が生成されることが無いという利点を有する。
MOCVD法などの熱CVD法は、上記記載の導電膜、絶縁膜、酸化物半導体膜、金属酸化膜などの膜を形成することができ、例えば、In−Ga−Zn−O膜を成膜する場合には、トリメチルインジウム(In(CH)、トリメチルガリウム(Ga(CH)、及びジメチル亜鉛を用いる(Zn(CH)。これらの組み合わせに限定されず、トリメチルガリウムに代えてトリエチルガリウム(Ga(C)を用いることもでき、ジメチル亜鉛に代えてジエチル亜鉛(Zn(C)を用いることもできる。
また、ALDを利用する成膜装置により酸化ハフニウム膜を形成する場合には、溶媒とハフニウム前駆体を含む液体(ハフニウムアルコキシドや、テトラキスジメチルアミドハフニウム(TDMAH、Hf[N(CH)やテトラキス(エチルメチルアミド)ハフニウムなどのハフニウムアミド)を気化させた原料ガスと、酸化剤としてオゾン(O)の2種類のガスを用いる。
また、ALDを利用する成膜装置により酸化アルミニウム膜を形成する場合には、溶媒とアルミニウム前駆体を含む液体(トリメチルアルミニウム(TMA、Al(CH)など)を気化させた原料ガスと、酸化剤としてHOの2種類のガスを用いる。他の材料としては、トリス(ジメチルアミド)アルミニウム、トリイソブチルアルミニウム、アルミニウムトリス(2,2,6,6−テトラメチル−3,5−ヘプタンジオナート)などがある。
また、ALDを利用する成膜装置により酸化シリコン膜を形成する場合には、ヘキサクロロジシランを被成膜面に吸着させ、酸化性ガス(O、一酸化二窒素)のラジカルを供給して吸着物と反応させる。
また、ALDを利用する成膜装置によりタングステン膜を成膜する場合には、WFガスとBガスを順次導入して初期タングステン膜を形成し、その後、WFガスとHガスとを用いてタングステン膜を形成する。なお、Bガスに代えてSiHガスを用いてもよい。
また、ALDを利用する成膜装置により酸化物半導体膜、例えばIn−Ga−Zn−O膜を成膜する場合には、In(CHガスとOガスを用いてIn−O層を形成し、その後、Ga(CHガスとOガスとを用いてGaO層を形成し、更にその後Zn(CHガスとOガスとを用いてZnO層を形成する。なお、これらの層の順番はこの例に限らない。また、これらのガスを用いてIn−Ga−O層やIn−Zn−O層、Ga−Zn−O層などの混合化合物層を形成しても良い。なお、Oガスに変えてAr等の不活性ガスで水をバブリングして得られたHOガスを用いても良いが、Hを含まないOガスを用いる方が好ましい。
<2−7.トランジスタの作製方法2>
次に、図20に示すトランジスタ100Aの作製方法の一例について、図34乃至図36を用いて説明する。なお、図34乃至図36は、トランジスタ100Aの作製方法を説明するチャネル長(L)方向、及びチャネル幅(W)方向の断面図である。
まず、基板102上に導電膜106を形成する。次に、基板102、及び導電膜106上に絶縁膜104を形成し、絶縁膜104上に酸化物半導体膜を形成する。その後、当該酸化物半導体膜を島状に加工することで、酸化物半導体膜107を形成する(図34(A)参照)。
導電膜106としては、導電膜120a、120bと同様の材料、及び同様の手法により形成することができる。本実施の形態においては、導電膜106として、厚さ50nmの窒化タンタル膜と、厚さ100nmの銅膜との積層膜をスパッタリング法により形成する。
次に、絶縁膜104及び酸化物半導体膜107上に絶縁膜110_0を形成する。(図34(B)参照)。
次に、絶縁膜110_0上の所望の位置に、リソグラフィによりマスクを形成した後、絶縁膜110_0、及び絶縁膜104の一部をエッチングすることで、導電膜106に達する開口部143を形成する(図34(C)参照)。
開口部143の形成方法としては、ウエットエッチング法及びドライエッチング法のいずれか一方または双方を用いればよい。本実施の形態においては、ドライエッチング法を用い、開口部143を形成する。
次に、開口部143を覆うように、導電膜106及び絶縁膜110_0上に導電膜112_0を形成する。また、導電膜112_0として、例えば金属酸化膜を用いる場合、導電膜112_0の形成時に導電膜112_0から絶縁膜110_0中に酸素が添加される場合がある(図34(D)参照)。
なお、図34(D)において、絶縁膜110_0中に添加される酸素を矢印で模式的に表している。また、開口部143を覆うように、導電膜112_0を形成することで、導電膜106と、導電膜112_0とが電気的に接続される。
次に、導電膜112_0上の所望の位置に、リソグラフィ工程によりマスク140を形成する(図35(A)参照)。
次に、マスク140上から、エッチングを行い、導電膜112_0、及び絶縁膜110_0を加工する。また、導電膜112_0及び絶縁膜110_0の加工後に、マスク140を除去する。導電膜112_0、及び絶縁膜110_0を加工することで、島状の導電膜112、及び島状の絶縁膜110が形成される(図35(B)参照)。
本実施の形態においては、ドライエッチング法を用い、導電膜112_0、及び絶縁膜110_0を加工する。
次に、絶縁膜104、酸化物半導体膜107、及び導電膜112上に絶縁膜116を形成する。なお、絶縁膜116を形成することで、絶縁膜116と接する酸化物半導体膜107は、ソース領域108s及びドレイン領域108dとなる。また、絶縁膜110と接する酸化物半導体膜107はチャネル領域108iとなる。これにより、チャネル領域108i、ソース領域108s、及びドレイン領域108dを有する酸化物半導体膜108が形成される(図35(C)参照)。
絶縁膜116としては、先に記載の材料を選択することで形成できる。本実施の形態においては、絶縁膜116として、プラズマCVD装置を用い、厚さ100nmの窒化酸化シリコン膜を形成する。また、当該窒化酸化シリコン膜の形成時において、プラズマ処理と、成膜処理との2つのステップを220℃の温度で行う。なお、当該プラズマ処理及び当該成膜処理としては、先の記載と同じ方法を用いればよい。
次に、絶縁膜116上に絶縁膜118を形成する(図36(A)参照)。
次に、絶縁膜118の所望の位置に、リソグラフィによりマスクを形成した後、絶縁膜118及び絶縁膜116の一部をエッチングすることで、ソース領域108sに達する開口部141aと、ドレイン領域108dに達する開口部141bと、を形成する(図36(B)参照)。
次に、開口部141a、141bを覆うように、ソース領域108s、ドレイン領域108d、及び絶縁膜118上に導電膜を形成し、当該導電膜を所望の形状に加工することで導電膜120a、120bを形成する(図36(C)参照)。
以上の工程により、図20に示すトランジスタ100Aを作製することができる。
また、本実施の形態において、トランジスタが酸化物半導体膜を有する場合の例を示したが、本発明の一態様は、これに限定されない。本発明の一態様では、トランジスタが酸化物半導体膜を有さなくてもよい。一例としては、トランジスタのチャネル領域、チャネル領域の近傍、ソース領域、またはドレイン領域において、Si(シリコン)、Ge(ゲルマニウム)、SiGe(シリコンゲルマニウム)、GaAs(ガリウムヒ素)、などを有する材料で形成してもよい。
以上、本実施の形態で示す構成、方法は、他の実施の形態で示す構成、方法と適宜組み合わせて用いることができる。
(実施の形態3)
本実施の形態においては、酸化物半導体の構造等について、図37乃至図41を参照して説明する。
<3−1.酸化物半導体の構造>
酸化物半導体は、単結晶酸化物半導体と、それ以外の非単結晶酸化物半導体と、に分けられる。非単結晶酸化物半導体としては、CAAC−OS(c−axis−aligned crystalline oxide semiconductor)、多結晶酸化物半導体、nc−OS(nanocrystalline oxide semiconductor)、擬似非晶質酸化物半導体(a−like OS:amorphous−like oxide semiconductor)および非晶質酸化物半導体などがある。
また別の観点では、酸化物半導体は、非晶質酸化物半導体と、それ以外の結晶性酸化物半導体と、に分けられる。結晶性酸化物半導体としては、単結晶酸化物半導体、CAAC−OS、多結晶酸化物半導体およびnc−OSなどがある。
非晶質構造は、一般に、等方的であって不均質構造を持たない、準安定状態で原子の配置が固定化していない、結合角度が柔軟である、短距離秩序は有するが長距離秩序を有さない、などといわれている。
すなわち、安定な酸化物半導体を完全な非晶質(completely amorphous)酸化物半導体とは呼べない。また、等方的でない(例えば、微小な領域において周期構造を有する)酸化物半導体を、完全な非晶質酸化物半導体とは呼べない。一方、a−like OSは、等方的でないが、鬆(ボイドともいう。)を有する不安定な構造である。不安定であるという点では、a−like OSは、物性的に非晶質酸化物半導体に近い。
<3−2.CAAC−OS>
まずは、CAAC−OSについて説明する。
CAAC−OSは、c軸配向した複数の結晶部(ペレットともいう。)を有する酸化物半導体の一種である。
CAAC−OSをX線回折(XRD:X−Ray Diffraction)によって解析した場合について説明する。例えば、空間群R−3mに分類されるInGaZnOの結晶を有するCAAC−OSに対し、out−of−plane法による構造解析を行うと、図37(A)に示すように回折角(2θ)が31°近傍にピークが現れる。このピークは、InGaZnOの結晶の(009)面に帰属されることから、CAAC−OSでは、結晶がc軸配向性を有し、c軸がCAAC−OSの膜を形成する面(被形成面ともいう。)、または上面に略垂直な方向を向いていることが確認できる。なお、2θが31°近傍のピークの他に、2θが36°近傍にもピークが現れる場合がある。2θが36°近傍のピークは、空間群Fd−3mに分類される結晶構造に起因する。そのため、CAAC−OSは、該ピークを示さないことが好ましい。
一方、CAAC−OSに対し、被形成面に平行な方向からX線を入射させるin−plane法による構造解析を行うと、2θが56°近傍にピークが現れる。このピークは、InGaZnOの結晶の(110)面に帰属される。そして、2θを56°近傍に固定し、試料面の法線ベクトルを軸(φ軸)として試料を回転させながら分析(φスキャン)を行っても、図37(B)に示すように明瞭なピークは現れない。一方、単結晶InGaZnOに対し、2θを56°近傍に固定してφスキャンした場合、図37(C)に示すように(110)面と等価な結晶面に帰属されるピークが6本観察される。したがって、XRDを用いた構造解析から、CAAC−OSは、a軸およびb軸の配向が不規則であることが確認できる。
次に、電子回折によって解析したCAAC−OSについて説明する。例えば、InGaZnOの結晶を有するCAAC−OSに対し、CAAC−OSの被形成面に平行にプローブ径が300nmの電子線を入射させると、図37(D)に示すような回折パターン(制限視野電子回折パターンともいう。)が現れる場合がある。この回折パターンには、InGaZnOの結晶の(009)面に起因するスポットが含まれる。したがって、電子回折によっても、CAAC−OSに含まれるペレットがc軸配向性を有し、c軸が被形成面または上面に略垂直な方向を向いていることがわかる。一方、同じ試料に対し、試料面に垂直にプローブ径が300nmの電子線を入射させたときの回折パターンを図37(E)に示す。図37(E)より、リング状の回折パターンが確認される。したがって、プローブ径が300nmの電子線を用いた電子回折によっても、CAAC−OSに含まれるペレットのa軸およびb軸は配向性を有さないことがわかる。なお、図37(E)における第1リングは、InGaZnOの結晶の(010)面および(100)面などに起因する。また、図37(E)における第2リングは(110)面などに起因する。
また、透過型電子顕微鏡(TEM:Transmission Electron Microscope)によって、CAAC−OSの明視野像と回折パターンとの複合解析像(高分解能TEM像ともいう。)を観察すると、複数のペレットを確認することができる。一方、高分解能TEM像であってもペレット同士の境界、即ち結晶粒界(グレインバウンダリーともいう。)を明確に確認することができない場合がある。そのため、CAAC−OSは、結晶粒界に起因する電子移動度の低下が起こりにくいといえる。
図38(A)に、試料面と略平行な方向から観察したCAAC−OSの断面の高分解能TEM像を示す。高分解能TEM像の観察には、球面収差補正(Spherical Aberration Corrector)機能を用いた。球面収差補正機能を用いた高分解能TEM像を、特にCs補正高分解能TEM像と呼ぶ。Cs補正高分解能TEM像は、例えば、日本電子株式会社製原子分解能分析電子顕微鏡JEM−ARM200Fなどによって観察することができる。
図38(A)より、金属原子が層状に配列している領域であるペレットを確認することができる。ペレット一つの大きさは1nm以上のものや、3nm以上のものがあることがわかる。したがって、ペレットを、ナノ結晶(nc:nanocrystal)と呼ぶこともできる。また、CAAC−OSを、CANC(C−Axis Aligned nanocrystals)を有する酸化物半導体と呼ぶこともできる。ペレットは、CAAC−OSの被形成面または上面の凹凸を反映しており、CAAC−OSの被形成面または上面と平行となる。
また、図38(B)および図38(C)に、試料面と略垂直な方向から観察したCAAC−OSの平面のCs補正高分解能TEM像を示す。図38(D)および図38(E)は、それぞれ図38(B)および図38(C)を画像処理した像である。以下では、画像処理の方法について説明する。まず、図38(B)を高速フーリエ変換(FFT:Fast Fourier Transform)処理することでFFT像を取得する。次に、取得したFFT像において原点を基準に、2.8nm−1から5.0nm−1の間の範囲を残すマスク処理する。次に、マスク処理したFFT像を、逆高速フーリエ変換(IFFT:Inverse Fast Fourier Transform)処理することで画像処理した像を取得する。こうして取得した像をFFTフィルタリング像と呼ぶ。FFTフィルタリング像は、Cs補正高分解能TEM像から周期成分を抜き出した像であり、格子配列を示している。
図38(D)では、格子配列の乱れた箇所を破線で示している。破線で囲まれた領域が、一つのペレットである。そして、破線で示した箇所がペレットとペレットとの連結部である。破線は、六角形状であるため、ペレットが六角形状であることがわかる。なお、ペレットの形状は、正六角形状とは限らず、非正六角形状である場合が多い。
図38(E)では、格子配列の揃った領域と、別の格子配列の揃った領域と、の間を点線で示し、格子配列の向きを破線で示している。点線近傍においても、明確な結晶粒界を確認することはできない。点線近傍の格子点を中心に周囲の格子点を繋ぐと、歪んだ六角形、歪んだ五角形、または歪んだ七角形などが形成できる。即ち、格子配列を歪ませることによって結晶粒界の形成を抑制していることがわかる。これは、CAAC−OSが、a−b面方向において原子配列が稠密でないことや、金属元素が置換することで原子間の結合距離が変化することなどによって、歪みを許容することができるためと考えられる。
以上に示すように、CAAC−OSは、c軸配向性を有し、かつa−b面方向において複数のペレット(ナノ結晶)が連結し、歪みを有した結晶構造となっている。よって、CAAC−OSを、CAA crystal(c−axis−aligned a−b−plane−anchored crystal)を有する酸化物半導体と称することもできる。
CAAC−OSは結晶性の高い酸化物半導体である。酸化物半導体の結晶性は不純物の混入や欠陥の生成などによって低下する場合があるため、CAAC−OSは不純物や欠陥(酸素欠損など)の少ない酸化物半導体ともいえる。
なお、不純物は、酸化物半導体の主成分以外の元素で、水素、炭素、シリコン、遷移金属元素などがある。例えば、シリコンなどの、酸化物半導体を構成する金属元素よりも酸素との結合力の強い元素は、酸化物半導体から酸素を奪うことで酸化物半導体の原子配列を乱し、結晶性を低下させる要因となる。また、鉄やニッケルなどの重金属、アルゴン、二酸化炭素などは、原子半径(または分子半径)が大きいため、酸化物半導体の原子配列を乱し、結晶性を低下させる要因となる。
酸化物半導体が不純物や欠陥を有する場合、光や熱などによって特性が変動する場合がある。例えば、酸化物半導体に含まれる不純物は、キャリアトラップとなる場合や、キャリア発生源となる場合がある。例えば、酸化物半導体中の酸素欠損は、キャリアトラップとなる場合や、水素を捕獲することによってキャリア発生源となる場合がある。
不純物および酸素欠損の少ないCAAC−OSは、キャリア密度の低い酸化物半導体である。具体的には、8×1011cm−3未満、好ましくは1×1011cm−3未満、さらに好ましくは1×1010cm−3未満であり、1×10−9cm−3以上のキャリア密度の酸化物半導体とすることができる。そのような酸化物半導体を、高純度真性または実質的に高純度真性な酸化物半導体と呼ぶ。CAAC−OSは、不純物濃度が低く、欠陥準位密度が低い。即ち、安定な特性を有する酸化物半導体であるといえる。
<3−3.nc−OS>
次に、nc−OSについて説明する。
nc−OSをXRDによって解析した場合について説明する。例えば、nc−OSに対し、out−of−plane法による構造解析を行うと、配向性を示すピークが現れない。即ち、nc−OSの結晶は配向性を有さない。
また、例えば、InGaZnOの結晶を有するnc−OSを薄片化し、厚さが34nmの領域に対し、被形成面に平行にプローブ径が50nmの電子線を入射させると、図39(A)に示すようなリング状の回折パターン(ナノビーム電子回折パターン)が観測される。また、同じ試料にプローブ径が1nmの電子線を入射させたときの回折パターン(ナノビーム電子回折パターン)を図39(B)に示す。図39(B)より、リング状の領域内に複数のスポットが観測される。したがって、nc−OSは、プローブ径が50nmの電子線を入射させることでは秩序性が確認されないが、プローブ径が1nmの電子線を入射させることでは秩序性が確認される。
また、厚さが10nm未満の領域に対し、プローブ径が1nmの電子線を入射させると、図39(C)に示すように、スポットが略正六角状に配置された電子回折パターンが観測される場合がある。したがって、厚さが10nm未満の範囲において、nc−OSが秩序性の高い領域、即ち結晶を有することがわかる。なお、結晶が様々な方向を向いているため、規則的な電子回折パターンが観測されない領域もある。
図39(D)に、被形成面と略平行な方向から観察したnc−OSの断面のCs補正高分解能TEM像を示す。nc−OSは、高分解能TEM像において、補助線で示す箇所などのように結晶部を確認することのできる領域と、明確な結晶部を確認することのできない領域と、を有する。nc−OSに含まれる結晶部は、1nm以上10nm以下の大きさであり、特に1nm以上3nm以下の大きさであることが多い。なお、結晶部の大きさが10nmより大きく100nm以下である酸化物半導体を微結晶酸化物半導体(micro crystalline oxide semiconductor)と呼ぶことがある。nc−OSは、例えば、高分解能TEM像では、結晶粒界を明確に確認できない場合がある。なお、ナノ結晶は、CAAC−OSにおけるペレットと起源を同じくする可能性がある。そのため、以下ではnc−OSの結晶部をペレットと呼ぶ場合がある。
このように、nc−OSは、微小な領域(例えば、1nm以上10nm以下の領域、特に1nm以上3nm以下の領域)において原子配列に周期性を有する。また、nc−OSは、異なるペレット間で結晶方位に規則性が見られない。そのため、膜全体で配向性が見られない。したがって、nc−OSは、分析方法によっては、a−like OSや非晶質酸化物半導体と区別が付かない場合がある。
なお、ペレット(ナノ結晶)間で結晶方位が規則性を有さないことから、nc−OSを、RANC(Random Aligned nanocrystals)を有する酸化物半導体、またはNANC(Non−Aligned nanocrystals)を有する酸化物半導体と呼ぶこともできる。
nc−OSは、非晶質酸化物半導体よりも規則性の高い酸化物半導体である。そのため、nc−OSは、a−like OSや非晶質酸化物半導体よりも欠陥準位密度が低くなる。ただし、nc−OSは、異なるペレット間で結晶方位に規則性が見られない。そのため、nc−OSは、CAAC−OSと比べて欠陥準位密度が高くなる。
<3−4.a−like OS>
a−like OSは、nc−OSと非晶質酸化物半導体との間の構造を有する酸化物半導体である。
図40に、a−like OSの高分解能断面TEM像を示す。ここで、図40(A)は電子照射開始時におけるa−like OSの高分解能断面TEM像である。図40(B)は4.3×10/nmの電子(e)照射後におけるa−like OSの高分解能断面TEM像である。図40(A)および図40(B)より、a−like OSは電子照射開始時から、縦方向に延伸する縞状の明領域が観察されることがわかる。また、明領域は、電子照射後に形状が変化することがわかる。なお、明領域は、鬆または低密度領域と推測される。
鬆を有するため、a−like OSは、不安定な構造である。以下では、a−like OSが、CAAC−OSおよびnc−OSと比べて不安定な構造であることを示すため、電子照射による構造の変化を示す。
試料として、a−like OS、nc−OSおよびCAAC−OSを準備する。いずれの試料もIn−Ga−Zn酸化物である。
まず、各試料の高分解能断面TEM像を取得する。高分解能断面TEM像により、各試料は、いずれも結晶部を有する。
なお、InGaZnOの結晶の単位格子は、In−O層を3層有し、またGa−Zn−O層を6層有する、計9層がc軸方向に層状に重なった構造を有することが知られている。これらの近接する層同士の間隔は、(009)面の格子面間隔(d値ともいう。)と同程度であり、結晶構造解析からその値は0.29nmと求められている。したがって、以下では、格子縞の間隔が0.28nm以上0.30nm以下である箇所を、InGaZnOの結晶部と見なした。なお、格子縞は、InGaZnOの結晶のa−b面に対応する。
図41は、各試料の結晶部(22箇所から30箇所)の平均の大きさを調査した例である。なお、上述した格子縞の長さを結晶部の大きさとしている。図41より、a−like OSは、TEM像の取得などに係る電子の累積照射量に応じて結晶部が大きくなっていくことがわかる。図41より、TEMによる観察初期においては1.2nm程度の大きさだった結晶部(初期核ともいう。)が、電子(e)の累積照射量が4.2×10/nmにおいては1.9nm程度の大きさまで成長していることがわかる。一方、nc−OSおよびCAAC−OSは、電子照射開始時から電子の累積照射量が4.2×10/nmまでの範囲で、結晶部の大きさに変化が見られないことがわかる。図41より、電子の累積照射量によらず、nc−OSおよびCAAC−OSの結晶部の大きさは、それぞれ1.3nm程度および1.8nm程度であることがわかる。なお、電子線照射およびTEMの観察は、日立透過電子顕微鏡H−9000NARを用いた。電子線照射条件は、加速電圧を300kV、電流密度を6.7×10/(nm・s)、照射領域の直径を230nmとした。
このように、a−like OSは、電子照射によって結晶部の成長が見られる場合がある。一方、nc−OSおよびCAAC−OSは、電子照射による結晶部の成長がほとんど見られない。即ち、a−like OSは、nc−OSおよびCAAC−OSと比べて、不安定な構造であることがわかる。
また、鬆を有するため、a−like OSは、nc−OSおよびCAAC−OSと比べて密度の低い構造である。具体的には、a−like OSの密度は、同じ組成の単結晶の密度の78.6%以上92.3%未満である。また、nc−OSの密度およびCAAC−OSの密度は、同じ組成の単結晶の密度の92.3%以上100%未満である。単結晶の密度の78%未満である酸化物半導体は、成膜すること自体が困難である。
例えば、In:Ga:Zn=1:1:1[原子数比]を満たす酸化物半導体において、菱面体晶構造を有する単結晶InGaZnOの密度は6.357g/cmである。よって、例えば、In:Ga:Zn=1:1:1[原子数比]を満たす酸化物半導体において、a−like OSの密度は5.0g/cm以上5.9g/cm未満である。また、例えば、In:Ga:Zn=1:1:1[原子数比]を満たす酸化物半導体において、nc−OSの密度およびCAAC−OSの密度は5.9g/cm以上6.3g/cm未満である。
なお、同じ組成の単結晶が存在しない場合、任意の割合で組成の異なる単結晶を組み合わせることにより、所望の組成における単結晶に相当する密度を見積もることができる。所望の組成の単結晶に相当する密度は、組成の異なる単結晶を組み合わせる割合に対して、加重平均を用いて見積もればよい。ただし、密度は、可能な限り少ない種類の単結晶を組み合わせて見積もることが好ましい。
以上のように、酸化物半導体は、様々な構造をとり、それぞれが様々な特性を有する。なお、酸化物半導体は、例えば、非晶質酸化物半導体、a−like OS、nc−OS、CAAC−OSのうち、二種以上を有する積層膜であってもよい。
なお、本実施の形態に示す構成は、他の実施の形態に示す構成と適宜、組み合わせて用いることができる。
(実施の形態4)
本実施の形態では、本発明の一態様の表示装置を有する表示モジュール及び電子機器について、図42乃至図45を用いて説明を行う。
<4−1.表示モジュール>
図42に示す表示モジュール8000は、上部カバー8001と下部カバー8002との間に、FPC8003が接続されたタッチパネル8004、FPC8005が接続された表示パネル8006、フレーム8009、プリント基板8010、バッテリ8011を有する。
本発明の一態様の表示装置は、例えば、表示パネル8006に用いることができる。
上部カバー8001及び下部カバー8002は、タッチパネル8004及び表示パネル8006のサイズに合わせて、形状や寸法を適宜変更することができる。
タッチパネル8004は、抵抗膜方式または静電容量方式のタッチパネルを表示パネル8006に重畳して用いることができる。また、表示パネル8006の対向基板(封止基板)に、タッチパネル機能を持たせるようにすることも可能である。また、表示パネル8006の各画素内に光センサを設け、光学式のタッチパネルとすることも可能である。
フレーム8009は、表示パネル8006の保護機能の他、プリント基板8010の動作により発生する電磁波を遮断するための電磁シールドとしての機能を有する。またフレーム8009は、放熱板としての機能を有していてもよい。
プリント基板8010は、電源回路、ビデオ信号及びクロック信号を出力するための信号処理回路を有する。電源回路に電力を供給する電源としては、外部の商用電源であっても良いし、別途設けたバッテリ8011による電源であってもよい。バッテリ8011は、商用電源を用いる場合には、省略可能である。
また、表示モジュール8000は、偏光板、位相差板、プリズムシートなどの部材を追加して設けてもよい。
<4−2.電子機器>
図43(A)乃至図43(E)、及び図44(A)乃至図44(E)は、電子機器を示す図である。これらの電子機器は、筐体9000、表示部9001、カメラ9002、スピーカ9003、操作キー9005(電源スイッチ、又は操作スイッチを含む)、接続端子9006、センサ9007(力、変位、位置、速度、加速度、角速度、回転数、距離、光、液、磁気、温度、化学物質、音声、時間、硬度、電場、電流、電圧、電力、放射線、流量、湿度、傾度、振動、におい又は赤外線を測定する機能を含むもの)、マイクロフォン9008等を有する。
図43(A)乃至図43(E)、及び図44(A)乃至図44(E)に示す電子機器は、様々な機能を有することができる。例えば、様々な情報(静止画、動画、テキスト画像など)を表示部に表示する機能、タッチパネル機能、カレンダー、日付または時刻などを表示する機能、様々なソフトウェア(プログラム)によって処理を制御する機能、無線通信機能、無線通信機能を用いて様々なコンピュータネットワークに接続する機能、無線通信機能を用いて様々なデータの送信または受信を行う機能、記録媒体に記録されているプログラムまたはデータを読み出して表示部に表示する機能、等を有することができる。なお、図43(A)乃至図43(E)、及び図44(A)乃至図44(E)に示す電子機器が有する機能はこれらに限定されず、その他の機能を有していてもよい。
図43(A)乃至図43(E)、及び図44(A)乃至図44(E)に示す電子機器の詳細について、以下説明を行う。
図43(A)は、テレビジョン装置9100を示す斜視図である。テレビジョン装置9100は、表示部9001を大画面、例えば、50インチ以上、80インチ以上、または100インチ以上の表示部9001を組み込むことが可能である。
図43(B)は携帯情報端末9101を、図43(C)は携帯情報端末9102を、図43(D)は携帯情報端末9103を、図43(E)は携帯情報端末9104を、それぞれ示す斜視図である。
図43(B)に示す携帯情報端末9101は、例えば電話機、手帳又は情報閲覧装置等から選ばれた一つ又は複数の機能を有する。具体的には、スマートフォンとして用いることができる。なお、図示していないが、携帯情報端末9101には、スピーカ9003、接続端子9006、センサ9007等を設けてもよい。また、携帯情報端末9101は、文字や画像情報をその複数の面に表示することができる。例えば、3つの操作ボタン9050(操作アイコンまたは単にアイコンともいう)を表示部9001の一の面に表示することができる。また、破線の矩形で示す情報9051を表示部9001の他の面(例えば、側面)に表示することができる。なお、情報9051の一例としては、電子メールやSNS(ソーシャル・ネットワーキング・サービス)や電話などの着信を知らせる表示、電子メールやSNSなどの題名、電子メールやSNSなどの送信者名、日時、時刻、バッテリの残量、受信信号の強度などがある。または、情報9051が表示されている位置に、情報9051の代わりに、操作ボタン9050などを表示してもよい。また、携帯情報端末9101が有する表示部9001は、一部に曲面を有する。
図43(C)に示す携帯情報端末9102は、表示部9001の3面以上に情報を表示する機能を有する。ここでは、情報9052、情報9053、情報9054がそれぞれ異なる面に表示されている例を示す。例えば、携帯情報端末9102の使用者は、洋服の胸ポケットに携帯情報端末9102を収納した状態で、その表示(ここでは情報9053)を確認することができる。具体的には、着信した電話の発信者の電話番号又は氏名等を、携帯情報端末9102の上方から観察できる位置に表示する。使用者は、携帯情報端末9102をポケットから取り出すことなく、表示を確認し、電話を受けるか否かを判断できる。また、携帯情報端末9102が有する表示部9001は、一部に曲面を有する。
図43(D)に示す携帯情報端末9103は、先に示す携帯情報端末9101、9102と異なり、表示部9001が曲面を有さない構成である。
また、図43(E)に示す携帯情報端末9104は、表示部9001が湾曲している。また、図43(E)に図示するように、携帯情報端末9104にカメラ9002を設け、静止画を撮影する機能、動画を撮影する機能、撮影した画像を記録媒体(外部またはカメラに内蔵)に保存する機能、撮影した画像を表示部9001に表示する機能等を有すると好ましい。
図44(A)は腕時計型の携帯情報端末9200を、図44(B)は腕時計型の携帯情報端末9201を、それぞれ示す斜視図である。
図44(A)に示す携帯情報端末9200は、移動電話、電子メール、文章閲覧及び作成、音楽再生、インターネット通信、コンピュータゲームなどの種々のアプリケーションを実行することができる。また、表示部9001はその表示面が湾曲して設けられ、湾曲した表示面に沿って表示を行うことができる。また、携帯情報端末9200は、通信規格された近距離無線通信を実行することが可能である。例えば無線通信可能なヘッドセットと相互通信することによって、ハンズフリーで通話することもできる。また、携帯情報端末9200は、接続端子9006を有し、他の情報端末とコネクターを介して直接データのやりとりを行うことができる。また接続端子9006を介して充電を行うこともできる。なお、充電動作は接続端子9006を介さずに無線給電により行ってもよい。
また、図44(B)に示す携帯情報端末9201は、図44(A)に示す携帯情報端末と異なり、表示部9001の表示面が湾曲していない。また、携帯情報端末9201の表示部の外形が非矩形状(図44(B)においては円形状)である。
図44(C)(D)(E)は、折り畳み可能な携帯情報端末9202を示す斜視図である。なお、図44(C)が携帯情報端末9202を展開した状態の斜視図であり、図44(D)が携帯情報端末9202を展開した状態または折り畳んだ状態の一方から他方に変化する途中の状態の斜視図であり、図44(E)が携帯情報端末9202を折り畳んだ状態の斜視図である。
携帯情報端末9202は、折り畳んだ状態では可搬性に優れ、展開した状態では、継ぎ目のない広い表示領域により表示の一覧性に優れる。携帯情報端末9202が有する表示部9001は、ヒンジ9055によって連結された3つの筐体9000に支持されている。ヒンジ9055を介して2つの筐体9000間を屈曲させることにより、携帯情報端末9202を展開した状態から折りたたんだ状態に可逆的に変形させることができる。例えば、携帯情報端末9202は、曲率半径1mm以上150mm以下で曲げることができる。
なお、本発明の一態様である表示装置は、表示部9001に好適に用いることができる。
また、図45(A)(B)は、複数の表示パネルを有する表示装置9500の斜視図である。なお、図45(A)は、複数の表示パネルが巻き取られた形態の斜視図であり、図45(B)は、複数の表示パネルが展開された状態の斜視図である。
図45(A)(B)に示す表示装置9500は、複数の表示パネル9501と、軸部9511と、軸受部9512と、を有する。また、複数の表示パネル9501は、表示領域9502と、透光性を有する領域9503と、を有する。
また、複数の表示パネル9501は、可撓性を有する。また、隣接する2つの表示パネル9501は、それらの一部が互いに重なるように設けられる。例えば、隣接する2つの表示パネル9501の透光性を有する領域9503を重ね合わせることができる。複数の表示パネル9501を用いることで、大画面の表示装置とすることができる。また、使用状況に応じて、表示パネル9501を巻き取ることが可能であるため、汎用性に優れた表示装置とすることができる。
また、図45(A)(B)においては、表示領域9502が隣接する表示パネル9501で離間する状態を図示しているが、これに限定されず、例えば、隣接する表示パネル9501の表示領域9502を隙間なく重ねあわせることで、連続した表示領域9502としてもよい。
なお、本発明の一態様である表示装置は、表示パネル9501に好適に用いることができる。
本実施の形態において述べた電子機器は、何らかの情報を表示するための表示部を有することを特徴とする。ただし、本発明の一態様の半導体装置は、表示部を有さない電子機器にも適用することができる。
本実施の形態に示す構成は、他の実施の形態に示す構成と適宜組み合わせて用いることができる。
(実施の形態5)
本実施の形態では、本発明の一態様の表示装置を有する情報処理装置の構成について、図46(A)(B)を参照して説明する。
図46(A)は本発明の一態様の表示装置を有する情報処理装置9600の構成を説明するブロック図であり、図46(B)は操作されている情報処理装置9600の状態を説明する模式図である。
以下に、情報処理装置9600を構成する個々の要素について説明する。なお、これらの構成は明確に分離できず、一つの構成が他の構成を兼ねる場合や他の構成の一部を含む場合がある。
<5.情報処理装置の構成例>
情報処理装置9600は、演算装置9610と、入出力装置9620とを有する。
[演算装置]
演算装置9610は、演算部9611と、記憶部9612と、伝送路9614と、入出力インターフェース9615と、を有する。
[演算部]
演算部9611は、プログラムを実行する機能を有する。
[記憶部]
記憶部9612は、演算部9611が実行するプログラム、初期情報、設定情報または画像等を記憶する機能を有する。具体的には、ハードディスク、フラッシュメモリまたは酸化物半導体を含むトランジスタを用いたメモリ等を用いることができる。
[プログラム]
演算部9611が実行するプログラムは、例えば、以下の3つのステップを有する。図46(B)を用いて、3つのステップについて説明する。
第1のステップにおいて、位置情報P1を取得する。
第2のステップにおいて、位置情報P1に基づいて、第1の領域9681を決定する。
第3のステップにおいて、第1の領域9681に表示する画像として、他の領域に表示する画像よりも輝度が高められた画像(画像情報Q1)を生成する。
例えば、演算装置9610は、位置情報P1に基づいて、第1の領域9681を決定する。具体的には、第1の領域9681の形状を楕円状、円形状、多角形状または矩形状等にすることができる。例えば、位置情報P1を含む半径60cm以下好ましくは5cm以上30cm以下の範囲を第1の領域9681に決定する。
なお、第1の領域9681に表示する画像として、他の領域に表示する画像よりも輝度が高められた画像を生成する方法としては、第1の領域9681に表示する画像の輝度を、他の領域に表示する画像の輝度の110%以上好ましくは120%以上200%以下に高める。または、第1の領域9681に表示する画像の輝度の平均を、他の領域に表示する画像の輝度の平均の110%以上好ましくは120%以上200%以下に高める。
上述のプログラムを実行することにより、情報処理装置9600は、位置情報P1に基づいて第1の領域9681に表示する画像として、他の領域に表示する画像よりも輝度が高められた画像情報Q1を生成することができる。その結果、操作者は操作を快適に行うことが可能となり、利便性に優れた情報処理装置9600を提供することができる。
[入出力インターフェース]
入出力インターフェース9615は、端子または配線を有する。また、入出力インターフェース9615は、情報を供給する機能と、情報を供給される機能とを有する。例えば、入出力インターフェース9615は、伝送路9614及び入出力装置9620のいずれか一方または双方と電気的に接続することができる。
[伝送路]
伝送路9614は配線を有する。また、伝送路9614は、情報を供給する機能と、情報を供給される機能とを有する。例えば、伝送路9614は、演算部9611、記憶部9612または入出力インターフェース9615と電気的に接続することができる。
[入出力装置]
入出力装置9620は、表示部9630と、入力部9640と、検知部9650と、通信部9690と、を有する。
[表示部]
表示部9630は表示パネルを有する。当該表示パネルは、画素を有し、画素は反射型の表示素子と、透過型の発光素子とを有する構成とすればよい。また、画像情報を用いて反射型の表示素子の反射率を高め、表示する画像の輝度を高めることができる。または、画像情報を用いて発光素子の輝度を高め、表示する画像の輝度を高めることができる。すなわち、表示部9630に、本発明の一態様の表示装置を好適に用いることができる。
[入力部]
入力部9640は入力パネルを有する。例えば、入力パネルは、近接センサを有する。当該近接センサは、ポインタ9682を検知する機能を有する。なお、ポインタ9682は、指やスタイラスペン等を用いればよい。また、当該スタイラスペンとしては、発光ダイオード等の発光素子、金属片またはコイル等用いればよい。
また、近接センサとしては、静電容量型の近接センサ、電磁誘導型の近接センサ、赤外線検知型の近接センサ、光電変換素子を用いた近接センサ等を用いればよい。
静電容量型の近接センサは、導電膜を有し、当該導電膜に対する近接を、検知する機能を有する。例えば、入力パネルの互いに異なる領域に複数の導電膜を配設し、ポインタ9682に用いられる指等が近接する領域を、導電膜に寄生する容量の変化に基づいて特定し、位置情報を決定できる。
電磁誘導型の近接センサは、金属片やコイル等の検知回路に対する近接を検知する機能を有する。例えば、入力パネルの互いに異なる領域に複数の発振回路を配設し、ポインタ9682に用いるスタイラスペン等に配設された金属片やコイル等が近接する領域を、発振回路の回路定数の変化に基づいて特定し、位置情報を決定できる。
光検知型の近接センサは、発光素子の近接を、検知する機能を有する。例えば、入力パネルの互いに異なる領域に複数の光電変換素子を配設し、ポインタ9682に用いるスタイラスペン等に配設された発光素子が近接する領域を、光電変換素子の起電力の変化に基づいて特定し、位置情報を決定できる。
[検知部]
検知部9650としては、環境の明るさを検知する照度センサや人感センサ等を用いればよい。
[通信部]
通信部9690は、ネットワークに情報を供給し、ネットワークから情報を取得する機能を有する。
上記説明した情報処理装置9600としては、例えば、教育、デジタルサイネージまたはスマートテレビジョンシステム等に用いることができる。
なお、本実施の形態は、本明細書で示す他の実施の形態と適宜組み合わせることができる。
100 トランジスタ
100A トランジスタ
100B トランジスタ
100C トランジスタ
100D トランジスタ
100E トランジスタ
100F トランジスタ
100G トランジスタ
100H トランジスタ
100J トランジスタ
100K トランジスタ
102 基板
104 絶縁膜
106 導電膜
107 酸化物半導体膜
108 酸化物半導体膜
108_1 酸化物半導体膜
108_2 酸化物半導体膜
108_3 酸化物半導体膜
108d ドレイン領域
108f 領域
108i チャネル領域
108s ソース領域
110 絶縁膜
110_0 絶縁膜
112 導電膜
112_0 導電膜
116 絶縁膜
118 絶縁膜
120a 導電膜
120b 導電膜
122 絶縁膜
140 マスク
141a 開口部
141b 開口部
143 開口部
401 基板
402 導電膜
403a 導電膜
403b 導電膜
403c 導電膜
404 絶縁膜
405a 導電膜
405b 導電膜
405c 導電膜
405d 導電膜
406 絶縁膜
407a 導電膜
407b 導電膜
407c 導電膜
407d 導電膜
407e 導電膜
407f 導電膜
407g 導電膜
408 絶縁膜
409a 酸化物半導体膜
409b 酸化物半導体膜
409c 酸化物半導体膜
410a 絶縁膜
410b 絶縁膜
410c 絶縁膜
411a 酸化物半導体膜
411b 酸化物半導体膜
411c 酸化物半導体膜
412 絶縁膜
413 絶縁膜
414a 導電膜
414b 導電膜
414c 導電膜
414d 導電膜
414e 導電膜
414f 導電膜
414g 導電膜
414h 導電膜
416 絶縁膜
417 導電膜
418 絶縁膜
419 EL層
420 導電膜
430 表示素子
430d 表示領域
450 開口部
452 基板
454 封止材
500 表示装置
501 画素回路
502 画素部
504a ゲートドライバ回路部
504b ゲートドライバ回路部
506 ソースドライバ回路部
508a 外部回路
508b 外部回路
602 遮光膜
604 着色膜
606 絶縁膜
608 導電膜
610a 構造体
610b 構造体
618a 配向膜
618b 配向膜
620 液晶層
622 シール材
624 導電体
626 機能膜
630 表示素子
630d 表示領域
652 基板
662 遮光膜
663 絶縁膜
664 導電膜
665 導電膜
666 絶縁膜
667 導電膜
668 絶縁膜
672 基板
674 接着材
681 絶縁膜
682 導電膜
691 タッチパネル
692 タッチパネル
693 タッチパネル
8000 表示モジュール
8001 上部カバー
8002 下部カバー
8003 FPC
8004 タッチパネル
8005 FPC
8006 表示パネル
8009 フレーム
8010 プリント基板
8011 バッテリ
9000 筐体
9001 表示部
9002 カメラ
9003 スピーカ
9005 操作キー
9006 接続端子
9007 センサ
9008 マイクロフォン
9050 操作ボタン
9051 情報
9052 情報
9053 情報
9054 情報
9055 ヒンジ
9100 テレビジョン装置
9101 携帯情報端末
9102 携帯情報端末
9103 携帯情報端末
9104 携帯情報端末
9200 携帯情報端末
9201 携帯情報端末
9202 携帯情報端末
9500 表示装置
9501 表示パネル
9502 表示領域
9503 領域
9511 軸部
9512 軸受部
9600 情報処理装置
9610 演算装置
9611 演算部
9612 記憶部
9614 伝送路
9615 入出力インターフェース
9620 入出力装置
9630 表示部
9640 入力部
9650 検知部
9681 領域
9682 ポインタ
9690 通信部

Claims (6)

  1. 第1の表示素子と、第2の表示素子と、第1のトランジスタと、第2のトランジスタと、を有する表示装置であって、
    前記第1の表示素子は、第1の画素電極と、液晶層と、を有し、
    前記第2の表示素子は、第2の画素電極と、発光層と、を有し、
    前記第1のトランジスタは、前記第1の画素電極と電気的に接続され、
    前記第2のトランジスタは、前記第2の画素電極と電気的に接続され、
    前記第1のトランジスタ及び前記第2のトランジスタは、
    酸化物半導体膜を有し、
    前記第1の画素電極及び前記第2の画素電極は、
    前記酸化物半導体膜が有する金属元素を、少なくとも1以上有する、
    ことを特徴とする表示装置。
  2. 請求項1において、
    第1の表示素子は、
    さらに、反射膜を有し、
    前記反射膜は、前記第1の画素電極と電気的に接続され、且つ入射する光を反射する機能を有し、
    前記反射膜には、入射する光を透過する開口部が設けられ、
    前記第2の表示素子は、
    前記開口部に向けて光を射出する機能を有する、
    ことを特徴とする表示装置。
  3. 請求項1または請求項2において、
    前記酸化物半導体膜は、
    Inと、Znと、M(MはAl、Ga、Y、またはSn)と、を有する、
    ことを特徴とする表示装置。
  4. 請求項1乃至請求項3のいずれか一項において、
    前記酸化物半導体膜は、
    結晶部を有し、
    前記結晶部は、c軸配向性を有する、
    ことを特徴とする表示装置。
  5. 請求項1乃至請求項4のいずれか一項において、
    前記第1のトランジスタ、及び前記第2のトランジスタのいずれか一方または双方は、
    スタガ型構造を有する、
    ことを特徴とする表示装置。
  6. 請求項1乃至請求項5のいずれか一項において、
    前記第1のトランジスタ及び前記第2のトランジスタのいずれか一方または双方は、
    第1の導電膜と、
    前記第1の導電膜上の第1の絶縁膜と、
    前記第1の絶縁膜上の第1の酸化物半導体膜と、
    前記第1の酸化物半導体膜上の第2の絶縁膜と、
    前記第2の絶縁膜上の第2の酸化物半導体膜と、を有し、
    前記第2の酸化物半導体膜は、
    チャネル幅方向の断面において、前記第2の絶縁膜を介して前記第1の酸化物半導体膜の側面を覆い、
    前記第1の酸化物半導体膜は、
    チャネル幅方向の断面において、前記第1の導電膜と、前記第2の酸化物半導体膜とで、囲まれた構造を有する、
    ことを特徴とする表示装置。
JP2016176344A 2015-09-11 2016-09-09 表示装置およびその作製方法 Withdrawn JP2017054124A (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2015179114 2015-09-11
JP2015179114 2015-09-11

Publications (1)

Publication Number Publication Date
JP2017054124A true JP2017054124A (ja) 2017-03-16

Family

ID=58239310

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2016176344A Withdrawn JP2017054124A (ja) 2015-09-11 2016-09-09 表示装置およびその作製方法

Country Status (4)

Country Link
US (1) US20170075155A1 (ja)
JP (1) JP2017054124A (ja)
KR (1) KR20170031620A (ja)
WO (1) WO2017042749A1 (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2018180723A1 (ja) * 2017-03-27 2018-10-04 シャープ株式会社 アクティブマトリクス基板およびその製造方法
WO2019187069A1 (ja) * 2018-03-30 2019-10-03 シャープ株式会社 トランジスタおよび表示装置

Families Citing this family (21)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US10254856B2 (en) 2014-01-17 2019-04-09 Osterhout Group, Inc. External user interface for head worn computing
US9810906B2 (en) 2014-06-17 2017-11-07 Osterhout Group, Inc. External user interface for head worn computing
US9939934B2 (en) 2014-01-17 2018-04-10 Osterhout Group, Inc. External user interface for head worn computing
US10139966B2 (en) 2015-07-22 2018-11-27 Osterhout Group, Inc. External user interface for head worn computing
US11003246B2 (en) 2015-07-22 2021-05-11 Mentor Acquisition One, Llc External user interface for head worn computing
US9852926B2 (en) 2015-10-20 2017-12-26 Semiconductor Energy Laboratory Co., Ltd. Manufacturing method for semiconductor device
WO2017081575A1 (en) 2015-11-11 2017-05-18 Semiconductor Energy Laboratory Co., Ltd. Display device and method for manufacturing the same
WO2017125834A1 (en) 2016-01-18 2017-07-27 Semiconductor Energy Laboratory Co., Ltd. Input/output device and data processor
US10684478B2 (en) 2016-05-09 2020-06-16 Mentor Acquisition One, Llc User interface systems for head-worn computers
US10466491B2 (en) 2016-06-01 2019-11-05 Mentor Acquisition One, Llc Modular systems for head-worn computers
US10824253B2 (en) 2016-05-09 2020-11-03 Mentor Acquisition One, Llc User interface systems for head-worn computers
US10180605B2 (en) 2016-07-27 2019-01-15 Semiconductor Energy Laboratory Co., Ltd. Display device and method for manufacturing the same
TWI724060B (zh) 2016-08-17 2021-04-11 日商半導體能源研究所股份有限公司 顯示裝置、電子裝置以及攜帶資訊終端
TWI713003B (zh) 2016-09-20 2020-12-11 日商半導體能源研究所股份有限公司 顯示裝置及電子機器
KR102387859B1 (ko) * 2016-09-30 2022-04-15 엘지디스플레이 주식회사 유기 발광 표시 장치 및 그 제조 방법
JP6887307B2 (ja) * 2017-05-19 2021-06-16 ルネサスエレクトロニクス株式会社 半導体装置の製造方法
US10152141B1 (en) 2017-08-18 2018-12-11 Osterhout Group, Inc. Controller movement tracking with light emitters
CN108962967B (zh) * 2018-08-03 2020-06-30 京东方科技集团股份有限公司 显示面板及其制造方法、显示装置及显示控制方法
KR20200042660A (ko) * 2018-10-16 2020-04-24 현대자동차주식회사 차량 디스플레이 제어 장치, 그를 포함한 시스템 및 그 방법
CN109817090B (zh) * 2019-01-30 2021-12-10 京东方科技集团股份有限公司 显示装置和显示装置的制造方法
CN111415948B (zh) * 2020-03-30 2022-11-08 厦门天马微电子有限公司 阵列基板、显示面板、显示装置及阵列基板的制备方法

Family Cites Families (14)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3898012B2 (ja) * 2001-09-06 2007-03-28 シャープ株式会社 表示装置
US7248235B2 (en) * 2001-09-14 2007-07-24 Sharp Kabushiki Kaisha Display, method of manufacturing the same, and method of driving the same
TW544944B (en) * 2002-04-16 2003-08-01 Ind Tech Res Inst Pixel element structure of sunlight-readable display
US20060072047A1 (en) * 2002-12-06 2006-04-06 Kanetaka Sekiguchi Liquid crystal display
JP5235011B2 (ja) * 2009-11-16 2013-07-10 株式会社神戸製鋼所 有機elディスプレイ用の反射アノード電極
US9349325B2 (en) 2010-04-28 2016-05-24 Semiconductor Energy Laboratory Co., Ltd. Liquid crystal display device and electronic device
US8953120B2 (en) * 2011-01-07 2015-02-10 Semiconductor Energy Laboratory Co., Ltd. Display device
KR102173801B1 (ko) * 2012-07-12 2020-11-04 가부시키가이샤 한도오따이 에네루기 켄큐쇼 표시 장치, 및 표시 장치의 제작 방법
KR20140031671A (ko) * 2012-09-05 2014-03-13 삼성디스플레이 주식회사 박막 트랜지스터 및 그 제조 방법
US9461179B2 (en) * 2014-07-11 2016-10-04 Semiconductor Energy Laboratory Co., Ltd. Thin film transistor device (TFT) comprising stacked oxide semiconductor layers and having a surrounded channel structure
CN104362127A (zh) * 2014-11-21 2015-02-18 深圳市华星光电技术有限公司 薄膜晶体管基板的制作方法及制造设备
KR102281844B1 (ko) * 2015-01-02 2021-07-26 삼성디스플레이 주식회사 박막 트랜지스터 표시판 및 그 제조 방법
DE112016000030T5 (de) * 2015-04-13 2016-12-22 Semiconductor Energy Laboratory Co., Ltd. Anzeigefeld, Datenprozessor und Herstellungsverfahren für ein Anzeigefeld
US9704893B2 (en) * 2015-08-07 2017-07-11 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and electronic device

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2018180723A1 (ja) * 2017-03-27 2018-10-04 シャープ株式会社 アクティブマトリクス基板およびその製造方法
US11038001B2 (en) 2017-03-27 2021-06-15 Sharp Kabushiki Kaisha Active matrix substrate and method for producing same
WO2019187069A1 (ja) * 2018-03-30 2019-10-03 シャープ株式会社 トランジスタおよび表示装置
US11437520B2 (en) 2018-03-30 2022-09-06 Sharp Kabushiki Kaisha Transistor and display device

Also Published As

Publication number Publication date
US20170075155A1 (en) 2017-03-16
WO2017042749A1 (en) 2017-03-16
KR20170031620A (ko) 2017-03-21

Similar Documents

Publication Publication Date Title
JP2017054124A (ja) 表示装置およびその作製方法
TWI721985B (zh) 半導體裝置、包括該半導體裝置的顯示裝置
JP6570486B2 (ja) 半導体装置
WO2017085591A1 (ja) 半導体装置、該半導体装置を有する表示装置、及び該半導体装置を有する電子機器
JP7293282B2 (ja) 半導体装置
JP2020080410A (ja) 半導体装置
JP2018006731A (ja) 半導体装置、当該半導体装置の作製方法、及び当該半導体装置を有する表示装置
JP2023009058A (ja) 半導体装置
JP2021184485A (ja) 半導体装置の作製方法
JP2022008388A (ja) 半導体装置の作製方法
JP2018006729A (ja) 半導体装置
JP2016027649A (ja) 半導体装置、該半導体装置を有する表示装置
US20160155759A1 (en) Semiconductor device and display device including the same
JP2017076785A (ja) 半導体装置、及び半導体装置の作製方法
JP2017034251A (ja) 半導体装置、該半導体装置を有する表示装置
WO2017125796A1 (ja) 金属酸化物膜、半導体装置、及び表示装置
JP2017112369A (ja) 酸化物半導体膜、半導体装置、または表示装置
JP2017108065A (ja) 半導体装置の作製方法および該半導体装置を有する表示装置の作製方法
JP2018006732A (ja) 半導体装置、該半導体装置の作製方法、または該半導体装置を有する表示装置
JP2018093166A (ja) 半導体装置の作製方法
JP7066672B2 (ja) 半導体装置
JP2017135271A (ja) 処理システム、及び半導体装置の作製方法
JP2017054899A (ja) 半導体装置、表示装置及び該表示装置を用いた電子機器
KR20240132436A (ko) 반도체 장치 및 표시 장치

Legal Events

Date Code Title Description
A761 Written withdrawal of application

Free format text: JAPANESE INTERMEDIATE CODE: A761

Effective date: 20190909