JP2016148843A - 非四角形ディスプレイ - Google Patents

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Abstract

【課題】ベゼル領域が狭い非四角形ディスプレイを提供する。【解決手段】本発明の一実施形態による非四角形ディスプレイは、非四角形表示領域に配置されて、第１方向に延長される複数の第１信号線のうちの対応する第１信号線、及び第１方向と交差する第２方向に延長される複数の第２信号線のうちの対応する第２信号線に連結される複数の画素と、表示領域の周辺領域に配置されて、複数の第１信号線のうちの対応する少なくとも一つの第１信号線に第１信号を出力する複数の第１駆動回路と、周辺領域に配置されて、複数の第２信号線のうちの対応する少なくとも一つの第２信号線に対応する第２信号を出力する複数の第２駆動回路と、を含み、周辺領域は複数の第１駆動回路のうちの隣接した二つの第１駆動回路間に位置する複数の第２駆動回路のうち、対応する第２駆動回路の個数が周辺領域の位置によって異なる領域を含む。【選択図】図５

Description

実施形態は、非四角形ディスプレイに関する。
表示パネルは、複数の画素と連結された複数の信号線を含む。画素は、非四角形状を有する表示領域内にあり、信号線に信号を供給するための駆動回路は、非四角形表示領域の周りのベゼル領域内にある。大きいパネルを生産するために、表示領域は増加し、ベゼル領域は減少する。
最近は、非四角形状（例えば、円形または楕円形）を有するディスプレイの需要が増加している。このようなディスプレイは、スマートウォッチ、スマートガラス、ＨＭＤ（ｈｅａｄ ｍｏｕｎｔｅｄ ｄｉｓｐｌａｙ）または車両クラスタのようなウェアラブルデバイスに使用されるのに適合する。しかし、このディスプレイのベゼル領域は、ディスプレイパネル画面のサイズを増加させるために、非常に幅の狭いサイズに縮小されなければならない。さらに小さな幅のベゼル領域は、駆動回路のためにさらに少ない空間を残す。
特開２００５−５２８６４４号公報 特開２０１４−１９７１７９号公報
実施形態は、ベゼル領域が狭い非四角形ディスプレイを提供することにその目的がある。
また、実施形態は、非四角形ディスプレイの表示パネル内に駆動回路が位置できる領域が確保される非四角形ディスプレイを提供することにその目的がある。
実施形態によれば、非四角形ディスプレイは、非四角形表示領域に位置する複数の画素を含み、画素それぞれは第１方向の第１信号線、及び第１方向と交差する第２方向の第２信号線に連結され、表示領域の周辺領域に位置する複数の第１駆動回路を含み、第１駆動回路それぞれは画素のうちの対応する一つの第１信号線に第１信号を出力し、周辺領域に位置する複数の第２駆動回路を含み、複数の第２駆動回路それぞれは画素のうちの対応する一つの第２信号線に第２信号を出力し、第１駆動回路間の第２駆動回路の個数は周辺領域の位置によって異なる。
複数の第１駆動回路と複数の第２駆動回路は表示領域の周りに隣接してもよい。複数の第１駆動回路と複数の第２駆動回路が配置される角度は、複数の第１駆動回路と複数の第２駆動回路の位置によって変更され得る。複数の第１駆動回路と複数の第２駆動回路それぞれの表示領域の法線方向に対応する角度はほぼ同一であり得る。
少なくとも一つの画素に対する第１駆動回路の面積と、少なくとも一つの画素に対する第２駆動回路の面積とが互いに異なってもよい。交互に配置されて、隣接するように位置する第１駆動回路及び第２駆動回路の表示領域の接線方向の幅の合計は、画素の幅の半分以下であり得る。
表示領域は曲線領域を含み、画素は曲線領域内で行列状に配列されてもよい。画素の隣接する配列の間に段差が発生する場合、段差の種類によって第１駆動回路または第２駆動回路が段差に対応する周辺領域に配置されてもよい。
複数の画素は複数の副画素を含み、副画素は異なる色を発光し、副画素は複数の第１信号線を通じて伝達される第１信号それぞれに同期されて、複数の第２信号線を通じて伝達される第２信号によって制御されてもよい。副画素は、スイッチングトランジスタを含み、スイッチングトランジスタそれぞれは複数の第２信号線のうちの対応する一つに連結されている第１電極及び第１信号線をゲート電極として含み、及び駆動トランジスタを含み、駆動トランジスタそれぞれはスイッチングトランジスタのうちの対応する一つの第２電極に連結されているゲート電極、電源電圧が供給される第１電極、及び有機発光ダイオードに連結されている第２電極を含んでもよい。
副画素それぞれは、直前画素行に対応する複数の第１信号線を通じて伝達される第１信号に同期されて初期化電圧が供給され得る。副画素それぞれは、駆動トランジスタのゲート電極及び第２電極間に連結されており、対応する第１信号線の部分として含まれているゲート電極を含む補償トランジスタをさらに含んでもよい。
画素の複数の第１信号線及び複数の第２信号線は周辺領域で互いに交差しなくてもよい。画素それぞれは第１方向の第３信号線に連結され、ディスプレイは第２駆動回路のうちの少なくとも一つと交互に配置される複数の第３駆動回路を含んでもよく、第３駆動回路それぞれは周辺領域のうちの第１駆動回路と対向する領域内の画素中、少なくとも一つの第３信号線に第３信号を出力する。
実施形態によれば、非四角形ディスプレイは、曲線を含む表示領域、曲線に対応する行方向及び列方向の段差を有するように配置された複数の画素が含まれている表示領域と、対応する画素に行方向に第１信号を供給する第１駆動回路、及び対応する画素に列方向に第２信号を供給する第２駆動回路を含み、表示領域の周りに沿って第１及び第２駆動回路が異なる個数で配置される非表示領域と、を含んでもよい。
第１駆動回路のうちの少なくとも一つは、画素が行方向に段差を有するほぼ法線方向に提供されてもよい。第２駆動回路のうちの少なくとも一つは、画素が列方向に段差を有するほぼ法線方向に提供されてもよい。非表示領域は、表示領域の周りに沿って一定の幅を有してもよい。第１駆動回路及び第２駆動回路それぞれはほぼ長方形状を有し、実質的に同一の長さの長辺を有してもよい。非表示領域の幅は、ほぼ長方形状の一つの長辺の長さより大きく、二つの長辺の長さの合計より小さくてもよい。
実施形態のうちの少なくとも一つによれば、広い面積の表示領域を提供できる長所がある。
また、実施形態のうちの少なくとも一つによれば、表示パネル及びこれを含む非四角形ディスプレイのサイズを縮小できる長所がある。
非四角形ディスプレイの実施形態を示した図面である。 表示パネルの実施形態を示した図面である。 画素の実施形態を示した図面である。 副画素の実施形態を示した図面である。 表示パネルの周縁のうちの第１位置の画素及び駆動回路の実施形態を示した図面である。 表示パネルの周縁のうちの第２位置の画素及び駆動回路の実施形態を示した図面である。 表示パネルの周縁のうちの第３位置の画素及び駆動回路の実施形態を示した図面である。 表示パネルの他の実施形態を示した図面である。 図８の表示パネルの周縁のうちの第１位置の画素及び駆動回路の実施形態を示した図面である。 図８の表示パネルの周縁のうちの第２位置の画素及び駆動回路の実施形態を示した図面である。 図８の表示パネルの周縁のうちの第３位置の画素及び駆動回路の実施形態を示した図面である。 表示パネルの他の実施形態を示した図面である。 図１２の表示パネルの第１領域の周縁のうちの第１位置の画素及び駆動回路の実施形態を示した図面である。 図１２の表示パネルの第１領域の周縁のうちの第２位置の画素及び駆動回路の実施形態を示した図面である。 図１２の表示パネルの第１領域の周縁のうちの第３位置の画素及び駆動回路の実施形態を示した図面である。 表示パネルの他の実施形態を示した図面である。 図１６の表示パネルの第１領域の画素及び駆動回路の実施形態を示した図面である。
ある構成要素が他の構成要素に「連結されて」いる、または「接続されて」いると言及されたときは、その他の構成要素に直接的に連結されているか、または接続されている場合もあるが、中間に他の構成要素が存在し得ることと理解されなければならない。一方、ある構成要素が他の構成要素に「直接連結されて」いる、または「直接接続されて」いると言及されたときは、中間に他の構成要素が存在しないことと理解されなければならない。
図１は、ドライバＩＣ１０、及び表示パネル２０とドライバＩＣ１０と表示パネル２０を連結する連結部１５を含む非四角形ディスプレイの実施形態を示した図面である。表示パネル２０は、非四角形の所定形態、例えば、円形、楕円形、一部が円形である多角形、または四角形を除いた多角形を有してもよい。一実施形態において、任意の形態は一部が曲線になった図形の形態を含んでもよい。表示パネル２０は、少なくとも一つの曲線部を含むフレキシブル表示パネルであってもよい。
表示パネル２０の駆動回路を駆動するために、ドライバＩＣ１０から駆動信号が伝達される。このとき、ドライバＩＣ１０から出力される駆動信号は、連結部１５を通じて表示パネル２０に伝達され得る。ドライバＩＣ１０に伝達される駆動信号に基づいて、表示パネル２０に形成された信号線に画素に対応する信号が適切に伝達され得る。
図２は、図１のディスプレイの表示パネルの実施形態を示した図面である。図２に示されているように、表示パネル２０の形態または形状に基づいて、表示領域３０の形態または形状が決定され得る。例えば、表示パネル２０の形態が円形であれば、表示領域３０の形態も円形であり得る、また、表示パネル２０の一部が曲線である場合、一部に対応する表示領域３０の形態も曲線の形態を有し得る。そして、表示パネル２０において、表示領域３０を除いた領域には、駆動回路を含む非表示領域４０が位置する。
表示領域３０内には複数の画素ＰＸが位置する。画素ＰＸは、表示領域３０内にマトリックス状に配置されてもよい。このとき、画素ＰＸは表示領域３０内で曲線に対応して配置されてもよい。例えば、表示領域３０の形態が円形である場合、表示領域３０の周縁に位置した画素配列間に段差が発生し得る。
例えば、一部が曲線の形態を有する表示領域３０の周縁に、四角形状の画素ＰＸが配置されるので、画素列間の段差配列を形成する。一実施形態において、第１行と第２行に対応する表示領域３０の周縁ＣＡ１に、画素ＰＸの所定個数（例えば、８個）の差ほど第１行の画素配列と第２行の画素配列間に段差が形成される。
行単位または列単位で隣接した画素配列間の段差は、対応する周縁の位置によって異なり得る。例えば、第１行の画素配列と第２行の画素配列間には画素８個の差ほど段差が発生するが、第２行の画素配列と第３行の画素配列間には画素６個の差ほど段差が発生し得る。
また、駆動回路が表示領域３０の形態により、非表示領域４０に適切に位置する。例えば、画素ＰＸが配置された形態が円形である場合、画素ＰＸに信号を供給するための駆動回路が、画素ＰＸが配置された円と隣接した周りの領域内に位置する。表示パネル２０の形態が円形である場合、画素ＰＸが配置される表示領域３０及び駆動回路が配置される非表示領域４０の全体が成す形態は円形であり得る。また、表示領域３０と同一の基板内で表示領域３０の周りに非表示領域４０が形成されてもよい。
表示領域３０の形態により、非表示領域４０の形態が決定され得る。例えば、画素ＰＸが配置された形態が円形である場合、非表示領域４０は表示領域３０の周りに所定幅を有する環（ｒｉｎｇ）形態に形成され得る。
図２においては、すべての画素ＰＸの形態及び大きさが同一のものと示されているが、表示領域３０内部の領域を区分して配置される画素ＰＸの大きさは異なってもよい。例えば、表示領域３０の中央領域に配置される画素は、表示領域３０の周縁領域（ｅｄｇｅ）に配置される画素より大きくてもよい。
図３は、本発明の画素ＰＸの実施形態を示した図面であり、図４は、本発明の実施形態に関する画素ＰＸの副画素の実施形態の等価回路図である。
図３に示されているように、画素ＰＸは、互いに異なる原色で発光する複数の副画素を含んでもよい。例えば、画素ＰＸは、それぞれ赤色（Ｒ）、緑色（Ｇ）、青色（Ｂ）で発光する３つの副画素ＰＸ１１、ＰＸ１２、ＰＸ１３を含む。
図４に示されているように、一つの副画素ＰＸ１１は、複数の信号線に連結されている複数のトランジスタＴ１、Ｔ２、Ｔ３、Ｔ４、Ｔ５、Ｔ６、Ｔ７、ストレージキャパシタ（ｓｔｏｒａｇｅ ｃａｐａｃｉｔｏｒ）Ｃｓｔ、及び有機発光ダイオード（ｏｒｇａｎｉｃ ｌｉｇｈｔ ｅｍｉｔｔｉｎｇ ｄｉｏｄｅ）ＯＬＥＤを含む。
トランジスタは、駆動トランジスタ（ｄｒｉｖｉｎｇ ｔｈｉｎ ｆｉｌｍ ｔｒａｎｓｉｓｔｏｒ）Ｔ１、スイッチングトランジスタ（ｓｗｉｔｃｈｉｎｇ ｔｈｉｎ ｆｉｌｍ ｔｒａｎｓｉｓｔｏｒ）Ｔ２、補償トランジスタＴ３、初期化トランジスタＴ４、動作制御トランジスタＴ５、発光制御トランジスタＴ６、及びバイパストランジスタＴ７を含む。
信号線は、スキャン信号を伝達するスキャンラインＳ[ｎ]、初期化トランジスタＴ４に前のスキャン信号を伝達する以前スキャンラインＳ[ｎ−１]、動作制御トランジスタＴ５及び発光制御トランジスタＴ６に発光制御信号を伝達する発光制御ラインＥＭ[ｎ]、スキャンラインと交差して、データ信号を伝達するデータラインＤ[ｍ]、電源電圧を伝達する電源電圧ライン、及び駆動トランジスタＴ１を初期化する初期化電圧を伝達する初期化電圧ラインを含む。
具体的に、駆動トランジスタＴ１は、第１ノードＮ１に連結される一端、第２ノードＮ２に連結されるゲート、及び第３ノードＮ３に連結される他端を含む。駆動トランジスタＴ１は、ゲートに印加される電圧によりターンオンされて有機発光素子ＯＬＥＤに供給される駆動電流を制御する。
第２トランジスタＴ２は、対応するデータ信号が供給されるデータラインＤ[ｍ]に連結される一端、対応する本段スキャン信号が供給されるスキャンラインＳ[ｎ]に連結されるゲート、及び第１ノードＮ１に連結される他端を含む。第２トランジスタＴ２は、スキャン信号によりターンオンされてデータ信号を第１ノードＮ１に伝達する。
第１キャパシタＣｓｔは、第１電源電圧ＥＬＶＤＤが供給される電源電圧ラインに連結される一端、及び第２ノードＮ２に連結される他端を含む。
第３トランジスタＴ３は、第２ノードＮ２に連結される一端、第３ノードＮ３に連結される他端、及び本段スキャンラインＳ[ｎ]に連結されるゲートを含む。第３トランジスタＴ３は、本段スキャンライン信号によってターンオンされて第２ノードＮ２と第３ノードＮ３を連結させる。
第４トランジスタＴ４は第２ノードＮ２に連結される一端、初期化電圧ＶＩＮＴが供給される初期化ラインに連結される他端、及び前の画素行に位置するスキャンラインＳ[ｎ−１]に連結されるゲートを含む。第４トランジスタＴ４は、前の画素行に位置するスキャンラインＳ[ｎ−１]のスキャン信号によりターンオンされて、第２ノードＮ２を初期化電圧ＶＩＮＴで初期化させる。
第５トランジスタＴ５は、第１電源電圧ＥＬＶＤＤに連結される一端、第１ノードＮ１に連結される他端、及び対応する発光信号が供給される発光ラインに連結されるゲートを含む。
第５トランジスタＴ５は発光信号によってターンオンされる。
第６トランジスタＴ６は、第３ノードＮ３に連結される一端、有機発光素子（ＯＬＥＤ）のアノードに連結される他端、及び発光信号が供給される発光ラインに連結されるゲートを含む。第６トランジスタＴ６は発光信号によってターンオンされて、第１トランジスタＴ１を通じて流れる電流を有機発光素子ＯＬＥＤに伝達する。
第７トランジスタＴ７は、有機発光素子ＯＬＥＤのアノードに連結される一端、初期化ラインに連結される他端、及び前の画素行に位置するスキャンラインＳ[ｎ−１]に連結されるゲートを含む。第７トランジスタＴ７は前の画素行に位置するスキャン信号によってターンオンされて、有機発光素子ＯＬＥＤのアノードに初期化電圧ＶＩＮＴを伝達する。
有機発光素子ＯＬＥＤは、第６トランジスタＴ６の他端に連結されるアノード、及び第２電源電圧ＥＬＶＳＳに連結されるカソードを含む。有機発光素子ＯＬＥＤは、原色（ｐｒｉｍａｒｙ ｃｏｌｏｒ）のうちの一つの光を発光し得る。原色の例としては、赤色、緑色、青色の三原色が挙げられ、これら三原色の空間的または時間的な相互作用によって所望する色が表示され得る。
前の画素行に位置するスキャンラインＳ[ｎ−１]を通じて供給される複数のスキャン信号に同期されて、初期化電圧Ｖｉｎｔが複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３それぞれの駆動トランジスタＴ１のゲート電極に供給され得る。そして、本段副画素行に位置する複数のスキャンラインを通じて伝達される複数のスキャン信号に同期されて、複数のデータラインＤ[ｍ]を通じて伝達される複数のデータ信号が複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３に伝達される。これと同時に、複数の第１電源電圧線を通じて供給される第１電源電圧ＥＬＶＤＤが、複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３を駆動させる電圧であり、複数の発光制御ラインＥＭ[ｎ]を通じて供給される複数の発光制御信号によって有機発光ダイオードＯＬＥＤの発光が制御される。
駆動回路はスキャンラインＳ[ｎ]にスキャン信号を供給する第１駆動回路、発光制御ラインＥＭ[ｎ]に発光制御信号を供給する第２駆動回路、及びデータラインＤ[ｍ]にデータ信号を供給する第３駆動回路を含む。その他にも、駆動回路は表示パネル２０の製造工程中に表示パネル２０の不良有無を検査するために、テスト電圧をデータラインＤ[ｍ]に供給する第４駆動回路をさらに含む。
前記の駆動回路は、表示パネル２０内に全て配置されて対応する画素ＰＸに適切な信号を供給する。このとき、駆動回路の種類によって画素ＰＸに信号を供給する方法が異なる。例えば、第１駆動回路及び第２駆動回路は第１方向に信号を供給し、第３駆動回路及び第４駆動回路は第１方向と交差する第２方向に信号を供給する。画素ＰＸがマトリックス状に配列されるとき、第１駆動回路及び第２駆動回路は行単位で信号を供給し、第３駆動回路及び第４駆動回路は列単位で信号を供給する。
このような駆動回路は、非表示領域４０が表示パネル２０内で狭い領域を占めるように、非表示領域４０に配列される。しかし、画素ＰＸが任意の形態に配置される表示パネル２０の場合、画素配列間の段差が発生するため、画素ＰＸが四角形に配置される表示パネル２０とは異なるように駆動回路が配置されなければならない。
図５は、第１実施形態による表示パネル２０の周縁のうちの第１位置Ａ１に配置された画素ＰＸ及び駆動回路を示した図面である。図示されているように、駆動回路は非表示領域４０に配置される。
以下の図面においては、第１駆動回路ＤＣ１及び第４駆動回路ＤＣ４が配置されることと説明しているが、非表示領域４０内のそれぞれの位置ごとに互いに異なる種類の駆動回路（第１駆動回路、第２駆動回路、第３駆動回路及び第４駆動回路）が混合され配置されてもよい。例えば、非表示領域４０には、第１駆動回路ＤＣ１と第４駆動回路ＤＣ４が混合され配置される領域、第２駆動回路ＤＣ２と第４駆動回路ＤＣ４が混合され配置される領域、第１駆動回路ＤＣ１と第３駆動回路が混合され配置される領域、及び第２駆動回路ＤＣ２と第３駆動回路が混合され配置される領域が含まれてもよい。
そして、非表示領域４０には、互いに異なる種類の駆動回路が表示領域３０の周りに沿ってそれぞれの個数が異なるように配置され得る。
このとき、それぞれの画素行または画素列に対応して互いに異なる種類の駆動回路が配置され得る。例えば、画素行に対応して第１駆動回路ＤＣ１が配置され、画素列に対応して第４駆動回路ＤＣ４が配置され得る。図示されているように、第１位置Ａ１には４個の画素行に対応して第１駆動回路ＤＣ１が４個配置され、１２個の画素列に対応して第４駆動回路ＤＣ４が１２個配置される。
一方、互いに異なる種類の駆動回路それぞれが占める面積が互いに異なってもよい。例えば、一つの第１駆動回路ＤＣ１の面積と一つの第４駆動回路ＤＣ４の面積とが互いに異なってもよい。第１駆動回路ＤＣ１及び第４駆動回路ＤＣ４が長方形状に形成されて、互いに同一の長辺の長さを有すると、短辺の長さは異なるように形成され得る。このとき、非表示領域４０の幅は、二つの駆動回路の長辺の長さの合計より小さく、一つの駆動回路の長辺の長さより大きく形成され得る。好ましくは、非表示領域４０の幅がほぼ一つの駆動回路の長辺の長さと同一で、非表示領域４０の幅を狭く設計できる効果がある。
そして、駆動回路は、表示領域３０の形態によって平面で対応する角度に傾いて配置され得る。具体的に、駆動回路は、表示領域３０と非表示領域４０の境界の法線角度とほぼ同一の角度に傾いて、非表示領域４０に配置され得る。表示領域３０が曲線である場合、表示領域３０の周りに沿って表示領域３０と非表示領域４０の境界に対する法線方向が変更されるので、基準線Ｌｒｅｆに対する表示領域３０の周りに沿って配置される駆動回路の配置角度も、前記法線方向によって変更される。図５において、最も左側に位置する第４駆動回路ＤＣ４は、基準線Ｌｒｅｆと平行に配置される。しかし、前記第４駆動回路ＤＣ４から表示領域３０の周りに沿って右側に配置される駆動回路ＤＣ１、ＤＣ４は、基準線Ｌｒｅｆからの角度が次第に増加するように傾いて配置される。
このとき、同じ種類の駆動回路ＤＣ４の場合においても、対応する画素行または画素列の位置によって基準線Ｌｒｅｆに対する配置角度α１、α２が変更される。一例として、互いに異なる画素列にそれぞれ対応する第４駆動回路ＤＣ４の配置角度α１、α２は互いに異なる。
また、駆動回路は非表示領域４０に一列に配列される。駆動回路は表示領域３０の周りに沿って一列に駆動回路の種類が変更され配列される。例えば、図５において、最も左側に位置する第４駆動回路ＤＣ４から最も右側に位置する第１駆動回路ＤＣ１まで、駆動回路は表示領域３０の周りに沿って一列にその種類ＤＣ１、ＤＣ４が変更され配列される。
このとき、画素配列間に段差が発生する場合、当該段差の種類によって駆動回路の種類が変更され配置される。行単位で画素配列間に段差が発生すると、第１駆動回路ＤＣ１が当該段差に対応して配置され、列単位で段差が発生すると、第４駆動回路ＤＣ４が当該段差に対応して配置される。第１駆動回路ＤＣ１は互いに異なる画素行に信号を供給し、第４駆動回路ＤＣ４は互いに異なる画素列に信号を供給するためである。
一つの駆動回路は、一つの行または列に含まれる画素ＰＸに信号を供給する。一つの画素ＰＸには複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３が含まれるので、一つの駆動回路は、一つの画素行または一つの画素列に含まれる複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３それぞれに信号を供給する。したがって、一つの駆動回路から一つの画素行または一つの画素列に供給する信号配線は複数個形成される。例えば、一つの第１駆動回路ＤＣ１は一つの画素行にスキャン信号を供給するが、一つの画素行内にはＲ副画素、Ｇ副画素、Ｂ副画素を含む画素ＰＸが複数個形成されるので、複数のＲ副画素にスキャン信号を供給するスキャン配線ＳＬ１、複数のＧ副画素にスキャン信号を供給するスキャン配線ＳＬ２、及び複数のＢ副画素にスキャン信号を供給するスキャン配線ＳＬ３が、一つの第１駆動回路ＤＣ１と対応して形成される。これは他の種類の駆動回路ＤＣ２、ＤＣ３、ＤＣ４に連結される信号配線の場合にも同一に適用され得る。
このとき、駆動回路が画素ＰＸに信号を供給するための信号配線は、非表示領域４０内で互いに交差しないように形成される。互いに異なる種類の駆動回路と連結された信号配線は、非表示領域４０で互いに交差しないように形成される。例えば、隣接して位置した第１駆動回路ＤＣ１と画素行を連結する信号配線（ＳＬ１〜ＳＬ３）と、第４駆動回路ＤＣ４と画素列を連結する信号配線ＴＬ１〜ＴＬ３とは、互いに交差しないように形成される。これにより、非表示領域４０内で信号配線の交差によって形成される寄生キャパシタによるカップリング（ｃｏｕｐｌｉｎｇ）などが減少する効果がある。
図６は、第１実施形態による表示パネル２０の周縁のうちの第２位置Ａ２に配置された画素ＰＸ及び駆動回路を示した図面である。図示されているように、駆動回路ＤＣ１、ＤＣ４は図５と同様に非表示領域４０に配置される。そして、それぞれの画素行または画素列に対応して互いに異なる種類の駆動回路ＤＣ１、ＤＣ４が配置され得る。例えば、画素行に対応して第１駆動回路ＤＣ１が配置され、画素列に対応して第４駆動回路ＤＣ４が配置され得る。
図示されているように、第２位置Ａ２には５個の画素行に対応して第１駆動回路ＤＣ１が５個配置され、５個の画素列に対応して第４駆動回路ＤＣ４が５個配置される。
そして、駆動回路ＤＣ１、ＤＣ４は、表示領域３０の形態によって平面で対応する角度に傾いて配置される。図６において、基準線Ｌｒｅｆから時計方向に傾いた角度を測定するとき、最も左側に位置する第１駆動回路ＤＣ１が基準線Ｌｒｅｆから傾いた角度α３より、最も右側に位置する第４駆動回路ＤＣ４が基準線Ｌｒｅｆから傾いた角度α４がさらに大きい。
また、駆動回路ＤＣ１、ＤＣ４は非表示領域４０に一列に配列される。駆動回路ＤＣ１、ＤＣ４は表示領域３０の周りに沿って一列に駆動回路の種類が変更され配列される。例えば、図６において、最も左側に位置する第４駆動回路ＤＣ４から最も右側に位置する第１駆動回路ＤＣ１まで、駆動回路は表示領域３０の周りに沿って一列にその種類が変更され配列される。
このとき、画素配列間に段差が発生する場合、当該段差の種類によって駆動回路の種類が変更され配置される。行単位で画素配列間に段差が発生すると、第１駆動回路ＤＣ１が当該段差に対応して配置され、列単位で段差が発生すると、第４駆動回路ＤＣ４が当該段差に対応して配置される。第１駆動回路ＤＣ１は互いに異なる画素行に信号を供給し、第４駆動回路ＤＣ４は、互いに異なる画素列に信号を供給するためである。図６においては、行方向及び列方向に一つの画素ＰＸほど段差が発生するので、第１駆動回路ＤＣ１と第４駆動回路ＤＣ４が交互に配置される。
一方、交互に配置されて、隣接するように位置する第１駆動回路ＤＣ１及び第４駆動回路ＤＣ４の表示領域３０の接線方向の幅の合計は、画素ＰＸの幅の半分以下に形成され得る。また、隣接するように位置する２個の駆動回路の幅の合計は、画素ＰＸの幅の半分以下に形成され得る。
一つの駆動回路は、一つの行または列に含まれる画素ＰＸに信号を供給する。一つの画素ＰＸには複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３が含まれるので、一つの駆動回路は、一つの画素行または一つの画素列に含まれる複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３それぞれに信号を供給する。したがって、一つの駆動回路から一つの画素行または一つの画素列に供給する信号配線は複数個形成される。このとき、駆動回路ＤＣ１、ＤＣ４が画素ＰＸに信号を供給するための信号配線は、非表示領域４０内で互いに交差しないように形成される。互いに異なる種類の駆動回路ＤＣ１、ＤＣ４と連結された信号配線は、非表示領域４０で互いに交差しないように形成される。
図７は、第１実施形態による表示パネル２０の周縁のうちの第３位置Ａ３に配置された画素ＰＸ及び駆動回路を示した図面である。図示されているように、駆動回路は図５と同様に非表示領域４０に配置される。そして、それぞれの画素行または画素列に対応して、互いに異なる種類の駆動回路ＤＣ１、ＤＣ４が配置され得る。例えば、画素行に対応して第１駆動回路ＤＣ１が配置され、画素列に対応して第４駆動回路ＤＣ４が配置され得る。図示されているように、第３位置Ａ３には１２個の画素行に対応して第１駆動回路ＤＣ１が１２個配置され、３個の画素列に対応して第４駆動回路ＤＣ４が３個配置される。
そして、駆動回路ＤＣ１、ＤＣ４は、表示領域３０の形態によって平面で対応する角度に傾いて配置され得る。図７において、時計方向に傾いた角度を測定するとき、最も左側に位置する第１駆動回路ＤＣ１が基準線Ｌｒｅｆから傾いた角度α５より、最も右側に位置する第１駆動回路ＤＣ１が基準線Ｌｒｅｆから傾いた角度α６がさらに大きい。
また、駆動回路ＤＣ１、ＤＣ４は非表示領域４０に一列に配列される。駆動回路ＤＣ１、ＤＣ４は表示領域３０の周りに沿って一列に駆動回路の種類が変更され配列される。例えば、図７において、最も左側に位置する第１駆動回路ＤＣ１から最も右側に位置する第１駆動回路ＤＣ１まで、駆動回路は表示領域３０の周りに沿って一列にその種類が変更され配列される。
このとき、画素配列間に段差が発生する場合、当該段差の種類によって駆動回路の種類が変更され配置される。行単位で画素配列間に段差が発生すると、第１駆動回路ＤＣ１が当該段差に対応して配置され、列単位で段差が発生すると、第４駆動回路ＤＣ４が当該段差に対応して配置される。第１駆動回路ＤＣ１は互いに異なる画素行に信号を供給し、第４駆動回路ＤＣ４は互いに異なる画素列に信号を供給するためである。
一つの駆動回路は、一つの行または列に含まれる画素ＰＸに信号を供給する。一つの画素ＰＸには複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３が含まれるので、一つの駆動回路は、一つの画素行または一つの画素列に含まれる複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３それぞれに信号を供給する。したがって、一つの駆動回路から一つの画素行または一つの画素列に供給する信号配線は複数個形成される。このとき、駆動回路ＤＣ１、ＤＣ４が画素ＰＸに信号を供給するための信号配線は、非表示領域４０内で互いに交差しないように形成される。互いに異なる種類の駆動回路ＤＣ１、ＤＣ４と連結された信号配線は、非表示領域４０で互いに交差しないように形成される。
図５乃至図７に示したように、駆動回路ＤＣ１、ＤＣ４は、表示パネル２０上で配置される位置によって、その個数が異なるように配置され得る。例えば、第１位置Ａ１では、列単位で発生する画素配列間の段差によって第４駆動回路ＤＣ４が複数個配置されるが、第３位置Ａ３では、行単位で発生する画素配列間の段差によって第１駆動回路ＤＣ１が複数個配置される。つまり、表示領域３０の周りに沿って配置される駆動回路の種類及び個数が変更される。
図８は、表示パネル２０の第２実施形態を示した図面である。図示されているように、表示パネル２０の形態に対応して表示領域３０の形態が決定され得る。例えば、表示パネル２０の形態が楕円形であれば、表示領域３０の形態も楕円形であり得る。また、表示パネル２０の一部が曲線である場合、一部に対応する表示領域３０の形態も曲線の形態を有する。そして、表示パネル２０において表示領域３０を除いた領域には、駆動回路が配置される非表示領域４０が形成される。
表示領域３０内には複数の画素ＰＸが配置される。画素ＰＸは表示領域３０内にマトリックス状に配置され得る。このとき、画素ＰＸは表示領域３０内で曲線に対応して適切に配置される。例えば、表示領域３０の形態が楕円形である場合、表示領域３０の周縁に位置した画素配列間に段差が発生する。
例えば、一部が曲線の形態を有する表示領域３０の周縁に四角形状の画素ＰＸが配置されるので、画素配列間の段差が発生する。例えば、第１行と第２行に対応する表示領域３０の周縁ＣＡ２に、画素ＰＸ１２個の差ほど第１行の画素配列と第２行の画素配列間に段差が発生する。
行単位または列単位で隣接した画素配列間の段差は、対応する周縁の位置によって異なり得る。例えば、第１行の画素配列と第２行の画素配列間には画素ＰＸ１２個の差ほど段差が発生するが、第２行の画素配列と第３行の画素配列間には画素ＰＸ６個の差ほど段差が発生し得る。
また、駆動回路が表示領域３０の形態によって非表示領域４０に適切に形成される。例えば、画素ＰＸが配置された形態が楕円形である場合、画素ＰＸに信号を供給するための駆動回路が、画素ＰＸが配置された楕円の周りに沿って位置する。表示パネル２０の形態が楕円形である場合、画素ＰＸが配置される表示領域３０及び駆動回路が配置される非表示領域４０の全体が成す形態は楕円形であり得る。
図８において、すべての画素ＰＸの形態及び大きさが同一のものと示されているが、表示領域３０内部の領域を区分して配置される画素ＰＸの大きさは異なってもよい。例えば、表示領域３０の中央領域に配置される画素ＰＸは、表示領域３０の周縁領域（ｅｄｇｅ）に配置される画素ＰＸより大きくてもよい。
このような駆動回路は、非表示領域４０が表示パネル２０内で狭い領域を占めるように、非表示領域４０に適切に配置されなければならない。しかし、画素ＰＸが任意の形態に配置される表示パネル２０の場合、画素配列間の段差が発生するため、画素ＰＸが四角形に配置される表示パネル２０とは異なるように駆動回路が配置されなければならない。
図９は、図８の表示パネル２０の周縁のうちの第１位置に配置された画素ＰＸ及び駆動回路の実施形態を示した図面である。図示されているように、駆動回路は非表示領域４０に配置される。図面には、第１駆動回路ＤＣ１及び第４駆動回路ＤＣ４が配置されることと説明しているが、非表示領域４０内のそれぞれの位置ごとに互いに異なる種類の駆動回路が混合され配置されてもよい。例えば、非表示領域４０には、第１駆動回路ＤＣ１と第４駆動回路ＤＣ４が混合され配置される領域、第２駆動回路と第４駆動回路ＤＣ４が混合され配置される領域、第１駆動回路ＤＣ１と第３駆動回路が混合され配置される領域、及び第２駆動回路と第３駆動回路が混合され配置される領域が含まれてもよい。そして、非表示領域４０には、互いに異なる種類の駆動回路が表示領域３０の周りに沿ってそれぞれの個数が異なるように配置され得る。
このとき、それぞれの画素行または画素列に対応して互いに異なる種類の駆動回路が配置され得る。例えば、画素行に対応して第１駆動回路ＤＣ１が配置され、画素列に対応して第４駆動回路ＤＣ４が配置され得る。図示されているように、第１位置には２個の画素行に対応して第１駆動回路ＤＣ１が２個配置され、１０個の画素列に対応して第４駆動回路ＤＣ４が１０個配置される。
一方、互いに異なる種類の駆動回路それぞれが占める面積が互いに異なり得る。例えば、一つの第１駆動回路ＤＣ１の面積と一つの第４駆動回路ＤＣ４の面積が互いに異なり得る。
そして、駆動回路ＤＣ１、ＤＣ４は、表示領域３０の形態によって平面で対応する角度に傾いて配置され得る。具体的に、駆動回路は、表示領域３０と非表示領域４０の境界の法線角度とほぼ同一の角度に傾いて、非表示領域４０に配置され得る。表示領域３０が曲線である場合、表示領域３０の周りに沿って表示領域３０と非表示領域４０の境界に対する法線方向が変更されるので、表示領域３０の周りに沿って配置される駆動回路の基準線Ｌｒｅｆに対する配置角度も前記法線方向によって変更される。図９において、最も左側に位置する第４駆動回路ＤＣ４は基準線Ｌｒｅｆと平行に配置される。しかし、前記第４駆動回路ＤＣ４から表示領域３０の周りに沿って右側に配置される駆動回路ＤＣ１、ＤＣ４は、基準線Ｌｒｅｆからの角度β１、β２が次第に増加するように傾いて配置される。
このとき、同じ種類の駆動回路の場合においても、対応する画素行または画素列の位置によって基準線Ｌｒｅｆに対する配置角度が変更される。一例として、互いに異なる画素行にそれぞれ対応する第１駆動回路ＤＣ１の配置角度は互いに異なる。
また、駆動回路ＤＣ１、ＤＣ４は非表示領域４０に一列に配列される。駆動回路ＤＣ１、ＤＣ４は表示領域３０の周りに沿って一列に駆動回路の種類が変更され配列される。例えば、図９において、最も左側に位置する第４駆動回路ＤＣ４から最も右側に位置する第１駆動回路ＤＣ１まで、駆動回路ＤＣ１、ＤＣ４は表示領域３０の周りに沿って一列にその種類が変更され配列される。
このとき、画素配列間に段差が発生する場合、当該段差の種類によって駆動回路の種類が変更され配置される。行単位で画素配列間に段差が発生すると、第１駆動回路ＤＣ１が当該段差に対応して配置され、列単位で段差が発生すると、第４駆動回路ＤＣ４が当該段差に対応して配置される。第１駆動回路ＤＣ１は互いに異なる画素行に信号を供給し、第４駆動回路ＤＣ４は互いに異なる画素列に信号を供給するためである。
一つの駆動回路は、一つの行または列に含まれる画素ＰＸに信号を供給する。一つの画素ＰＸには複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３が含まれるので、一つの駆動回路は、一つの画素行または一つの画素列に含まれる複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３それぞれに信号を供給する。したがって、一つの駆動回路から一つの画素行または一つの画素列に供給する信号配線は複数個形成される。例えば、一つの第１駆動回路ＤＣ１は一つの画素行にスキャン信号を供給するが、一つの画素行内にはＲ副画素、Ｇ副画素、Ｂ副画素を含む画素ＰＸが複数個形成されるので、複数のＲ副画素にスキャン信号を供給するスキャン配線、複数のＧ副画素にスキャン信号を供給するスキャン配線、及び複数のＢ副画素にスキャン信号を供給するスキャン配線が一つの第１駆動回路ＤＣ１と対応して形成される。これは、他の種類の駆動回路に連結される信号配線の場合にも同一に適用され得る。
このとき、駆動回路ＤＣ１、ＤＣ４が画素ＰＸに信号を供給するための信号配線は、非表示領域４０内で互いに交差しないように形成される。互いに異なる種類の駆動回路と連結された信号配線は、非表示領域４０で互いに交差しないように形成される。例えば、隣接して位置した第１駆動回路ＤＣ１と画素行を連結される信号配線と、第４駆動回路ＤＣ４と画素列を連結される信号配線とは、互いに交差しないように形成される。これにより、非表示領域４０内で信号配線の交差によって形成される寄生キャパシタによるカップリングなどが減少する効果がある。
図１０は、図８の表示パネル２０の周縁のうちの第２位置に配置された画素ＰＸ及び駆動回路の実施形態を示した図面である。図示されているように、駆動回路は図９と同様に、非表示領域４０に配置される。そして、それぞれの画素行または画素列に対応して互いに異なる種類の駆動回路ＤＣ１、ＤＣ４が配置され得る。例えば、画素行に対応して第１駆動回路ＤＣ１が配置され、画素列に対応して第４駆動回路ＤＣ４が配置され得る。図示されているように、第２位置には５個の画素行に対応して第１駆動回路ＤＣ１が５個配置され、５個の画素列に対応して第４駆動回路ＤＣ４が５個配置される。
そして、駆動回路ＤＣ１、ＤＣ４は、表示領域３０の形態によって平面で対応する角度に傾いて配置され得る。図１０において、時計方向に傾いた角度を測定するとき、最も左側に位置する第４駆動回路ＤＣ４が基準線Ｌｒｅｆから傾いた角度β３より、右側に位置する第１駆動回路ＤＣ１が基準線Ｌｒｅｆから傾いた角度β４がさらに大きい。
また、駆動回路ＤＣ１、ＤＣ４は非表示領域４０に一列に配列される。駆動回路ＤＣ１、ＤＣ４は表示領域３０の周りに沿って一列に駆動回路の種類が変更され配列される。例えば、図１０において、最も左側に位置する第４駆動回路ＤＣ４から最も右側に位置する第１駆動回路ＤＣ１まで、駆動回路ＤＣ１、ＤＣ４は表示領域３０の周りに沿って一列にその種類が変更され配列される。
このとき、画素配列間に段差が発生する場合、当該段差の種類によって駆動回路の種類が変更され配置される。行単位で画素配列間に段差が発生すると、第１駆動回路ＤＣ１が当該段差に対応して配置され、列単位で段差が発生すると、第４駆動回路ＤＣ４が当該段差に対応して配置される。第１駆動回路ＤＣ１は互いに異なる画素行に信号を供給し、第４駆動回路ＤＣ４は互いに異なる画素列に信号を供給するためである。図１０においては、行方向及び列方向に一つの画素ＰＸほど段差が発生するので、第１駆動回路ＤＣ１と第４駆動回路ＤＣ４が交互に配置される。
一つの駆動回路は、一つの行または列に含まれる画素ＰＸに信号を供給する。一つの画素ＰＸには複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３が含まれるので、一つの駆動回路は、一つの画素行または一つの画素列に含まれる複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３それぞれに信号を供給する。したがって、一つの駆動回路から一つの画素行または一つの画素列に供給する信号配線は複数個形成される。このとき、駆動回路ＤＣ１、ＤＣ４が画素ＰＸに信号を供給するための信号配線は、非表示領域４０内で互いに交差しないように形成される。互いに異なる種類の駆動回路と連結された信号配線は、非表示領域４０で互いに交差しないように形成される。
図１１は、図８の表示パネル２０の周縁のうちの第３位置に配置された画素ＰＸ及び駆動回路の実施形態を示した図面である。図示されているように、駆動回路は図９と同様に、非表示領域４０に配置される。そして、それぞれの画素行または画素列に対応して互いに異なる種類の駆動回路が配置され得る。例えば、画素行に対応して第１駆動回路ＤＣ１が配置され、画素列に対応して第４駆動回路ＤＣ４が配置され得る。図示されているように、第３位置には１２個の画素行に対応して第１駆動回路ＤＣ１が１２個配置され、３個の画素列に対応して第４駆動回路ＤＣ４が３個配置される。
そして、駆動回路ＤＣ１、ＤＣ４は、表示領域３０の形態によって平面で対応する角度に傾いて配置される。図１１において、時計方向に傾いた角度を測定するとき、最も左側に位置する第１駆動回路ＤＣ１が基準線Ｌｒｅｆから傾いた角度β５より、最も右側に位置する第１駆動回路ＤＣ１が基準線Ｌｒｅｆから傾いた角度β６がさらに大きい。
また、駆動回路ＤＣ１、ＤＣ４は非表示領域４０に一列に配列される。駆動回路ＤＣ１、ＤＣ４は表示領域３０の周りに沿って一列に駆動回路の種類が変更され配列される。例えば、図１１において、最も左側に位置する第１駆動回路ＤＣ１から最も右側に位置する第１駆動回路ＤＣ１まで、駆動回路ＤＣ１、ＤＣ４は表示領域３０の周りに沿って一列にその種類が変更され配列される。
このとき、画素配列間に段差が発生する場合、当該段差の種類によって駆動回路の種類が変更され配置される。行単位で画素配列間に段差が発生すると、第１駆動回路ＤＣ１が当該段差に対応して配置され、列単位で段差が発生すると、第４駆動回路ＤＣ４が当該段差に対応して配置される。第１駆動回路ＤＣ１は互いに異なる画素行に信号を供給し、第４駆動回路ＤＣ４は互いに異なる画素列に信号を供給するためである。
一つの駆動回路は、一つの行または列に含まれる画素ＰＸに信号を供給する。一つの画素ＰＸには複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３が含まれるので、一つの駆動回路は、一つの画素行または一つの画素列に含まれる複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３それぞれに信号を供給する。したがって、一つの駆動回路から一つの画素行または一つの画素列に供給する信号配線は複数個形成される。このとき、駆動回路ＤＣ１、ＤＣ４が画素ＰＸに信号を供給するための信号配線は、非表示領域４０内で互いに交差しないように形成される。互いに異なる種類の駆動回路と連結された信号配線は、非表示領域４０で互いに交差しないように形成される。
図９乃至図１１に示されているように、駆動回路ＤＣ１、ＤＣ４は、表示パネル２０上で配置される位置によって、その個数が異なるように配置される。例えば、第１位置では、列単位で発生する画素配列間の段差によって第４駆動回路ＤＣ４が複数個配置されるが、第３位置では、行単位で発生する画素配列間の段差によって第１駆動回路ＤＣ１が複数個配置される。つまり、表示領域３０の周りに沿って配置される駆動回路ＤＣ１、ＤＣ４の種類及び個数が変更される。
また、第１実施形態と比較して、第２実施形態の場合、表示領域３０が楕円形に形成されて、表示領域３０と非表示領域４０の境界線の曲率が変更される。しかし、実施形態によれば、駆動回路ＤＣ１、ＤＣ４が表示領域３０の周りに沿って一列に配列され、表示領域３０と非表示領域４０の境界線の法線方向に配置されるので、曲率が変更される場合にも非表示領域４０の幅を縮小させる効果がある。
図１２は、表示パネル２０の第３実施形態を示した図面である。図示されているように、表示パネル２０は一部が曲線に形成され得る。例えば、表示パネル２０は、弓形状の第１領域ＣＡ３及び四角形状の第２領域ＣＡ４が結合される形態であり得る。
表示パネル２０の形態に対応して表示領域３０の形態が決定され得る。例えば、表示パネル２０の一部が曲線である場合、一部に対応する表示領域３０の形態も曲線の形態を有する。
したがって、第１領域ＣＡ３の表示領域３０は弓形状に形成され、第２領域ＣＡ４の表示領域３０は四角形状に形成される。そして、表示パネル２０において表示領域３０を除いた領域には、駆動回路が配置される非表示領域４０が形成される。
表示領域３０内には複数の画素ＰＸが配置される。画素ＰＸは表示領域３０内にマトリックス状に配置され得る。このとき、画素ＰＸは、表示領域３０内で曲線に対応して適切に配置される。例えば、表示領域３０が弓形状である場合、弓形状の表示領域３０の周縁に位置した画素配列間に段差が発生する。
つまり、一部が曲線の形態を有する表示領域３０の周縁に四角形状の画素ＰＸが配置されるので、画素配列間の段差が発生する。例えば、第１行と第２行に対応する表示領域３０の周縁に、画素ＰＸ６個の差ほど第１行の画素配列と第２行の画素配列間に段差が発生する。
行単位または列単位で隣接した画素配列間の段差は、対応する周縁の位置によって異なり得る。例えば、第１行の画素配列と第２行の画素配列間には画素ＰＸ６個の差ほど段差が発生するが、第２行の画素配列と第３行の画素配列間には画素ＰＸ４個の差ほど段差が発生し得る。
また、駆動回路が表示領域３０の形態によって非表示領域４０に適切に形成される。例えば、画素ＰＸが配置された形態が弓形状である場合、画素ＰＸに信号を供給するための駆動回路が、画素ＰＸが配置された弓形の弧の周りに沿って位置する。表示パネル２０の形態が弓形状である場合、画素ＰＸが配置される表示領域３０及び駆動回路が配置される非表示領域４０全体が成す形態が弓形状であり得る。
図１２においては、すべての画素ＰＸの形態及び大きさが同一のものと示されているが、表示領域３０内部の領域を区分して配置される画素ＰＸの大きさは異なり得る。例えば、表示領域３０の第２領域ＣＡ４に配置される画素ＰＸは、第１領域ＣＡ３の周縁領域（ｅｄｇｅ）に配置される画素ＰＸより大きくてもよい。
このような駆動回路ＤＣ１、ＤＣ２、ＤＣ４は、非表示領域４０が表示パネル２０内で狭い領域を占めるように、非表示領域４０に適切に配置されなければならない。しかし、画素ＰＸが任意の形態に配置される表示パネル２０の場合、画素配列間の段差が発生するため、画素ＰＸが四角形に配置される表示パネル２０とは異なるように駆動回路が配置されなければならない。
図１３は、図１２の表示パネル２０の第１領域ＣＡ３の周縁のうちの第１位置に配置された画素ＰＸ及び駆動回路の実施形態を示した図面である。図示されているように、駆動回路は非表示領域４０に配置される。図面には、第１駆動回路ＤＣ１、第２駆動回路ＤＣ２及び第４駆動回路ＤＣ４が配置されることと説明されているが、非表示領域４０内のそれぞれの位置ごとに互いに異なる種類の駆動回路ＤＣ１、ＤＣ２、ＤＣ４が混合され配置され得る。
例えば、非表示領域４０には、第１駆動回路ＤＣ１、第２駆動回路ＤＣ２及び第４駆動回路ＤＣ４が混合され配置される領域、第１駆動回路ＤＣ１と第４駆動回路ＤＣ４が混合され配置される領域、第２駆動回路ＤＣ２と第４駆動回路ＤＣ４が混合され配置される領域が含まれてもよい。そして、非表示領域４０には互いに異なる種類の駆動回路ＤＣ１、ＤＣ２、ＤＣ４が、表示領域３０の周りに沿ってそれぞれの個数が異なるように配置され得る。
このとき、それぞれの画素行または画素列に対応して互いに異なる種類の駆動回路ＤＣ１、ＤＣ２、ＤＣ４が配置され得る。例えば、画素行に対応して第１駆動回路ＤＣ１及び第２駆動回路ＤＣ２が配置され、画素列に対応して第４駆動回路ＤＣ４が配置され得る。図示されているように、第１位置には、１個の画素行に対応して第１駆動回路ＤＣ１及び第２駆動回路ＤＣ２が一つずつ配置され、１４個の画素列に対応して第４駆動回路ＤＣ４が１４個配置される。
一方、互いに異なる種類の駆動回路ＤＣ１、ＤＣ２、ＤＣ４それぞれが占める面積が互いに異なってもよい。例えば、一つの第１駆動回路ＤＣ１の面積、一つの第２駆動回路ＤＣ２の面積、及び一つの第４駆動回路ＤＣ４の面積が互いに異なってもよい。
そして、駆動回路ＤＣ１、ＤＣ２、ＤＣ４は、表示領域３０の形態によって平面で対応する角度に傾いて配置され得る。具体的に、駆動回路は、第１領域ＣＡ３で表示領域３０と非表示領域４０の境界の法線角度とほぼ同一の角度に傾いて、非表示領域４０に配置され得る。表示領域３０が曲線である場合、表示領域３０の周りに沿って表示領域３０と非表示領域４０の境界に対する法線方向が変更されるので、表示領域３０の周りに沿って配置される駆動回路の基準線Ｌｒｅｆに対する配置角度も前記法線方向によって変更される。図１３で中央に位置する第４駆動回路ＤＣ４は、基準線Ｌｒｅｆと平行に配置される。しかし、前記第４駆動回路ＤＣ４から表示領域３０の周りに沿って右側または左側に配置される駆動回路ＤＣ１、ＤＣ２、ＤＣ４は、基準線Ｌｒｅｆからの角度が次第に増加するか、または減少するように傾いて配置される。例えば、右側に配置される第４駆動回路ＤＣ４の基準線Ｌｒｅｆからの配置角度γ１は、正の値を有する。
このとき、同じ種類の駆動回路の場合にも、対応する画素行または画素列の位置によって基準線Ｌｒｅｆに対する配置角度が変更される。一例として、互いに異なる画素列にそれぞれ対応する第４駆動回路ＤＣ４の配置角度は互いに異なる。
また、駆動回路ＤＣ１、ＤＣ２、ＤＣ４は非表示領域４０に一列に配列される。駆動回路ＤＣ１、ＤＣ２、ＤＣ４は表示領域３０の周りに沿って一列に駆動回路の種類が変更され配列される。例えば、図１３において、最も左側に位置する第２駆動回路ＤＣ２から最も右側に位置する第１駆動回路ＤＣ１まで、駆動回路ＤＣ１、ＤＣ２、ＤＣ４は表示領域３０の周りに沿って一列にその種類が変更され配列される。
このとき、画素配列間に段差が発生する場合、当該段差の種類によって駆動回路の種類が変更され配置される。行単位で画素配列間に段差が発生すると、第１駆動回路ＤＣ１及び第２駆動回路ＤＣ２が当該段差に対応して配置され、列単位で段差が発生すると、第４駆動回路ＤＣ４が当該段差に対応して配置される。第１駆動回路ＤＣ１及び第２駆動回路ＤＣ２は互いに異なる画素行に信号を供給し、第４駆動回路ＤＣ４は互いに異なる画素列に信号を供給するためである。
このとき、第１駆動回路ＤＣ１及び第２駆動回路ＤＣ２は、同一の行単位で発生する画素配列間の段差に対応して隣接した領域に配置されてもよい。または、図１３に示されているように、第１画素行と第２画素行の段差は、中央領域の左側及び右側で発生するので、左側または右側に対応して第１駆動回路ＤＣ１及び第２駆動回路ＤＣ２が配置され得る。つまり、左側の第１画素行及び第２画素行の段差に対応して第２駆動回路ＤＣ２が配置され、右側の第１画素行及び第２画素行の段差に対応して第１駆動回路ＤＣ１が配置され得る。
一つの駆動回路は、一つの行または列に含まれる画素ＰＸに信号を供給する。一つの画素ＰＸには複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３が含まれるので、一つの駆動回路は、一つの画素行または一つの画素列に含まれる複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３それぞれに信号を供給する。したがって、一つの駆動回路から一つの画素行または一つの画素列に供給する信号配線は複数個形成される。例えば、一つの第１駆動回路ＤＣ１は一つの画素行にスキャン信号を供給するが、一つの画素行内にはＲ副画素、Ｇ副画素、Ｂ副画素を含む画素ＰＸが複数個形成されるので、複数のＲ副画素にスキャン信号を供給するスキャン配線、複数のＧ副画素にスキャン信号を供給するスキャン配線、及び複数のＢ副画素にスキャン信号を供給するスキャン配線が一つの第１駆動回路ＤＣ１と対応して形成される。これは、他の種類の駆動回路に連結される信号配線の場合にも同一に適用され得る。
このとき、駆動回路ＤＣ１、ＤＣ２、ＤＣ４が画素ＰＸに信号を供給するための信号配線は、非表示領域４０内で互いに交差しないように形成される。互いに異なる種類の駆動回路ＤＣ１、ＤＣ２、ＤＣ４と連結された信号配線は、非表示領域４０で互いに交差しないように形成される。例えば、隣接するように位置した第１駆動回路ＤＣ１と画素行を連結される信号配線と、第４駆動回路ＤＣ４と画素列を連結される信号配線とは、互いに交差しないように形成される。これにより、非表示領域４０内で信号配線の交差によって形成される寄生キャパシタによるカップリングなどが減少する効果がある。
図１４は、図１２の表示パネル２０の第１領域ＣＡ３の周縁のうちの第２位置に配置された画素ＰＸ及び駆動回路の実施形態を示した図面である。図示されているように、駆動回路は図１３と同様に、非表示領域４０に配置される。そして、それぞれの画素行または画素列に対応して互いに異なる種類の駆動回路ＤＣ１、ＤＣ２、ＤＣ４が配置され得る。例えば、画素行に対応して第１駆動回路ＤＣ１が配置され、画素列に対応して第４駆動回路ＤＣ４が配置され得る。図示されているように、第２位置には４個の画素行に対応して第１駆動回路ＤＣ１が４個配置され、６個の画素列に対応して第４駆動回路ＤＣ４が６個配置される。
そして、駆動回路ＤＣ１、ＤＣ２、ＤＣ４は、表示領域３０の形態によって平面で対応する角度に傾いて配置され得る。図１４において、時計方向に傾いた角度を測定するとき、最も左側に位置する第１駆動回路ＤＣ１が基準線Ｌｒｅｆから傾いた角度より、最も右側に位置する第４駆動回路ＤＣ４が基準線Ｌｒｅｆから傾いた角度がさらに大きい。
また、駆動回路ＤＣ１、ＤＣ２、ＤＣ４は非表示領域４０に一列に配列される。駆動回路ＤＣ１、ＤＣ２、ＤＣ４は表示領域３０の周りに沿って一列に駆動回路の種類が変更され配列される。例えば、図１４において、最も左側に位置する第４駆動回路ＤＣ４から最も右側に位置する第１駆動回路ＤＣ１まで、駆動回路ＤＣ１、ＤＣ２、ＤＣ４は表示領域３０の周りに沿って一列にその種類が変更され配列される。
このとき、画素配列間に段差が発生する場合、当該段差の種類によって駆動回路の種類が変更され配置される。行単位で画素配列間に段差が発生すると、第１駆動回路ＤＣ１が当該段差に対応して配置され、列単位で段差が発生すると、第４駆動回路ＤＣ４が当該段差に対応して配置される。第１駆動回路ＤＣ１は互いに異なる画素行に信号を供給し、第４駆動回路ＤＣ４は互いに異なる画素列に信号を供給するためである。図１４では、行方向及び列方向に一つの画素ＰＸほど段差が発生するので、第１駆動回路ＤＣ１と第４駆動回路ＤＣ４が交互に配置される。
一つの駆動回路は、一つの行または列に含まれる画素ＰＸに信号を供給する。一つの画素ＰＸには複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３が含まれるので、一つの駆動回路は、一つの画素行または一つの画素列に含まれる複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３それぞれに信号を供給する。したがって、一つの駆動回路から一つの画素行または一つの画素列に供給する信号配線は複数個形成される。このとき、駆動回路ＤＣ１、ＤＣ２、ＤＣ４が画素ＰＸに信号を供給するための信号配線は、非表示領域４０内で互いに交差しないように形成される。互いに異なる種類の駆動回路ＤＣ１、ＤＣ２、ＤＣ４と連結された信号配線は、非表示領域４０で互いに交差しないように形成される。
図１５は、図１２の表示パネル２０の第１領域ＣＡ３の周縁のうちの第３位置に配置された画素ＰＸ及び駆動回路の実施形態を示した図面である。図示されているように、駆動回路は図１３と同様に、非表示領域４０に配置される。そして、それぞれの画素行または画素列に対応して互いに異なる種類の駆動回路ＤＣ１、ＤＣ２、ＤＣ４が配置され得る。例えば、画素行に対応して第２駆動回路ＤＣ２が配置され、画素列に対応して第４駆動回路ＤＣ４が配置され得る。図示されているように、第３位置には４個の画素行に対応して第２駆動回路ＤＣ２が４個配置され、６個の画素列に対応して第４駆動回路ＤＣ４が６個配置される。
第３位置は、第２位置と表示領域３０の中央領域を基準として対称であり、第２位置の非表示領域４０には第１駆動回路ＤＣ１及び第４駆動回路ＤＣ４が配置されるが、第３位置の非表示領域４０には第２駆動回路ＤＣ２及び第４駆動回路ＤＣ４が配置され得る。
そして、駆動回路ＤＣ１、ＤＣ２、ＤＣ４は、表示領域３０の形態によって平面で対応する角度に傾いて配置され得る。図１５において、基準線Ｌｒｅｆから時計方向に傾いた角度を測定するとき、最も左側に位置する第２駆動回路ＤＣ２が基準線Ｌｒｅｆから傾いた角度より、最も右側に位置する第４駆動回路ＤＣ４が基準線Ｌｒｅｆから傾いた角度がさらに大きい。
また、駆動回路ＤＣ１、ＤＣ２、ＤＣ４は非表示領域４０に一列に配列される。駆動回路ＤＣ１、ＤＣ２、ＤＣ４は表示領域３０の周りに沿って一列に駆動回路の種類が変更され配列される。例えば、図１５において、最も左側に位置する第２駆動回路ＤＣ２から最も右側に位置する第４駆動回路ＤＣ４まで、駆動回路ＤＣ１、ＤＣ２、ＤＣ４は表示領域３０の周りに沿って一列にその種類が変更され配列される。
このとき、画素配列間に段差が発生する場合、当該段差の種類によって駆動回路の種類が変更され配置される。行単位で画素配列間に段差が発生すると、第２駆動回路ＤＣ２が当該段差に対応して配置され、列単位で段差が発生すると、第４駆動回路ＤＣ４が当該段差に対応して配置される。第２駆動回路ＤＣ２は互いに異なる画素行に信号を供給し、第４駆動回路ＤＣ４は互いに異なる画素列に信号を供給するためである。
一つの駆動回路は、一つの行または列に含まれる画素ＰＸに信号を供給する。一つの画素ＰＸには複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３が含まれるので、一つの駆動回路は、一つの画素行または一つの画素列に含まれる複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３それぞれに信号を供給する。したがって、一つの駆動回路から一つの画素行または一つの画素列に供給する信号配線は複数個形成される。このとき、駆動回路ＤＣ１、ＤＣ２、ＤＣ４が画素ＰＸに信号を供給するための信号配線は、非表示領域４０内で互いに交差しないように形成される。互いに異なる種類の駆動回路ＤＣ１、ＤＣ２、ＤＣ４と連結された信号配線は、非表示領域４０で互いに交差しないように形成される。
図１３乃至図１５に示されているように、駆動回路ＤＣ１、ＤＣ２、ＤＣ４は、表示パネル２０上で配置される位置によって、その個数が異なるように配置され得る。例えば、第１位置では、列単位で発生する画素配列間の段差によって第４駆動回路ＤＣ４が複数個配置されるが、第２位置では、行単位で発生する画素配列間の段差によって第１駆動回路ＤＣ１が複数個配置され、第３位置では行単位で発生する画素配列間の段差によって第２駆動回路ＤＣ２が複数個配置される。つまり、表示領域３０の周りに沿って配置される駆動回路ＤＣ１、ＤＣ２、ＤＣ４の種類及び個数が変更される。
また、第１実施形態及び第２実施形態と比較して、第３実施形態の場合、表示領域３０の一部が弓形に形成されて、表示領域３０と非表示領域４０の境界線の曲率が変更される。しかし、実施形態によれば、駆動回路ＤＣ１、ＤＣ２、ＤＣ４が表示領域３０の周りに沿って一列に配列され、表示領域３０と非表示領域４０の境界線の法線方向に配置されるので、曲率が変更される場合にも非表示領域４０の幅を縮小させる効果がある。
図１６は、表示パネル２０の第４実施形態を示した図面である。図示されているように、表示パネル２０は一部が曲線に形成され得る。例えば、表示パネル２０は、凹曲線状の第１領域ＣＡ５及び四角形状の第２領域ＣＡ６が結合される形態であり得る。
表示パネル２０の形態に対応して表示領域３０の形態が決定され得る。例えば、表示パネル２０の一部が曲線である場合、一部に対応する表示領域３０の形態も曲線の形態を有する。
したがって、第１領域ＣＡ５の表示領域３０は凹曲線状に形成され、第２領域ＣＡ６の表示領域３０は四角形状に形成される。そして、表示パネル２０において表示領域３０を除いた領域には、駆動回路が配置される非表示領域４０が形成される。
表示領域３０内には複数の画素ＰＸが配置される。画素ＰＸは表示領域３０内にマトリックス状に配置され得る。このとき、画素ＰＸは表示領域３０内で曲線に対応して適切に配置される。例えば、表示領域３０が凹曲線状である場合、凹曲線状の表示領域３０の周縁に位置した画素配列間に段差が発生する。
つまり、一部が曲線の形態を有する表示領域３０の周縁に四角形状の画素ＰＸが配置されるので、画素配列間の段差が発生する。例えば、左側から第１列と第２列に対応する表示領域３０の周縁に、画素ＰＸ２個の差ほど第１列の画素配列と第２列の画素配列間に段差が発生する。
行単位または列単位で隣接した画素配列間の段差は、対応する周縁の位置によって異なってもよい。例えば、第１列の画素配列と第２列の画素配列間には画素ＰＸ２個の差ほど段差が発生するが、第３列の画素配列と第４列の画素配列間には画素ＰＸ１個の差ほど段差が発生し得る。
また、駆動回路が表示領域３０の形態によって非表示領域４０に適切に形成される。例えば、画素ＰＸが配置された形態が凹曲線状である場合、画素ＰＸに信号を供給するための駆動回路が、画素ＰＸが配置された凹曲線に沿って位置する。
図１６においては、すべての画素ＰＸの形態及び大きさが同一のものと示されているが、表示領域３０内部の領域を区分して配置される画素ＰＸの大きさは異なってもよい。例えば、表示領域３０の第２領域ＣＡ６に配置される画素ＰＸは、第１領域ＣＡ５の周縁領域（ｅｄｇｅ）に配置される画素ＰＸより大きくてもよい。
このような駆動回路ＤＣ１、ＤＣ２、ＤＣ４は、非表示領域４０が表示パネル２０内で狭い領域を占めるように、非表示領域４０に適切に配置されなければならない。しかし、画素ＰＸが任意の形態に配置される表示パネル２０の場合、画素配列間の段差が発生するため、画素ＰＸが四角形に配置される表示パネル２０とは異なるように駆動回路が配置されなければならない。これについて、図１７を参照して、第４実施形態による表示パネル２０の駆動回路配置について説明する。
図１７は、図１６の表示パネル２０の第１領域ＣＡ５の第１位置Ｄ１に配置された画素ＰＸ及び駆動回路の実施形態を示した図面である。図示されているように、駆動回路は非表示領域４０に配置される。図面には、第１駆動回路ＤＣ１、第２駆動回路ＤＣ２及び第４駆動回路ＤＣ４が配置されることと説明したが、非表示領域４０内のそれぞれの位置ごとに互いに異なる種類の駆動回路ＤＣ１、ＤＣ２、ＤＣ４が混合され配置され得る。例えば、非表示領域４０には、第１駆動回路ＤＣ１及び第４駆動回路ＤＣ４が混合され配置される領域、第２駆動回路ＤＣ２が配置される領域、第３駆動回路が配置される領域が含まれてもよい。そして、非表示領域４０には、互いに異なる種類の駆動回路ＤＣ１、ＤＣ２、ＤＣ４が表示領域３０の周りに沿ってそれぞれの個数が異なるように配置され得る。
このとき、それぞれの画素行または画素列に対応して、互いに異なる種類の駆動回路ＤＣ１、ＤＣ２、ＤＣ４が配置され得る。例えば、画素行に対応して第１駆動回路ＤＣ１及び第２駆動回路ＤＣ２が配置され、画素列に対応して第４駆動回路ＤＣ４が配置され得る。図示されているように、第１領域ＣＡ５には、７個の画素行に対応して第１駆動回路ＤＣ１及び第２駆動回路ＤＣ２がそれぞれ７個配置され、５個の画素列に対応して第４駆動回路ＤＣ４が５個配置される。
一方、互いに異なる種類の駆動回路ＤＣ１、ＤＣ２、ＤＣ４それぞれが占める面積が互いに異なってもよい。例えば、一つの第１駆動回路ＤＣ１の面積、一つの第２駆動回路ＤＣ２の面積、及び一つの第４駆動回路ＤＣ４の面積が互いに異なってもよい。
そして、駆動回路ＤＣ１、ＤＣ２、ＤＣ４は、表示領域３０の形態によって平面で対応する角度に傾いて配置され得る。具体的に、駆動回路は第１領域ＣＡ５で表示領域３０と非表示領域４０の境界の法線角度とほぼ同一の角度に傾いて、非表示領域４０に配置され得る。表示領域３０が曲線である場合、曲線の表示領域３０の周りに沿って表示領域３０と非表示領域４０の境界に対する法線方向が変更されるので、表示領域３０の周りに沿って配置される駆動回路の基準線Ｌｒｅｆに対する配置角度も前記法線方向によって変更される。
図１７において、表示領域３０の左側に位置する第２駆動回路ＤＣ２は、対応する表示領域３０の形態が直線であるため、直線と直交する角度に配置される。そして、表示領域３０の最も左側画素列と連結される第４駆動回路ＤＣ４から、表示領域３０の周りに沿って右側に配置される駆動回路ＤＣ１、ＤＣ２、ＤＣ４は、基準線Ｌｒｅｆからの角度が次第に減少するように傾いて配置される。例えば、最も左側の画素列と連結される第４駆動回路ＤＣ４の基準線Ｌｒｅｆからの配置角度δ１は、正の値を有する。
このとき、同じ種類の駆動回路の場合にも、対応する画素行または画素列の位置によって基準線Ｌｒｅｆに対する配置角度が変更される。一例として、互いに異なる画素列にそれぞれ対応する第４駆動回路ＤＣ４の配置角度は互いに異なる。
また、駆動回路ＤＣ１、ＤＣ２、ＤＣ４は非表示領域４０に一列に配列される。駆動回路ＤＣ１、ＤＣ２、ＤＣ４は表示領域３０の周りに沿って一列に駆動回路の種類が変更され配列される。例えば、図１７に示されているように、曲線形態の表示領域３０に対応して、最も左側に位置する第４駆動回路ＤＣ４から最も右側に位置する第１駆動回路ＤＣ１まで、駆動回路ＤＣ１、ＤＣ２、ＤＣ４は表示領域３０の周りに沿って一列にその種類が変更され配列される。
このとき、画素配列間に段差が発生する場合、当該段差の種類によって駆動回路の種類が変更され配置される。行単位で画素配列間に段差が発生すると、第１駆動回路ＤＣ１及び第２駆動回路ＤＣ２が当該段差に対応して配置され、列単位で段差が発生すると、第４駆動回路ＤＣ４が当該段差に対応して配置される。第１駆動回路ＤＣ１及び第２駆動回路ＤＣ２は互いに異なる画素行に信号を供給し、第４駆動回路ＤＣ４は互いに異なる画素列に信号を供給するためである。
一つの駆動回路は、一つの行または列に含まれる画素ＰＸに信号を供給する。一つの画素ＰＸには複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３が含まれるので、一つの駆動回路は、一つの画素行または一つの画素列に含まれる複数の副画素ＰＸ１１、ＰＸ１２、ＰＸ１３それぞれに信号を供給する。したがって、一つの駆動回路から一つの画素行または一つの画素列に供給する信号配線は複数個形成される。例えば、一つの第１駆動回路ＤＣ１は一つの画素行にスキャン信号を供給する。そして、一つの画素行内にはＲ副画素、Ｇ副画素、Ｂ副画素を含む画素ＰＸが複数個形成される。したがって、複数のＲ副画素にスキャン信号を供給するスキャン配線、複数のＧ副画素にスキャン信号を供給するスキャン配線、及び複数のＢ副画素にスキャン信号を供給するスキャン配線が一つの第１駆動回路ＤＣ１と対応して形成される。これは、他の種類の駆動回路に連結される信号配線の場合にも同一に適用され得る。
このとき、駆動回路ＤＣ１、ＤＣ２、ＤＣ４が画素ＰＸに信号を供給するための信号配線は、非表示領域４０内で互いに交差しないように形成される。互いに異なる種類の駆動回路ＤＣ１、ＤＣ２、ＤＣ４と連結された信号配線は、非表示領域４０で互いに交差しないように形成される。例えば、隣接するように位置した第１駆動回路ＤＣ１と画素行を連結される信号配線と、第４駆動回路ＤＣ４と画素列を連結される信号配線とは、互いに交差しないように形成される。これにより、非表示領域４０内で信号配線の交差によって形成される寄生キャパシタによるカップリングなどが減少する効果がある。
上記の図面を参照して、任意の形態を有する表示パネル２０と画素に互いに異なる種類の駆動信号（例えば、スキャン信号、データ信号、発光制御信号、テスト電圧など）を供給する駆動回路が、表示パネル２０の非表示領域３０に配置される実施形態について説明した。
実施形態は、すべての非四角形ディスプレイに適用可能であり、上記の図面においては第１駆動回路ＤＣ１、第２駆動回路ＤＣ２、第４駆動回路ＤＣ４を例として挙げて説明したが、第４駆動回路ＤＣ４を第３駆動回路に置換可能であり、これは表示パネル２０内の相対的な位置に過ぎない。
実施形態による駆動回路は、画素が配置される形態によって、非表示領域４０に密度が異なるように形成される。また、駆動回路は非表示領域４０で一列に配置される。したがって、非表示領域４０の幅を減少させる効果がある。
そして、それぞれの駆動回路から信号を表示領域３０に供給するための信号配線が交差しないので、配線が重なることによって発生する寄生キャパシタンスを減少させる効果がある。
上記の図面においては、一部の形態が凸曲線及び凹曲線を全て含む表示パネル２０について説明していないが、この場合にも上記の実施形態を組み合わせて駆動回路を適切に配置することができる。
以上、本発明の実施形態について詳細に説明したが、本発明の権利範囲はこれに限定されず、次の特許請求の範囲で定義している本発明の基本概念を利用した当業者の色々な変形及び改良形態も本発明の権利範囲に属する。
１０ ドライバＩＣ
２０ 表示パネル
３０ 表示領域
４０ 周辺領域

Claims (14)

  1. 非四角形表示領域に位置して、第１方向に延長される複数の第１信号線のうちの対応する第１信号線、及び前記第１方向と交差する第２方向に延長される複数の第２信号線のうちの対応する第２信号線に連結される複数の画素と、
    前記表示領域の周辺領域に位置して、前記複数の第１信号線のうちの対応する少なくとも一つの第１信号線に第１信号を出力する複数の第１駆動回路と、
    前記周辺領域に位置して、前記複数の第２信号線のうちの対応する少なくとも一つの第２信号線に対応する第２信号を出力する複数の第２駆動回路と、
    を含み、
    隣接する第１駆動回路間の第２駆動回路の個数は、前記周辺領域の位置によって異なる、非四角形ディスプレイ。
  2. 前記複数の第１駆動回路と前記複数の第２駆動回路は前記表示領域の周りに隣接する、請求項１に記載の非四角形ディスプレイ。
  3. 前記複数の第１駆動回路と前記複数の第２駆動回路それぞれが配置される角度は、前記複数の第１駆動回路と前記複数の第２駆動回路それぞれの位置によって変更される、請求項２に記載の非四角形ディスプレイ。
  4. 前記複数の第１駆動回路と前記複数の第２駆動回路それぞれの前記表示領域の法線方向に対応する角度はほぼ同一である、請求項３に記載の非四角形ディスプレイ。
  5. 前記複数の第１駆動回路のうちの一つの面積と、前記複数の第２駆動回路のうちの一つの面積とが互いに異なる、請求項４に記載の非四角形ディスプレイ。
  6. 交互に配置され、隣接するように位置する第１駆動回路及び第２駆動回路の表示領域の接線方向の幅の合計は、前記画素の幅の半分以下である、請求項５に記載の非四角形ディスプレイ。
  7. 前記表示領域は曲線領域を含み、
    前記複数の画素は前記曲線領域内で行列状に配列される、請求項１に記載の非四角形ディスプレイ。
  8. 前記画素の隣接する配列の間に段差がある場合、前記段差の種類によって前記第１駆動回路または前記第２駆動回路が前記段差に対応する周辺領域に位置する、請求項７に記載の非四角形ディスプレイ。
  9. 前記複数の画素は互いに異なる色で発光し、前記複数の第１信号線を通じて伝達される第１信号それぞれに同期されて、前記複数の第２信号線を通じて伝達される第２信号によって制御される複数の副画素をそれぞれ含む、請求項１に記載の非四角形ディスプレイ。
  10. 前記複数の副画素は、
    前記複数の第２信号線に連結されている一電極、及び前記複数の第１信号線をゲート電極として含む複数のスイッチングトランジスタと、
    前記複数のスイッチングトランジスタの他電極に連結されているゲート電極、電源電圧が供給される一電極、及び有機発光ダイオードに連結されている他電極を含む複数の駆動トランジスタと、を含む、請求項９に記載の非四角形ディスプレイ。
  11. 前記副画素それぞれは、
    直前画素行に対応する第１信号線を通じて伝達される第１信号に同期されて初期化電圧が供給される、請求項１０に記載の非四角形ディスプレイ。
  12. 前記副画素それぞれは、
    前記駆動トランジスタのゲート電極及び他電極の間に連結されており、対応する第１信号線をゲート電極として含む補償トランジスタをさらに含む、請求項１１に記載の非四角形ディスプレイ。
  13. 前記複数の第１信号線及び前記複数の第２信号線は前記周辺領域で互いに交差しない、請求項１に記載の非四角形ディスプレイ。
  14. 前記複数の画素は、前記第１方向に延長される複数の第３信号線のうちの対応する第３信号線に連結され、
    前記周辺領域のうちの前記複数の第１駆動回路と対向する領域内で、前記複数の第２駆動回路のうちの少なくとも一つと交互に配置され、前記複数の第３信号線のうちの対応する少なくとも一つの第３信号線に第３信号を出力する複数の第３駆動回路をさらに含む、請求項１に記載の非四角形ディスプレイ。
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