JP2016148751A - 表示装置 - Google Patents
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Abstract
Description
<表示装置の構成>
まず、図1〜図3を参照し、表示装置の構成について説明する。図1は、実施の形態1の表示装置の一例を示す平面図である。図2および図3は、実施の形態1の表示装置の一例を示す断面図である。図2は、図1のA−A線に沿った断面図である。また、図3は、図2のB部の拡大断面図である。
ここで、図1を参照し、表示装置の平面形状について説明する。前述したように、本実施の形態1の表示装置LCD1は、基板BSおよび基板FS、ならびに、表示部DPの平面形状が、矩形形状と異なる形状を有する、いわゆる異形ディスプレイである。
次に、図4を参照し、表示装置の等価回路について説明する。図4は、実施の形態1の表示装置の等価回路を示す図である。
次に、図4、ならびに、図5〜図7を参照し、走査線駆動回路CGの構成について説明する。図5は、実施の形態1の表示装置における走査線駆動回路に含まれる転送回路の等価回路を示す図である。図6は、実施の形態1の表示装置における走査線駆動回路に含まれる転送回路の配置の一例を示す平面図である。図7は、転送回路に含まれるトランジスタの構成を示す断面図である。図7は、図6のC−C線に沿った断面図である。
次に、図9〜図12を参照し、転送回路の配置について説明する。図9〜図12は、実施の形態1の表示装置における額縁領域での転送回路の配置を示す平面図である。図9は、図1において二点鎖線で囲まれた部分PR1における転送回路VSRの配置を拡大して示す。図10は、図1において二点鎖線で囲まれた部分PR2における転送回路VSRの配置を拡大して示す。図11は、図1において二点鎖線で囲まれた部分PR3における転送回路の配置を拡大して示す。なお、図12は、部分PR3および部分PR3の周辺における転送回路VSRの配置を拡大して示す。
次に、図13および図14を参照し、走査線GLに接続された接続配線GCLと映像線SLsとの交差について説明する。図13は、走査線に接続された接続配線と映像線との交差を説明するための平面図である。図14は、走査線に接続された接続配線と映像線との交差を説明するための断面図である。図14は、図13のD−D線に沿った断面図である。
次に、額縁領域の幅について、図15を参照し、比較例と比較しながら説明する。図15は、比較例の表示装置における額縁領域での転送回路の配置を示す平面図である。図15は、図1において二点鎖線で囲まれた部分PR3に相当する部分における転送回路の配置を拡大して示す。
図16〜図18は、実施の形態1の変形例の表示装置における額縁領域での転送回路の配置を示す平面図である。図16は、図1において二点鎖線で囲まれた部分PR1における転送回路VSRの配置を拡大して示す。図17は、図1において二点鎖線で囲まれた部分PR2における転送回路の配置を拡大して示す。図18は、図1において二点鎖線で囲まれた部分PR3における転送回路VSRの配置を拡大して示す。
実施の形態1では、転送回路VSRは、額縁領域FLA2に設けられていた。それに対して、実施の形態2では、転送回路VSRは、額縁領域FLA2に加えて、額縁領域FLA3にも設けられている。
次に、図19〜図22を参照し、転送回路VSRの配置について説明する。図19は、実施の形態2の表示装置の一例を示す平面図である。図20〜図22は、実施の形態2の表示装置における額縁領域での転送回路の配置を示す平面図である。図20は、図19において二点鎖線で囲まれた部分PR1における転送回路VSRの配置を拡大して示す。図21は、図19において二点鎖線で囲まれた部分PR2における転送回路VSRの配置を拡大して示す。図22は、図19において二点鎖線で囲まれた部分PR3における転送回路VSRの配置を拡大して示す。
BM 遮光膜
BS、FS 基板
BSb、FSb 背面
BSf、FSf 前面
BSs1〜BSs4 側部
CC 駆動回路
CE 共通電極
CF カラーフィルタ
CFb、CFg、CFr カラーフィルタ画素
CG 走査線駆動回路
CHP 半導体チップ
CHs チャネル領域
Clc 容量
CM 共通電極駆動回路
CS 映像線駆動回路
CTL 制御回路
CWC 接続配線
CWG 信号線
DEs ドレイン電極
DP 表示部
DPA 表示領域
DPA1、DPA2 領域
DPAs1、DPAs2、DPAs21、DPAs22 側部
DPAs3、DPAs4、DPAs41、DPAs42 側部
DR 方向
DRs ドレイン領域
EPG、EPS 端部
EX 延在部
FL 額縁部
FLA、FLA1、FLA2、FLA3、FLA4 額縁領域
FLA21、FLA21a、FLA22 領域
FLA41、FLA41a、FLA42 領域
GCK1、GCK2 入力端子
GCL、GCLL、GCLL1、GCLL2、GCLM、GCLU 接続配線
GEs ゲート電極
GIN1 入力端子
GIs ゲート絶縁膜
GL、GLL1、GLL2 走査線
GST リセット信号線
HLs コンタクトホール
IFs 絶縁膜
LCD1 表示装置
LCL 液晶層
LCK1〜LCK4 クロック信号線
LS バックライト
LXL、LXM、LXU、LYL、LYM、LYU 長さ
OC1 樹脂層
OC2 絶縁層
PE 画素電極
Pix 画素
PL1、PL2 偏光板
PR1〜PR3 部分
RES 入力端子
SCL 接続配線
SCs 半導体層
SEs ソース電極
SL、SL1〜SL3、SLs、SLs1〜SLs3 映像線
SPix 副画素
SR シフトレジスタ
SRs ソース領域
SWS RGBスイッチ回路
T1、T10〜T13、T2〜T9、Trd トランジスタ
VA ビア
VCK1〜VCK4 信号
VDD 入力端子
VG、VG1、VG2、VG3、VGn 走査信号
VH 高電位線
VL 低電位線
VOUT1、VOUT2 出力端子
VSR、VSR1、VSR2、VSR3、VSRIN 転送回路
VSRL、VSRM、VSRn、VSRU 転送回路
VSS 入力端子
VSTF リセット信号
VW 観者
WD1 幅
WR1、WR2 配線
Claims (20)
- 基板と、
前記基板に設けられた複数の画素と、
前記複数の画素に供給される走査信号を出力する第1回路と、
前記複数の画素と前記第1回路とを接続する複数の走査線と、
を有し、
前記基板は、
前記基板の第1領域と、
前記基板の前記第1領域の第1方向における第1の側の第1側部に沿って配置された領域である第2領域と、
を含み、
前記複数の画素は、前記第1領域に設けられ、
前記第1回路は、前記第2領域に設けられ、
前記複数の走査線は、前記第1領域に設けられ、平面視において、前記第1方向にそれぞれ延在し、
前記第1回路は、前記複数の走査線の各々の前記第1方向における前記第1の側の第1端部とそれぞれ接続された複数の回路部を含み、
前記複数の回路部のうち第1回路部は、前記複数の走査線のうち第1走査線と電気的に接続され、
前記複数の回路部のうち第2回路部は、前記複数の走査線のうち前記第1走査線に対して前記第1方向とは異なる第2方向における第2の側に配置された第2走査線と電気的に接続され、
前記第1回路部の形状は、前記第2回路部の形状と異なる、表示装置。 - 請求項1記載の表示装置において、
前記第1回路部の前記第1方向における長さは、前記第2回路部の前記第1方向における長さと異なる、表示装置。 - 請求項1又は2に記載の表示装置において、
前記第1回路部の前記第2方向における長さは、前記第2回路部の前記第2方向における長さと異なる、表示装置。 - 請求項1乃至3の何れかに記載の表示装置において、
前記第1回路部の前記第1方向における長さに対する、前記第1回路部の前記第2方向における長さの比は、前記第2回路部の前記第1方向における長さに対する、前記第2回路部の前記第2方向における長さの比と異なる、表示装置。 - 請求項1乃至4の何れかに記載の表示装置において、
前記第1走査線の長さは、前記第2走査線の長さと異なる、表示装置。 - 請求項1乃至5の何れかに記載の表示装置において、
前記複数の画素に供給される映像信号が入力される第2回路と、
前記複数の画素と前記第2回路とを接続する複数の映像線と、
を有し、
前記基板は、前記基板の領域であって、前記第1領域に対して、前記第2方向における前記第2の側に配置された領域である第3領域を含み、
前記第2回路は、前記第3領域に設けられ、
前記複数の映像線は、前記第1領域に設けられ、平面視において、前記第2方向にそれぞれ延在し、かつ、前記第1方向に配列され、
前記第1領域の前記第1側部は、前記第2方向における前記第2の側と反対側ほど、前記第1方向における前記第1の側に位置する形状を有する、表示装置。 - 請求項6記載の表示装置において、
前記第1走査線の長さは、前記第2走査線の長さよりも長く、
前記第1回路部の前記第1方向における長さに対する、前記第1回路部の前記第2方向における長さの比は、前記第2回路部の前記第1方向における長さに対する、前記第2回路部の前記第2方向における長さの比よりも小さい、表示装置。 - 請求項6記載の表示装置において、
前記複数の映像線の各々の前記第2方向における前記第2の側の第2端部とそれぞれ接続された複数の映像信号接続配線を有し、
前記第2回路は、前記複数の映像信号接続配線の各々を介して、前記複数の映像線の各々の前記第2端部と接続され、
前記複数の映像線のうち第1映像線は、平面視において、前記第1側部と重なり、
前記複数の映像信号接続配線のうち第1映像信号接続配線は、前記第1映像線と接続され、
前記第1映像信号接続配線は、前記第2領域に設けられている、表示装置。 - 請求項6記載の表示装置において、
前記基板は、前記基板の領域であって、前記第1領域に対して、前記第2方向における前記第2の側と反対側に配置された領域である第4領域を含み、
前記複数の回路部のうち、前記複数の走査線の配列の前記第2方向における前記第2の側と反対側の第3端部に配置された第3走査線と接続された第3回路部は、前記第4領域に設けられている、表示装置。 - 請求項1記載の表示装置において、
前記第1回路は、前記複数の走査線の各々の前記第1端部とそれぞれ接続された複数の走査信号接続配線を含み、
前記複数の回路部は、前記複数の走査信号接続配線の各々を介して、前記複数の走査線の各々の前記第1端部とそれぞれ接続され、
前記複数の走査信号接続配線のうち第1走査信号接続配線は、前記第1走査線と接続され、
前記複数の走査信号接続配線のうち第2走査信号接続配線は、前記第2走査線と接続され、
前記第1走査信号接続配線は、第3方向に延在する第1延在部を含み、
前記第2走査信号接続配線は、前記第3方向と異なる第4方向に延在する第2延在部を含む、表示装置。 - 基板と、
前記基板に設けられた複数の画素と、
前記複数の画素に供給される走査信号を出力する第1回路と、
前記複数の画素と前記第1回路とを接続する複数の走査線と、
を有し、
前記基板は、
前記基板の第1領域と、
前記基板の前記第1領域の第1方向における第1の側の第1側部に沿って配置された領域である第2領域と、
を含み、
前記複数の画素は、前記第1領域に設けられ、
前記第1回路は、前記第2領域に設けられ、
前記複数の走査線は、前記第1領域に設けられ、平面視において、前記第1方向にそれぞれ延在し、
前記第1回路は、
前記複数の走査線の各々の前記第1方向における前記第1の側の第1端部とそれぞれ接続された複数の走査信号接続配線と、
前記複数の走査信号接続配線の各々を介して、前記複数の走査線の各々の前記第1端部とそれぞれ接続された複数の回路部と、
を含み、
前記複数の走査信号接続配線のうち第1走査信号接続配線は、前記複数の走査線のうち第1走査線と接続され、
前記複数の走査信号接続配線のうち第2走査信号接続配線は、前記複数の走査線のうち前記第1走査線に対して前記第1方向とは異なる第2方向における第2の側に配置された第2走査線と接続され、
前記第1走査信号接続配線は、第3方向に延在する第1延在部を含み、
前記第2走査信号接続配線は、前記第3方向と異なる第4方向に延在する第2延在部を含む、表示装置。 - 請求項11記載の表示装置において、
前記複数の画素に供給される映像信号が入力される第2回路と、
前記複数の画素と前記第2回路とを接続する複数の映像線と、
を有し、
前記基板は、前記基板の領域であって、前記第1領域に対して、前記第2方向における前記第2の側に配置された第3領域を含み、
前記第2回路は、前記第3領域に設けられ、
前記複数の映像線は、前記第1領域に設けられ、平面視において、前記第2方向にそれぞれ延在し、かつ、前記第1方向に配列され、
前記第1領域の前記第1側部は、前記第2方向における前記第2の側と反対側ほど、前記第1方向における前記第1の側に位置する形状を有する、表示装置。 - 請求項11又は12記載の表示装置において、
前記第3方向が前記第1方向となす角度は、前記第4方向が前記第1方向となす角度よりも大きい、表示装置。 - 請求項12記載の表示装置において、
前記複数の映像線の各々の前記第2方向における前記第2の側の第2端部とそれぞれ接続された複数の映像信号接続配線を有し、
前記第2回路は、前記複数の映像信号接続配線の各々を介して、前記複数の映像線の各々の前記第2端部と接続され、
前記複数の映像線のうち第1映像線は、平面視において、前記第1側部と重なり、
前記複数の映像信号接続配線のうち第1映像信号接続配線は、前記第1映像線と接続され、
前記第1映像信号接続配線は、前記第2領域に設けられている、表示装置。 - 表示領域と、前記表示領域の外側に設けられた周辺領域とを有する基板と、
前記表示領域に設けられた複数の走査線と複数の映像線と、
前記周辺領域に設けられた、複数の走査線に走査信号を供給するシフトレジスタと、前記複数の走査線と前記シフトレジスタとを接続する複数の走査線接続配線と、を有する表示装置であって、
前記複数の映像線と接続された複数の映像線接続配線と前記走査線接続配線とが、前記周辺領域において交差しており、
前記シフトレジスタのうちの第1回路部は、前記複数の走査線接続配線のうち第1走査線接続配線と接続され、
前記シフトレジスタのうちの第2回路部は、前記複数の走査線接続配線のうち前記第1走査線接続配線とは異なる第2走査線接続配線と接続され、
前記第1回路部の形状は、前記第2回路部の形状と異なる、表示装置。 - 請求項15記載の表示装置において、
前記複数の走査線のうち第1走査線の長さは、前記複数の走査線のうち第2走査線の長さと異なる、表示装置。 - 請求項16記載の表示装置において、
前記表示領域は、矩形ではない形状を有している、表示装置。 - 請求項15乃至17の何れかに記載の表示装置において、
前記周辺領域には、前記シフトレジスタに対してクロックを供給する信号線が設けられており、
前記第1回路部と前記第2回路部とは、前記信号線に接続されており、
前記第1回路部と前記第2回路部とは、前記信号線と前記表示領域との間に設けられている、表示装置。 - 請求項15乃至18の何れかに記載の表示装置において、
前記第1回路部の第1方向における長さに対する、前記第1回路部の第2方向における長さの比は、前記第2回路部の前記第1方向における長さに対する、前記第2回路部の前記第2方向における長さの比と異なる、表示装置。 - 請求項15乃至19の何れかに記載の表示装置において、
前記複数の走査線の延在方向と前記第1走査線接続配線とがなす角度と、前記複数の走査線の延在方向と前記第2走査線接続配線とがなす角度とが異なる、表示装置。
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