JP2015126070A - 半導体装置 - Google Patents
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Abstract
【解決手段】ゲート電極20、第1ソース電極161、ボディ電極171のそれぞれは、上下左右の4つの直線部と、4隅の円弧部で構成される。LDMOSとJFETが設けられる領域Aは、図1における右下隅の円弧部に設けられている。一方、パワーLDMOSは、上下左右の4つの直線部と3つの円弧部で形成される。パワーLDMOSを構成するゲート電極20、第1ソース電極161、ボディ電極171は、点線で囲まれた領域Aで分断されている。この構成においては、オン抵抗が高くなる右下隅の円弧部がパワーLDMOSの一部とされないために、パワーLDMOSのオン抵抗を低くすることができる。
【選択図】図1
Description
本発明の半導体装置は、第1導電型の第1半導体層と、平面視における中央部がドレイン領域として機能し前記第1半導体層の上に形成された前記第1導電型と逆の第2導電型の第2半導体層と、平面視において前記ドレイン領域を中心とした外側において前記ドレイン領域を囲むように前記第2半導体層の表面側に形成された、前記第1導電型のボディ領域と、平面視において前記ボディ領域中で前記ドレイン領域の外側で、複数の直線部と前記直線部間を繋ぐ円弧部で構成された形状を具備し、前記ボディ領域の表面側に形成された前記第2導電型の第1ソース領域と、平面視において前記ボディ領域の外側において前記ボディ領域を囲み、かつ前記第1半導体層の表面から前記第1半導体層に達する深さまで形成された前記第1導電型の素子分離領域と、少なくとも前記第1ソース領域よりも前記ドレイン領域に近い側における前記ボディ領域の表面をゲート酸化膜を介して形成されたゲート電極と、を具備する半導体装置であって、前記ドレイン領域の周りにおける前記円弧部の少なくとも一つに対応した領域において、前記ゲート電極、前記ボディ領域は、前記円弧部と隣接する前記直線部に対応する領域の前記ゲート電極、前記ボディ領域とそれぞれ分離され、前記円弧部と隣接する前記直線部における前記ゲート電極、前記ボディ領域、前記第1ソース領域を用いて第1の素子が形成され、前記円弧部において分離された前記ゲート電極、前記ボディ領域、前記第1ソース領域を用いて第2の素子が形成されたことを特徴とする。
本発明の半導体装置において、前記第2の素子は前記第1の素子の起動用に用いられることを特徴とする。
本発明の半導体装置は、前記第1の素子と前記第2の素子において、前記ドレイン領域が共通に用いられることを特徴とする。
本発明の半導体装置は、前記ドレイン領域の周りにおける前記円弧部に対応した領域において、前記ドレイン領域の中心からみた前記ドレイン領域と前記第1ソース領域との間の間隔が、前記円弧部と隣接する2つの前記直線部に近い側で小さく、前記円弧部と隣接する2つの前記直線部の中間となる側で大きくなるように、前記第1ソース領域における円弧部の曲率が設定されたことを特徴とする。
12 エピタキシャル層(第2半導体層)
13 素子分離領域
14 ドレイン引出領域(ドレイン領域)
15 ボディ領域
16 第1ソース領域
17 ボディ引出領域
18 フィールド酸化膜
19 ゲート酸化膜
20 ゲート電極
21 チャネルn層
23 第2ソース引出領域(第2ソース領域)
51 LDMOS
52 JFET
53 パワーLDMOS
141 ドレイン電極
161 第1ソース電極
171 ボディ電極
211 絶縁膜
231 第2ソース引出電極
Claims (4)
- 第1導電型の第1半導体層と、
平面視における中央部がドレイン領域として機能し前記第1半導体層の上に形成された前記第1導電型と逆の第2導電型の第2半導体層と、
平面視において前記ドレイン領域を中心とした外側において前記ドレイン領域を囲むように前記第2半導体層の表面側に形成された、前記第1導電型のボディ領域と、
平面視において前記ボディ領域中で前記ドレイン領域の外側で、複数の直線部と前記直線部間を繋ぐ円弧部で構成された形状を具備し、前記ボディ領域の表面側に形成された前記第2導電型の第1ソース領域と、
平面視において前記ボディ領域の外側において前記ボディ領域を囲み、かつ前記第1半導体層の表面から前記第1半導体層に達する深さまで形成された前記第1導電型の素子分離領域と、
少なくとも前記第1ソース領域よりも前記ドレイン領域に近い側における前記ボディ領域の表面をゲート酸化膜を介して形成されたゲート電極と、
を具備する半導体装置であって、
前記ドレイン領域の周りにおける前記円弧部の少なくとも一つに対応した領域において、
前記ゲート電極、前記ボディ領域は、前記円弧部と隣接する前記直線部に対応する領域の前記ゲート電極、前記ボディ領域とそれぞれ分離され、
前記円弧部と隣接する前記直線部における前記ゲート電極、前記ボディ領域、前記第1ソース領域を用いて第1の素子が形成され、
前記円弧部において分離された前記ゲート電極、前記ボディ領域、前記第1ソース領域を用いて第2の素子が形成されたことを特徴とする半導体装置。 - 前記第2の素子は前記第1の素子の起動用に用いられることを特徴とする請求項1に記載の半導体装置。
- 前記第1の素子と前記第2の素子において、前記ドレイン領域が共通に用いられることを特徴とする請求項1又は2に記載の半導体装置。
- 前記ドレイン領域の周りにおける前記円弧部に対応した領域において、
前記ドレイン領域の中心からみた前記ドレイン領域と前記第1ソース領域との間の間隔が、前記円弧部と隣接する2つの前記直線部に近い側で小さく、前記円弧部と隣接する2つの前記直線部の中間となる側で大きくなるように、前記第1ソース領域における円弧部の曲率が設定されたことを特徴とする請求項1から請求項3までのいずれか1項に記載の半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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JP6233012B2 JP6233012B2 (ja) | 2017-11-22 |
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