JP2012165320A - Snr改善回路、同期情報検出回路、通信装置、snr改善方法、および、同期情報検出方法 - Google Patents
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Abstract
【解決手段】入力信号のSNRを改善するSNR改善回路4は、上記入力信号を遅延させて1つ以上の遅延信号を生成する遅延部50と、上記1つ以上の遅延信号と遅延前の上記入力信号とを加算する加算部60とを含んでいる。上記入力信号は、同じ信号が所定周期で所定回数繰り返された周期信号を含んでいる。遅延部50は、上記所定周期のα倍(αは自然数であり、2つ以上の遅延信号に対しては異なる値に設定される)の遅延時間で以て上記1つ以上の遅延信号を生成する。
【選択図】図3
Description
<通信装置の概略>
図1に、第1の実施の形態に係る通信装置1を概説するブロック図を示す。ここでは、通信装置1がOFDMに準拠した無線通信装置である場合を例示するが、この例に限定されるものではない。
図2に、通信装置1で受信するパケットの構成の概略を示す。なお、図2のパケット構成はIEEE802.15.4gに準拠している。図2に示すパケット10は、同期ヘッダー11と、同期ヘッダー11に続くPHY(物理層)ヘッダー12と、PHYヘッダー12に続くPHYペイロード13とを含んでいる。
図3に、タイミング検出処理回路3の構成例を示す。図3にはSNR改善回路4の構成例も示しており、これについては後述する。
SNR改善回路4は、図3の例では、遅延部50と、加算部60とを有している。
一般に、ある信号と、その信号を遅延させた信号とを加算した信号は、マルチパスで伝送された受信信号に似ている。このため、上記のSNR改善回路4の出力はマルチパスと同様の影響が生じる可能性がある。例えば、周波数シフト(換言すれば周波数誤差)が無い、あるいは小さい場合にはマルチパスの影響は無視できるが、そうでない場合は深いフェージングが生じる。
第3の実施の形態では、SNR改善回路の遅延部の他の構成例を説明する。図8に、第3の実施の形態に係るSNR改善回路4Dを例示する。SNR改善回路4Dは上記SNR改善回路4B(図6参照)に対応する。
上記ではSNR改善回路4,4B〜4Dが通信装置1に用いられる場合を例示したが、SNR改善回路4,4B〜4Dの適用はこれに限定されるものではない。具体的には、SNR改善回路4,4B〜4Dは、通信パケット10に限らず、同じ信号が所定周期で所定回数繰り返された周期信号を含んだ信号に対して有用である。
2 同期タイミング検出回路(同期情報検出回路)
3 タイミング検出処理回路(同期情報検出処理回路)
4,4B〜4D SNR改善回路
10 パケット
11 同期ヘッダー
14 STF(周期信号)
16 固定パターン信号
50,50D 遅延部
51〜54 遅延回路
60 加算部
70 振幅調整部
z 周期
Claims (9)
- 入力信号のSNRを改善するSNR改善回路であって、
前記入力信号を遅延させて1つ以上の遅延信号を生成する遅延部と、
前記1つ以上の遅延信号と遅延前の前記入力信号とを加算する加算部と
を備え、
前記入力信号は、同じ信号が所定周期で所定回数繰り返された周期信号を含んでおり、
前記遅延部は、前記所定周期のα倍(αは自然数であり、2つ以上の遅延信号に対しては異なる値に設定される)の遅延時間で以て前記1つ以上の遅延信号を生成する、
SNR改善回路。 - 請求項1に記載のSNR改善回路であって、
遅延前の前記入力信号と前記1つ以上の遅延信号とのうちの少なくとも1つの信号に対して振幅をβ倍(βは正数であり、複数の信号に対してはそれぞれ値が設定される)にする振幅調整部
をさらに備え、
前記加算部は、前記少なくとも1つの信号については前記振幅調整部で振幅が前記β倍にされた後の信号を用いて加算を行い、
前記βは、前記振幅調整部を備えない構成に比べて前記加算部での加算結果におけるフェージングを軽減可能な値に設定されている、
SNR改善回路。 - 請求項1または請求項2に記載のSNR改善回路であって、
前記1つ以上の遅延信号は、前記α=1の遅延信号と、前記α=2の遅延信号である、
SNR改善回路。 - 請求項2を引用する請求項3に記載のSNR改善回路であって、
前記振幅調整部で処理される前記少なくとも1つの信号は、前記α=1の前記遅延信号であり、
前記α=1の前記遅延信号に対して前記β=4に設定されている、
SNR改善回路。 - 請求項1ないし請求項4のうちのいずれか1項に記載のSNR改善回路と、
前記SNR改善回路の前記加算部による加算結果から、前記入力信号に対する同期情報を検出する処理を行う同期情報検出処理回路と
を備える、同期情報検出回路。 - 同じ信号が所定周期で所定回数繰り返された周期信号を同期ヘッダー中に有するパケットを用いて通信を行う通信装置であって、
請求項5に記載の同期情報検出回路を備え、
前記同期情報検出回路内の前記SNR改善回路は、前記パケットを含んだ受信信号を前記入力信号として動作し、
前記同期情報検出回路内の前記同期情報検出処理回路は、前記SNR改善回路からの出力信号に対して前記同期情報の検出処理を行うことにより、前記同期情報の検出タイミングに同期して前記パケットの同期タイミング信号を出力する、
通信装置。 - 入力信号のSNRを改善するSNR改善方法であって、
前記入力信号を遅延させて1つ以上の遅延信号を生成する遅延処理と、
前記1つ以上の遅延信号と遅延前の前記入力信号とを加算する加算処理と
を備え、
前記入力信号は、同じ信号が所定周期で所定回数繰り返された周期信号を含んでおり、
前記遅延処理では、前記所定周期のα倍(αは自然数であり、2つ以上の遅延信号に対しては異なる値に設定される)の遅延時間で以て前記1つ以上の遅延信号を生成する、
SNR改善方法。 - 請求項7に記載のSNR改善方法であって、
遅延前の前記入力信号と前記1つ以上の遅延信号とのうちの少なくとも1つの信号に対して振幅をβ倍(βは正数であり、複数の信号に対してはそれぞれ値が設定される)にする振幅調整処理
をさらに備え、
前記加算処理では、前記少なくとも1つの信号については前記振幅調整処理で振幅が前記β倍にされた後の信号を用いて加算を行い、
前記βを、前記振幅調整処理を行わない場合に比べて前記加算処理での加算結果におけるフェージングを軽減可能な値に設定する、
SNR改善方法。 - 請求項7または請求項8に記載のSNR改善方法の各処理と、
前記SNR改善方法の前記加算処理による加算結果から、前記入力信号に対する同期情報を検出する処理を行う同期情報検出処理と
を備える、同期情報検出方法。
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