JP2008109174A - 相関値生成方法及び相関器 - Google Patents
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Abstract
【解決手段】相関器20における相関値生成方法では、受信信号S19を入力し、遅延回路21−1〜21−5、掛け算回路22−1〜22−3、及び積分回路23−1〜23−3により、時間位置がずれた3つの相関値を求め、この3つの相関値を加算回路24で加算して1つの相関値として出力する。これにより、主到来波となるパスと同等の受信電力をもつ長遅延パスが存在する場合において、主到来パスと長遅延パスの中間位置に強い相関が現れることで、時間同期のふらつきを抑えることが可能となる。
【選択図】図1
Description
図8〜図10は、従来の相関器10を説明するための図である。そのうち、図8は、図7の相関窓と受信信号の関係を示す図、図9は、主到来パス(S2)のみ1パス受信時における図7の相関出力信号S10の例を示す図、及び、図10は、等電力の主到来パス(S2)と長遅延パス(受信信号Sinが反射等して長時間遅延した信号S2−1)との2パス受信時における図7の相関出力信号S10の例を示す図である。
図1は、本発明の実施例1を示すFFT時間同期用の相関器の概略の構成図である。
このFFT時間同期用の相関器20は、例えば、従来の図7の復調装置中の相関器10に対応する箇所に設けられ、図7のデジタルベースバンド信号S2に相当する受信信号S19を遅延して時間位置の異なる複数の相関値を算出する相関値算出手段と、その複数の相関値を加算してFFT時間同期用の相関出力信号S24を出力する加算手段(例えば、加算回路)24とを有している。前記相関値算出手段は、受信信号S19を遅延する遅延手段(例えば、シフトレジスタ等で構成された遅延回路)21−1〜21−5と、この遅延回路21−1〜21−5における遅延前の受信信号と遅延後の受信信号とを掛け算する掛け算手段(例えば、掛け算回路)22−1〜22−3と、この掛け算回路22−1〜22−3の掛け算結果を積分して同一の遅延時間間隔となる複数の相関値を求める積分手段(例えば、積分回路)23−1〜23−3とにより構成されている。
本実施例1の相関器20における相関値生成方法では、受信信号S19が入力されると、この受信信号S19が、遅延回路21−1,21−2,21−5により順に遅延され、更に、受信信号S19が遅延回路21−3で遅延されると共に、遅延回路21−1の出力信号が遅延回路21−4で遅延される。受信信号S19と遅延回路21−3の出力信号とが掛け算回路22−1で掛け算され、遅延回路21−1の出力信号と遅延回路21−4の出力信号とが掛け算回路22−2で掛け算され、更に、掛け算回路21−2の出力信号と掛け算回路21−5の出力信号とが掛け算回路22−3で掛け算される。
本実施例1によれば、次の(1)、(2)のような効果がある。
図3は、本発明の実施例2を示すFFT時間同期用の相関器の概略の構成図であり、実施例1を示す図1中の要素と共通の要素には共通の符号が付されている。
本実施例2の相関器20Aにおける相関値生成方法では、受信信号S19が入力されると、この受信信号S19が、遅延回路21−1〜21−5により順に遅延され、これらの各入出力信号が、実施例1と同様に、掛け算回路22−1〜22−3により掛け算され、この各掛け算結果が積分回路23−1〜23−3により積分されて3つの相関値が求められた後、加算回路24で加算されて1つの相関値となり、相関出力信号S24として出力される。
本実施例2によれば、実施例1に比べて遅延回路の回路規模を削減でき、しかも、実施例1の効果(1)、(2)と同様の効果がある。
図4は、本発明の実施例3を示すFFT時間同期用の相関器の概略の構成図であり、実施例1を示す図1中の要素と共通の要素には共通の符号が付されている。
本実施例3の相関器20Bでは、実施例1の遅延回路21−1〜21−5をメモリ26等に置き換えたものであるが、相関値生成方法は実施例1とほぼ同様に実行される。
本実施例3によれば、実施例1の効果(1)、(2)と同様の効果がある他に、更に、次のような効果がある。
図5は、本発明の実施例4を示すFFT時間同期用の相関器の概略の構成図であり、実施例3を示す図4中の要素と共通の要素には共通の符号が付されている。
本実施例4の相関器20Cにおける相関値生成方法は、実施例3とほぼ同様に実行される。実施例3と異なる動作は、積分回路23−1〜23−3により求められた遅延した3つの相関値のうちの、積分回路23−1,23−3により求められた2つの相関値に対して、利得回路28−1,28−3により重み付けをすることである。利得回路28−1,28−3により掛け合わせる定数を変えることにより、遅延波による最大相関時間位置のふらつき度合いを変え、最もふらつきの少ない相関結果に変更することが可能となる。
本実施例4によれば、実施例1の効果(1)、(2)、及び実施例3の効果(3)と同様の効果がある他に、更に、次のような効果がある。
本発明は、上記実施例1〜4に限定されず、種々の利用形態や変形が可能である。この利用形態や変形例としては、例えば、次のようなものがある。
4 FFT部
20,20A,20B,20C 相関器
21−1〜21−5 遅延回路
22−1〜22−3 掛け算回路
23−1〜23−3 積分回路
24 加算回路
25 アドレスデコーダ
26 メモリ
27 セレクタ
28−1,28−3 利得回路
Claims (12)
- OFDM変調されて有効シンボルにガードインターバルが付加された受信信号を遅延して、時間位置の異なる複数の相関値を求め、前記複数の相関値を加算して、FFT時間同期用の相関出力信号を生成することを特徴とする相関値生成方法。
- 前記複数の相関値を重み付けして加算することを特徴とする請求項1記載の相関値生成方法。
- 前記複数の相関値は、3つであることを特徴とする請求項1又は2記載の相関値生成方法。
- OFDM変調されて有効シンボルにガードインターバルが付加された受信信号を遅延して、時間位置の異なる複数の相関値を算出する相関値算出手段と、
前記相関値算出手段で算出された前記複数の相関値を加算して、FFT時間同期用の相関出力信号を出力する加算手段と、
を有することを特徴とする相関器。 - 請求項4記載の相関器は、更に、
前記相関値算出手段で算出された前記複数の相関値を重み付けして前記加算手段に加算させる重み付け手段を有することを特徴とする相関器。 - 前記相関値算出手段は、
前記受信信号を遅延する遅延手段と、
前記遅延手段における遅延前の受信信号と遅延後の受信信号とを掛け算する掛け算手段と、
前記掛け算手段の掛け算結果を積分して同一の遅延時間間隔となる前記複数の相関値を求める積分手段と、
により構成されていることを特徴とする請求項4又は5記載の相関器。 - 前記遅延手段は、複数の遅延回路により構成されていることを特徴とする請求項6記載の相関器。
- 前記遅延手段は、前記受信信号を格納し所望の遅延時間分遅延させて出力させるメモリを有することを特徴とする請求項6記載の相関器。
- 前記遅延手段は、
前記受信信号を格納し所望の遅延時間分遅延させて出力させるメモリと、
アドレス生成の値を変更することによって前記メモリから出力される遅延時間間隔を調整可能なアドレスデコーダと、
を有することを特徴とする請求項6記載の相関器。 - 前記重み付け手段は、定数を掛ける利得回路により構成されていることを特徴とする請求項5〜9のいずれか1項に記載の相関器。
- 前記複数の相関値は、3つであることを特徴とする5〜10のいずれか1項に記載の相関器。
- 前記重み付け手段は、
前記3つの相関値のうち、時間的中心を除く2つの相関値に定数を掛ける2つの利得回路により構成されていることを特徴とする請求項11記載の相関器。
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