JP2011103129A - データ転送制御装置およびデータ転送方法 - Google Patents
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Abstract
【解決手段】レジスタSREG1,SREG2およびEREG1,EREG2において主メモリの開始アドレスと終了アドレスの組を2組用意する。セレクタSEL1,SEL2は、主メモリの記憶領域Aの開始アドレスA、終了アドレスAと記憶領域Bの開始アドレスB、終了アドレスBとの間を切り換える。アドレスカウンターAC1は一方の組の開始アドレスを起点として順次増分した宛先アドレスを生成してアービタ45に出力し、アービタ45はメモリコントロール回路を制御して主メモリの当該宛先アドレスに対してDMA転送を実行する。CPU17にかかる負荷が軽減し、DMA転送速度が向上する。
【選択図】図3
Description
図2は、本発明の実施の形態1に係るDMAコントローラ(データ転送制御装置)24の構成を示すブロック図である。DMAコントローラ24は、DMAチャンネルCH0,CH1、アービタ(調停回路)45およびメモリコントロール回路MC1を備えており、アービタ45とメモリコントロール回路MC1はメインバス10に接続されている。また図2において内部モジュールML0,ML1は上記RPU14やディスプレイモジュール20などの何れかである。内部モジュールの個数は2個に限らず3個以上でもよい。
次に、図5は、本発明の実施の形態2に係るDMAコントローラ(データ転送制御装置)24のDMAチャンネルCHnの回路構成を示す図、図6および図7は、このDMAコントローラによる転送処理を説明する図である。図5において、図3に示した符号と同一符号を付した記号およびブロックについては略同一機能を有するものとして詳細な説明を省略する。
次に、図8は本発明の実施の形態3に係るDMAコントローラ(データ転送制御装置)24の回路構成を示す概略図、図9および図10は、このDMAコントローラによる転送処理を説明する図である。図8において、図3,図4に示した符号と同一符号を付した記号およびブロックについては略同一機能を有するものとして詳細な説明を省略する。
SREG1,SREG2 レジスタ
EREG1,EREG2 レジスタ
OREG1,OREG2,CREG1 レジスタ
LEREG1,LEREG2 レジスタ
AD1,AD2 加算器
SEL1〜SEL4 セレクタ
AC1 アドレスカウンター
MC1 メモリコントロール回路
CMP1〜CMP3 比較器
LC1,LC2 ローカルカウンター
CHn DMAチャンネル
Claims (12)
- 撮像センサから出力された画像信号を格納する主メモリと内部モジュール間のバスを介したデータ転送を制御するデータ転送制御装置であって、
前記主メモリにおける複数の記憶領域の各々の開始アドレスと終了アドレスの組を複数格納するレジスタと、
前記複数の組の中から1組の開始アドレスと終了アドレスを選択する選択回路と、
前記選択回路から出力された開始アドレスを起点とし、当該開始アドレスと対をなす終了アドレスに達するまで順次変化する宛先アドレスを生成出力するアドレスカウンターと、
前記主メモリを制御し且つ前記バスを獲得して当該宛先アドレスに対応する前記主メモリの記憶領域と前記内部モジュール間でデータ転送を実行させるメモリコントロール回路と、
前記アドレスカウンターで生成された宛先アドレスが前記終了アドレスと一致した時点で、前記複数の組の中から次の1組の開始アドレスと終了アドレスを選択するように前記選択回路を制御するアドレス切換手段と、
を備えることを特徴とするデータ転送制御装置。 - 請求項1記載のデータ転送制御装置であって、前記アドレス切換手段は、前記開始アドレスと終了アドレスの組をサイクリック(循環的)に切り換える、データ転送制御装置。
- 請求項1または2記載のデータ転送制御装置であって、
前記アドレスカウンターにおける前記宛先アドレスの変化と同期して計数した計数値を算出する計数回路と、
前記計数回路から出力された計数値が所定値に達するまでは零値を選択し、当該計数値が前記所定値に達した時点でオフセット値を選択する第2の選択回路と、
前記第2の選択回路から出力された前記オフセット値または前記零値と前記アドレスカウンターから出力された宛先アドレスとを加減算した加減算値を前記アドレスカウンターに出力する加減算回路と、を更に備え、
前記計数回路は当該計数値が前記所定値に達した時点で当該計数値をリセットし、前記アドレスカウンターは前記加減算値を起点として順次変化する宛先アドレスを生成出力する、データ転送制御装置。 - 請求項3記載のデータ転送制御装置であって、
前記アドレスカウンターにおける宛先アドレスの変化と同期して計数した計数値を算出する第2の計数回路と、
前記第2の計数回路から出力された計数値が所定値に達するまでは零値を選択し、当該計数値が前記所定値に達した時点で第2のオフセット値を選択する第3の選択回路と、
前記第3の選択回路から出力された前記第2のオフセット値または前記零値と請求項3記載の前記加減算回路から出力された前記加減算値とを加減算して前記アドレスカウンターに出力する第2の加減算回路と、
を更に備え、
前記第2の計数回路は当該計数値が前記所定値に達した時点で当該計数値をリセットし、前記アドレスカウンターは前記第2の加減算回路から出力された加減算値を起点として順次変化する宛先アドレスを生成する、データ転送制御装置。 - 撮像センサから出力された画像信号を格納する主メモリと内部モジュールとの間でバスを介したデータ転送を制御するデータ転送制御装置であって、
前記主メモリの記憶領域の所定のアドレスを起点として順次変化する宛先アドレスを生成出力するアドレスカウンターと、
前記アドレスカウンターにおける前記宛先アドレスの変化と同期して計数した計数値を算出する計数回路と、
前記計数回路から出力された計数値が所定値に達するまでは零値を選択し、当該計数値が前記所定値に達した時点でオフセット値を選択する選択回路と、
前記選択回路から出力された前記オフセット値または前記零値と前記アドレスカウンターから出力された宛先アドレスとを加減算した加減算値を前記アドレスカウンターに出力する加減算回路と、
前記主メモリを制御し且つ前記バスを獲得して当該宛先アドレスに対応する前記主メモリの記憶領域と前記内部モジュールとの間でデータ転送を実行させるメモリコントロール回路と、
を備え、
前記計数回路は当該計数値が前記所定値に達した時点で当該計数値をリセットし、前記アドレスカウンターは前記加減算値を起点として順次変化する宛先アドレスを生成する、データ転送制御装置。 - 請求項5記載のデータ転送制御装置であって、
前記アドレスカウンターにおける宛先アドレスの変化と同期して所定値に達するまで計数した計数値を算出する第2の計数回路と、
前記第2の計数回路から出力された計数値が所定値に達するまでは零値を選択し、当該計数値が前記所定値に達した時点で第2のオフセット値を選択する第3の選択回路と、
前記第3の選択回路から出力された前記第2のオフセット値または前記零値と請求項5記載の前記加減算回路から出力された前記加減算値とを加減算して前記アドレスカウンターに出力する第2の加減算回路と、
を更に備え、
前記第2の計数回路は当該計数値が前記所定値に達した時点で当該計数値をリセットし、前記アドレスカウンターは前記第2の加減算回路から出力された加減算値を起点として順次変化する宛先アドレスを生成する、データ転送制御装置。 - 撮像センサから出力された画像信号を格納する主メモリと内部モジュールとの間でバスを介してデータ転送を行うデータ転送方法であって、
(a)前記主メモリにおける複数の記憶領域の各々の開始アドレスと終了アドレスの組を複数記憶する工程と、
(b)前記工程(a)で記憶した複数の組の中から1組の開始アドレスと終了アドレスを選択する工程と、
(c)前記工程(b)で選択した開始アドレスを起点とし、当該開始アドレスと対をなす終了アドレスに達するまで順次変化する宛先アドレスを生成する工程と、
(d)前記主メモリを制御し且つ前記バスを獲得して前記宛先アドレスに対応する前記主メモリの記憶領域と前記内部モジュールとの間でデータ転送を実行する工程と、
(e)前記工程(c)で生成された宛先アドレスが前記終了アドレスと一致した時点で、前記工程(b)において前記複数の組の中から次の1組の開始アドレスと終了アドレスを選択し、前記工程(c)および(d)を実行する工程と、
を備えることを特徴とするデータ転送方法。 - 請求項7記載のデータ転送方法であって、前記工程(e)において、前記次の1組が前記複数の組の中からサイクリック(循環的)に選択される、データ転送方法。
- 請求項7または8記載のデータ転送方法であって、
(f)前記工程(c)で生成される宛先アドレスの変化に同期して計数した計数値を算出する工程と、
(g)前記工程(f)で算出された計数値が所定値に達するまでは零値を選択し、当該計数値が前記所定値に達した時点でオフセット値を選択し且つ前記工程(f)の計数値をリセットする工程と、
(h)前記工程(g)で選択した前記零値または前記オフセット値と前記工程(c)で生成した宛先アドレスとを加減算した加減算値を算出する工程と、
を更に備え、
前記工程(c)において、前記工程(h)で算出された加減算値を起点として順次変化する宛先アドレスを生成する、データ転送方法。 - 請求項9記載のデータ転送方法であって、
(i)前記工程(c)で生成される宛先アドレスの変化に同期して計数した第2の計数値を算出する工程と、
(j)前記工程(i)の第2の計数値が所定値に達するまでは零値を選択し、当該計数値が前記所定値に達した時点で第2のオフセット値を選択し且つ前記工程(i)の第2の計数値をリセットする工程と、
(k)前記工程(j)で選択した前記零値または前記第2のオフセット値と前記工程(h)で算出した加減算値とを加算した加減算値を算出する工程と、
を更に備え、
前記工程(c)において、前記工程(k)で算出された加減算値を起点として順次変化する宛先アドレスを生成する、データ転送方法。 - 撮像センサから出力された画像信号を格納する主メモリと内部モジュールとの間でバスを介してデータ転送を行うデータ転送方法であって、
(c−1)前記主メモリの記憶領域の所定のアドレスを起点として順次変化する宛先アドレスを生成する工程と、
(f−1)前記工程(c−1)で生成される宛先アドレスの変化と同期して計数した計数値を算出する工程と、
(g−1)前記工程(f−1)で算出された計数値が所定値に達するまでは零値を選択し、当該計数値が前記所定値に達した時点でオフセット値を選択し且つ前記工程(f−1)の計数値をリセットする工程と、
(h−1)前記工程(g−1)で選択した前記零値または前記オフセット値と前記工程(c−1)で生成した宛先アドレスとを加減算した加減算値を算出する工程と、
(d−1)前記主メモリを制御し且つ前記バスを獲得して前記宛先アドレスに対応する前記主メモリの記憶領域と前記内部モジュールとの間でデータ転送を実行する工程と、
を備え、
前記工程(c−1)において、前記工程(h−1)で算出された加減算値を起点として順次変化する宛先アドレスを生成することを特徴とするデータ転送方法。 - 請求項11記載のデータ転送方法であって、
(i−1)前記工程(c−1)で生成される宛先アドレスの変化に同期して計数した第2の計数値を算出する工程と、
(j−1)前記工程(i−1)の第2の計数値が所定値に達するまでは零値を選択し、当該計数値が前記所定値に達した時点で第2のオフセット値を選択し且つ前記工程(i−1)の第2の計数値をリセットする工程と、
(k−1)前記工程(j−1)で選択した前記零値または前記第2のオフセット値と前記工程(h−1)で算出した加減算値とを加減算した加減算値を算出する工程と、
を更に備え、
前記工程(c−1)において、前記工程(k−1)で算出された加減算値を起点として順次変化する宛先アドレスを生成する、データ転送方法。
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