JPH05181788A - 特殊形状領域ｄｍａ機構 - Google Patents
特殊形状領域ｄｍａ機構Info
- Publication number
- JPH05181788A JPH05181788A JP34727391A JP34727391A JPH05181788A JP H05181788 A JPH05181788 A JP H05181788A JP 34727391 A JP34727391 A JP 34727391A JP 34727391 A JP34727391 A JP 34727391A JP H05181788 A JPH05181788 A JP H05181788A
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- JP
- Japan
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- register
- address
- counter
- rectangular area
- mask
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Abstract
(57)【要約】
【目的】 ＥＷＳやパーソナルコンピュータで使用され
る汎用高速バスに直結し、特殊形状画像データのＤＭＡ
を高速実行できる機構を得る。 【構成】 ＢＷレジスタ６に格納されたベース矩形領域
の幅は、ＢＡレジスタ１０に格納された相対矩形領域ベ
ースアドレスに、Ｘカウンタ１４がＷレジスタ１２の相
対矩形領域幅をカウントする毎に加算される。同時に、
Ｙカウンタ１５がカウントアップされ、Ｘカウンタ１４
はクリアされる。同様にＭＢＷレジスタ９に格納された
マスク領域幅は、ＭＢＡレジスタ１１に格納されたマス
クベースアドレスに加算され、マスクデータアドレス３
０が発生する。このアドレスにしたがって、形状メモリ
５からマスクデータ１９を得る。ＤＭＡアドレスは、Ｂ
Ａレジスタ１０とＸカウンタ１４の値を加算器で加算し
たもので得られた値が格納されているアクセスアドレス
レジスタ２２をマスクデータ１９によってマスクして与
えられる。ＤＭＡはＹカウンタ１５がＨレジスタ１３値
になると終了する。
る汎用高速バスに直結し、特殊形状画像データのＤＭＡ
を高速実行できる機構を得る。 【構成】 ＢＷレジスタ６に格納されたベース矩形領域
の幅は、ＢＡレジスタ１０に格納された相対矩形領域ベ
ースアドレスに、Ｘカウンタ１４がＷレジスタ１２の相
対矩形領域幅をカウントする毎に加算される。同時に、
Ｙカウンタ１５がカウントアップされ、Ｘカウンタ１４
はクリアされる。同様にＭＢＷレジスタ９に格納された
マスク領域幅は、ＭＢＡレジスタ１１に格納されたマス
クベースアドレスに加算され、マスクデータアドレス３
０が発生する。このアドレスにしたがって、形状メモリ
５からマスクデータ１９を得る。ＤＭＡアドレスは、Ｂ
Ａレジスタ１０とＸカウンタ１４の値を加算器で加算し
たもので得られた値が格納されているアクセスアドレス
レジスタ２２をマスクデータ１９によってマスクして与
えられる。ＤＭＡはＹカウンタ１５がＨレジスタ１３値
になると終了する。
Description
【０００１】
【産業上の利用分野】この発明は、ＥＷＳ（エンジニヤ
リングワークステーション）やパーソナルコンピュータ
などにおいて画像データを扱う場合、これら装置に使用
されている汎用高速バスに直結し、特殊形状画像データ
の転送処理を高速実行するためのＤＭＡ（ダイレクトメ
モリアクセス）機構に関する。
リングワークステーション）やパーソナルコンピュータ
などにおいて画像データを扱う場合、これら装置に使用
されている汎用高速バスに直結し、特殊形状画像データ
の転送処理を高速実行するためのＤＭＡ（ダイレクトメ
モリアクセス）機構に関する。
【０００２】
【従来の技術】従来、ＥＷＳやパーソナルコンピュータ
を使用した画像処理において、これら装置に画像処理装
置を付加する場合、ホストコンピュータの高速汎用バス
に直結する汎用ＤＭＡを使用し、矩形領域のデータとし
てメモリ空間をアクセスするため、連続したメモリ空間
を扱っていた。
を使用した画像処理において、これら装置に画像処理装
置を付加する場合、ホストコンピュータの高速汎用バス
に直結する汎用ＤＭＡを使用し、矩形領域のデータとし
てメモリ空間をアクセスするため、連続したメモリ空間
を扱っていた。
【０００３】
【発明が解決しようとする課題】しかし、従来の汎用Ｄ
ＭＡでは、扱う領域が連続であり、マルチウィンドなど
でウィンド相互で干渉して矩形ではない領域となるよう
な対象にデータを転送したりすることはできないという
課題を有していた。そこで、本発明の目的は、特殊形状
の画像データを効率よく転送可能なＤＭＡを得ることに
ある。
ＭＡでは、扱う領域が連続であり、マルチウィンドなど
でウィンド相互で干渉して矩形ではない領域となるよう
な対象にデータを転送したりすることはできないという
課題を有していた。そこで、本発明の目的は、特殊形状
の画像データを効率よく転送可能なＤＭＡを得ることに
ある。
【０００４】
【課題を解決するための手段】上記課題を解決するた
め、この発明はホストコンピュータ上の汎用高速バスに
直結される装置内のＤＭＡにおいて、アドレス空間に矩
形領域を設定し、その矩形領域内に設定された相対矩形
領域の水平走査に従ったアドレスを発生するために、相
対矩形領域のベースアドレスを設定するレジスタと、ベ
ース矩形領域のサイズを設定するレジスタと、相対矩形
領域のサイズを設定するレジスタと相対矩形領域の水平
走査を行なう水平カウンタ及び垂直カウンタと、これら
カウンタ値とレジスタ値からＤＭＡアドレスを算出する
加算器と、さらにそのメモリアクセスを制限する領域を
記述するマスク画像データを格納するメモリをから成る
構成とし、ＤＭＡによって目的とする特殊形状画像デー
タ領域へのアクセスを可能とする。
め、この発明はホストコンピュータ上の汎用高速バスに
直結される装置内のＤＭＡにおいて、アドレス空間に矩
形領域を設定し、その矩形領域内に設定された相対矩形
領域の水平走査に従ったアドレスを発生するために、相
対矩形領域のベースアドレスを設定するレジスタと、ベ
ース矩形領域のサイズを設定するレジスタと、相対矩形
領域のサイズを設定するレジスタと相対矩形領域の水平
走査を行なう水平カウンタ及び垂直カウンタと、これら
カウンタ値とレジスタ値からＤＭＡアドレスを算出する
加算器と、さらにそのメモリアクセスを制限する領域を
記述するマスク画像データを格納するメモリをから成る
構成とし、ＤＭＡによって目的とする特殊形状画像デー
タ領域へのアクセスを可能とする。
【０００５】
【作用】上記のように構成されたＤＭＡにおいては、ベ
ース矩形領域のサイズとして、ベース矩形領域の幅がＢ
Ｗ（ベースワイズ）レジスタに設定され、相対矩形領域
のベースアドレスはＢＡ（ベースアドレス）レジスタに
設定され、相対矩形領域のサイズは幅がＷレジスタに設
定され、高さがＨレジスタに設定される。ＤＭＡ起動時
には、相対矩形領域の水平走査に従った水平方向のカウ
ントをＸカウンタが行い、Ｗレジスタで指定された幅を
カウントする毎にＸカウンタはクリアされる。同時に、
Ｙカウンタがカウントされ、ＢＡレジスタにはＢＷレジ
スタの値が加算される。アクセスアドレスレジスタの値
はＢＡレジスタとＸカウンタの値を加算器で加算して得
る。これに対して形状メモリに記述されているデータ
を、ＭＢＷ（マスクベースワイズ）レジスタとＭＢＡ
（マスクメモリベースアドレス）レジスタに設定された
マスクメモリの矩形情報とＸカウンタの値に基づいて相
対矩形領域のアドレス発生と同様にしてマスクメモリの
アドレスを発生して得て、アクセスアドレスレジスタ値
をマスクして最終的な発生アドレスを得る。
ース矩形領域のサイズとして、ベース矩形領域の幅がＢ
Ｗ（ベースワイズ）レジスタに設定され、相対矩形領域
のベースアドレスはＢＡ（ベースアドレス）レジスタに
設定され、相対矩形領域のサイズは幅がＷレジスタに設
定され、高さがＨレジスタに設定される。ＤＭＡ起動時
には、相対矩形領域の水平走査に従った水平方向のカウ
ントをＸカウンタが行い、Ｗレジスタで指定された幅を
カウントする毎にＸカウンタはクリアされる。同時に、
Ｙカウンタがカウントされ、ＢＡレジスタにはＢＷレジ
スタの値が加算される。アクセスアドレスレジスタの値
はＢＡレジスタとＸカウンタの値を加算器で加算して得
る。これに対して形状メモリに記述されているデータ
を、ＭＢＷ（マスクベースワイズ）レジスタとＭＢＡ
（マスクメモリベースアドレス）レジスタに設定された
マスクメモリの矩形情報とＸカウンタの値に基づいて相
対矩形領域のアドレス発生と同様にしてマスクメモリの
アドレスを発生して得て、アクセスアドレスレジスタ値
をマスクして最終的な発生アドレスを得る。
【０００６】
【実施例】以下に、この発明の実施例を図面に基づいて
説明する。図１に示すブロック図はＥＷＳ用に実施され
た本発明によるＤＭＡである。特殊形状はＥＷＳのマル
チウィンドに画像データを表示する時に使用するためデ
スティネーションアドレス発生時に参照される。特殊形
状は外付けで最大２５６Ｋバイトの形状メモリ５に１Ｂ
ｉｔ幅で記述される。この形状メモリ５への書き込みは
アドレスとデータがマルチプレックスされている、３２
Ｂｉｔ幅のＥＷＳ内のシステムバス６から行われ、メモ
リ空間は制御ブロック７によってＥＷＳの空間にマップ
されている。マルチプレクサ２９は、このときマスクデ
ータアドレス３０をシステムバス６からのデータとする
か加算器１６からのデータとするかを切り換えるための
ものである。１Ｂｉｔ幅の形状データは形状メモリ５内
で３２Ｂｉｔ幅に図３の様に割り当てられている。
説明する。図１に示すブロック図はＥＷＳ用に実施され
た本発明によるＤＭＡである。特殊形状はＥＷＳのマル
チウィンドに画像データを表示する時に使用するためデ
スティネーションアドレス発生時に参照される。特殊形
状は外付けで最大２５６Ｋバイトの形状メモリ５に１Ｂ
ｉｔ幅で記述される。この形状メモリ５への書き込みは
アドレスとデータがマルチプレックスされている、３２
Ｂｉｔ幅のＥＷＳ内のシステムバス６から行われ、メモ
リ空間は制御ブロック７によってＥＷＳの空間にマップ
されている。マルチプレクサ２９は、このときマスクデ
ータアドレス３０をシステムバス６からのデータとする
か加算器１６からのデータとするかを切り換えるための
ものである。１Ｂｉｔ幅の形状データは形状メモリ５内
で３２Ｂｉｔ幅に図３の様に割り当てられている。
【０００７】ＤＭＡはシステムバス６に対して行われ
る。ベース矩形領域３１の幅ｗはＢＷ（ベースワイズ）
レジスタ８に１６Ｂｉｔ幅で設定される。マスクメモリ
３２の領域幅ｍｗは同様にＭＢＷ（マスクベースワイ
ズ）レジスタ９に１６Ｂｉｔ幅で設定される。また、Ｂ
Ａ（ベースアドレス）レジスタ１０に３２Ｂｉｔ幅で、
相対矩形領域３２の先頭アドレスａが設定される。同様
にＭＢＡ（マスクベースアドレス）レジスタ１１にはマ
スクメモリ３３に設定されるマスク領域のベースアドレ
スｍａが設定される。このベースアドレスはメモリ内で
の相対アドレスで、ＥＷＳにマップされたＥＷＳのアド
レス空間のものではない。
る。ベース矩形領域３１の幅ｗはＢＷ（ベースワイズ）
レジスタ８に１６Ｂｉｔ幅で設定される。マスクメモリ
３２の領域幅ｍｗは同様にＭＢＷ（マスクベースワイ
ズ）レジスタ９に１６Ｂｉｔ幅で設定される。また、Ｂ
Ａ（ベースアドレス）レジスタ１０に３２Ｂｉｔ幅で、
相対矩形領域３２の先頭アドレスａが設定される。同様
にＭＢＡ（マスクベースアドレス）レジスタ１１にはマ
スクメモリ３３に設定されるマスク領域のベースアドレ
スｍａが設定される。このベースアドレスはメモリ内で
の相対アドレスで、ＥＷＳにマップされたＥＷＳのアド
レス空間のものではない。
【０００８】相対矩形領域３２の幅ｒｗはＷ（ワイズ）
レジスタ１２に１６Ｂｉｔ幅で設定される。相対矩形領
域３２の高さｒｈはＨ（ハイト）レジスタ１３に１６Ｂ
ｉｔ幅で設定される。ＤＭＡの起動は制御ブロック７に
コマンドが設定されてから行われる。制御ブロック７
は、他のブロックの動作を制御信号２８で制御する。Ｄ
ＭＡが起動されるとＸカウンタ１４（１０Ｂｉｔカウン
タ）が転送毎にカウントアップしていく。Ｘカウンタ１
４がＷレジスタ１２の値になると、ＢＡレジスタ１０に
ＢＷレジスタ８の値が加算され、Ｙカウンタ１５（１０
Ｂｉｔカウンタ）もカウントアップされる。この段階で
Ｘカウンタ１４はクリアされ、次の転送に備える。
レジスタ１２に１６Ｂｉｔ幅で設定される。相対矩形領
域３２の高さｒｈはＨ（ハイト）レジスタ１３に１６Ｂ
ｉｔ幅で設定される。ＤＭＡの起動は制御ブロック７に
コマンドが設定されてから行われる。制御ブロック７
は、他のブロックの動作を制御信号２８で制御する。Ｄ
ＭＡが起動されるとＸカウンタ１４（１０Ｂｉｔカウン
タ）が転送毎にカウントアップしていく。Ｘカウンタ１
４がＷレジスタ１２の値になると、ＢＡレジスタ１０に
ＢＷレジスタ８の値が加算され、Ｙカウンタ１５（１０
Ｂｉｔカウンタ）もカウントアップされる。この段階で
Ｘカウンタ１４はクリアされ、次の転送に備える。
【０００９】転送が進みＹカウンタ１５がＨレジスタ１
３の値になると転送が終了する。データの転送アドレス
はＸカウンタ１４とＢＡレジスタ１０の加算を加算器１
６で行い算出する。形状メモリ５へのアクセスは、デー
タがＥＷＳ側へ転送される場合に行われ、形状メモリへ
のアドレスはＤＭＡ転送アドレスの生成と同じようにＸ
カウンタ１４がＷレジスタ１２の値になると、ＭＢＡレ
ジスタ１１にＭＢＷレジスタ９の値が加算され、転送ア
ドレスはＸカウンタ１４とＭＢＡレジスタ１１の加算を
加算器３６で算出する。形状メモリ５へのマスク参照は
３２Ｂｉｔでおこなわれるため、アドレスは３２画素毎
に１回で発行され、その値は３２画素のバウンダリに沿
ったものとなっている。３２Ｂｉｔのマスクデータはマ
スクデータレジスタ１７に格納され、転送アドレスの下
位５Ｂｉｔがマスクデータレジスタ１７のマスクデータ
レジスタアドレス１８となってマスクデータ１９を参照
する。データは１６Ｂｉｔ幅の双方向Ｉ／Ｏチャネル２
０とシステムバス６の間で転送される。
３の値になると転送が終了する。データの転送アドレス
はＸカウンタ１４とＢＡレジスタ１０の加算を加算器１
６で行い算出する。形状メモリ５へのアクセスは、デー
タがＥＷＳ側へ転送される場合に行われ、形状メモリへ
のアドレスはＤＭＡ転送アドレスの生成と同じようにＸ
カウンタ１４がＷレジスタ１２の値になると、ＭＢＡレ
ジスタ１１にＭＢＷレジスタ９の値が加算され、転送ア
ドレスはＸカウンタ１４とＭＢＡレジスタ１１の加算を
加算器３６で算出する。形状メモリ５へのマスク参照は
３２Ｂｉｔでおこなわれるため、アドレスは３２画素毎
に１回で発行され、その値は３２画素のバウンダリに沿
ったものとなっている。３２Ｂｉｔのマスクデータはマ
スクデータレジスタ１７に格納され、転送アドレスの下
位５Ｂｉｔがマスクデータレジスタ１７のマスクデータ
レジスタアドレス１８となってマスクデータ１９を参照
する。データは１６Ｂｉｔ幅の双方向Ｉ／Ｏチャネル２
０とシステムバス６の間で転送される。
【００１０】また、データは８Ｂｉｔと１６Ｂｉｔが使
用可能でデータパックレジスタ２１で３２Ｂｉｔデータ
からの分解と積み込みが行われる。ただし、システムバ
ス６への転送アドレスが３２Ｂｉｔバウンダリを満たさ
ない場合、システムバス６への転送は８Ｂｉｔ又は１６
Ｂｉｔ単位で行い、システムバス６からの転送の場合す
べて３２Ｂｉｔ単位で転送される。従ってアクセスアド
レスレジスタ２２には転送アドレスの下位２Ｂｉｔを省
いたものが格納され、３２Ｂｉｔ幅メモリアクセス時に
は１サイクル参照される。その他の幅でのメモリアクセ
ス時にはドレインカウンタ２３をカウントしながらその
値でアドレスの下位を補い、データパックレジスタ２１
を分割して転送する。マスクデータ１９は双方向Ｉ／Ｏ
チャネル２０からのデータをデータパックレジスタ２１
にパックする時に参照され、データパックレジスタ２１
にデータと共に格納される。データパックレジスタ２１
が正しく３２Ｂｉｔデータとなっても、マスク情報によ
って３２Ｂｉｔバウンダリを満たしていない場合と同じ
ようにマスクされたデータを除いた転送を発生する。こ
のようにして発生されたアドレスは転送領域３４のよう
になる。
用可能でデータパックレジスタ２１で３２Ｂｉｔデータ
からの分解と積み込みが行われる。ただし、システムバ
ス６への転送アドレスが３２Ｂｉｔバウンダリを満たさ
ない場合、システムバス６への転送は８Ｂｉｔ又は１６
Ｂｉｔ単位で行い、システムバス６からの転送の場合す
べて３２Ｂｉｔ単位で転送される。従ってアクセスアド
レスレジスタ２２には転送アドレスの下位２Ｂｉｔを省
いたものが格納され、３２Ｂｉｔ幅メモリアクセス時に
は１サイクル参照される。その他の幅でのメモリアクセ
ス時にはドレインカウンタ２３をカウントしながらその
値でアドレスの下位を補い、データパックレジスタ２１
を分割して転送する。マスクデータ１９は双方向Ｉ／Ｏ
チャネル２０からのデータをデータパックレジスタ２１
にパックする時に参照され、データパックレジスタ２１
にデータと共に格納される。データパックレジスタ２１
が正しく３２Ｂｉｔデータとなっても、マスク情報によ
って３２Ｂｉｔバウンダリを満たしていない場合と同じ
ようにマスクされたデータを除いた転送を発生する。こ
のようにして発生されたアドレスは転送領域３４のよう
になる。
【００１１】本実施例では画像処理装置のための走査デ
ータをＤＭＡで得るので、データパックレジスタ２１の
タイミングに併せてＤＲＤＹ信号２４とＤＡＴＡＲ信号
２５とＤＡＴＡＷ信号２６を出力する。また、ＤＴＲＥ
Ｑ信号２７は双方向Ｉ／Ｏチャネル２０への転送開始要
求信号で、データのシステムバス６への転送時はこの信
号によってＤＭＡ転送が開始される。このようにしてＤ
ＭＡ転送時に矩形領域に限られない形状の画像データを
扱うことが可能となる。
ータをＤＭＡで得るので、データパックレジスタ２１の
タイミングに併せてＤＲＤＹ信号２４とＤＡＴＡＲ信号
２５とＤＡＴＡＷ信号２６を出力する。また、ＤＴＲＥ
Ｑ信号２７は双方向Ｉ／Ｏチャネル２０への転送開始要
求信号で、データのシステムバス６への転送時はこの信
号によってＤＭＡ転送が開始される。このようにしてＤ
ＭＡ転送時に矩形領域に限られない形状の画像データを
扱うことが可能となる。
【００１２】
【発明の効果】この発明は以上説明したように、ＤＭＡ
において、アドレス空間に矩形領域を設定し、その矩形
領域内に設定された相対矩形領域の水平走査に従ったア
ドレスを発生するために、相対矩形領域のベースアドレ
スを設定するレジスタと、ベース矩形領域のサイズを設
定するレジスタと、相対矩形領域のサイズを設定するレ
ジスタと、相対矩形領域の水平走査を行なう水平カウン
タ及び垂直カウンタと、これらカウンタ値とレジスタ値
からアクセスアドレスを算出する加算器と、さらにその
メモリアクセスを制限する領域を記述するマスク画像デ
ータを格納するメモリをから成る構成とし、ＤＭＡによ
って目的とする特殊形状画像データ領域へのアクセスを
可能とする効果を有する。
において、アドレス空間に矩形領域を設定し、その矩形
領域内に設定された相対矩形領域の水平走査に従ったア
ドレスを発生するために、相対矩形領域のベースアドレ
スを設定するレジスタと、ベース矩形領域のサイズを設
定するレジスタと、相対矩形領域のサイズを設定するレ
ジスタと、相対矩形領域の水平走査を行なう水平カウン
タ及び垂直カウンタと、これらカウンタ値とレジスタ値
からアクセスアドレスを算出する加算器と、さらにその
メモリアクセスを制限する領域を記述するマスク画像デ
ータを格納するメモリをから成る構成とし、ＤＭＡによ
って目的とする特殊形状画像データ領域へのアクセスを
可能とする効果を有する。
【図１】本発明の実施例における構成例を示した説明図
である。
である。
【図２】本発明の実施例におけるメモリ空間を示した説
明図である。
明図である。
【図３】本発明の実施例における形状メモリを示した説
明図である。
明図である。
５ 形状メモリ ６ システムバス ７ 制御ブロック ８ ＢＷ（ベースワイズ）レジスタ ９ ＭＢＷ（マスクベースワイズ）レジスタ １０ ＢＡ（ベースアドレス）レジスタ １１ ＭＢＡ（マスクベースアドレス）レジスタ １２ Ｗ（ワイズ）レジスタ １３ Ｈ（ハイト）レジスタ １４ Ｘカウンタ １５ Ｙカウンタ １６，３６ 加算器 １７ マスクデータレジスタ １８ マスクデータレジスタアドレス １９ マスクデータ ２０ 双方向Ｉ／Ｏチャネル ２１ データパックレジスタ ２２ アクセスアドレスレジスタ ２３ ドレインカウンタ ２４ ＤＲＤＹ信号 ２５ ＤＡＴＡＲ信号 ２６ ＤＡＴＡＷ信号 ２７ ＤＴＲＥＱ信号 ２８ 制御信号 ２９ マルチプレクサ ３０ マスクデータアドレス ３１ ベース矩形領域 ３２ 相対矩形領域 ３３ マスクメモリ ３４ ＤＭＡアドレス発生領域
Claims (1)
- 【請求項１】 汎用高速バスに接続されるＤＭＡにおい
て、アドレス空間に矩形領域を設定し、その矩形領域に
対して水平走査でＤＭＡアドレスを発生する手段と、前
記ＤＭＡアドレス発生時にマスク形状を記述するマスク
メモリのデータにしたがってアクセスアドレスをマスク
する手段を有することを特徴とするＤＭＡ機構。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP34727391A JPH05181788A (ja) | 1991-12-27 | 1991-12-27 | 特殊形状領域ｄｍａ機構 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP34727391A JPH05181788A (ja) | 1991-12-27 | 1991-12-27 | 特殊形状領域ｄｍａ機構 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05181788A true JPH05181788A (ja) | 1993-07-23 |
Family
ID=18389103
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP34727391A Pending JPH05181788A (ja) | 1991-12-27 | 1991-12-27 | 特殊形状領域ｄｍａ機構 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05181788A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2011103129A (ja) * | 2010-11-29 | 2011-05-26 | Mega Chips Corp | データ転送制御装置およびデータ転送方法 |
-
1991
- 1991-12-27 JP JP34727391A patent/JPH05181788A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2011103129A (ja) * | 2010-11-29 | 2011-05-26 | Mega Chips Corp | データ転送制御装置およびデータ転送方法 |
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