JP2011009363A - 半導体装置及びその製造方法並びにこれを用いた複合回路装置 - Google Patents

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bump
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adhesive resin
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兼二 難波
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Abstract

【課題】特にフリップチップ方式の実装形態において微細ピッチ化、高スループット化に対応すると共に高い接続信頼性の得られる半導体装置、及びその製造方法並びにこれを用いた複合回路装置を提供する。
【解決手段】本発明に係る半導体装置は、電極と、電極上に開口部を有する絶縁層と、を備える。また前記電極上に形成されたバンプと、前記絶縁層と前記バンプの周辺を覆う保護膜と、前記バンプと接することなく前記保護膜の一部を覆う接着樹脂層と、を具備し、前記バンプの上面と、前記保護膜の上面と、前記接着樹脂層の上面とが同一平面上にある。
【選択図】図1

Description

本発明は、半導体装置、及び半導体装置の製造方法に関し、特にフリップチップ方式の実装形態において微細ピッチ化、高スループット化に対応すると共に高い接続信頼性の得られる半導体装置、及びその製造方法並びにこれを用いた複合回路装置に関するものである。
近年、半導体装置の高性能化,高機能化に対応するパッケージ構造として、CPU(中央演算処理装置)やメモリ等の複数個の半導体素子を積層実装し1パッケージ化することでシステム構築するSiP(System in Package)構造が知られている。このSiP構造では、近年、半導体素子間におけるデータ転送能力の向上を目的に、更なる多ピン化や電極間ピッチの微細化が進んでいる。
図9は、上記した従来の半導体装置の製造方法の一つである。初めに、電極2上にバリアメタル14を介しSnを主成分とするハンダバンプ15が形成された半導体素子1と、半導体素子1と同様に電極2上にバリアメタル14を介しハンダバンプ15が形成された、もしくはバリアメタル14とバリアメタル14上にAuからなる薄膜が形成された電極2を具備する半導体素子1を双方の電極2が対向する位置に位置合せを行う(図9(a))。その後、双方のハンダバンプ15を当接し加熱,荷重を加えることで、ハンダバンプ15同士を反応させ接続する。最後に、半導体素子1間に接着樹脂層7となる熱硬化性のアンダーフィル樹脂を封入し、硬化させることで複合回路装置を得ている(図9(b))。
また、生産性の向上を図るために、特開2007−142232(特許文献1)のように基板側に液状の樹脂材を供給した後、半導体素子を搭載し電極間の接続と樹脂材の熱硬化を行う製造方法が示されている。
また、半導体素子の搭載前に樹脂材の供給を行った製造方法として、特開2005−294430(特許文献2)のように半導体素子側に半硬化状の接着樹脂層を形成し、その後にハンダバンプと接着樹脂層とを研削することでハンダバンプの表面を接着樹脂層より露出させると共に、平坦形状にする製造方法が示されている。
また、特開2004−172491(特許文献3)には、突起電極の表面とストッパマスク層の表面を面一にした構造が記載されている。また、ストッパマスク層に接着性を有する熱可塑性樹脂又は低軟化点(融点)ガラスを用いることが記載されている。
特開2007−142232号公報 特開2005−294430号公報 特開2004−172491号公報
しかしながら、従来構造には幾つかの問題点がある。
第1の課題は、アンダーフィル樹脂の充填性の低下によりボイドが発生しやすくなることである。この原因は、更なる多ピン化や電極間ピッチの微細化に伴いバンプ間の隙間は狭くバンプ高さも低いことから、半導体素子間のギャップが狭くなることに起因する。半導体素子間のギャップが狭い場合、充填領域への充填速度と半導体素子のエッジを伝い周り込む速度の相違が顕著となり、巻き込みによるボイドが発生してしまう。また、充填領域内でもバンプ配列部とそうでない領域との間でアンダーフィル樹脂の充填速度は異なり、バンプ接続部でボイドが発生し易い。
第2の課題は、パッケージ組立における生産性が低いことである。この原因は、個々に半導体素子の実装とアンダーフィル樹脂の充填を行っていることに起因する。充填領域におけるボイド発生の抑制を目的にアンダーフィル樹脂の粘度や塗布量等の条件を調整することで、充填時間に影響し、また個々にアンダーフィル樹脂の充填を行っていることから生産性の低下に至ってしまう。
また、特許文献1に記載の製造方法では、半導体素子の搭載時において半導体素子と樹脂材との間に空気が巻き込まれ易いことから、樹脂内ボイドが発生しやすい。また、微細ピッチ且つ狭ギャップである場合、取り込まれた空気を樹脂材が熱硬化する前に樹脂材の流動を利用して排出させることは困難である。その他の課題として、接続部における樹脂材の噛み込みが考えられる。予め電極部も含め基板上に樹脂材を供給されていることから、半導体素子の実装時において接合部に樹脂材が噛み込まれ、電極部において接続面積が狭くなる。
特許文献2に開示の製造方法では、半硬化状の接着樹脂層と金属であるハンダバンプとは硬度が異なることから、切削時にハンダバンプに切削ダレが生じる可能性がある。従って、電極間ピッチが微細化した場合、この切削ダレによって隣接バンプとのショート不良が発生する可能性がある。更に、微細化によるその他の課題として、電極サイズも微細化するため、バンプ形成時のめっきバラツキによる影響が顕著に現われる。
また、特許文献3に記載の構造では、ストッパマスク層に接着性を有する熱可塑性樹脂又は低軟化点(融点)ガラスを用いることが記載されているが、電極間の絶縁性と接着性の両方の機能を持たせることは記載がない。突起電極間ピッチの微細化のためには、電極間の絶縁性も考慮する必要がある。
本発明は上記従来技術の問題点を解決するための、特にフリップチップ方式の実装形態において微細ピッチ化、高スループット化に対応すると共に高い接続信頼性の得られる半導体装置、及びその製造方法並びにこれを用いた複合回路装置に関するものである。
第1の視点において、本発明に係る半導体装置は、電極と、電極上に開口部を有する絶縁層と、を備える。また前記電極上に形成されたバンプと、前記絶縁層と前記バンプの周辺を覆う保護膜と、前記バンプと接することなく前記保護膜の一部を覆う接着樹脂層と、を具備し、前記バンプの上面と、前記保護膜の上面と、前記接着樹脂層の上面とが同一平面上にある。なお、各要素又は部材の「上面」とは、各要素又は部材の上端部にあって外部に露出している面を言う。
第2の視点において、本発明に係る半導体装置の製造方法は、電極と、電極上に開口部を有する絶縁層とを配した半導体素子の該電極上にバンプの主材部を形成する工程と、該半導体素子の該絶縁層上と該バンプの主材部上に保護膜を形成する工程と、該保護膜上に接着樹脂層となる材料を供給する工程と、該バンプの主材部表面と該バンプの主材部周辺の該保護膜表面と該接着樹脂層を平坦化加工し同一平面とする工程と、を含む。
第3の視点において、本発明に係る半導体装置の製造方法は、電極と、電極上に開口部を有する絶縁層とを配した半導体素子の該電極上にバンプの主材部を形成する工程と、該半導体素子の該絶縁層上と該バンプの主材部上に保護膜を形成する工程と、該バンプの主材部表面と該バンプの主材部周辺の該保護膜表面を平坦化加工し同一平面とする工程と、ダイシングライン上の該保護膜を除去する工程と、該バンプ及び該保護膜上に接着樹脂層となる材料を供給する工程とマスクを用いて該接着樹脂層となる樹脂を成形する工程と、該接着樹脂層をドライエッチングし該接合材料部の表面を露出させる工程と、を含む。
本発明の第1の実施形態による半導体装置の構造を示す断面模式図である。 本発明の第2の実施形態による半導体装置の構造を示す断面模式図である。 本発明の第1、第2の実施形態による半導体装置の製造方法を示す断面模式図である。 本発明の第1の実施形態による半導体装置の製造方法を示す断面模式図である。 本発明の第2の実施形態による半導体装置の製造方法を示す断面模式図である。 本発明の第2の実施形態による半導体装置の製造方法を示す断面模式図である。 本発明の第2の実施形態による半導体装置の製造方法を示す断面模式図である。 本発明の第1の実施形態による複合回路装置を示す断面模式図である。 従来の半導体装置の接合構造及び接合方法を示す断面模式図である。
第1の視点において、前記バンプが主材部と接合材料部の2層から構成されていることが好ましい。
前記バンプの主材部がCuであることが好ましい。また、前記バンプの接合材料部がAu又はSnの何れかであることが好ましい。
前記半導体装置の少なくとも1つの側面において、前記保護膜を露出させないように前記接着樹脂層が覆っていることが好ましい。
前記保護膜が前記バンプ間で中央が窪んだ円弧状の保護膜であることが好ましい。
前記保護膜はポリイミドからなる有機膜とすることができる。また、前記保護膜は無機膜としてもよい。
前記保護膜の厚みは、前記バンプ間で前記バンプ高さの1/2以下であることが好ましい。
前記接着樹脂層が、半硬化状の熱硬化性樹脂、熱硬化と感光性の併用型樹脂又は熱可塑性樹脂のいずれか一以上からなることが好ましい。
第2の視点において、前記半導体素子の絶縁層上とバンプの主材部上に保護膜を形成する工程と、前記保護膜上に接着樹脂層となる材料を供給する工程との間に、ダイシングライン上の該保護膜を除去する工程をさらに含むことが好ましい。
さらに該バンプの主材部表面に接合材料部を形成する工程を含むことが好ましい。
第3の視点において、バンプの主材部表面に接合材料部を形成する工程をさらに含むことが好ましい。
また、前記バンプの主材部表面に接合材料部を形成する工程は、置換型のめっき浴を用い無電解めっき法にて行うことが好ましい。
前記接着樹脂層となる材料を供給する工程は、フィルム状の半硬化樹脂をラミネート法にて行う工程であることが好ましい。
前記接着樹脂層となる材料を供給する工程は、液状の樹脂をスピンコートにて供給した後に、加熱又は露光し半硬化状にする工程であることが好ましい。
前記バンプの主材部表面とバンプの主材部周辺の保護膜表面(及び接着樹脂層)を平坦化加工し同一平面とする工程は、研磨法、研削法、化学機械研磨法の何れかにより行うことが好ましい。
前記ダイシングライン上の保護膜を除去する工程は、レーザー法又はフォトリソグラフィ法の何れかで行うことが好ましい。
前記マスクを用いて接着樹脂層となる樹脂を成形する工程は、ダイシングライン上に突起部を有するマスクを押し当て成形することが好ましい。
前記マスクを用いて接着樹脂層となる樹脂を成形する工程は、平板状のマスクを用いフォトリソグラフィ法により行うことが好ましい。
さらに具体的な実施形態について以下に説明する。
(実施形態1)
《半導体装置》
本発明の実施形態1に係る半導体装置について、図1を参照して詳細に説明する。図1を参照すると、本発明の実施形態1に係る半導体装置の断面図が示されている。なお、2つの断面図(a)、(b)が示されているが、これは一括製造した2種類の半導体装置をダイシングにより切断分離したときの断面図である(後述の製造方法参照)。
それぞれ半導体素子1の回路面上に電極2と電極2上に開口部を有するSiONやSiO等の絶縁膜3、及び電極2上にCuからなるバンプ10の主材部8があり、この主材部8の表面にはSnやAu等からなる薄膜状の接合材料9が形成されている。また、絶縁膜3上とバンプ10の周辺部には絶縁性の高い保護膜6によって覆われている。ここで、保護膜6にはポリイミド等の有機樹脂や、絶縁膜3と同様にSiONやSiO等の無機膜を適用することができる。
なお、電極2(及び絶縁膜3の一部)とバンプ10の主材部8との間には、密着層4及び接着層5が形成されている。
更に、バンプ10の周辺部を除く保護膜6上には半硬化状の接着樹脂層7が設けられている。接合材料9の表面、バンプ10の周辺部の保護膜6表面、及び接着樹脂層7の表面は同一平面を形成している。この接着樹脂層7には熱硬化性樹脂や熱可塑性樹脂、及び熱硬化と感光性の併用型樹脂にて構成することができる。
本実施形態の半導体装置では、半導体装置表面の一部に接着樹脂層を形成することにより、接合部へのアンダーフィル樹脂充填工程が不要となり、高い生産性が得られる。また、バンプの接合材料表面が接着樹脂層から露出し同一平面上にあることから、実装時において樹脂の噛み込みによる接合不良を抑制することが可能である。更に、バンプの周辺を絶縁性の高い保護膜が覆っていることにより、微細な電極ピッチにおいても隣接バンプ間での高い絶縁性が確保可能である。
《半導体装置の製造方法》
本実施形態の半導体装置は、図3、図4に示すように製造される。図3(a)は、回路面上にAl等からなる電極2と電極2の一部に開口部を有し、回路面上を覆うSiONやSiO等からなる絶縁膜3が具備された、半導体装置を複数個分含む半導体素子1がウェハ上に面付けされている状態である。なお、符号11はダイシングラインであり、本実施形態では最終的にこのダイシングライン11で切断され、複数の半導体装置が製造される工程を示す。
これにスパッタ法等を用いTiやTiW等からなる密着層4とCu等からなる接着層5を電極2と絶縁膜3の全面に形成する。そして、スピンコート等によって感光性のレジスト12を接着層5上に供給し、露光現像することで所望の電極2上に開口部を形成する。更に、このレジスト12の開口部に電解めっき法等でバンプ10の主材部8となるCuを析出させると図3(b)のようになる。このとき、主材部8の高さは各電極2間でバラツキが生じている。
その後、レジスト12を除去し、主材部8に覆われた部分以外に形成されている密着層4と接着層5をウェットエッチング法等を用い除去すると図3(c)となる。
次に、スピンコート等により主材部8上も含め、全面に保護膜6となる熱硬化型又は感光性のポリイミド等の有機樹脂を供給し硬化する(図3(d))。樹脂の供給量として、絶縁膜3上における保護膜6の成形後の膜厚が、最終的なバンプ10の高さの1/2以下となる量が好ましい。保護膜6にSiONやSiO等を適用する場合には、スパッタ法を用いて供給する。この場合の保護膜6の厚みは、1μm以下であることが好ましい。
その後、保護膜6上に接着樹脂層7となる樹脂の供給を行う(図4(e))。接着樹脂層7に熱硬化性樹脂又は熱可塑性樹脂を適用する場合は、フィルム状の樹脂を用いて保護膜6上にラミネートすることで供給を行う。ここで、熱硬化性樹脂を適用した場合は、ラミネート後においてもまだ半硬化状の樹脂である。その他の接着樹脂層7の供給方法として、液状の熱硬化性樹脂を保護膜6上にスピンコート等によって供給し、加熱することにより半硬化状の接着樹脂層7とする方法を採ってもよい。また、接着樹脂層7に熱硬化性と感光性の併用型樹脂を適用する場合は、スピンコート等によって樹脂を供給した後、露光し半硬化状の接着樹脂層7とする方法を採ってもよい。
次に、接着樹脂層7と保護膜6、及びバンプ10の主材部8を研磨法や研削法、及び化学機械研磨法等を用いて、平坦化加工を行う(図4(f))。そして、露出した主材部8表面に薄膜状の接合材料9となる金属を無電解めっき法等により供給する(図4(g))。ここで、無電解めっき法で行う場合は、置換めっき浴を用いて所望のめっき厚の接合材料9を供給してもよい。また、接合材料9には、AuやSnを適用することができる。
最後に、ダイシングライン11の部分でダイシング加工しウェハ形態より個片化を行うことで、本発明の実施形態1に係る半導体装置が得られる(図4(h))。また、半導体素子1の裏面を研磨法等にて加工し所望の薄さに薄型化して後、ダイシング加工を行ってもよい。
本発明の本実施形態に係る製造方法では、ウェハ形態で接着樹脂層を一括供給することにより、高い生産性が得られる。また、バンプの平坦化加工をバンプ主材部の周辺が既に硬化した保護膜で覆われた状態で行うことにより、加工時のバンプのダレを抑制し、微細な電極ピッチにおいても隣接バンプとのショート不良を防止することが可能である。更に、バンプの平坦化加工後に薄い接合材料を形成していることで、めっき厚バラツキを抑制し、高い接合信頼性の得られるバンプ形状を得ることが可能である。また更に、接合材料の供給に置換めっき浴を用いた無電解めっき法を適用することで、接着樹脂層との平坦性を維持しつつ接合材料の供給が可能となる。
《複合回路装置》
本発明の実施形態に係る半導体装置を用いた複合回路装置について、図8を参照して詳細に説明する。最初に、本発明の実施形態に係る半導体装置と、バンプ10の表面と保護膜6の表面が同一平面上にある半導体装置との位置合せを行う(図8(a))。その後、接合材料9と他方のバンプの主材部8を当接し加熱と荷重を加えて接合材料9と両方の主材部の金属を反応させ接合する(図8(b))。この時、接着樹脂層7も加熱され熱硬化することで、半導体装置間の接着も完了する。
本発明の実施形態1に係る複合回路装置では、先に接着樹脂層が形成されていることで、実装時に電極の電気的接続と接合部への樹脂充填及び硬化を同時に実施することが可能となり、高い生産性が得られる。また、表面が平坦なもの同士を実装することで、微細な電極ピッチ及び狭ギャップにおいても、実装時の空気の巻き込みによって生じる樹脂内ボイドを抑制することが可能である。
上記実施形態において、半導体装置同士の構造を示したが、半導体装置と基板の接合や基板同士の接合であってもよい。また、双方に本発明の半導体装置構造を適用した複合回路装置や、接合部位とその他の部位が同一平面上にある構造に本発明の半導体装置構造を接合した複合回路装置であってもよく、同様の効果が得られる。更に、双方の半導体装置に接合材料が供給されていてもよい。
(実施形態2)
次に第2の実施形態について図2を用いて説明する。図2は実施形態2における半導体装置の断面図である。図2に示すように、本実施形態において実施形態1と相違する点は、保護膜6の一側面(半導体装置の側面)が接着樹脂層7によって覆われている点である。なお、図2においても2種類の半導体装置の断面を図2(a)、(b)に示している。
本実施形態では、保護膜の側面(半導体装置の側面)が接着樹脂層によって覆われていることにより、半導体装置の実装後において外力や熱膨張差起因によって生じる内部応力が接着樹脂層によって緩和されることから、保護膜の側面を基点とした界面剥離を抑制し高い信頼性を得ることができる。
《製造方法》
図3、図5は本実施形態に係る半導体装置の製造方法を示す工程図である。本実施形態では、保護膜6を供給する工程まで、第1の実施形態と同様である(図3(a)から(d)まで)。次に、ウェハ形態より個片状に分割する部位のダイシングライン11上において、レーザー法等を用い保護膜6を除去する(図5(e))。また、保護膜6に感光性のポリイミド等の有機樹脂を使用した場合は、樹脂の硬化の際にダイシングライン11上に開口部が形成されるよう露光現像してもよい。その後に接着樹脂層7となる樹脂の供給を行う(図5(f))。接着樹脂層7に熱硬化性樹脂又は熱可塑性樹脂を適用する場合は、フィルム状の樹脂を用いて保護膜6上にラミネートすることで供給を行う。ここで、熱硬化性樹脂を適用した場合は、ラミネート後においてもまだ半硬化状の樹脂である。その他の接着樹脂層7の供給方法として、液状の熱硬化樹脂を保護膜6上にスピンコート等によって供給し、加熱することにより半硬化状の接着樹脂層7とする方法を採ってもよい。また、接着樹脂層7に熱硬化性と感光性の併用型樹脂を適用する場合は、スピンコート等によって樹脂を供給した後、露光し半硬化状の接着樹脂層7とする方法を採ってもよい。
次に、接着樹脂層7と保護膜6、及びバンプ10の主材部8を研磨法や研削法、及び化学機械研磨法等を用いて、平坦化加工を行う(図5(g))。そして、露出した主材部8表面に薄膜状の接合材料9となる金属を無電解めっき法等により供給する(図5(h))。ここで、無電解めっき法で行う場合は、置換めっき浴を用いて所望のめっき厚の接合材料9を供給してもよい。また、接合材料9には、例えばAuやSn又はこれらの合金を適用することができる。最後に、ダイシングライン11の部分でダイシング加工しウェハ形態より個片化を行うことで、本発明の実施形態が得られる(図5(i))。また、半導体素子1の裏面を研磨法等にて加工し所望の薄さに薄型化して後、ダイシング加工を行ってもよい。
本実施形態の製造方法では、ダイシングライン上の保護膜が予め除去された状態でダイシングを行うことにより、ダイシング時に発生する保護膜の界面剥離を防止することが可能である。
(第3の実施形態)
次に第3の実施形態について図3、図6を用いて説明する。図3、図6に示すように、本実施形態において第1、第2の実施形態と相違する点は、接着樹脂層7となる樹脂の供給前にバンプ10の主材部8の平坦化加工と接合材料10の形成を行う製造方法である点である。
本実施形態について具体的に説明する。保護膜6を供給する工程まで、第1、第2の実施形態と同様である(図3(a)から(d))。次に、保護膜6、及びバンプ10の主材部8を研磨法や研削法、及び化学機械研磨法等を用いて、平坦化加工を行う(図6(e))。そして、保護膜6から露出した主材部8表面に薄膜状の接合材料9となる金属を無電解めっき法等により供給する(図6(f))。ここで、無電解めっき法で行う場合は、置換めっき浴を用いて所望のめっき厚の接合材料9を供給してもよい。また、接合材料9には、AuやSn又はこれらの合金を適用することができる。その後、ウェハ形態より個片状に分割する部位のダイシングライン11上において、保護膜6をレーザー法等にて除去する(図6(g))。また、保護膜6に感光性のポリイミド等の有機樹脂を使用した場合は、樹脂の硬化の際にダイシングライン11上に開口部が形成されるよう露光現像してもよい。
次に、接着樹脂層7となる樹脂の供給を行う(図6(h))。接着樹脂層7に熱硬化性樹脂又は熱可塑性樹脂を適用する場合は、例えばフィルム状の樹脂を用いて保護膜6上にラミネートすることで供給を行うことが好ましい。ここで、熱硬化性樹脂を適用した場合は、ラミネート後においてもまだ半硬化状の樹脂である。その他の接着樹脂層7の供給方法として、液状の熱硬化樹脂又は熱硬化と感光性の併用型樹脂を保護膜6上にスピンコート等によって供給する方法を採ってもよい。
その後、平板状のマスク13を押し当て接着樹脂層7となる樹脂を成形する。成形後、ドライエッチングにより、接合材料9の表面の残渣を除去し露出させる(図6(i))。ここで、接着樹脂層7に熱硬化性樹脂又は熱可塑性樹脂を適用した場合は、加熱を行いながらマスク13を押し当て成形することで接着樹脂層7を形成することが好ましい。なお、熱硬化性樹脂を使用した場合では、成形後においても半硬化状となる程度の温度、時間で成形を行うことが好ましい。熱硬化と感光性の併用型樹脂を適用した場合では、例えば材質にガラス等を用いたマスク13を押し当てながら露光することができる。最後に、ダイシングライン11の部分でダイシング加工しウェハ形態より個片化を行うことで、本発明の実施形態が得られる(図6(j))。また、半導体素子1の裏面を研磨法等にて加工し所望の薄さに薄型化して後、ダイシング加工を行ってもよい。
本実施形態の製造方法では、接着樹脂層となる樹脂の供給前にバンプの主材部の平坦化加工と接合材料の形成を行うことによって、無電解めっき法等で接合材料を形成する際にめっき溶剤から受ける接着樹脂層の樹脂物性への影響を回避できる。
(第4の実施形態)
次に第4の実施形態について図3、図7を用いて説明する。図3、図7に示すように、本実施形態において第1、第2、第3の実施形態と相違する点は、接着樹脂層7の成形において、ダイシングライン11の部位に供給された接着樹脂層7を除去する製造方法である点である。
本実施形態について具体的に説明する。接着樹脂層7となる樹脂を供給する工程まで、第3の実施形態と同様である(図3(a)から(d)、図7(e)から(h))。次に、ダイシングライン11の部位に突起部を有するマスク13を押し当て接着樹脂層7となる樹脂を成形する。成形後、接合材料9表面及びダイシングライン11部の残渣をドライエッチング等により除去し露出させる(図7(i))。ここで、接着樹脂層7に熱硬化性樹脂又は熱可塑性樹脂を適用した場合は、加熱を行いながらマスク13を押し当て成形することで接着樹脂層7を形成する。なお、熱硬化性樹脂を使用した場合では、成形後においても半硬化状となる程度の温度、時間で成形を行う。熱硬化と感光性の併用型樹脂を適用した場合では、材質にガラス等を用いた同様の形状のマスク13を押し当てながら露光する。
また、この樹脂では、平板状のマスク13を使用し、マスク13を樹脂に押し当てながら、ダイシングライン11部が開口するよう露光現像を行ってもよい。最後に、ダイシングライン11の部分でダイシング加工しウェハ形態より個片化を行うことで、本発明の実施形態が得られる(図7(j))。また、半導体素子1の裏面を研磨法等にて加工し所望の薄さに薄型化して後、ダイシング加工を行ってもよい。
本実施形態の製造方法では、接着樹脂層の成形において、ダイシングラインの部位に供給された接着樹脂層を除去することによって、ウェハ形態より個片化へダイシングを行う際にダイシングブレードへの樹脂目詰まりを回避できる。従って、ダイシング時に生じる半導体素子のチッピング、クラック発生が抑制され信頼性の向上が図れる。
次に、本発明の実施例について、本発明の半導体装置の製造方法を示す図3、図4を参照し説明する。図3、図4に示すように、初めに、回路面上に一例として20μmピッチエリア配列で配置されたAlからなる電極2と電極2の一部に開口部を有し、回路面上を覆うSiONからなる絶縁膜3が具備された、例えばφ8インチ、厚み725μmのウェハ状の半導体素子1において(図3(a))、スパッタ法を用いTiからなる密着層4とCuからなる接着層5を電極2と絶縁膜3の全面に形成した。そして、スピンコートによって感光性のレジスト12を接着層5上に供給し、露光現像することで電極2上に一例としてφ10μmの開口部を形成した。更に、このレジスト12の開口部に電解めっき法でバンプ10の主材部8となるCuを例えば高さ10μm以上に析出させた(図3(b))。このとき、主材部8の高さは各電極2間でバラツキが生じている。
その後、レジスト12を除去し、主材部8の下以外に形成されている密着層4と接着層5をウェットエッチング法にて除去した(図3(c))。次に、スピンコートにより主材部8上も含め、保護膜6となるポリイミドの有機樹脂を供給し熱硬化した(図3(d))。ポリイミド樹脂の供給量として、絶縁膜3上における保護膜6の成形後の膜厚が例えば3μmとなる量を供給した。その後、一例として保護膜6上に接着樹脂層7となる厚み30μmのフィルム状の熱硬化性樹脂を加熱温度が85℃で真空圧が0.5MPaで真空ラミネートし供給した(図4(e))。ここで、ラミネート後においてもまだ半硬化状の樹脂である。
次に、接着樹脂層7と保護膜6、及び主材部8を研削法にて平坦化加工を行った(図4(f))。平坦化加工後の主材部8の高さは8μmであった。そして、置換Auめっき浴を用いて無電解めっき法により露出した主材部8表面に薄膜状のAuからなる接合材料9を形成した(図4(g))。Au膜厚は例えば0.03μmの薄膜状である。最後に、半導体素子1の裏面を研磨法により例えば厚み120μmまで薄型化し、ダイシングライン11の部分で8mm矩形のサイズにダイシング加工することで本発明に係る半導体装置が得られた(図4(h))。
《複合回路装置》
図8に示すように、本発明の実施形態の半導体装置と、Cuからなるφ13μmの主材部8の表面とポリイミドからなる保護膜6の表面が同一平面上にある半導体装置との位置合せを行った(図8(a))。その後、Auからなる接合材料9と他方の主材部8を当接し、例えば加熱温度300℃で実装荷重75N/Chipを15sec間加えて接合材料9と両方の主材部8を反応させ接合させた(図8(b))。この時、接着樹脂層7は150℃以上の温度で反応を開始し、熱硬化することで半導体装置間の接着も完了した。
以上、本発明を上記実施形態及び実施例に即して説明したが、本発明は上記の構成ないし各工程の数値条件や使用材質等にのみ制限されるものではなく、本発明の範囲内で当業者であればなしうるであろう各種変形、修正特に、記載した各要素の異なった組み合わせ等を含むことはもちろんである。
1 半導体素子
2 電極
3 絶縁膜
4 密着層
5 接着層
6 保護膜
7 接着樹脂層
8 主材部
9 接合材料
10 バンプ
11 ダイシングライン
12 レジスト
13 マスク
14 バリアメタル
15 ハンダバンプ

Claims (24)

  1. 電極と、電極上に開口部を有する絶縁層とを配した半導体装置において、
    前記電極上に形成されたバンプと、
    前記絶縁層と前記バンプの周辺を覆う保護膜と、
    前記バンプと接することなく前記保護膜の一部を覆う接着樹脂層と、を具備し、
    前記バンプの上面と、前記保護膜の上面と、前記接着樹脂層の上面とが同一平面上にある、
    ことを特徴とする半導体装置。
  2. 前記バンプが主材部と接合材料部の2層から構成されていること、を特徴とする請求項1に記載の半導体装置。
  3. 前記バンプの主材部がCuであること、を特徴とする請求項2に記載の半導体装置。
  4. 前記バンプの接合材料部がAu又はSnの何れかであること、を特徴とする請求項2又は3に記載の半導体装置。
  5. 前記半導体装置の少なくとも1つの側面において、前記保護膜を露出させないように前記接着樹脂層が覆っていることを特徴とする、請求項1〜4のいずれか一に記載の半導体装置。
  6. 前記保護膜が前記バンプ間で中央が窪んだ円弧状の保護膜であること、を特徴とする請求項1〜5のいずれか一に記載の半導体装置。
  7. 前記保護膜がポリイミドからなる有機膜であること、を特徴とする請求項1〜6のいずれか一に記載の半導体装置。
  8. 前記保護膜が無機膜からなること、を特徴とする請求項1〜6のいずれか一に記載の半導体装置。
  9. 前記保護膜の厚みは、前記バンプ間で前記バンプ高さの1/2以下であること、を特徴とする請求項1〜8のいずれか一に記載の半導体装置。
  10. 前記接着樹脂層が、半硬化状の熱硬化性樹脂、熱硬化と感光性の併用型樹脂又は熱可塑性樹脂のいずれか一以上からなること、を特徴とする請求項1〜9のいずれか一に記載の半導体装置。
  11. 電極と、電極上に開口部を有する絶縁層とを配した半導体素子の該電極上にバンプの主材部を形成する工程と、
    該半導体素子の該絶縁層上と該バンプの主材部上に保護膜を形成する工程と、
    該保護膜上に接着樹脂層となる材料を供給する工程と、
    該バンプの主材部表面と該バンプの主材部周辺の該保護膜表面と該接着樹脂層を平坦化加工し同一平面とする工程と、
    を含むことを特徴とする半導体装置の製造方法。
  12. 前記半導体素子の絶縁層上とバンプの主材部上に保護膜を形成する工程と、前記保護膜上に接着樹脂層となる材料を供給する工程との間に
    ダイシングライン上の該保護膜を除去する工程、
    をさらに含むことを特徴とする、請求項11に記載の製造方法。
  13. 前記バンプの主材部表面に接合材料部を形成する工程をさらに含むことを特徴とする、請求項11又は12に記載の製造方法。
  14. 電極と、電極上に開口部を有する絶縁層とを配した半導体素子の該電極上にバンプの主材部を形成する工程と、
    該半導体素子の該絶縁層上と該バンプの主材部上に保護膜を形成する工程と、
    該バンプの主材部表面と該バンプの主材部周辺の該保護膜表面を平坦化加工し同一平面とする工程と、
    ダイシングライン上の該保護膜を除去する工程と、
    該バンプ及び該保護膜上に接着樹脂層となる材料を供給する工程と
    マスクを用いて該接着樹脂層となる樹脂を成形する工程と、
    該接着樹脂層をドライエッチングし該接合材料部の表面を露出させる工程と、
    を含むことを特徴とする半導体装置の製造方法。
  15. 前記バンプの主材部表面に接合材料部を形成する工程をさらに含むことを特徴とする、請求項14に記載の製造方法。
  16. 前記バンプの主材部表面に接合材料部を形成する工程は、置換型のめっき浴を用い無電解めっき法にて行うこと、を特徴とする請求項15に記載の製造方法。
  17. 前記接着樹脂層となる材料を供給する工程は、フィルム状の半硬化樹脂をラミネート法にて行う工程である、ことを特徴とする請求項11〜16のいずれか一に記載の製造方法。
  18. 前記接着樹脂層となる材料を供給する工程は、液状の樹脂をスピンコートにて供給した後に加熱し半硬化状にする工程であること、を特徴とする請求項11〜16のいずれか一に記載の製造方法。
  19. 前記接着樹脂層となる材料を供給する工程は、液状の樹脂をスピンコートにて供給した後に露光し半硬化状にする工程であること、を特徴とする請求項11〜16のいずれか一に記載の製造方法。
  20. 前記バンプの主材部表面とバンプの主材部周辺の保護膜表面と接着樹脂層を平坦化加工し同一平面とする工程は、研磨法、研削法、化学機械研磨法の何れかにより行うこと、を特徴とする請求項11〜13のいずれか一に記載の製造方法。
  21. 前記バンプの主材部表面とバンプの主材部周辺の保護膜表面を平坦化加工し同一平面とする工程は、研磨法、研削法、化学機械研磨法の何れかにより行うこと、を特徴とする請求項14〜16のいずれか一に記載の製造方法。
  22. 前記ダイシングライン上の保護膜を除去する工程は、レーザー法又はフォトリソグラフィ法の何れかで行う、ことを特徴とする請求項12又は14に記載の製造方法。
  23. 前記マスクを用いて接着樹脂層となる樹脂を成形する工程は、ダイシングライン上に突起部を有するマスクを押し当て成形すること、を特徴とする請求項14〜16の何れか一に記載の製造方法。
  24. 前記マスクを用いて接着樹脂層となる樹脂を成形する工程は、平板状のマスクを用いフォトリソグラフィ法により行うこと、を特徴とする請求項14〜16の何れか一に記載の製造方法。
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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2016174134A (ja) * 2015-03-17 2016-09-29 株式会社東芝 半導体装置およびその製造方法
US10872710B2 (en) 2018-05-30 2020-12-22 Samsung Electronics Co., Ltd. Dielectric composites, and multi-layered capacitors and electronic devices comprising thereof

Families Citing this family (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US9082832B2 (en) 2011-09-21 2015-07-14 Stats Chippac, Ltd. Semiconductor device and method of forming protection and support structure for conductive interconnect structure
US9484259B2 (en) * 2011-09-21 2016-11-01 STATS ChipPAC Pte. Ltd. Semiconductor device and method of forming protection and support structure for conductive interconnect structure
US8653658B2 (en) 2011-11-30 2014-02-18 Taiwan Semiconductor Manufacturing Company, Ltd. Planarized bumps for underfill control
US9202714B2 (en) * 2012-04-24 2015-12-01 Micron Technology, Inc. Methods for forming semiconductor device packages
US8659153B2 (en) * 2012-07-16 2014-02-25 Micron Technology, Inc. Pillar on pad interconnect structures, semiconductor dice and die assemblies including such interconnect structures, and related methods
US9236277B2 (en) * 2012-08-10 2016-01-12 Taiwan Semiconductor Manufacturing Company, Ltd. Integrated circuit with a thermally conductive underfill and methods of forming same
US10115703B2 (en) 2015-03-17 2018-10-30 Toshiba Memory Corporation Semiconductor device and manufacturing method thereof

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH05291262A (ja) * 1992-04-07 1993-11-05 Toshiba Corp バンプ電極の形成方法
JP2001077145A (ja) * 1999-09-07 2001-03-23 Casio Comput Co Ltd 半導体装置の製造方法
JP2003086626A (ja) * 2001-09-13 2003-03-20 Matsushita Electric Ind Co Ltd 電子部品、その製造方法、電子部品の実装体および実装方法
JP2005129874A (ja) * 2003-10-27 2005-05-19 Seiko Epson Corp 半導体チップ、半導体チップの製造方法、半導体実装基板、電子デバイスおよび電子機器
JP2008244383A (ja) * 2007-03-29 2008-10-09 Casio Comput Co Ltd 半導体装置およびその製造方法

Family Cites Families (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4120133B2 (ja) * 2000-04-28 2008-07-16 沖電気工業株式会社 半導体装置及びその製造方法
JP3851607B2 (ja) 2002-11-21 2006-11-29 ローム株式会社 半導体装置の製造方法
TWI223363B (en) * 2003-11-06 2004-11-01 Ind Tech Res Inst Bonding structure with compliant bumps
US7960830B2 (en) * 2003-11-14 2011-06-14 Industrial Technology Research Institute Electronic assembly having a multilayer adhesive structure
JP4353845B2 (ja) 2004-03-31 2009-10-28 富士通株式会社 半導体装置の製造方法
KR101134168B1 (ko) * 2005-08-24 2012-04-09 삼성전자주식회사 반도체 칩 및 그 제조 방법과, 그를 이용한 표시 패널 및그 제조 방법
JP2007142232A (ja) 2005-11-21 2007-06-07 Henkel Corp バンプ付電子部品の実装方法
US8749065B2 (en) * 2007-01-25 2014-06-10 Tera Probe, Inc. Semiconductor device comprising electromigration prevention film and manufacturing method thereof
US7781867B2 (en) * 2007-12-28 2010-08-24 Fujitsu Limited Method and system for providing an aligned semiconductor assembly
US8079141B2 (en) * 2008-02-29 2011-12-20 Sumitomo Bakelite Co., Ltd. Electrical connection and method of manufacturing the same
US7851346B2 (en) * 2008-07-21 2010-12-14 Taiwan Semiconductor Manufacturing Company, Ltd. Bonding metallurgy for three-dimensional interconnect
WO2010047006A1 (ja) * 2008-10-23 2010-04-29 パナソニック株式会社 半導体装置およびその製造方法
KR101234597B1 (ko) * 2009-10-15 2013-02-22 한국전자통신연구원 플립 칩 본딩 방법 및 그의 구조
US8610270B2 (en) * 2010-02-09 2013-12-17 Taiwan Semiconductor Manufacturing Company, Ltd. Semiconductor device and semiconductor assembly with lead-free solder
US9018758B2 (en) * 2010-06-02 2015-04-28 Taiwan Semiconductor Manufacturing Company, Ltd. Cu pillar bump with non-metal sidewall spacer and metal top cap

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH05291262A (ja) * 1992-04-07 1993-11-05 Toshiba Corp バンプ電極の形成方法
JP2001077145A (ja) * 1999-09-07 2001-03-23 Casio Comput Co Ltd 半導体装置の製造方法
JP2003086626A (ja) * 2001-09-13 2003-03-20 Matsushita Electric Ind Co Ltd 電子部品、その製造方法、電子部品の実装体および実装方法
JP2005129874A (ja) * 2003-10-27 2005-05-19 Seiko Epson Corp 半導体チップ、半導体チップの製造方法、半導体実装基板、電子デバイスおよび電子機器
JP2008244383A (ja) * 2007-03-29 2008-10-09 Casio Comput Co Ltd 半導体装置およびその製造方法

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2016174134A (ja) * 2015-03-17 2016-09-29 株式会社東芝 半導体装置およびその製造方法
US10872710B2 (en) 2018-05-30 2020-12-22 Samsung Electronics Co., Ltd. Dielectric composites, and multi-layered capacitors and electronic devices comprising thereof

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