JP2008286911A - 画像表示装置 - Google Patents

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Abstract

【課題】カラーフィルタと半導体回路とを形成した基板の位置合わせを不要にし、かつ安定的な動作を示す半導体回路及び表示装置を提供する。
【解決手段】実質的に透明な基材上に形成されたカラーフィルタ層上にソース電極、ドレイン電極、ゲート絶縁膜、ゲート電極、及び金属酸化物からなる半導体活性層を備えた実質的に透明な薄膜トランジスタと、実質的に透明な薄膜トランジスタと電気的接点を有する実質的に透明な導電材料によって形成された配線と、からなる実質的に透明な半導体回路を設けた画像表示装置において、半導体活性層の膜厚が10nm以上35nm以下であることを特徴とする画像表示装置。
【選択図】図1

Description

本発明は、画像表示装置に関し、特に半導体回路とカラーフィルタとの位置合わせが容易かつ信頼性に優れる画像表示装置に関する。
一般に電子デバイスの駆動用トランジスタとして、アモルファスシリコンや多結晶シリコン等を用いた薄膜トランジスタが用いられてきた。しかしながら、アモルファスシリコンや多結晶シリコンは不透明であり、また可視光領域において光感度を持つため、遮光膜が必要となる。そのため薄膜トランジスタやその配線等の半導体回路(以下、半導体回路と呼ぶ。)は視認性を害するためディスプレイ観察側から見て画像表示要素の裏側に設置されてきた。
反射型液晶表示装置や電気泳動表示装置等の反射型の表示装置のカラー化においては一般的にはカラーフィルタが用いられるが、上記の理由により、カラーフィルタと薄膜トランジスタ基板の間に液晶封入層や電気泳動粒子層が形成される。しかしながら、この位置にカラーフィルタおよび半導体回路基板が形成されると、例えば液晶の場合は、液晶を封入した後、半導体回路とカラーフィルタとを位置合わせする必要があり、高い精度を得るためには困難が伴い、コスト上昇や歩留まり低下の原因となっている。そのため、透明な半導体回路を直接カラーフィルタ上に形成することで、位置合わせが容易な表示装置を実現するため研究開発がなされている。
上記のディスプレイ構造を取ることでカラーフィルタと半導体回路との位置合わせは容易になる。しかしながらこの構造では視認側から見て半導体回路が画像表示要素の表側に存在するため、太陽光など外光が半導体回路に直接当たると薄膜トランジスタが誤動作する恐れがある。実際、酸化物半導体は透明であってもバンドギャップが3.0eV〜3.5eV程度であることが多く、バンドギャップがこの範囲であると太陽光などの照射により半導体活性層に光電流が流れ薄膜トランジスタが誤作動することが分かった。そのため上記ディスプレイ構造では屋外など非常に明るい所では画像表示に問題が生じることが分かった。なお、この種の画像表示装置については、例えば下記非特許文献1に開示されている。
M. Ito et al., Proc. 13th IDW, 585(2006)
本発明の目的は、半導体回路とカラーフィルタとの位置合わせが容易かつ信頼性に優れた画像表示装置を提供することである。
本発明の請求項1に係る発明は、実質的に透明な基材上に形成されたカラーフィルタ層上にソース電極、ドレイン電極、ゲート絶縁膜、ゲート電極、及び金属酸化物からなる半導体活性層を備えた実質的に透明な薄膜トランジスタと、実質的に透明な薄膜トランジスタと電気的接点を有する実質的に透明な導電材料によって形成された配線と、からなる実質的に透明な半導体回路を設けた画像表示装置において、半導体活性層の膜厚が10nm以上35nm以下であることを特徴とする画像表示装置としたものである。
本発明の請求項2に係る発明は、実質的に透明な半導体回路上に積層された画像表示要素を有することを特徴とする請求項1記載の画像表示装置としたものである。
本発明の請求項3に係る発明は、画像表示要素は液晶又は電気泳動粒子を含むことを特徴とする請求項2に記載の画像表示装置としたものである。
本発明の請求項4に係る発明は、実質的に透明な基材と、実質的に透明な基材上に形成されたカラーフィルタ層と、カラーフィルタ層上の第1の領域に配設されたゲート電極、ゲート電極上のゲート絶縁膜、ゲート絶縁膜上の半導体活性層、半導体活性層上の一対の主電極領域、及び一対の主電極領域上の層間絶縁膜を有する実質的に透明な薄膜トランジスタと、カラーフィルタ層上の第1の領域とは異なる第2の領域に配設され、一対の主電極領域の一方に電気的に接続された画素電極と、画素電極上に配設された画像表示要素と、画像表示要素上に配設された共通電極と、を備えたことを特徴とする画像表示装置としたものである。
本発明の請求項5に係る発明は、実質的に透明な薄膜トランジスタが行列状に複数配列されていることを特徴とする請求項4に記載の画像表示装置としたものである。
本発明の請求項6に係る発明は、半導体活性層の膜厚は10nm以上35nm以下の金属酸化物からなることを特徴とする請求項4又は5に記載の画像表示装置としたものである。
本発明によれば、実質的に透明な基板上に設けられたカラーフィルタの上に実質的に透明な半導体回路を形成し、反射型画像表示要素の前面に配置することで、カラーフィルタと半導体回路との位置合わせが容易で製造コストの安い反射型表示装置を提供することができる。
本発明の実施形態を、図面を参照しつつ説明する。しかしながら、本発明はこれらに限定されるものではない。
図1に示すように、本発明の実施の形態に係る画像表示装置の一画素100は、実質的に透明な基材3、カラーフィルタ層4、ゲート電極6、半導体活性層11、一対の主電極領域(ソース電極9及びドレイン電極10)及び層間絶縁膜12を備え、画素電極13、画像表示要素1及び共通電極14を備えている。
図2に示すように、本発明の実施の形態に係る画像表示装置200は、画像表示装置の1画素100を行列状に配置している。実質的に透明な基材3の下面に位相差板20、偏光膜21を備えている。画像表示要素1には液晶23を用いている。
カラーフィルタ層4及び実質的に透明な半導体回路2を形成する基材は実質的に透明でなければならない。ここで実質的に透明とは可視光である波長領域400nm〜700nmの範囲内で透過率が70%以上であること。具体的にはポリメチルメタクリレート、ポリアクリレート、ポリカーボネート、ポリスチレン、ポリエチレンサルファイド、ポリエーテルスルホン、ポリオレフィン、ポリエチレンテレフタレート、ポリエチレンナフタレート、シクロオレフィンポリマー、ポリエーテルサルフェン、トリアセチルセルロース、ポリビニルフルオライドフィルム、エチレン-テトラフルオロエチレン共重合樹脂、耐候性ポリエチレンテレフタレート、耐候性ポリプロピレン、ガラス繊維強化アクリル樹脂フィルム、ガラス繊維強化ポリカーボネート、透明性ポリイミド、フッ素系樹脂、環状ポリオレフィン系樹脂、ガラス及び石英等を使用することができるがこれらに限定されるものでない。これらは単独の基材として使用してもよいが、二種以上を積層した複合基材を使用することもできる。
また基材が有機物フィルムである場合は、素子の耐久性を上げるために透明のガスバリア層(図示せず)を形成することも好ましい。ガスバリア層としてはAl、SiO、SiN、SiON、SiC及びダイヤモンドライクカーボン(DLC)などを使用することができるがこれらに限定されるものではない。またこれらのガスバリア層は二層以上積層して使用することもできる。またガスバリア層は有機物フィルム基板の片面だけに付与してもよいし、両面に付与しても構わない。ガスバリア層は真空蒸着法、イオンプレーティング法、スパッタリング法、レーザアブレーション法、プラズマCVD(Chemical Vapor Deposition)法、ホットワイヤーCVD法及びゾルゲル法などで形成されるがこれらに限定されるものではない。
本発明の実質的に透明な半導体回路2に用いる、ゲート電極6、ソース電極9、ドレイン電極10、補助コンデンサ電極7、画素電極13、走査線電極(図示せず)及び信号線電極(図示せず)には、酸化インジウム(In)、酸化スズ(SnO)、酸化亜鉛(ZnO)、酸化カドミウム(CdO)、酸化インジウムカドミウム(CdIn)、酸化カドミウムスズ(CdSnO)、酸化亜鉛スズ(ZnSnO)及び酸化インジウム亜鉛(In−Zn−O)等の酸化物材料でもよい。またこの酸化物材料に不純物をドープしたものも好適に用いられる。例えば、酸化インジウムにスズ(Sn)やモリブデン(Mo)、チタン(Ti)をドープしたもの、酸化スズにアンチモン(Sb)やフッ素(F)をドープしたもの、酸化亜鉛にインジウム、アルミニウム及びガリウム(Ga)をドープしたものなどである。この中では特に酸化インジウムにスズ(Sn)をドープした酸化インジウムスズ(通称ITO)が高い透明性と低い抵抗率のために特に好適に用いられる。また上記導電性酸化物材料とAu、Ag、Cu、Cr、Al、Mg及びLiなどの金属の薄膜を複数積層したものも使用できる。この場合、金属材料の酸化や経時劣化を防ぐために導電性酸化物薄膜、金属薄膜、導電性酸化物薄膜の順に積層した3層構造が特に好適に用いられる。また金属薄膜層での光反射や光吸収が表示装置の視認性を妨げないために金属薄膜層はできる限り薄くすることが好ましい。具体的には1nm以上20nm以下であることが望ましい。
またPEDOT(ポリエチレンジオキシチオフェン)等の有機導電性材料も好適に用いることができる。ゲート電極6、ソース電極9、ドレイン電極10、補助コンデンサ電極7、画素電極13、走査線電極(図示せず)及び信号線電極(図示せず)は同じ材料であっても構わないし、また全て違う材料であっても構わない。しかし、工程数を減らすためにゲート電極6及び補助コンデンサ電極7とソース電極9及びドレイン電極10とは同一の材料であることがより望ましい。これらの透明電極は、真空蒸着法、イオンプレーティング法、スパッタリング法、レーザアブレーション法、プラズマCVD法、光CVD法、ホットワイヤーCVD法またはスクリーン印刷、凸版印刷、インクジェット法等で形成することができるがこれらに限定されるものではない。またこれらの透明電極の透明度を増加させるために成膜中基板を加熱したり、成膜後に基板を熱処理したりすることも好適に行われる。但し下地層のカラーフィルタ層4にダメージを与えないために基板温度は230℃以下であることが望ましい。
本発明の画像表示装置に用いる実質的に透明な半導体活性層11としては酸化物半導体材料が好適に使用できる。酸化物半導体材料は亜鉛、インジウム、スズ、タングステン、マグネシウム及びガリウムのうち一種類以上の元素を含む酸化物である、酸化亜鉛、酸化インジウム、酸化インジウム亜鉛、酸化スズ、酸化タングステン(WO)、酸化亜鉛ガリウムインジウム(In−Ga−Zn−O)等の材料が挙げられるがこれらに限定されるものではない。これらの材料は実質的に透明であり、バンドギャップが2.8eV以上、好ましくはバンドギャップが3.2eV以上であることが望ましい。これらの材料の構造は単結晶、多結晶、微結晶、結晶、アモルファスの混晶、ナノ結晶散在アモルファス、アモルファスのいずれであってもかまわない。また前記酸化物半導体材料の電子キャリア濃度が1018/cm3以下であることが望ましい。酸化物半導体層はスパッタリング法、パルスレーザ堆積法、真空蒸着法、CVD法、MBE(Molecular Beam Epitaxy)法、ゾルゲル法などの方法を用いて形成されるが、好ましくはスパッタリング法、パルスレーザ堆積法、真空蒸着法、CVD法である。スパッタリング法ではRFマグネトロンスパッタ法、DCスパッタ法、真空蒸着法では加熱蒸着法、電子ビーム蒸着法、イオンプレーティング法、CVD法ではホットワイヤーCVD法、プラズマCVD法などが挙げられるがこれらに限定されるものではない。
半導体活性層11の膜厚は10nm以上35nm以下の範囲であれば、歩留まりが高くかつ光照射の影響をほぼ回避することができる。膜厚が10nmよりも薄いと生産工程でわずかな膜厚不均一などがあると半導体活性層11が十分な機能を果たす程度に成膜されず歩留まりが下がるという問題がある。また膜厚が35nmよりも厚いと半導体活性層11で十分に光吸収が起こり、光照射のために薄膜トランジスタが誤作動を起こす。
本発明で用いられる薄膜トランジスタのゲート絶縁膜8に用いる材料は、特に限定しないが、酸化シリコン、窒化シリコン、シリコンオキシナイトライド(SiNxOy)、酸化アルミニウム、酸化タンタル、酸化イットリウム、酸化ハフニウム、ハフニウムアルミネート、酸化ジルコニア、酸化チタン等の無機材料、または、PMMA(ポリメチルメタクリレート)等のポリアクリレート、PVA(ポリビニルアルコール)、PS(ポリスチレン)、透明性ポリイミド、ポリエステル、エポキシ、ポリビニルフェノール及びポリビニルアルコール等が挙げられるがこれらに限定されるものではない。ゲートリーク電流を抑えるためには、絶縁材料の抵抗率は1011Ωcm以上、望ましくは1014Ωcm以上であることが好ましい。ゲート絶縁膜8は真空蒸着法、イオンプレーティング法、スパッタリング法、レーザアブレーション法、プラズマCVD法、光CVD法、ホットワイヤーCVD法、スピンコート、ディップコート、スクリーン印刷などの方法を用いて形成される。ゲート絶縁膜8の厚さは50nm〜2μmであることが望ましい。これらのゲート絶縁膜8は単層として用いても構わないし、複数の層を積層したものを用いても構わないし、また成長方向に向けて組成を傾斜したものでも構わない。
本発明で用いられる薄膜トランジスタの構成は特に限定されない。ボトムコンタクト型、トップコンタクト型のどちらであっても構わない。また本発明で用いられる薄膜トランジスタ上に層間絶縁膜12を設けさらにその上にドレイン電極10と電気的に接続されている画素電極13とを設けることで、開口率を高くすることは好適に行われる。
層間絶縁膜12としては絶縁性で実質的に透明であれば特に限定されない。例えば、酸化シリコン、窒化シリコン、シリコンオキシナイトライド(SiNxOy)、酸化アルミニウム、酸化タンタル、酸化イットリウム、酸化ハフニウム、ハフニウムアルミネート、酸化ジルコニア、酸化チタン等の無機材料、または、PMMA(ポリメチルメタクリレート)等のポリアクリレート、PVA(ポリビニルアルコール)、PS(ポリスチレン)、透明性ポリイミド、ポリエステル、エポキシ、ポリビニルフェノール、ポリビニルアルコール等の有機材料が挙げられるがこれらに限定されるものではない。層間絶縁膜12はゲート絶縁膜8と同じ材料であっても構わないし、異なる材料であっても構わない。これらの層間絶縁膜12は単層として用いても構わないし、複数の層を積層したものを用いても構わない。
またボトムゲート構造の素子の場合は半導体活性層11の上を覆うような保護膜を設けることも好ましい。保護膜を用いることで、半導体活性層11が湿度などで経時変化を受けたり、層間絶縁膜12から影響を受けたりすることを防ぐことができる。保護膜として酸化シリコン、窒化シリコン、シリコンオキシナイトライド(SiNxOy)、酸化アルミニウム、酸化タンタル、酸化イットリウム、酸化ハフニウム、ハフニウムアルミネート、酸化ジルコニア、酸化チタン等の無機材料、または、PMMA(ポリメチルメタクリレート)等のポリアクリレート、PVA(ポリビニルアルコール)、PS(ポリスチレン)、透明性ポリイミド、ポリエステル、エポキシ、ポリビニルフェノール、ポリビニルアルコール、フッ素系樹脂等が挙げられるがこれらに限定されるものではない。これらの保護膜は単層として用いても構わないし、複数の層を積層したものを用いても構わない。
また画素電極13は薄膜トランジスタのドレイン電極10と電気的に接続していなければならい。具体的には、層間絶縁膜12をスクリーン印刷などの方法でパターン印刷してドレイン電極10の部分に層間絶縁膜12を設けない方法などや、層間絶縁膜12を全面に塗布し、そのあとレーザビーム等層間絶縁膜12に穴を空ける方法などが挙げられる。
本発明で用いられるカラーフィルタ層4は赤色フィルタ(R)、緑色フィルタ(G)、青色カラーフィルタ(B)の3種類、もしくは赤色フィルタ(R)、緑色フィルタ(G)、青色カラーフィルタ(B)、白色カラーフィルタ(W)から形成されていることが好ましいがこれらに限定されるものではない。前記カラーフィルタ層4の着色層はその各色フィルタ(R、G、BまたはR、G、B、W)をそれぞれ所定幅の線条(ストライプ)マトリクス状、または所定サイズの矩形マトリクス状等、適宜パターン状にパターニングされている。また着色パターン形成後に、着色パターンを保護し、カラーフィルタ層4の凸凹を小さくするために、カラーフィルタ層4上に透明なオーバーコートが好適に設けられる。
本発明の画像表示要素1としては、液晶を封入した液晶表示装置、分散媒溶液と電荷を帯びた電気泳動粒子とを充填した電気泳動表示装置、分散媒溶液に分散された電荷を帯びた表面領域を有する回転粒子を充填した回転粒子表示装置、気体中に固体状物質が分散質として安定に浮遊するエアロゾル状態で高流動性を示す粉流体を封入した粉流体を移動させる電子粉流体方式表示装置等が挙げられるが特に液晶表示装置および電気泳動表示装置が望ましい。また本発明の反射型画像表示要素は視認する側からみて薄膜トランジスタの裏に設けられているため、本発明の画像表示要素1に付与される共通電極14は透明導電膜であっても構わないし、また不透明な電極であっても構わない。具体的には酸化インジウム(In)、酸化スズ(SnO)、酸化亜鉛(ZnO)、酸化カドミウム(CdO)、酸化インジウムカドミウム(CdIn)、酸化カドミウムスズ(CdSnO)、酸化亜鉛スズ(ZnSnO)、酸化インジウム亜鉛(In−Zn−O)等の酸化物材料やAu、Ag、Cu、Cr、Al、Mg、Li、Ni、NiCrなどの金属などがあげられる。またこれらを複数組み合わせたものも好適に用いられる。
また同様の理由から画像表示要素1を構成する基材は透明であっても透明でなくても構わない。また可撓性基材であっても可撓性基材でなくても構わない。具体的にはポリメチルメタクリレート、ポリアクリレート、ポリカーボネート、ポリスチレン、ポリエチレンサルファイド、ポリエーテルスルホン、ポリオレフィン、ポリエチレンテレフタレート、ポリエチレンナフタレート、シクロオレフィンポリマー、ポリエーテルサルフェン、トリアセチルセルロース、ポリビニルフルオライドフィルム、エチレン-テトラフルオロエチレン共重合樹脂、耐候性ポリエチレンテレフタレート、耐候性ポリプロピレン、ガラス繊維強化アクリル樹脂フィルム、ガラス繊維強化ポリカーボネート、透明性ポリイミド、フッ素系樹脂、環状ポリオレフィン系樹脂、ガラス及び石英等を使用することができるがこれらに限定されるものではない。これらは単独の基材として使用してもよいが、二種以上を積層した複合基材を使用することもできる。
また本発明の画像表示要素1の基材に導電性の材料を用いて共通電極14として代用することもできる。具体的には薄SUS板、アルミフォイル、薄銅板などがあげられる。このように反射型表示装置前面板の基材として導電性材料を用いる場合は基材の表示装置を設けない側に絶縁層もしくは絶縁材料を付与することが望ましい。
(実施例1)
実質的に透明な基材3としてコーニング社製無アルカリガラス1737(厚さ0.7mm)を用い、その一方の面にR(赤)、G(緑)、B(青)のカラーフィルタ層4を形成し、そのうえに透明樹脂からなるオーバーコート層を形成した。続いて、カラーフィルタ層4上に、ITO薄膜をDCマグネトロンスパッタ法で50nm形成した。そして、前記ITO薄膜をカラーフィルタ層4の各画素と位置合わせをしながら、所望の形状にパターニングし、ゲート電極6及び補助コンデンサ電極7とした。さらにその上に窒化シリコン(Si)のターゲットを用いてRFスパッタリング法でSiON薄膜を330nm形成し、ゲート絶縁膜8とした。さらに、半導体活性層11として、InGaZnOターゲットを用いアモルファスIn−Ga−Zn−O薄膜をRFスパッタリング法で15nm形成し、所望の形状にパターニングした。その上に、レジストを塗布し、乾燥、現像を行った後、ITO膜をDCマグネトロンスパッタ法で50nm形成し、リフトオフを行いソース電極9およびドレイン電極10とした。さらに、エポキシ系樹脂を厚さ3μmスピンコート法で塗布し、フォトリソグラフィ法でドレイン電極10上に貫通孔を開け、層間絶縁膜12とした。そして最後にITO膜をマグネトロンスパッタ法で100nm成膜しパターニングを行い、画素電極13とした。各膜の作成条件を表1に示す。なお成膜は全て室温で行った。作製後、半導体回路の透明度を増すために大気中で200℃にて1時間熱処理を行った。ここで作製した透明な半導体回路2は160×120の画素を持つ薄膜トランジスタアレイである。また薄膜トランジスタのゲート長は10μmゲート幅は50μmである。こうして作成された実質的に透明な半導体回路2の上に配向膜22を塗布した。それに、共通電極25としてITO薄膜を70nm成膜したコーニング社製無アルカリガラス1737(厚さ0.7mm)上に配向膜24を塗布して薄膜トランジスタを形成した基材をスペーサを介して配置し、その後そのスペーサ間に液晶を封入した。最後に、実質的に透明な基材3のカラーフィルタ層4が形成されていない面に位相差板20と偏光板21とを配置して実施例1の表示装置を作製した。
(実施例2)
実質的に透明な基材3としてコーニング社製無アルカリガラス1737(厚さ0.7mm)を用い、その一方の面にR(赤)、G(緑)、B(青)のカラーフィルタ層4を形成し、そのうえに透明樹脂からなるオーバーコート層を形成した。続いて、カラーフィルタ層4上に、ITO薄膜をDCマグネトロンスパッタ法で50nm形成した。そして、前記ITO薄膜をカラーフィルタ層4の各画素と位置合わせをしながら、所望の形状にパターニングし、ゲート電極6及び補助コンデンサ電極7とした。さらにその上に窒化シリコン(Si)のターゲットを用いてRFスパッタリング法でSiON薄膜を330nm形成し、ゲート絶縁膜8とした。さらに、半導体活性層11として、InGaZnOターゲットを用いアモルファスIn−Ga−Zn−O薄膜をRFスパッタリング法で25nm形成し、所望の形状にパターニングした。その上に、レジストを塗布し、乾燥、現像を行った後、ITO膜をDCマグネトロンスパッタ法で50nm形成し、リフトオフを行いソース電極9およびドレイン電極10とした。さらに、エポキシ系樹脂を厚さ3μmスピンコート法で塗布し、フォトリソグラフィ法でドレイン電極10上に貫通孔を開け、層間絶縁膜12とした。そして最後にITO膜をマグネトロンスパッタ法で100nm成膜しパターニングを行い、画素電極13とした。各膜の作成条件を表1に示す。なお成膜は全て室温で行った。作製後、半導体回路の透明度を増すために大気中で200℃にて1時間熱処理を行った。ここで作製した透明な半導体回路2は160×120の画素を持つ薄膜トランジスタアレイである。また薄膜トランジスタのゲート長は10μmゲート幅は50μmである。こうして作成された実質的に透明な半導体回路2の上に配向膜22を塗布した。それに、共通電極25としてITO薄膜を70nm成膜したコーニング社製無アルカリガラス1737(厚さ0.7mm)上に配向膜24を塗布して薄膜トランジスタを形成した基材をスペーサを介して配置し、その後そのスペーサ間に液晶を封入した。最後に、実質的に透明な基材3のカラーフィルタ層4が形成されていない面に位相差板20と偏光板21とを配置して実施例2の表示装置を作製した。
(実施例3)
実質的に透明な基材3としてコーニング社製無アルカリガラス1737(厚さ0.7mm)を用い、その一方の面にR(赤)、G(緑)、B(青)のカラーフィルタ層4を形成し、そのうえに透明樹脂からなるオーバーコート層を形成した。続いて、カラーフィルタ層4上に、ITO薄膜をDCマグネトロンスパッタ法で50nm形成した。そして、前記ITO薄膜をカラーフィルタ層4の各画素と位置合わせをしながら、所望の形状にパターニングし、ゲート電極6および補助コンデンサ電極7とした。さらにその上に窒化シリコン(Si)のターゲットを用いてRFスパッタリング法でSiON薄膜を330nm形成し、ゲート絶縁膜8とした。さらに、半導体活性層11として、InGaZnOターゲットを用いアモルファスIn−Ga−Zn−O薄膜をRFスパッタ法で35nm形成し、所望の形状にパターニングした。その上に、レジストを塗布し、乾燥、現像を行った後、ITO膜をDCマグネトロンスパッタ法で50nm形成し、リフトオフを行いソース電極9およびドレイン電極10とした。さらに、エポキシ系樹脂を厚さ3μmスピンコート法で塗布し、フォトリソグラフィ法でドレイン電極10上に貫通孔を開け、層間絶縁膜12とした。そして最後にITO膜をマグネトロンスパッタ法で100nm成膜しパターニングを行い、画素電極13とした。各膜の作成条件を表1に示す。なお成膜は全て室温で行った。作製後、半導体回路の透明度を増すために大気中で200℃にて1時間熱処理を行った。ここで作製した透明な半導体回路2は160×120の画素を持つ薄膜トランジスタアレイである。また薄膜トランジスタのゲート長は10μmゲート幅は50μmである。こうして作成された実質的に透明な半導体回路2の上に配向膜22を塗布した。それに、共通電極25としてITO薄膜を70nm成膜したコーニング社製無アルカリガラス1737(厚さ0.7mm)上に配向膜24を塗布して薄膜トランジスタを形成した基材をスペーサを介して配置し、その後そのスペーサ間に液晶を封入した。最後に、実質的に透明な基材3のカラーフィルタ層4が形成されていない面に位相差板20と偏光板21とを配置して実施例3の表示装置を作製した。
(比較例1)
実質的に透明な基材3としてコーニング社製無アルカリガラス1737(厚さ0.7mm)を用い、その一方の面にR(赤)、G(緑)、B(青)のカラーフィルタ層4を形成し、そのうえに透明樹脂からなるオーバーコート層を形成した。続いて、カラーフィルタ層4上に、ITO薄膜をDCマグネトロンスパッタ法で50nm形成した。そして、前記ITO薄膜をカラーフィルタ層4の各画素と位置合わせをしながら、所望の形状にパターニングし、ゲート電極6および補助コンデンサ電極7とした。さらにその上に窒化シリコン(Si)のターゲットを用いてRFスパッタリング法でSiON薄膜を330nm形成し、ゲート絶縁膜8とした。さらに、半導体活性層11として、InGaZnOターゲットを用いアモルファスIn−Ga−Zn−O薄膜をRFスパッタリング法で7nm形成し、所望の形状にパターニングした。その上に、レジストを塗布し、乾燥、現像を行った後、ITO膜をDCマグネトロンスパッタ法で50nm形成し、リフトオフを行いソース電極9およびドレイン電極10とした。さらに、エポキシ系樹脂を厚さ3μmスピンコート法で塗布し、フォトリソグラフィ法でドレイン電極10上に貫通孔を開け、層間絶縁膜12とした。そして最後にITO膜をマグネトロンスパッタ法で100nm成膜しパターニングを行い、画素電極13とした。各膜の作成条件を表1に示す。なお成膜は全て室温で行った。作製後、半導体回路の透明度を増すために大気中で200℃にて1時間熱処理を行った。ここで作製した透明な半導体回路2は160×120の画素を持つ薄膜トランジスタアレイである。また薄膜トランジスタのゲート長は10μmゲート幅は50μmである。こうして作成された実質的に透明な半導体回路2の上に配向膜22を塗布した。それに、共通電極25としてITO薄膜を70nm成膜したコーニング社製無アルカリガラス1737(厚さ0.7mm)上に配向膜24を塗布して薄膜トランジスタを形成した基材をスペーサを介して配置し、その後そのスペーサ間に液晶を封入した。最後に、実質的に透明な基材3のカラーフィルタ層4が形成されていない面に位相差板20と偏光板21を配置して実施例3の表示装置を作製した。
(比較例2)
実質的に透明な基材3としてコーニング社製無アルカリガラス1737(厚さ0.7mm)を用い、その一方の面にR(赤)、G(緑)、B(青)のカラーフィルタ層4を形成し、そのうえに透明樹脂からなるオーバーコート層を形成した。続いて、カラーフィルタ層4上に、ITO薄膜をDCマグネトロンスパッタ法で50nm形成した。そして、前記ITO薄膜をカラーフィルタ層4の各画素と位置合わせをしながら、所望の形状にパターニングし、ゲート電極6および補助コンデンサ電極7とした。さらにその上に窒化シリコン(Si)のターゲットを用いてRFスパッタリング法でSiON薄膜を330nm形成し、ゲート絶縁膜8とした。さらに、半導体活性層11として、InGaZnOターゲットを用いアモルファスIn−Ga−Zn−O薄膜をRFスパッタリング法で10nm形成し、所望の形状にパターニングした。その上に、レジストを塗布し、乾燥、現像を行った後、ITO膜をDCマグネトロンスパッタ法で50nm形成し、リフトオフを行いソース電極9およびドレイン電極10とした。さらに、エポキシ系樹脂を厚さ3μmスピンコート法で塗布し、フォトリソグラフィ法でドレイン電極10上に貫通孔を開け、層間絶縁膜12とした。そして最後にITO膜をマグネトロンスパッタ法で100nm成膜しパターニングを行い、画素電極13とした。各膜の作成条件を表1に示す。なお成膜は全て室温で行った。作製後、半導体回路の透明度を増すために大気中で200℃にて1時間熱処理を行った。ここで作製した透明な半導体回路2は160×120の画素を持つ薄膜トランジスタアレイである。また薄膜トランジスタのゲート長は10μmゲート幅は50μmである。こうして作成された実質的に透明な半導体回路2の上に配向膜22を塗布した。それに、共通電極25としてITO薄膜を70nm成膜したコーニング社製無アルカリガラス1737(厚さ0.7mm)上に配向膜24を塗布して薄膜トランジスタを形成した基材をスペーサを介して配置し、その後そのスペーサ間に液晶を封入した。最後に、実質的に透明な基材3のカラーフィルタ層4が形成されていない面に位相差板20と偏光板21とを配置して実施例3の表示装置を作製した。
(比較例3)
実質的に透明な基材3としてコーニング社製無アルカリガラス1737(厚さ0.7mm)を用い、その一方の面にR(赤)、G(緑)、B(青)のカラーフィルタ層4を形成し、そのうえに透明樹脂からなるオーバーコート層を形成した。続いて、カラーフィルタ層4上に、ITO薄膜をDCマグネトロンスパッタ法で50nm形成した。そして、前記ITO薄膜をカラーフィルタ層4の各画素と位置合わせをしながら、所望の形状にパターニングし、ゲート電極6及び補助コンデンサ電極7とした。さらにその上に窒化シリコン(Si)のターゲットを用いてRFスパッタリング法でSiON薄膜を330nm形成し、ゲート絶縁膜8とした。さらに、半導体活性層11として、InGaZnOターゲットを用いアモルファスIn−Ga−Zn−O薄膜をRFスパッタリング法で40nm形成し、所望の形状にパターニングした。その上に、レジストを塗布し、乾燥、現像を行った後、ITO膜をDCマグネトロンスパッタ法で50nm形成し、リフトオフを行いソース電極9およびドレイン電極10とした。さらに、エポキシ系樹脂を厚さ3μmスピンコート法で塗布し、フォトリソグラフィ法でドレイン電極10上に貫通孔を開け、層間絶縁膜12とした。そして最後にITO膜をマグネトロンスパッタ法で100nm成膜しパターニングを行い、画素電極13とした。各膜の作成条件を表1に示す。なお成膜は全て室温で行った。作製後、半導体回路の透明度を増すために大気中で200℃にて1時間熱処理を行った。ここで作製した透明な半導体回路2は160×120の画素を持つ薄膜トランジスタアレイである。また薄膜トランジスタのゲート長は10μmゲート幅は50μmである。こうして作製された実質的に透明な半導体回路の上に配向膜22を塗布した。それに、共通電極としてITO薄膜を70nm成膜したコーニング社製無アルカリガラス1737(厚さ0.7mm)上に配向膜24を塗布して薄膜トランジスタを形成した基材をスペーサを介して配置し、その後そのスペーサ間に液晶を封入した。最後に、実質的に透明な基材3のカラーフィルタ層4が形成されていない面に位相差板20と偏光板21とを配置して比較例1の表示装置を作製した。
(比較例4)
実質的に透明な基材3としてコーニング社製無アルカリガラス1737(厚さ0.7mm)を用い、その一方の面にR(赤)、G(緑)、B(青)のカラーフィルタ層4を形成し、そのうえに透明樹脂からなるオーバーコート層を形成した。続いて、カラーフィルタ層4上に、ITO薄膜をDCマグネトロンスパッタ法で50nm形成した。そして、前記ITO薄膜をカラーフィルタ層4の各画素と位置合わせをしながら、所望の形状にパターニングし、ゲート電極6及び補助コンデンサ電極7とした。さらにその上に窒化シリコン(Si)のターゲットを用いてRFスパッタリング法でSiON薄膜を330nm形成し、ゲート絶縁膜8とした。さらに、半導体活性層11として、InGaZnOターゲットを用いアモルファスIn−Ga−Zn−O薄膜をRFスパッタリング法で50nm形成し、所望の形状にパターニングした。その上に、レジストを塗布し、乾燥、現像を行った後、ITO膜をDCマグネトロンスパッタ法で50nm形成し、リフトオフを行いソース電極9およびドレイン電極10とした。さらに、エポキシ系樹脂を厚さ3μmスピンコート法で塗布し、フォトリソグラフィ法でドレイン電極10上に貫通孔を開け、層間絶縁膜12とした。そして最後にITO膜をマグネトロンスパッタ法で100nm成膜しパターニングを行い、画素電極13とした。各膜の作成条件を表1に示す。なお成膜は全て室温で行った。作製後、半導体回路の透明度を増すために大気中で200℃にて1時間熱処理を行った。ここで作製した透明な半導体回路2は160×120の画素を持つ薄膜トランジスタアレイである。また薄膜トランジスタのゲート長は10μmゲート幅は50μmである。こうして作成された実質的に透明な半導体回路の上に配向膜22を塗布した。それに、共通電極としてITO薄膜を70nm成膜したコーニング社製無アルカリガラス1737(厚さ0.7mm)上に配向膜24を塗布して薄膜トランジスタを形成した基材をスペーサを介して配置し、その後そのスペーサ間に液晶を封入した。最後に、実質的に透明な基材3のカラーフィルタ層4が形成されていない面に位相差板20と偏光板21とを配置して比較例2の表示装置を作製した。
上記実施例1〜3及び比較例1〜4で作製した画像表示装置の各画素の歩留まり(全画素数中正常な動作を示した画素の割合)及び実施例1〜3及び比較例1〜3で作製した透明な半導体回路2中の薄膜トランジスタの動作特性[光照射時及び暗状態時のオン・オフ比]を表2、図3及び図4に示す。ここで光照射とは基準太陽AM1.5(オリール社製擬似太陽光)を照射して測定している。
表2、図3及び図4から明らかな通り半導体活性層の膜厚を15nmよりも薄くすると薄膜トランジスタの歩留まりが大きく減少し、また半導体活性層の膜厚を35nmよりも厚くすると光照射時にオン・オフ比が大きく減少することが分かる。
以上のとおり、カラーフィルタの上に実質的に透明な半導体回路を設けることで、視認性に影響を与えず、かつカラーフィルタと半導体回路の位置合わせが容易にできるようになる上、半導体層の活性層の膜厚を10nm以上35nm以下に制御することで歩留まりが高くかつ光照射の影響がほぼ回避できる画像表示装置を実現できる。
本発明の画像表示装置の一画素の部分断面図である。 本発明の実施例による反射型画像表示装置の概略断面図である。 半導体層の膜厚を変えた時の画素の歩留まり率である。 半導体層の膜厚を変えた時の暗時および光照射時のオン・オフ比である。
符号の説明
1 画像表示要素
2 実質的に透明な半導体回路
3 実質的に透明な基材
4 カラーフィルタ層
5 基材
6 ゲート電極
7 補助コンデンサ電極
8 ゲート絶縁膜
9 ソース電極
10 ドレイン電極
11 半導体活性層
12 層間絶縁膜
13 画素電極
14 共通電極
20 位相差板
21 偏光膜
22 配向膜1
23 液晶
24 配向膜2
25 共通電極
26 画像表示要素用基材
27 導電性基材
100 画像表示装置の一画素
200 画像表示装置

Claims (6)

  1. 実質的に透明な基材上に形成されたカラーフィルタ層上にソース電極、ドレイン電極、ゲート絶縁膜、ゲート電極、及び金属酸化物からなる半導体活性層を備えた実質的に透明な薄膜トランジスタと、
    前記実質的に透明な薄膜トランジスタと電気的接点を有する実質的に透明な導電材料によって形成された配線と、
    からなる実質的に透明な半導体回路を設けた画像表示装置において、
    前記半導体活性層の膜厚が10nm以上35nm以下であることを特徴とする画像表示装置。
  2. 前記実質的に透明な半導体回路上に積層された画像表示要素を有することを特徴とする請求項1記載の画像表示装置。
  3. 前記画像表示要素は液晶又は電気泳動粒子を含むことを特徴とする請求項2に記載の画像表示装置。
  4. 実質的に透明な基材と、
    前記実質的に透明な基材上に形成されたカラーフィルタ層と、
    前記カラーフィルタ層上の第1の領域に配設されたゲート電極、前記ゲート電極上のゲート絶縁膜、前記ゲート絶縁膜上の半導体活性層、前記半導体活性層上の一対の主電極領域、及び前記一対の主電極領域上の層間絶縁膜を有する実質的に透明な薄膜トランジスタと、
    前記カラーフィルタ層上の前記第1の領域とは異なる第2の領域に配設され、前記一対の主電極領域の一方に電気的に接続された画素電極と、
    前記画素電極上に配設された画像表示要素と、
    前記画像表示要素上に配設された共通電極と、
    を備えたことを特徴とする画像表示装置。
  5. 前記実質的に透明な薄膜トランジスタが行列状に複数配列されていることを特徴とする請求項4に記載の画像表示装置。
  6. 前記半導体活性層の膜厚は10nm以上35nm以下の金属酸化物からなることを特徴とする請求項4又は5に記載の画像表示装置。
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