JP2007518223A - 発散制御機能を有したハイブリッド型マルチビーム電子放出デバイス - Google Patents
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Abstract
Description
−複数の電子ビーム放出源61を有しているマトリクス状放出構造60と、
−複数のダイヤフラム構造開口を有している電極構造7と、
−マトリクス状放出構造6と電極構造7との間に介装されたハイブリッド化システム9,9’と、
を備えている。
−1次元または2次元のマトリクス状とされた複数の電子ビーム放出源を備えてなる第1構造6と、マトリクス状とされた複数のダイヤフラム開口を備えてなる第2構造7と、を互いに個別的に製造することができ、
−第2構造7を第1構造6に対して移送することができ、
−第2構造7と第1構造6との間との間隔Xを制御することができ、
−第2構造7の開口8と、第1構造6の放出源61と、の間の位置合わせを制御することができ、
−第1構造6のうちのある種の導電性部分60と、第2構造7のうちのある種の導電性部分70と、を電気的にコンタクトさせることができる。
ΔVS = −R×Igate
6 第1構造
7 第2構造
8 ダイヤフラム開口
9 ハイブリッド化手段
9’ ハイブリッド化手段
40 焦点合わせシステム、第3手段、第3分極アノード、電極構造
50 電子放出デバイス
59 電子ビーム
61 電子ビーム放出源
62 電子ビーム放出源
69 電子ビーム
70 メンブラン、導電性部分
71 誘電性部分
72 誘電性部分
75 導電性部分
76 誘電性部分
77 誘電性部分
80 ダイヤフラム開口
81 開口表面
82 開口表面
83 開口エッジプロファイル
90 金属製ボール
120 カソード
124 電子放出手段
126 抽出グリッド
134 パルス状の電圧を印加する手段
140 電流収集手段
142 測定手段
160 基板、CMOS基板
180 アンプ
182 キャパシタ
184 抵抗器
Claims (32)
- 複数の電子ビーム(59)を放出する電子放出デバイス(50)であって、
電子ビーム(69)を放出する複数の放出源(61)を備えている第1構造(6)と、
複数のダイヤフラム開口(8)を備えている第2構造(7)と、
を具備し、
前記第1構造と前記第2構造とが、ハイブリッド化手段(9)によってハイブリッド化されていることを特徴とするデバイス。 - 請求項1記載のデバイスにおいて、
前記第2構造(7)が、電極によって、あるいは、金属製のまたは導電性のまたは半導電性のメンブラン(70)によって、形成されていることを特徴とするデバイス。 - 請求項1または2記載のデバイスにおいて、
前記第1構造(6)と前記第2構造(7)との間の前記ハイブリッド化手段(9,9’)が、金属製ボール(90)の介装を行う手段とされ、
前記金属製ボール(90)が、溶融可能な合金合金から形成されているおよび/または金から形成されていることを特徴とするデバイス。 - 請求項1または2記載のデバイスにおいて、
前記第1構造(6)と前記第2構造(7)との間の前記ハイブリッド化手段(9,9’)が、異方的導電性を有した1つまたは複数のフィルムの介装を行う手段とされていることを特徴とするデバイス。 - 請求項1〜4のいずれか1項に記載のデバイスにおいて、
少なくとも1つのダイヤフラム開口(80)が、互いに反対側に位置した2つの開口表面(81,82)を備え、
一方サイドの前記開口表面(81)の表面積が、他方サイドの前記開口表面(82)の表面積と比較して、より大きなものとされていることを特徴とするデバイス。 - 請求項1〜5のいずれか1項に記載のデバイスにおいて、
各ダイヤフラム(70)の開口(80)が、斜めのまたはフラットなまたは凹状をなすまたは凸状をなす開口エッジプロファイル(83)を有していることを特徴とするデバイス。 - 請求項1〜6のいずれか1項に記載のデバイスにおいて、
各構造(6,7)が、前記電子放出源(61,62)または前記ダイヤフラム開口(8,80)に関して周期的な構成を有し、
前記構造(6,7)が、マトリクス配置を有している、あるいは、複数の直線からなる配置を有している、あるいは、直線状配置を有している、あるいは、規則的な配置を有している、あるいは、不規則的な配置を有している、ことを特徴とするデバイス。 - 請求項1〜7のいずれか1項に記載のデバイスにおいて、
前記電子ビーム放出源(61,62)および前記ダイヤフラム開口(8,80)が、数μm〜1mmという間隔でもって配置されていることを特徴とするデバイス。 - 請求項1〜8のいずれか1項に記載のデバイスにおいて、
さらに、前記複数の電子ビームを焦点合わせするための、静電的なまたは磁気的なまたは電磁気的な、手段またはシステム(4)を具備していることを特徴とするデバイス。 - 請求項1〜9のいずれか1項に記載のデバイスにおいて、
さらに、磁気放射に基づく焦点合わせシステム(40)を具備していることを特徴とするデバイス。 - 請求項1〜10のいずれか1項に記載のデバイスにおいて、
さらに、第3手段、すなわち、第3分極アノードまたは電極構造(40)を具備し、
この第3手段が、前記第2構造(7)の前記ダイヤフラム開口(70)の外側に配置されていることを特徴とするデバイス。 - 請求項1〜11のいずれか1項に記載のデバイスにおいて、
前記第2構造(7)が、少なくとも1つの導電性部分(70,75)と、少なくとも1つの誘電性部分(71,72,76,77)と、を備えていることを特徴とするデバイス。 - 請求項1〜12のいずれか1項に記載のデバイスにおいて、
前記第2構造(7)が、2つの高さ位置(70,75)に配置されたような、電極または金属製メンブランまたは導電性メンブランを備え、
前記電極またはメンブランには、少なくとも1つの誘電体層(71,72)が付設されていることを特徴とするデバイス。 - 請求項1〜13のいずれか1項に記載のデバイスにおいて、
前記第2構造(7)の厚さが、前記ダイヤフラム開口(8)の領域(73,78)の周囲において、0.1μm〜数百μmとされていることを特徴とするデバイス。 - 請求項1〜14のいずれか1項に記載のデバイスにおいて、
前記第2構造(7)が、前記ダイヤフラム開口(8)の領域(73,78)の外側に、1μm〜1mmという厚さの厚さ部分(71,72,76,77)を有していることを特徴とするデバイス。 - 請求項1〜15のいずれか1項に記載のデバイスにおいて、
前記第2構造(7)が、各開口(8)どうしをあるいは複数の開口からなる各グループどうしを絶縁する胞状構造を備え、
これにより、各開口に対してあるいは各グループに対して、それぞれに個別的な電圧を印加し得るものとされていることを特徴とするデバイス。 - 請求項1〜16のいずれか1項に記載のデバイスにおいて、
前記第2構造の前記ダイヤフラム(70)の少なくとも一方のサイド(82,82’,83)に対して、電子の加速のためのまたは電子の焦点合わせのための電界(E2)が印加されていることを特徴とするデバイス。 - 請求項1〜17のいずれか1項に記載のデバイスにおいて、
前記第2構造(7)の前記ダイヤフラム開口(70)が、互いに反対側に位置した2つのサイド(81,82)を備え、
一方サイド(81)に対しては、電界(E1)が印加され、
他方サイド(82)に対しては、他の電界(E2)が印加されていることを特徴とするデバイス。 - 請求項17または18記載のデバイスにおいて、
前記ダイヤフラム開口(80,80’)に関し、相対的により大きな表面積を有した開口表面(82,81’)に対して、相対的により大きな電界値(E2,E1’)が印加され、なおかつ、相対的により大きな表面積を有した開口表面(81,82’)に対して、相対的により小さな電界値(E1,E2’)が印加されているまたは電界が印加されていない、ことを特徴とするデバイス。 - 請求項1〜19のいずれか1項に記載のデバイスにおいて、
前記第2構造(70)に対して、少なくとも1つの分極電圧(Vd,Vd1,Vd2)が印加されていることを特徴とするデバイス。 - 請求項1〜20のいずれか1項に記載のデバイスにおいて、
前記第1構造が、
基板(160)と、
カソード(120)と、
電子放出手段(124)と、
抽出グリッド(126)と、
を備え、
前記第2構造が、
前記抽出グリッドから絶縁されているとともに前記放出手段から放出された電流の一部を収集し得る位置に配置された電流収集手段(140)と、
収集された電流の測定手段(142)と、
収集された電流の測定結果の関数として、前記電子放出手段から放出される電流を制御するための制御手段と、
を備えていることを特徴とするデバイス。 - 請求項21記載のデバイスにおいて、
前記電子放出手段(124)が、少なくとも1つのマイクロポイントあるいは1つのナノチューブを有していることを特徴とするデバイス。 - 請求項21または22記載のデバイスにおいて、
前記制御手段が、前記抽出グリッド(126)に対してパルス状の電圧を印加する手段(134)を有していることを特徴とするデバイス。 - 請求項21または22記載のデバイスにおいて、
前記制御手段が、前記カソードに対してパルス状の電圧を印加する手段(134)を有していることを特徴とするデバイス。 - 請求項21〜24のいずれか1項に記載のデバイスにおいて、
前記基板が、CMOS基板(160)とされていることを特徴とするデバイス。 - 請求項25記載のデバイスにおいて、
電気的交差によって、前記CMOS基板(160)に対して、前記収集手段(146)および前記抽出グリッドが接続可能とされていることを特徴とするデバイス。 - 請求項21〜25のいずれか1項に記載のデバイスにおいて、
前記収集手段(140)が、ボールまたは柱によって形成された電気的かつ機械的な相互連結手段を介して、前記導電性領域(171)に対して接続されていることを特徴とするデバイス。 - 請求項27記載のデバイスにおいて、
前記測定手段(142)が、前記基板の中に配置されていることを特徴とするデバイス。 - 請求項21〜27のいずれか1項に記載のデバイスにおいて、
前記測定手段(142)が、前記収集手段が配置された基板上に形成されていることを特徴とするデバイス。 - 請求項21〜29のいずれか1項に記載のデバイスにおいて、
前記測定手段(142)が、アンプ(180)を備え、
このアンプ(180)に対しては、キャパシタ(182)あるいは抵抗器(184)が、並列接続的に付設されていることを特徴とするデバイス。 - 請求項30記載のデバイスにおいて、
前記測定手段(142)が、電流ミラーによって構成された測定系を備えていることを特徴とするデバイス。 - 請求項31記載のデバイスにおいて、
前記開口が、円形のものとされている、あるいは、円形の一部分(100,102,104)を有して形成されている、ことを特徴とするデバイス。
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