JP2006351559A - 配線基板および配線基板への半導体チップ実装構造 - Google Patents

配線基板および配線基板への半導体チップ実装構造 Download PDF

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明宣 井上
Atsunori Kajiki
篤典 加治木
Satoo Yamanishi
学雄 山西
Takashi Tsubota
崇 坪田
Hiroyuki Takatsu
浩幸 高津
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Abstract

【課題】アンダーフィル樹脂の流れ出しを効果的に防止することのできる配線基板への半導体チップ実装構造を提供する。
【解決手段】配線基板のチップ搭載エリア14内に半導体チップ30がフリップチップ接続して搭載され、該半導体チップ30とチップ搭載エリア14との間の隙間にアンダーフィル樹脂32が充填され、該アンダーフィル樹脂32が半導体チップ30側壁部を這い上がってフィレット部34が形成されると共に、保護レジスト層18上に流れ出たアンダーフィル樹脂32が枠状樹脂ダム20によって堰き止められていることを特徴とする。
【選択図】 図7

Description

【0001】
【発明の属する技術分野】
本発明は配線基板および配線基板への半導体チップ実装構造に関する。
【0002】
【従来の技術】
今後市場成長の見込める次世代携帯電話、デジタルカメラ等はさらなる高付加価値化が求められている。この高付加価値化を実現するためには半導体パッケージ(配線基板)の高密度化、小型化、軽量化が必須となる。
この配線基板の高密度化、小型化、軽量化のために、アッセンブリ技術において、半導体チップのフリップチップ接続構造を採用することが有効な手段である。
半導体チップのフリップチップ接続においては、チップ搭載エリア周辺の配線パターンの保護のために、チップ搭載エリアを囲むようにして、配線パターンを覆う保護レジスト層が設けられる。保護レジスト層はまた、半導体チップとチップ搭載エリアとの間の隙間に充填するアンダーフィル樹脂の流れ出し防止にも寄与している。
【0003】
【特許文献1】
特開平11−111894号(図1、図2)
【0004】
【発明が解決しようとする課題】
ところで、半導体チップとチップ搭載エリアとの間の隙間に充填される上記アンダーフィル樹脂は、50μm程度のきわめて小さな隙間に毛細管現象によって浸透させるものであるため、低粘性の樹脂が用いられる。
このため、量が多くなると、チップ搭載エリアよりも外方、すなわち、保護レジスト層上にも流れ出す可能性がある。
従来においては、アンダーフィル樹脂の多少の流れ出しは、見栄えを多少損ねる程度であるため無視できたが、半導体チップそのものが小型化し、半導体チップ、その他の電子部品の搭載密度が高くなってくると、このアンダーフィル樹脂の流れ出しが、周辺のチップや電子部品に悪影響をもたらすおそれがでてきた。
【0005】
そこで、本発明は上記課題を解決すべくなされたものであり、その目的とするところは、アンダーフィル樹脂の流れ出しを効果的に防止することのできる配線基板および配線基板への半導体チップ実装構造を提供するにある。
【0006】
【課題を解決するための手段】
本発明は上記課題を解決するために次の構成を有する。
すなわち、本発明に係る配線基板は、半導体チップがフリップチップ接続によって搭載されるチップ搭載エリアを囲んで保護レジスト層が設けられ、前記チップ搭載エリア内に、金属パッドが所要パターンで露出して形成された配線基板において、前記搭載される半導体チップとチップ搭載エリアとの対向面間に生じる隙間にアンダーフィル樹脂が充填される場合の、該アンダーフィル樹脂の外方への流れ出しを防止するための枠状樹脂ダムが、前記保護レジスト層上であって、前記チップ搭載エリアを囲む保護レジスト層の内端エッジ部から所要距離外方に離れた位置に形成されていることを特徴とする。
【0007】
搭載される半導体チップと前記チップ搭載部を囲む保護レジスト層の内端エッジ部との間に、アンダーフィル樹脂が浸入可能な隙間が形成されていることを特徴とする。
また、搭載される半導体チップの外壁と前記枠状樹脂ダム内壁との間が、少なくともアンダーフィル樹脂を注入するディスペンサーのノズルが移動可能な空間が形成される距離だけ離れていることを特徴とする。
また、前記金属パッドの表面にはんだ薄層が形成されていることを特徴とする。
【0008】
また、本発明に係る配線基板への半導体チップの実装構造は、上記配線基板のチップ搭載エリア内に半導体チップがフリップチップ接続して搭載され、該半導体チップとチップ搭載エリアとの隙間にアンダーフィル樹脂が充填され、該アンダーフィル樹脂が半導体チップ側壁部を這い上がってフィレット部が形成されると共に、保護レジスト層上に流れ出たアンダーフィル樹脂が枠状樹脂ダムによって堰き止められていることを特徴とする。
【0009】
【発明の実施の形態】
以下、本発明の好適な実施の形態を添付図面に基づいて詳細に説明する。
図1〜図7に配線基板にベアチップを実装するまでの一連の製造工程例を示す。
この製造工程の説明と併せて、配線基板の構造、半導体チップの実装構造を説明する。
図1は、多層の(プリント)配線基板10の説明図であり、この配線基板10は樹脂基板12を用いた公知の方法によって製造されるものであって、その製造工程の説明は省略する。
14はチップ搭載エリアであり、半導体チップがフリップチップ接続によって搭載される部位である。チップ搭載エリア14には、半導体チップと電気的に接続される金属パッド16が所要電極パターンで形成されている。
【0010】
チップ搭載エリア14を囲んで保護レジスト層18が設けられている。
保護レジスト層18は、チップ搭載エリア14周辺の配線パターン(図示せず)を覆って形成され、配線パターンを保護するものである。この保護レジスト層18は、レジストをスクリーン印刷によって所要パターンに印刷して形成してもよいし、感光性レジストを塗布して、感光、現像して所要のパターンに形成してもよい。
【0011】
次に図2に示すように、保護レジスト層18上に、保護レジスト層18の内端エッジ部から所要距離mだけ外方に離れた位置に枠状樹脂ダム20を形成する(請求項1の配線基板)。
この枠状樹脂ダム20は、搭載される半導体チップとチップ搭載エリア14との対向面間に生じる隙間にアンダーフィル樹脂が充填される場合の、該アンダーフィル樹脂の外方への流れ出しを防止するためのものである。
この枠状樹脂ダム20は、やはりレジストをスクリーン印刷して形成してもよいし、感光性レジストを塗布し、露光、現像して形成してもよい。
【0012】
図3〜図6は、スーパージャフィット法により、金属パッド16上にはんだ薄層を形成する工程を示す。
このスーパージャフィット法は、特開平7−7244号公報等に示されるように公知の方法である。
すなわち、まず、同公報に示されるように、粘着性付与化合物(イミダゾール系化合物など)の溶液に基板12を浸漬処理、または基板12に該粘着性付与化合物の溶液を塗布することにより、金属露出部である金属パッド16上に薄い接着剤層22を形成する(図3)。
【0013】
次いで、図4に示すように、錫―銀合金等からなる小径のはんだ粉末24を基板12上に散布する。
次に、エアーガン(図示せず)等により高圧エアーを基板12上に吹き付け、金属パッド16、その他の露出している金属部分(金属パッド16に接続する配線部分など)以外に付着している余分なはんだ粉末24を除去する(図5)。
なお、高圧エアーでなく、純水をスプレーノズル(図示せず)により基板12上に噴霧して余分なはんだ粉末24を除去するようにしてもよい。純水を噴霧することにより、はんだ粉末が粉塵として飛散するのを防止できる。
【0014】
基板12上には、金属パッド16以外の樹脂表面上にも、静電気その他の粘着力により、付着力は強くないが余分なはんだ粉末24が付着している。この余分なはんだ粉末24を高圧エアー等により除去するのである。金属パッド16上に付着しているはんだ粉末24は、接着剤層22の強い粘着力によって金属パッド16表面上に強く付着していることから、高圧エアー等によっては除去されない。
【0015】
次いで、基板12を加熱炉(図示せず)内に収容して加熱し、はんだ粉末24をリフローして、金属パッド16上にはんだ薄層26をプリコーティングすることができる(請求項4の配線基板、図6)。
加熱炉内で加熱して、はんだ粉末24をリフローさせる際、金属パッド16に接続している配線部分(図示せず)に付着しているはんだ粉末も溶融するが、この配線部分は微細で面積が小さいことから、当該配線部分上の溶融はんだは、金属パッド16上の溶融はんだの表面張力によって引っ張られ、金属パッド16上に集積してはんだ薄層26に形成される。
【0016】
なお、保護レジスト層18が大きく後退して、金属パッド16に接続する配線部分が長く露出すると、該配線部分が微細であるとしても、トータルの面積は大きくなって、該配線部分上で溶融したはんだに、金属パッド16上の溶融はんだの表面張力が及ばなくなり、該配線部分にはんだが残ってしまうので、保護レジスト層18の開口部(チップ搭載エリア)はあまり大きくならないようにする。
【0017】
そのための目安として、保護レジスト層18の開口部の大きさは、図7に示すように、搭載される半導体チップ30とチップ搭載部14を囲む保護レジスト層18の内端エッジ部との間に、少なくとも、アンダーフィル樹脂32が浸入可能な隙間n(200μm程度)が形成されように、必要最小限の大きさとするようにするとよい。
【0018】
なお、上記実施の形態では、枠状樹脂ダム20を、はんだ薄層26を形成する前の段階で形成したが、図6に示す、はんだ薄層26を形成した後の工程で形成するようにしてもよい。
【0019】
上記のように、はんだ薄層26を形成した後、端子上に金バンプを形成した半導体チップ(ベアチップ)30を常法によりフリップチップ接続して搭載することができる(図7)。
また、半導体チップ30とチップ搭載エリア14との対向面間に生じる隙間にエポキシ樹脂等の比較的低粘性のアンダーフィル樹脂32を充填する。
【0020】
このアンダーフィル樹脂32の注入は、ディスペンサーのノズル(図示せず)を、半導体チップ30の一辺に沿わせて移動させることにより行う。アンダーフィル樹脂32は、隙間nから、半導体チップ30とチップ搭載エリア14との対向面間に生じる隙間に毛細管現象により浸透し、該隙間を埋める。
【0021】
枠状樹脂ダム20は、半導体チップの搭載密度を高くするため、小型化するためには、半導体チップ30に接近させて設けるのがよいが、例えば、枠状樹脂ダム20の内端エッジ部を保護レジスト層18の内端エッジ部と一致させるなど、枠状樹脂ダム20を半導体チップ30にあまり接近させて形成すると、間隙nの長さが短くなって、アンダーフィル樹脂32が浸透しにくくなる。また、ディスペンサーのノズルが入らなくなり、該ノズルを半導体チップ30の一辺に沿って移動させられなくなる。
【0022】
そこで、枠状樹脂ダム20は、保護レジスト層18上であって、保護レジスト層18の内端エッジ部から所要距離外方に離れた位置、具体的には、搭載される半導体チップ30の外壁と枠状樹脂ダム20内壁との間(間隔p)が、少なくともアンダーフィル樹脂32を注入するディスペンサーのノズルが移動可能な空間が形成される距離だけ離れるようにするとよい(図7)。
【0023】
上記隙間に充填されたアンダーフィル樹脂32は低粘性であって、外方に流れ出しやすいが、図7に示すように、枠状樹脂ダム20によって堰き止められ、かつ、該アンダーフィル樹脂32が半導体チップ30側壁部を這い上がってフィレット部34が形成される。このフィレット部34が形成されることによって、半導体チップ30が強固に接合されるのである(請求項5の実装構造)。
【0024】
【発明の効果】
以上のように、本発明によれば、アンダーフィル樹脂の流れ出しを効果的に防止することのできる配線基板および配線基板への半導体チップ実装構造を提供することができる。
【図面の簡単な説明】
【図1】チップ搭載部を示す配線基板の説明図である。
【図2】枠状樹脂ダムを形成した配線基板の説明図である。
【図3】金属パッド上に接着剤層を形成した状態の説明図である。
【図4】基板上にはんだ粉末を散布した状態の説明図である。
【図5】余分なはんだ粉末を除去した状態の説明図である。
【図6】金属パッド上にはんだ薄層をプリコーティングした状態の説明図である。
【図7】半導体チップを搭載し、アンダーフィル樹脂を充填した状態の実装構造を示す説明図である。
【符号の説明】
10 配線基板
12 基板
14 チップ搭載エリア
16 金属パッド
18 保護レジスト層
20 枠状樹脂ダム
22 接着剤層
24 はんだ粉末
26 はんだ薄層
30 半導体チップ
32 アンダーフィル樹脂
34 フィレット部

Claims (5)

  1. 半導体チップがフリップチップ接続によって搭載されるチップ搭載エリアを囲んで保護レジスト層が設けられ、前記チップ搭載エリア内に、金属パッドが所要パターンで露出して形成された配線基板において、
    前記搭載される半導体チップとチップ搭載エリアとの対向面間に生じる隙間にアンダーフィル樹脂が充填される場合の、該アンダーフィル樹脂の外方への流れ出しを防止するための枠状樹脂ダムが、前記保護レジスト層上であって、前記チップ搭載エリアを囲む保護レジスト層の内端エッジ部から所要距離外方に離れた位置に形成されていることを特徴とする配線基板。
  2. 搭載される半導体チップと前記チップ搭載部を囲む保護レジスト層の内端エッジ部との間に、アンダーフィル樹脂が浸入可能な隙間が形成されていることを特徴とする請求項1記載の配線基板。
  3. 搭載される半導体チップの外壁と前記枠状樹脂ダム内壁との間が、少なくともアンダーフィル樹脂を注入するディスペンサーのノズルが移動可能な空間が形成される距離だけ離れていることを特徴とする請求項1または2記載の配線基板。
  4. 前記金属パッドの表面にはんだ薄層が形成されていることを特徴とする請求項1〜3いずれか1項記載の配線基板。
  5. 請求項4記載の配線基板のチップ搭載エリア内に半導体チップがフリップチップ接続して搭載され、
    該半導体チップとチップ搭載エリアとの隙間にアンダーフィル樹脂が充填され、該アンダーフィル樹脂が半導体チップ側壁部を這い上がってフィレット部が形成されると共に、保護レジスト層上に流れ出たアンダーフィル樹脂が枠状樹脂ダムによって堰き止められていることを特徴とする配線基板への半導体チップ実装構造。
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Cited By (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2008218708A (ja) * 2007-03-05 2008-09-18 Fujitsu Ltd 樹脂充填装置、充填方法および電子装置の製造方法
KR20090063117A (ko) * 2007-12-12 2009-06-17 신꼬오덴기 고교 가부시키가이샤 배선 기판 및 반도체 장치
JP2009212228A (ja) * 2008-03-03 2009-09-17 Shinko Electric Ind Co Ltd 配線基板及びその製造方法
US7825499B2 (en) 2007-06-27 2010-11-02 Shinko Electric Industries Co., Ltd. Semiconductor package and trenched semiconductor power device using the same
US7911018B2 (en) 2007-10-30 2011-03-22 Panasonic Corporation Optical device and method of manufacturing the same
US8109432B2 (en) 2005-07-11 2012-02-07 Showa Denko K.K. Method for attachment of solder powder to electronic circuit board and solder-attached electronic circuit board
US8123111B2 (en) 2005-03-29 2012-02-28 Showa Denko K.K. Production method of solder circuit board
JP2013062472A (ja) * 2011-09-15 2013-04-04 Toppan Printing Co Ltd 半導体パッケージおよびその製造方法
JP2014123702A (ja) * 2012-12-24 2014-07-03 Samsung Electro-Mechanics Co Ltd 印刷回路基板及び印刷回路基板の製造方法
KR20190000927U (ko) 2013-04-25 2019-04-19 미쓰비시 세이시 가부시키가이샤 프린트 배선판
KR20190065920A (ko) * 2017-12-04 2019-06-12 주식회사 비욘드아이즈 댐 구조를 갖는 프리즘 시트를 포함한 반도체 패키지

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4760361B2 (ja) * 2005-12-20 2011-08-31 ソニー株式会社 半導体装置
JP4438006B2 (ja) * 2007-03-30 2010-03-24 Okiセミコンダクタ株式会社 半導体装置及び半導体装置の製造方法

Family Cites Families (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3367886B2 (ja) * 1998-01-20 2003-01-20 株式会社村田製作所 電子回路装置
JP3420076B2 (ja) * 1998-08-31 2003-06-23 新光電気工業株式会社 フリップチップ実装基板の製造方法及びフリップチップ実装基板及びフリップチップ実装構造
JP2001257240A (ja) * 2000-03-13 2001-09-21 Toshiba Corp 半導体装置および半導体装置用基板

Cited By (17)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8123111B2 (en) 2005-03-29 2012-02-28 Showa Denko K.K. Production method of solder circuit board
US8109432B2 (en) 2005-07-11 2012-02-07 Showa Denko K.K. Method for attachment of solder powder to electronic circuit board and solder-attached electronic circuit board
JP2008218708A (ja) * 2007-03-05 2008-09-18 Fujitsu Ltd 樹脂充填装置、充填方法および電子装置の製造方法
US7825499B2 (en) 2007-06-27 2010-11-02 Shinko Electric Industries Co., Ltd. Semiconductor package and trenched semiconductor power device using the same
US7911018B2 (en) 2007-10-30 2011-03-22 Panasonic Corporation Optical device and method of manufacturing the same
US7977138B1 (en) 2007-10-30 2011-07-12 Panasonic Corporation Optical device and method of manufacturing the same
KR101578175B1 (ko) * 2007-12-12 2015-12-16 신꼬오덴기 고교 가부시키가이샤 배선 기판 및 반도체 장치
KR20090063117A (ko) * 2007-12-12 2009-06-17 신꼬오덴기 고교 가부시키가이샤 배선 기판 및 반도체 장치
US8693211B2 (en) 2007-12-12 2014-04-08 Shinko Electric Industries Co., Ltd. Wiring substrate and semiconductor device
JP2009212228A (ja) * 2008-03-03 2009-09-17 Shinko Electric Ind Co Ltd 配線基板及びその製造方法
JP2013062472A (ja) * 2011-09-15 2013-04-04 Toppan Printing Co Ltd 半導体パッケージおよびその製造方法
JP2014123702A (ja) * 2012-12-24 2014-07-03 Samsung Electro-Mechanics Co Ltd 印刷回路基板及び印刷回路基板の製造方法
KR20190000927U (ko) 2013-04-25 2019-04-19 미쓰비시 세이시 가부시키가이샤 프린트 배선판
KR20200000700U (ko) 2013-04-25 2020-04-02 미쓰비시 세이시 가부시키가이샤 프린트 배선판
KR20190065920A (ko) * 2017-12-04 2019-06-12 주식회사 비욘드아이즈 댐 구조를 갖는 프리즘 시트를 포함한 반도체 패키지
KR102475417B1 (ko) * 2017-12-04 2022-12-08 아크소프트 코포레이션 리미티드 댐 구조를 갖는 프리즘 시트를 포함한 반도체 패키지
US11580773B2 (en) 2017-12-04 2023-02-14 Arcsoft Corporation Limited Semiconductor package having self-aligned structure

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Publication number Publication date
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