JP2006030527A - 駆動回路 - Google Patents
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Abstract
【解決手段】 容量性負荷を用いる表示装置の駆動回路であって、電源電位に接続され、電力を時間的に分散させて容量性負荷に供給するように容量性負荷の電位を電源電位にクランプするクランプ回路を有する駆動回路が提供される。例えば、クランプ回路は、容量性負荷(120)及び電源電位(Vs)間に並列接続される複数のスイッチ(CU1,CU2)を有し、複数のスイッチは時間をずらしてオンする。
【選択図】 図1
Description
図18は本発明の第1の実施形態によるプラズマディスプレイ装置の構成例を示すブロック図、図19(A)〜(C)はプラズマディスプレイ装置の表示セルの断面図、図20は画像のフレーム構成図である。これらの説明は、上記と同じである。
図5(A)は本発明の第2の実施形態によるトランジスタCU1及びCU2の構成例を示す回路図であり、図5(B)はその動作を説明するためのタイミングチャートである。トランジスタCU1のゲートにはゲート抵抗R1が設けられ、トランジスタCU2のゲートにはゲート抵抗R2が設けられる。入力信号INは、ドライバ501を介してトランジスタCU1及びCU2のゲートに供給される。ここで、抵抗R1は、抵抗R2よりも小さい。
図6(A)はTERES(Technology of Reciprocal Sustainer)によるY電極サステイン回路の構成例を示す回路図であり、図6(B)及び(C)はY電極及びX電極の電圧波形を示す図である。このTERES回路は、図1のY電極サステイン回路と同様の電圧パルスを生成することができる。なお、図6(A)のTERES回路では、LC共振を行うための電力回収回路を省略し、クランプ回路のみを示している。
図17は、Y電極サステイン回路1701及びX電極サステイン回路1702の構成例を示す回路図である。サステイン回路1701及び1702の構成は同じである。スイッチCUは図1の並列スイッチCU1及びCU2の代わりに設けられ、スイッチCDは図1の並列スイッチCD1及びCD2の代わりに設けられる。その他の点は、図1と同じである。
図9は、本発明の第5の実施形態によるスイッチCU1及びCU2の制御方法を示すタイミングチャートである。本実施形態は、図1の回路構成を有する。スイッチCU2は、表示率が小さいときの制御信号911と表示率が大きいときの制御信号912とを切り替える。
図10(A)は、本発明の第6の実施形態によるトランジスタCUのゲート抵抗R1及びR2の構成例を示す回路図である。本実施形態の全体構成は、図17の構成を有する。ゲート抵抗R1及びスイッチSW1の直列接続とゲート抵抗R2及びスイッチSW2の直列接続とが並列に接続される。その並列接続は、トランジスタCUのゲート及びドライバ1001間に接続される。入力信号INは、ドライバ1001を介してトランジスタCUのゲートに供給される。本実施形態では、表示率に応じてトランジスタCUのゲート抵抗値を変える。ゲート抵抗R1は、ゲート抵抗R2よりも大きい。なお、抵抗R1及びR2は、それぞれスイッチSW1及びSW2の左側(1次側)に設けても、右側(2次側)に設けてもよい。
本発明の第7の実施形態の全体構成は、図17の構成を有する。
図11(A)は、本発明の第7の実施形態によるスイッチ(トランジスタ)CUのゲート電圧VGの制御方法を示すタイミングチャートである。本実施形態では、表示率に応じてゲート電圧VGを変える。ゲート電圧VGは、波形1121が表示率の大きいときの波形であり、波形1122が表示率の小さいときの波形である。
図12(A)〜(C)は、本発明の第8の実施形態によるX電極101及びY電極102のサステインパルスを示す波形図である。
図13(A)〜(D)は、本発明の第9の実施形態によるX電極101及びY電極102のサステインパルスを示す波形図である。○印は電力分散クランプを示し、△印は電力集中クランプを示す。
図14は、ALIS(Alternate Lighting of Surfaces)方式のプラズマディスプレイパネル装置の基本構成を示す図である。図14の装置が図18の装置と異なる点を説明する。Y電極サステイン回路1804a及び1804bは図18のY電極サステイン回路1804の代わりに設けられ、スキャンドライバ1805a及び1805bは図18のスキャンドライバ1805の代わりに設けられ、X電極サステイン回路1803a及び1803bは図18のX電極サステイン回路1803の代わりに設けられる。Y電極サステイン回路1804a及びスキャンドライバ1805aは、奇数番目のY電極Y1,Y3,・・・に電圧を供給する。Y電極サステイン回路1804b及びスキャンドライバ1805bは、偶数番目のY電極Y2,Y4,・・・に電圧を供給する。X電極サステイン回路1803aは、奇数番目のX電極X1,X3,・・・に電圧を供給する。X電極サステイン回路1803bは、偶数番目のX電極X2,X4,・・・に電圧を供給する。
図16は、本発明の第11の実施形態によるALIS方式のX電極X1,X2及びY電極Y1,Y2のサステインパルスを示す波形図である。第1のフィールドVS1は第1の垂直同期信号によるフィールド、第2のフィールドVS2は第2の垂直同期信号によるフィールド、第3のフィールドVS3は第3の垂直同期信号によるフィールド、第4のフィールドVS4は第4の垂直同期信号によるフィールド、第5のフィールドVS5は第5の垂直同期信号によるフィールドである。フィールドVS1〜VS4を1周期TTとして、繰り返す。○印は電力分散クランプを示し、△印は電力集中クランプを示す。
容量性負荷を用いる表示装置の駆動回路であって、
電源電位に接続され、電力を時間的に分散させて前記容量性負荷に供給するように前記容量性負荷の電位を前記電源電位にクランプするクランプ回路を有する駆動回路。
(付記2)
前記クランプ回路は、電力を時間的に分散させて前記容量性負荷に供給するように前記容量性負荷の電位を前記電源電位にクランプする電力分散クランプと、電力を時間的に集中させて前記容量性負荷に供給するように前記容量性負荷の電位を前記電源電位にクランプする電力集中クランプとを選択的に行う付記1記載の駆動回路。
(付記3)
前記クランプ回路は、前記容量性負荷及び前記電源電位間に並列接続される複数のスイッチを有し、
前記電力分散クランプは前記複数のスイッチを時間的にずらしてオンし、
前記電力集中クランプは前記複数のスイッチを同時にオンする付記2記載の駆動回路。
(付記4)
前記クランプ回路は、前記電力集中クランプによるパルスと前記電力分散クランプによるパルスとを交互に生成する付記2記載の駆動回路。
(付記5)
前記クランプ回路は、前記容量性負荷及び前記電源電位間に並列接続される複数のスイッチを有し、前記複数のスイッチは時間をずらしてオンする付記1記載の駆動回路。
(付記6)
前記クランプ回路は、前記容量性負荷及び前記電源電位間に並列接続される複数の電界効果トランジスタを有し、前記複数の電界効果トランジスタのゲート抵抗は相互に異なる値である付記1記載の駆動回路。
(付記7)
前記クランプ回路は、第1の電源電位及び第2の電源電位間に直列接続される第1のスイッチ、容量及び第2のスイッチとを有し、前記容量の一端が前記容量性負荷に接続可能であり、前記第1及び第2のスイッチは時間をずらしてオンする付記1記載の駆動回路。
(付記8)
前記クランプ回路は、表示画素数の割合を示す表示率に応じて電力分散クランプ又は電力集中クランプを選択する付記2記載の駆動回路。
(付記9)
前記クランプ回路は、前記電源電位及び前記容量性負荷間の抵抗値を比較的大きくすることにより電力分散クランプを行い、前記電源電位及び前記容量性負荷間の抵抗値を比較的小さくすることにより電力分散クランプを行う付記2記載の駆動回路。
(付記10)
前記クランプ回路は、前記容量性負荷及び前記電源電位間に並列接続される複数のスイッチを有し、
前記電力分散クランプは前記複数のスイッチを時間的にずらしてオンし、
前記電力集中クランプは前記複数のスイッチを同時にオンする付記8記載の駆動回路。
(付記11)
前記クランプ回路は、前記容量性負荷及び前記電源電位間に接続される電界効果トランジスタを有し、
前記電力分散クランプと前記電力集中クランプとでは前記電界効果トランジスタのゲート抵抗値を変える付記2記載の駆動回路。
(付記12)
前記電力分散クランプでは前記電界効果トランジスタのゲート抵抗を比較的大きくし、
前記電力集中クランプでは前記電界効果トランジスタのゲート抵抗を比較的小さくする付記11記載の駆動回路。
(付記13)
前記クランプ回路は、前記容量性負荷及び前記電源電位間に接続される電界効果トランジスタを有し、
前記電力分散クランプと前記電力集中クランプとでは前記電界効果トランジスタのゲート電圧を変える付記2記載の駆動回路。
(付記14)
前記電力分散クランプでは前記電界効果トランジスタのゲート電圧を比較的低くし、
前記電力集中クランプでは前記電界効果トランジスタのゲート電圧を比較的高くする付記13記載の駆動回路。
(付記15)
前記クランプ回路は、前記容量性負荷及び前記電源電位間に接続される電界効果トランジスタを有し、前記電界効果トランジスタのゲート電圧を段階的に変化させてクランプする付記1記載の駆動回路。
(付記16)
前記クランプ回路は、前記電源電位にクランプするパルスの立ち上がり又は立ち下がりにより前記容量性負荷の電極間で放電させる付記1記載の駆動回路。
(付記17)
前記クランプ回路は、前記電力分散クランプによるパルスの幅を前記電力集中クランプによるパルスの幅よりも広くする付記2記載の駆動回路。
(付記18)
前記容量性負荷は第1及び第2の表示電極を有し、
前記クランプ回路は、前記第1の表示電極に接続される第1のクランプ回路と、前記第2の表示電極に接続される第2のクランプ回路を有し、
前記第1及び第2のクランプ回路は、
電源電位に接続され、電力を時間的に分散させて前記容量性負荷に供給するように前記容量性負荷の電位を前記電源電位にクランプする付記1記載の駆動回路。
(付記19)
前記表示装置は第1及び第2の表示電極が交互に複数配置され、
前記容量性負荷は1組の第1及び第2の表示電極を有し、
前記第1の表示電極は、両隣の前記第2の表示電極との間で表示のための放電が可能である付記18記載の駆動回路。
(付記20)
前記第1及び第2のクランプ回路は、電力を時間的に分散させて前記容量性負荷に供給するように前記容量性負荷の電位を前記電源電位にクランプする電力分散クランプと、電力を時間的に集中させて前記容量性負荷に供給するように前記容量性負荷の電位を前記電源電位にクランプする電力集中クランプとを選択的に行う付記18記載の駆動回路。
(付記21)
前記第1及び第2のクランプ回路は、前記電力分散クランプによるパルスと前記電力集中クランプによるパルスとの生成割合が同じである付記20記載の駆動回路。
102 Y電極(スキャン電極)
120 容量(容量性負荷)
CU1,CU2,CD1,CD2 スイッチ
1801 制御回路部
1802 アドレスドライバ
1803,1803a,1803b X電極サステイン回路
1804,1804a,1804b Y電極サステイン回路
1805,1805a,1805b スキャンドライバ
1806 リブ
1807 表示領域
1911 前面ガラス基板
1912 誘電体層
1913 Mgo保護膜
1914 背面ガラス基板
1915 誘電体層
1916 リブ
1917 放電空間
1921 光
Tr リセット期間
Ta アドレス期間
Ts サステイン期間
Claims (10)
- 容量性負荷を用いる表示装置の駆動回路であって、
電源電位に接続され、電力を時間的に分散させて前記容量性負荷に供給するように前記容量性負荷の電位を前記電源電位にクランプするクランプ回路を有する駆動回路。 - 前記クランプ回路は、電力を時間的に分散させて前記容量性負荷に供給するように前記容量性負荷の電位を前記電源電位にクランプする電力分散クランプと、電力を時間的に集中させて前記容量性負荷に供給するように前記容量性負荷の電位を前記電源電位にクランプする電力集中クランプとを選択的に行う請求項1記載の駆動回路。
- 前記クランプ回路は、前記容量性負荷及び前記電源電位間に並列接続される複数のスイッチを有し、
前記電力分散クランプは前記複数のスイッチを時間的にずらしてオンし、
前記電力集中クランプは前記複数のスイッチを同時にオンする請求項2記載の駆動回路。 - 前記クランプ回路は、前記容量性負荷及び前記電源電位間に並列接続される複数のスイッチを有し、前記複数のスイッチは時間をずらしてオンする請求項1記載の駆動回路。
- 前記クランプ回路は、前記容量性負荷及び前記電源電位間に並列接続される複数の電界効果トランジスタを有し、前記複数の電界効果トランジスタのゲート抵抗は相互に異なる値である請求項1記載の駆動回路。
- 前記クランプ回路は、第1の電源電位及び第2の電源電位間に直列接続される第1のスイッチ、容量及び第2のスイッチとを有し、前記容量の一端が前記容量性負荷に接続可能であり、前記第1及び第2のスイッチは時間をずらしてオンする請求項1記載の駆動回路。
- 前記クランプ回路は、前記電源電位及び前記容量性負荷間の抵抗値を比較的大きくすることにより電力分散クランプを行い、前記電源電位及び前記容量性負荷間の抵抗値を比較的小さくすることにより電力分散クランプを行う請求項2記載の駆動回路。
- 前記クランプ回路は、前記容量性負荷及び前記電源電位間に接続される電界効果トランジスタを有し、
前記電力分散クランプと前記電力集中クランプとでは前記電界効果トランジスタのゲート抵抗値を変える請求項2記載の駆動回路。 - 前記クランプ回路は、前記容量性負荷及び前記電源電位間に接続される電界効果トランジスタを有し、
前記電力分散クランプと前記電力集中クランプとでは前記電界効果トランジスタのゲート電圧を変える請求項2記載の駆動回路。 - 前記クランプ回路は、前記容量性負荷及び前記電源電位間に接続される電界効果トランジスタを有し、前記電界効果トランジスタのゲート電圧を段階的に変化させてクランプする請求項1記載の駆動回路。
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