JP2005045162A - 半導体素子およびその製造方法 - Google Patents
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Abstract
【解決手段】下クラッド層2、活性層1、上クラッド層3の順に積層され、これらの積層面内に導波路7となる線状欠陥領域を導入した周期的屈折率分布構造が形成されたシート状のスラブ層4が基板5によって支持される2次元スラブフォトニック結晶構造を有する半導体素子10であって、スラブ層4の積層面に対して所定の角度を持ってpn接合面が形成されるように、スラブ層4内にp型領域とn型領域を形成する。
【選択図】 図1−2
Description
図1−1と図1−2は、この発明にかかる半導体素子を模式的に示す図であり、図1−1は、半導体素子の全体構成を示す斜視図であり、図1−2は、図1−1の半導体素子におけるA−A断面図である。
図5−1と図5−2は、実施の形態1で製造した半導体素子にさらに電流注入を行なうための電極を形成した半導体素子の構成を模式的に示す図であり、図4−1は半導体素子の平面図であり、図5−2は図5−1における半導体素子のB−B断面図である。
図6−1は、電極を形成した半導体素子の実施の形態3の構成を模式的に示す断面図である。この実施の形態3では、電極8とスラブ層4との間でオーミックコンタクトを得るために、2次元スラブフォトニック結晶(上クラッド層3)と電極8との間に、InGaAsなどのオーミックコンタクト層9を最上層として形成することを特徴とする。ただし、オーミックコンタクト層9は、レーザ発光部の上部に残してしまうと光吸収層として機能してしまうので、2次元屈折率周期構造から除去する必要がある。また、図6−2と図6−3に示されるように、オーミックコンタクト層9bを下クラッド層2の下方にも形成してもよい。たとえば、図6−2に示されるように、n型電極8n側の半導体素子を、後述するように異方性エッチングによって基板5から上クラッド層3までの断面を露出させて、露出した下部のオーミックコンタクト層9b上にn側電極8nを形成してもよい。また、図6−3に示されるように、n型電極8n側の基板5を下部のオーミックコンタクト層9bが露出するように除去し、この除去した部分にn側電極8nを形成してもよい。
図8〜図10は、電極を形成した半導体素子の実施の形態4の構成を模式的に示す断面図である。これらの図8〜図10に示されるように、この実施の形態4では、一方の電極8の取り付け位置を、上クラッド層3よりも下側の低い位置とすることを特徴とする。
図11は、電極を形成した半導体素子の実施の形態5の構成を模式的に示す断面図である。この図11に示されるように、この実施の形態5では、結晶方位を利用した異方性ウエットエッチングを用いて電極形成部を水平方向に対して傾斜して形成することを特徴とする。
2 下クラッド層
3 上クラッド層
4 スラブ層
5,21 基板
6 空気穴構造
7 線状欠陥
8 電極
9,9b オーミックコンタクト層
10 半導体素子
11 ZnO層
12 マスク層
13 露光用レジスト
14 誘電体マスク層
15 露光用レジスト層
16,17 フォトマスク
20 誘電体層
Claims (33)
- 下クラッド層、活性層、上クラッド層の順に積層され、これらの積層面内に導波路となる線状欠陥領域を導入した周期的屈折率分布構造が形成されたシート状のスラブ層が基板によって支持される2次元スラブフォトニック結晶構造を有する半導体素子、あるいはシート状スラブ層が誘電体層に積層保持される2次元スラブフォトニック結晶構造を有する半導体素子、あるいは周期的屈折率分布構造を有するシート状のスラブ層が中実の半導体層に積層保持される2次元スラブフォトニック結晶構造を有する半導体素子であって、
前記スラブ層の積層面に対して所定の角度を持ってpn接合面が形成されるように、前記スラブ層内にp型領域とn型領域を形成することを特徴とする半導体素子。 - 前記pn接合面と前記スラブ層の積層面との交線の方向が前記線状欠陥領域の伸長方向とほぼ同じ方向であることを特徴とする請求項1に記載の半導体素子。
- 前記pn接合は、GaAs,InGaAsP,AlGaAs,GaP,GaAsP,AlGaInP,GaInNAsからなる群より選択される少なくとも1種以上によって構成されるn型の前記活性層または前記クラッド層に、Zn,Be,Cd,Si,Ge,C,Mgの元素からなる群より選択される少なくとも1種以上の元素をp型ドーパントとして使用して形成されることを特徴とする請求項1または2に記載の半導体素子。
- 前記pn接合は、GaAs,InGaAsP,AlGaAs,GaP,GaAsP,AlGaInP,GaInNAsからなる群より選択される少なくとも1種以上によって構成されるp型の前記活性層または前記クラッド層に、Si,Ge,S,Sn,Teの元素からなる群より選択される少なくとも1種以上の元素をn型ドーパントとして使用して形成されることを特徴とする請求項1または2に記載の半導体素子。
- 前記p型領域に配置される第1の電極と、前記n型領域に配置される第2の電極をさらに備え、
前記活性層は、前記スラブ層の積層面とほぼ平行に形成され、
前記第1と前記第2の電極は、前記活性層にほぼ平行に電流を注入するように配置されることを特徴とする請求項1に記載の半導体素子。 - 前記第1と前記第2の電極は、前記スラブ層に接し前記線状欠陥を挟んでほぼ対称的な位置に形成されることを特徴とする請求項5に記載の半導体素子。
- 前記基板は、半絶縁性の基板であることを特徴とする請求項5に記載の半導体素子。
- 前記基板は、半導体基板であり、
前記スラブ層は、半絶縁性層またはアンドープ層が堆積された前記半導体基板上に形成されることを特徴とする請求項5に記載の半導体素子。 - 前記下クラッド層は、n型ドーパントがドープされた下クラッド層であり、前記上クラッド層は、p型ドーパントがドープされた上クラッド層であることを特徴とする請求項8に記載の半導体素子。
- 前記下クラッド層は、p型ドーパントがドープされた下クラッド層であり、前記上クラッド層は、n型ドーパントがドープされた上クラッド層であることを特徴とする請求項8に記載の半導体素子。
- 前記スラブ層は、アンドープの前記上および下クラッド層にn型の活性層が挟まれる構成を有し、少なくとも前記n型の活性層の一部にp型領域を形成し、前記活性層のp型領域のみに接する前記上および下クラッド層部分はp型領域またはアンドープであることを特徴とする請求項8に記載の半導体素子。
- 前記スラブ層は、アンドープの前記上および下クラッド層にp型の活性層が挟まれる構成を有し、少なくとも前記p型の活性層の一部にn型領域を形成し、前記活性層のn型領域のみに接する前記上および下クラッド層部分はn型領域またはアンドープであることを特徴とする請求項8に記載の半導体素子。
- 前記第1と前記第2の電極と前記スラブ層の間に、オーミックコンタクトを取るためのオーミックコンタクト層がさらに形成されることを特徴とする請求項5に記載の半導体素子。
- 前記オーミックコンタクト層は、前記周期的屈折率分布構造の上下部には形成されないことを特徴とする請求項13に記載の半導体素子。
- 前記オーミックコンタクト層は、前記スラブ層の積層面内で、前記線状欠陥の幅方向の中心からこの方向に10μm以上離れずに形成されることを特徴とする請求項13に記載の半導体素子。
- 前記第1と前記第2の電極のうち少なくともいずれか1つの電極の取り付け位置に存在する前記上クラッド層と前記活性層を除去して前記下クラッド層を露出させ、この露出した下クラッド層上に前記電極を形成することを特徴とする請求項5に記載の半導体素子。
- 前記第1と前記第2の電極のうち少なくともいずれか1つの電極の取り付け位置に存在する前記スラブ層の一部を、前記スラブ層の積層面とほぼ平行に除去して階段状の段差を設け、前記段差部分に前記電極を形成することを特徴とする請求項5に記載の半導体素子。
- 前記電極の取り付け位置に存在する前記スラブ層の一部として、前記上クラッド層のみを除去することを特徴とする請求項17に記載の半導体素子。
- 前記電極の取り付け位置に存在する前記スラブ層の一部として、前記上クラッド層と前記活性層を除去することを特徴とする請求項17に記載の半導体素子。
- 前記電極は、その側面が前記階段状の段差の側面部と接触しないように形成されることを特徴とする請求項19に記載の半導体素子。
- 前記スラブ層の一部を、前記スラブ層の積層面に対して所定の角度で傾斜する面に沿って前記活性層を含む前記スラブ層の断面を露出させ、この露出した断面に前記電極を形成することを特徴とする請求項5に記載の半導体素子。
- 前記電極は、前記活性層と前記下クラッド層に接触させて形成されることを特徴とする請求項21に記載の半導体素子。
- 前記電極は、前記下クラッド層のみに電極を接触させて形成されることを特徴とする請求項21に記載の半導体素子。
- 前記電極と前記スラブ層の間に、オーミックコンタクトを取るためのオーミックコンタクト層がさらに形成されることを特徴とする請求項16〜23のいずれか1つに記載の半導体素子。
- 前記基板はAlを含む材料から構成され、前記基板の前記下クラッド層との接触部から所定の厚さの部分に前記Alを酸化した誘電体層を形成することを特徴とする請求項5に記載の半導体素子。
- 基板上に、下クラッド層と活性層と上クラッド層からなるスラブ層を順に積層する第1の工程と、
前記スラブ層の積層面に対して所定の角度を持ってpn接合面を形成する第2の工程と、
前記上クラッド層上に電極を取り付けるためのオーミックコンタクト層を形成する第3の工程と、
前記スラブ層と前記オーミックコンタクト層に、導波路となる線状欠陥領域を導入した周期的な空気穴構造を形成する第4の工程と、
前記スラブ層内のp型領域とn型領域のそれぞれの前記オーミックコンタクト層上に電極を形成する第5の工程と、
前記オーミックコンタクト層を除去する第6の工程と、
前記スラブ層をシート状にするために、前記基板内部を中空状にアンダカットする第7の工程と、
を含むことを特徴とする半導体素子の製造方法。 - 基板上に、下クラッド層と活性層と上クラッド層からなるスラブ層を順に積層する第1の工程と、
前記スラブ層の積層面に対して所定の角度を持ってpn接合面を形成する第2の工程と、
前記上クラッド層上に電極を取り付けるためのオーミックコンタクト層を形成する第3の工程と、
前記スラブ層と前記オーミックコンタクト層に、導波路となる線状欠陥領域を導入した周期的な空気穴構造を形成する第4の工程と、
前記スラブ層内のp型領域とn型領域のそれぞれの前記オーミックコンタクト層上に電極を形成する第5の工程と、
前記オーミックコンタクト層を除去する第6の工程と、
前記半導体スラブ層を形成するため下部または上下部のAl含有層を酸化して誘電体層にする第7の工程と、
を含むことを特徴とする半導体素子の製造方法。 - 第1の基板上に、下クラッド層と活性層と上クラッド層からなるスラブ層を順に積層する第1の工程と、
前記スラブ層の積層面に対して所定の角度を持ってpn接合面を形成する第2の工程と、
前記上クラッド層上に電極を取り付けるためのオーミックコンタクト層を形成する第3の工程と、
前記スラブ層と前記オーミックコンタクト層に、導波路となる線状欠陥領域を導入した周期的な空気穴構造を形成する第4の工程と、
前記半導体スラブ層を形成するため下部または上下部を除去する第5の工程と、
前記第1の基板とは別に用意した第2の基板を前記第1の基板に融着接続する第6の工程と、
融着形成後の前記第2の基板上にあるp型およびn型領域のオーミックコンタクト層に接して電極を形成する第7の工程と、
を含むことを特徴とする半導体素子の製造方法。 - 前記第1の工程で積層される前記活性層または前記上下クラッド層は、n型の化合物半導体によって形成され、
前記第2の工程で、前記スラブ層の所定の領域にp型ドーパントを拡散させることを特徴とする請求項26または27に記載の半導体素子の製造方法。 - 前記第1の工程で積層される前記活性層または前記上下クラッド層は、p型の化合物半導体によって形成され、
前記第2の工程で、前記スラブ層の所定の領域にn型ドーパントを拡散させることを特徴とする請求項26または27に記載の半導体素子の製造方法。 - 前記第2の工程でpn接合面を形成したときに、pn接合の位置を識別することが可能なアライメントマークをさらに前記スラブ層上に形成し、
前記第6の工程では、前記アライメントマークを基準にして定めた所定の領域の前記オーミックコンタクト層を除去することを特徴とする請求項26または27に記載の半導体素子の製造方法。 - 前記第2の工程で、pn接合面を形成したときに、pn接合の位置を識別することが可能なアライメントマークをさらに前記スラブ層状に形成し、
前記第4の工程では、前記アライメントマークを基準にして前記スラブ層と前記オーミックコンタクト層上に形成する前記周期的な空気穴構造の位置合わせを行うことを特徴とする請求項26または27に記載の半導体素子の製造方法。 - 基板上に、下クラッド層と活性層と上クラッド層からなるスラブ層を順に積層する第1の工程と、
前記上クラッド層上に電極を取り付けるためのオーミックコンタクト層を形成する第2の工程と、
前記スラブ層と前記オーミックコンタクト層に、導波路となる線状欠陥領域を導入した周期的な空気穴構造を形成する第3の工程と、
前記スラブ層の積層面に対して所定の角度を持ってpn接合面を形成する第4の工程と、
前記スラブ層内のp型領域とn型領域のそれぞれの前記オーミックコンタクト層上に電極を形成する第5の工程と、
前記オーミックコンタクト層を除去する第6の工程と、
前記スラブ層をシート状にするために、前記基板内部を中空状にアンダカットする第7の工程と、
を含むことを特徴とする半導体素子の製造方法。
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