JP2004311935A - 単結晶シリコン膜の製造方法 - Google Patents
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Abstract
【課題】結晶化用で、より簡単なマスクを使用して、容易な方法で所望の位置に望みの大きさで単結晶Siを形成させる方法を提供する。
【解決手段】透明又は半透明の基板上に半導体層又は金属薄膜を形成する段階と、レーザー照射を用いた結晶化方法で前記半導体層又は金属薄膜が形成された基板上に所望の大きさの単結晶シード領域を形成する段階と、前記単結晶シード領域をシード(seed)として、前記半導体層又は金属薄膜の所望の領域を単結晶領域に変換させる段階とを含んで構成される。
【選択図】図14
【解決手段】透明又は半透明の基板上に半導体層又は金属薄膜を形成する段階と、レーザー照射を用いた結晶化方法で前記半導体層又は金属薄膜が形成された基板上に所望の大きさの単結晶シード領域を形成する段階と、前記単結晶シード領域をシード(seed)として、前記半導体層又は金属薄膜の所望の領域を単結晶領域に変換させる段階とを含んで構成される。
【選択図】図14
Description
本発明は半導体薄膜の製造方法に関するものであり、より詳細にはレーザー照射(irradiation)とレーザー照射される半導体薄膜がある基板上で、非晶質または多結晶質の薄膜から所望の位置に所望の大きさで単結晶の薄膜を得ることができる単結晶シリコン膜の製造方法に関するものである。
一般的に、LCDや、有機EL材料を利用したOLED(Organic Light Emitting Diode)等に利用される中心(core)スイッチング素子である薄膜トランジスタ(Thin Film Transistor:以下TFTと記す)は、上記デバイスの平板ディスプレイ(Flat Panel Display、以下FPDと記す)の性能に対して最も重要な半導体装置である。
TFTの性能を判断する基準である移動度(mobility)や漏洩電流(leakage current)等は電荷搬送体が移動する経路(channel)である活性層(active layer)を形成するシリコン(Si)薄膜がどのような状態(state)またはどのような構造(structure)を有するかによって大きく左右される。現在商用化されているLCDの場合、大部分のTFTの活性層が非晶質シリコン(amorphous Si:以下a−Siと記す)薄膜である。
a−Siを利用したa−Si TFTは移動度が約0.5cm2/Vsと非常に低いために、a−Si TFTを用いてLCDに入っている要求されるすべてのスイッチング素子を作るには制限がある。これはLCDの周辺回路用スイッチング素子の場合、非常に速いスピードでの動作が要求され、この高速動作をa−Si TFTでは達成できないためである。
したがって、周辺回路用スイッチング部品、例えば、駆動回路(driver circuit)、種々のコントローラ、そしてデジタル−アナログ−コンバーター(Digital−Analogue−Converter、DAC)等は、LCD駆動に要求される速いスピードに対応するように、単結晶Si上に集積されたスイッチング素子で形成される。一方、a−Si TFTの場合、スイッチング機能を有すると同時に画質を確保するのに必須的な低い漏洩電流特性を示すために、画素スイッチング素子として用いられる。
多結晶Si(poly−Si)を利用したTFTは、移動度が数十〜数百cm2/Vsと高いために周辺回路用に対応可能な高い駆動速度を出すことができる。そのためにガラス基板上にpoly−Siを形成すれば、画素領域だけでなく周辺回路領域まで具現が可能になる。
したがって、poly−Siの場合、周辺回路形成に要求される別個の部品実装工程が必要でなく、画素領域を形成する時、共に周辺回路まで形成することができ、周辺回路用の部品費用の節減を期待することができる。それだけでなく、poly−Siは高い移動度のために、既存a−Siより小さくTFTを作ることができ、集積工程を通じて周辺回路と画素領域とを形成させることができるために、線幅の微細化がより容易になってa−Si TFT−LCDに比べて高解像度を実現できる。
また、poly−Si TFTは、高い電流特性を出すことができるために、次世代FPDの電流駆動型のディスプレイであるOLEDでの使用に適している。よって、近年ガラス基板上でpoly−Siを形成させてTFTを製作する研究が活発である。
poly−Siをガラス基板上で形成させるためには、a−Siを蒸着後に所定の熱処理によってpoly−Siを結晶化させる方法が代表的に用いられているが、ガラス基板が600℃以上の高温では変形してしまうために、基板に熱的損傷を与えずに、a−Siのみを結晶化させるエキシマレーザーアニール(Excimer Laser Annealing:以下ELAと記す)が代表的な結晶化方法として用いられている。一般に、ELAによる結晶化時、a−Siはレーザーを照射され、a−Siが溶融(melting)されて再び凝固(solidification)されてpoly−Siが生成される。結晶化時に結晶粒はランダム(random)に形成されて、レーザー照射条件によって数十nm〜数μmまでの多様な大きさを有する。
一般的に結晶粒の大きさが大きいほどTFT素子の移動度が大きくなって、周辺回路集積時に集積できる部品の範囲が広くなるために、可能な限り大きい結晶粒を得ることができるELA条件を得ることが好ましいが、結晶粒の大きさが大きくなるほど結晶粒分布の均一性(uniformity)が悪くなり、これは素子特性の均一性の低下が誘発されて結果的に信頼性に問題が発生するようになる。
したがって、ELA結晶化されたpoly−SiをLCDに適用する時は、均一性が保証される範囲で適当な大きさの結晶粒を有するpoly−Siが適用される。しかし、この時、結晶粒大きさの制限のために高い移動度を有するpoly−Si TFTを製作できなく、したがって周辺回路集積においても制限が必要である。
近年、米国特許において均一性を保証しながら結晶粒大きさが大きい結晶化方法が開示されたが(例えば、特許文献1及び2参照)。
この順次側面凝固(Sequential Lateral Solidification:以下SLSと記す)と呼ばれるこの方法の原理を説明すると次の通りである。
この順次側面凝固(Sequential Lateral Solidification:以下SLSと記す)と呼ばれるこの方法の原理を説明すると次の通りである。
図1は、SLS工程を実行するためのレーザーシステムの概略図であり、図に示すように、a−Si膜120が蒸着された基板110がステージ100上に載っており、マスク140を通してレーザービーム130の最初の(一次)照射を行うものである。この時、マスク140には多様なパターンが可能である。
その代表的な例は、図2に示したスリット形状のマスク200である。マスク200内には幅220と長さ230を有するスリット210がパターンになっていて、このマスクを通してレーザーを1次的に照射するとマスクを通過したレーザーは単位線束(beamlet)形態で照射され、照射されるレーザーのエネルギーはa−Siを完全に溶融させる程である。
図5はスリットのひとつを拡大したものを示す。レーザーが照射される前の状況であり、参照符号310はスリット330で露出される領域の幅を示して、レーザー照射露出される前にはa−Si320が存在する。図6はスリットを通してレーザーが照射された直後を示す(レーザーは数十ns程度の間のみ照射され遮断された状態である)。
この時、露出された領域は溶融されて液状シリコン360となった状態であり、スリットの縁付近に液状シリコン360とa−Siシリコン340との境界が形成され、その境界部分には微細な大きさのpoly−Si350が形成される。時間が経過するにつれて、poly−Si350をシード(seed)として結晶粒の成長がスリット中心部に向かって進行される。結晶粒の成長過程で成長速度が遅い結晶粒は、成長速度が速い結晶粒370により成長が遮断されて一部結晶粒のみが引続き成長していく(図7参照)。poly−Siと液状Siの界面380はずっと移動して最終的には図8に示すようにスリット中央で接触するようになる。この時に成長した結晶粒大きさ392は約スリット幅の半分である。もし、スリット幅が広いか、あるいはレーザー照射後に溶融されたシリコンの過冷却速度が速ければ、スリットの両側縁部から成長してきた結晶粒が境界381で互いに接触する前に液状シリコン361内で核生成が発生する。
そのような状況は望ましくないので、レーザー照射条件と基板温度、スリット形状を最適化して、上記の核生成が起こらないようにすることが重要である。
1次照射が完了された後、レーザービーム照射位置を図9に示すように長さ450程度移動させた後、再びスリットを通して2次レーザー照射を実施する。2次レーザー照射後、スリット境界420、421との間のシリコンは液状シリコン460に変わって、1次照射後に形成されたpoly−Si領域440は残っている状態で再結晶化が進行される(図10参照)。この時、境界421側は微細なpoly−Si領域が形成され、その後形成されたpoly−Siをシード(seed)として結晶粒成長が進行される。
しかし、境界420では1次照射後に形成された結晶粒440のうち2次照射後に溶融された部分を除外した領域をシード(seed)として結晶粒成長が進行されて最終的に図11に示すような形態を得る。すなわち、2次照射後にスリット両側から結晶粒成長が進行されて接触する境界470は、照射位置を距離491シフト(shift)させて2次照射をするために最初の境界位置から距離491動いて形成される。
この工程により、スキャン(scan)方向に結晶粒長さが増加するので結晶粒大きさが大きくなる。また、2次照射時にシード結晶と新しく生まれた結晶は結晶配向が変わらない状態で連続的な成長を経るようになるために、境界480は消失する。
上記の工程を反復しながらレーザービームがある程度の距離に移動した後の状態を図12に示す。図12の下方は片方の方向にずっと成長が進行されてきた結晶粒が細長い形態で存在し、成長の前段階でスリットに露出された以後、各スリットの境界510及び511から成長してきた結晶粒の成長界面520と521が液状シリコン530内に成長している状態である。
以後、スキャン工程が地点551まで進行されて、a−Si地域550が結晶化されて図13のようになる。スキャンした距離は概ね参照符号580程度であり、成長した結晶粒の長さは前記スキャン距離580に該当する。マスクに従ってスリットがパターン化されるために、所定のスキャン距離をレーザービームが移動すると、図3、図4のようなpoly−Siパターンが形成されるのである。
各poly−Siパターンは図13のような結晶粒の構造を有しているが、スキャンが始まった初期領域では多くの結晶粒がお互い競争しながら成長するために微細な結晶粒がたくさん見られる領域、すなわち参照符号560で示される領域が存在し、その上には結晶粒が細長く育った領域、すなわち参照符号570で示される領域が存在する。実際の実験結果では大部分の場合、参照符号560の領域は1μm以内で、poly−Siパターン領域においてほとんど無視する程に小さい(例えば、非特許文献1参照)。
SLSの長所はマスクの形状によって、多様な形状が得られて、一部マスクに対してはTFTのチャンネル領域が形成される部分に単結晶Siアイランド(island)領域を選択的に形成することができる(例えば、特許文献2参照)。
したがって、このような方法を利用すると、poly−Si構造及び素子特性の均一性と性能向上を共に得ることができる。
しかしながら、上記のSLS工程の結果得られるSi薄膜は、四角形や六角形等の結晶配列を有する単結晶Siアレイ(array)及び単結晶Siアイランドの形成において、規則性をLCD基板上でのピクセル配置設計及び周辺回路の配置設計と合うようにしないと、素子特性の均一性にむしろ悪影響が引き起こされる。
したがって、既存のSLS方法の場合、結晶化のためのマスク設計とピクセル及び周辺回路設計をマッチさせなければならない観点から、設計面で制限が発生する可能性がある。
さらに、上記のSLS方法のうち、単結晶を得る方法も厳密にいうと、単結晶Siアイランドを形成するものであるために、結晶粒界が基板のいくつかのところに存在するので、前記結晶粒界を避けてピクセルや周辺回路を構成することができれば優秀な素子特性と均一性を同時に期待することができる。
結果的にいかなる設計図式(scheme)でも均一性と優秀な素子特性の保証を受けようとするなら、基板全体にわたって単結晶シリコンを形成させるか、あるいは周辺回路部のみ単結晶Siを育てて残りのピクセル領域はa−Si状態で置いて漏洩電流が低いピクセル領域とスイッチング特性が優秀な周辺回路用の単結晶Siをピクセル領域の外部に形成させる方式などを通じて、不均一性を引き起こす可能性のある結晶粒界の形成自体を基本的に防止する方法が窮極的な解決法である。
そこで、本発明は上記従来の単結晶シリコン膜の製造方法における問題点に鑑みてなされたものであって、本発明の目的は、結晶化用で、より簡単なマスクを使用して、容易な方法で所望の位置に望みの大きさで単結晶Siを形成させる方法を提供することにある。
また、本発明の他の目的は、LCDやOLEDに応用される画素または周辺回路駆動素子である薄膜トランジスタの活性層である低温ポーリシリコンの結晶性を向上させて単結晶シリコンを形成できる単結晶シリコン膜の製造方法を提供することにある。
上記目的を達成するためになされた本発明による単結晶シリコン膜の製造方法は、透明又は半透明の基板上に半導体層又は金属薄膜を形成する段階と、レーザー照射を用いた結晶化方法で前記半導体層又は金属薄膜が形成された基板上に所望の大きさの単結晶シード領域を形成する段階と、前記単結晶シード領域をシード(seed)として、前記半導体層又は金属薄膜の所望の領域を単結晶領域に変換させる段階とを含んで構成されることを特徴とする。
また、前記単結晶シード領域を形成する段階は、レーザーを前記半導体層又は金属薄膜が形成された基板上にマスクを介して特定形状の所望の大きさにて照射してレーザー照射された部分を1次的に結晶化させる段階と、レーザーを所望の間隔移動させて前記1次的に結晶化された部分内の結晶粒を前記所望の間隔により成長させる過程を反復する1次スキャン工程を実施する段階と、前記1次スキャン工程が所望の距離実行された後に終了させて多結晶アイランド領域を形成する段階とを含み、前記単結晶領域に変換させる段階は、前記1次スキャン工程が終了された後、レーザービーム照射位置を90度回転させ、1次スキャン工程でスキャン方向に細長い形状に成長した結晶粒をシードとして2次スキャンを実行してその結晶粒を成長させて単結晶領域を作る2次スキャン工程を実施する段階と、前記2次スキャン工程を所望の距離実行させた後、形成された単結晶領域をシードとしてそのシードの一部に再びレーザー照射を反復しながら単結晶領域を広める段階とを含むことを特徴とする。
本発明によれば、従来のSLS工程で形成されたpoly−Siアイランド内に細長く発達した結晶粒1〜2ケをシード結晶として追加レーザー照射工程を通して単結晶Siシード領域を形成してこのシード領域を基点として薄膜全体または一部または特定領域に単結晶Si領域を形成させることができるため、均一性の問題が根本的に解決できるために、多様な製品設計に対応でき、また、単結晶Si領域上にパネルを製作時に、周辺回路でスイッチング速度に対応することができるという効果がある。
したがって、周辺回路部品を集積するようになるために、モジュール部品費用が減少される。また、既存工程とは異なり単結晶シリコンを適用するために、ドライブ(drive)回路だけでなく、各種インターフェース部品まで集積できる充分のスイッチング速度を出すことができるために窮極的にシステム−オン−パネルを形成できて、既存のLTPS(Low Temperature Poly−Si) TFT−LCDの製品領域より広い製品領域を有することができるという効果がある。
また、本発明によれば、ピクセル領域もまたa−Siで形成できるために、低い漏洩電流特性を有しながら周辺回路を集積させるる製品を作ることができて工程費用も大きく減少させることができ、そして、ピクセル領域を単結晶シリコンで作る場合、高い電流を出すことができるために、電流駆動型ディスプレイであるOLEDに適合し、低電圧駆動が可能になるという効果がある。
それだけでなく、本発明によれば、大型ガラス(glass)上での単結晶Siだけでなく、Siウェーハのような小型基板上でも実現可能であるために、半導体メモリー集積回路工程においてSOI(System−on−insulator)や3次元集積回路工程にも応用が可能となる効果がある。
また、レーザー結晶化をSiでないアルミニウム(Al)や銅(Cu)のような配線材料にも適用して単結晶を製作時に、超高集積回路でのエレクトロマイグレーション(electro−migration)による配線不良も減少させることができる効果がある。
次に、本発明に係る単結晶シリコン膜の製造方法を実施するための最良の形態の具体例を図面を参照しながら説明する。
ガラスやプラスチック及び絶縁体(insulator)等のような非晶質基板上でのpoly−Siまたは多結晶薄膜を形成させる時の結晶性の向上と同時に均一性も確保するために、本発明では基板全体に単結晶または位置が正確に制御された単結晶タイル(tile)が形成される。これにより従来技術の問題点を根本的に解決できる。本発明ではその代表的な方法を考案してa−Siの結晶化工程を例にして説明する。
ガラスやプラスチック及び絶縁体(insulator)等のような非晶質基板上でのpoly−Siまたは多結晶薄膜を形成させる時の結晶性の向上と同時に均一性も確保するために、本発明では基板全体に単結晶または位置が正確に制御された単結晶タイル(tile)が形成される。これにより従来技術の問題点を根本的に解決できる。本発明ではその代表的な方法を考案してa−Siの結晶化工程を例にして説明する。
本発明を実現するための原理として、従来のSLS工程を経たpoly−Siアイランドパターンで結晶粒が成長した方向と垂直になるような方向に追加的なレーザースキャン工程を実行して単結晶Siシード領域を形成した後、以後このシード領域を利用したSLSL工程を通じて基板全体または工程時間短縮のためにパネルが形成される部分や周辺回路部分のような特定領域に単結晶Siまたは単結晶Siタイルを形成するようにした。
図14は図13で完成されたpoly−Siアイランド(横幅660、縦幅670)610の様子と2次スキャンをするためのレーザービーム(長さ640、幅650)630の配置を示す。レーザービーム630は1次スキャン方向と垂直になるようにx方向(図横方向)に移動させて、開始位置はpoly−Siアイランドパターン610内の片方の末端である。
2次スキャンのためのレーザービーム長さ640は一般的にpoly−Siアイランドパターン610の縦幅670とほとんど同一にすることが望ましく、1次スキャン終了後2次スキャン前にマスクを90度回転させるか、あるいは試片を90度回転させる。
図14、15、16及び17は、2次スキャン工程をより詳細に示す。ここで、レーザービームの幅650はSLSの場合、一般的に数μm程度であり、poly−Siアイランドパターン610内に細長く成長している結晶粒の幅も1〜数μm程度である。図15はpoly−Siアイランドパターン720内で片方の末端部分に結晶粒が存在する様相を概略的に示す。結晶粒710の場合、1次スキャン工程で細長い形状に形成されていて、結晶粒711の場合は、初期成長工程で成長しなかった結晶粒である。
上記で言及したように、結晶粒711の場合、その大きさが1μm以内と非常に小さい。SLSシステムでのレーザービームの調整(align)の正確度はサブ−μmw程度であるので、図16に示すようにレーザービームが結晶粒710の一部のみを溶かすように調整(align)をすることができる。もちろん、結晶粒730の場合も一部が溶けるか、あるいは全体が溶けるように行える。重要なことは、poly−Siアイランドパターン全体にわたり細長く成長した結晶粒の大きさ(長さと幅)がレーザービームのディメンションレベル(dimension level)と似ているという点である。
このようにして2次スキャン工程の一番目の照射後に領域730は液状になり、液状になった部分は再凝固する。この時、シードとしての役目をする結晶粒710と結晶粒731はきわめて小さいし、シードの大部分は結晶粒710ひとつであるために2次スキャンをpoly−Si領域740に進行させると、図16のpoly−Si領域740が溶融及び凝固工程を通じて図17に示すような単結晶Si領域に変換される。
もちろん、結晶粒731が2次スキャンの一番目の照射時に部分的に溶融された時、スキャン工程で成長が行われるが、その大きさは非常に小さく、成長速度も既に1次スキャン工程で表れたように結晶粒710に比べて遅いために、新しく成長した領域751の大きさは無視する程度である。2次スキャンの一番目の照射時に溶融された部分と残っていた部分の境界760は消失するであろう。なぜなら、シード領域710と結晶化された領域750は同じ配向(orientation)を有するためである。
もしも、レーザービームの調整の正確度が不正確であるか、あるいは、シード領域で細長い結晶粒が複数存在する場合、最悪の場合が引き起こされる。1次スキャン工程で形成された下方の小さな結晶粒(例えば結晶粒731)を無視するならば、この場合、シード結晶はお互い成長速度が同様である2個の結晶となるであろう。
図18及び19は、上記のような状況での2次スキャン工程を示す。初期二つのシード結晶820、821がレーザービーム830でスキャンされ、poly−Si領域810をなくしながらスキャンが完了されると、スキャン前に存在した結晶粒界800が残りながらpoly−Siアイランドパターンは2個の結晶粒でなされる。
この場合、結晶粒870の成長が結晶粒871の成長より比較的優勢であって最終的に結晶粒870の領域が大きい場合を示した。このような場合としても、このような結晶粒は、残っている基板領域または単結晶化する特定領域を変換させる単結晶シード層として作用(act)するのに充分である。なぜなら、各結晶粒領域の大きさ850、851、880、881がスリットを通してでてきたレーザービームの幅より十分に大きい数十μm程度であるためにこのような結晶粒から適当な結晶粒を選択して以後の結晶化に対するシード結晶として適用すると良いためである。
上記の方式を利用して基板全体にわたり単結晶Siを形成させる方法を図28、29、30、及び31に示した。
図28は、レーザービーム1130を1次スキャン時に生じたpoly−Siアイランドパターン1120の片方の末端辺部から照射を開始し、2次スキャンを図に示したスキャン方向に進行して基板1110の他方の末端辺部まで進行させることを示す。
図28は、レーザービーム1130を1次スキャン時に生じたpoly−Siアイランドパターン1120の片方の末端辺部から照射を開始し、2次スキャンを図に示したスキャン方向に進行して基板1110の他方の末端辺部まで進行させることを示す。
このようにすると、2次スキャン後、レーザービーム1160が基板1110の反対側まで到着するようになると、直角四角形の単結晶Siシード領域1150が形成されて、残り領域1140はa−Si状態で残る。
その後、レーザービームを図30に示すように、単結晶Siシード領域1150の一部に照射させて溶融と凝固を反復する。レーザー照射は1170、1171、・・・、1180の順で進行し、その照射する経路は1190に示すように進行させる。このようにして、最終的に図31に示すのように基板1192全体に単結晶Si領域1191を形成させる。図30で各照射ステップ1170、1171をレーザービーム照射条件によって一度にいくつかの照射領域に対し行うことにより工程時間を短縮させることもできる。(例えば、1170と1172を一度に照射してその次に照射領域をシフトして1171と1173を照射する方式がありえる。)
このような方法は特許文献1によって提案されたものと以下のような差別性を有する。
本発明は、y方向への1次スキャンとx方向への2次スキャンによって単結晶Si領域を形成する。特に2次スキャンの場合、シード結晶の数がほとんど1〜2個程度と少なくても、少ない数の結晶からの2次スキャンでも単結晶シード領域を形成することができるという点である。これらシード領域が一旦形成されると、特許文献1と同じ方式で結晶化が進行する。結果的に出来てくる構造は、特許文献1の場合、図8に示したpoly−Si領域が配列された形態である。
本発明は、y方向への1次スキャンとx方向への2次スキャンによって単結晶Si領域を形成する。特に2次スキャンの場合、シード結晶の数がほとんど1〜2個程度と少なくても、少ない数の結晶からの2次スキャンでも単結晶シード領域を形成することができるという点である。これらシード領域が一旦形成されると、特許文献1と同じ方式で結晶化が進行する。結果的に出来てくる構造は、特許文献1の場合、図8に示したpoly−Si領域が配列された形態である。
しかし、本発明の場合、単結晶Si領域が形成される。すなわち、初期において単結晶Si領域を形成させる工程を追加することにより、最終的な薄膜の微細構造が大きく変わることである。もちろん本発明の場合、単結晶領域を形成させるために追加的な工程(1次、2次スキャン工程)が要求されるが、結果的に出来た構造が特許文献1とは異なり均一性や設計自由度が非常に高いという長所を有する。追加的な工程は、以降に説明する本発明の他の実施例で一部改善することができる。
図20乃至図26及び図27は、図30に示した工程をより詳細に示したものである。
図20は、2次スキャン(図29参照)時に形成された単結晶Si領域900に対してレーザービーム910を逆y方向に参照符号931のようにシフトして照射する状況を示す。この時、照射された領域は最初の単結晶領域921とa−Si領域920をすべて含んで図21に示すように二つの領域がすべて合わされた領域940として溶融される。レーザー照射が終った直後の成長は図22に示すように、最初の単結晶領域であった所から成長する領域951とa−Si領域から成長する領域950が存在する。
図20は、2次スキャン(図29参照)時に形成された単結晶Si領域900に対してレーザービーム910を逆y方向に参照符号931のようにシフトして照射する状況を示す。この時、照射された領域は最初の単結晶領域921とa−Si領域920をすべて含んで図21に示すように二つの領域がすべて合わされた領域940として溶融される。レーザー照射が終った直後の成長は図22に示すように、最初の単結晶領域であった所から成長する領域951とa−Si領域から成長する領域950が存在する。
結晶化が完了されると、図23に示すように単結晶領域961とpoly−Si領域960が境界962で接触するようになる。このようにすると、単結晶領域の大きさはレーザー照射のために逆y方向移動した距離931程度さらに大きくなって、結果的に単結晶領域が拡張される。この時、レーザー照射は、単結晶領域961及びpoly−Si領域960が形成される前に、図22で溶融されたSi領域952内部の核生成によって結晶粒が形成されないように行わなければならない。新しく形成された単結晶領域961は最初の単結晶領域900から成長されるために、実質上、境界963は観察されない。
その後、次のレーザー照射のためにレーザービームをx方向に移動させて照射する。図24に示すような場合、レーザービームが照射される領域970と以前に形成された領域の一部(参照符号972で示される)が若干重なるようにして境界効果を取り除くようにする。この時、照射された領域971は溶融され、図25に示すように単結晶領域から成長していく領域981と、a−Si領域から形成されていく領域980が存在する。成長が終了すると、図26に示すように単結晶領域991とpoly−Si領域990が接触するようになる。この時、以前に形成された単結晶領域994と新しく形成された単結晶領域991との境界992、そして最初の単結晶領域900とこれら単結晶領域との境界993は実質上観察されない。
その理由は、お互い異なる配向(orientation)を有する結晶粒が接触して形成される結晶粒界ではなく、これら結晶粒992、993は、すべて同一の結晶配向を有しているためである。このような方式でx方向にスキャンを続ければ、単結晶領域の大きさが大きくなり、x方向のスキャンが完了すると、再び逆y方向(下の方向:矢印)にスキャンを進行させながら、レーザーの照射を行う。そうした状況を図27に示す。x方向スキャンの完了後に、再びレーザー照射領域を逆y方向に若干シフトして照射し、単結晶領域1020をシード(seed)としての役目を行うようにし、同時にpoly−Si領域1030を融融させるようにする。
このようにしてレーザー1040が照射された領域1050は、再び溶融と結晶化を反復するようになる。このようなスキャンを図30に示すように進行させると、最終的に図31に示すように基板全体にわたり単結晶Siが形成されるようになる。
上述の結晶化方法は単結晶Siを基板全体に形成する方法である。既存SLS方式に比べてこの方式の場合、初期の単結晶シード(seed)領域を形成するのに必要な追加工程により工程時間が多少増加する。したがって、これを補完するためのいくつかの実施例を以下に示す。
実施例2として、図32及び図33に、1、2次スキャン工程で形成される単結晶Siシード領域をいくつか同時に形成する方法を示す。基板1200上にa−Si膜1210を蒸着し、スリットパターンが形成されたマスクを使用してレーザー照射をする。この時、マスク内のスリットパターンがいくつか形成されているためにレーザー照射時に1次スキャンで形成されるpoly−Siアイランドパターン(横幅1230、縦幅1220)1221、1222、1223、1224を同時に形成して、2次スキャン時にも同時にx方向にレーザー照射させた後に2次スキャンで形成された単結晶Si領域をシードとして逆y方向に再びレーザー照射工程を反復すると、図33に示すような単結晶Siタイル1231、1232、1233、1234が形成される。このような方式は単結晶Siタイル1231〜1234がお互い異なる配向を有するために、各単結晶Siタイル間に境界が生じるという短所があるが、前述の基板全体に単結晶Siを形成させる方法に比べて工程時間を1/4程度短縮させることができる。この実施例は、パネル領域が単結晶Siタイル領域より小さな製品に対して適用すると有用である。
また実施例3として、図34乃至図38に示す工程がある。まず基板1300上にa−Si膜を蒸着し、スリットパターンが構成されたマスクを通してレーザーを照射する。マスク1304内には長さ1306、幅1305のスリットが間隔1360程度ずつ離れているように規則的に配置されている。1次スキャンによって移動する距離は参照符号1301として示される。
1次スキャン終了後、一定の間隔で各領域にはpoly−Siアイランドパターン1311が形成され、参照符号1312の部分はまだa−Si状態である。その後、境界1310近くにレーザービームが1次スキャン方向と直角となる配置になるように調整(align)した後、x方向に2次スキャンを実行し、この時、スキャン距離は参照符号1302程度になるように調節する。
このようにすると、各poly−Siアイランドパターン内の特定結晶粒をシードとしてa−Si領域1312地域に向かって単結晶Siの成長が進行されて、図35に示すような形態でpoly−Siアイランドパターンと単結晶Si領域1322からなるタイルが基板全体にわたり形成される。
その後、追加的スキャンを単結晶Si領域1332をシードとして行っていけば、図36に示すようにpoly−Siアイランドパターンであった領域が単結晶Si領域1331に変わり、全体的には横1333、縦1334の単結晶Si領域がタイル形態で基板全体にわたり形成される。この時、図35に示したpoly−Siアイランドパターンと単結晶Si領域間の境界であった参照符号1330は実質上観察されない。スキャン方向と追加ステップによって図37や図38に示す多様な単結晶Siタイル形態を得ることができる。
この実施例は、図29に示した基板全体にわたる2次スキャンの長さを大きく縮小してくれるために、工程時間が顕著に短縮される長所がある。もちろん、基板全体にわたり単結晶が形成されないが、パネルの大きさによって基板全体を単結晶とする必要がない場合や、単結晶Siと同等の高品質のSi薄膜が要求されず均一性(uniformity)の確保が重要な製品等に対して費用を低くする必要がある場合に適用することができる。もちろんこの時、タイルの大きさ1302、1303が均一性に影響を与えないように十分に小さい必要がある。
また実施例4として、図39に示すようにスキャン方向と数を適切に調節して、基板1400上にパネル1420が形成される部分(ピクセル領域1440と周辺回路領域1430)のみを単結晶に作って、残りの部分はpoly−Siタイル1410形態として形成し工程時間短縮と均一性確保が同時に得られる。
この実施例は、高速のスイッチング速度を有する周辺回路でパネルの大きさが大きい製品等に対して適用することができる。
また実施例5として、図40に示すように基板1500上にa−Si膜1520を蒸着後、パネル1510の周辺回路領域1530のみを単結晶に作って、ピクセル領域1540はa−Siとして残す方法がある。
この実施例は、低い漏洩電流を有するa−Si TFTをピクセル部に配置して、高速のスイッチング速度が要求される周辺部TFTは単結晶で製作する場合に適用することができ、工程時間の顕著な短縮と、ピクセル部の低い漏洩電流特性を同時に確保することができる。
上述のあらゆる結晶化方法はレーザー照射方向とマスク配列の適切な処理によって実現可能な方法であり、費用、製品特性及び多様な設計案をうまく処理する解決策として注目される。
尚、本発明は、上述の実施例に限られるものではない。本発明の技術的範囲から逸脱しない範囲内で多様に変更実施することが可能である。
610、720、1120、1221〜4、1311 poly−Siアイランドパターン
630、830、910、1040、1130、1160 レーザービーム
640 レーザービーム長さ
660 poly−Siアイランドパターン横幅
670 poly−Siアイランドパターン縦幅
650 レーザービーム幅
710、711、730、731、870 結晶粒
740、810 poly−Si領域
750 結晶化された領域
751 新しく成長した領域
800 スキャン前の結晶粒界
820、821 シード結晶
850、851、880、881 結晶粒領域の大きさ
870、871 結晶粒
900 単結晶Si領域
920、1312 a−Si領域
921 最初の単結晶領域
940 単結晶領域とa−Si領域がすべて合わされた領域
950、980 a−Si領域から成長する領域
951、981 最初の単結晶領域であった所から成長する領域
952 溶融されたSi領域
960、990、1030 poly−Si領域
961、991、994、1020 単結晶領域
962、963、992、993、1310、1330 境界
970 レーザービーム照射領域
1110、1192、1200、1300、1400、1500 基板
1150 単結晶Siシード領域
1191、1322、1331、1332 単結晶Si領域
1210、1520 a−Si膜
1231〜4 単結晶Siタイル
1304 マスク
1410 poly−Siタイル
1420、1510 パネル
1430、1530 周辺回路領域
1440、1540 ピクセル領域
630、830、910、1040、1130、1160 レーザービーム
640 レーザービーム長さ
660 poly−Siアイランドパターン横幅
670 poly−Siアイランドパターン縦幅
650 レーザービーム幅
710、711、730、731、870 結晶粒
740、810 poly−Si領域
750 結晶化された領域
751 新しく成長した領域
800 スキャン前の結晶粒界
820、821 シード結晶
850、851、880、881 結晶粒領域の大きさ
870、871 結晶粒
900 単結晶Si領域
920、1312 a−Si領域
921 最初の単結晶領域
940 単結晶領域とa−Si領域がすべて合わされた領域
950、980 a−Si領域から成長する領域
951、981 最初の単結晶領域であった所から成長する領域
952 溶融されたSi領域
960、990、1030 poly−Si領域
961、991、994、1020 単結晶領域
962、963、992、993、1310、1330 境界
970 レーザービーム照射領域
1110、1192、1200、1300、1400、1500 基板
1150 単結晶Siシード領域
1191、1322、1331、1332 単結晶Si領域
1210、1520 a−Si膜
1231〜4 単結晶Siタイル
1304 マスク
1410 poly−Siタイル
1420、1510 パネル
1430、1530 周辺回路領域
1440、1540 ピクセル領域
Claims (9)
- 透明又は半透明の基板上に半導体層又は金属薄膜を形成する段階と、
レーザー照射を用いた結晶化方法で前記半導体層又は金属薄膜が形成された基板上に所望の大きさの単結晶シード領域を形成する段階と、
前記単結晶シード領域をシード(seed)として、前記半導体層又は金属薄膜の所望の領域を単結晶領域に変換させる段階とを含んで構成されることを特徴とする単結晶シリコン膜の製造方法。 - 前記単結晶シード領域を形成する段階は、レーザーを前記半導体層又は金属薄膜が形成された基板上にマスクを介して特定形状の所望の大きさにて照射してレーザー照射された部分を1次的に結晶化させる段階と、
レーザーを所望の間隔移動させて前記1次的に結晶化された部分内の結晶粒を前記所望の間隔により成長させる過程を反復する1次スキャン工程を実施する段階と、
前記1次スキャン工程が所望の距離実行された後に終了させて多結晶アイランド領域を形成する段階とを含み、
前記単結晶領域に変換させる段階は、前記1次スキャン工程が終了された後、レーザービーム照射位置を90度回転させ、1次スキャン工程でスキャン方向に細長い形状に成長した結晶粒をシードとして2次スキャンを実行してその結晶粒を成長させて単結晶領域を作る2次スキャン工程を実施する段階と、
前記2次スキャン工程を所望の距離実行させた後、形成された単結晶領域をシードとしてそのシードの一部に再びレーザー照射を反復しながら単結晶領域を広める段階とを含むことを特徴とする請求項1に記載の単結晶シリコン膜の製造方法。 - 前記単結晶シード領域を形成する段階及び単結晶領域に変換させる段階は、前記レーザー照射領域を同時に基板上の複数の場所に適用して前記1、2次スキャン工程によって単結晶シード領域及び単結晶領域をいくつかのところに作る段階と、
前記単結晶領域をシードとして追加的なスキャンを開始して、基板上に残っている多結晶又は非晶質領域を消費しながら単結晶領域が拡張されるように成長させて基板全体にわたり単結晶タイル(tile)を形成させる段階とを含むことを特徴とする請求項2に記載の単結晶シリコン膜の製造方法。 - 前記単結晶領域をシードとして追加的なスキャンによって単結晶領域を拡張させる時、レーザースリットの多様な形状と大きさ及びレーザー照射領域のスキャン方向と配置(alignment)の多様な組み合わせで単結晶タイルの大きさと位置を制御することを特徴とする請求項3に記載の単結晶シリコン膜の製造方法。
- 前記単結晶領域は、基板全体、半導体装置が形成される部分、または半導体装置の回路領域が形成される部分であることを特徴とする請求項1に記載の単結晶シリコン膜の製造方法。
- 前記透明の基板は、ガラス、合成樹脂(plastic)及び絶縁膜を含み、
前記絶縁膜は、SiOx、SiOxNy、SiNx、及びそれらの二層膜又は多層膜の中から選択されるSi窒化膜、Si酸化膜、あるいは、Al、Cu、Ti、Wの中から選択された一つの金属の窒化膜または酸化膜であることを特徴とする請求項1に記載の単結晶シリコン膜の製造方法。 - 前記半導体層は、a−Si(amorphous−Si)、a−Ge、a−SixGey、poly−Si、poly−Ge、poly−SixGexの中から選択される一つであることを特徴とする請求項1に記載の単結晶シリコン膜の製造方法。
- 前記金属薄膜は、Al、Cu、Ti、W、Au、及びAgの中から選択される一つの金属、またはこれら金属と半導体との化合物であることを特徴とする請求項1に記載の単結晶シリコン膜の製造方法。
- 前記レーザーはエキシマレーザーであることを特徴とする請求項1に記載の単結晶シリコン膜の製造方法。
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020030019953A KR100618184B1 (ko) | 2003-03-31 | 2003-03-31 | 결정화 방법 |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2004311935A true JP2004311935A (ja) | 2004-11-04 |
Family
ID=32985911
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2003391471A Pending JP2004311935A (ja) | 2003-03-31 | 2003-11-20 | 単結晶シリコン膜の製造方法 |
Country Status (5)
Country | Link |
---|---|
US (1) | US7135388B2 (ja) |
JP (1) | JP2004311935A (ja) |
KR (1) | KR100618184B1 (ja) |
CN (1) | CN100377294C (ja) |
TW (1) | TWI310059B (ja) |
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Publication number | Publication date |
---|---|
KR20040085310A (ko) | 2004-10-08 |
US20040192013A1 (en) | 2004-09-30 |
KR100618184B1 (ko) | 2006-08-31 |
CN100377294C (zh) | 2008-03-26 |
TWI310059B (en) | 2009-05-21 |
CN1534725A (zh) | 2004-10-06 |
US7135388B2 (en) | 2006-11-14 |
TW200419017A (en) | 2004-10-01 |
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A977 | Report on retrieval |
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|
A131 | Notification of reasons for refusal |
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