JP2003203910A - 高誘電率ゲート酸化膜上に強誘電体薄膜を形成するmocvdシード層プロセス - Google Patents
高誘電率ゲート酸化膜上に強誘電体薄膜を形成するmocvdシード層プロセスInfo
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-
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Abstract
(57)【要約】
【課題】 高誘電率ゲート酸化物と強誘電体材料との間
の界面不整合により、劣化されない強誘電体デバイスを
提供すること。 【解決手段】 本発明は、シリコン基板を準備する工程
と、上記基板上に高誘電率層を形成する工程と、相対的
に高温で、上記高誘電率層上に強誘電体材料のシード層
を堆積する工程と、相対的に低温で、上記シード層上に
強誘電体材料の上層を堆積する工程と、強誘電体薄膜を
形成するように、上記基板、上記高誘電率層および上記
強誘電体層をアニーリングする工程と、を包含する。
の界面不整合により、劣化されない強誘電体デバイスを
提供すること。 【解決手段】 本発明は、シリコン基板を準備する工程
と、上記基板上に高誘電率層を形成する工程と、相対的
に高温で、上記高誘電率層上に強誘電体材料のシード層
を堆積する工程と、相対的に低温で、上記シード層上に
強誘電体材料の上層を堆積する工程と、強誘電体薄膜を
形成するように、上記基板、上記高誘電率層および上記
強誘電体層をアニーリングする工程と、を包含する。
Description
【0001】
【発明の属する技術分野】本発明は、強誘電体薄膜プロ
セス、強誘電体メモリデバイス構造および強誘電体不揮
発性メモリデバイスへの集積プロセスに関し、詳細に
は、高誘電率ゲート酸化物上に形成される強誘電体薄膜
を製造する方法に関する。
セス、強誘電体メモリデバイス構造および強誘電体不揮
発性メモリデバイスへの集積プロセスに関し、詳細に
は、高誘電率ゲート酸化物上に形成される強誘電体薄膜
を製造する方法に関する。
【0002】
【従来の技術】所望の特性を有するMFOSトランジス
タメモリデバイスを提供するように、酸化物は、強誘電
体およびシリコン基板と反応しないか、または、拡散し
てはならない。他方で、酸化物層上の強誘電体薄膜は、
メモリトランジスタに使用の際に良質な強誘電体の性質
を有する必要がある。所望の強誘電体の性質を有する均
質な強誘電体薄膜は、高誘電率ゲート酸化物と強誘電体
材料との間の界面不整合のために、ゲート酸化物上に堆
積させることが困難である。上記不整合により、PG
O、薄膜および粗い表面ラフネス等のランダムな強誘電
体が生じる。シード層プロセスは、界面不整合を解決す
るように、MFOSトランジスタ強誘電体メモリの用途
のために発展してきた。
タメモリデバイスを提供するように、酸化物は、強誘電
体およびシリコン基板と反応しないか、または、拡散し
てはならない。他方で、酸化物層上の強誘電体薄膜は、
メモリトランジスタに使用の際に良質な強誘電体の性質
を有する必要がある。所望の強誘電体の性質を有する均
質な強誘電体薄膜は、高誘電率ゲート酸化物と強誘電体
材料との間の界面不整合のために、ゲート酸化物上に堆
積させることが困難である。上記不整合により、PG
O、薄膜および粗い表面ラフネス等のランダムな強誘電
体が生じる。シード層プロセスは、界面不整合を解決す
るように、MFOSトランジスタ強誘電体メモリの用途
のために発展してきた。
【0003】
【発明が解決しようとする課題】本発明の目的は、強誘
電体(FE)堆積プロセスを向上させるようにFE材料
のシード層を提供することである。
電体(FE)堆積プロセスを向上させるようにFE材料
のシード層を提供することである。
【0004】本発明のさらなる目的は、高誘電率ゲート
酸化物と強誘電体材料との間の界面不整合により、劣化
されないFEデバイスを提供することである。
酸化物と強誘電体材料との間の界面不整合により、劣化
されないFEデバイスを提供することである。
【0005】本発明の別の目的は、MFOSトランジス
タ強誘電体メモリの用途において、ZrO2,HfO2
および(Zrx,Hf1−x)O2等の高誘電率ゲート
酸化物上に均質の強誘電体薄膜を堆積するように、シー
ド層プロセスを用いたFEデバイスを提供することであ
る。
タ強誘電体メモリの用途において、ZrO2,HfO2
および(Zrx,Hf1−x)O2等の高誘電率ゲート
酸化物上に均質の強誘電体薄膜を堆積するように、シー
ド層プロセスを用いたFEデバイスを提供することであ
る。
【0006】本発明の別の目的は、MFOS1トランジ
スタデバイスを提供することである。
スタデバイスを提供することである。
【0007】これにより、本発明の本質を素早く理解す
ることが可能になる。
ることが可能になる。
【0008】
【課題を解決するための手段】本発明は、高誘電率層上
に強誘電体薄膜を形成する方法であって、シリコン基板
を準備する工程と、上記基板上に高誘電率層を形成する
工程と、相対的に高温で、上記高誘電率層上に強誘電体
材料のシード層を堆積する工程と、相対的に低温で、上
記シード層上に強誘電体材料の上層を堆積する工程と、
強誘電体薄膜を形成するように、上記基板、上記高誘電
率層および上記強誘電体層をアニーリングする工程と、
を包含する。
に強誘電体薄膜を形成する方法であって、シリコン基板
を準備する工程と、上記基板上に高誘電率層を形成する
工程と、相対的に高温で、上記高誘電率層上に強誘電体
材料のシード層を堆積する工程と、相対的に低温で、上
記シード層上に強誘電体材料の上層を堆積する工程と、
強誘電体薄膜を形成するように、上記基板、上記高誘電
率層および上記強誘電体層をアニーリングする工程と、
を包含する。
【0009】本発明は、高誘電率層上に強誘電体薄膜を
形成する方法であって、シリコン基板を準備する工程
と、上記基板上に高誘電率層を形成し、酸化物層を形成
するように上記高誘電率層をアニーリングする工程と、
PGO前駆体溶液を準備する工程と、上記高誘電率酸化
物層上に強誘電体材料のシード層を堆積する工程であっ
て、約180℃〜200℃の間の蒸発器温度で、約20
%〜30%の間の酸素分圧を有する雰囲気内にて、約1
Torr〜5Torrの間の圧力で、約500℃〜54
0℃の間の温度でc軸配向PGO薄膜の層を堆積する工
程を包含し、上記前駆体溶液は、約5分〜20分の間の
堆積時間の間、約0.05ml/分〜0.1ml/分の
間の搬送レートを有する、シード層を堆積する工程と、
相対的に低温でシード層上に、強誘電体材料の上層を堆
積する工程であって、約380℃〜420℃の間の堆積
温度でPGO薄膜を堆積する工程を包含し、上記堆積圧
力は、約200℃〜240℃の間の蒸発器温度で、約3
0%〜40%の間の酸素分圧を有する雰囲気内にて、約
5Torr〜10Torrの間であり、上記前駆体溶液
搬送レートが約0.1ml/分〜0.2ml/分までの
間であり、上記堆積時間が約1時間〜3時間の間であ
る、強誘電体層の上層を堆積する工程と、強誘電体薄膜
を形成するように上記基板、上記高誘電率層および上記
強誘電体層をアニーリングする工程であって、純酸素雰
囲気内にて、約30分〜1時間の間の、約520℃〜5
60℃の間の温度でアニーリングする工程を包含する、
上記アニーリングする工程と、を包含する。
形成する方法であって、シリコン基板を準備する工程
と、上記基板上に高誘電率層を形成し、酸化物層を形成
するように上記高誘電率層をアニーリングする工程と、
PGO前駆体溶液を準備する工程と、上記高誘電率酸化
物層上に強誘電体材料のシード層を堆積する工程であっ
て、約180℃〜200℃の間の蒸発器温度で、約20
%〜30%の間の酸素分圧を有する雰囲気内にて、約1
Torr〜5Torrの間の圧力で、約500℃〜54
0℃の間の温度でc軸配向PGO薄膜の層を堆積する工
程を包含し、上記前駆体溶液は、約5分〜20分の間の
堆積時間の間、約0.05ml/分〜0.1ml/分の
間の搬送レートを有する、シード層を堆積する工程と、
相対的に低温でシード層上に、強誘電体材料の上層を堆
積する工程であって、約380℃〜420℃の間の堆積
温度でPGO薄膜を堆積する工程を包含し、上記堆積圧
力は、約200℃〜240℃の間の蒸発器温度で、約3
0%〜40%の間の酸素分圧を有する雰囲気内にて、約
5Torr〜10Torrの間であり、上記前駆体溶液
搬送レートが約0.1ml/分〜0.2ml/分までの
間であり、上記堆積時間が約1時間〜3時間の間であ
る、強誘電体層の上層を堆積する工程と、強誘電体薄膜
を形成するように上記基板、上記高誘電率層および上記
強誘電体層をアニーリングする工程であって、純酸素雰
囲気内にて、約30分〜1時間の間の、約520℃〜5
60℃の間の温度でアニーリングする工程を包含する、
上記アニーリングする工程と、を包含する。
【0010】MOCVDによる堆積に用いる強誘電体前
駆体溶液を準備する工程は、5.0:3〜5.5:3の
モル比の[Pd(thd)2]および[Ge(ETO)
4]の溶液(thdは、C11H19O2であり、ET
Oは、OC2H5である)を準備する工程を包含し、約
5.0:3〜5.5:3のモル比の[Pd(th
d) 2]および[Ge(ETO)4]の溶液は、ブチル
エーテルと、テトラヒドロフランと、イソプロパノール
と、テトラグリムとからなる溶媒の群から選択されたモ
ル比約8:2:1溶媒からなる混合溶媒内で溶解され、
上記溶液は、約0.1M/Lの濃度のPGOを有し、上
記溶液は、約180℃〜240℃の間の範囲内の温度
で、ポンプにより、約0.05ml/分〜0.20ml
/分の流速で蒸発器に注入され、これにより、前駆体ガ
スを形成し、MOCVD供給ラインは、約185℃〜2
45℃の間の温度で維持される。
駆体溶液を準備する工程は、5.0:3〜5.5:3の
モル比の[Pd(thd)2]および[Ge(ETO)
4]の溶液(thdは、C11H19O2であり、ET
Oは、OC2H5である)を準備する工程を包含し、約
5.0:3〜5.5:3のモル比の[Pd(th
d) 2]および[Ge(ETO)4]の溶液は、ブチル
エーテルと、テトラヒドロフランと、イソプロパノール
と、テトラグリムとからなる溶媒の群から選択されたモ
ル比約8:2:1溶媒からなる混合溶媒内で溶解され、
上記溶液は、約0.1M/Lの濃度のPGOを有し、上
記溶液は、約180℃〜240℃の間の範囲内の温度
で、ポンプにより、約0.05ml/分〜0.20ml
/分の流速で蒸発器に注入され、これにより、前駆体ガ
スを形成し、MOCVD供給ラインは、約185℃〜2
45℃の間の温度で維持される。
【0011】上記高誘電率層を形成する工程は、HfO
2および(Zr0.5,Hf0.5)O2からなる材料
の群から選択される材料の層を、約3.5nm〜15n
mの間の厚みに形成する工程を包含する。
2および(Zr0.5,Hf0.5)O2からなる材料
の群から選択される材料の層を、約3.5nm〜15n
mの間の厚みに形成する工程を包含する。
【0012】上記シリコン基板を準備する工程は、SC
1+SC2(SC1は、5500mlの脱イオン水、1
100mlのNH4OHおよび1100mlのH2O2
の混合物であり、SC2は、6000mlの脱イオン
水、1000mlのHClおよび1000mlのH2O
2の混合物である)を用いて上記基板をクリーニングす
る工程を包含し、HFディップエッチによって任意の表
面酸化物を除去する工程をさらに包含する。
1+SC2(SC1は、5500mlの脱イオン水、1
100mlのNH4OHおよび1100mlのH2O2
の混合物であり、SC2は、6000mlの脱イオン
水、1000mlのHClおよび1000mlのH2O
2の混合物である)を用いて上記基板をクリーニングす
る工程を包含し、HFディップエッチによって任意の表
面酸化物を除去する工程をさらに包含する。
【0013】本発明は、高誘電率層上に堆積された強誘
電体薄膜を有するMFOSキャパシタを製造する方法で
あって、シリコン基板を準備する工程と、上記基板上に
高誘電率層を形成する工程と、相対的に高温で、上記高
誘電率層上に強誘電体材料のシード層を堆積する工程
と、相対的に低温で、上記シード層上に強誘電体材料の
上層を堆積する工程と、強誘電体薄膜を形成するよう
に、上記基板、上記高誘電率層および上記強誘電体層を
アニーリングする工程と、上記強誘電体薄膜上に電極を
形成する工程と、上記MFOSキャパシタを金属化し、
完成させる工程と、を包含する。
電体薄膜を有するMFOSキャパシタを製造する方法で
あって、シリコン基板を準備する工程と、上記基板上に
高誘電率層を形成する工程と、相対的に高温で、上記高
誘電率層上に強誘電体材料のシード層を堆積する工程
と、相対的に低温で、上記シード層上に強誘電体材料の
上層を堆積する工程と、強誘電体薄膜を形成するよう
に、上記基板、上記高誘電率層および上記強誘電体層を
アニーリングする工程と、上記強誘電体薄膜上に電極を
形成する工程と、上記MFOSキャパシタを金属化し、
完成させる工程と、を包含する。
【0014】上記MFOSキャパシタは、約1.5V〜
2.0Vの範囲内でメモリウィンドウを有する。
2.0Vの範囲内でメモリウィンドウを有する。
【0015】上記シード層を堆積する工程は、約180
℃〜200℃の間の蒸発器温度で、約20%〜30%の
間の酸素分圧を有する雰囲気内にて、約1Torr〜5
Torrの間の圧力で、約500℃〜540℃の間の温
度でc軸配向のPGO薄膜の層を堆積する工程を包含
し、前駆体溶液は、約5分〜20分の間の堆積時間の
間、約0.05ml/分〜0.1ml/分の間の搬送レ
ートを有する。
℃〜200℃の間の蒸発器温度で、約20%〜30%の
間の酸素分圧を有する雰囲気内にて、約1Torr〜5
Torrの間の圧力で、約500℃〜540℃の間の温
度でc軸配向のPGO薄膜の層を堆積する工程を包含
し、前駆体溶液は、約5分〜20分の間の堆積時間の
間、約0.05ml/分〜0.1ml/分の間の搬送レ
ートを有する。
【0016】上記強誘電体の上層を堆積する工程は、約
380℃〜420℃の間の堆積温度でPGO薄膜を堆積
する工程を包含し、堆積圧力は、約200℃〜240℃
の間の蒸発器温度で、約30%〜40%の間の酸素分圧
を有する雰囲気内にて、約5Torr〜10Torrの
間であり、前駆体溶液搬送レートは、約0.1ml/分
〜0.2ml/分の間であり、堆積時間は、約1時間〜
3時間の間である。
380℃〜420℃の間の堆積温度でPGO薄膜を堆積
する工程を包含し、堆積圧力は、約200℃〜240℃
の間の蒸発器温度で、約30%〜40%の間の酸素分圧
を有する雰囲気内にて、約5Torr〜10Torrの
間であり、前駆体溶液搬送レートは、約0.1ml/分
〜0.2ml/分の間であり、堆積時間は、約1時間〜
3時間の間である。
【0017】MOCVDによる堆積に用いる強誘電体前
駆体を準備する工程をさらに包含し、約5.0:3〜
5.5:3のモル比の[Pd(thd)2]および[G
e(ETO)4](thdは、C11H19O2であ
り、ETOは、OC2H5である)の溶液は、ブチルエ
ーテルと、テトラヒドロフランと、イソプロパノール
と、テトラグリムとからなる溶媒の群から選択されたモ
ル比約8:2:1の溶媒からなる混合溶媒内で溶解さ
れ、上記溶液は、約0.1M/Lの濃度のPGOを有
し、上記溶液は、約180℃〜240℃の間の範囲内の
温度で、ポンプにより、約0.05ml/分〜0.20
ml/分の流速で蒸発器に注入され、これにより、前駆
体ガスを形成し、MOCVD供給ラインは、約185℃
〜245℃の間の温度で維持される。
駆体を準備する工程をさらに包含し、約5.0:3〜
5.5:3のモル比の[Pd(thd)2]および[G
e(ETO)4](thdは、C11H19O2であ
り、ETOは、OC2H5である)の溶液は、ブチルエ
ーテルと、テトラヒドロフランと、イソプロパノール
と、テトラグリムとからなる溶媒の群から選択されたモ
ル比約8:2:1の溶媒からなる混合溶媒内で溶解さ
れ、上記溶液は、約0.1M/Lの濃度のPGOを有
し、上記溶液は、約180℃〜240℃の間の範囲内の
温度で、ポンプにより、約0.05ml/分〜0.20
ml/分の流速で蒸発器に注入され、これにより、前駆
体ガスを形成し、MOCVD供給ラインは、約185℃
〜245℃の間の温度で維持される。
【0018】上記高誘電率層を形成する工程は、HfO
2および(Zr0.5,Hf0.5)O2からなる材料
の群から選択される材料の層を、約3.5nm〜15.
0nmの厚みにて形成する工程を包含する。
2および(Zr0.5,Hf0.5)O2からなる材料
の群から選択される材料の層を、約3.5nm〜15.
0nmの厚みにて形成する工程を包含する。
【0019】上記アニーリングする工程は、純酸素雰囲
気内に約30分〜1時間の間に、約520℃〜560℃
の間の温度で上記基板をアニーリングする工程を包含す
る。
気内に約30分〜1時間の間に、約520℃〜560℃
の間の温度で上記基板をアニーリングする工程を包含す
る。
【0020】上記シリコン基板を準備する工程は、SC
1+SC2(SC1は、5500mlの脱イオン水、1
100mlのNH4OHおよび1100mlのH2O2
の混合物であり、SC2は、6000mlの脱イオン
水、1000mlのHClおよび1000mlのH2O
2の混合物である)を用いて上記基板をクリーニングす
る工程を包含し、HFディップエッチによって任意の表
面酸化物を除去する工程をさらに包含する。
1+SC2(SC1は、5500mlの脱イオン水、1
100mlのNH4OHおよび1100mlのH2O2
の混合物であり、SC2は、6000mlの脱イオン
水、1000mlのHClおよび1000mlのH2O
2の混合物である)を用いて上記基板をクリーニングす
る工程を包含し、HFディップエッチによって任意の表
面酸化物を除去する工程をさらに包含する。
【0021】上記強誘電体シード層を堆積する工程は、
MOCVD、スパッタリングおよびゾル−ゲルからなる
技術の群から選択される堆積技術により、シード層を堆
積する工程を包含する。
MOCVD、スパッタリングおよびゾル−ゲルからなる
技術の群から選択される堆積技術により、シード層を堆
積する工程を包含する。
【0022】以上により、本発明の本質を素早く理解す
ることが可能になる。本発明は、以下の本発明の好適な
実施形態の詳細な説明を参照することにより、さらに理
解される。
ることが可能になる。本発明は、以下の本発明の好適な
実施形態の詳細な説明を参照することにより、さらに理
解される。
【0023】
【発明の実施の形態】(関連出願)金属、強誘電体、酸
化物およびシリコン(MFOS)トランジスタ強誘電体
メモリデバイスは、関連出願である米国特許出願第
号、「High kGate Oxides wi
th Buffer Layers of Tifor
MFOS One Transistor Memo
ry Applications」、2001年10月
30日出願に提示されている。
化物およびシリコン(MFOS)トランジスタ強誘電体
メモリデバイスは、関連出願である米国特許出願第
号、「High kGate Oxides wi
th Buffer Layers of Tifor
MFOS One Transistor Memo
ry Applications」、2001年10月
30日出願に提示されている。
【0024】(好適な実施形態の詳細な説明)高誘電率
層上に強誘電体層を製造する方法を説明するために、強
誘電体(FE)薄膜金属−強誘電体−酸化物−シリコン
(MFOS)構造は、本発明の方法の実施例として、1
トランジスタメモリに組み込まれるように選択されてい
る。MFOSトランジスタメモリデバイスに適切な電気
的性質を与えるために、シード層は、MFOSトランジ
スタ強誘電体メモリの用途に用いる本発明の方法によ
り、製造される。平滑な強誘電体であるゲルマニウム酸
化鉛(Pb5Ge3O11)(PGO)薄膜は、ZrO
2,HfO2,または(Zrx,Hf1−x)O2等の
高誘電率ゲート酸化物の上に堆積され得る。PGO薄膜
は、本発明のシード層MOCVD法を用いることによ
り、程度の低い表面ラフネスおよび均質な厚みを有す
る。
層上に強誘電体層を製造する方法を説明するために、強
誘電体(FE)薄膜金属−強誘電体−酸化物−シリコン
(MFOS)構造は、本発明の方法の実施例として、1
トランジスタメモリに組み込まれるように選択されてい
る。MFOSトランジスタメモリデバイスに適切な電気
的性質を与えるために、シード層は、MFOSトランジ
スタ強誘電体メモリの用途に用いる本発明の方法によ
り、製造される。平滑な強誘電体であるゲルマニウム酸
化鉛(Pb5Ge3O11)(PGO)薄膜は、ZrO
2,HfO2,または(Zrx,Hf1−x)O2等の
高誘電率ゲート酸化物の上に堆積され得る。PGO薄膜
は、本発明のシード層MOCVD法を用いることによ
り、程度の低い表面ラフネスおよび均質な厚みを有す
る。
【0025】(本発明の方法)本発明の方法の好適な実
施形態において、Pタイプのシリコンウェハは、MFO
S1トランジスタメモリセルの基板として用いられる。
シリコンウェハは、SC1+SC2を用いてクリーニン
グされる。SC1は、5500mlの脱イオン水と、1
100mlのNH4OHと、1100mlのH2O
2と、の混合物であり、SC2は、6000mlの脱イ
オン水と、1000mlのHClと、1000mlのH
2O2の混合物である。表面酸化物がHFディップエッ
チにより除去される。約3.5nm〜15nmの間の厚
みを有する、HfO2および(Zr0 .5,H
f0.5)O2薄膜等の高誘電率材料の層は、好適な実
施形態において、スパッタリングにより、シリコン基板
上に堆積される。HfO2および(Zr 0.5,Hf
0.5)O2を有するシリコンウェハは、十分に酸化す
るように、純酸素雰囲気内にて、約500℃〜550℃
の間で、アニーリングされる。酸化MOCVDリアクタ
は、(Zr0.5,Hf0.5)O2層上にて、200
nm〜300nmの間の厚みのc軸配向Pb5Ge3O
11(PGO)薄膜を有する層の成長に用いられる。約
100nmの厚みを有するプラチナの上部電極は、電子
ビーム蒸着技術によって堆積される。
施形態において、Pタイプのシリコンウェハは、MFO
S1トランジスタメモリセルの基板として用いられる。
シリコンウェハは、SC1+SC2を用いてクリーニン
グされる。SC1は、5500mlの脱イオン水と、1
100mlのNH4OHと、1100mlのH2O
2と、の混合物であり、SC2は、6000mlの脱イ
オン水と、1000mlのHClと、1000mlのH
2O2の混合物である。表面酸化物がHFディップエッ
チにより除去される。約3.5nm〜15nmの間の厚
みを有する、HfO2および(Zr0 .5,H
f0.5)O2薄膜等の高誘電率材料の層は、好適な実
施形態において、スパッタリングにより、シリコン基板
上に堆積される。HfO2および(Zr 0.5,Hf
0.5)O2を有するシリコンウェハは、十分に酸化す
るように、純酸素雰囲気内にて、約500℃〜550℃
の間で、アニーリングされる。酸化MOCVDリアクタ
は、(Zr0.5,Hf0.5)O2層上にて、200
nm〜300nmの間の厚みのc軸配向Pb5Ge3O
11(PGO)薄膜を有する層の成長に用いられる。約
100nmの厚みを有するプラチナの上部電極は、電子
ビーム蒸着技術によって堆積される。
【0026】FE材料のMOCVD堆積について、モル
比が5.0:3〜5.5:3の[Pb(thd)2]お
よび[Ge(ETO)4](thdは、C11H19O
2であり、ETOは、OC2H5である)は、モル比
8:2:1であるブチルエーテルまたはテトラヒドロフ
ラン、イソプロパノールおよびテトラグリムの混合溶液
にて溶解され、これにより前駆体溶液を形成する。前駆
体溶液は、約0.1M/LのPGOの濃度を有する。上
記溶液は、ポンプにより、約0.05ml/分〜0.2
0ml/分の間の流速で、約180℃〜240℃の間の
範囲の温度で蒸発器に注入され、前駆体ガスを形成す
る。供給ラインは、約185℃〜245℃の間の温度で
維持される。
比が5.0:3〜5.5:3の[Pb(thd)2]お
よび[Ge(ETO)4](thdは、C11H19O
2であり、ETOは、OC2H5である)は、モル比
8:2:1であるブチルエーテルまたはテトラヒドロフ
ラン、イソプロパノールおよびテトラグリムの混合溶液
にて溶解され、これにより前駆体溶液を形成する。前駆
体溶液は、約0.1M/LのPGOの濃度を有する。上
記溶液は、ポンプにより、約0.05ml/分〜0.2
0ml/分の間の流速で、約180℃〜240℃の間の
範囲の温度で蒸発器に注入され、前駆体ガスを形成す
る。供給ラインは、約185℃〜245℃の間の温度で
維持される。
【0027】好適な実施形態において、FEシード層の
MOCVDおよびアニーリングプロセスは、以下のよう
に、高誘電率(Zr0.5,Hf0.5)O2上に堆積
されるc軸配向PGO薄膜の層の堆積を含む:堆積温度
は、約500℃〜540℃の間であり、圧力は、約1T
orr〜5Torrの間であり、酸素分圧は、約20%
〜30%の間であり、蒸発温度は、約180℃〜200
℃の間であり、溶液搬送レートは、約0.05ml/分
〜0.1ml/分の間であり、堆積時間は、約5分〜2
0分の間である。
MOCVDおよびアニーリングプロセスは、以下のよう
に、高誘電率(Zr0.5,Hf0.5)O2上に堆積
されるc軸配向PGO薄膜の層の堆積を含む:堆積温度
は、約500℃〜540℃の間であり、圧力は、約1T
orr〜5Torrの間であり、酸素分圧は、約20%
〜30%の間であり、蒸発温度は、約180℃〜200
℃の間であり、溶液搬送レートは、約0.05ml/分
〜0.1ml/分の間であり、堆積時間は、約5分〜2
0分の間である。
【0028】PGOの、本体またはFE層は、以下のよ
うに、相対的に低温でシード層上に堆積される:堆積温
度は、約380℃〜420℃の間であり、圧力は、約5
Torr〜10Torrの間であり、酸素分圧は、約3
0%〜40%の間であり、蒸発温度は、約200℃〜2
40℃の間であり、溶液搬送レートは、約0.1ml/
分〜0.2ml/分の間であり、堆積時間は、所望の膜
厚に応じて約1時間〜3時間の間である。
うに、相対的に低温でシード層上に堆積される:堆積温
度は、約380℃〜420℃の間であり、圧力は、約5
Torr〜10Torrの間であり、酸素分圧は、約3
0%〜40%の間であり、蒸発温度は、約200℃〜2
40℃の間であり、溶液搬送レートは、約0.1ml/
分〜0.2ml/分の間であり、堆積時間は、所望の膜
厚に応じて約1時間〜3時間の間である。
【0029】堆積後のアニーリング温度は、純酸素雰囲
気内にて、約30分と1時間との間、約520℃〜56
0℃の間である。膜の相は、x線回折を用いて識別され
る。PGO MFOSキャパシタのキャパシタンスは、
Keithley 182CV analyzerを用
いて測定される。
気内にて、約30分と1時間との間、約520℃〜56
0℃の間である。膜の相は、x線回折を用いて識別され
る。PGO MFOSキャパシタのキャパシタンスは、
Keithley 182CV analyzerを用
いて測定される。
【0030】(結果)程度の低い表面ラフネスを有し、
相対的に小さい粒子を含む平滑なPGO薄膜を形成する
ように、PGO薄膜は、相対的に低温の堆積温度で堆積
され、次いで、相対的に高温でアニーリングされ、これ
により、均質なグレーン成長を促進させる必要がある。
実験結果は、平滑なアモルファスPGO薄膜は、図1お
よび図2のSEM写真により示されるように、高温アニ
ーリングの後に非常に粗くなることを示している。表面
が粗くなる理由は、均質なグレーン成長を促進させるた
めの結晶核がより低温で堆積されたPGO薄膜内に十分
でないことであり、結果として、非常に高い表面ラフネ
スが生じる。
相対的に小さい粒子を含む平滑なPGO薄膜を形成する
ように、PGO薄膜は、相対的に低温の堆積温度で堆積
され、次いで、相対的に高温でアニーリングされ、これ
により、均質なグレーン成長を促進させる必要がある。
実験結果は、平滑なアモルファスPGO薄膜は、図1お
よび図2のSEM写真により示されるように、高温アニ
ーリングの後に非常に粗くなることを示している。表面
が粗くなる理由は、均質なグレーン成長を促進させるた
めの結晶核がより低温で堆積されたPGO薄膜内に十分
でないことであり、結果として、非常に高い表面ラフネ
スが生じる。
【0031】本発明の方法のシード層MOCVDプロセ
スは、この問題を解決するために発展した。PGOシー
ド層は、相対的に高温で、相対的に低い堆積圧力で、堆
積される。結果として生じる低い堆積レートおよび相対
的に低い酸素分圧は、所望でない粒子を形成し得る任意
の気相の反応を避ける。均質で、かつ、連続的なc軸配
向のPGOシード層の形成は、後の薄膜の成長工程に必
要とされる。図3は、PGOシード層のx線パターン
(一般に10)を示しており、PGOシード層のx線パ
ターン(一般に10)は、単相c軸PGOシード層の存
在を示している。
スは、この問題を解決するために発展した。PGOシー
ド層は、相対的に高温で、相対的に低い堆積圧力で、堆
積される。結果として生じる低い堆積レートおよび相対
的に低い酸素分圧は、所望でない粒子を形成し得る任意
の気相の反応を避ける。均質で、かつ、連続的なc軸配
向のPGOシード層の形成は、後の薄膜の成長工程に必
要とされる。図3は、PGOシード層のx線パターン
(一般に10)を示しており、PGOシード層のx線パ
ターン(一般に10)は、単相c軸PGOシード層の存
在を示している。
【0032】本発明の方法の次の工程は、相対的に低い
堆積温度で、シード層上にアモルファスPGO薄膜を成
長することであり、次いで、相対的に高温で、PGO薄
膜をアニーリングすることであり、これにより、PGO
薄膜を十分に結晶化させる。アニーリングプロセス後、
PGOシード層が均質の結晶核をPGOグレーン成長に
提供するので、平滑で、かつ、十分に結晶化されたPG
O薄膜が形成される。図3はまた、成長後PGO薄膜の
x線パターン12およびアニーリング後のPGO薄膜の
x線パターン14を示す。
堆積温度で、シード層上にアモルファスPGO薄膜を成
長することであり、次いで、相対的に高温で、PGO薄
膜をアニーリングすることであり、これにより、PGO
薄膜を十分に結晶化させる。アニーリングプロセス後、
PGOシード層が均質の結晶核をPGOグレーン成長に
提供するので、平滑で、かつ、十分に結晶化されたPG
O薄膜が形成される。図3はまた、成長後PGO薄膜の
x線パターン12およびアニーリング後のPGO薄膜の
x線パターン14を示す。
【0033】図4は、(Zrx,Hf1−x)O2上で
の、成長後のPGO薄膜のSEM写真であり、図5は、
アニーリング後のPGO薄膜のSEM写真である。成長
後のPGO薄膜は、非常に平滑であり、非常に程度の低
い表面ラフネスを有する。約540℃でのアニーリング
後、本発明の方法によりPGO薄膜の結晶粒度が増加す
るが、PGO薄膜は、まだ平滑であり、アニーリング
は、薄膜の表面ラフネスに影響を与えない。
の、成長後のPGO薄膜のSEM写真であり、図5は、
アニーリング後のPGO薄膜のSEM写真である。成長
後のPGO薄膜は、非常に平滑であり、非常に程度の低
い表面ラフネスを有する。約540℃でのアニーリング
後、本発明の方法によりPGO薄膜の結晶粒度が増加す
るが、PGO薄膜は、まだ平滑であり、アニーリング
は、薄膜の表面ラフネスに影響を与えない。
【0034】プラチナの上部電極は、本発明の方法のシ
ード層MOCVDプロセスによって作製されたPGO薄
膜上に堆積され、これにより、MFOSキャパシタを形
成する。図6は、本発明の方法のシード層MOCVDプ
ロセスによって形成されたPGO MFOSキャパタの
C−V曲線を示す。1.5V〜2.0Vのメモリウィン
ドウが容易に測定される。
ード層MOCVDプロセスによって作製されたPGO薄
膜上に堆積され、これにより、MFOSキャパシタを形
成する。図6は、本発明の方法のシード層MOCVDプ
ロセスによって形成されたPGO MFOSキャパタの
C−V曲線を示す。1.5V〜2.0Vのメモリウィン
ドウが容易に測定される。
【0035】均質の強誘電体薄膜は、本発明のシード層
の方法により、優れた強誘電体の性質を維持しながら、
高誘電率ゲート酸化物上に堆積され得る。シード層は、
MOCVD、スパッタリング、MOD、およびゾル−ゲ
ル等の方法により、堆積され得る。程度の低い表面ラフ
ネスおよび均質な厚みを有する、均質で、かつ、平滑な
PGO薄膜は、本発明のシード層MOCVDプロセス方
法を用いて、(Zrx,Hf1−x)O2層上に堆積さ
れ得る。PGO MFOSキャパシタのメモリウィンド
ウは、約1.5V〜2.0Vの範囲内で測定される。
の方法により、優れた強誘電体の性質を維持しながら、
高誘電率ゲート酸化物上に堆積され得る。シード層は、
MOCVD、スパッタリング、MOD、およびゾル−ゲ
ル等の方法により、堆積され得る。程度の低い表面ラフ
ネスおよび均質な厚みを有する、均質で、かつ、平滑な
PGO薄膜は、本発明のシード層MOCVDプロセス方
法を用いて、(Zrx,Hf1−x)O2層上に堆積さ
れ得る。PGO MFOSキャパシタのメモリウィンド
ウは、約1.5V〜2.0Vの範囲内で測定される。
【0036】したがって、高誘電率ゲート酸化物上に堆
積されるMOCVD強誘電体薄膜シード層プロセスが開
示されている。本発明のさらなる変形および改変は、特
許請求の範囲内で規定される本発明の範囲内で為され
る。
積されるMOCVD強誘電体薄膜シード層プロセスが開
示されている。本発明のさらなる変形および改変は、特
許請求の範囲内で規定される本発明の範囲内で為され
る。
【0037】
【発明の効果】本発明は、強誘電体(FE)堆積プロセ
スを向上させるようにFE材料のシード層を提供でき
る。
スを向上させるようにFE材料のシード層を提供でき
る。
【0038】本発明は、高誘電率ゲート酸化物と強誘電
体材料との間の界面不整合により、劣化されないFEデ
バイスを提供できる。
体材料との間の界面不整合により、劣化されないFEデ
バイスを提供できる。
【0039】本発明は、MFOSトランジスタメモリの
用途において、ZrO2,HfO2および(Zrx,H
f1−x)O2等の高誘電率ゲート酸化物上に同質の強
誘電体薄膜を堆積するように、シード層プロセスを提供
できる。
用途において、ZrO2,HfO2および(Zrx,H
f1−x)O2等の高誘電率ゲート酸化物上に同質の強
誘電体薄膜を堆積するように、シード層プロセスを提供
できる。
【0040】本発明は、MFOS1トランジスタデバイ
スを提供できる。
スを提供できる。
【図1】図1は、シード層を含まない堆積されたPGO
薄膜を示す図である。
薄膜を示す図である。
【図2】図2は、アニーリング後の図1のPGO薄膜を
示す図である。
示す図である。
【図3】図3は、PGOシード層のX線パターンおよび
成長後およびアニーリング後におけるPGO薄膜のX線
パターンを示す図である。
成長後およびアニーリング後におけるPGO薄膜のX線
パターンを示す図である。
【図4】図4は、シード層を有する高誘電率層上に堆積
される成長後のPGO薄膜を示す図である。
される成長後のPGO薄膜を示す図である。
【図5】図5は、アニーリング後の図4のPGO薄膜を
示す図である。
示す図である。
【図6】図6は、本発明の方法により構築されたPGO
MFOSキャパシタのC(キャパシタンス)−V(印
加電圧)曲線を示す図である。
MFOSキャパシタのC(キャパシタンス)−V(印
加電圧)曲線を示す図である。
10 PGOシード層のx線パターン
12 成長後PGO薄膜のx線パターン
14 アニーリング後のPGO薄膜のx線パターン
─────────────────────────────────────────────────────
フロントページの続き
(51)Int.Cl.7 識別記号 FI テーマコート゛(参考)
H01L 29/788
29/792
(72)発明者 シェン テン スー
アメリカ合衆国 ワシントン 98607,
ケイマス, エヌダブリュー トラウト
コート 2216
Fターム(参考) 4K030 AA11 AA14 BA01 BA09 BA42
BB01 CA04 DA03 DA09 EA01
FA10 JA09 JA10 LA02 LA15
5F058 BA11 BA20 BC03 BE03 BF06
BF12 BF27 BF46 BH03 BJ04
5F083 FR06 JA02 JA15 JA38 PR05
PR21 PR33
5F101 BA62 BF01 BH02 BH13 BH16
Claims (21)
- 【請求項1】 シリコン基板を準備する工程と、 該基板上に高誘電率層を形成する工程と、 相対的に高温で、該高誘電率層上に強誘電体材料のシー
ド層を堆積する工程と、 相対的に低温で、該シード層上に強誘電体材料の上層を
堆積する工程と、 強誘電体薄膜を形成するように、該基板、該高誘電率層
および該強誘電体層をアニーリングする工程と、を包含
する、高誘電率層上に強誘電体薄膜を形成する方法。 - 【請求項2】 前記シード層を堆積する工程は、約18
0℃〜200℃の間の蒸発器温度で、約20%〜30%
の間の酸素分圧を有する雰囲気内にて、約1Torr〜
5Torrの間の圧力で、約500℃〜540℃の間の
温度でc軸配向のPGO薄膜の層を堆積する工程を包含
し、前駆体溶液は、約5分〜20分の間の堆積時間の
間、約0.05ml/分〜0.1ml/分の間の搬送レ
ートを有する、請求項1に記載の方法。 - 【請求項3】 前記強誘電体の上層を堆積する工程は、
約380℃〜420℃の間の堆積温度でPGO薄膜を堆
積する工程を包含し、堆積圧力は、約200℃〜240
℃の間の蒸発器温度で、約30%〜40%の間の酸素分
圧を有する雰囲気内にて、約5Torr〜10Torr
の間であり、前駆体溶液搬送レートは、約0.1ml/
分〜0.2ml/分の間であり、堆積時間は、約1時間
〜3時間の間である、請求項1に記載の方法。 - 【請求項4】 MOCVDによる堆積に用いる強誘電体
前駆体を準備する工程をさらに包含し、5.0:3〜
5.5:3のモル比の[Pd(thd)2]および[G
e(ETO)4](thdは、C11H19O2であ
り、ETOは、OC2H5である)の溶液は、ブチルエ
ーテルと、テトラヒドロフランと、イソプロパノール
と、テトラグリムとからなる溶媒の群から選択されたモ
ル比約8:2:1の溶媒からなる混合溶媒内で溶解さ
れ、該溶液は、約0.1M/Lの濃度のPGOを有し、
該溶液は、約180℃〜240℃の間の範囲内の温度
で、ポンプにより、約0.05ml/分〜0.20ml
/分の流速で蒸発器に注入され、これにより、前駆体ガ
スを形成し、MOCVD供給ラインは、約185℃〜2
45℃の間の温度で維持される、請求項1に記載の方
法。 - 【請求項5】 前記高誘電率層を形成する工程は、Hf
O2および(Zr0 .5,Hf0.5)O2からなる材
料の群から選択される材料の層を、約3.5nm〜15
nmの厚みにて形成する工程を包含する、請求項1に記
載の方法。 - 【請求項6】 前記アニーリングする工程は、純酸素雰
囲気内に約30分〜1時間の間に、約520℃〜560
℃の間の温度で基板をアニーリングする工程を包含す
る、請求項1に記載の方法。 - 【請求項7】 前記シリコン基板を準備する工程は、S
C1+SC2(SC1は、5500mlの脱イオン水、
1100mlのNH4OHおよび1100mlのH2O
2の混合物であり、SC2は、6000mlの脱イオン
水、1000mlのHClおよび1000mlのH2O
2の混合物である)を用いて該基板をクリーニングする
工程を包含し、HFディップエッチによって任意の表面
酸化物を除去する工程をさらに包含する、請求項1に記
載の方法。 - 【請求項8】 前記強誘電体シード層を堆積する工程
は、MOCVD、スパッタリングおよびゾル−ゲルから
なる技術の群から選択される堆積技術により、シード層
を堆積する工程を包含する、請求項1に記載の方法。 - 【請求項9】 シリコン基板を準備する工程と、 該基板上に高誘電率層を形成し、酸化物層を形成するよ
うに該高誘電率層をアニーリングする工程と、 PGO前駆体溶液を準備する工程と、 該高誘電率酸化物層上に強誘電体材料のシード層を堆積
する工程であって、約180℃〜200℃の間の蒸発器
温度で、約20%〜30%の間の酸素分圧を有する雰囲
気内にて、約1Torr〜5Torrの間の圧力で、約
500℃〜540℃の間の温度でc軸配向PGO薄膜の
層を堆積する工程を包含し、該前駆体溶液は、約5分〜
20分の間の堆積時間の間、約0.05ml/分〜0.
1ml/分の間の搬送レートを有する、シード層を堆積
する工程と、 相対的に低温でシード層上に、強誘電体材料の上層を堆
積する工程であって、約380℃〜420℃の間の堆積
温度でPGO薄膜を堆積する工程を包含し、該堆積圧力
は、約200℃〜240℃の間の蒸発器温度で、約30
%〜40%の間の酸素分圧を有する雰囲気内にて、約5
Torr〜10Torrの間であり、該前駆体溶液搬送
レートが約0.1ml/分〜0.2ml/分までの間で
あり、該堆積時間が約1時間〜3時間の間である、強誘
電体層の上層を堆積する工程と、 強誘電体薄膜を形成するように該基板、該高誘電率層お
よび該強誘電体層をアニーリングする工程であって、純
酸素雰囲気内にて、約30分〜1時間の間の、約520
℃〜560℃の間の温度でアニーリングする工程を包含
する、アニーリングする工程と、を包含する、高誘電率
層上に強誘電体薄膜を形成する方法。 - 【請求項10】 MOCVDによる堆積に用いる強誘電
体前駆体溶液を準備する工程は、5.0:3〜5.5:
3のモル比の[Pd(thd)2]および[Ge(ET
O)4]の溶液(thdは、C11H19O2であり、
ETOは、OC2H5である)を準備する工程を包含
し、約5.0:3〜5.5:3のモル比の[Pd(th
d)2]および[Ge(ETO)4]の溶液は、ブチル
エーテルと、テトラヒドロフランと、イソプロパノール
と、テトラグリムとからなる溶媒の群から選択されたモ
ル比約8:2:1の溶媒からなる混合溶媒内で溶解さ
れ、該溶液は、約0.1M/Lの濃度のPGOを有し、
該溶液は、約180℃〜240℃の間の範囲内の温度
で、ポンプにより、約0.05ml/分〜0.20ml
/分の流速で蒸発器に注入され、これにより、前駆体ガ
スを形成し、MOCVD供給ラインは、約185℃〜2
45℃の間の温度で維持される、請求項9に記載の方
法。 - 【請求項11】 前記高誘電率層を形成する工程は、H
fO2および(Zr 0.5,Hf0.5)O2からなる
材料の群から選択される材料の層を、約3.5nm〜1
5nmの間の厚みに形成する工程を包含する、請求項9
に記載の方法。 - 【請求項12】 前記シリコン基板を準備する工程は、
SC1+SC2(SC1は、5500mlの脱イオン
水、1100mlのNH4OHおよび1100mlのH
2O2の混合物であり、SC2は、6000mlの脱イ
オン水、1000mlのHClおよび1000mlのH
2O2の混合物である)を用いて該基板をクリーニング
する工程を包含し、HFディップエッチによって任意の
表面酸化物を除去する工程をさらに包含する、請求項9
に記載の方法。 - 【請求項13】 高誘電率層上に堆積された強誘電体薄
膜を有するMFOSキャパシタを製造する方法であっ
て、 シリコン基板を準備する工程と、 該基板上に高誘電率層を形成する工程と、 相対的に高温で、該高誘電率層上に強誘電体材料のシー
ド層を堆積する工程と、 相対的に低温で、該シード層上に強誘電体材料の上層を
堆積する工程と、 強誘電体薄膜を形成するように、該基板、該高誘電率層
および該強誘電体層をアニーリングする工程と、 該強誘電体薄膜上に電極を形成する工程と、 該MFOSキャパシタを金属化し、完成させる工程と、
を包含する、MFOSキャパシタを製造する方法。 - 【請求項14】 前記MFOSキャパシタは、約1.5
V〜2.0Vの範囲内でメモリウィンドウを有する、請
求項13に記載の方法。 - 【請求項15】 前記シード層を堆積する工程は、約1
80℃〜200℃の間の蒸発器温度で、約20%〜30
%の間の酸素分圧を有する雰囲気内にて、約1Torr
〜5Torrの間の圧力で、約500℃〜540℃の間
の温度でc軸配向のPGO薄膜の層を堆積する工程を包
含し、前駆体溶液は、約5分〜20分の間の堆積時間の
間、約0.05ml/分〜0.1ml/分の間の搬送レ
ートを有する、請求項13に記載の方法。 - 【請求項16】 前記強誘電体の上層を堆積する工程
は、約380℃〜420℃の間の堆積温度でPGO薄膜
を堆積する工程を包含し、堆積圧力は、約200℃〜2
40℃の間の蒸発器温度で、約30%〜40%の間の酸
素分圧を有する雰囲気内にて、約5Torr〜10To
rrの間であり、前駆体溶液搬送レートは、約0.1m
l/分〜0.2ml/分の間であり、堆積時間は、約1
時間〜3時間の間である、請求項13に記載の方法。 - 【請求項17】 MOCVDによる堆積に用いる強誘電
体前駆体を準備する工程をさらに包含し、約5.0:3
〜5.5:3のモル比の[Pd(thd)2]および
[Ge(ETO)4](thdは、C11H19O2で
あり、ETOは、OC2H5である)の溶液は、ブチル
エーテルと、テトラヒドロフランと、イソプロパノール
と、テトラグリムとからなる溶媒の群から選択されたモ
ル比約8:2:1の溶媒からなる混合溶媒内で溶解さ
れ、該溶液は、約0.1M/Lの濃度のPGOを有し、
該溶液は、約180℃〜240℃の間の範囲内の温度
で、ポンプにより、約0.05ml/分〜0.20ml
/分の流速で蒸発器に注入され、これにより、前駆体ガ
スを形成し、MOCVD供給ラインは、約185℃〜2
45℃の間の温度で維持される、請求項13に記載の方
法。 - 【請求項18】 前記高誘電率層を形成する工程は、H
fO2および(Zr 0.5,Hf0.5)O2からなる
材料の群から選択される材料の層を、約3.5nm〜1
5.0nmの厚みにて形成する工程を包含する、請求項
13に記載の方法。 - 【請求項19】 前記アニーリングする工程は、純酸素
雰囲気内に約30分〜1時間の間に、約520℃〜56
0℃の間の温度で前記基板をアニーリングする工程を包
含する、請求項13に記載の方法。 - 【請求項20】 前記シリコン基板を準備する工程は、
SC1+SC2(SC1は、5500mlの脱イオン
水、1100mlのNH4OHおよび1100mlのH
2O2の混合物であり、SC2は、6000mlの脱イ
オン水、1000mlのHClおよび1000mlのH
2O2の混合物である)を用いて該基板をクリーニング
する工程を包含し、HFディップエッチによって任意の
表面酸化物を除去する工程をさらに包含する、請求項1
3に記載の方法。 - 【請求項21】 前記強誘電体シード層を堆積する工程
は、MOCVD、スパッタリングおよびゾル−ゲルから
なる技術の群から選択される堆積技術により、シード層
を堆積する工程を包含する、請求項13に記載の方法。
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