JP2002108316A - 表示コントロール方法、表示コントローラ、表示ユニット及び電子機器 - Google Patents

表示コントロール方法、表示コントローラ、表示ユニット及び電子機器

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JP2002108316A JP2000299718A JP2000299718A JP2002108316A JP 2002108316 A JP2002108316 A JP 2002108316A JP 2000299718 A JP2000299718 A JP 2000299718A JP 2000299718 A JP2000299718 A JP 2000299718A JP 2002108316 A JP2002108316 A JP 2002108316A
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Abstract

(57)【要約】 【課題】 読み出しレートより低いレートで生成される
動画データでも違和感のない動画表示を可能にする表示
コントロール方法、表示コントローラ、表示ユニット及
び電子機器を提供する。 【解決手段】 表示コントローラ８０は、表示データＲ
ＡＭ８２を備え、内部の発振回路で周波数ｆ0のフレー
ム周波数を生成する。表示データＲＡＭ８２の記憶領域
は液晶パネルの動画表示領域８４に対応し、フレーム周
波数ｆ0で表示データＲＡＭ８２から読み出された動画
データ８６により、液晶パネルが表示駆動される。表示
コントローラ８０は、表示データＲＡＭ８２に表示デー
タ生成回路８８からフレーム周波数ｆ0より低いフレー
ム周波数ｆ1で生成された表示データ９０が書き込まれ
る場合、少なくとも１走査ライン以上書き込みを先行さ
せてから、フレーム周波数ｆ0で表示データを読み出す
ように制御する。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、表示コントロール
方法、表示コントローラ、表示ユニット及び電子機器に
関し、特に動画表示に好適な表示コントロール方法、表
示コントローラ、表示ユニット及び電子機器に関する。
【０００２】
【背景技術及び発明が解決しようとする課題】近年の通
信技術、実装技術等の発達により、携帯型の電子機器の
表示部に数字や文字といったキャラクタ文字のみなら
ず、静止画像や動画像等ユーザにとって情報性の高い各
種データが表示できるようになった。
【０００３】このような電子機器に表示されるデータに
ついては、種々のデータ形式が提案されている。例えば
携帯電話機を例に挙げれば、ＭＰＥＧ（Moving Picture
Experts Group）の規格により圧縮して符号化された画
像データを受信または送信する技術が提案されている。
【０００４】この場合、携帯電話機の表示部として、例
えば液晶パネルが備えられ、受信された動画、あるいは
静止画が表示される。すなわち、例えば液晶パネルに
は、受信された動画が動画表示領域に表示され、静止画
表示領域には例えばその動画に関する説明、操作情報等
の静止画表示される。このような液晶パネルに対して動
画あるいは静止画を表示駆動する表示コントローラの一
例として、フレームメモリとして利用されるＲＡＭを内
蔵した液晶ドライバがある。
【０００５】液晶ドライバのＲＡＭの記憶領域には、動
画が表示される液晶パネルの動画表示領域に対応する動
画記憶領域に、動画データをリアルタイムに書き換える
必要がある。一方、液晶パネルの静止画表示領域に表示
される静止画は、携帯電話機のキー操作等によって変更
され、液晶ドライバのＲＡＭの記憶領域のうち静止画表
示領域に対応する静止画記憶領域に、更新すべき静止画
データを書き換える必要が生ずる。
【０００６】このような液晶ドライバのＲＡＭに記憶さ
れた表示データ（動画データ、或いは静止画データ）
は、人間の視覚特性を考慮して、概略６０分の１秒毎に
読み出され、液晶パネルが表示駆動される。従って、例
えばＭＰＥＧ規格のような圧縮データは伸張処理を行う
必要があってこの６０Ｈｚの読み出しレートで表示すべ
き領域に対応した液晶ドライバのＲＡＭに動画データを
書き換えることができない場合には、複数フレームにわ
たって同一画像を連続して読み出すことが行われる。
【０００７】本発明に係る発明者は、このような液晶ド
ライバにより表示駆動される液晶パネルの視認性を確認
したところ、液晶ドライバのＲＡＭの動画記憶領域が１
秒間に２０フレームから２５フレーム程度を越えるフレ
ーム数で書き換えられる範囲、すなわち液晶ドライバの
ＲＡＭから２フレームだけ連続して同一画像が読み出さ
れる範囲であれば、ある程度動画を視認できるレベルで
あることがわかった。
【０００８】これに対して、液晶ドライバのＲＡＭの動
画記憶領域が１秒間に２０フレームから２５フレーム程
度以下のフレーム数で書き換えられる範囲、すなわち液
晶ドライバのＲＡＭから少なくとも３フレーム以上連続
して同一画像が読み出される範囲の場合、液晶ドライバ
により表示駆動される動画が、前のフレームとのつなが
りに違和感がある等、液晶パネルに動画像を表示駆動す
る際の技術的課題を発見するに至った。
【０００９】本発明は以上のような技術的課題に鑑みて
なされたものであり、その目的とするところは、読み出
しレートより低いレートで生成される動画データを記憶
するＲＡＭを内蔵した場合に違和感のない動画表示を可
能にする表示コントロール方法、表示コントローラ、表
示ユニット及び電子機器を提供することにある。
【００１０】
【課題を解決するための手段】上記課題を解決するため
に本発明は、少なくとも１フレーム分の表示データを記
憶するメモリと、所与の表示タイミングを生成するタイ
ミング生成回路とを有する表示コントローラにより、３
フレーム以上連続した同一画像を含む画像を表示するた
めの表示データに基づいて表示部を表示駆動するための
表示コントロール方法であって、前記表示部を表示駆動
するために前記表示タイミングに基づく前記メモリから
の１走査ライン分の表示データの読み出しに先行して、
１走査ライン分の表示データを、前記表示タイミングに
同期して前記表示データの読み出し速度以上の速度で前
記メモリに書き込むことを特徴とする。
【００１１】このように本発明は、タイミング生成回路
とメモリとを有し、生成された表示タイミングに従っ
て、例えばフレームメモリとして用いられるメモリに記
憶された表示データを読み出すことができる表示コント
ローラによる表示コントロール方法である。表示部は、
この読み出された表示データに基づいて表示駆動され
る。
【００１２】ここで、３フレーム以上連続した同一画像
を含む画像の表示データというのは、例えば１秒間に６
０フレームずつ（フレーム周波数が６０Ｈｚの状態で）
メモリから表示データが読み出されている場合、１秒間
に２０フレームから２５フレーム程度以下のフレーム数
がメモリに書き込まれるときの表示データを意味する。
すなわち、上述したフレーム周波数で表示データを読み
出す必要があるため、メモリに記憶された表示データを
複数フレーム以上連続して同一のフレーム画像が読み出
されることになる。
【００１３】また、表示データというのは、動画データ
のみならず、静止画データをも含んでも良い。
【００１４】さらに読み出し速度というのは、１走査ラ
イン分の表示データの読み出し速度であって、１走査ラ
イン分の書き込み速度と同じ場合、読み出しレートと等
価である。
【００１５】従って、表示データの書き込みが行われる
場合、この書き込みを読み出しに先行させ、かつ１走査
ライン分の書き込み速度が１走査ライン分の読み出し速
度以上とすることでメモリへの書き込みが読み出しに追
い越されることがなくなる。これにより、前のフレーム
とのつながりに違和感がなくなり、このような表示コン
トローラによって表示部が表示駆動される場合、特に動
画の視認性を大幅に向上させることができるようにな
る。１走査ライン分の書き込み速度と、１走査ライン分
の読み出し速度とが同じ場合、フレーム周波数以上の周
波数で書き込みを行うことによって、同様の効果を得る
ことができる。
【００１６】また本発明は、前記表示データの書き込み
は、少なくとも１走査ライン以上前記読み出しに先行す
ることを特徴とする。
【００１７】すなわち、タイミング生成回路で表示タイ
ミングを生成するようにしているため、走査ラインのタ
イミングも生成することが可能であり、この走査ライン
単位で容易に表示データの読み出しを行うことができ
る。従って、１走査ラインの表示データの書き込みを先
行させ、なおかつ１走査ライン分の読み出し速度以上の
速度で１走査ライン分の書き込みを行うことによって、
１走査ライン分の表示データの書き込みが常に１走査ラ
イン分の読み出しに先行させる制御が容易となる。
【００１８】また本発明は、制御対象の走査ラインに対
して前記表示データの書き込みが行われた後、当該走査
ラインの表示データが読み出されることを特徴とする。
【００１９】すなわち、先行することを具体的に言え
ば、ある制御対象の走査ラインに着目すると、表示デー
タの読み出しが行われる走査ラインは、既に書き込みが
行われている状況を意味する。従って、同じフレーム内
で、ある走査ラインの書き込みが行われた後、当該走査
ラインの読み出しを行わせることで、前のフレームとの
つながりに違和感がなくなり、このような表示コントロ
ール方法により表示部が表示駆動される場合、特に動画
の視認性を大幅に向上させることができるようになる。
【００２０】また本発明は、所与のフレーム同期タイミ
ングを基準に1フレーム分の表示データの書き込みが終
了後、次のフレーム同期タイミングまで前記表示データ
の書き込みを停止することを特徴とする。
【００２１】このように表示データの書き込みが読み出
しに先行し、その１走査ライン分の書き込み速度が、１
走査ライン分の読み出し速度以上であるため、１フレー
ムの表示データの書き込みは、その読出が終了する前に
必ず終了する。従って、その終了以降、次のフレームの
書き込み開始まで、書き込みクロックなど書き込みに必
要な制御を停止させることで低消費電力化を図ることが
できる。
【００２２】また本発明は、少なくとも１フレーム分の
表示データを記憶するメモリと、所与の表示タイミング
を生成するタイミング生成回路とを有する表示コントロ
ーラにより、３フレーム以上連続した同一画像を含む画
像を表示するための表示データに基づいて表示部を表示
駆動するための表示コントロール方法であって、前記表
示タイミングに同期した前記メモリへの１走査ライン分
の表示データの書き込みに先行して、前記表示タイミン
グに同期して、前記表示データの書き込み速度以上の速
度で前記メモリから前記表示部を表示駆動するための１
走査ライン分の表示データを読み出すことを特徴とす
る。
【００２３】このように、表示データの書き込みが行わ
れる場合、表示データの読み出しを書き込みに先行さ
せ、かつ１走査ライン分の読み出し速度が１走査ライン
分の書き込み速度以上とすることでメモリからの読み出
しが書き込みに追い越されることがなくなる。これによ
り、前のフレームとのつながりに違和感がなくなり、こ
のような表示コントロール方法によって表示部が表示駆
動される場合、特に動画の視認性を大幅に向上させるこ
とができるようになる。１走査ライン分の書き込み速度
と、１走査ライン分の読み出し速度とが同じ場合、フレ
ーム周波数以上の周波数で書き込みを行うことによっ
て、同様の効果を得ることができる。
【００２４】また本発明は、前記表示データの読み出し
は、少なくとも１走査ライン以上の表示データの書き込
みに先行することを特徴とする。
【００２５】すなわち、タイミング生成回路で表示タイ
ミングを生成するようにしているため、走査ラインのタ
イミングも生成することが可能であり、この走査ライン
単位で容易に表示データの読み出しを行うことができ
る。従って、１走査ラインの表示データの読み出しを先
行させ、なおかつ１走査ライン分の書き込み速度以上の
速度で読み出しを行うことによって、１走査ライン分の
読み出しが常に１走査ライン分の書き込みに先行させる
制御が容易となる。
【００２６】また本発明は、制御対象の走査ラインに対
して前記表示データの読み出しが行われた後、当該走査
ラインの表示データが書き込まれることを特徴とする。
【００２７】ここで、先行することを具体的に言えば、
ある制御対象の走査ラインに着目すると、表示データの
書き込みが行われる走査ラインは、既に読み出しが行わ
れている状況を意味する。従って、同じフレーム内で、
ある走査ラインの読み出しが行われた後、当該走査ライ
ンの書き込みを行わせることで、前のフレームとのつな
がりに違和感がなくなり、このような表示コントロール
方法によって表示部が表示駆動される場合、特に動画の
視認性を大幅に向上させることができるようになる。
【００２８】また本発明は、前記メモリに書き込まれる
表示データは、前記表示コントローラによって生成され
た表示タイミングに同期して入力されることを特徴とす
る。
【００２９】これにより、例えば表示タイミングと非同
期に、内蔵するメモリに書き込むべき表示データが生成
される場合であっても、簡素な制御により前のフレーム
とのつながりが重要な動画データのような表示データの
供給を容易にする。
【００３０】また本発明は、３フレーム以上連続した同
一画像を含む画像を表示するための表示データに基づい
て、表示部を表示駆動するための表示コントローラであ
って、所与の表示タイミングを生成するタイミング生成
回路と、少なくとも１フレーム分の表示データを記憶す
るメモリと、前記表示部を表示駆動するために、前記表
示タイミングに基づいて前記メモリに記憶された１走査
ライン分の表示データの読み出しを制御する第１の制御
回路と、前記読み出しに先行して、前記表示タイミング
とは非同期で入力される１走査ライン分の表示データ
を、前記メモリに記憶された前記表示データの読み出し
速度以上の速度で前記メモリに書き込む第２の制御回路
とを含むことを特徴とする。
【００３１】このように本発明の一態様に係る表示コン
トローラは、タイミング生成回路とメモリとを含み、タ
イミング生成回路によって生成された表示タイミングに
従って、例えばフレームメモリとして用いられるメモリ
に記憶された表示データを読み出すものである。表示部
は、この読み出された表示データに基づいて表示駆動さ
れる。
【００３２】また本発明は、前記第２の制御回路は、少
なくとも１走査ライン以上前記読み出しに先行すること
を特徴とする。
【００３３】また本発明は、制御対象の走査ラインに対
して前記表示データの書き込みが行われた後、当該走査
ラインの表示データが読み出されることを特徴とする。
【００３４】また本発明は、所与のフレーム同期タイミ
ングを基準に1フレーム分の表示データの書き込みが終
了後、次のフレーム同期タイミングまで前記表示データ
の書き込みを停止することを特徴とする。
【００３５】また本発明は、３フレーム以上連続した同
一画像を含む画像を表示するための表示データに基づい
て、表示部を表示駆動するための表示コントローラであ
って、所与の表示タイミングを生成するタイミング生成
回路と、少なくとも１フレーム分の表示データを記憶す
るメモリと、前記表示タイミングとは非同期で入力され
る表示データを前記メモリに書き込む第２の制御回路
と、前記表示部を表示駆動するために、前記書き込みに
先行して、前記メモリへの１走査ライン分の表示データ
の書き込み速度以上の速度で、前記メモリに記憶された
１走査ライン分の表示データの読み出しを制御する第１
の制御回路とを含むことを特徴とする。
【００３６】また本発明は、前記第１の制御回路は、少
なくとも１走査ライン以上前記書き込みに先行すること
を特徴とする。
【００３７】また本発明は、制御対象の走査ラインに対
して前記表示データの読み出しが行われた後、当該走査
ラインの表示データが書き込まれることを特徴とする。
【００３８】また本発明は、前記表示タイミングを出力
する手段を含むことを特徴とする。
【００３９】このように表示コントローラから表示タイ
ミングを出力することで、例えば表示タイミングと非同
期に、内蔵するメモリに書き込むべき表示データが生成
される場合であっても、簡素な制御により前のフレーム
とのつながりが重要な動画データのような表示データの
供給を容易にする。
【００４０】また本発明は、複数の第１の電極と複数の
第２の電極により駆動される電気光学素子を有するパネ
ルと、前記複数の第１の電極を駆動するための上記いず
れかに記載の表示コントローラと、前記複数の第２の電
極を走査駆動する走査駆動ドライバとを含むことを特徴
とする。
【００４１】このようにすることで、低消費電力化を図
り、特に動画の視認性を大幅に向上させる表示ユニット
を提供することができる。
【００４２】また本発明は、上記記載の表示ユニット
と、前記表示ユニットに対し、前記表示データを供給す
る回路とを含むことを特徴とする。
【００４３】このように構成することによって、低消費
電力化を図り、特に動画の視認性を大幅に向上させる表
示ユニットを備える電子機器を提供することができる。
【００４４】
【発明の実施の形態】以下、本発明の好適な実施の形態
について図面を用いて詳細に説明する。
【００４５】１． 本実施形態の表示コントローラが適
用された電子機器 図１に、本実施形態の表示コントローラが適用される電
子機器の概略ブロック図を示す。
【００４６】この電子機器は、ＭＰＵ（マイクロプロセ
ッサユニット）１０と、表示ユニット２０とを含む。
【００４７】表示ユニット２０は、電気光学素子を有す
るマトリクスパネル、例えばカラー液晶パネル２２と、
この液晶パネル２２を駆動するＲＡＭ（広義には、メモ
リ）内蔵のＸドライバＩＣ（表示コントローラ）２４
と、走査用のＹドライバＩＣ２６とを有する。
【００４８】マトリクスパネル２２は、電圧印加によっ
て光学特性が変化する液晶その他の電気光学素子を用い
たものであれば良い。液晶パネル２２としては、例えば
単純マトリクスパネルで構成でき、この場合、複数のセ
グメント電極（第１の電極）が形成された第１基板と、
コモン電極（第２の電極）が形成された第２基板との間
に、液晶が封入される。液晶パネル２２は薄膜トランジ
スタ（ＴＦＴ）、薄膜ダイオード（ＴＦＤ）等の三端子
素子、二端子素子を用いたアクティブマトリクスパネル
であっても良い。これらのアクティブマトリクスパネル
も、ＲＡＭ内蔵ＸドライバＩＣ２４により駆動される複
数の信号電極（第１の電極）と、ＹドライバＩＣ２６に
より走査駆動される複数の走査電極（第２の電極）を有
する。
【００４９】液晶パネル２２には静止画と動画とを同時
に表示可能である。この場合、図１に示すように、画像
サイズによって定められる動画表示領域２２Ａと、それ
以外の静止画表示領域（テキストデータ表示領域）２２
Ｂの各領域が液晶パネルに設定される。
【００５０】ＭＰＵ１０から表示ユニット２０には、図
１に示すように、大別して表示コマンド／静止画データ
と、動画データとが供給される。表示コマンドとして代
表的なものに、コマンド／データの区別を示す信号Ａ
０、反転リセット信号ＸＲＥＳ、反転チップセレクト信
号ＸＣＳ、反転リード信号ＸＲＤおよび反転ライト信号
ＸＷＲ等がある。データＤ７〜Ｄ０は８ビットのコマン
ドデータ（静止画及び動画用アドレスデータを含む）ま
たは静止画データであり、コマンド／データ識別信号Ａ
０の論理によって区別されている。動画データは例えば
各６ビットのＲ，Ｇ，Ｂ信号であり、クロック信号ＣＬ
Ｋ、水平同期信号Ｈｓｙｎｃ、垂直同期信号Ｖｓｙｎｃ
等も供給される。
【００５１】図２に、図１のＭＰＵ１０および表示ユニ
ット２０を携帯電話機３０に搭載した例を示す。図２に
示すＭＰＵ１０は、携帯電話機３０の制御を司るＣＰＵ
１２を有し、このＣＰＵ１２には静止画用メモリ１４、
ＤＳＰ（ディジタル・シグナル・プロセッサ）１６が接
続されている。また、ＤＳＰ１６には動画用メモリ１８
が接続されている。
【００５２】この携帯電話機３０には、アンテナ３２を
介して受信された信号を復調し、あるいはアンテナ３２
を介して送信される信号を変調する変復調回路３４が設
けられている。そして、アンテナ３２からは、例えばＭ
ＰＥＧのレイヤーIVの規格にて符号化された動画データ
を送受信可能となっている。
【００５３】この携帯電話機３０には、例えばディジタ
ルビデオカメラ３６を設けることもできる。このディジ
タルビデオカメラ３６を介して動画データを取り込むこ
とができる。携帯電話機３０でのデータ送受信、ディジ
タルビデオカメラ３６での撮影等に必要な操作情報は、
操作入力部３８を介して入力される。
【００５４】ＭＰＵ１０に設けられたＣＰＵ１２は、液
晶パネル２２の動画表示領域２２Ａに動画を表示する際
には、その動画のサイズを動画情報から決定する。すな
わち、図１に示す動画のスタートアドレスＳＡ及びエン
ドアドレスＥＡを決定する。なお、動画表示領域２２Ａ
と静止画表示領域２２Ｂとを例えば上下でライン分割し
ても良く、この場合も同様にスタートアドレスＳＡ、エ
ンドアドレスＥＡが動画のサイズから決定される。
【００５５】この動画表示領域２２Ａに表示される動画
は、本実施形態ではアンテナ３２またはディジタルビデ
オカメラ３６から供給される。アンテナ３２から入力さ
れる信号は、変復調回路３４を介して復調されてＤＳＰ
１６にて信号処理される。このＤＳＰ１６は動画処理用
メモリ１８と接続され、アンテナ３２、変復調回路３４
を介して入力される圧縮データを伸張し、またＭＰＥＧ
のレイヤーIVの規格にて符号化されているデータについ
てはデコードする。変復調回路３４、アンテナ３２を介
して送信されるデータはＤＳＰ１６にて圧縮され、ＭＰ
ＥＧのレイヤーIVの規格にて符号化して送信する場合に
はエンコードされる。このようにＤＳＰ１６は、ＭＰＥ
Ｇの例えばレイヤーIVのデコーダ、エンコーダとしての
機能を有することができる。
【００５６】このＤＳＰ１６にはディジタルビデオカメ
ラ３６からの信号も入力され、アンテナ３２またはディ
ジタルビデオカメラ３６より入力された信号は、ＤＳＰ
１６にてＲＧＢ信号に処理されて表示ユニット２０に供
給される。
【００５７】ＣＰＵ１２は、操作入力部３８からの情報
等に基づき、必要により静止画用メモリ１４を用いて、
液晶パネル２２に表示される静止画の表示に必要なコマ
ンド、静止画データを表示ユニット２０に出力する。
【００５８】例えば、動画はインターネットを経由して
配信された映画情報であり、その劇場チケットを予約す
るための情報が静止画として表示され、操作入力部３８
からの情報に基づいてチケット予約が実施される。この
ため、ＣＰＵ１２はさらに、変復調回路３４、アンテナ
３２を介して静止画情報（例えば予約情報）を送出制御
する。またＣＰＵ１２は、必要により、ディジタルビデ
オカメラ３６にて撮影された動画情報を、変復調回路３
４、アンテナ３２を介して送出制御することができる。
【００５９】２． 本実施形態の表示コントローラの特
徴 本実施形態の表示コントローラ（狭義には、図１におけ
るＸドライバＩＣ２４）は、液晶パネルの画像表示領域
に対応した画像記憶領域を有するＲＡＭ（広義には、メ
モリ）を備え、内部の発振回路（広義には、表示タイミ
ング生成手段）により例えば６０Ｈｚのフレーム周波数
を液晶パネルの表示駆動を行う表示タイミングとして生
成する。
【００６０】このようにＲＡＭと、最も周波数の高い発
振回路とを内蔵することで、液晶パネルの基板上に搭載
した場合、低消費電力化を図ることができる。
【００６１】さらに本実施形態の表示コントローラは、
３フレーム以上連続した同一画像を含む画像の１走査ラ
イン分の表示データを、上述した表示タイミングで既に
ＲＡＭに記憶された１走査ライン分の表示データの読み
出し速度以上に書き込み、しかもその書き込みが読み出
しに先行して行われるようになっている。
【００６２】図３に、本実施形態の表示コントローラの
原理的動作を説明するための説明図を示す。ここでは、
表示データとして６０Ｈｚのフレーム周波数で表示処理
される動画データに着目した場合を示すが、静止画デー
タであっても良い。
【００６３】本実施形態における表示コントローラ８０
は、少なくとも１フレーム分の表示データを記憶する表
示データＲＡＭ８２を備え、図示しない内部の発振回路
で周波数ｆ0（例えばｆ0＝６０Ｈｚ）のフレーム周波数
を生成する。表示データＲＡＭ８２の記憶領域のうち少
なくとも一部は、液晶パネルの動画表示領域８４に対応
している。表示コントローラ８０は、この生成したフレ
ーム周波数ｆ0で、表示データＲＡＭ８２に記憶された
動画データ８６を読み出し、液晶パネルを表示駆動し、
その動画表示領域８４に動画を表示させる。
【００６４】表示コントローラ８０の表示データＲＡＭ
８２には、表示データ生成回路８８から供給された動画
データ９０が書き込まれるようになっている。表示デー
タ生成回路８８は、例えばＭＰＥＧ−４規格の１秒間に
１５フレーム程度といった、フレーム周波数ｆ0より低
いフレーム周波数ｆ1（ｆ1＜ｆ0）の動画像の圧縮デー
タ９２を伸張し、動画データ９０を生成する。
【００６５】表示コントローラ８０は表示データＲＡＭ
８２の記憶内容に関わりなくフレーム周波数ｆ0で動画
データを読み出す。従って、表示データ生成回路８８が
表示データＲＡＭ８２に対し上述した伸張処理等により
フレーム周波数ｆ0より低い周波数ｆ1で動画データを書
き込まざるを得ない場合、表示コントローラ８０は表示
データＲＡＭ８２から連続する複数フレームにわたって
同一画像の動画データを読み出して、液晶パネルを表示
駆動することで例えば動画表示を行う。
【００６６】そこで、本実施形態の表示コントローラ８
０は、フレーム周波数ｆ0を表示用のフレーム同期信号
として、表示用垂直同期信号９１を表示データ生成回路
８８に対して出力する。表示データ生成回路８８は、こ
の表示用垂直同期信号９１に同期して、表示コントロー
ラ８０に対し生成した動画データ９０を出力するように
なっている。そして、表示コントローラ８０において、
３フレーム以上同一画像が連続する画像を含む動画デー
タが表示データＲＡＭ８２に書き込まれる場合、この表
示用垂直同期信号９１を起点に少なくとも１走査ライン
以上書き込みを先行させてから、フレーム周波数ｆ0で
表示データＲＡＭ８２から動画データを読み出すように
制御している。これにより、液晶パネルに表示される動
画像において、例えば前のフレームとのつながりに違和
感をなくし、視認性を大幅に向上させることができるよ
うになる。
【００６７】図４（Ａ）、（Ｂ）に、本実施形態の表示
コントローラによる表示データＲＡＭの書き込みタイミ
ングと読み出しタイミングとの関係を模式的に示す。こ
こでは、表示データＲＡＭの記憶領域を液晶パネルの動
画表示領域の走査ライン単位に模式的に示している。
【００６８】図４（Ａ）は、動画表示領域９４に対応し
た表示データＲＡＭの記憶領域に、動画表示領域９４の
１走査ライン目の動画データが書き込まれた時点での、
動画データの書き込み位置と読み出し位置との関係を示
している。すなわち、図４（Ａ）に示すように動画表示
領域９４の１走査ライン目の書き込みが行われてから、
当該１走査ライン目の読み出し動作９６が行われる。従
って、当該１走査ライン目の読み出し動作９６が行われ
たとき、既に２走査ライン目の書き込み動作９８が行わ
れている。
【００６９】本実施形態では、表示１走査ライン分の表
示データの読み出し動作９６の速度ＶRと、１走査ライ
ン分の表示データの書き込み動作９８の速度ＶWとの間
に次の（１）式の関係を有している。
【００７０】ＶW≧ＶR ・・・（１） 従って、書き込み動作９８が読み出し動作９６に先行し
て行われる限り、液晶パネルを表示駆動する動画データ
の読み出しが、動画表示領域９４への新たな動画データ
の書き込みを追い越すことがない。これにより、前のフ
レームとのつながりの違和感を解消し、滑らかな動きを
する動画像を表示させることができるようになる。
【００７１】図４（Ｂ）は、動画表示領域９４に対応し
た表示データＲＡＭの記憶領域に、動画表示領域９４の
Ｍ走査ライン目の動画データが書き込まれた時点での書
き込み位置と読み出し位置との関係を示している。
（１）式により、Ｍ（Ｍは自然数）走査ライン目の動画
データが読み出された時点では、既にＮ（Ｍ＜Ｎ、Ｎは
自然数）走査ライン目の書き込みが行われている。
【００７２】ここで、表示１走査ライン分の表示データ
の読み出し動作９６の速度ＶRと、１走査ライン分の表
示データの書き込み動作９８の速度ＶWとが等しい場
合、読み出しレートｆRと書き込みレートｆWとの関係
は、次の（２）式のように規定される。
【００７３】ｆW≧ｆR ・・・（２） なお、図３の場合、読み出しレートｆRはフレーム周波
数ｆ0（＝６０Ｈｚ）に相当する。従って、この場合６
０Ｈｚ以上のレートで書き込みが行われなければならな
い。
【００７４】３． 本実施形態の表示コントローラの構
成図５は、本実施形態の表示コントローラとして、図１
に示すＲＡＭ内蔵ＸドライバＩＣ２４のブロック図であ
る。図５に示すＲＡＭ内蔵ＸドライバＩＣ２４の入出力
回路として、ＭＰＵインターフェース１００と入出力バ
ッファ１０２、入力バッファ１０４が設けられている。
【００７５】ＭＰＵインターフェース１００には、反転
チップセレクト信号ＸＣＳ、コマンド／データの識別信
号Ａ０、反転リード信号ＸＲＤ、反転ライト信号ＸＷ
Ｒ、反転リセット信号ＸＲＥＳ等が入力される。
【００７６】入出力バッファ１０２には、例えば８ビッ
トのコマンドまたは静止画データＤ７〜Ｄ０が入力され
る。なお、図５では信号Ｄ７〜Ｄ０はパラレルで入出力
される例を示しているが、ＸドライバＩＣ２４内の表示
データＲＡＭ１６０からＭＰＵ１０にデータを読み出す
必要がない場合には、先頭ビットを識別信号Ａ０とし、
それに続く信号Ｄ７〜Ｄ０をシリアルで入出力しても良
い。こうすると、ＭＰＵ１０及びＸドライバＩＣ２４の
端子数を減らすことができる。
【００７７】入力バッファ１０４には、例えば各６ビッ
トのＲ，Ｇ，Ｂ信号からなる動画データと、クロック信
号ＣＬＫとが入力される。各６ビットのＲ，Ｇ，Ｂ信号
は、クロック信号ＣＬＫに同期してパラレルで入出力さ
れる。
【００７８】ＸドライバＩＣ２４には、ＭＰＵインター
フェース１００及び入出力バッファ１０２に接続された
第１のバスライン１１０と、入力バッファ１０４に接続
された第２のバスライン１２０とが設けられている。
【００７９】第１のバスライン１１０にはバスホールダ
１１２とコマンドデコーダ１１４とが接続され、第２の
バスライン１２０にはバスホールダ１２２が接続されて
いる。なお、入出力バッファ１０２にはステータス設定
回路１１６が接続され、ＸドライバＩＣ２４の動作状態
がＭＰＵ１０に出力されるようになっている。この動作
状態とは、例えば表示がオン状態であるか否かや、画面
内の所与のスクロール領域のスクロールモードといった
ＸドライバＩＣ２４で設定されている内部状態であり、
ＭＰＵ１０から入力された所与のコマンドがコマンドデ
コーダ１１４でデコードされた結果、出力されるように
なっている。
【００８０】第１，第２のバスライン１１０，１２０は
共に、表示データＲＡＭ１６０のＩ／Ｏバッファ１６２
に接続され、表示データＲＡＭ１６０に対してリード、
ライトされる静止画データ及び動画データが伝送され
る。
【００８１】ＸドライバＩＣ２４には、上述した表示デ
ータＲＡＭ１６０、Ｉ／Ｏバッファ１６２の他に、ＭＰ
Ｕ系制御回路１３０、カラムアドレス制御回路１４０、
ページアドレス制御回路１５０、ドライバ系制御回路１
７０、ＰＭＷデコーダ回路１８０及び液晶駆動回路１９
０等が設けられている。
【００８２】ＭＰＵ系制御回路１３０は、コマンドデコ
ーダ１１４を介して入力されるＭＰＵ１０のコマンドに
基づいて、表示データＲＡＭ１６０に対するリード、ラ
イト動作を制御する。このＭＰＵ系制御回路１３０によ
り制御されるカラムアドレス制御回路１４０及びページ
アドレス制御回路１５０が設けられている。本実施形態
では、カラムアドレス制御回路１４０は、静止画データ
の書き込みカラムアドレスと静止画及び動画データの読
み出しカラムアドレスを指定する第１のカラムアドレス
制御回路１４２と、動画データの書き込みカラムアドレ
スを指定する第２のカラムアドレス制御回路１４４とを
有する。ページアドレス制御回路１５０は、静止画デー
タの書き込みページアドレスと静止画及び動画データの
読み出しページアドレスとを指定する第１のページアド
レス制御回路１５２と、動画データの書き込みページア
ドレスを指定する第２のページアドレス制御回路１５４
とを有する。なお、図５では図示していないが、ＭＰＵ
１０からの水平・垂直同期信号Ｈ・ＶｓｙｎｃがＭＰＵ
系制御回路１３０に入力される。水平同期信号Ｈｓｙｎ
ｃは、動画データの書き込みの際のノイズ等の誤書き込
みによる表示ずれ等を極力抑えるために、第２のカラム
・ページアドレス制御回路１４４、１５４内に設けられ
たカウンタのセット、リセットに用いられる。さらに、
水平・垂直同期信号Ｈ・Ｖｓｙｎｃは、カラムアドレ
ス、ページアドレスをスタートアドレスＳＡに戻すため
に用いられる。また、ページアドレス制御回路１５０
は、ドライバ系制御回路１７０により制御されて１走査
ライン毎に表示アドレスを指定する表示アドレス制御回
路１５６を含んでいる。
【００８３】ドライバ系制御回路１７０は、Ｘドライバ
系制御回路１７２及びＹドライバ系制御回路１７４を含
む。このドライバ系制御回路１７０は、発振回路１７６
からの発振出力に基づいて表示用垂直同期信号Ｖｓｙｎ
ｃ、階調制御パルスＧＣＰ、極性反転信号ＦＲ、走査用
ラッチパルスＬＰ、Ｙドライバ用スタートパルスＹＤ、
Ｙドライバ用走査クロックＹＣＬＫ、表示データＲＡＭ
１６０への書き込みクロック等を発生し、ＭＰＵ系制御
回路１３０とは独立して、表示アドレス制御回路１５
６、ＰＷＭデコード回路１８０、電源制御回路１７８お
よびＹドライＩＣ２６を制御する。
【００８４】本実施形態のドライバ系制御回路１７０
は、発振回路１７６からの発振出力に基づいて生成され
た表示用垂直同期信号Ｖｓｙｎｃを外部出力する。図示
しない表示データ生成回路では、生成した動画データ
を、この表示用垂直同期信号Ｖｓｙｎｃに同期して本実
施形態の示コントローラとしてのＲＡＭ内蔵Ｘドライバ
ＩＣ２４に供給する。
【００８５】ドライバ系制御回路１７０は、発振回路１
７６からの発振出力に基づいて生成された書き込みクロ
ックに同期して、この表示用垂直同期信号Ｖｓｙｎｃに
対応して供給された動画データを、表示用データＲＡＭ
１６０に新たなフレームの画像として１走査ライン毎に
書き込む。
【００８６】さらに、ドライバ系制御回路１７０は、発
振回路１７６からの発振出力に基づいて生成された走査
用ラッチパルスＬＰを基準に、表示用データＲＡＭ１６
０から１フレーム分の画像を１走査ライン毎に読み出
す。この読み出しは、少なくとも１走査ラインの書き込
みが先行してから行われ、さらに表示データＲＡＭ１６
０への１走査ライン分の表示データの書き込み速度が、
表示データＲＡＭ１６０からの表示１走査ライン分の表
示データの読み出し速度以上で行われるようになってい
る。
【００８７】ＰＷＭデコード回路１８０は、表示データ
ＲＡＭ１６０より１走査ライン毎に読み出されるデータ
をラッチして、極性反転周期に従って階調値に応じたパ
ルス幅の信号を出力する。液晶駆動回路１９０は、ＰＷ
Ｍデコード回路１８０からの信号を、ＬＣＤ表示系の電
圧に応じた電圧にシフトさせ、図１に示す液晶パネル２
０のセグメント電極ＳＥＧに供給する。
【００８８】３．１ 表示データＲＡＭおよびその周辺
回路 図６に、表示データＲＡＭ１６０およびその周辺回路の
概略回路図を示す。図６には、第１，第２のカラムアド
レス制御回路１４２，１４４、第１，第２のページアド
レス制御回路１５２，１５４および表示アドレス制御回
路１５６のそれぞれの最終段に設けられた第１，第２の
カラムアドレスデコーダ１４２Ａ，１４４Ａ、第１，第
２のページアドレスデコーダ１５２Ａ，１５４Ａおよび
表示アドレスデコーダ１５６Ａが示されている。
【００８９】図６にはさらに、第１，第２行目のメモリ
セルＣ１０，Ｃ１１…、Ｃ２０，Ｃ２１…が示されてい
る。そして、図６に示す各メモリセルには、第１〜第３
のワード線Ｗ１〜Ｗ３と、第１のビット線対Ｂ１，／Ｂ
１と、第２のビット線対Ｂ２，／Ｂ２とが接続されてい
る。
【００９０】第１のカラムアドレスデコーダ１４２Ａ
は、第１のビット線対Ｂ１，／Ｂ１に接続された第１の
カラムスイッチＳＷ１をオン、オフさせる信号を出力す
る。第２のカラムアドレスデコーダ１４４Ａは、第２の
ビット線対Ｂ２，／Ｂ２に接続された第２のカラムスイ
ッチＳＷ２をオン、オフさせる信号を出力する。第１の
ページアドレスデコーダ１５２Ａは第１のワード線Ｗ１
を、第２のページアドレスデコーダ１５２Ａは第２のワ
ード線Ｗ２を、表示アドレスデコーダ１５６Ａは第３の
ワードラインＷ３を、それぞれをアクティブとする信号
を供給する。
【００９１】第２のカラムおよびページアドレスデコー
ダ１４４Ａ，１５４Ａは、動画データ（Ｒ，Ｇ，Ｂ）を
書き込むためのカラムおよびページアドレスを指定する
場合にのみ用いられ、このアドレス指定により第２のバ
スライン１２０、第２のカラムスイッチＳＷ２を介し
て、動画データ（Ｒ，Ｇ，Ｂ）がメモリセルに書き込ま
れる。
【００９２】第１のカラムおよびページアドレスデコー
ダ１４２Ａ，１５２Ａは、静止画データを書き込むとき
と、静止画および動画データを読み出すときに、カラム
およびページアドレスを指定する。このアドレス指定に
より第１のバスライン１２０、第１のカラムスイッチＳ
Ｗ１を介して、表示データＲＡＭ１６０に対してデータ
がリード・ライトされる。
【００９３】表示アドレスデコーダ１５６Ａは、第３の
ワード線Ｗ３を順次１本ずつアクティブにすることで、
１走査ライン上の全メモリセルのデータを表示データ出
力線ＯＵＴに読み出すものである。この読み出しデータ
が図５に示すＰＷＭデコーダ回路１８０に供給されて液
晶駆動に供される。
【００９４】３．２ メモリセルの構成 図７に、表示データＲＡＭ１６０内のメモリセルＣ１０
を示す回路図を示す。メモリセルＣ１０は、他のメモリ
セルと同一の構成を有する。このメモリセルＣ１０は、
２つのＣＭＯＳインバータ２１０，２０２にて構成され
るメモリ素子２００を有する。２つのＭＯＳインバータ
２０１，２０２は、その入出力同士を互いに接続する第
１，第２の配線２０４，２０６を有する。第１配線２０
４とビット線Ｂ１との間には第１のＮ型ＭＯＳトランジ
スタ２１０（第１のスイッチ）が接続され、そのゲート
は第１のワード線Ｗ１に接続されている。同様に、第２
配線２０６とビット線／Ｂ１との間には第２のＮ型ＭＯ
Ｓトランジスタ２１２（第１のスイッチ）が接続され、
そのゲートは第１のワード線Ｗ１に接続されている。
【００９５】以上の構成により、第１のページアドレス
デコーダ１５２Ａからのアクティブ信号により第１のワ
ード線Ｗ１が論理レベル「Ｈ」（以下、単にＨと略
す。）となると、第１，第２のＮ型トランジスタ２１
０，２１２がオンされる。これにより、メモリセルＣ１
０は第１の一対のビット線Ｂ１，／Ｂ１と接続される。
このとき、第１のカラムアドレスデコーダ１４２Ａから
アクティブ信号により第１のカラムスイッチＳＷ１がオ
ンしていると、メモリセルＣ１０に対するデータのリー
ド・ライトが可能となる。
【００９６】また、電源供給線ＶＤＤと表示データ出力
線ＯＵＴとの間には第１，第２のＰ型ＭＯＳトランジス
タ２２０，２２２が接続されている。第１のＰ型ＭＯＳ
トランジスタ２２０のゲートは第２の配線２０６に接続
され、第２のＰ型ＭＯＳトランジスタ２２２のゲートは
第３のワード線Ｗ３に接続されている。
【００９７】メモリセルＣ１０のデータを表示データ出
力線ＯＵＴに読み出す前に、この表示データ出力線ＯＵ
Ｔは論理レベル「Ｌ」（以下、単にＬと略す。）にプリ
チャージされている。このプリチャージ動作後に第３の
ワード線Ｗ３をＬとして第２のＰ型ＭＯＳトランジスタ
２２２をオンさせた状態で、表示データ出力線ＯＵＴの
データがＰＷＭデコーダ回路１８０にてラッチされる。
このとき、第２の配線２０６の電位がＨ（第１の配線２
０４の電位がＬ）であれば表示データ出力線ＯＵＴはＬ
のままであり、第２の配線２０６の電位がＬ（第１の配
線２０４の電位がＨ）であれば表示データ出力線ＯＵＴ
はＨとなる。このようにして、表示データＲＡＭ１６０
からの表示データの読み出しを１走査ライン同時に行う
ことができる。
【００９８】本実施形態ではさらに、第２のワード線Ｗ
２と第２のビット線対Ｂ２，／Ｂ２とが設けられてい
る。このため、第１配線２０４とビット線Ｂ２との間に
は第３のＮ型ＭＯＳトランジスタ２３０（第２のスイッ
チ）が接続され、そのゲートは第２のワード線Ｗ２に接
続されている。同様に、第２配線２０６とビット線／Ｂ
２との間には第４のＮ型ＭＯＳトランジスタ２３２（第
２のスイッチ）が接続され、そのゲートは第２のワード
線Ｗ２に接続されている。
【００９９】以上の構成により、第２のページアドレス
デコーダ１５４Ａからのアクティブ信号により第２のワ
ード線Ｗ２がＨとなると、第３，第４のＮ型トランジス
タ２３０，２３２がオンされ、メモリセルＣ１０は第２
の一対のビット線Ｂ２，／Ｂ２と接続される。このと
き、第２のカラムアドレスデコーダ１４４Ａからアクテ
ィブ信号により第２のカラムスイッチＳＷ２がオンして
いると、メモリセルＣ１０に対する動画データのライト
が可能となる。
【０１００】４． 本実施形態の表示コントローラの動
作タイミング ＭＰＵ１０は、図１に示す動画表示領域２２Ａのスター
トおよびエンドアドレスＳＡ，ＥＡと対応する表示デー
タＲＡＭ１６０のページアドレスおよびカラムアドレス
を、動画情報から予め知得している。このためＭＰＵ１
０は、表示データＲＡＭ１６０のエリアのうち動画表示
領域２２Ａと対応するエリアのカラムアドレスおよびペ
ージアドレスを、所与の書き込み周波数に従って繰り返
し指定することが可能となる。この動画表示領域２２Ａ
と対応するエリアのカラムアドレスおよびページアドレ
スは、ＸドライバＩＣ２４の入出力バッファ１０２、Ｍ
ＰＵ系制御回路１３０を経由して、第２のカラムアドレ
ス制御回路１４４および第２のページアドレス制御回路
１５４に入力される。最終的に、図６に示す第２のカラ
ムアドレスデコーダ１４４Ａおよび第２のページアドレ
スデコーダ１５４Ａを介して、表示データＲＡＭ１６０
のカラムおよびページアドレスが指定される。動画デー
タについて、入力バッファ１０４および第２のバスライ
ン１２０を経由させることで、静止画データのバスライ
ン１１０とは異なる経路にてリアルタイムで伝送するこ
とができ、それにより動画データがリアルタイムで書き
換えられることになる。
【０１０１】一方ＭＰＵ１０は、表示データＲＡＭ１６
０のエリアのうち静止画表示領域２２Ａと対応するエリ
アのカラムアドレスおよびページアドレスを指定して、
操作入力部３８からの情報入力があった時等の静止画デ
ータに変更が生じた時にのみ、所与の書き込み周波数に
てデータ書き換えを実施する。
【０１０２】このように、本実施形態では、静止画と動
画とを表示データＲＡＭ１６０に書き込むにあたって、
アドレス指定およびデータ伝送をそれぞれ別ルートにて
実施し、メモリセルはそれらのいずれのデータも書き込
めるように構成されている。従って、静止画と動画とを
同時にページ単位で異なるメモリセルに書き込むことが
可能となり、どちらか一方のデータ書き込みを停止する
必要はない。
【０１０３】また、メモリセルは静止画および動画のい
ずれのデータも書き込めるように構成されているので、
動画表示領域２２Ａを任意に変更することが可能とな
る。
【０１０４】ここで、液晶パネル２２の動画表示領域２
２Ａに動画を表示するに際しては、例えば６０Ｈｚすな
わち１秒間に６０フレームを表示できる表示タイミング
に従って、表示データＲＡＭ１６０から表示データが読
み出される。これに対して、表示データＲＡＭ１６０へ
の書き込みタイミングは、上述したようにその読み出し
タイミングに先行し、その１走査ライン分の表示データ
の書き込み速度は１走査ライン分の表示データの読み出
し速度以上で行われるようになっている。
【０１０５】図８に、本実施形態の表示コントローラに
よる動画データの書き込みタイミングを示す。
【０１０６】すなわち、内部で生成された発振回路の発
振出力に基づいて１フレーム単位に生成される表示用垂
直同期信号Ｖｓｙｎｃのエッジを基準に、書き込みクロ
ック（ＣＬＫ）の出力が開始され、１フレームの動画デ
ータが順次１走査ラインずつ表示データＲＡＭ１６０に
設定された動画表示領域２２Ａに対応した動画記憶領域
に書き込まれる。
【０１０７】一方、表示用垂直同期信号Ｖｓｙｎｃのエ
ッジを基準に走査用ラッチパルスＬＰの出力が開始され
るが、フレーム同期信号としての表示用垂直同期信号Ｖ
ｓｙｎｃに対して１走査ライン分だけ遅延させた２つ目
のラッチパルスに同期して、表示データＲＡＭ１６０に
設定された動画表示領域２２Ａに対応した動画記憶領域
から、順次その読み出しが行われる。すなわち、書き込
みを１走査ライン先行させてから、読み出しが行われ
る。
【０１０８】書き込みクロックは、例えば表示データＲ
ＡＭ１６０に設定された動画表示領域２２Ａに対応した
動画記憶領域のサイズが１２０走査ラインであるものと
すると、１２０走査ラインの書き込みが終了すると、Ｈ
に固定され、書き込みクロックの動作が停止される。
【０１０９】これ以降、表示データＲＡＭ１６０に対し
動画データの書き込みが行われる場合、１フレーム毎に
書き込みタイミングと読み出しタイミングとは同様の関
係をもって表示データＲＡＭ１６０へのアクセスが行わ
れる。
【０１１０】５． 変形例 本実施形態における表示コントローラは、内蔵する表示
データＲＡＭに対し、表示データの書き込みを少なくと
も１走査ライン先行させてから、その読み出しを行うよ
うにしていたが、これに限定されるものではない。本変
形例における表示コントローラは、内蔵する表示データ
ＲＡＭからの読み出しを１走査ライン先行させてから、
後続する１フレーム分の表示データを書き込む。
【０１１１】本変形例における表示コントローラは、本
実施形態における表示コントローラと同様の構成である
ため説明を省略する。
【０１１２】本変形例では、表示１走査ライン分の表示
データの読み出しの速度ＶR´と、１走査ライン分の表
示データの書き込みの速度ＶW´との間に次の（３）式
の関係が成り立つようになっている。
【０１１３】ＶR´≧Ｖw´＞ＶR0 ・・・（３） ここで、ＶR0は、これ以上遅くなると次のフレームの１
走査ライン目の表示データの読み出しが始まるとされる
読み出し速度の最低値を示す。この場合、１走査ライン
分の表示データの書き込み速度ＶW´が１走査ライン分
の表示データの読み出し速度ＶR0以下となると、次のフ
レームの表示データの読み出しが始まってしまい、液晶
パネルに表示される動画の視認性に違和感が残ってしま
う可能性がある。
【０１１４】しかしながら、読み出しが書き込みに先行
して行われ、その１走査ライン分の表示データの書き込
み速度が（３）式の関係を有する限り、動画表示領域に
おける新たな動画データの書き込みが、液晶パネルを表
示駆動するフレームの動画データの読み出しを追い越す
ことがない。この場合でも、前のフレームとのつながり
の違和感を解消することができる。
【０１１５】図９に、本変形例の表示コントローラによ
る動画データの書き込みタイミング及び読み出しタイミ
ングを示す。
【０１１６】すなわち、１フレーム単位に出力される表
示用垂直同期信号Ｖｓｙｎｃのエッジを基準に、走査用
ラッチパルスＬＰの出力が開始され、１フレームの動画
データが順次１走査ラインずつ表示データＲＡＭ１６０
に設定された動画表示領域２２Ａに対応した動画記憶領
域から読み出される。
【０１１７】一方、フレーム同期信号としての表示用垂
直同期信号Ｖｓｙｎｃのエッジに同期して出力される走
査用ラッチパルスＬＰのうち、１走査ライン分だけ遅延
させた２つ目のラッチパルスＬＰに同期して、表示デー
タＲＡＭ１６０に設定された動画表示領域２２Ａに対応
した動画記憶領域に、順次1走査ラインずつ動画データ
の書き込みが行われる。すなわち、読み出しを１走査ラ
イン先行させてから、書き込みが行われる。
【０１１８】これ以降、表示データＲＡＭ１６０に対し
動画データの書き込みが行われる場合、１フレーム毎に
書き込みタイミングと読み出しタイミングとは同様の関
係をもって表示データＲＡＭ１６０へのアクセスが行わ
れる。
【０１１９】ここで、１走査ライン分の表示データの読
み出しの速度ＶR´と１走査ライン分の表示データの書
き込みの速度ＶW´とが同じ場合、１走査ライン分の表
示データの読み出しレートｆR´と１走査ライン分の表
示データの書き込みレートｆW´との関係で次の（４）
式のように規定される。
【０１２０】ｆR´≧ｆW´＞ｆR0 ・・・（４） なお、図３の場合、読み出しレートｆR´はフレーム周
波数ｆ0（＝６０Ｈｚ）に相当する。また、ｆR0は、こ
れ以上低レートになると次のフレームの表示データの読
み出しが始まる最低のフレーム周波数を示す。
【０１２１】なお本実施形態及び本変形例における表示
コントローラは、内蔵する表示データＲＡＭ１６０に設
定された動画表示領域に対応した動画記憶領域に対し、
１フレーム分の動画データを書き込む場合について説明
したが、これに限定されるものではない。例えば、内蔵
する表示データＲＡＭ１６０の記憶領域全体を動画表示
領域として、これに対応した動画記憶領域に対し、１フ
レーム分の動画データを書き込む場合についても同様に
行うことができる。
【０１２２】また、本実施形態及び本変形例における表
示コントローラに内蔵するＲＡＭは、３ポートＲＡＭと
して説明したが、これに限定されるものではない。内蔵
ＲＡＭとして、２ポートＲＡＭであっても同様である。
この場合、１フレーム分の動画データと次のフレームの
動画データを表示データＲＡＭに書き込む間に、例えば
静止画データを表示データＲＡＭに書き込むといった複
雑な書き込み制御が必要となる。
【０１２３】さらに、本実施形態及び本変形例における
表示コントローラをＸドライバＩＣとして説明したが、
これに限定されるものではない。例えば、表示コントロ
ーラにＸドライバＩＣの機能だけでなくＹドライバＩＣ
の機能をも内蔵し、ＸドライバＩＣとＹドライバＩＣを
１チップ化したものであっても同様である。
【０１２４】さらにまた、本実施形態及び本変形例にお
ける表示コントローラは、高耐圧性を要求される液晶駆
動回路を分離して、２チップ化するようにしても良い。
【０１２５】本発明は本実施形態及び本変形例に限定さ
れるものではなく、本発明の要旨の範囲内で種々の変形
実施が可能である。
【図面の簡単な説明】
【図１】本実施形態における表示コントローラが適用さ
れる電子機器の概略ブロック図である。
【図２】本実施形態における表示コントローラが適用さ
れる電子機器の一例である携帯電話機の概略ブロック図
である。
【図３】本実施形態の表示コントローラの動作原理を説
明するための説明図である。
【図４】図４（Ａ）、（Ｂ）は、本実施形態の表示コン
トローラによる書き込み位置及び読み出し位置の関係を
模式的に示した説明図である。
【図５】本実施形態の表示コントローラとしてのＸドラ
イバＩＣの概略ブロック図である。
【図６】本実施形態における表示データＲＡＭ及びその
周辺回路の概略説明図である。
【図７】本実施形態の表示データＲＡＭ内のメモリセル
の構成図である。
【図８】本実施形態における表示コントローラによる動
画データの書き込みタイミング及び読み出しタイミング
を示すタイミングチャートである。
【図９】本変形例の表示コントローラによる動画データ
の書き込みタイミング及び読み出しタイミングを示すタ
イミングチャートである。
【符号の説明】
１０ ＭＰＵ １２ ＣＰＵ １４ 静止画用メモリ １６ ＤＳＰ（ディジタル・シグナル・プロセッサ） １８ 動画用メモリ ２０ 表示ユニット ２２ 液晶パネル ２２Ａ 動画表示領域 ２２Ｂ 静止画表示領域 ２４ ＸドライバＩＣ ２６ ＹドライバＩＣ ３０ 携帯電話機 ３２ アンテナ ３４ 変復調回路 ３６ ディジタルビデオカメラ ３８ 操作入力部 ８０ 表示コントローラ ８２、１６０ 表示データＲＡＭ ８４、９４ 動画表示領域 ８６ 動画データ ８８ 表示データ生成回路 ９０ 表示データ ９１ 表示用垂直同期信号Ｖｓｙｎｃ ９２ 圧縮データ ９６ 読み出し動作 ９８ 書き込み動作 １００ ＭＰＵインターフェース １０２ 入出力バッファ １０４ 入力バッファ １１０ 第１のバスライン １１２ バスホールダ １１４ コマンドデコーダ １１６ ステータス設定回路 １２０ 第２のバスライン １２２ バスホールダ １３０ ＭＰＵ系制御回路 １４０ カラムアドレス制御回路 １４２ 第１のカラムアドレス制御回路 １４２Ａ 第１のカラムアドレスデコーダ １４４ 第２のカラムアドレス制御回路 １４４Ａ 第２のカラムアドレスデコーダ １５０ ページアドレス制御回路 １５２ 第１のページアドレス制御回路 １５２Ａ 第１のページアドレスデコーダ １５４ 第２のページアドレス制御回路 １５４Ａ 第２のページアドレスデコーダ １６２ Ｉ／Ｏバッファ １７０ ドライバ系制御回路 １７２ Ｘドライバ系制御回路 １７４ Ｙドライバ系制御回路 １７６ 発振回路 １７８ 電源制御回路 １８０ ＰＷＭデコーダ回路 １９０ 液晶駆動回路 ２００ メモリ素子 ２０１，２０２ ＣＭＯＳインバータ ２０４，２０６ 第１，第２の配線 ２１０，２１２ 第１，第２のＮ型ＭＯＳトランジスタ
（第１のスイッチ） ２２０，２２２ 第１，第２のＰ型ＭＯＳトランジスタ ２３０，２３２ 第３，第４のＮ型ＭＯＳトランジスタ
（第２のスイッチ） Ｗ１〜Ｗ３ 第１〜第３のワード線 Ｂ１，／Ｂ１ 第１のビット線対 Ｂ２，／Ｂ２ 第２のビット線対 Ｃ１０，Ｃ１１，Ｃ２０，Ｃ２１ メモリセル
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.7 識別記号 ＦＩ テーマコート゛(参考） Ｇ０９Ｇ 3/20 ６６０ Ｇ０９Ｇ 5/36 ５１０Ｍ 3/36 5/00 ５２０Ｖ 5/36 ５１０ Ｆターム(参考） 2H093 NA16 NA31 NA41 NA51 NC01 NC26 NC29 NC34 NC37 NC41 NC50 ND01 ND39 5C006 AF03 AF04 AF26 AF42 BB11 BC16 BF02 5C080 AA10 BB05 DD01 EE19 GG12 GG15 GG17 JJ01 JJ02 JJ03 JJ04 KK07 KK47 5C082 BA41 BB01 BB15 BB44 BD02 CA84 CB01 DA26 DA54 DA55 MM10

Claims (18)

    【特許請求の範囲】
  1. 【請求項１】 少なくとも１フレーム分の表示データを
    記憶するメモリと、所与の表示タイミングを生成するタ
    イミング生成回路とを有する表示コントローラにより、
    ３フレーム以上連続した同一画像を含む画像を表示する
    ための表示データに基づいて表示部を表示駆動するため
    の表示コントロール方法であって、前記表示部を表示駆
    動するために前記表示タイミングに基づく前記メモリか
    らの１走査ライン分の表示データの読み出しに先行し
    て、１走査ライン分の表示データを、前記表示タイミン
    グに同期して前記表示データの読み出し速度以上の速度
    で前記メモリに書き込むことを特徴とする表示コントロ
    ール方法。
  2. 【請求項２】 請求項１において、 前記表示データの書き込みは、少なくとも１走査ライン
    以上前記読み出しに先行することを特徴とする表示コン
    トロール方法。
  3. 【請求項３】 請求項１又は２において、 制御対象の走査ラインに対して前記表示データの書き込
    みが行われた後、当該走査ラインの表示データが読み出
    されることを特徴とする表示コントロール方法。
  4. 【請求項４】 請求項１乃至３のいずれかにおいて、 所与のフレーム同期タイミングを基準に１フレーム分の
    表示データの書き込みが終了後、次のフレーム同期タイ
    ミングまで前記表示データの書き込みを停止することを
    特徴とする表示コントロール方法。
  5. 【請求項５】 少なくとも１フレーム分の表示データを
    記憶するメモリと、所与の表示タイミングを生成するタ
    イミング生成回路とを有する表示コントローラにより、
    ３フレーム以上連続した同一画像を含む画像を表示する
    ための表示データに基づいて表示部を表示駆動するため
    の表示コントロール方法であって、 前記表示タイミングに同期した前記メモリへの１走査ラ
    イン分の表示データの書き込みに先行して、前記表示タ
    イミングに同期して、前記表示データの書き込み速度以
    上の速度で前記メモリから前記表示部を表示駆動するた
    めの１走査ライン分の表示データを読み出すことを特徴
    とする表示コントロール方法。
  6. 【請求項６】 請求項５において、 前記表示データの読み出しは、少なくとも１走査ライン
    以上の表示データの書き込みに先行することを特徴とす
    る表示コントロール方法。
  7. 【請求項７】 請求項５又は６において、 制御対象の走査ラインに対して前記表示データの読み出
    しが行われた後、当該走査ラインの表示データが書き込
    まれることを特徴とする表示コントロール方法。
  8. 【請求項８】 請求項１乃至７のいずれかにおいて、 前記メモリに書き込まれる表示データは、前記表示コン
    トローラによって生成された表示タイミングに同期して
    入力されることを特徴とする表示コントロール方法。
  9. 【請求項９】 ３フレーム以上連続した同一画像を含む
    画像を表示するための表示データに基づいて、表示部を
    表示駆動するための表示コントローラであって、 所与の表示タイミングを生成するタイミング生成回路
    と、 少なくとも１フレーム分の表示データを記憶するメモリ
    と、 前記表示部を表示駆動するために、前記表示タイミング
    に基づいて前記メモリに記憶された１走査ライン分の表
    示データの読み出しを制御する第１の制御回路と、 前記読み出しに先行して、前記表示タイミングとは非同
    期で入力される１走査ライン分の表示データを、前記メ
    モリに記憶された前記表示データの読み出し速度以上の
    速度で前記メモリに書き込む第２の制御回路と、 を含むことを特徴とする表示コントローラ。
  10. 【請求項１０】 請求項９において、 前記第２の制御回路は、少なくとも１走査ライン以上前
    記読み出しに先行することを特徴とする表示コントロー
    ラ。
  11. 【請求項１１】 請求項９又は１０において、 制御対象の走査ラインに対して前記表示データの書き込
    みが行われた後、当該走査ラインの表示データが読み出
    されることを特徴とする表示コントローラ。
  12. 【請求項１２】 請求項９乃至１１のいずれかにおい
    て、 所与のフレーム同期タイミングを基準に1フレーム分の
    表示データの書き込みが終了後、次のフレーム同期タイ
    ミングまで前記表示データの書き込みを停止することを
    特徴とする表示コントローラ。
  13. 【請求項１３】 ３フレーム以上連続した同一画像を含
    む画像を表示するための表示データに基づいて、表示部
    を表示駆動するための表示コントローラであって、 所与の表示タイミングを生成するタイミング生成回路
    と、 少なくとも１フレーム分の表示データを記憶するメモリ
    と、 前記表示タイミングとは非同期で入力される表示データ
    を前記メモリに書き込む第２の制御回路と、 前記表示部を表示駆動するために、前記書き込みに先行
    して、前記メモリへの１走査ライン分の表示データの書
    き込み速度以上の速度で、前記メモリに記憶された１走
    査ライン分の表示データの読み出しを制御する第１の制
    御回路と、 を含むことを特徴とする表示コントローラ。
  14. 【請求項１４】 請求項１３において、 前記第１の制御回路は、少なくとも１走査ライン以上前
    記書き込みに先行することを特徴とする表示コントロー
    ラ。
  15. 【請求項１５】 請求項１３又は１４において、 制御対象の走査ラインに対して前記表示データの読み出
    しが行われた後、当該走査ラインの表示データが書き込
    まれることを特徴とする表示コントローラ。
  16. 【請求項１６】 請求項９乃至１５のいずれかにおい
    て、 前記表示タイミングを出力する手段を含むことを特徴と
    する表示コントローラ。
  17. 【請求項１７】 複数の第１の電極と複数の第２の電極
    により駆動される電気光学素子を有するパネルと、 前記複数の第１の電極を駆動するための請求項９乃至１
    ７のいずれかに記載表示コントローラと、 前記複数の第２の電極を走査駆動する走査駆動ドライバ
    と、 を含むことを特徴とする表示ユニット。
  18. 【請求項１８】 請求項１７に記載の表示ユニットと、 前記表示ユニットに対し、前記表示データを供給する回
    路と、 を含むことを特徴とする電子機器。
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