JP2000022451A - 信号処理回路装置 - Google Patents
信号処理回路装置Info
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- H03F3/50—Amplifiers in which input is applied to, or output is derived from, an impedance common to input and output circuits of the amplifying element, e.g. cathode follower
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- H03F1/02—Modifications of amplifiers to raise the efficiency, e.g. gliding Class A stages, use of an auxiliary oscillation
- H03F1/0205—Modifications of amplifiers to raise the efficiency, e.g. gliding Class A stages, use of an auxiliary oscillation in transistor amplifiers
- H03F1/0211—Modifications of amplifiers to raise the efficiency, e.g. gliding Class A stages, use of an auxiliary oscillation in transistor amplifiers with control of the supply voltage or current
- H03F1/0216—Continuous control
- H03F1/0222—Continuous control by using a signal derived from the input signal
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- H03F2200/00—Indexing scheme relating to amplifiers
- H03F2200/504—Indexing scheme relating to amplifiers the supply voltage or current being continuously controlled by a controlling signal, e.g. the controlling signal of a transistor implemented as variable resistor in a supply path for, an IC-block showed amplifier
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- Power Engineering (AREA)
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Abstract
(57)【要約】
【課題】 電源電圧を大きくすることなくＳ／Ｎ特性の
向上を実現した信号処理回路装置を提供する。 【解決手段】 信号入力端子ＩＮに入力される信号を増
幅して出力するための演算増幅器ＯＰ１による増幅と同
極性で信号入力端子ＩＮに入力される信号を増幅するた
めの演算増幅器ＯＰ２、演算増幅器ＯＰ２の出力側と演
算増幅器ＯＰ１の電源ラインＬ+との間に接続されたコ
ンデンサＣB、及び、電源端子Ｔと演算増幅器ＯＰ１の
電源ラインＬ+との間に接続されたダイオードＤからな
る動作電圧制御回路を設けることによって、演算増幅器
ＯＰ１の電源ラインＬ+に供給される電圧を電源端子Ｔ
に外部から供給される電源電圧ＶCC以上に、信号入力端
子ＩＮに入力される信号に応じて上昇させる。
向上を実現した信号処理回路装置を提供する。 【解決手段】 信号入力端子ＩＮに入力される信号を増
幅して出力するための演算増幅器ＯＰ１による増幅と同
極性で信号入力端子ＩＮに入力される信号を増幅するた
めの演算増幅器ＯＰ２、演算増幅器ＯＰ２の出力側と演
算増幅器ＯＰ１の電源ラインＬ+との間に接続されたコ
ンデンサＣB、及び、電源端子Ｔと演算増幅器ＯＰ１の
電源ラインＬ+との間に接続されたダイオードＤからな
る動作電圧制御回路を設けることによって、演算増幅器
ＯＰ１の電源ラインＬ+に供給される電圧を電源端子Ｔ
に外部から供給される電源電圧ＶCC以上に、信号入力端
子ＩＮに入力される信号に応じて上昇させる。
Description
【０００１】
【発明の属する技術分野】本発明は、入力した信号に所
定の処理を施して出力する信号処理回路を有する信号処
理回路装置に関するものである。
定の処理を施して出力する信号処理回路を有する信号処
理回路装置に関するものである。
【０００２】
【従来の技術】演算増幅器を例に挙げて従来技術を説明
する。演算増幅器では、図４の（イ）に示すように、最
終段の電力増幅回路を構成する上側のＮＰＮ型のトラン
ジスタＱ１のベースは、前段のエミッタ接地増幅回路の
能動負荷を構成するＰＮＰ型のトランジスタＱ２を介し
て電源ラインＬに接続されている。そして、電源ライン
Ｌには外部から電源電圧ＶCCが供給されている。
する。演算増幅器では、図４の（イ）に示すように、最
終段の電力増幅回路を構成する上側のＮＰＮ型のトラン
ジスタＱ１のベースは、前段のエミッタ接地増幅回路の
能動負荷を構成するＰＮＰ型のトランジスタＱ２を介し
て電源ラインＬに接続されている。そして、電源ライン
Ｌには外部から電源電圧ＶCCが供給されている。
【０００３】このため、図５の（イ）に示すように、出
力端子Ｏに現れ得る電圧の上限は電源電圧ＶCC−上側ト
ランジスタＱ１のベース・エミッタ間電圧ＶBE−トラン
ジスタＱ２のコレクタ・エミッタ間飽和電圧ＶCE(SAT)
となる、すなわち、上側の残り電圧は、上側トランジス
タＱ１のベース・エミッタ間電圧ＶBE−トランジスタＱ
２のコレクタ・エミッタ間飽和電圧ＶCE(SAT)となる。
力端子Ｏに現れ得る電圧の上限は電源電圧ＶCC−上側ト
ランジスタＱ１のベース・エミッタ間電圧ＶBE−トラン
ジスタＱ２のコレクタ・エミッタ間飽和電圧ＶCE(SAT)
となる、すなわち、上側の残り電圧は、上側トランジス
タＱ１のベース・エミッタ間電圧ＶBE−トランジスタＱ
２のコレクタ・エミッタ間飽和電圧ＶCE(SAT)となる。
【０００４】また、上側の残り電圧を小さくするため
に、図４の（ロ）に示すように、上側トランジスタＱ１
を駆動する駆動部Ｋと出力端子Ｏとの間にコンデンサＣ
を設けてブートストラップをかけることによって、出力
電圧の上昇に伴って上側トランジスタＱ１のベース電位
が押し上げられるので、図５の（ロ）に示すように、上
側の残り電圧を上側トランジスタＱ１のコレクタ・エミ
ッタ間飽和電圧ＶCE(SAT)だけにすることができる。
に、図４の（ロ）に示すように、上側トランジスタＱ１
を駆動する駆動部Ｋと出力端子Ｏとの間にコンデンサＣ
を設けてブートストラップをかけることによって、出力
電圧の上昇に伴って上側トランジスタＱ１のベース電位
が押し上げられるので、図５の（ロ）に示すように、上
側の残り電圧を上側トランジスタＱ１のコレクタ・エミ
ッタ間飽和電圧ＶCE(SAT)だけにすることができる。
【０００５】
【発明が解決しようとする課題】ここで、ソース（信号
源）のデジタル化が進み、より高品位なＳ／Ｎ特性が求
められている。これを実現するためには、ノイズの大き
さは回路の特性によって決まってしまうことから、でき
るだけ信号の出力ダイナミックレンジを大きくする必要
がある。
源）のデジタル化が進み、より高品位なＳ／Ｎ特性が求
められている。これを実現するためには、ノイズの大き
さは回路の特性によって決まってしまうことから、でき
るだけ信号の出力ダイナミックレンジを大きくする必要
がある。
【０００６】ところが、従来の信号処理回路装置では、
上述したように、上側の残り電圧の程度の差こそある
が、いずれにしても出力電圧の上限を電源電圧以上とす
ることはできないので、電源電圧を大きくしない限りＳ
／Ｎ特性を改善することができない。
上述したように、上側の残り電圧の程度の差こそある
が、いずれにしても出力電圧の上限を電源電圧以上とす
ることはできないので、電源電圧を大きくしない限りＳ
／Ｎ特性を改善することができない。
【０００７】そこで、本発明は、電源電圧を大きくする
ことなくＳ／Ｎ特性の向上を実現した信号処理回路装置
を提供することを目的とする。
ことなくＳ／Ｎ特性の向上を実現した信号処理回路装置
を提供することを目的とする。
【０００８】
【課題を解決するための手段】上記の目的を達成するた
め、本発明では、入力信号に所定の処理を施して出力す
る信号処理回路を有する信号処理回路装置において、前
記信号処理回路の電源ラインに供給される電圧を前記入
力信号に応じて電源電圧以上に上昇させる動作電圧制御
回路を設けている。
め、本発明では、入力信号に所定の処理を施して出力す
る信号処理回路を有する信号処理回路装置において、前
記信号処理回路の電源ラインに供給される電圧を前記入
力信号に応じて電源電圧以上に上昇させる動作電圧制御
回路を設けている。
【０００９】以上の構成により、電源電圧を大きくする
ことなく信号処理回路の出力電圧の上限を高めることが
できるが、例えば、前記信号処理回路が入力信号を増幅
して出力する増幅回路である場合、前記動作電圧制御回
路は、電流流入側を電源電圧側、電流流出側を前記増幅
回路の電源ライン側にして電源電圧と前記増幅回路の電
源ラインとの間に接続される一方向導電素子と、前記増
幅回路と同極性で前記増幅回路が入力する信号を増幅し
て出力する動作電圧制御用増幅回路と、該動作電圧制御
用増幅回路の出力側と前記増幅回路の電源ラインとの間
に接続されるコンデンサとで構成することができる。
ことなく信号処理回路の出力電圧の上限を高めることが
できるが、例えば、前記信号処理回路が入力信号を増幅
して出力する増幅回路である場合、前記動作電圧制御回
路は、電流流入側を電源電圧側、電流流出側を前記増幅
回路の電源ライン側にして電源電圧と前記増幅回路の電
源ラインとの間に接続される一方向導電素子と、前記増
幅回路と同極性で前記増幅回路が入力する信号を増幅し
て出力する動作電圧制御用増幅回路と、該動作電圧制御
用増幅回路の出力側と前記増幅回路の電源ラインとの間
に接続されるコンデンサとで構成することができる。
【００１０】
【発明の実施の形態】以下に、本発明の実施形態を図面
を参照しながら説明する。図１は本発明の一実施形態で
ある信号処理回路装置のブロック図である。演算増幅器
ＯＰ１の非反転入力端子（＋）は演算増幅器ＯＰ３の出
力側に抵抗Ｒを介して接続されているとともに、信号入
力端子ＩＮに入力用の結合コンデンサＣINを介して接続
されている。
を参照しながら説明する。図１は本発明の一実施形態で
ある信号処理回路装置のブロック図である。演算増幅器
ＯＰ１の非反転入力端子（＋）は演算増幅器ＯＰ３の出
力側に抵抗Ｒを介して接続されているとともに、信号入
力端子ＩＮに入力用の結合コンデンサＣINを介して接続
されている。
【００１１】演算増幅器ＯＰ１の反転入力端子（−）は
抵抗Ｒ１及びコンデンサＣSを介してグランド端子Ｇに
接続されている。演算増幅器ＯＰ１の出力側は出力用の
結合コンデンサＣOUTを介して出力端子ＯＵＴに接続さ
れているとともに、演算増幅器ＯＰ１の反転入力端子
（−）に抵抗Ｒ２を介して接続されている。
抵抗Ｒ１及びコンデンサＣSを介してグランド端子Ｇに
接続されている。演算増幅器ＯＰ１の出力側は出力用の
結合コンデンサＣOUTを介して出力端子ＯＵＴに接続さ
れているとともに、演算増幅器ＯＰ１の反転入力端子
（−）に抵抗Ｒ２を介して接続されている。
【００１２】レベルシフタＬＳ１の入力側は、演算増幅
器ＯＰ１の非反転入力端子（＋）と同じく、演算増幅器
ＯＰ３の出力側に抵抗Ｒを介して接続されているととも
に、信号入力端子ＩＮに入力用の結合コンデンサＣINを
介して接続されている。そして、レベルシフタＬＳ１の
出力側に演算増幅器ＯＰ２の非反転入力端子（＋）が接
続されている。
器ＯＰ１の非反転入力端子（＋）と同じく、演算増幅器
ＯＰ３の出力側に抵抗Ｒを介して接続されているととも
に、信号入力端子ＩＮに入力用の結合コンデンサＣINを
介して接続されている。そして、レベルシフタＬＳ１の
出力側に演算増幅器ＯＰ２の非反転入力端子（＋）が接
続されている。
【００１３】レベルシフタＬＳ２の入力側は演算増幅器
ＯＰ４の出力側に接続されている。そして、レベルシフ
タＬＳ２の出力側に演算増幅器ＯＰ２の反転入力端子
（−）が抵抗Ｒ３を介して接続されている。演算増幅器
ＯＰ２の出力側は演算増幅器ＯＰ２の反転入力端子
（−）に抵抗Ｒ４を介して接続されている。
ＯＰ４の出力側に接続されている。そして、レベルシフ
タＬＳ２の出力側に演算増幅器ＯＰ２の反転入力端子
（−）が抵抗Ｒ３を介して接続されている。演算増幅器
ＯＰ２の出力側は演算増幅器ＯＰ２の反転入力端子
（−）に抵抗Ｒ４を介して接続されている。
【００１４】尚、レベルシフタＬＳ１、ＬＳ２は、図２
に示すように、コレクタが電源電圧ＶCCに接続されたト
ランジスタＴ１と、コレクタがトランジスタＴ１のエミ
ッタに接続されたダイオード接続のトランジスタＴ２
と、電流流出側が接地された定電流回路ＣＣと、ベース
がトランジスタＴ２のエミッタに接続され、コレクタが
電源電圧ＶCCに接続され、エミッタが定電流回路ＣＣの
電流流入側に接続されたトランジスタＴ３と、トランジ
スタＴ３のベース−エミッタ間に接続された抵抗Ｒ７と
で構成されており、トランジスタＴ１、Ｔ２、Ｔ３のベ
ース−エミッタ間電圧をＶBEとすると、トランジスタＴ
１のベースに入力される電圧は３ＶBEだけ低くなってト
ランジスタＴ３のエミッタから出力される。
に示すように、コレクタが電源電圧ＶCCに接続されたト
ランジスタＴ１と、コレクタがトランジスタＴ１のエミ
ッタに接続されたダイオード接続のトランジスタＴ２
と、電流流出側が接地された定電流回路ＣＣと、ベース
がトランジスタＴ２のエミッタに接続され、コレクタが
電源電圧ＶCCに接続され、エミッタが定電流回路ＣＣの
電流流入側に接続されたトランジスタＴ３と、トランジ
スタＴ３のベース−エミッタ間に接続された抵抗Ｒ７と
で構成されており、トランジスタＴ１、Ｔ２、Ｔ３のベ
ース−エミッタ間電圧をＶBEとすると、トランジスタＴ
１のベースに入力される電圧は３ＶBEだけ低くなってト
ランジスタＴ３のエミッタから出力される。
【００１５】演算増幅器ＯＰ３の出力側は演算増幅器Ｏ
Ｐ３の反転入力端子（−）に接続されている。演算増幅
器ＯＰ４の出力側は演算増幅器ＯＰ４の反転入力端子
（−）に接続されている。
Ｐ３の反転入力端子（−）に接続されている。演算増幅
器ＯＰ４の出力側は演算増幅器ＯＰ４の反転入力端子
（−）に接続されている。
【００１６】抵抗Ｒ５及び抵抗Ｒ６は電源端子Ｔとグラ
ンド端子Ｇとの間に直列に接続されており、そして、抵
抗Ｒ５と抵抗Ｒ６との接続点に、演算増幅器ＯＰ３の非
反転入力端子（＋）、及び、演算増幅器ＯＰ４の非反転
入力端子（＋）が接続されている。抵抗Ｒ５と抵抗Ｒ６
との接続点にはノイズ除去のためのコンデンサＣNが接
続されている。
ンド端子Ｇとの間に直列に接続されており、そして、抵
抗Ｒ５と抵抗Ｒ６との接続点に、演算増幅器ＯＰ３の非
反転入力端子（＋）、及び、演算増幅器ＯＰ４の非反転
入力端子（＋）が接続されている。抵抗Ｒ５と抵抗Ｒ６
との接続点にはノイズ除去のためのコンデンサＣNが接
続されている。
【００１７】そして、演算増幅器ＯＰ１の＋側の電源ラ
インＬ+はダイオードＤを介して電源端子Ｔに接続され
ているとともに、コンデンサＣBを介して演算増幅器Ｏ
Ｐ２の出力側に接続されており、一方、−側の電源ライ
ンＬ-はグランド端子Ｇに接続されている。尚、図示し
てはいないが、演算増幅器ＯＰ１を除く各演算増幅器Ｏ
Ｐ２、ＯＰ３、ＯＰ４の各電源ラインは、＋側が電源端
子Ｔに、−側がグランド端子Ｇに、それぞれ接続されて
いる。
インＬ+はダイオードＤを介して電源端子Ｔに接続され
ているとともに、コンデンサＣBを介して演算増幅器Ｏ
Ｐ２の出力側に接続されており、一方、−側の電源ライ
ンＬ-はグランド端子Ｇに接続されている。尚、図示し
てはいないが、演算増幅器ＯＰ１を除く各演算増幅器Ｏ
Ｐ２、ＯＰ３、ＯＰ４の各電源ラインは、＋側が電源端
子Ｔに、−側がグランド端子Ｇに、それぞれ接続されて
いる。
【００１８】また、電源端子Ｔには外部から電源電圧Ｖ
CCが供給され、また、グランド端子Ｇは接地される。ま
た、本発明を半導体集積回路で実現するならば、入力用
の結合コンデンサＣIN、出力用の結合コンデンサ
ＣOUT、コンデンサＣS、コンデンサＣN、コンデンサＣB
の各コンデンサは外付けとなる。また、演算増幅器ＯＰ
１による信号の増幅度を決定する抵抗Ｒ１及び抵抗Ｒ２
についても外付けとなる。
CCが供給され、また、グランド端子Ｇは接地される。ま
た、本発明を半導体集積回路で実現するならば、入力用
の結合コンデンサＣIN、出力用の結合コンデンサ
ＣOUT、コンデンサＣS、コンデンサＣN、コンデンサＣB
の各コンデンサは外付けとなる。また、演算増幅器ＯＰ
１による信号の増幅度を決定する抵抗Ｒ１及び抵抗Ｒ２
についても外付けとなる。
【００１９】以上の構成により、各抵抗ＲＫ（Ｋ＝１〜
６）の抵抗値をＲKで表すと、信号入力端子ＩＮに信号
が入力されない無信号時には、演算増幅器ＯＰ２の出力
側の電位はＶCC・Ｒ6／（Ｒ5＋Ｒ6）−３ＶBEとなり、
ダイオードＤの順方向降下電圧をＶFとすると、ＶCC−
ＶF＞ＶCC・Ｒ6／（Ｒ5＋Ｒ6）−３ＶBEとなるように各
パラメータの値が設定されており、ダイオードＤ側から
電流が流れ込んでコンデンサＣBは充電される。例え
ば、ＶCC＝９Ｖ、Ｒ5＝６．８ｋΩ、Ｒ6＝２４ｋΩと設
定し、また、ＶBE＝０．６Ｖ、ＶF＝０．６Ｖとする
と、ＶCC−ＶF＝８．４Ｖ、ＶCC・Ｒ6／（Ｒ5＋Ｒ6）−
３ＶBE≒５．２Ｖとなる。
６）の抵抗値をＲKで表すと、信号入力端子ＩＮに信号
が入力されない無信号時には、演算増幅器ＯＰ２の出力
側の電位はＶCC・Ｒ6／（Ｒ5＋Ｒ6）−３ＶBEとなり、
ダイオードＤの順方向降下電圧をＶFとすると、ＶCC−
ＶF＞ＶCC・Ｒ6／（Ｒ5＋Ｒ6）−３ＶBEとなるように各
パラメータの値が設定されており、ダイオードＤ側から
電流が流れ込んでコンデンサＣBは充電される。例え
ば、ＶCC＝９Ｖ、Ｒ5＝６．８ｋΩ、Ｒ6＝２４ｋΩと設
定し、また、ＶBE＝０．６Ｖ、ＶF＝０．６Ｖとする
と、ＶCC−ＶF＝８．４Ｖ、ＶCC・Ｒ6／（Ｒ5＋Ｒ6）−
３ＶBE≒５．２Ｖとなる。
【００２０】尚、無信号時には、演算増幅器ＯＰ１は電
圧ＶCC−ＶFで動作しており、コンデンサＣSが充電さ
れ、出力端子ＯＵＴから出力される電圧はＶCC・Ｒ6／
（Ｒ5＋Ｒ6）となっている。例えば、ＶCC＝９Ｖ、Ｒ5
＝６．８ｋΩ、Ｒ6＝２４ｋΩと設定すれば、ＶCC・Ｒ6
／（Ｒ5＋Ｒ6）≒７Ｖとなる。
圧ＶCC−ＶFで動作しており、コンデンサＣSが充電さ
れ、出力端子ＯＵＴから出力される電圧はＶCC・Ｒ6／
（Ｒ5＋Ｒ6）となっている。例えば、ＶCC＝９Ｖ、Ｒ5
＝６．８ｋΩ、Ｒ6＝２４ｋΩと設定すれば、ＶCC・Ｒ6
／（Ｒ5＋Ｒ6）≒７Ｖとなる。
【００２１】そして、例えば、正弦波信号が信号入力端
子ＩＮに入力されたとすると、演算増幅器ＯＰ２の出力
側には、（Ｒ3＋Ｒ4）／Ｒ3倍に増幅された信号が現れ
るので、演算増幅器ＯＰ１の＋側の電源ラインＬ+の電
位は、図３に波形Ａで示すように、正の半波の区間で
は、コンデンサＣBの充電電圧により、ＶCC−ＶF以上に
押し上げられる。例えば、ＶCC＝９Ｖ、Ｒ3＝２２ｋ
Ω、Ｒ4＝３３ｋΩ、Ｒ5＝６．８ｋΩ、Ｒ6＝２４ｋΩ
と設定し、また、信号入力端子ＩＮへの入力信号の振幅
が１Ｖとすると、（Ｒ3＋Ｒ4）／Ｒ3＝２．５となり、
演算増幅器ＯＰ１の＋側の電源ラインＬ+の電位は最大
で８．４＋２．５＝１０．９Ｖとなる。一方、負の半波
の区間では、ダイオードＤにより、ＶCC−ＶFに固定さ
れる。
子ＩＮに入力されたとすると、演算増幅器ＯＰ２の出力
側には、（Ｒ3＋Ｒ4）／Ｒ3倍に増幅された信号が現れ
るので、演算増幅器ＯＰ１の＋側の電源ラインＬ+の電
位は、図３に波形Ａで示すように、正の半波の区間で
は、コンデンサＣBの充電電圧により、ＶCC−ＶF以上に
押し上げられる。例えば、ＶCC＝９Ｖ、Ｒ3＝２２ｋ
Ω、Ｒ4＝３３ｋΩ、Ｒ5＝６．８ｋΩ、Ｒ6＝２４ｋΩ
と設定し、また、信号入力端子ＩＮへの入力信号の振幅
が１Ｖとすると、（Ｒ3＋Ｒ4）／Ｒ3＝２．５となり、
演算増幅器ＯＰ１の＋側の電源ラインＬ+の電位は最大
で８．４＋２．５＝１０．９Ｖとなる。一方、負の半波
の区間では、ダイオードＤにより、ＶCC−ＶFに固定さ
れる。
【００２２】このようにして、演算増幅器ＯＰ１の＋側
の電源ラインＬ+に供給される電圧は、ＶCC−ＶF以上に
押し上げられ、（Ｒ3＋Ｒ4）／Ｒ3の値の設定により、
外部から供給される電源電圧ＶCC以上に押し上げられ、
電源電圧を大きくすることなく演算増幅器ＯＰ１の出力
電圧の上限を高めることができる。
の電源ラインＬ+に供給される電圧は、ＶCC−ＶF以上に
押し上げられ、（Ｒ3＋Ｒ4）／Ｒ3の値の設定により、
外部から供給される電源電圧ＶCC以上に押し上げられ、
電源電圧を大きくすることなく演算増幅器ＯＰ１の出力
電圧の上限を高めることができる。
【００２３】したがって、演算増幅器ＯＰ１の出力側に
は入力された信号が（Ｒ1＋Ｒ2）／Ｒ1倍に増幅されて
現れるが、演算増幅器ＯＰ１の出力側に現れる信号と演
算増幅器ＯＰ２の出力側に現れる信号とは位相が同じで
あるので、演算増幅器ＯＰ１の入力のＤＣレベル（すな
わち、ＶCC・Ｒ6／（Ｒ5＋Ｒ6））、及び、（Ｒ1＋
Ｒ2）／Ｒ1の値と（Ｒ3＋Ｒ4）／Ｒ3の値との関係によ
り、図３に波形Ｂで示すように、歪を生じることなく信
号の出力ダイナミックレンジを大きくすることができ、
電源電圧を大きくすることなくＳ／Ｎ特性を向上させる
ことができる。
は入力された信号が（Ｒ1＋Ｒ2）／Ｒ1倍に増幅されて
現れるが、演算増幅器ＯＰ１の出力側に現れる信号と演
算増幅器ＯＰ２の出力側に現れる信号とは位相が同じで
あるので、演算増幅器ＯＰ１の入力のＤＣレベル（すな
わち、ＶCC・Ｒ6／（Ｒ5＋Ｒ6））、及び、（Ｒ1＋
Ｒ2）／Ｒ1の値と（Ｒ3＋Ｒ4）／Ｒ3の値との関係によ
り、図３に波形Ｂで示すように、歪を生じることなく信
号の出力ダイナミックレンジを大きくすることができ、
電源電圧を大きくすることなくＳ／Ｎ特性を向上させる
ことができる。
【００２４】例えば、ＶCC＝９Ｖ、Ｒ1＝２２ｋΩ、Ｒ2
＝３３ｋΩ、Ｒ3＝２２ｋΩ、Ｒ4＝３３ｋΩ、Ｒ5＝
６．８ｋΩ、Ｒ6＝２４ｋΩに設定すると、ＶCC・Ｒ6／
（Ｒ5＋Ｒ6）≒７Ｖ、（Ｒ1＋Ｒ2）／Ｒ1＝２．５とな
り、信号入力端子ＩＮへの入力信号の振幅を１Ｖとする
と、演算増幅器ＯＰ１の出力側の電位は最大でほぼ９．
５Ｖとなる。各パラメータが上記設定になっている場合
は、上述したように、演算増幅器ＯＰ１の＋側の電源ラ
インＬ+の電位は、最大で１０．９Ｖであり、演算増幅
器ＯＰ１の出力側の電位より高くなっている。
＝３３ｋΩ、Ｒ3＝２２ｋΩ、Ｒ4＝３３ｋΩ、Ｒ5＝
６．８ｋΩ、Ｒ6＝２４ｋΩに設定すると、ＶCC・Ｒ6／
（Ｒ5＋Ｒ6）≒７Ｖ、（Ｒ1＋Ｒ2）／Ｒ1＝２．５とな
り、信号入力端子ＩＮへの入力信号の振幅を１Ｖとする
と、演算増幅器ＯＰ１の出力側の電位は最大でほぼ９．
５Ｖとなる。各パラメータが上記設定になっている場合
は、上述したように、演算増幅器ＯＰ１の＋側の電源ラ
インＬ+の電位は、最大で１０．９Ｖであり、演算増幅
器ＯＰ１の出力側の電位より高くなっている。
【００２５】
【発明の効果】以上説明したように、本発明の信号処理
回路装置によれば、電源電圧を大きくすることなく、信
号の出力ダイナミックレンジを大きくすることができ、
Ｓ／Ｎ特性を向上させることができる。したがって、本
発明は、例えば、カーオーディオ、ラジカセ、ポータブ
ル機器など、限られた電源電圧環境下でＳ／Ｎ特性の改
善が要求される機器に搭載して非常に有効なものであ
る。
回路装置によれば、電源電圧を大きくすることなく、信
号の出力ダイナミックレンジを大きくすることができ、
Ｓ／Ｎ特性を向上させることができる。したがって、本
発明は、例えば、カーオーディオ、ラジカセ、ポータブ
ル機器など、限られた電源電圧環境下でＳ／Ｎ特性の改
善が要求される機器に搭載して非常に有効なものであ
る。
【図１】 本発明の一実施形態である信号処理回路装置
にブロック図である。
にブロック図である。
【図２】 レベルシフタの構成を示す図である。
【図３】 各部の電圧波形を示す図である。
【図４】 従来の信号処理回路の出力段の構成例を示す
図である。
図である。
【図５】 従来の信号処理回路の信号の出力ダイナミッ
クレンジを示す図である。
クレンジを示す図である。
ＯＰ１、ＯＰ２、ＯＰ３、ＯＰ４ 演算増幅器 Ｒ１、Ｒ２、Ｒ３、Ｒ４、Ｒ５、Ｒ６、Ｒ 抵抗 ＬＳ１、ＬＳ２ レベルシフタ ＣIN、ＣOUT、ＣS、ＣN、ＣB コンデンサ Ｄ ダイオード ＩＮ 信号入力端子 ＯＵＴ 出力端子 Ｔ 電源端子 Ｇ グランド端子
Claims (2)
- 【請求項１】 入力信号に所定の処理を施して出力する
信号処理回路を有する信号処理回路装置において、前記
信号処理回路の電源ラインに供給される電圧を前記入力
信号に応じて電源電圧以上に上昇させる動作電圧制御回
路を設けたことを特徴とする信号処理回路装置。 - 【請求項２】 前記信号処理回路が入力信号を増幅して
出力する増幅回路であるとともに、前記動作電圧制御回
路が、電流流入側を電源電圧側、電流流出側を前記増幅
回路の電源ライン側にして電源電圧と前記増幅回路の電
源ラインとの間に接続される一方向導電素子と、前記増
幅回路と同極性で前記増幅回路が入力する信号を増幅し
て出力する動作電圧制御用増幅回路と、該動作電圧制御
用増幅回路の出力側と前記増幅回路の電源ラインとの間
に接続されるコンデンサとからなることを特徴とする請
求項１に記載の信号処理回路装置。
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| JP18748598A JP3719853B2 (ja) | 1998-07-02 | 1998-07-02 | 信号処理回路装置 |
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| JP3719853B2 JP3719853B2 (ja) | 2005-11-24 |
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