EP0360887B1 - CMOS-Spannungsreferenz - Google Patents

CMOS-Spannungsreferenz Download PDF

Info

Publication number
EP0360887B1
EP0360887B1 EP88115839A EP88115839A EP0360887B1 EP 0360887 B1 EP0360887 B1 EP 0360887B1 EP 88115839 A EP88115839 A EP 88115839A EP 88115839 A EP88115839 A EP 88115839A EP 0360887 B1 EP0360887 B1 EP 0360887B1
Authority
EP
European Patent Office
Prior art keywords
circuit
output
voltage
bipolar
transistor
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
EP88115839A
Other languages
English (en)
French (fr)
Other versions
EP0360887A1 (de
Inventor
Heinz Zitta
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Siemens AG
Original Assignee
Siemens AG
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Siemens AG filed Critical Siemens AG
Priority to AT88115839T priority Critical patent/ATE93634T1/de
Priority to EP88115839A priority patent/EP0360887B1/de
Priority to DE88115839T priority patent/DE3883536D1/de
Priority to JP1243254A priority patent/JP2759905B2/ja
Priority to US07/412,894 priority patent/US4931718A/en
Publication of EP0360887A1 publication Critical patent/EP0360887A1/de
Application granted granted Critical
Publication of EP0360887B1 publication Critical patent/EP0360887B1/de
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Images

Classifications

    • GPHYSICS
    • G05CONTROLLING; REGULATING
    • G05FSYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
    • G05F3/00Non-retroactive systems for regulating electric variables by using an uncontrolled element, or an uncontrolled combination of elements, such element or such combination having self-regulating properties
    • G05F3/02Regulating voltage or current
    • G05F3/08Regulating voltage or current wherein the variable is dc
    • G05F3/10Regulating voltage or current wherein the variable is dc using uncontrolled devices with non-linear characteristics
    • G05F3/16Regulating voltage or current wherein the variable is dc using uncontrolled devices with non-linear characteristics being semiconductor devices
    • G05F3/20Regulating voltage or current wherein the variable is dc using uncontrolled devices with non-linear characteristics being semiconductor devices using diode- transistor combinations
    • G05F3/30Regulators using the difference between the base-emitter voltages of two bipolar transistors operating at different current densities

Definitions

  • the invention relates to a circuit arrangement in complementary MOS technology according to the preamble of claim 1.
  • Bandgap or bandgap circuits are known and are described, for example, in the book "Semiconductor Circuit Technology” by U. Tietze and Ch. Schenk, 7th edition, Springer-Verlag, Berlin, Heidelberg, New York 1985, pages 534 ff.
  • bandgap circuits can be used to generate reference voltages which, independently of the temperature coefficients of the components used in them, provide a temperature-independent reference voltage.
  • the principle of such circuits is to compensate for the negative temperature coefficient of the base-emitter diode voltage of a bipolar transistor by adding a voltage with a correspondingly positive temperature coefficient by using a second transistor with a different base-emitter voltage and an emitter resistor.
  • CMOS complementary metal-oxide-semiconductor
  • the different base-emitter voltages of the bipolar transistors are generated, for example, by different area ratios of the emitter zones.
  • the circuit relates to a p-well CMOS technology, as can be implemented, for example, on an n ⁇ -conductive substrate or a correspondingly conductive epitaxial layer.
  • N-channel field effect transistors are produced by introducing p+ zones for the source and drain into the substrate.
  • Bipolar transistors can be produced in this technique by introducing a p-type well on the n-type substrate and in turn a n-type connection zone. This creates a substrate-npn transistor, in which the n+-zone is the emitter, the p ⁇ -well is the base and the substrate is the collector. The collector or the substrate must be connected to the positive operating voltage in order to reliably block parasitic diodes between the p-wells and the substrate.
  • the CMOS bandgap circuit known from the aforementioned prior publication has the base connections of the two npn transistors as a reference point for the bandgap voltage. Usually this point is applied to the reference potential, i. H. to ground.
  • the output connection of the bandgap voltage is at the connection point of the drain connection of a MOS transistor with a resistor, both of which are arranged in the emitter circuit of a bipolar transistor.
  • the known CMOS bandgap circuit requires a positive and a negative supply voltage with respect to the reference potential.
  • bandgap circuits which manage with only an unipolar supply voltage, but which have to do without bipolar transistors.
  • these circuits do not achieve the temperature stability of bipolar bandgap circuits.
  • the invention has for its object to provide a CMOS voltage reference circuit that manages with an only unipolar supply voltage and achieves the temperature stability of bipolar bandgap circuits.
  • the circuit arrangement according to the invention has the advantage that it can be operated with a low and unipolar voltage with respect to the reference potential and that it can also be used to implement higher reference voltages than the bandgap voltage of the semiconductor material.
  • Embodiments of the invention are characterized in the subclaims.
  • the bandgap circuit contains two bipolar transistors T1 and T2 with different base-emitter voltages. Both collector connections are connected to the VDD terminal, which has a positive potential compared to the reference voltage.
  • a resistor R3 and in series the output circuit of a field effect transistor M1 is arranged in the emitter circuit of transistor T1, the source of which is connected to terminal VSS.
  • the VSS terminal is at reference potential, i. H. grounded.
  • the series circuit of two resistors R1 and R2 and the output circuit of another field effect transistor M2 is arranged in the output circuit of transistor T2.
  • the source connection of M2 is also at the VSS terminal.
  • connection points of the emitter of T1 with the resistor R3 on the one hand and the two resistors R1 and R2 on the other hand lead to the inputs of an operational amplifier OP1, the output of which controls the transistors M1 and M2.
  • the bandgap voltage UG must be tapped at the drain connection of the transistor M2, to which the connection VG1 corresponds, based on the base connections of the bipolar transistors T1 and T2, to which the connection VG2 corresponds.
  • the output of the bandgap circuit VG1 is now fed back to the reference point VG2.
  • the connection VG1 is connected to an input of a second operational amplifier OP2, the other input of which lies at the dividing point of an ohmic voltage divider consisting of the resistors R4 and R5.
  • the ohmic voltage divider is between the connection VG2 and the terminal VSS, i. H. Ground, switched.
  • the output of the operational amplifier OP2 is on the connection VG2, i. H. fed back to the base connections of the bipolar transistors T1 and T2.
  • the output of the second operational amplifier OP2 is connected to the terminal VR, at which the temperature-independent reference voltage UR can be tapped with respect to the reference potential at the terminal VSS.
  • the relationship between the temperature-independent reference voltage UR and the bandgap voltage UG is established by the ohmic voltage divider from the resistors R4 and R5.
  • the temperature-independent reference voltage UR is thus calculated from the product of the bandgap voltage UG on the one hand and the sum of the two resistors R4 and R5 in relation to the resistor R4 on the other hand.
  • An embodiment of the invention according to the figure contains a startup circuit IA, which is connected between the output terminal VR of the second operational amplifier OP2 and the terminal VDD with the relatively positive supply voltage potential.
  • This start-up circuit IA is drawn as a current source and can be implemented, for example, by a current source transistor or a resistor.
  • the starting circuit IA enables the reference voltage UR to be used as the operating voltage of the bandgap circuit, so that the actual reference voltage source can be operated from the two bipolar transistors T1 and T2 with the stabilized output reference voltage. This results in excellent suppression of input voltage fluctuations at the VDD terminal.
  • the start-up circuit IA is necessary since the operating voltage derived from the temperature-independent reference voltage UR must first be built up when a voltage is applied to the VDD terminal.
  • the circuit according to the embodiment of the figure makes it possible to dispense with a separate connection terminal VR, so that the CMOS voltage reference according to the invention has only the two connection terminals VDD and VSS to the outside.

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Physics & Mathematics (AREA)
  • Power Engineering (AREA)
  • Nonlinear Science (AREA)
  • Electromagnetism (AREA)
  • General Physics & Mathematics (AREA)
  • Radar, Positioning & Navigation (AREA)
  • Automation & Control Theory (AREA)
  • Control Of Electrical Variables (AREA)

Description

  • Die Erfindung betrifft eine Schaltungsanordnung in komplementärer MOS-Technik nach dem Oberbegriff des Patentanspruchs 1.
  • Eine derartige Schaltungsanordnung ist aus der EP-A-0 217 225 bekannt.
  • Bandgap- bzw. Bandabstands-Schaltungen sind bekannt und beispielsweise in dem Buch "Halbleiter-Schaltungstechnik" von U. Tietze und Ch. Schenk, 7. Auflage, Springer-Verlag, Berlin, Heidelberg, New York 1985, Seiten 534 ff. beschrieben.
  • In der vorgenannten Veröffentlichung ist ausgeführt, daß mit derartigen Bandgap-Schaltungen Referenzspannungen erzeugt werden können, die unabhängig von Temperaturkoeffizienten der in ihr verwendeten Bauelemente eine temperaturunabhängige Referenzspannung liefern. Das Prinzip derartiger Schaltungen besteht darin, den negativen Temperaturkoeffizienten der Basis-Emitter-Diodenspannung eines Bipolartransistors durch Addition einer Spannung mit entsprechend positivem Temperaturkoeffizienten zu kompensieren, indem ein zweiter Transistor mit anderer Basis-Emitter-Spannung und einem Emitterwiderstand benutzt wird.
  • Außer in der EP-A-0 217 225 ist in der Veröffentlichung IEEE ISSC Vol.SC-20, No. 6, Dec. 1985, pp. 1151-1157 eine weitere Bandgap-Schaltung in komplementärer CMOS-Technik mit ähnlichen Eigenschaften bekannt. Die unterschiedlichen Basis-Emitter-Spannungen der Bipolartransistoren werden beispielsweise durch unterschiedliche Flächenverhältnisse der Emitterzonen erzeugt. Die Schaltung bezieht sich auf eine p-Wannen-CMOS-Technik, wie sie beispielsweise auf einem n⁻-leitenden Substrat oder einer entsprechend leitfähigen epitaktischen Schicht realisiert werden kann. n-Kanal-Feldeffekttransistoren werden erzeugt, indem p⁺-Zonen für Source und Drain in das Substrat eingebracht werden. Zur Herstellung von p-Kanal-Feldeffekttransistoren ist ist eine p⁻-leitende Wanne erforderlich, in die für die Source- und Drainanschlüsse n⁺-leitende Zonen eingebracht werden. Bipolartransistoren lassen sich in dieser Technik erzeugen, indem auf dem n⁻-leitenden Substrat eine p⁻-leitende Wanne und in diese wiederum eine n⁺-leitende Anschlußzone eingebracht wird. Auf diese Weise entsteht ein Substrat-npn-Transistor, bei dem die n⁺-Zone den Emitter, die p⁻-Wanne die Basis und das Substrat den Kollektor darstellt. Der Kollektor bzw. das Substrat müssen an die positive Betriebsspannung angeschlossen werden, um parasitäre Dioden zwischen den p-Wannen und dem Substrat sicher zu sperren.
  • Die aus der genannten Vorveröffentlichung bekannte CMOS-Bandgap-Schaltung hat als Bezugspunkt für die Bandgap-Spannung die Basisanschlüsse der beiden npn-Transistoren. Üblicherweise legt man diesen Punkt an das Bezugspotential, d. h. an Masse. Der Ausgangsanschluß der Bandgap-Spannung liegt am Verbindungspunkt des Drainanschlusses eines MOS-Transistors mit einem Widerstand, die beide im Emitterkreis eines Bipolartransistors angeordnet sind. In jedem Fall ist für die bekannte CMOS-Bandgap-Schaltung eine bezüglich des Bezugspotentials positive und eine negative Versorgungsspannung erforderlich.
  • Andererseits sind Bandgap-Schaltungen bekannt, die mit einer nur unipolaren Versorgungsspannung auskommen, dafür jedoch auf bipolare Transistoren verzichten müssen. Diese Schaltungen erreichen jedoch nicht die Temperaturstabilität von bipolaren Bandgap-Schaltungen.
  • Der Erfindung liegt die Aufgabe zugrunde, eine CMOS-Spannungs-Referenzschaltung anzugeben, die mit einer nur unipolaren Versorgungsspannung auskommt und die Temperaturstabilität bipolarer Bandgap-Schaltungen erreicht.
  • Diese Aufgabe wird bei einer Schaltungsanordnung der eingangs genannten Art erfindungsgemäß durch die Merkmale des kennzeichnenden Teils des Patentanspruchs 1 gelöst.
  • Die erfindungsgemäße Schaltungsanordnung besitzt den Vorteil, daß sie sich mit einer niedrigen und dazu unipolaren Spannung bezüglich des Bezugspotentials betreiben läßt und daß sich mit ihr auch höhere Referenzspannungen als die Bandgap-Spannung des Halbleitermaterials realisieren läßt.
  • Ausgestaltungen der Erfindung sind in Unteransprüchen gekennzeichnet.
  • Die Erfindung wird im folgenden anhand eines in der Figur der Zeichnung dargestellten Ausführungsbeispiels näher erläutert.
  • Gemäß der Figur enthält die Bandgap-Schaltung zwei bipolare Transistoren T1 und T2 mit unterschiedlichen Basis-Emitter-Spannungen. Beide Kollektoranschlüsse sind an die Klemme VDD angeschlossen, die gegenüber der Bezugsspannung ein positives Potential führt. Im Emitterkreis des Transistors T1 ist ein Widerstand R3 und in Reihe dazu der Ausgangskreis eines Feldeffekttransistors M1 angeordnet, dessen Source an der Klemme VSS liegt. Die Klemme VSS ist an Bezugspotential, d. h. an Masse gelegt. Im Ausgangskreis des Transistors T2 ist die Reihenschaltung zweier Widerstände R1 und R2 sowie des Ausgangskreises eines anderen Feldeffekttransistors M2 angeordnet. Der Sourceanschluß von M2 liegt ebenfalls an der Klemme VSS. Die Verbindungspunkte des Emitters von T1 mit dem Widerstand R3 einerseits und der beiden Widerstände R1 und R2 andererseits führen auf die Eingänge eines Operationsverstärkers OP1, dessen Ausgang die Transistoren M1 und M2 steuert. Am Drainanschluß des Transistors M2, dem der Anschluß VG1 entspricht, ist bezogen auf die Basisanschlüsse der Bipolartransistoren T1 und T2, denen der Anschluß VG2 entspricht, die Bandgap-Spannung UG abzugreifen.
  • Erfindungsgemäß ist nun der Ausgang der Bandgap-Schaltung VG1 auf den Bezugspunkt VG2 rückgekoppelt. Dazu ist der Anschluß VG1 auf einen Eingang eines zweiten Operationsverstärkers OP2 geschaltet, dessen anderer Eingang am Teilerpunkt eines ohmschen Spannungsteilers aus den Widerständen R4 und R5 liegt.
  • Der ohmsche Spannungsteiler ist zwischen den Anschluß VG2 und die Klemme VSS, d. h. Masse, geschaltet. Der Ausgang des Operationsverstärkers OP2 ist auf den Anschluß VG2, d. h. auf die Basisanschlüsse der Bipolartransistoren T1 und T2 rückgeführt.
  • Gleichzeitig ist der Ausgang des zweiten Operationsverstärkers OP2 an die Klemme VR gelegt, an der bezüglich des an der Klemme VSS liegenden Bezugspotentials die temperaturunabhängige Referenzspannung UR abgegriffen werden kann. Die Beziehung zwischen der temperaturunabhängigen Referenzspannung UR und der Bandgap-Spannung UG wird durch den ohmschen Spannungsteiler aus den Widerständen R4 und R5 hergestellt. So berechnet sich die temperaturunabhängige Referenzspannung UR aus dem Produkt der Bandgap-Spannung UG einerseits und der Summe der beiden Widerstände R4 und R5 bezogen auf den Widerstand R4 andererseits.
  • Eine Ausgestaltung der Erfindung gemäß der Figur enthält eine Anlaufschaltung IA, die zwischen dem Ausgangsanschluß VR des zweiten Operationsverstärkers OP2 und der Klemme VDD mit dem relativ positiven Versorgungsspannungspotential angeschlossen ist. Diese Anlaufschaltung IA ist als Stromquelle gezeichnet und kann beispielsweise durch einen Stromquellentransistor oder einen Widerstand realisiert werden. Die Anlaufschaltung IA ermöglicht es, daß die Referenzspannung UR als Betriebsspannung der Bandgap-Schaltung verwendet wird, so daß sich die eigentliche Referenzspannungsquelle aus den beiden Bipolartransistoren T1 und T2 mit der stabilisierten Ausgangsreferenzspannung betreiben läßt. Auf diese Weise ergibt sich eine ausgezeichnete Unterdrückung von Eingangsspannungsschwankungen an der Klemme VDD. Die Anlaufschaltung IA ist erforderlich, da sich bei Anlegen einer Spannung an die Klemme VDD die aus der temperaturunabhängigen Referenzspannung UR abgeleitete Betriebsspannung erst aufbauen muß. Die Schaltung gemäß dem Ausführungsbeispiel der Figur ermöglicht es, auf eine separate Anschlußklemme VR zu verzichten, so daß die erfindungsgemäße CMOS-Spannungsreferenz nach außen nur die beiden Anschlußklemmen VDD und VSS besitzt.

Claims (5)

  1. Schaltungsanordnung in komplementärer MOS-Technik zur Erzeugung einer von der Temperatur unabhängigen Referenzspannung mit Hilfe einer mit einem CMOS-Prozeß realisierten Bandgap-Schaltung, bei der die Reihenschaltung aus der Kollektor-Emitter-Strecke eines ersten Bipolartransistors (T1) mit einer ersten Basis-Emitter-Spannung, einem ersten Widerstand (R3) und der Drain-Source-Strecke eines ersten Feldeffekttransistors (M1) zwischen den Klemmen (VDD, VSS) einer Versorgungsspannungsquelle liegt und entsprechend parallel dazu die Reihenschaltung aus der Kollektor-Emitter-Strecke eines zweiten Bipolartransistors (T2) mit einer zweiten Basis-Emitter-Spannung, zwei in Reihe geschalteten Widerständen (R1, R2) und der Drain-Source-Strecke eines zweiten Feldeffekttransistors (M2) vorgesehen ist, und bei der die Basisanschlüsse der Bipolartransistoren (T1, T2) miteinander verbunden sind und die Verbindungspunkte des ersten Bipolartransistors (T1) mit dem ersten Widerstand (R3) einerseits und der zwei in Reihe geschalteten Widerstände (R1, R2) andererseits an die Eingänge (-, +) eines ersten Operationsverstärkers (OP1) gelegt sind, dessen Ausgang die beiden Gateanschlüsse der Feldeffekttransistoren (M1, M2) steuert, dadurch gekennzeichnet, daß der Ausgang der Bandgap-Schaltung (VG1) am Drainanschluß des zweiten Feldeffekttransistors (M2) auf die Basisanschlüsse der Bipolartransistoren (T1, T2) rückgekoppelt ist.
  2. Anordnung nach Anspruch 1, dadurch gekennzeichnet, daß im Rückkoppelzweig ein zweiter Operationsverstärker (OP2) eingangsseitig (-, +) einerseits am Ausgang der Bandgap-Schaltung (VG1) und andererseits am Teilerpunkt eines zwischen den Basisanschlüssen der Bipolartransistoren (T1, T2) und der Klemme (VSS) mit relativ negativem Versorgungsspannungspotential liegenden ohmschen Spannungsteilers (R4, R5) angeschlossen ist und ausgangsseitig (VR) mit den Basisanschlüssen (VG2) der Bipolartransistoren (T1, T2) verbunden ist.
  3. Anordnung nach Anspruch 1 oder 2, dadurch gekennzeichnet, daß zwischen dem Ausgangsanschluß (VR) des zweiten Operationsverstärkers (OP2) und der Klemme (VDD) mit relativ positivem Versorgungspotential eine Anlaufschaltung (IA) angeschlossen ist.
  4. Anordnung nach Anspruch 3, dadurch gekennzeichnet, daß die Anlaufschaltung (IA) aus einer Stromquelle besteht.
  5. Anordnung nach Anspruch 3, dadurch gekennzeichnet, daß die Anlaufschaltung (IA) aus einem Widerstand besteht.
EP88115839A 1988-09-26 1988-09-26 CMOS-Spannungsreferenz Expired - Lifetime EP0360887B1 (de)

Priority Applications (5)

Application Number Priority Date Filing Date Title
AT88115839T ATE93634T1 (de) 1988-09-26 1988-09-26 Cmos-spannungsreferenz.
EP88115839A EP0360887B1 (de) 1988-09-26 1988-09-26 CMOS-Spannungsreferenz
DE88115839T DE3883536D1 (de) 1988-09-26 1988-09-26 CMOS-Spannungsreferenz.
JP1243254A JP2759905B2 (ja) 1988-09-26 1989-09-18 相補性mos技術による回路装置
US07/412,894 US4931718A (en) 1988-09-26 1989-09-26 CMOS voltage reference

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
EP88115839A EP0360887B1 (de) 1988-09-26 1988-09-26 CMOS-Spannungsreferenz

Publications (2)

Publication Number Publication Date
EP0360887A1 EP0360887A1 (de) 1990-04-04
EP0360887B1 true EP0360887B1 (de) 1993-08-25

Family

ID=8199372

Family Applications (1)

Application Number Title Priority Date Filing Date
EP88115839A Expired - Lifetime EP0360887B1 (de) 1988-09-26 1988-09-26 CMOS-Spannungsreferenz

Country Status (5)

Country Link
US (1) US4931718A (de)
EP (1) EP0360887B1 (de)
JP (1) JP2759905B2 (de)
AT (1) ATE93634T1 (de)
DE (1) DE3883536D1 (de)

Families Citing this family (16)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0782404B2 (ja) * 1989-07-11 1995-09-06 日本電気株式会社 基準電圧発生回路
US5027053A (en) * 1990-08-29 1991-06-25 Micron Technology, Inc. Low power VCC /2 generator
JPH06175742A (ja) * 1992-12-09 1994-06-24 Nec Corp 基準電圧発生回路
US5545978A (en) * 1994-06-27 1996-08-13 International Business Machines Corporation Bandgap reference generator having regulation and kick-start circuits
US5889394A (en) * 1997-06-02 1999-03-30 Motorola Inc. Temperature independent current reference
US5894215A (en) * 1997-10-30 1999-04-13 Xerox Corporation Shunt voltage regulator utilizing a floating reference voltage
US6150872A (en) * 1998-08-28 2000-11-21 Lucent Technologies Inc. CMOS bandgap voltage reference
US6411158B1 (en) * 1999-09-03 2002-06-25 Conexant Systems, Inc. Bandgap reference voltage with low noise sensitivity
FR2802316B1 (fr) * 1999-12-08 2003-10-24 Mhs Controle de source de courant basse consommation par double alimentation basse regulee en tension
US6724176B1 (en) * 2002-10-29 2004-04-20 National Semiconductor Corporation Low power, low noise band-gap circuit using second order curvature correction
US6844772B2 (en) * 2002-12-11 2005-01-18 Texas Instruments Incorporated Threshold voltage extraction circuit
US6815941B2 (en) * 2003-02-05 2004-11-09 United Memories, Inc. Bandgap reference circuit
KR100588339B1 (ko) * 2004-01-07 2006-06-09 삼성전자주식회사 오토 튜닝 기능을 갖는 전압-전류 변환회로를 구비한전류원 회로
US7728574B2 (en) * 2006-02-17 2010-06-01 Micron Technology, Inc. Reference circuit with start-up control, generator, device, system and method including same
ATE547840T1 (de) * 2006-07-26 2012-03-15 Austriamicrosystems Ag Verstärkeranordnung und verstärkungsverfahren
EP1884856B1 (de) * 2006-07-26 2016-04-06 ams AG Spannungs-Strom-Umsetzerschaltungsanordnung und Verfahren zur Bereitstellung eines Rampenstroms.

Family Cites Families (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4317054A (en) * 1980-02-07 1982-02-23 Mostek Corporation Bandgap voltage reference employing sub-surface current using a standard CMOS process
US4399399A (en) * 1981-12-21 1983-08-16 Motorola, Inc. Precision current source
US4602207A (en) * 1984-03-26 1986-07-22 At&T Bell Laboratories Temperature and power supply stable current source
US4590418A (en) * 1984-11-05 1986-05-20 General Motors Corporation Circuit for generating a temperature stabilized reference voltage
US4590419A (en) * 1984-11-05 1986-05-20 General Motors Corporation Circuit for generating a temperature-stabilized reference voltage
US4622512A (en) * 1985-02-11 1986-11-11 Analog Devices, Inc. Band-gap reference circuit for use with CMOS IC chips
US4588941A (en) * 1985-02-11 1986-05-13 At&T Bell Laboratories Cascode CMOS bandgap reference
US4626770A (en) * 1985-07-31 1986-12-02 Motorola, Inc. NPN band gap voltage reference
EP0217225B1 (de) * 1985-09-30 1991-08-28 Siemens Aktiengesellschaft Trimmbare Schaltungsanordnung zur Erzeugung einer temperaturunabhängigen Referenzspannung
GB8630980D0 (en) * 1986-12-29 1987-02-04 Motorola Inc Bandgap reference circuit
US4857823A (en) * 1988-09-22 1989-08-15 Ncr Corporation Bandgap voltage reference including a process and temperature insensitive start-up circuit and power-down capability

Also Published As

Publication number Publication date
ATE93634T1 (de) 1993-09-15
EP0360887A1 (de) 1990-04-04
US4931718A (en) 1990-06-05
JPH02121012A (ja) 1990-05-08
JP2759905B2 (ja) 1998-05-28
DE3883536D1 (de) 1993-09-30

Similar Documents

Publication Publication Date Title
EP0360887B1 (de) CMOS-Spannungsreferenz
DE2457753C2 (de) Spannungsregelschaltung
DE69024619T2 (de) Bandgapreferenzspannungsschaltung
DE68926201T2 (de) Operationsverstärkerschaltung
EP0508327A2 (de) CMOS-Bandabstands-Referenzschaltung
DE68910413T2 (de) Ausgangsschaltung.
DE68919764T2 (de) Völlig differentielle Referenzspannungsquelle.
EP0217225B1 (de) Trimmbare Schaltungsanordnung zur Erzeugung einer temperaturunabhängigen Referenzspannung
DE3933986A1 (de) Komplementaerer stromspiegel zur korrektur einer eingangsoffsetspannung eines "diamond-followers" bzw. einer eingangsstufe fuer einen breitbandverstaerker
EP0216265B1 (de) Schaltungsanordnung zur Erzeugung einer Referenzspannung mit vorgebbarer Temperaturdrift
DE2207233A1 (de) Elektronischer Signalverstärker
DE3877093T2 (de) Gesteuerter praezisionsstromgenerator.
DE68923334T2 (de) Stromschalterlogikschaltung mit gesteuerten Ausgangssignalpegeln.
DE68919932T2 (de) Kompensierungsstromkreis für Transistorbasisstrom.
DE3447002C2 (de)
EP0360888B1 (de) CMOS-Pulsweitenmodulator
DE2438255A1 (de) Stromverstaerker
DE3913446A1 (de) Stromspiegel
EP0162266B1 (de) Schaltungsanordnung zur Erzeugung einer temperatur- und versorgungsspannungsunabhängigen Referenzspannung
EP0237086B1 (de) Stromspiegelschaltung
EP0523266A1 (de) Integrierbarer Stromspiegel
DE10156048C1 (de) Referenzspannungsquelle
DE69506920T2 (de) Störungsunempfindliche Anordnung für Vorspannungsstromerzeugung
DE3716577C2 (de) Stromspiegelschaltung großer Leistungsfähigkeit
EP0033154A2 (de) Monolithisch integrierte Halbleiterschaltung mit Transistoren

Legal Events

Date Code Title Description
PUAI Public reference made under article 153(3) epc to a published international application that has entered the european phase

Free format text: ORIGINAL CODE: 0009012

AK Designated contracting states

Kind code of ref document: A1

Designated state(s): AT BE CH DE ES FR GB GR IT LI LU NL SE

RBV Designated contracting states (corrected)

Designated state(s): AT DE FR GB IT NL

17P Request for examination filed

Effective date: 19900425

17Q First examination report despatched

Effective date: 19920625

GRAA (expected) grant

Free format text: ORIGINAL CODE: 0009210

AK Designated contracting states

Kind code of ref document: B1

Designated state(s): AT DE FR GB IT NL

REF Corresponds to:

Ref document number: 93634

Country of ref document: AT

Date of ref document: 19930915

Kind code of ref document: T

REF Corresponds to:

Ref document number: 3883536

Country of ref document: DE

Date of ref document: 19930930

ET Fr: translation filed
ITF It: translation for a ep patent filed
GBT Gb: translation of ep patent filed (gb section 77(6)(a)/1977)

Effective date: 19931101

PLBE No opposition filed within time limit

Free format text: ORIGINAL CODE: 0009261

STAA Information on the status of an ep patent application or granted ep patent

Free format text: STATUS: NO OPPOSITION FILED WITHIN TIME LIMIT

26N No opposition filed
PGFP Annual fee paid to national office [announced via postgrant information from national office to epo]

Ref country code: AT

Payment date: 19980826

Year of fee payment: 11

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: AT

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 19990926

PGFP Annual fee paid to national office [announced via postgrant information from national office to epo]

Ref country code: NL

Payment date: 20010914

Year of fee payment: 14

REG Reference to a national code

Ref country code: GB

Ref legal event code: IF02

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: NL

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20030401

PGFP Annual fee paid to national office [announced via postgrant information from national office to epo]

Ref country code: GB

Payment date: 20030827

Year of fee payment: 16

PGFP Annual fee paid to national office [announced via postgrant information from national office to epo]

Ref country code: FR

Payment date: 20030904

Year of fee payment: 16

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: GB

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20040926

GBPC Gb: european patent ceased through non-payment of renewal fee

Effective date: 20040926

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: FR

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20050531

REG Reference to a national code

Ref country code: FR

Ref legal event code: ST

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: IT

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES;WARNING: LAPSES OF ITALIAN PATENTS WITH EFFECTIVE DATE BEFORE 2007 MAY HAVE OCCURRED AT ANY TIME BEFORE 2007. THE CORRECT EFFECTIVE DATE MAY BE DIFFERENT FROM THE ONE RECORDED.

Effective date: 20050926

PGFP Annual fee paid to national office [announced via postgrant information from national office to epo]

Ref country code: DE

Payment date: 20071113

Year of fee payment: 20