DE68923874T2 - Interframe-entschachtelungsumschaltkreis. - Google Patents
Interframe-entschachtelungsumschaltkreis.Info
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Description
- Die vorliegende Erfindung betrifft einen Interframe-Entschachtelungs-Umschaltkreis, welcher zum automatischen Umschalten einer Entschachtelungslänge bei einer Interframe-Entschachtelungsoperation fähig ist, die bei einem hochauflösenden Fernseh-Sendesystem (MUSE-System) durchgeführt wird.
- Ein Interframe-Entschachtelungs-Schaltkreis wird als eine der Einrichtungen zum Zerlegen eines Farbsynchronsignalfehlers beim PCM-Niederfrequenzsignal des hochauflösenden Fernsehsendens verwendet. Jedoch wird, da die Möglichkeit besteht, verschiedene Schachtelungslängen zwischen einem Übertragungssystem und einem Packsystem zu verwenden und daher eine Notwendigkeit für deren Umschaltung auftritt, nun ein Interframe-Entschachtelungs-Umschaltkreis in Betracht gezogen.
- Nachfolgend wird ein Beispiel des bisherigen herkömmlichen Interframe-Entschachtelungs-Umschaltkreises, bezugnehmend auf die Zeichnungen, beschrieben.
- Fig. 4 ist ein Blockdiagramm, welches eine herkömmlichen Interframe-Entschachtelungs-Umschaltkreis zeigt und Fig. 5 zeigt ein Beispiel eines Interframe-Entschachtelungs-Schaltkreises. In Fig. 4 bezeichnet 1 einen Interframe-Entschachtelungskreis. In Fig. 5 bezeichnen 6 bis 10 Schieberegister, 11 bezeichnet ein Wählglied, 12 bezeichnet ein Zählglied, 13 bezeichnet eine n-Dekoder-Schaltung, 14 bezeichnet eine m-Dekoder-Schaltung und 15 ein Wählglied.
- Nachfolgend wird die Funktionsweise des Interframe-Entschachtelungs-Umschaltkreises mit vorstehendem Aufbau beschrieben.
- Ein Eingangssignal wird durch eine Anzahl n von den Schieberegistern 6 bis 10 hindurchgeschickt, von denen jedes einem Einzel-Frame von 1350 Takten eines Niederfrequenzsignals entspricht. Diese Schieberegister dienen somit zur Zuführung der sich ergebenden Signale 1&sub0;, 1&sub1;, 1&sub2;, 1&sub3;, ....1n-2, 1n-1, 1n inklusive des Eingangssiganls 1&sub0;.
- Und ein Zählglied 1&sub2; beginnt mit dem Zählen an einem Anfangswert und schickt die Ausgangsgröße an eine n-Dekoderschaltung 13. Wenn die n-Dekoderschaltung 13 die Ausgangsgröße in n umwandelt, erscheint ein CLEAR(Nullstell)-Signal f&sub1;. Wenn die m-Dekoderschaltung 14 die Ausgabegröße in m(m< n) umwandelt, erscheint ein CLEAR-Signal f&sub2;. Dann schaltet das Wählglied als Reaktion auf ein Umschaltsignal von der externen Einheit die Frequenz f&sub1; auf f&sub2; um und schickt die Ausgangsgröße g an das Zählglied 12, um dieses "nullzusetzen".
- Wenn, auf das Umschaltsignal hin, f&sub1; zugeleitet wird, wiederholt die Zähleinrichtung 12 das Zählen von 0 bis n. Und das Wählglied 11 dient zur sequenziellen Auswahl des Eingangssiganls 1&sub0; und den Ausgangsgrößen 1&sub1;, 1&sub2;, ...... 1n-1, 1n der Schieberegister 6 bis 10, als Reaktion auf die Ausgangsgröße der Zähleinrichtung 12.
- Die vorhergehende Anordung weist jedoch den Nachteil auf, daß es erforderlich ist, von einer externen Einheit ein Umschaltsignal für ein Entschachtelungssignal aufzunehmen.
- EP-A-0 222 386 beschreibt ein PCM-Audiosignal-Aufzeichnungs- und Wiedergabegerät, welches ein ein Videosignal begleitendes Audiosignal abtastet, in ein PCM-Signal umwandelt, Fehlererfassungskorrekturdaten zu einer vorbestimmten Zahl von PCM-Daten hinzufügt, aus diesen Signalen einen Daten-Frame bildet, diesen in Übereinstimmung mit einem vorbestimmten Modulationssystem moduliert, und das Audiosignal zusammen mit dem Videosignal oder einzeln, unter Verwendung eines Scanners vom Rotationskopftyp, auf einem Aufzeichnungsmedium aufzeichnet. Ein Digitalsignalverarbeitungsschaltkreis mit einem Speicher von einer vorbestimmten Kapazität ist vorgesehen, und die Anzahl der in einem einzelnen Daten-Frame auszuzeichnenden digitalen Daten wird, gemäß einer Differenz zwischen der Anzahl von Eingangsdaten des digitalen Audiosignals an die Digitalsignal-Verarbeitungsschaltung und der Anzahl der dem Aufzeichnungsmedium zur Aufzeichnung zugeführten Ausgangsdaten, variiert. Im Aufzeichnungsmodus wird das PCM-Audiosignal in Blöcke aufgeteilt, ein Datenblockadress-Signal wird zu jedem Block hinzugefügt, um eine relative Reihenfolge zu anderen Blocks anzuzeigen. Ein Schachtelungs-Blockadressen-Signal wird zu jedem der Blöcke in einem Blocksatz hinzugefügt, welcher eine vorbestimmte Anzahl von Blocks zum Durchführen einer Signalverarbeitung, wie beispielsweise Schachteln und Entschachteln, aufweist, um eine relative Reihenfolge des Blocks zu anderen Blocks anzuzeigen, wobei der Block in einem mit der Abtastfrequenz synchronisierten Zeitraum fertiggestellt wird. Das Schachtelungs-Blockadressen-Signal und ein Identifizierungssignal werden zu abwechselnden Blocks hinzugefügt.
- Ein Ziel der Erfindung ist, einen Interframe-Entschachtelungs-Umschaltkreis zu liefern, der zum automatischen Umschalten einer Schachtelungslänge fähig ist, ohne ein Umschaltsignal von außen zu benötigen.
- Die Hauptmerkmale der Erfindung gegen aus Anspruch 1 hervor.
- Fig. 1 ist ein Blockdiagramm, welches einen Interframe-Entschachtelungs-Schaltkreis nach einer Ausführungsform der Erfindung zeigt;
- Fig. 2 ist ein Schaltdiagramm, welches eine konkrete Umschaltsignalerzeugungsschaltung zeigt;
- Fig. 3 ist eine Ansicht, welche einige Zeitabläufe der Schaltsignalerzeugungsschaltung zeigt;
- Fig. 4 ist ein Blockdiagramm, welches den herkömmlichen Interframe-Entschachtelungs-Umschaltkreis zeigt; und
- Fig. 5 ist ein Schaltdiagramm, welches einen konkreten Interframe-Entschachtelungs-Schaltkreis zeigt.
- Nachfolgend wird eine einzige Ausführungsform eines Interframe-Entschachtelungs-Umschaltkreises, bezugnehmend auf die Zeichnungen, beschrieben Fig. 1 ein Blockdiagramm, welches einen Interframe-Entschachtelungs-Umschaltkreis nach einer Ausführungsform der Erfindung zeigt, Fig. 2 ist ein Schaltdiagramm, welches eine konkrete Schaltung eines Umschaltsignalerzeugungsschaltkreises zeigt, und Fig. 3 ist eine Ansicht, die einige Zeitabläufe zeigt.
- In Fig. 1 bezeichnet 1 einen Interframe-Entschachtelungs-Schaltkreis, 2 bezeichnet eine Synchronismuserfassungsschaltung zur Erfassung eines Niederfrequenzsynchronisiersignals, 3 bezeichnet einen Umschaltsignalerzeugungsschaltkreis zur Erzeugung eines Umschaltsignals, welches als Umschalt-Entschachtelungslänge dient, 4 bezeichnet eine Invertierschaltung zum Invertieren eines Synchronismuserfassungssignals, und 5 bezeichnet eine D-Latch-Schaltung zur Erzeugung eines Umschaltsignals.
- Die Funktionsweise des Interframe-Entschachtelungs-Umschaltkreises vorstehender Ausführung wird nun bezugnehmend auf die Figuren 1, 2 und 3 beschrieben.
- Ein Eingangssignal wird dem Interframe-Entschachtelungs-Schaltkreis 1 zugeführt, in welchem das Signal einer Interframe-Entschachtelungs-Operation mit einer Schachtelungslänge m unterzogen wird. Danach wird die sich ergebende Ausgangsgröße der Synbchronismuserfassungsschaltung 2 zugeführt, in der ein Niederfrequenzsynchronisiersignal von der Ausgangsgröße erfaßt wird. Die Synchronismuserfassungsschaltung 2 dient dazu, als Synchronismuserfassungssignal b ein "HIGH"-Pegel-Signal zuzuführen, wenn es erfaßt wird, un ein "LOW"-Pegel-Signal, wenn es nicht erfaßt wird. Danach wird in der Umschaltsignalerzeugungsschaltung 3 das Synchronismuserfassungssignal b in der Invertierschaltung 4 invertiert, und es resultiert ein Signal c, wie in Fig. 3 gezeigt. In der D-Latch-Schaltung 5 wird ein Eingangstaktsignal a unverändert als Umschaltsignal d verwendet, wenn das Synchronismuserfassungssignal c auf einem "High"-Pegel ist, d.h. die Synchronismuserfassungsschaltung 2 kein Niederfrequenz-Synchronisiersignal erfassen kann. Dies bedeutet, daß das Schaltsignal d invertiert ist, und somit die Schachtelungslänge auf n geändert wird. Wenn das Synchronismuserfassungssignal auf einem "LOW"-Pegel ist, d.h. die Synsnchronismuserfassungsschaltung 2 ein Niederfrequenz-Synchrnonisiersignsal erfassen kann, dann dient die D-Latch-Schaltung 5 zur Lieferung eines Taktimpulses a, der zu einem Zeitpunkt gegeben wird, an dem das Synchronismuserfassungssignal c auf einem "LOW"-Pegel ist, und das Umschaltsignal sorgt für das Beibehalten des Erfassens des Niederfrequenz-Synchronisiersignal durch die Synchronismuserfassungsschaltung 2. Der Zeitraum t&sub1; des Takts a muß die folgende Beziehung mit einer Zeit t&sub2;, welche sich von der Änderung des Umschaltsignals d zur Freigabezeit zum Erfassen des Synchronismus erstreckt, erfüllen:
- t&sub1;/2> t&sub2;
- Wie im vorhergehenden erwähnt, liefert die vorliegende Ausführungsform die Synchronismuserfassungsschaltung 2 zur Erfassung eines Niederfrequenz-Synchronisiersignals und die Umschaltsignalerzeugungsschaltung 3, um das Umschaltsignal zum Umschalten der Schachtelungslänge zu schalten.
- Nach der vorliegenden Erfindung ermöglicht das Vorsehen der Synchronismuserfassungsschaltung und der Umschaltsignalerzeugungsschaltung, automatisch die Schachtelungslänge umzuschalten, ohne daß ein Umschaltsignal von der externen Einheit erforderlich ist.
Claims (2)
1. Interframe-Entschachtelungs-Umschaltkreis zum
Umschalten einer Entschachtelungslänge für ein digital kodiertes
Signal mit zwei verschidenen Schachtelungslängen zwischen einem
Übertragungssystem und einem Packsystem, wobei der Schaltkreis
aufweist:
einen Interframe-Entschachtelungskreis (1) zum Ändern
der Entschachtelungslänge für das digital kodierte Signal;
gekennzeichnet durch
eine Synchronismuserfassungsschaltung (2) zum Erfassen
eines Synchronisiersignals von einem Ausgangsanschluß des
Interframe-Entschachtelungskreises (1); und
einen Schaltsignalerzeugungskreis (3) zum Erzeugen
eines Schaltsignals, das den Interframe-Entschachtelungskreis
(1) die Entschachtelungslänge halten läßt, wenn die
Synchronismuserfassungsschaltung (2) ein Synchronisiersignal erfaßt,
und das die Interframe-Entschachtelungsschaltung (1) die
Entschachtelungslänge ändern läßt, wenn die
Synchronismuserfassungsschaltung (2) kein Synchronisiersignal erfaßt.
2. Interframe-Entschachtelungs-Umschaltkreis nach
Anspruch 1, bei dem
der Schaltsignalerzeugungskreis eine
Invertierschaltung (4) zum Invertieren Eines Ausgangssignals (b) der
Synchronismuserfassungsschaltung (2) und eine
D-Latch-Schaltung (5) zum Empfangen eines Taktsignals (a) sowie eines
Ausgangssignals (c) der Invertierschaltung (4) und zum Halten
des Taktsignals (a), um ein Haltesignal (d) als das
Schaltsignal abzugeben, wenn die Synchronismuserfassungsschaltung
(2) das Synchronisiersignal erfaßt, sowie zum Abgeben des
Taktsignals (a) als das Schaltsignal beeinhaltet, wenn die
Synchronismuserfassungsschaltung (2) kein Synchronisiersignal
erfaßt.
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