DE19801488B4 - Verfahren zum Zusammenbau eines Halbleiterbausteins - Google Patents
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Abstract
Verfahren
zum Zusammenbau eines Halbleiterbausteins mit den Schritten:
Zersägen eines Wafers (18) zum Bilden von Halbleiterchips (11) mit einer Vielzahl von Kontaktflecken (11a);
Verkleben einer Vielzahl von Leitern (14a) auf der Oberfläche eines Halbleiterchips (11) mittels eines Klebematerials (13);
Verbinden der Kontaktflecken (11a) und der Leiter (14a); und
Vergießen des Halbleiterchips (11), der Leiter (14a) und vorgegebener Abschnitte einschließlich eines Wärmeübertragungsmaterials (12) unter Verwendung eines Gießharzes (6), so dass eine Oberfläche des Wärmeübertragungsmaterials (12) und Oberflächen (14b) der Leiter frei liegen,
dadurch gekennzeichnet, dass das Wärmeübertragungsmaterial (12) an einer Oberfläche des Wafers (18) vor dessen Zersägen zu Halbleiterchips (11) befestigt wird.
Zersägen eines Wafers (18) zum Bilden von Halbleiterchips (11) mit einer Vielzahl von Kontaktflecken (11a);
Verkleben einer Vielzahl von Leitern (14a) auf der Oberfläche eines Halbleiterchips (11) mittels eines Klebematerials (13);
Verbinden der Kontaktflecken (11a) und der Leiter (14a); und
Vergießen des Halbleiterchips (11), der Leiter (14a) und vorgegebener Abschnitte einschließlich eines Wärmeübertragungsmaterials (12) unter Verwendung eines Gießharzes (6), so dass eine Oberfläche des Wärmeübertragungsmaterials (12) und Oberflächen (14b) der Leiter frei liegen,
dadurch gekennzeichnet, dass das Wärmeübertragungsmaterial (12) an einer Oberfläche des Wafers (18) vor dessen Zersägen zu Halbleiterchips (11) befestigt wird.
Description
- Die vorliegende Erfindung betrifft ein Verfahren zum Zusammenbau eines Halbleiterbausteins.
- Wie aus
1 ersichtlich ist, enthält der dem Stand der Technik entsprechende Halbleiterbaustein einen Halbleiterchip1 mit einer Vielzahl von Bondierungsflecken1a , ein auf einer Unterseite des Halbleiterchips1 befestigtes Wärmeübertragungsmaterial2 , eine Vielzahl innerer Leiter4a , die mittels eines ersten Klebematerials3 mit beiden Oberkantenseiten des Halbleiterchips1 verklebt sind, eine Vielzahl äußerer Leiter4b , die von den inneren Leitern4a aus nach oben verlaufen, Drähte5 , die die Bondierungsflecken1a des Halbleiterchips1 und die inneren Leiter4a elektrisch verbinden, und ein Gießharz6 , das den Halbleiterchip1 , die inneren und äußeren Leiter4a und4b und das Wärmeübertragungsmaterial2 dichtend kapselt. Die Unterseite des Wärmeübertragungsmaterials und die Oberflächen der äußeren Leiter4b sind von Gießharz6 frei. - Das dem Stand der Technik entsprechende Verfahren zum Herstellen des in
1 dargestellten Halbleiterbausteins wird nunmehr unter Bezugnahme auf2A bis2F erläutert. - Zunächst wird ein zweites Klebematerial
9 auf einer Unterseite des Wafers8 angebracht. - Wie aus
2B ersichtlich ist, wird der Wafer8 , auf dessen Unterseite das zweite Klebematerial9 angebracht ist, mittels einer Diamant-Schleifscheibe zu einer Vielzahl Halbleiterchips1 zersägt. Das zweite Klebematerial9 dient hier dazu, zu verhindern, daß die Halbleiterchips1 bei der Herstellung derselben durch Zersägen des Wafers8 zerstreut werden. Ein Bondierungspfad (nicht dargestellt) wird auf der Oberfläche des Halbleiterchips1 ausgeformt. - Wie in
2C dargestellt, wird das zweite Klebematerial9 entfernt, und die äußeren Leiter4b , die von den inneren Leitern4a nach oben verlaufen, werden mittels des Klebematerials3 mit den Oberkantenseiten des Halbleiterchips1 verklebt. - Wie
2D zeigt, wird das Wärmeübertragungsmaterial2 an der Unterseite des in2C dargestellten Halbleiterchips1 befestigt. - Wie in
2E dargestellt, werden die Bondierungsflecken1a des Halbleiterchips1 und die inneren Leiter4a elektrisch durch Drähte5 verbunden. - Wie aus
2F ersichtlich ist, werden das Wärmeübertragungsmaterial2 , die inneren Leiter4a , die äußeren Leiter4b und vorgegebene Abschnitte einschließlich der Drähte5 dichtend unter Verwendung des Gießharzes6 vergossen. Das Vergießen erfolgt dabei auf eine solche Weise, daß die Unterseite des Wärmeübertragungsmaterials2 und die Oberseiten der äußeren Leiter4b jeweils frei von Gießharz6 bleiben, womit die Herstellung des dem Stand der Technik entsprechenden Halbleiterbausteins abgeschlossen ist. - Wie oben beschrieben wird das Wärmeübertragungsmaterial bei dem bekannten Halbleitergehäuse jeweils an jedem einzelnen der Halbleiterchips angebracht, wodurch der Herstellungsprozeß komplizierter wird. Da außerdem die Fläche des Wärmeübertragungsmaterials größer ist als die Fläche des Halbleiterchips, wird das Gewicht des Gehäuses größer.
-
DE 40 10 370 A1 undEP 0 499 752 A2 zeigen die Ausbildung einer Wärmesenkeschicht an der Unterseite eines Halbleiterwafers und die anschließende Durchtrennung des Wafers zusammen mit der daran angeordneten Wärmesenkeschicht in einzelne Halbleiterchips. Die letztere der beiden vorstehend genannten Druckschriften zeigt darüber hinaus ein unter der Wärmesenkeschicht angebrachtes Klebeband, an dem die Halbleiterchips hängen bleiben, wenn der Wafer zersägt wird. Die einzelnen Chips können dann von diesem Klebeband abgehoben werden. - Mit einer Gussmasse vergossene Halbleiterbausteine sind z.B. aus
DE 38 14 469 C2 ,DE 44 00 341 A1 undDE 42 31 705 A1 bekannt. InDE 38 14 469 C2 erfolgt die Kontaktierung eines Chips des Halbleiterbausteins über aus dem Gussmaterial herausgeführte Leitungen, deren innere Endbereiche über leitende Materialklumpen in elektrischem Kontakt mit dem Chip stehen. InDE 44 00 341 A1 dienen Bonddrähte zur Verbindung von Anschlussflecken eines Chips des Halbleiterbausteins mit den inneren, vergossenen Enden von Leitungen, deren äußere Enden aus dem Halbleiterbaustein herausgeführt sind. Die Innenbereiche dieser Leiter sind ringsum von dem Gussmaterial umgeben und nicht mit dem Chip verklebt. InDE 42 31 705 A1 ist ein Chip des Halbleiterbausteins über Haltestege an einem Anschlussrahmen gehalten. Die Haltestege sind durch eine Klebstoffverbindung mit dem Chip verbunden. - Zur elektrischen Kontaktierung des Chips werden Bonddrähte verwendet, welche zwischen auf der Chipoberfläche vorgesehenen Kontaktflächen und Anschlussleitern verlaufen, deren innere, von dem Chip separierte Enden mit dem Gussmaterial vergossen sind.
- Aufgabe der Erfindung ist es, ein vereinfachtes Verfahren zur Herstellung eines Halbleiterbausteins anzugeben.
- Bei der Lösung dieser Aufgabe geht die Erfindung aus von einem Verfahren zum Zusammenbau eines Halbleiterbausteins mit den Schritten: Zersägen eines Wafers zum Bilden von Halbleiterchips mit einer Vielzahl von Kontaktflecken; Verkleben einer Vielzahl von Leitern auf der Oberfläche eines Halbleiterchips mittels eines Klebematerials; Verbinden der Kontaktflecken und der Leiter; und Vergießen des Halbleiterchips, der Leiter und vorgegebener Abschnitte einschließlich eines Wärmeübertragungsmaterials unter Verwendung eines Gießharzes, so dass eine Oberfläche des Wärmeübertragungsmaterials und Oberflächen der Leiter frei liegen. Wie aus
DE 38 14 469 C2 bekannt. Erfindungsgemäß ist dabei vorgesehen, dass das Wärmeübertragungsmaterial an einer Oberfläche des Wafers vor dessen Zersägen zu Halbleiterchips befestigt wird. - Bevorzugte Ausgestaltungen dieses Verfahrens sind in den abhängigen Unteransprüchen 2–8 angegeben.
- Die Erfindung wird nachfolgend anhand der beigefügten Zeichnungen näher erläutert: Es stellen dar:
-
1 eine waagrechte Querschnittansicht eines dem Stand der Technik entsprechenden Halbleiterbausteins; -
2A bis2F Querschnittansichten des Herstellungsverfahrens für ein dem Stand der Technik entsprechenden Halbleiterbaustein; -
3 eine waagrechte Querschnittansicht eines der vorliegenden Erfindung entsprechenden Halbleiterbausteins; und -
4A bis4E Querschnittansichten des Herstellungsverfahrens für einen der vorliegenden entsprechenden Halbleiterbaustein. - Der Halbleiterbaustein gemäß der vorliegenden Erfindung wird nunmehr unter Bezugnahme auf die beiliegenden Zeichnungen erläutert.
- Wie aus
3 ersichtlich ist, weist der Halbleiterbaustein gemäß der vorliegenden Erfindung folgendes auf: einen Halbleiterchip11 , auf dessen Oberfläche eine Vielzahl Bondierungsflecken11a ausgeformt sind, ein auf der Unterseite des Halbleiterchips11 befestigtes Wärmeübertragungsmaterial12 , eine Vielzahl innerer Leiter14a , die an beiden Oberkantenseiten des Halbleiterchips11 mittels eines Klebematerials13 befestigt sind, eine Vielzahl äußerer Leiter14b , die von den inneren Leiter14a nach oben verlaufen, eine Vielzahl Drähte (oder Kontaktwarzen)15 , die die Bondierungsflecken11a und die inneren Leiter14a elektrisch verbinden, und ein Gießharz 16 zum dichtenden Vergießen der Leiter14a und14b und vorgegebener Abschnitte einschließlich des Wärmeübertragungsmaterials12 . Die Unterseite des Wärmeübertragungsmaterials12 und die äußeren Leiter14b sind von Gießharz16 frei. - Das Verfahren zum Herstellen des Halbleiterbausteins gemäß der vorliegenden Erfindung wird nunmehr unter Bezugnahme auf
4A bis4E erläutert. - Zunächst wird wie in
4A dargestellt das Wärmeübertragungsmaterial12 an der Unterseite des Wafers18 und die Isolierschicht19 auf der Unterseite des Wärmeübertragungsmaterials12 befestigt. Das Wärmeübertragungsmaterial12 besteht aus einem leitfähigen Material, z.B. Kupfer, einer Legierung aus Kupfer und Nickel, Aluminium etc. - Wie aus
4B ersichtlich ist, wird zum Zersägen des Wafers in eine Vielzahl Halbleiterchips11 allgemein eine Diamant-Schleifscheibe verwendet. In diesem Fall werden das Wärmeübertragungsmaterial12 und die Isolierschicht19 gleichzeitig zersägt (Sägeprozeß). Die Isolierschicht19 verhindert, daß die Halbleiterchips11 beim Zersägen des Wafers18 zerstreut werden, und besteht aus Polyimid etc. Der Fleck (nicht dargestellt) ist auf dem Halbleiterchip11 nicht ausgeformt. - Wie
4C zeigt, wird die Isolierschicht19 entfernt, und die inneren Leiter14a sowie die äußeren Leiter14b , die von den inneren Leitern14a nach oben verlaufen, werden unter Verwendung des Klebematerials13 (Druckklebeprozeß) mit beiden Oberkantenseiten des Halbleiterchips11 verklebt. Das Klebematerial13 besteht aus einem Polyimidfilm. - Wie in
4D dargestellt, werden die Bondierungsflecken11a des Halbleiterchips11 und die inneren Leiter14a mittels der Drähte15 (oder Kontaktwarzen (nicht dargestellt)) (Drahtbondierungsprozeß) elektrisch verbunden. - Wie aus
4E ersichtlich ist, werden das Wärmeübertragungsmaterial12 , die inneren Leiter14a , die äußeren Leiter14b und vorgegebene Abschnitte einschließlich der Drähte15 unter Verwendung des Gießharzes16 vergossen. Dabei bleiben die Unterseite des Wärmeübertragungsmaterials12 und die Oberflächen der äußeren Leiter14b von Gießharz16 frei, womit die Herstellung des erfindungsgemäßen Halbleiterbausteins abgeschlossen ist. - Da bei dem erfindungsgemäßen Halbleiterbaustein wie oben beschrieben das Wärmeübertragungsmaterial an der Unterseite des Wafers befestigt ist und dann zusammen mit diesem zersägt wird, wird der Herstellungsprozeß des Halbleiterbausteins vereinfacht. Darüber hinaus wird das Gewicht des Halbleiterbausteins durch Minimieren der Fläche des Wärmeübertragungsmaterials verringert.
Claims (8)
- Verfahren zum Zusammenbau eines Halbleiterbausteins mit den Schritten: Zersägen eines Wafers (
18 ) zum Bilden von Halbleiterchips (11 ) mit einer Vielzahl von Kontaktflecken (11a ); Verkleben einer Vielzahl von Leitern (14a ) auf der Oberfläche eines Halbleiterchips (11 ) mittels eines Klebematerials (13 ); Verbinden der Kontaktflecken (11a ) und der Leiter (14a ); und Vergießen des Halbleiterchips (11 ), der Leiter (14a ) und vorgegebener Abschnitte einschließlich eines Wärmeübertragungsmaterials (12 ) unter Verwendung eines Gießharzes (6 ), so dass eine Oberfläche des Wärmeübertragungsmaterials (12 ) und Oberflächen (14b ) der Leiter frei liegen, dadurch gekennzeichnet, dass das Wärmeübertragungsmaterial (12 ) an einer Oberfläche des Wafers (18 ) vor dessen Zersägen zu Halbleiterchips (11 ) befestigt wird. - Verfahren nach Anspruch 1, dadurch gekennzeichnet, dass das Wärmeübertragungsmaterial (
12 ) aus einem leitfähigem Material besteht. - Verfahren nach Anspruch 2, dadurch gekennzeichnet, dass das leitfähige Material aus Kupfer, einer Legierung aus Kupfer und Nickel oder Aluminium besteht.
- Verfahren nach einem der Ansprüche 1 bis 3, dadurch gekennzeichnet, dass das Klebematerial (
13 ) aus einem Polyimidfilm besteht. - Verfahren nach Anspruch 1, dadurch gekennzeichnet, dass eine Isolierschicht (
19 ) am Wärmeübertragungsmaterial (12 ) vor dem Zersägen des Wafers (18 ) befestigt wird. - Verfahren nach Anspruch 5, dadurch gekennzeichnet, dass die Isolierschicht (
19 ) vor dem Vergießen entfernt wird. - Verfahren nach Anspruch 5, dadurch gekennzeichnet, dass die Isolierschicht (
19 ) nach dem Vergießen entfernt wird. - Verfahren nach einem der Ansprüche 5 bis 7, dadurch gekennzeichnet, dass die Isolierschicht (
19 ) aus Polyimid besteht.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR3990/97 | 1997-02-11 | ||
KR1019970003990A KR19980067735A (ko) | 1997-02-11 | 1997-02-11 | 반도체 패키지의 제조방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
DE19801488A1 DE19801488A1 (de) | 1998-08-20 |
DE19801488B4 true DE19801488B4 (de) | 2004-10-21 |
Family
ID=19496767
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE19801488A Expired - Fee Related DE19801488B4 (de) | 1997-02-11 | 1998-01-16 | Verfahren zum Zusammenbau eines Halbleiterbausteins |
Country Status (3)
Country | Link |
---|---|
JP (1) | JP2838703B2 (de) |
KR (1) | KR19980067735A (de) |
DE (1) | DE19801488B4 (de) |
Families Citing this family (13)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US10451897B2 (en) | 2011-03-18 | 2019-10-22 | Johnson & Johnson Vision Care, Inc. | Components with multiple energization elements for biomedical devices |
US9804418B2 (en) * | 2011-03-21 | 2017-10-31 | Johnson & Johnson Vision Care, Inc. | Methods and apparatus for functional insert with power layer |
US8857983B2 (en) | 2012-01-26 | 2014-10-14 | Johnson & Johnson Vision Care, Inc. | Ophthalmic lens assembly having an integrated antenna structure |
US10381687B2 (en) | 2014-08-21 | 2019-08-13 | Johnson & Johnson Vision Care, Inc. | Methods of forming biocompatible rechargable energization elements for biomedical devices |
US9793536B2 (en) | 2014-08-21 | 2017-10-17 | Johnson & Johnson Vision Care, Inc. | Pellet form cathode for use in a biocompatible battery |
US10627651B2 (en) | 2014-08-21 | 2020-04-21 | Johnson & Johnson Vision Care, Inc. | Methods and apparatus to form biocompatible energization primary elements for biomedical devices with electroless sealing layers |
US9599842B2 (en) | 2014-08-21 | 2017-03-21 | Johnson & Johnson Vision Care, Inc. | Device and methods for sealing and encapsulation for biocompatible energization elements |
US9941547B2 (en) | 2014-08-21 | 2018-04-10 | Johnson & Johnson Vision Care, Inc. | Biomedical energization elements with polymer electrolytes and cavity structures |
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US9715130B2 (en) | 2014-08-21 | 2017-07-25 | Johnson & Johnson Vision Care, Inc. | Methods and apparatus to form separators for biocompatible energization elements for biomedical devices |
US10345620B2 (en) | 2016-02-18 | 2019-07-09 | Johnson & Johnson Vision Care, Inc. | Methods and apparatus to form biocompatible energization elements incorporating fuel cells for biomedical devices |
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- 1997-02-11 KR KR1019970003990A patent/KR19980067735A/ko not_active Application Discontinuation
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1998
- 1998-01-16 DE DE19801488A patent/DE19801488B4/de not_active Expired - Fee Related
- 1998-02-09 JP JP10027166A patent/JP2838703B2/ja not_active Expired - Fee Related
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Also Published As
Publication number | Publication date |
---|---|
KR19980067735A (ko) | 1998-10-15 |
DE19801488A1 (de) | 1998-08-20 |
JP2838703B2 (ja) | 1998-12-16 |
JPH10229095A (ja) | 1998-08-25 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
OP8 | Request for examination as to paragraph 44 patent law | ||
8364 | No opposition during term of opposition | ||
8339 | Ceased/non-payment of the annual fee |