DE102009006152B4 - Verfahren zur Herstellung eines Elektronikbauelements - Google Patents
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- H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/32245—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
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- H01L2224/34—Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
- H01L2224/36—Structure, shape, material or disposition of the strap connectors prior to the connecting process
- H01L2224/37—Structure, shape, material or disposition of the strap connectors prior to the connecting process of an individual strap connector
- H01L2224/37001—Core members of the connector
- H01L2224/37099—Material
- H01L2224/371—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/37117—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 400°C and less than 950°C
- H01L2224/37124—Aluminium [Al] as principal constituent
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- H01L2224/34—Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
- H01L2224/36—Structure, shape, material or disposition of the strap connectors prior to the connecting process
- H01L2224/37—Structure, shape, material or disposition of the strap connectors prior to the connecting process of an individual strap connector
- H01L2224/37001—Core members of the connector
- H01L2224/37099—Material
- H01L2224/371—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/37138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/37147—Copper [Cu] as principal constituent
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- H01L2224/34—Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
- H01L2224/36—Structure, shape, material or disposition of the strap connectors prior to the connecting process
- H01L2224/37—Structure, shape, material or disposition of the strap connectors prior to the connecting process of an individual strap connector
- H01L2224/3754—Coating
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- H01L2224/34—Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
- H01L2224/39—Structure, shape, material or disposition of the strap connectors after the connecting process
- H01L2224/40—Structure, shape, material or disposition of the strap connectors after the connecting process of an individual strap connector
- H01L2224/401—Disposition
- H01L2224/40151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/40221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/40245—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
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- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/481—Disposition
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- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/48245—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
- H01L2224/48247—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
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- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/731—Location prior to the connecting process
- H01L2224/73151—Location prior to the connecting process on different surfaces
- H01L2224/73153—Bump and layer connectors
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- H01L2224/732—Location after the connecting process
- H01L2224/73201—Location after the connecting process on the same surface
- H01L2224/73219—Layer and TAB connectors
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- H01L2224/732—Location after the connecting process
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- H01L2224/83399—Material
- H01L2224/834—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/83438—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/83439—Silver [Ag] as principal constituent
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- H01L2224/8338—Bonding interfaces outside the semiconductor or solid-state body
- H01L2224/83399—Material
- H01L2224/834—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/83438—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/83447—Copper [Cu] as principal constituent
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- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/8338—Bonding interfaces outside the semiconductor or solid-state body
- H01L2224/83399—Material
- H01L2224/834—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/83438—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/83455—Nickel [Ni] as principal constituent
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- H01L2224/8338—Bonding interfaces outside the semiconductor or solid-state body
- H01L2224/83399—Material
- H01L2224/834—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/83438—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/8346—Iron [Fe] as principal constituent
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- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/838—Bonding techniques
- H01L2224/83801—Soldering or alloying
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- H01L2224/83801—Soldering or alloying
- H01L2224/8382—Diffusion bonding
- H01L2224/83825—Solid-liquid interdiffusion
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- H01L2224/838—Bonding techniques
- H01L2224/8385—Bonding techniques using a polymer adhesive, e.g. an adhesive based on silicone, epoxy, polyimide, polyester
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- H01L2224/84—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a strap connector
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- H01L2924/15738—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950 C and less than 1550 C
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Abstract
Verfahren, umfassend:
– Bereitstellen eines ersten Halbleiterchips (10) mit einer ersten Elektrode (15) auf einer ersten Oberfläche (16) und einer zweiten Elektrode (17) auf einer der ersten Oberfläche (16) gegenüberliegenden zweiten Oberfläche (18);
– Bereitstellen eines zweiten Halbleiterchips (30) mit einer ersten Elektrode (15) auf einer ersten Oberfläche (16) und einer zweiten Elektrode (17) auf einer der ersten Oberfläche (16) gegenüberliegenden zweiten Oberfläche (18);
– Bereitstellen eines ersten metallischen, S-förmigen Clips (11) mit einem ersten Ende und einem zweiten Ende;
– Bereitstellen eines zweiten metallischen, S-förmigen Clips (31) mit einem ersten Ende und einem zweiten Ende;
– Bereitstellen eines Systemträgers (13) mit einem ersten Pad (32) und einem zweiten Pad (33);
– Herstellen einer ersten Baugruppe durch Verbinden der zweiten Elektrode (17) des ersten Halbleiterchips (10) mit dem ersten Ende des ersten Clips (11);
– Herstellen einer zweiten Baugruppe durch Verbinden der zweiten Elektrode (17) des zweiten Halbleiterchips (30) mit dem ersten Ende des zweiten Clips (31); und
– Befestigen der ersten Baugruppe und der zweiten Baugruppe an dem Systemträger (13), wobei die erste Elektrode (15) des ersten Halbleiterchips (10) an dem ersten Pad (32) befestigt wird, die erste Elektrode (15) des zweiten Halbleiterchips (30) an dem zweiten Ende des ersten Clips (11) befestigt wird und das zweite Ende des zweiten Clips (31) an dem zweiten Pad (33) befestigt wird, wobei
– die dem ersten und zweiten Halbleiterchip (10, 30) abgewandten Oberflächen des ersten Pads (32), des zweiten Pads (33) und des zweiten Endes des ersten Clips (11) eine gemeinsame Ebene bilden.
– Bereitstellen eines ersten Halbleiterchips (10) mit einer ersten Elektrode (15) auf einer ersten Oberfläche (16) und einer zweiten Elektrode (17) auf einer der ersten Oberfläche (16) gegenüberliegenden zweiten Oberfläche (18);
– Bereitstellen eines zweiten Halbleiterchips (30) mit einer ersten Elektrode (15) auf einer ersten Oberfläche (16) und einer zweiten Elektrode (17) auf einer der ersten Oberfläche (16) gegenüberliegenden zweiten Oberfläche (18);
– Bereitstellen eines ersten metallischen, S-förmigen Clips (11) mit einem ersten Ende und einem zweiten Ende;
– Bereitstellen eines zweiten metallischen, S-förmigen Clips (31) mit einem ersten Ende und einem zweiten Ende;
– Bereitstellen eines Systemträgers (13) mit einem ersten Pad (32) und einem zweiten Pad (33);
– Herstellen einer ersten Baugruppe durch Verbinden der zweiten Elektrode (17) des ersten Halbleiterchips (10) mit dem ersten Ende des ersten Clips (11);
– Herstellen einer zweiten Baugruppe durch Verbinden der zweiten Elektrode (17) des zweiten Halbleiterchips (30) mit dem ersten Ende des zweiten Clips (31); und
– Befestigen der ersten Baugruppe und der zweiten Baugruppe an dem Systemträger (13), wobei die erste Elektrode (15) des ersten Halbleiterchips (10) an dem ersten Pad (32) befestigt wird, die erste Elektrode (15) des zweiten Halbleiterchips (30) an dem zweiten Ende des ersten Clips (11) befestigt wird und das zweite Ende des zweiten Clips (31) an dem zweiten Pad (33) befestigt wird, wobei
– die dem ersten und zweiten Halbleiterchip (10, 30) abgewandten Oberflächen des ersten Pads (32), des zweiten Pads (33) und des zweiten Endes des ersten Clips (11) eine gemeinsame Ebene bilden.
Description
- Die vorliegende Erfindung betrifft ein Verfahren zur Herstellung eines Elektronikbauelements.
- Elektronikbauelemente können Träger enthalten, auf denen Halbleiterchips platziert werden können. Weiterhin können Elektronikbauelemente elektrisch leitende Einrichtungen wie etwa metallische Clips enthalten, um eine elektrische Kopplung zwischen den Komponenten des Bauelements bereitzustellen.
- Die Schrift
DE 10 2007 019 686 A1 beschreibt ein Bauelement mit einem vertikalen Halbleiterchip, der auf einen Systemträger montiert ist und über dem ein metallischer Bügel angeordnet ist. Die SchriftDE 102 35 797 A1 beschreibt die Montage von Halbleiterchips auf Trägern mit Hilfe von flexiblen Folien. Die SchriftUS 2005/0161785 A1 - Der Erfindung liegt die Aufgabe zugrunde, ein Verfahren zur Herstellung eines Bauelements zu schaffen, bei dem Halbleiterchip, Träger und metallischer Clip in vorteilhafter Weise angeordnet sind.
- Die der Erfindung zugrunde liegende Aufgabe wird durch die Merkmale der unabhängigen Ansprüche gelöst. Vorteilhafte Weiterbildungen und Ausgestaltungen der Erfindung sind in den Unteransprüchen angegeben.
- Die beiliegenden Zeichnungen sind aufgenommen, um ein eingehenderes Verständnis von Ausführungsformen zu vermitteln, und sind in diese Spezifikation aufgenommen und stellen einen Teil dieser dar. Die Zeichnungen veranschaulichen Ausführungsformen und dienen zusammen mit der Beschreibung der Erläuterung von Prinzipien von Ausführungsformen. Andere Ausführungsformen und viele der damit einhergehenden Vorteile von Ausführungsformen lassen sich ohne weiteres verstehen, wenn sie durch Bezugnahme auf die folgende ausführliche Beschreibung besser verstanden werden. Die Elemente der Zeichnungen sind relativ zueinander nicht notwendigerweise maßstabsgetreu. Gleiche Bezugszahlen bezeichnen entsprechende ähnliche Teile.
- Die
1A bis1C zeigen schematisch eine Ausführungsform eines Verfahrens zum Herstellen eines Bauelements. - Die
2A bis2E zeigen schematisch eine Ausführungsform eines Verfahrens zum Herstellen eines Bauelements. - Die
3A bis3G zeigen schematisch eine Ausführungsform eines Verfahrens zum Herstellen eines Bauelements. -
4 zeigt eine Grundschaltung einer Halbbrücke. - Die
5A bis5C zeigen schematisch eine Ausführungsform eines Verfahrens zum Herstellen des Bauelements. - Bauelemente mit Halbleiterchips werden unten beschrieben. Die Halbleiterchips können von extrem verschiedenen Arten sein und können beispielsweise integrierte elektrische oder elektrooptische Schaltungen enthalten. Die Halbleiterchips können beispielsweise als Leistungshalbleiterchips wie etwa Leistungstransistoren, Leistungsdioden oder IGBTs (Insulated Gate Bipolar Transistors) konfiguriert sein. Weiterhin können die Halbleiterchips Steuerschaltungen, Mikroprozessoren oder mikroelektromechanische Komponenten enthalten. Bei einer Ausführungsform können Halbleiterchips mit einer vertikalen Struktur beteiligt sein, das heißt, dass die Halbleiterchips auf derartige Weise hergestellt sein können, dass elektrische Ströme in einer Richtung senkrecht zu den Hauptoberflächen der Halbleiterchips fließen können. Ein Halbleiterchip mit einer vertikalen Struktur kann bei einer Ausführungsform Kontaktelemente auf seinen beiden Hauptoberflächen aufweisen, das heißt auf seiner Oberseite und Unterseite. Bei einer Ausführungsform können Leistungstransistoren, Leistungsdioden und IGBTs eine vertikale Struktur besitzen. Beispielhaft können sich die Source-Elektrode und die Gate-Elektrode eines Leistungstransistors und die Anodenelektrode einer Leistungsdiode auf einer Hauptoberfläche befinden, während die Drain-Elektrode des Leistungstransistors und die Katodenelektrode der Leistungsdiode auf der anderen Hauptoberfläche angeordnet sind. Eine Leistungsdiode kann in einer Ausführungsform als eine Schottky-Diode verkörpert sein. Weiterhin können die unten beschriebenen Bauelemente integrierte Schaltungen zum Steuern der integrierten Schaltungen von anderen Halbleiterchips enthalten, beispielsweise der integrierten Schaltungen von Leistungstransistoren oder Leistungsdioden. Die Halbleiterchips brauchen nicht aus einem spezifischen Halbleitermaterial hergestellt sein, beispielsweise Si, SiC, SiGe, GaAs, und können weiterhin anorganische und/oder organische Materialien enthalten, die keine Halbleiter sind, wie etwa beispielsweise Isolatoren, Kunststoffe oder Metalle. Zudem können die Halbleiterchips gekapselt oder ungekapselt sein.
- Die Halbleiterchips besitzen Elektroden (oder Kontaktpads), die das Herstellen eines elektrischen Kontakts mit den in den Halbleiterchips enthaltenen integrierten Schaltungen gestatten. Eine oder mehrere Metallschichten können auf den Elektroden der Halbleiterchips aufgebracht sein. Die Metallschichten können mit einer beliebigen gewünschten geometrischen Gestalt und einer beliebigen gewünschten Materialzusammensetzung hergestellt werden. Die Metallschichten können beispielsweise in Form einer einen Bereich bedeckenden Schicht vorliegen. Als das Material kann jedes gewünschte Metall oder jede gewünschte Metalllegierung verwendet werden, beispielsweise Aluminium, Titan, Gold, Silber, Kupfer, Palladium, Platin, Nickel, Chrom oder Nickel-Vanadium. Die Metallschichten brauchen nicht homogen oder aus nur einem Material hergestellt zu sein, das heißt, verschiedene Zusammensetzungen und Konzentrationen der in den Metallschichten enthaltenen Materialien sind möglich.
- Die Halbleiterchips können auf Trägern montiert sein. Die Träger können von beliebiger Gestalt oder Größe oder aus einem beliebigen Material sein. Während der Fabrikation der Bauelemente kann der Träger derart bereitgestellt werden, dass andere Träger in der Nähe angeordnet sind und durch Verbindungseinrichtungen mit dem Träger verbunden sind, mit dem Zweck, die Träger zu trennen. Der Träger kann aus Metallen oder Metalllegierungen hergestellt sein, bei einer Ausführungsform Kupfer, Kupferlegierungen, Eisen-Nickel, Aluminium, Aluminiumlegierungen oder anderen Materialien. Er kann weiterhin elektrisch leitend sein. Zudem können die Träger mit einem elektrisch leitenden Material elektrochemisch beschichtet sein, beispielsweise Kupfer, Silber, Eisen-Nickel oder Nickel-Phosphor. Der Träger kann beispielsweise ein Systemträger (Leadframe) oder ein Teil eines Systemträgers wie etwa ein Die-Pad (Chipträger) oder ein metallischer Clip (Bügel) oder irgendein anderes starres Substrat sein. Der Träger oder ein Teil davon kann gebogen sein, zum Beispiel auf S-förmige Weise. Dadurch kann der Träger zwei Oberflächen mit verschiedenen Höhen verbinden.
- Die Halbleiterchips und die Träger, wie etwa Systemträger oder metallische Clips oder andere geeignete Substrate, können durch Löten verbunden werden. Löten ist ein Prozess, bei dem zwei oder mehr Gegenstände wie etwa Metallgegenstände durch Schmelzen und Fließen eines Lötmaterials in die Fuge miteinander verbunden werden. Um die Halbleiterchips an die Träger zu löten, kann Lötmaterial auf den Halbleiterchips, bei einer Ausführungsform auf einer oder mehreren Elektroden der Halbleiterchips, oder auf den Trägern abgeschieden werden. Wenn als Verbindungstechnik zum Verbinden der Halbleiterchips mit den Trägern Diffusionslöten verwendet wird, werden Lötmaterialien verwendet, die nach dem Ende der Lötoperation an der Grenzfläche zwischen dem Halbleiterchip und dem Träger aufgrund von Grenzflächendiffusionsprozessen zu intermetallischen Phasen führen. In diesem Fall ist der Einsatz von AuSn-, AgSn-, CuSn-, Sn-, AuIn-, AgIn-, AuSi- oder CuIn-Loten denkbar.
- Wenn ein Weichlötprozess zum Verbinden der Halbleiterchips und der Träger miteinander verwendet wird, bleibt Lötmaterial an der Grenzfläche zwischen dem Halbleiterchip und dem Träger nach der Beendigung des Lötprozesses zurück.
- Wenn die Halbleiterchips adhäsiv an die Träger gebondet werden, ist es möglich, elektrisch leitende Kleber zu verwenden, die auf gefüllten oder ungefüllten Polyimiden, Epoxidharzen, Acrylatharzen, Siliconharzen oder Mischungen davon basieren können und die mit Gold, Silber, Nickel oder Kupfer angereichert sein können, um eine elektrische Leitfähigkeit herzustellen.
- Die Bauelemente können ein Formmaterial (Moldmaterial) enthalten, das mindestens Teile der Komponenten der Bauelemente bedeckt. Das Formmaterial kann ein beliebiges angemessenes thermoplastisches oder wärmehärtendes Material sein. Verschiedene Techniken können verwendet werden, um die Komponenten mit dem Formmaterial zu bedecken, beispielsweise Formpressen oder Spritzgießen.
- Die
1A bis1C zeigen schematisch ein Verfahren zur Herstellung eines Bauelements100 . Ein Querschnitt durch das durch das Verfahren erhaltene Bauelement100 ist in1C dargestellt. Zuerst werden ein erster Halbleiterchip10 und ein erster metallischer Clip11 bereitgestellt (siehe1A ). Dann wird der Halbleiterchip10 an dem metallischen Clip11 angebracht (siehe1B ). Falls ein Diffusionslötprozess durchgeführt wird, um den Halbleiterchip10 an den metallischen Clip11 anzubringen, bleiben kein Lötmaterial oder nur Spuren von Lötmaterial zwischen den zwei Komponenten nach dem Fertigstellen des Lötprozesses zurück. Statt dessen wird durch den Diffusionslötprozess an der Grenzfläche zwischen dem Halbleiterchip10 und dem metallischen Clip11 eine intermetallische Phase12 erzeugt. Der Diffusionslötprozess kann eine elektrische Kopplung zwischen dem Halbleiterchip10 und dem metallischen Clip11 herstellen. - Nach dem Anbringen des Halbleiterchips
10 an den metallischen Clip11 kann der Halbleiterchip10 über einem Träger13 platziert werden, beispielsweise einem Systemträger oder einem Die-Pad des Systemträgers. Die Verbindung zwischen dem Halbleiterchip10 und dem Träger13 kann durch einen Weichlötprozess oder einen Klebeprozess hergestellt werden, was dazu führt, dass Lötmaterial14 oder Klebematerial14 zwischen den beiden Komponenten verbleibt. - Die
2A bis2E zeigen schematisch ein Verfahren zur Herstellung eines Bauelements200 , von dem ein Querschnitt in2E gezeigt ist. Das in2A bis2E gezeigte Verfahren ist eine Weiterentwicklung des in Figuren1A bis1C gezeigten Verfahrens. Die Einzelheiten des Herstellungsverfahrens, die unten beschrieben sind, können deshalb gleichermaßen auf das Verfahren der1A bis1C angewendet werden. - In
2A werden der Halbleiterchip10 und der metallische Clip11 bereitgestellt. Der Halbleiterchip10 kann eine erste Elektrode15 auf einer ersten Hauptoberfläche16 und eine zweite Elektrode17 auf einer zweiten Hauptoberfläche18 , die der ersten Hauptoberfläche16 gegenüberliegt, aufweisen. Der Halbleiterchip10 kann beispielsweise ein IGBT (Insulated Gate Bipolar Transistor), eine vertikale Leistungsdiode oder ein vertikaler Leistungstransistor, beispielsweise ein Leistungs-MOSFET, sein. Im letzteren Fall, der beispielhaft in2A gezeigt ist, können die erste und zweite Elektrode15 und17 Drain- bzw. Source-Elektroden sein. Weiterhin kann der Halbleiterchip10 eine dritte Elektrode19 auf der zweiten Hauptoberfläche18 aufweisen, die in dem Fall, dass der Halbleiterchip10 ein Leistungstransistor ist, als eine Gate-Elektrode fungiert. - Der metallische Clip
11 kann aus Metallen oder Metalllegierungen hergestellt sein, bei einer Ausführungsform Kupfer, Kupferlegierungen, Eisen-Nickel, Aluminium, Aluminiumlegierungen oder anderen elektrisch leitenden Materialien. Weiterhin kann der metallische Clip11 mit einem elektrisch leitenden Material elektrochemisch beschichtet sein, beispielsweise Kupfer, Silber, Eisen-Nickel oder Nickel-Phosphor. Der metallische Clip11 kann eine oder mehrere planare Oberflächen aufweisen, auf denen die Komponenten des herzustellenden Bauelements200 platziert werden können oder die zum Plazieren des metallischen Clips11 auf den Komponenten verwendet werden können. Die Gestalt des metallischen Clips11 ist auf keine Größe oder geometrische Gestalt beschränkt. Der metallische Clip11 kann gebogen sein, wie beispielhaft in2A gezeigt. Ein Abschnitt oder mehrere Abschnitte des metallischen Clips11 können S-förmig sein. Der metallische Clip11 kann eine Dicke im Bereich von 100 μm bis 1 mm aufweisen oder sogar noch dicker sein. Der metallische Clip11 kann durch Stanzen, Prägen, Pressen, Schneiden, Sägen, Fräsen oder irgendeine andere angemessene Technik hergestellt werden. - Wie in
2B dargestellt, ist der Halbleiterchip10 mit seiner dem metallischen Clip11 zugewandten ersten Hauptoberfläche16 an dem metallischen Clip11 befestigt. Die Drain-Elektrode15 kann durch Diffusionslöten elektrisch an den metallischen Clip11 gekoppelt sein. Dazu kann ein Lötmaterial auf der Drain-Elektrode15 oder der unteren Oberfläche des metallischen Clips11 abgeschieden werden (nicht dargestellt), beispielsweise durch Sputtern oder durch andere geeignete physikalische oder chemische Abscheidungsverfahren. Das Lötmaterial kann eine Dicke im Bereich von 100 nm bis 10 μm besitzen, bei einer Ausführungsform im Bereich von 1 bis 3 μm. Das Lötmaterial kann beispielsweise aus AuSn, AgSn, CuSn, Sn, AuIn, AgIn, AuSi oder CuIn bestehen. - Zum Herstellen der gelöteten Verbindung kann der metallische Clip
11 von einer Heizplatte auf eine Temperatur über dem Schmelzpunkt des Lötmaterials erhitzt werden, beispielsweise im Bereich von 200 bis 400°C, bei einer Ausführungsform im Bereich von 330 bis 350°C. Bei einer Ausführungsform können sowohl der Halbleiterchip10 als auch der metallische Clip11 in einem Ofen platziert und auf eine angemessene Temperatur erhitzt werden. Eine Pick-and-Place-Anlage (Greifen-und-Platzieren-Anlage) kann verwendet werden, die in der Lage ist, den Halbleiterchip10 aufzugreifen und ihn auf dem erhitzten metallischen Clip11 zu platzieren oder umgekehrt. Während des Lötprozesses kann der Halbleiterchip10 für eine angemessene Zeit im Bereich zwischen 10 und 200 ms, bei einer Ausführungsform etwa 50 ms, auf den metallischen Clip11 gepresst werden. - Während des Lötprozesses erzeugt das Lötmaterial eine metallische Verbindung zwischen dem Halbleiterchip
10 und dem metallischen Clip11 , der aufgrund der Tatsache, dass das Lötmaterial eine temperaturbeständige und mechanisch hoch stabile intermetallische Phase mit hochschmelzenden Materialien des Halbleiterchips10 und des metallischen Clips11 , die verbunden werden sollen, bildet, hohen Temperaturen standhalten kann. Die intermetallische Phase besitzt einen höheren Schmelzpunkt als das zum Erzeugen der intermetallischen Phase verwendete Lötmaterial. Im Prozess wird das niedrigschmelzende Lötmaterial vollständig umgewandelt, das heißt, es geht vollständig in die intermetallische Phase über. Der Prozess ist diffusionsgesteuert, und seine Dauer nimmt mit der Zunahme der Dicke der Lötmaterialschicht zu. - Anstatt einen einzelnen metallischen Clip
11 zu verwenden, kann ein integrales Array (Anordnung) aus metallischen Clips bereitgestellt werden und ein Halbleiterchip kann auf jedem der metallischen Clips montiert werden. Später in dem Herstellungsprozess können die individuellen Bauelemente getrennt werden, indem das integrale Array aus metallischen Clips zerlegt wird. - Wie in
2C dargestellt, werden der erste Halbleiterchip10 zusammen mit dem ersten metallischen Clip11 über dem Systemträger13 platziert. Ein auf einem zweiten metallischen Clip auf ähnliche Weise wie der erste Halbleiterchip10 montierter zweiter Halbleiterchip kann ebenfalls über dem Systemträger13 platziert werden (in2C nicht dargestellt). Weiterhin können mit weiteren metallischen Clips verbundene weitere Halbleiterchips über dem Systemträger13 platziert werden (in20 nicht dargestellt). Die Halbleiterchips können auf einem aus Halbleitermaterial hergestellten Wafer produziert worden sein. Die Halbleiterchips können auf dem gleichen Wafer hergestellt worden sein, können aber auch auf verschiedenen Wafern hergestellt worden sein. Weiterhin können die Halbleiterchips physisch identisch sein, können aber auch verschiedene integrierte Schaltungen enthalten. - Der Systemträger
13 kann aus Metallen oder Metalllegierungen hergestellt sein, bei einer Ausführungsform Kupfer, Kupferlegierungen, Eisen-Nickel, Aluminium, Aluminiumlegierungen oder anderen elektrisch leitenden Materialien. Weiterhin kann der Systemträger13 mit einem elektrisch leitenden Material elektrochemisch beschichtet sein, beispielsweise Kupfer, Silber, Eisen-Nickel oder Nickel-Phosphor. Die Gestalt des Systemträgers13 ist auf keine Größe oder geometrische Gestalt beschränkt. Der Abschnitt des Systemträgers13 , über dem der Halbleiterchip10 und der metallische Clip11 platziert sind, können mehrere Pads (Kontaktflächen)20 ,21 ,22 und23 enthalten, wobei die Pads20 und23 als ein einzelnes Pad verkörpert sein können. Jedes der Pads20 bis23 kann mit einer Schicht aus Lötmaterial14 beschichtet sein. Bei einer Ausführungsform kann das Lötmaterial14 auf dem Halbleiterchip10 und dem metallischen Clip11 abgeschieden sein. Die Schichten des Lötmaterials14 können eine Dicke im Bereich zwischen 10 und 30 μm besitzen. Das Lötmaterial14 kann beispielsweise aus AuSn, AgSn, CuSn, Sn, AuIn, AgIn, AuSi oder CuIn bestehen. - Ein Weichlötprozess kann durchgeführt werden, um den Halbleiterchip
10 und den metallischen Clip11 mit dem Systemträger13 zu verbinden. Dazu können der Systemträger13 und/oder der Halbleiterchip10 sowie der metallische Clip11 auf eine Temperatur im Bereich von 200 bis 400°C erhitzt werden, und der Halbleiterchip10 und der metallische Clip11 können auf dem Systemträger13 platziert werden. Wegen der erhöhten Schmelztemperatur der während des Diffusionslötprozesses erzeugten intermetallischen Phase wird die intermetallische Phase zwischen dem Halbleiterchip10 und dem metallischen Clip11 während des Weichlötprozesses nicht geschmolzen. Nach dem Anbringen kann der metallische Clip11 aufgrund der S-Gestalt des metallischen Clips11 (siehe2D ) an den Pads20 und23 angebracht werden. Die Source- und Gate-Elektroden17 und19 des Halbleiterchips10 werden an den Pads21 bzw.22 angebracht. - Anstelle eines Weichlötprozesses kann adhäsives Bonden unter Einsatz eines elektrisch leitenden Klebers verwendet werden, um den Halbleiterchip
10 und den metallischen Clip11 an den Systemträger13 anzubringen. Der elektrisch leitende Kleber kann auf gefüllten oder ungefüllten Polyimiden, Epoxidharzen, Acrylatharzen, Siliconharzen oder Mischungen davon basieren und kann mit Gold, Silber, Nickel oder Kupfer angereichert sein, um eine elektrische Leitfähigkeit zu erzeugen. - Wenn Weichlöten oder adhäsives Bonden als eine Verbindungstechnik verwendet wird, bleibt eine Schicht auf dem Lötmaterial
14 oder dem Kleber14 an der Grenzfläche zwischen dem Halbleiterchip10 und dem Systemträger13 nach dem Löt- oder Klebeprozess zurück, wie in2D gezeigt. Diese Schicht kann eine Dicke im Bereich zwischen 1 bis 30 μm besitzen. - Ein Formmaterialtransferprozess (Moldprozess) kann durchgeführt werden, um die auf dem Systemträger
13 angeordneten Komponenten mit einem Formmaterial24 (Moldmaterial) zu kapseln (siehe2E ). Das Formmaterial24 kann einen beliebigen Abschnitt des Bauelements200 kapseln, lässt aber mindestens Teile der Pads20 bis23 unbedeckt. Die exponierten Oberflächen der Pads20 bis23 können als externe Kontaktelemente zum elektrischen Koppeln des Bauelements200 an andere Komponenten wie etwa beispielsweise eine Leiterplatte, wie etwa eine PCB (Printed Circuit Board; gedruckte Leiterplatte) verwendet werden. - Das Formmaterial
24 kann aus einem beliebigen angemessenen thermoplastischen oder wärmehärtenden Material bestehen, bei einer Ausführungsform kann es aus einem üblicherweise in der gegenwärtigen Halbleiterkapselungstechnologie verwendeten Material bestehen. Es können verschiedene Techniken eingesetzt werden, um die Komponenten des Bauelements200 mit dem Formmaterial24 zu bedecken, beispielsweise Formpressen oder Spritzgießen. - Vor oder nach der Kapselung mit dem Formmaterial
24 werden die individuellen Bauelemente200 durch Trennung des Systemträgers13 , beispielsweise durch Sägen, voneinander getrennt. - Die
3A bis3G zeigen schematisch ein Verfahren zur Herstellung eines Bauelements300 , von dem eine Draufsicht in3G gezeigt ist. Die Einzelheiten des Herstellungsverfahrens, die oben in Verbindung mit2A bis2E beschrieben sind, können gleichermaßen auf das Verfahren der3A bis3G angewendet werden. - Wie in
3A gezeigt, werden ein erster Halbleiterchip10 , ein zweiter Halbleiterchip30 , ein erster Träger11 und ein zweiter Träger31 bereitgestellt. Bei der vorliegenden Ausführungsform sind beide Halbleiterchips10 und30 Leistungshalbleiterchips, bei einer Ausführungsform Leistungstransistoren. Beide Träger11 und31 können als metallische Clips implementiert werden und können S-förmig sein. - Eine erste Baugruppe kann hergestellt werden, indem der erste Halbleiterchip
10 mit dem ersten metallischen Clip11 verbunden wird, und eine zweite Baugruppe kann hergestellt werden, indem der zweite Halbleiterchip30 mit dem zweiten metallischen Clip31 verbunden wird (siehe3B ). Die metallischen Clips11 und31 können an den Source-Elektroden17 der Halbleiterchips10 bzw.30 angebracht werden. Beide Baugruppen können unter Verwendung eines Diffusionslötprozesses wie oben in Verbindung mit2B beschrieben hergestellt werden. Der Diffusionslötprozess verursacht intermetallische Phasen zwischen den Halbleiterchips10 und30 sowie den jeweiligen metallischen Clips11 und31 . - Nach der Vormontage der ersten und zweiten Baugruppe können die erste und zweite Baugruppe miteinander und auch mit einem dritten Träger verbunden werden. Der dritte Träger kann ein Systemträger
13 sein. In3C sind nur zwei Pads32 und33 des Systemträgers13 gezeigt. Die erste und zweite Baugruppe und der Systemträger13 können durch Einsatz eines Weichlötprozesses oder eines Klebeprozesses verbunden werden. Ähnlich wie oben in Verbindung mit2C beschrieben, können die Pads32 und33 sowie die obere Oberfläche des ersten metallischen Clips11 mindestens teilweise mit einer Schicht aus Lötmaterial14 oder einem elektrisch leitenden Kleber14 bedeckt werden. Bei einer Ausführungsform kann das Lötmaterial14 oder der elektrisch leitende Kleber14 auf den Drain-Elektroden15 der Halbleiterchips10 und30 sowie der unteren Oberfläche des zweiten metallischen Clips31 abgeschieden werden. Die Schichten des Lötmaterials14 oder des elektrisch leitenden Klebers14 können eine Dicke im Bereich zwischen 10 und 30 μm besitzen. - Wie in
3D gezeigt können die erste Baugruppe, die zweite Baugruppe und der Systemträger13 derart verbunden sein, dass die Drain-Elektrode15 des ersten Halbleiterchips10 elektrisch an das Pad32 gekoppelt ist, die Drain-Elektrode15 des zweiten Halbleiterchips30 elektrisch an den ersten metallischen Clip11 gekoppelt ist und der zweite metallische Clip31 elektrisch an das Pad33 gekoppelt ist. Weiterhin können die Komponenten derart verbunden sein, dass die unteren Oberflächen der Pads32 und33 und des ersten metallischen Clips11 eine gemeinsame Ebene bilden. Wenn zum Verbinden der vormontierten Komponenten ein Weichlöt- oder Klebeprozess verwendet wird, bleibt Lötmaterial14 oder Kleber14 an den Löt- oder Klebegrenzflächen zurück, wie in3D gezeigt. - In
3E ist die Baugruppe, die in3D im Querschnitt dargestellt ist, in Draufsicht gezeigt. Hier sind das Pad33 und der zweite metallische Clip31 um 90° gedreht. In3D wurden diese Komponenten zur besseren Darstellung unterschiedlich angeordnet. - In der Draufsicht sind auch weitere Pads
34 und35 des Systemträgers13 dargestellt. Bonddrähte36 und37 können angebracht sein, um die Drain-Elektroden19 des ersten und zweiten Halbleiterchips10 und30 elektrisch an die Pads34 bzw.35 zu koppeln (siehe3F ). - Ein Formmaterialtransferprozess kann durchgeführt werden, um die auf dem Systemträger
13 angeordneten Komponenten mit einem Formmaterial24 zu kapseln (siehe3G ). Das Formmaterial24 kann einen beliebigen Abschnitt des Bauelements300 kapseln, lässt aber mindestens Teile der Pads32 bis35 und des ersten metallischen Clips11 unbedeckt, beispielsweise ihre unteren Oberflächen. Die exponierten Oberflächen der Pads32 bis35 und des ersten metallischen Clips11 können als externe Kontaktelemente verwendet werden, um das Bauelement300 elektrisch an andere Komponenten zu koppeln. - Vor oder nach der Kapselung mit dem Formmaterial
24 können die individuellen Bauelemente300 durch Trennung des Systemträgers13 beispielsweise durch Sägen voneinander getrennt werden. - Wenn die Verbindungen wie in
3G gezeigt vorliegen, kann das Bauelement300 als eine Halbbrücke verwendet werden. Eine Grundschaltung einer zwischen zwei Knoten N1 und N2 angeordneten Halbbrücke400 ist in4 gezeigt. Die Halbbrücke400 besteht aus zwei in Reihe geschalteten Schaltern S1 und S2. Die Halbleiterchips10 und30 können als die beiden Schalter S1 bzw. S2 implementiert sein. Im Vergleich zu dem in3G dargestellten Bauelement300 ist der Knoten N1 die Drain-Elektrode15 des ersten Halbleiterchips10 , der zwischen den beiden Schaltern S1 und S2 angeordnete Knoten N3 ist die Drain-Elektrode15 des zweiten Halbleiterchips30 , und der Knoten N2 ist die Source-Elektrode17 des zweiten Halbleiterchips30 . - Die Halbbrücke
400 kann beispielsweise in Elektronikschaltungen zum Konvertieren von Gleichspannungen implementiert werden, bei einer Ausführungsform Gleichspannungswandlern. Gleichspannungswandler können verwendet werden, um eine von einer Batterie oder einem Akkumulator gelieferte Eingangsgleichspannung in eine Ausgangsgleichspannung zu konvertieren, die an den Bedarf der nachgeschalteten Elektronikschaltungen angepasst ist. Gleichspannungswandler können als Step-Down-Wandler (Abwärtswandler) verkörpert sein, bei denen die Ausgangsspannung kleiner ist als die Eingangsspannung, oder als Step-Up-Wandler (Aufwärtswandler), bei denen die Ausgangsspannung größer ist als die Eingangsspannung. Frequenzen von mehreren MHz oder höher können an Gleichspannungswandler angelegt werden. Weiterhin können Ströme von bis zu 50 A oder noch höher durch die Gleichspannungswandler fließen. - Für einen Fachmann ist es offensichtlich, dass die in
1C ,2E und3G gezeigten Bauelemente100 ,200 und300 nur als Ausführungsbeispiele gedacht sind und viele Variationen möglich sind. Beispielsweise kann das Bauelement300 unter Verwendung eines geringfügig anderen Fabrikationsverfahrens, das in5A bis5C gezeigt ist, hergestellt werden. Gemäß diesem Fabrikationsverfahren wird die erste Baugruppe durch Diffusionslöten der Drain-Elektrode15 des ersten Halbleiterchips10 an die obere Oberfläche des Pads32 hergestellt (siehe5A ). Die zweite Baugruppe wird durch Diffusionslöten der Drain-Elektrode15 des zweiten Halbleiterchips30 an die obere Oberfläche des ersten metallischen Clips11 hergestellt. - Die erste und zweite Baugruppe und der zweite metallische Clip
31 werden dann durch Weichlöten oder adhäsives Bonden miteinander verbunden. Dazu wird eine Schicht aus Lötmaterial14 oder elektrisch leitendem Kleber14 auf der Source-Elektrode17 der Halbleiterchips10 und30 und dem Pad33 abgeschieden (siehe5B ). Nach dem Weichlötprozess bleibt eine dünne Schicht aus Lötmaterial14 an den Lötgrenzflächen zurück (siehe5C ). - Andere Variationen des Fabrikationsverfahrens des Bauelements
300 sind ebenfalls möglich. Diese Variationen können beinhalten, dass Baugruppen durch Diffusionslöten vormontiert werden und die Baugruppen dann durch Weichlöten oder adhäsives Bonden miteinander verbunden werden.
Claims (6)
- Verfahren, umfassend: – Bereitstellen eines ersten Halbleiterchips (
10 ) mit einer ersten Elektrode (15 ) auf einer ersten Oberfläche (16 ) und einer zweiten Elektrode (17 ) auf einer der ersten Oberfläche (16 ) gegenüberliegenden zweiten Oberfläche (18 ); – Bereitstellen eines zweiten Halbleiterchips (30 ) mit einer ersten Elektrode (15 ) auf einer ersten Oberfläche (16 ) und einer zweiten Elektrode (17 ) auf einer der ersten Oberfläche (16 ) gegenüberliegenden zweiten Oberfläche (18 ); – Bereitstellen eines ersten metallischen, S-förmigen Clips (11 ) mit einem ersten Ende und einem zweiten Ende; – Bereitstellen eines zweiten metallischen, S-förmigen Clips (31 ) mit einem ersten Ende und einem zweiten Ende; – Bereitstellen eines Systemträgers (13 ) mit einem ersten Pad (32 ) und einem zweiten Pad (33 ); – Herstellen einer ersten Baugruppe durch Verbinden der zweiten Elektrode (17 ) des ersten Halbleiterchips (10 ) mit dem ersten Ende des ersten Clips (11 ); – Herstellen einer zweiten Baugruppe durch Verbinden der zweiten Elektrode (17 ) des zweiten Halbleiterchips (30 ) mit dem ersten Ende des zweiten Clips (31 ); und – Befestigen der ersten Baugruppe und der zweiten Baugruppe an dem Systemträger (13 ), wobei die erste Elektrode (15 ) des ersten Halbleiterchips (10 ) an dem ersten Pad (32 ) befestigt wird, die erste Elektrode (15 ) des zweiten Halbleiterchips (30 ) an dem zweiten Ende des ersten Clips (11 ) befestigt wird und das zweite Ende des zweiten Clips (31 ) an dem zweiten Pad (33 ) befestigt wird, wobei – die dem ersten und zweiten Halbleiterchip (10 ,30 ) abgewandten Oberflächen des ersten Pads (32 ), des zweiten Pads (33 ) und des zweiten Endes des ersten Clips (11 ) eine gemeinsame Ebene bilden. - Verfahren nach Anspruch 1, wobei Diffusionslötprozesse zum Verbinden des ersten Halbleiterchips (
10 ) mit dem ersten Clip (11 ) und zum Verbinden des zweiten Halbleiterchips (30 ) mit dem zweiten Clip (31 ) durchgeführt werden. - Verfahren nach Anspruch 1 oder 2, wobei Weichlötprozesse oder Klebeprozesse zum Befestigen der ersten Baugruppe und der zweiten Baugruppe an dem Systemträger (
13 ) durchgeführt werden. - Verfahren, umfassend: – Bereitstellen eines ersten Halbleiterchips (
10 ) mit einer ersten Elektrode (15 ) auf einer ersten Oberfläche (16 ) und einer zweiten Elektrode (17 ) auf einer der ersten Oberfläche (16 ) gegenüberliegenden zweiten Oberfläche (18 ); – Bereitstellen eines zweiten Halbleiterchips (30 ) mit einer ersten Elektrode (15 ) auf einer ersten Oberfläche (16 ) und einer zweiten Elektrode (17 ) auf einer der ersten Oberfläche (16 ) gegenüberliegenden zweiten Oberfläche (18 ); – Bereitstellen eines ersten metallischen, S-förmigen Clips (11 ) mit einem ersten Ende und einem zweiten Ende; – Bereitstellen eines zweiten metallischen, S-förmigen Clips (31 ) mit einem ersten Ende und einem zweiten Ende; – Bereitstellen eines Systemträgers (13 ) mit einem ersten Pad (32 ) und einem zweiten Pad (33 ); – Verbinden der ersten Elektrode (15 ) des ersten Halbleiterchips (10 ) mit dem ersten Pad (32 ); – Verbinden der ersten Elektrode (15 ) des zweiten Halbleiterchips (30 ) mit dem zweiten Ende des ersten Clips (11 ); und – Befestigen des ersten und zweiten Clips (11 ,31 ) an dem Systemträger (13 ), wobei die zweite Elektrode (17 ) des ersten Halbleiterchips (10 ) an dem ersten Ende des ersten Clips (11 ) befestigt wird, die zweite Elektrode (17 ) des zweiten Halbleiterchips (30 ) an dem ersten Ende des zweiten Clips (31 ) befestigt wird und das zweite Ende des zweiten Clips (31 ) an dem zweiten Pad (33 ) befestigt wird, wobei – die dem ersten und zweiten Halbleiterchip (10 ,30 ) abgewandten Oberflächen des ersten Pads (32 ), des zweiten Pads (33 ) und des zweiten Endes des ersten Clips (11 ) eine gemeinsame Ebene bilden. - Verfahren nach Anspruch 4, wobei Diffusionslötprozesse zum Verbinden des ersten Halbleiterchips (
10 ) mit dem ersten Pad (32 ) und zum Verbinden des zweiten Halbleiterchips (30 ) mit dem ersten Clip (11 ) durchgeführt werden. - Verfahren nach Anspruch 4 oder 5, wobei Weichlötprozesse oder Klebeprozesse zum Befestigen des ersten und zweiten Clips (
11 ,31 ) an dem Systemträger (13 ) durchgeführt werden.
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