CN1879205A - 改善半导体晶片的表面粗糙度的工艺 - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 10
- 238000000034 method Methods 0.000 title abstract description 14
- 230000008569 process Effects 0.000 title abstract description 11
- 230000003746 surface roughness Effects 0.000 title description 20
- XKRFYHLGVUSROY-UHFFFAOYSA-N Argon Chemical compound [Ar] XKRFYHLGVUSROY-UHFFFAOYSA-N 0.000 claims abstract description 70
- 238000000137 annealing Methods 0.000 claims abstract description 46
- 229910052786 argon Inorganic materials 0.000 claims abstract description 35
- 239000012298 atmosphere Substances 0.000 claims abstract description 30
- 238000004140 cleaning Methods 0.000 claims abstract description 19
- 239000003344 environmental pollutant Substances 0.000 claims abstract description 16
- 231100000719 pollutant Toxicity 0.000 claims abstract description 16
- 239000000126 substance Substances 0.000 claims abstract description 10
- 238000005516 engineering process Methods 0.000 claims description 58
- 239000007789 gas Substances 0.000 claims description 25
- 239000012300 argon atmosphere Substances 0.000 claims description 16
- 239000001257 hydrogen Substances 0.000 claims description 15
- 229910052739 hydrogen Inorganic materials 0.000 claims description 15
- 238000010926 purge Methods 0.000 claims description 15
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims description 13
- 229910052710 silicon Inorganic materials 0.000 claims description 13
- 239000010703 silicon Substances 0.000 claims description 13
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 claims description 12
- 229910000577 Silicon-germanium Inorganic materials 0.000 claims description 8
- VHUUQVKOLVNVRT-UHFFFAOYSA-N Ammonium hydroxide Chemical compound [NH4+].[OH-] VHUUQVKOLVNVRT-UHFFFAOYSA-N 0.000 claims description 7
- 235000011114 ammonium hydroxide Nutrition 0.000 claims description 7
- 238000009499 grossing Methods 0.000 abstract 1
- 235000012431 wafers Nutrition 0.000 description 149
- 238000004151 rapid thermal annealing Methods 0.000 description 73
- 238000011282 treatment Methods 0.000 description 24
- 239000010410 layer Substances 0.000 description 23
- 238000010438 heat treatment Methods 0.000 description 10
- 238000002347 injection Methods 0.000 description 10
- 239000007924 injection Substances 0.000 description 10
- 239000003595 mist Substances 0.000 description 10
- 230000004048 modification Effects 0.000 description 10
- 238000012986 modification Methods 0.000 description 10
- 238000012545 processing Methods 0.000 description 9
- 239000000463 material Substances 0.000 description 8
- 239000000758 substrate Substances 0.000 description 8
- 238000004381 surface treatment Methods 0.000 description 6
- 229910052736 halogen Inorganic materials 0.000 description 5
- 150000002367 halogens Chemical class 0.000 description 5
- 238000009826 distribution Methods 0.000 description 4
- 230000002349 favourable effect Effects 0.000 description 4
- 238000001816 cooling Methods 0.000 description 3
- 238000010586 diagram Methods 0.000 description 3
- 150000002431 hydrogen Chemical class 0.000 description 3
- 238000002156 mixing Methods 0.000 description 3
- 238000005498 polishing Methods 0.000 description 3
- 239000000243 solution Substances 0.000 description 3
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 description 2
- 239000007864 aqueous solution Substances 0.000 description 2
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 description 2
- 238000004320 controlled atmosphere Methods 0.000 description 2
- 230000002950 deficient Effects 0.000 description 2
- 239000000428 dust Substances 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 230000003628 erosive effect Effects 0.000 description 2
- 239000012212 insulator Substances 0.000 description 2
- 230000003647 oxidation Effects 0.000 description 2
- 238000007254 oxidation reaction Methods 0.000 description 2
- 239000001301 oxygen Substances 0.000 description 2
- 229910052760 oxygen Inorganic materials 0.000 description 2
- 230000009257 reactivity Effects 0.000 description 2
- 241000894007 species Species 0.000 description 2
- 239000004215 Carbon black (E152) Substances 0.000 description 1
- 241000283984 Rodentia Species 0.000 description 1
- LEVVHYCKPQWKOP-UHFFFAOYSA-N [Si].[Ge] Chemical compound [Si].[Ge] LEVVHYCKPQWKOP-UHFFFAOYSA-N 0.000 description 1
- 230000001133 acceleration Effects 0.000 description 1
- 230000006978 adaptation Effects 0.000 description 1
- 239000003708 ampul Substances 0.000 description 1
- 238000013459 approach Methods 0.000 description 1
- 125000004429 atom Chemical group 0.000 description 1
- 230000009286 beneficial effect Effects 0.000 description 1
- 230000008901 benefit Effects 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 230000008859 change Effects 0.000 description 1
- 239000003153 chemical reaction reagent Substances 0.000 description 1
- 230000000052 comparative effect Effects 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 238000005520 cutting process Methods 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- PXBRQCKWGAHEHS-UHFFFAOYSA-N dichlorodifluoromethane Chemical compound FC(F)(Cl)Cl PXBRQCKWGAHEHS-UHFFFAOYSA-N 0.000 description 1
- 235000019404 dichlorodifluoromethane Nutrition 0.000 description 1
- 238000010790 dilution Methods 0.000 description 1
- 239000012895 dilution Substances 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 239000008246 gaseous mixture Substances 0.000 description 1
- 230000014509 gene expression Effects 0.000 description 1
- 229930195733 hydrocarbon Natural products 0.000 description 1
- 150000002430 hydrocarbons Chemical class 0.000 description 1
- 230000006872 improvement Effects 0.000 description 1
- 238000005259 measurement Methods 0.000 description 1
- 238000004377 microelectronic Methods 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 238000006386 neutralization reaction Methods 0.000 description 1
- 229910052757 nitrogen Inorganic materials 0.000 description 1
- 230000005693 optoelectronics Effects 0.000 description 1
- 238000000746 purification Methods 0.000 description 1
- 239000010453 quartz Substances 0.000 description 1
- 230000009467 reduction Effects 0.000 description 1
- 230000004044 response Effects 0.000 description 1
- 230000000717 retained effect Effects 0.000 description 1
- 230000000630 rising effect Effects 0.000 description 1
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N silicon dioxide Inorganic materials O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 1
- 239000002344 surface layer Substances 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02041—Cleaning
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/324—Thermal treatment for modifying the properties of semiconductor bodies, e.g. annealing, sintering
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/76—Making of isolation regions between components
- H01L21/762—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers
- H01L21/7624—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers using semiconductor on insulator [SOI] technology
- H01L21/76251—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers using semiconductor on insulator [SOI] technology using bonding techniques
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- Crystals, And After-Treatments Of Crystals (AREA)
- Container, Conveyance, Adherence, Positioning, Of Wafer (AREA)
- Cleaning Or Drying Semiconductors (AREA)
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Abstract
本发明涉及一种降低半导体晶片自由面的粗糙度的工艺,所述工艺包括用于平滑所述自由面的单个退火步骤,所述单个退火步骤实施为纯氩气氛下的RTA,其特征在于,在RTA之前,进行晶片表面的化学清洗,以便于减少晶片上初步污染物的量。
Description
技术领域
本发明一般涉及材料的表面处理,并特别涉及晶片的处理,该晶片用于制造在微电子学和/或光电子学中应用的元件。
更精确地,本发明涉及用于降低半导体晶片自由面的粗糙度的工艺,所述工艺包括用于平滑所述自由面的单个退火步骤,所述单个退火步骤实施为在纯氩气氛中的RTA。
背景技术
术语“自由面”指的是暴露于外部环境的晶片表面(由此不同于由多层晶片的两层之间的内界面所限定的表面)。
从描述将明显可见的是,结合用于制造薄层的工艺可以有利地实现本发明,例如在专利FR 2681472中描述的(尽管这种结合不限制本
发明的范围)。
再现上述专利的教导的工艺叫做Smart-Cut工艺。它的主要步骤示意如下:
●在半导体施主衬底的表面下注入种类(species)——也称为“上部”并且制造在例如硅或者硅-锗中,在上部的注入区中,
●注入上部和接收衬底接触——接收衬底也称为“基底”,
●在注入区劈开注入的上部,以便于在基底上转移所述上部位于注入区和注入表面之间的部分,并由此在基底上形成薄半导体层。
“种类注入”意味着一种或者多种原子或者离子种类注入,以便于在注入晶片的材料中引入这种种类,在注入晶片的确定深度处具有最大的种类浓度,并产生脆性区。
注入不同种类的情况通常被称为“共同注入”。
注入晶片中脆性区的深度是注入种类的本性和注入能量的函数。
在本文中,通用术语“晶片”是指包括在基础衬底上转移的层的结构,如通过这种Smart-Cut型工艺获得。
并且在本文中术语“晶片”还通常指代任何层、衬底或者晶片,而不管它的来源(Smart-Cut型工艺或者不是)。这种“晶片”还可以是块体材料的晶片。
在所有的情况中,本发明的一般目的是改善晶片的自由面的粗糙度。
可以通过以下获得改善晶片的这个目的:
●通过降低表面的粗糙度(平均粗糙度),还
●通过增加表面上粗糙度的均匀性。
对于例如在本文开头提到的应用,晶片自由面的粗糙度的规格实际上非常严格,并且晶片自由面的质量对于将在晶片上制造的元件的质量是至关重要的参数。
例如,通常找到最大5埃rms的粗糙度规格。
规定的是,通常用AFM显微镜进行粗糙度测量。
用这种装置,在AFM显微镜的尖端所扫描的表面上测量粗糙度,这种表面的尺寸例如可能在1×1μm2和10×10μm2之间,有时是50×50μm2或者甚至是100×100μm2。
粗糙度可尤其根据两个主要方法来表征。
根据第一个主要方法,粗糙度是“高频粗糙度”;它对应于大约1×1μm2的扫描表面。
根据另一个主要方法,粗糙度是“低频粗糙度”;它对应于大于或等于大约10×10μm2的扫描表面。上面作为例证给出的5埃的规格是通常对应于10×10μm2的扫描表面的粗糙度。
在不存在特殊的表面处理(例如抛光操作)的情况下,通过已知工艺(Smart-Cut型工艺或者其它工艺)制造的晶片显示出高于例如上面所述规格的自由面粗糙度。
根据表面处理的第一种已知类型,晶片经历“传统的”热处理(例如牺牲氧化)。
但是这种表面处理不能使粗糙度降低到如上所述的规格。
当然可以的是,增加传统热处理的连续步骤和/或组合其它已知的表面处理与这种处理,以便进一步降低粗糙度。
但是这将增加这种处理所需的时间和工艺的复杂性。
如在EP 1061565中描述的工艺是这种传统热处理的例证。该文献公开了用高温长时间(大约60分钟)实现的退火步骤。
该退火之后是在含有氢的气氛中冷却。
根据表面处理的第二种已知类型,对晶片的自由面施加化学机械抛光(CMP)。
这种类型的处理的确可以降低晶片自由面的粗糙度。
在晶片内存在朝着表面增大的缺陷(defaults)浓度梯度的情况中,这第二种类型的已知表面处理可以进一步允许将晶片磨损到相关于可接受的缺陷浓度的区域。
但是该第二种类型的已知表面处理可能会损害晶片的自由面的均匀性(尤其是表面层的厚度的均匀性)。
如果需要重要的抛光,其通常是为了获得例如上面所述的低粗糙度值,则这种缺点进一步增大。
根据表面处理的第三种已知类型,将晶片在受控气氛中进行快速热退火(RTA)。
在该第三种类型的已知表面处理中,在高温中对晶片退火,例如以1100到1300℃的量级,在可以从大约一秒到几十秒的时间中。
根据该第三种类型的表面处理的第一个变型,在通常包含氢与反应气体(HCl、HF、HBr、SF6、CF4NF3、CCl2F2...)的组合的混合气所构成的气氛中,通过晶片的RTA来平滑晶片的自由面。
US 6171965给出了这种变型的例子。EP 1061565还公开了RTA(在氢的气氛中进行)。
在第三种已知表面处理的该第一个变型中,混合退火气氛的反应性允许蚀刻晶片的自由面,这降低了它的粗糙度。
可以认为该第一个变型是有利的。
由EP 1061565公开的实施例对应于第三种已知类型的表面处理的该第一个变型。
在这个实施例中,在系统地包含氢的气氛中进行RTA。
然而,这种变型的局限来源于这样的事实,即退火气氛是反应性的。
除了要被退火的晶片自由面之外的部位(elements)由此可受到这种气氛的作用(这些部位例如可以是,与要被处理的表面相对的晶片表面,退火腔室的壁......)。
因此还必须使用另外的手段以保护这些部位。这易于进一步增加处理的复杂性。
并且,混合气氛的反应性还可能可以进一步损害晶片的一些缺陷,这当然是不想要的。
另外,这种变型可能需要特殊的装设(例如,给退火装置供应不同的气体和/或确保安全......)。这构成了另外的限制。
根据第三种已知类型的表面处理的第二个变型,晶片在不侵蚀晶片材料的气氛中进行RTA。
在这种变型中,平滑不是通过蚀刻晶片的自由面获得的,而是通过重新构造它而获得的。
在这种情况中退火气氛通常是由混有氩或氮的氢构成的。
EP 1158581公开了这种表面处理。由该专利公开的处理系统地包括两个不同的退火步骤,它们的其中一个是RTA。可以在包含氢或者氩的气氛中实现这些退火步骤。
由该专利公开的两个退火步骤旨在平滑晶片的自由面。通过该专利的表2的最后一栏例证了低频粗糙度的降低,其尤其示出了RTA之后第二次退火的效果。
实际上,根据该专利,单个RTA(“比较例1”)导致1,60nm rms的低频粗糙度。通过使该RTA之后进行连续的附加退火步骤,低频粗糙度的值降低到0,28和0.30nm rms。
EP 1158581由此教示了两个连续退火,第一个退火是RTA。
但是由EP 1158581公开的工艺系统地包括两个独立的退火步骤的事实使得该工艺相对长和复杂。
本发明的目的是改善已知的表面处理工艺,例如上面所述的。
确实有利的是进一步简化、加速和容易化这些已知工艺。
而且,还将有利的是减少可能的滑移线,例如可在晶片材料的结晶结构中出现的那些滑移线,尤其是在热处理之后(例如在Smart-Cut型工艺中施加到晶片以劈开它的热处理)。
由晶片表面的不同区域所获得的热预算(heat budget)的局部差异可产生这种滑移线(在显示冷点的退火装置的情形中甚至更是这样)。
而且,在该变型中所用的氢是挥发(volatile)气体,其导致可能使用极大量氢的事实——而同时一直在追求减小与晶片表面处理相关的成本。
最后,将尤其有利的是,结合Smart-Cut型工艺来完成实现上述目的的工艺。
为了满足上面所述的目的,WO 03/005434提出了有利的解决方案。
该文献公开了实施为在纯氩气氛中的RTA的、是单个退火的热处理。
这种处理展示了优点,因为它改善了表面粗糙度,而没有上面提及其它技术时所述的缺点。
发明内容
本发明的目的是进一步改善该最后的处理。
实际上,如果这种处理显著地减小了受处理晶片的表面粗糙度的平均值,那么一些不均匀性仍然保留在晶片表面上的粗糙度分布中。
由此本发明的另一目的是改善晶片表面上的粗糙度均匀性。
确实想起的是,在晶片的表面处理的观点中,目的不仅仅是降低晶片的表面粗糙度的平均值。
实际上,还追求获得在晶片表面上尽可能均匀的粗糙度分布。
尤其是,理想的是,避免获得显示出对应于不同粗糙度值的不同区域的受处理表面。
为了达到上述目的,本发明提出了用于降低半导体晶片的自由面的粗糙度的工艺,所述工艺包括用于平滑所述自由面的单个退火步骤,所述单个退火步骤实施为在纯氩气氛中的RTA,其特征在于,在RTA之前,进行晶片表面的化学清洗,以便于减少晶片上初步污染物的量。
该工艺的优选但非限定性方面如下所述:
●紧接在所述RTA之前进行所述化学清洗,
●所述清洗是RCA清洗,
●RCA清洗包括后跟有SC2浴(bath)的SC1浴,
●对于SC1浴,NH4OH和H2O2的分子量浓度都在1%和5%之间,
●晶片具有硅表面层以及NH4OH和H2O2的各自分子量浓度是1%和2%,
●对于SC2浴,HCl和H2O2的分子量浓度都在0.1%和5%之间,
●晶片具有硅表面层以及HCl和H2O2各自的分子量浓度都是1%,
●SC1浴和SC2浴的温度在20和80℃之间,
●晶片具有硅表面层并且SC1浴和SC2浴的温度是70℃,
●所述清洗是HF清洗,
●对于HF浴,HF的分子量浓度在0.1%和49%之间,
●对于HF浴,HF的分子量浓度是20%,
●在RTA之前,以受控的方式吹洗退火环境的气氛,以便于建立包含混合有第二气体的氩的受控吹洗气氛,其中该第二气体可以是氢和/或HCl,从而允许进一步减少晶片上的初步污染物,
●在1150到1230℃的温度进行在纯氩气氛中的所述RTA,
●在1到30秒中进行在纯氩气氛中的所述RTA,
●在通过Smart-Cut型工艺获得的晶片上进行该工艺,
●在SOI晶片上进行该工艺,
●在具有SiGe中的表面层的SGOI晶片上进行该工艺,Ge浓度小于20%。
附图说明
从参考附图作出的下述描述,本发明的其它方面将显而易见,其中:
●图1是可以用在本发明中的退火腔室的纵向切割的概括示意图,
●图2是示意在硅晶片上,通过为本发明实施的RTA而获得的粗糙度降低的曲线图,
●图3是示意在纯氩气氛中进行的RTA的温度变化的曲线,
●图4是示意根据本发明实施例的热处理的温度变化的曲线,
●图5a和5b示意了两个各自晶片上的粗糙度分布,图5a的晶片在没有初步处理的情况下经受纯氩的RTA,图5b的晶片在纯氩的RTA之前还经受了初步处理。
具体实施方式
图1示意性地示出了可以用于实现本发明的退火腔室1的非限定例子。
该腔室将用于在100%纯氩气氛中进行的RTA热处理。
腔室1包括由壁2限定的内部空间。它还包括反应器4、用于承载要被退火的晶片的载体6、卤素灯(halogen lamps)的两个网络8、10和两对侧灯(未示出)。
壁2尤其包括下壁12、上壁14和在内部空间的相对纵向端部的两个侧壁16、18。
这两个侧壁的其中一个16包括用于将晶片引入反应器中/从反应器取回晶片的门20。
反应器4由在侧壁16、18之间纵向延伸的石英管制成。它分别在这些侧壁16、18的每一处提供有气体入口21和气体出口22。气体出口22位于包括门20的侧壁18的一侧。
卤素灯8、10的每个网络分别位于反应器4的上面和下面,在所述反应器和上下壁12以及14之间。
在该实施例中,卤素灯8、10的每个网络包括垂直于反应器4的纵轴集体设置的17个灯26。
两对侧灯(图1中未示出)平行于反应器4的纵轴设置,每个灯在所述反应器的一侧。这些侧灯的每一个位于网络8、10的纵向端部的附近。
载体6支撑着要在纯氩气氛中经受RTA的晶片50。该载体可以滑到反应器4中,由此允许将晶片引入到反应器中和从反应器取出晶片。
由此理解的是,本发明的RTA是单个晶片加热处理,晶片一次处理一个。
可以用作这种类型退火腔室的装置的非限定例子是例如由STEAG出售的“SHS AST 2800”装置,或者Applied Materials的“Radiance”装置。
可以提醒的是,晶片50可以是任何类型的晶片,可以是单层或者多层,至少包括在半导体材料(例如硅或者硅锗)中的表面层。
本发明可以用于改善任何来源的晶片50的表面粗糙度。
尤其是,本发明用于改善SOI(绝缘体上硅)或者SGOI(绝缘体上硅锗)类型的晶片的表面粗糙度。
例如,通过Smart-Cut型工艺可以获得处理的晶片。
实际上,结合这种Smart-Cut型工艺,可以使用本发明改善在脆性区通过劈开步骤所产生的一个或者另一个(或者两个)自由面的表面粗糙度。
另外,可以通过共同注入两种(或者更多种)不同的种类而完成这种Smart-Cut型工艺的注入。在以申请人的名义的申请FR 0309304中给出了这种结合Smart-Cut型工艺的共同注入的例子。
本发明的不同实施例可以应用到晶片50,该晶片50包括在半导体材料(例如硅或者硅锗)中制成的工作表面层52,所述层具有自由表面54。
层52被称作“工作”层,因为它然后将被用于制造晶片50上的电子、光学或者光电元件。
如上所述,通过Smart-Cut型工艺的劈开步骤可以已经产生了表面54。
在这种情况中,晶片50包括在工作层52下面的隐埋氧化物层,其本身覆盖了支撑衬底。
在图1中,为了示出层52而夸大了晶片50的厚度。
如上所述,本发明包含对晶片50的单个热处理,包括在纯氩气氛中进行的RTA。
这种RTA包括下述的一般操作:
●在腔室1中引入晶片50,此时所述腔室是“冷的”(即低于400℃),
●在腔室中建立等于或者接近于大气压力的纯氩退火气氛。还可以将压力设置为较低的值,从几mTorr到大气压力,
●通过选择性地给卤素灯26供电,以大约50℃/s的速度将腔室中的温度增加到RTA温度,
●在RTA期间(从大约一秒到几十秒),维持腔室中晶片50为恒定的温度,
●关闭灯26并通过空气循环而冷却晶片50,以每秒钟几十℃的速度并根据任何所需的冷却定律。
在这个方面中,尤其重要的是,使用的氩应当是尽可能最纯的,因为申请人已经确定,在退火气氛中其它元素(例如尤其是氧)的存在(甚至低含量)可在RTA过程中产生对工作层的材料的侵蚀。
因此“纯”氩在本文中被理解为含有少于1ppm的其它元素(污染物、其它气体......)的氩。
为此目的,必须处理使用的氩,以便在它被引入到退火腔室之前被净化。市场上买得到的氩实际上不存在本发明所需要的高纯度。
通过在将氩引入腔室的供给线上的净化器和/或过滤器可以实现净化处理。
在经受包含少量氧的退火气氛的Si工作层的情况中,如上所述的“侵蚀”可例如对应于SiO(非常易挥发)的形成。
申请人已经确定,在纯氩气氛中进行的RTA的形式下的这种单个热处理显著改善了晶片的表面粗糙度。
尤其是,这种RTA改善了粗糙度,远胜过通过已知热处理,例如牺牲氧化所获得的。
另外,工作层的均匀性远胜于用CMP处理的。
RTA可以包括具有1-30s的持续时间的恒定温度水平,例如温度为1100到1250℃。
图2描述了通过这种RTA获得的平均粗糙度分布。
在该图中,水平轴描述不同的晶片,在这种RTA之前(在图的较高部分中的点)和在这种RTA之后(在图的较低部分中的点)已经测量每个晶片的雾度(haze)。
在图2中,较高的曲线由此对应于在分裂的(劈开之后即刻)SOI晶片的表面上测量的雾度,而较低曲线对应于同类的测量,在相同的晶片已经在1230℃的恒定温度下经受了30s的纯氩气氛下的RTA之后。
要说明的是,术语“雾度”指的是响应于激发光,由晶片50的光所扩散的光信号。该雾度表示表面粗糙度。
在图2的情况中,使用KLA TencorSurfscan 6220测量该雾度:因此该雾度在此被称为“雾度6220”。
所观察到的雾度的减少至少可以与通过其它RTA技术能获得的结果可比,例如在包括混合有氩的氢的气氛下的RTA。
更精确地,雾度被除以了系数6到10。
在本发明的RTA的情况中,获得了这些有利的结果,而没有在本文介绍中提及这些已知RTAs时的缺点。
还应当注意的是,氩具有良好的导热特性。
这有助于促进退火腔室中热的均匀再分配,并因此:
●更均匀的粗糙度分布,和
●滑移线的危险减少。
在本发明中使用的特殊RTA允许对晶片自由面的非常良好的平滑。应当注意的是,实际上没有侵蚀晶片50的材料,而是通过表面的重新构造而获得这种平滑。
本发明还包含在上述的特殊RTA之前对晶片表面的初步处理。
申请人实际上已经观察到,如果这种特殊RTA(如通常在WO03/005434中公开的)非常有利,则仍然可在粗糙度均匀性方面进一步改善晶片的表面粗糙度。
在没有这种初步处理的情况下,实际上可获得一些区域具有稍微高于其它区域的粗糙度(这种“较粗糙”区域通常位于晶片表面的中心)的晶片表面。
表面粗糙度的这种可能差异是由于在进行纯氩RTA之前,晶片表面上污染物的存在。
实际上,提醒的是,本发明的RTA退火是逐个晶片(wafer-by-wafer)的退火。
在这种退火的工业开发中,连续的晶片将在同一腔室中一个接一个地经受RTA。
因此,当将晶片引入到腔室内经受RTA时,理想的是,腔室的气氛应当尽可能不含当引入要被处理的下一晶片时通过打开腔室的门所产生的元素(例如残留气体)。
在打开腔室门之后腔室的气氛实际上可包括例如O2、CO2等的气体以及H2O蒸汽。在腔室中这些残余气体对于要进行的下一RTA是不期望的。
在打开腔室并在引入要处理的晶片后再次关闭之后,由此必须在对另一晶片进行下一RTA之前吹洗腔室的气氛。
图3全面描述了实施为纯氩RTA的单个退火(这构成了本发明所提出的改善的基础)。
该退火包括热处理的初始阶段3.1,其对应于腔室气氛的吹洗以及从腔室的“冷”温度(也就是低于400℃——实际上要说明的是,用于创建图3和4的曲线的温度传感器对于实际上低于400℃的温度显示出400℃的固定值,而仅仅对于高于400℃的温度显示温度的实际值)的温度斜坡上升。
初始阶段之后接着:
●在1150-1230℃,1到30s(阶段3.2)的RTA,
●冷却(阶段3.3),
在初始阶段3.1,用两个主要步骤进行斜坡上升:
●第一个步骤,从400℃上升到大约750℃的预稳定温度,
●第二个步骤,从预稳定温度到RTA温度(在1150和1230℃之间)。
在该初始阶段中,已经进行了腔室气氛的吹洗,其目的是排出不想要的气体。
该吹洗是传统的吹洗,排出与晶片一起引入到腔室内的气氛,并建立纯氩气氛。
在图3和4的底部的表格显示出处理步骤,以及在退火腔室内的气体组成。
在图3的情况中,因此在整个处理过程中气氛由纯氩构成。
并且初步净化已经允许从退火气氛排出污染物,该污染物在纯氩RTA之后可在表面粗糙度中产生差异。
然而,申请人已经判断出,在纯氩RTA之后可在表面粗糙度中产生差异的污染物可不仅仅是存在于退火腔室初步气氛中的元素,而且还可是甚至在将晶片引入退火腔室之前存在于晶片之上的元素。
实际上,申请人已经观察到,即使在纯氩RTA之前初步吹洗退火腔室,仍然能在处理的晶片上观察到粗糙度的一些差异。
为了清楚的目的,存在于晶片表面上并且在纯氩RTA之后可在表面粗糙度中产生差异的这些元素在这里被称为“初步污染物”。
这些初步污染物尤其可以是在晶片表面上的固有氧化物,或者其它污染物,例如碳氢化合物。
因此,本发明提供了在纯氩RTA之前的初步处理,其目的是消除与初步污染物相关的不想要的影响,并甚至比纯氩RTA更加改善表面粗糙度(尤其是关于均匀性)。
提出了这种初步处理的两个主要实施例。
这两个实施例的每一个对应于实施为纯氩RTA的单个退火。这些实施例提出了要与这种单个退火相关而实施的两个分别的初步处理。
这两个实施例可以作为替换而实现。它们还可以组合在一起。
根据初步处理的第一个实施例,退火腔室的初步吹洗和退火腔室内气氛的可控富集(enrichment)结合在一起。
该实施例描述在图4中。
在该第一个实施例中,在退火的初始阶段(图4的阶段4.1)中,不仅吹洗腔室,而且还用包括氩和可控比例的第二气体的可控气氛填充该腔室。
第二气体尤其可以是氢、HCl或者两者的混合。
在图4中,第二气体是氢(参见曲线下面的表格)。
“可控比例”通常在0.5和30%之间。
更精确地,如果第二气体是氢,则“可控比例”应当在0.5和30%之间。
如果第二气体是HCl,则“可控比例”应当在0.5和5%之间。
如果第二气体是氢和HCl的混合,则“可控比例”应当在0.5%和5至30%的百分比之间,依赖于第二气体的比率(氢/HCl)。
应当注意的是,注入有第二气体,则“初始”阶段4.1在时间上被限制在吹洗和温度初始升高——到大约750℃的预稳定温度(该温度对于发生平滑而言太低)。
该初始阶段4.1允许消除(或者至少明显减少)初步污染物。
在该实施例中,在RTA本身的相同一般操作中进行初步处理。
然而,应当注意的是,该初始阶段4.1不对应于预退火,因为温度非常低(低于400℃——并且有时甚至极其低,因为可在通常100和400℃之间的温度下进行该初始阶段)。阶段4.1是可控的吹洗阶段。
一旦已经到达了该预稳定温度,则改变腔室的气氛,以便于消除所有的第二气体,并具有用于斜坡上升到RTA温度(阶段4.2)和RTA本身(阶段4.3)的纯氩气氛。
RTA基本上与上面参考图3(阶段3.2)所述的相同。
最后,冷却阶段4.4结束该工艺,它类似于参考图3描述的阶段3.3。
在该实施例中,在初始阶段4.1中注入的第二气体有助于在初始阶段4.1中从晶片表面消除初步污染物(尤其是固有氧化物)。
已经经受这种初步处理的晶片然后可以经受纯氩RTA:不仅晶片表面的粗糙度显著降低,而且此外在晶片表面上该粗糙度将是均匀的。
通过下述的表格描述这一点,其显示出了对于两个SOI晶片(晶片1和晶片2)在纯氩RTA之后的表面粗糙度,并且是对于三种模式的粗糙度测量——从2×2μm2的扫描表面到40×40μm2的扫描表面。
AFM粗糙度(埃rms) | |||
2×2μm2 | 10×10μm2 | 40×40μm2 | |
晶片1:标准粗糙度区 | 1.5 | 5 | 7 |
晶片1:高粗糙度区(没有初步处理) | 6.2 | 11.7 | 13.7 |
晶片2:整个晶片表面 | 1.5 | 5 | 7 |
在该表格中,晶片1在纯氩RTA之前没有经历任何初步处理。
该晶片1的表面显示出两种不同的区:
●“标准粗糙度区”,具有保持在低水平的表面粗糙度,
●“高粗糙度区”,具有基本上较高的粗糙度。
图5a描述了在纯氩RTA之后在晶片表面上的粗糙度分布。图的上部分示出了晶片表面上的雾度的重新分配。
在图5a中描述的晶片50表示上述的“晶片1”,因为在纯氩RTA之前,它没有经受任何初步处理。
在图5a的下部分,柱状图概括了雾度值的分布(直接与粗糙度值有关)。
该图示出了粗糙度值广泛分布(从5到120ppm——参见柱状图)。
并且图的上部分显示出较高粗糙度区52,该区位于晶片的下中心部分。相反,区51在较低粗糙度区。
在图5a中描述的晶片由此与粗糙度的广泛分布相关,并与明显较高的粗糙度区相关。
上面表格的晶片2已经经历初步处理(根据上述的第一个实施例)。
该晶片描述在图5b中,其类似于图5a对于晶片1的描述。
可以看出的是,该晶片2不显示任何的“高粗糙度区”——在纯氩RTA之后,低表面粗糙度实际上均匀地分布在晶片上(特别参见图5b的下部分中的柱状图)。
因此初步处理是有利的,因为它显著增强了粗糙度的均匀性。
另外它还是方便的,因为它利用了在RTA之前必要的吹洗阶段。因此不需要附加的步骤。
根据初步处理的第二个实施例,在纯氩RTA之前,使晶片经受在化学清洗晶片表面的形式下进行的初步处理。
这里再一次,晶片尤其可以是(尽管这不是本发明范围的限制)SOI或者SGOI晶片。并且这可以通过Smart-Cut型工艺获得。
在将晶片引入退火腔室之前即刻进行清洗。
该清洗允许消除初始污染物。这改善了纯氩RTA之后所观察到的粗糙度——尤其是关于均匀性。
该清洗优选是RCA清洗,或者HF清洗。
RCA清洗包括两个连续的化学浴(chemical bathes)。
第一个浴在SC1溶液中(NH4OH和H2O2的水溶液)。
申请人已经发现,NH4OH和H2O2的浓度必须在1%和5%之间(分子量)。
更精确地,对于具有硅表面层的晶片(例如SOI)的初步处理,优选的浓度对于NH4OH是1%以及对于H2O2是2%。
然后第二个浴在SC2溶液中(HCl和H2O2的水溶液)。
申请人已经发现,HCl和H2O2的浓度必须在0.1%和5%之间(分子量)。
更精确地,对于具有硅表面层的晶片(例如SOI)的初步处理,优选的浓度对于HCl是1%以及对于H2O2是1%。
SC1和SC2浴的温度应当优选在20和80℃之间,对于具有硅表面层的晶片更优选70℃。
HF清洗将特别蚀刻可存在于晶片表面上的固有氧化物SiO2。
申请人已经发现,HF的浓度必须在0.1%和49%之间(分子量)。很好适合的HF浓度是20%。
HF浴优选应当在室温下(大约20℃)进行。
在两种情况中(RCA和HF清洗),清洗可以和冲洗步骤结合。然而,在HF清洗的情况中,在清洗之后优选不应进行冲洗。
如上所述,在该第二个主要实施例中,要被处理的晶片仍然尤其可以是SOI或者SGOI晶片。
应当注意的是,在具有SiGe中的表面层的晶片的情况中,在所述层中Ge的浓度优选应当不大于20%。
而且,一般来说(无论对于RCA还是对于HF清洗,或者对于其它可能类型的化学清洗),将设置在化学清洗形式下的初步处理的参数,以便于使得对于SGOI晶片比对于SOI晶片具有较小侵蚀性的清洗。
尤其通过下面而获得对于SGOI晶片的清洗的这种适应:
●采用更稀释的清洗试剂,和/或
●对于清洗,将温度设置为较低值。
上述的两个实施例允许对在WO 03/005434中公开的一般工艺进一步改善。
尤其是,通过这些实施例的其中一个所处理的晶片的表面粗糙度是:
●甚至进一步降低,以及
●更均匀地分布(尤其是,在晶片的中心区中观察不到较高粗糙度区)。
Claims (19)
1、一种用于降低半导体晶片自由面的粗糙度的工艺,所述工艺包括用于平滑所述自由面的单个退火步骤,所述单个退火步骤实施为纯氩气氛下的RTA,其特征在于,在RTA之前,进行晶片表面的化学清洗,以便于减少晶片上初步污染物的量。
2、根据前述权利要求的工艺,其特征在于,紧接在所述RTA之前进行所述化学清洗。
3、根据前述任一项权利要求的工艺,其特征在于,所述清洗是RCA清洗。
4、根据前述权利要求的工艺,其特征在于,RCA清洗包括后跟有SC2浴的SC1浴。
5、根据前述权利要求的工艺,其特征在于,对于SC1浴,NH4OH和H2O2的分子量浓度都在1%和5%之间。
6、根据前述权利要求的工艺,其特征在于,该晶片具有硅表面层以及NH4OH和H2O2的各自分子量浓度是l%和2%。
7、根据前述三项权利要求的其中之一的工艺,其特征在于,对于SC2浴,HCl和H2O2的分子量浓度都在0.1%和5%之间。
8、根据前述权利要求的工艺,其特征在于,该晶片具有硅表面层以及HCl和H2O2的各自分子量浓度都是1%。
9、根据前述五项权利要求的其中之一的工艺,其特征在于,SC1浴和SC2浴的温度在20和80℃之间。
10、根据前述权利要求的工艺,其特征在于,该晶片具有硅表面层并且SC1浴和SC2浴的温度是70℃。
11、根据权利要求2的工艺,其特征在于,所述清洗是HF清洗。
12、根据前述权利要求的工艺,其特征在于,对于HF浴,HF的分子量浓度在0.1%和49%之间。
13、根据前述权利要求的工艺,其特征在于,对于HF浴,HF的分子量浓度是20%。
14、根据前述任一项权利要求的工艺,其特征在于,在RTA之前,以受控方式吹洗退火环境的气氛,以便于建立包含混合有第二气体的氩的受控吹洗气氛,其中该第二气体可以是氢和/或HCl,从而允许进一步减少晶片上的初步污染物。
15、根据前述任一项权利要求的工艺,其特征在于,在1150到1230℃的温度进行在纯氩气氛中的所述RTA。
16、根据前述任一项权利要求的工艺,其特征在于,在1到30秒中进行在纯氩气氛中的所述RTA。
17、根据前述任一项权利要求的工艺,其特征在于,在通过Smart-Cut型工艺获得的晶片上进行该工艺。
18、根据前述任一项权利要求的工艺,其特征在于,在SOI晶片上进行该工艺。
19、根据权利要求1到16的任一项的工艺,其特征在于,在具有SiGe表面层的SGOI晶片上进行该工艺,该SiGe具有小于20%的Ge浓度。
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
PCT/IB2003/006351 WO2005055307A1 (en) | 2003-12-03 | 2003-12-03 | Process for improving the surface roughness of a semiconductor wafer |
Publications (2)
Publication Number | Publication Date |
---|---|
CN1879205A true CN1879205A (zh) | 2006-12-13 |
CN1879205B CN1879205B (zh) | 2010-12-01 |
Family
ID=34640308
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN2003801107824A Expired - Lifetime CN1879205B (zh) | 2003-12-03 | 2003-12-03 | 改善半导体晶片的表面粗糙度的工艺 |
Country Status (7)
Country | Link |
---|---|
EP (1) | EP1697981B9 (zh) |
JP (1) | JP4694372B2 (zh) |
CN (1) | CN1879205B (zh) |
AT (1) | ATE504941T1 (zh) |
AU (1) | AU2003296844A1 (zh) |
DE (1) | DE60336687D1 (zh) |
WO (1) | WO2005055307A1 (zh) |
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CN110504156A (zh) * | 2018-05-17 | 2019-11-26 | 美光科技公司 | 用于减少硅消耗的方法,形成半导体结构的方法,以及形成隔离结构的方法 |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP6927143B2 (ja) * | 2018-05-17 | 2021-08-25 | 信越半導体株式会社 | 貼り合わせsoiウェーハの製造方法 |
Family Cites Families (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
FR2681472B1 (fr) | 1991-09-18 | 1993-10-29 | Commissariat Energie Atomique | Procede de fabrication de films minces de materiau semiconducteur. |
US5571373A (en) * | 1994-05-18 | 1996-11-05 | Memc Electronic Materials, Inc. | Method of rough polishing semiconductor wafers to reduce surface roughness |
JP3575854B2 (ja) * | 1995-02-06 | 2004-10-13 | 信越半導体株式会社 | シリコン単結晶ウエーハの洗浄方法および洗浄装置 |
JP3518324B2 (ja) * | 1997-03-27 | 2004-04-12 | 信越半導体株式会社 | シリコンウエーハの熱処理方法およびシリコンウエーハ |
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JP2002043318A (ja) * | 2000-07-28 | 2002-02-08 | Shin Etsu Handotai Co Ltd | シリコン単結晶ウエーハの製造方法 |
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-
2003
- 2003-12-03 EP EP03819093A patent/EP1697981B9/en not_active Expired - Lifetime
- 2003-12-03 DE DE60336687T patent/DE60336687D1/de not_active Expired - Lifetime
- 2003-12-03 WO PCT/IB2003/006351 patent/WO2005055307A1/en active Application Filing
- 2003-12-03 AU AU2003296844A patent/AU2003296844A1/en not_active Abandoned
- 2003-12-03 JP JP2005511233A patent/JP4694372B2/ja not_active Expired - Lifetime
- 2003-12-03 AT AT03819093T patent/ATE504941T1/de not_active IP Right Cessation
- 2003-12-03 CN CN2003801107824A patent/CN1879205B/zh not_active Expired - Lifetime
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Publication number | Publication date |
---|---|
CN1879205B (zh) | 2010-12-01 |
WO2005055307A1 (en) | 2005-06-16 |
AU2003296844A1 (en) | 2005-06-24 |
DE60336687D1 (de) | 2011-05-19 |
EP1697981A1 (en) | 2006-09-06 |
JP4694372B2 (ja) | 2011-06-08 |
ATE504941T1 (de) | 2011-04-15 |
EP1697981B1 (en) | 2011-04-06 |
JP2007527604A (ja) | 2007-09-27 |
EP1697981B9 (en) | 2012-01-25 |
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Date | Code | Title | Description |
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C06 | Publication | ||
PB01 | Publication | ||
C10 | Entry into substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
C14 | Grant of patent or utility model | ||
GR01 | Patent grant | ||
C56 | Change in the name or address of the patentee |
Owner name: SUTAIKE INC. Free format text: FORMER NAME: SOITEC SILICON ON INSULATOR |
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CP01 | Change in the name or title of a patent holder |
Address after: French Bernini Patentee after: SOITEC Address before: French Bernini Patentee before: S.O.I.TEC SILICON ON INSULATOR TECHNOLOGIES |
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CX01 | Expiry of patent term |
Granted publication date: 20101201 |
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CX01 | Expiry of patent term |