CN1705971A - 显示器件及其驱动方法 - Google Patents

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Abstract

关于作为数字灰度表示方法的时间灰度方法，本发明的目的是提供一种防止帧频率降低以及实现一种低功耗的SRAM的显示器件。借助于利用其状态在一定时刻被读出的读出和写入信号，来选择二个存储器中哪一个要被有效地写入，从而使写入和读出同步，本发明克服了常规技术的上述缺点。

Description

显示器件及其驱动方法
技术领域
本发明涉及显示器件，更确切地说是涉及具有发光元件和存储器控制电路的显示器件。此存储器控制电路控制对诸如SRAM之类的存储器的写入和读出。
背景技术
以下解释一种显示器件，此显示器件在每个像素处设置发光元件，并借助于控制发光元件的发射而显示图像。
本说明书中通篇的解释采用这样一些元件(OLED元件)，其具有用来在产生电场时发光的有机化合物层被夹在发光元件的阳极与阴极之间的结构，但本发明不局限于这种结构。
而且，本说明书中的解释采用了利用从单重激发态到基态跃迁时发射的光(荧光)的元件，以及利用从三重激发态到基态跃迁时发射的光(磷光)的元件。
有机化合物层包括空穴注入层、空穴输运层、发光层、电子输运层、电子注入层等。发光元件的基本结构是阳极、发光层、以及阴极按此顺序的叠层。此基本结构可以被修正成阳极、空穴注入层、发光层、电子注入层、以及阴极按此顺序的叠层，或阳极、空穴注入层、空穴输运层、发光层、电子输运层、电子注入层、以及阴极按此顺序的叠层。
显示器件由显示器以及用来将信号输入到显示器的外围电路构成。
显示器的结构被示于图8的方框图中。
在图8中，显示器2000由源信号线驱动电路2107、栅信号线驱动电路2108、以及像素部分2109构成。像素部分具有设置成矩阵形状的像素。
薄膜晶体管(以下称为TFT)排列在每个像素中。下面来解释在每个像素中放置两个TFT以及对每个像素的发光元件所发射的光进行控制的方法。
图9示出了显示器件像素部分的结构。
源信号线S1-Sx、栅信号线G1-Gy、以及电源馈线V1-Vx被排列在像素部分2700中，且x列和y行(其中x和y是自然数)的像素也被置于像素部分中。每个像素2705具有开关TFT 2701、驱动TFT2702、储存电容器2703、以及发光元件2704。
像素由源信号线S1-Sx的其中一个源信号线S、栅信号线G1-Gy的其中一个栅信号线G、电源馈线V1-Vx的其中一个电源馈线V、开关TFT 2701、驱动TFT 2702、储存电容器2703、以及发光元件2704构成。
开关TFT 2701的栅电极被连接到栅信号线G，开关TFT 2701的源区或漏区被连接到源信号线S，而另一个被连接到驱动TFT 2702的栅电极以及储存电容器2703的一个电极。驱动TFT 2702的源区或漏区被连接到电源馈线V，而另一个被连接到发光元件2704的阳极或阴极。电源馈线V被连接到储存电容器2703两个电极之一，亦即在其上不连接驱动TFT 2702和开关TFT 2701的一侧上的电极。
在本说明书中，对于驱动TFT 2702的源区或漏区被连接到发光元件2704的阳极的情况，发光元件2704的阳极被称为像素电极，而发光元件2704的阴极被称为反电极。另一方面，若驱动TFT 2702的源区或漏区被连接到发光元件2704的阴极，则发光元件2704的阴极被称为像素电极，而发光元件2704的阳极被称为反电极。
而且，赋予电源馈线V的电位被称为电源电位，而赋予反电极的电位被称为反电位。
开关TFT 2701和驱动TFT 2702可以是p沟道TFT或n沟道TFT。但对于发光元件2704的像素电极是阳极的的情况，驱动TFT 2702优选为p沟道TFT，且开关TFT 2701优选为n沟道TFT。相反，若像素电极是阴极，则驱动TFT 2702优选为n沟道TFT，且开关TFT 2701优选为p沟道TFT。
下面来解释用上述像素结构显示图像时的操作。
信号被输入到栅信号线G，开关TFT 2701的栅电极电位改变，栅电压于是改变。经由已经被置于导通状态的开关TFT 2701的源和漏，信号被源信号线S输入到驱动TFT 2702的栅电极。而且，信号被储存在储存电容器2703中。驱动TFT 2702的栅电压根据输入到驱动TFT 2702栅电极的信号而改变，源和漏于是被置于导通状态。电源馈线V的电位通过驱动TFT 2702被赋予给发光元件2704的像素电极。发光元件2704于是发光。
下面解释利用这种结构的像素来表示灰度的方法。灰度表示方法可以粗略地分成模拟方法和数字方法。与模拟方法相比，数字方法具有对于TFT的变型优异的优点。这里关注数字灰度表示方法。时间灰度方法可以提供为数字灰度表示方法。下面来详细地解释时间灰度驱动方法。
时间灰度驱动方法是一种借助于控制显示器件的每个像素发光的周期而表示灰度的方法。若将显示一个图像的周期采取作为一个帧周期，则一个帧周期被分成多个子帧周期。
对于每个子帧周期，执行导通和关断，亦即使每个像素的发光元件发光或不发光。对发光元件在一个帧周期中发光的周期进行控制，从而表示每个像素的灰度。
用图10A和10B的时序图来解释时间灰度驱动方法。注意，图10A和10B示出了采用4位数字图像信号来表示灰度的例子。还注意到，图9可以分别参考用于像素部分的结构和像素的结构。根据外部电源(图中未示出)，反电位可以在与电源馈线V1-Vx的电位(电源电位)相同量级的电位、和足以使发光元件2704发光的量级上的电源馈线V1-Vx的电位差之间被转换。
一个帧周期F被分成多个子帧周期SF1-SF4。栅信号线G1在第一子帧周期SF1中首先被选中，数字图像信号从源信号线S1-Sx被输入到具有其栅电极连接到栅信号线G 1的开关TFT 2701的每个像素。每个像素的驱动TFT 2702通过所输入的数字图像信号置于导通状态或关断状态。
在本说明书中，术语TFT的“导通状态”表示此TFT处于这样一种状态，其中根据栅电压而在源和漏之间存在导通的状态。而且，术语TFT的“关断状态”表示根据栅电压而在源和漏之间存在不导通的状态。
此时，发光元件2704的反电位被设定为几乎等于电源馈线V1-Vx的电位(电源电位)，因此，即使每个像素的驱动TFT 2702处于导通状态，发光元件2704也不发光。上述的操作对所有的栅信号线G1-Gx重复，从而完成写入周期Ta1。注意，第一子帧周期SF1中的写入周期被称为Ta1。通常，第j子帧周期的写入周期(其中j是自然数)被称为Taj。
当写入周期Ta1完成时，反电位改变，以便具有在量级上与电源电位不同的电位差，从而使发光元件2704发光。于是开始显示周期Ts1。注意，第一子帧周期SF1的显示周期被称为Ts1。通常，第j子帧周期(其中j是自然数)的显示周期用参考符号Tsj来表示。在显示周期Ts1中，对应于输入信号，每个像素的发光元件2704处于发光状态或不发光状态。
上述的操作对所有的子帧周期SF1-SF4重复，从而完成一个帧周期F1。此处，适当地设定子帧周期SF1-SF4的显示周期Ts1-Ts4的长度，由发光元件2704在其间发光的子帧周期的显示周期的累积来表示灰度。换言之，一个帧周期内的导通时间的总量用来表示灰度。
下面来解释借助于输入n位数字视频信号而一般地表示2n个灰度的方法。例如，此时一个帧周期被分成n个子帧周期SF1-SFn，且子帧周期SF1-SFn的显示周期Ts1-Tsn的长度比率被设定为Ts1∶Ts2∶…∶Tsn＝20∶2-1∶…∶2-n+2∶2-n+1。注意，写入周期Ta1-Tan的长度都是相同的。
在一个帧周期中，借助于找到在其间在发光元件2704中选择发光状态的总显示周期Ts，来确定一个帧周期中像素的灰度。例如n＝8时，若对于其中像素在所有显示周期中发光的情况，亮度被取为100％，则若像素在显示周期Ts8和显示周期Ts7中发光，可以表示1％的亮度。对于像素在显示周期Ts6、Ts4、以及Ts1中发光的情况，可以表示60％的亮度。
为了以上述这样的时间灰度方法进行显示，需要一种转换信号的电路。图2示出了常规的控制电路示意图。控制电路200由用来存储数据的存储器A201和B202、用来读出数据和将数据写入到存储器中的逻辑电路(W-LOGIC 203)、以及用来读出存储器并输出数据的逻辑电路(R-LOGIC 204)构成。
图3示出了常规控制电路的时序图。利用存储器A201和B202，数据被交替地写入和读出，以便使数字信号输入到W-LOGIC 203与时间灰度方法同步。
当R-LOGIC 204读出存储器A201中的信号时，下一帧周期的数字视频信号通过W-LOGIC 203被输入到存储器B202，并开始被储存。
以这种方式，控制电路200包括了每个都能够储存一个帧周期的数字视频信号的存储器A201和B202，以便用它们交替地取样数字视频信号。
然而，通常在写入到存储器A201和B202之后直至出现下一个读出信号才具有等待状态。存储器A201和B202的写入和读出之间的转换功能以花费更多时间的读取的时序而进行操作(图3)。
发明内容
在常规方法中，读出的时间设定得比写入的时间更长得多。因此，对于按需要发生写入、并在读出之后转换操作功能的方法不存在问题。
但有一个问题。在存储器读出时间与写入时间之间的差别很小的驱动方法中，在写入后直至完成读出时才具有等待状态的常规方法将对存储器写入的时刻向后拉。因此，帧频率降低了。
为了解决相关技术的上述问题，本发明采取了下面的方法。亦即，利用在一定时刻读取读出信号状态和写入信号的状态，获得了同步化，并通过此信号来确定二个存储器中哪一个要被写入。
亦即，利用一种显示器件，此显示器件具有：
储存数据的第一存储器和第二存储器；
对第一存储器和第二存储器读出数据和写入的写入装置；
从第一存储器或第二存储器中读出数据并输出数据的读出装置；
根据写入装置和读出装置的状态而决定对第一存储器和第二存储器的写入和读出作用的装置；以及
选择对第一存储器和第二存储器的写入和读出的第一存储器选择器和第二存储器选择器；
写入装置和读出装置可以被同步，以便解决此问题。
作为根据写入装置和读出装置的状态来决定对第一存储器和第二存储器的写入和读出作用的一种装置，显示器件提供了一种电路，其中：
写入装置的状态由第一信号表示，而读出装置的状态由第二信号表示；
第三信号决定对第一存储器和第二存储器的写入和读出作用，且当第一和第二信号进入第二状态时进行反转，以便转换第一和第二存储器的作用；
第四信号保持第三信号；
所述第一和第二存储器被分别提供写入和读出作用；
第一信号被输入到读出装置，而第二信号被输入到写入装置；
当写入装置处于写入状态时，第一信号和第二信号进入第一状态，因此，第三信号不被反转，且第四信号重写第三信号的状态；
当写入装置处于写入状态时，第一信号进入第二状态，且第二信号也进入第二状态，以反转第三信号，因此，两个存储器的写入和读出作用被转换。第二信号于是再次回到第一状态。第四信号与第三信号进行比较，且第一信号的状态在第三信号的状态改变时被返回到第一状态，写入装置开始写入。
于是，读出装置和写入装置不仅可以是FPGA，而且可以是LSI。而且，它们可以构成在与显示器件同一个衬底上。
这样，即使当对存储器的读出和写入时间之间存在很小的差异时，也能够在最佳周期内转换操作功能。于是能够解决帧频率降低的问题。
附图说明
图1是本发明的方框图。
图2是常规实例的方框图。
图3是常规实例操作的时序图。
图4是本发明操作的时序图。
图5是本发明操作的时序图。
图6示出了采用本发明的一个实施方案的示意图。
图7示出了采用本发明的显示器件的一个实例的示意图。
图8是常规实例的方框图。
图9是设置成矩阵形状的像素的电路图。
图10A和10B是常规实例操作的时序图。
图11示出了采用本发明的显示器件的一个实例。
图12A-12G示出了采用本发明的电子装置的示意图。
图13示出了采用本发明的显示器件的一个实例。
具体实施方式
实施方案模式
图1示出了本发明主要结构的方框图。
控制电路100具有存储器A101和B102、用来写入存储器的选择器103、用来输出的选择器104、用来写入到存储器中的逻辑电路(W-LOGIC 105)、以及用来读出存储器并输出数据的逻辑电路(R-LOGIC 106)。当视频数据被输入到W-LOGIC 105时，其就将数据写入由用来写入存储器的选择器103选择的存储器A101或B102。然后，选择器104选择未被选择器103选择的其它存储器作为R-LOGIC106要读出的存储器。
信号SYNC、WFLAG、RFLAG、以及RAM_SELECT以新的方式用来实现同步。W-LOGIC 105将写入状态WFLAG输入到R-LOGIC 106，且按需要从存储器中读出状态RFLAG被输入到W-LOGIC 105。RAM_SELECT根据WFLAG和RFLAG每一个的状态而选择存储器来写入。R-LOGIC 106保持RAM_SELECT，并在输入SYNC时与存储器的RAM_SELECT进行比较。
在图1的结构中，R-LOGIC 106特别地保持RAM_SELECT，但W-LOGIC 105也可以保持RAM_SELECT。
图4示出了W-LOGIC 105和R-LOGIC 106的操作时序图。
当W-LOGIC 105处于写入状态时，WFLAG为低，且当低的WFLAG被输入到R-LOGIC 106时，RFLAG也变成低。
当W-LOGIC 105处于等待状态时，WFLAG为高，且当高的WFLAG被输入到R-LOGIC 106时，RFLAG也变成高。当WFLAG和RFLAG都为高、且R-LOGIC 106完成了从由用于输出的选择器104所选择的存储器中读出数据时，RFLAG变成低。在RFLAG变成低的时刻，RAM_SELECT反转，且由选择器103和104选择的存储器发生切换。
当SYNC被输入时，此时的RAM_SELECT与储存在R-LOGIC 106中的RAM_SELECT进行比较。在等待周期中，RAM_SELECT被反转，当反转的RAM_SELECT的状态不同于储存在R-LOGIC 106中的RAM_SELECT时，WFLAG变成低，且W-LOGIC 105再次变成写入状态。
在图5中，示出了有关同步化的时序图以及写入和读出的时序图。当SYNC被输入时，R-LOGIC 106写入RAM_SELECT的状态。在写入(WFLAG为低)周期中，新的RAM_SELECT状态被重写，且在等待(WFLAG为高)周期中，状态被保持。
而且，当在等待周期中被反转的RAM_SELECT的状态不同于储存在R-LOGIC 106中的RAM_SELECT时，WFLAG变成低，W-LOGIC 105再次变成写入状态。
由于在RAM_SELECT被反转时RFLAG为低，故此时写入和读出能够被同步。
实施方案1
在本实施方案中，参照图6来解释输出到采用OLED元件进行显示的显示器的控制电路的构造示例。
18位(6位×RGB)的视频数据和控制信号被输入到控制电路601。描述了从视频数据的输入到向显示器608输出的操作。
每个线的读出由VCLK控制(周期为148.8μs)。首先，视频数据的输入由输入SYNC信号开始。在输入SYNC信号并经过一定的关断时间段之后，开始将视频数据输入到W-LOGIC 602。每半个VCLK周期读取一行视频数据。在输入220行并经过一定关断时间段之后，再次输入SYNC信号，且输入视频数据。整页的输入周期为18.1536ms(122个VCLK周期)。
对一行中的每个块的读出是由HCLK控制的(周期为400ns)。在视频使能为高期间，HCLK读出视频数据。在读出一行之后，更具体地说，176个数据块，并经过一定的关断时间段(视频使能为低)之后，再读出下一行视频数据。借助于对220行重复这一过程，就完成了一屏的数据。
另一方面，存储器A606和存储器B607被连接到控制电路601，且来自控制电路601的信号RAM_SELECT决定哪一个存储器被写入和读出。每个存储器由24(8×3)个触发器构成。每个触发器能够在一定时刻储存一种颜色的数据(6位)。数据相继地被HCLK移动到下一个触发器。当存储器具有8个数据块时，根据RAM_SELECT的值，一个存储器被选择来写入，另一存储器被选择来读出数据。在完成读出数据和接收数据的周期之后，RAM_SELECT被切换。
由于显示器608上的显示是由时间灰度(time gradation)来完成的，故写入到存储器A606或存储器B607的数据被改变其输出到显示器的顺序，并随后输出到显示器608。R-LOGIC 603提取8个数据块到存储器A606和存储器B607中，随后按该顺序读出1-4块的第一周期、5-8块的第一周期、1-4块的第二周期、5-8块的第二周期、...、直至第六周期，并将它们输出到显示器608。
在显示器608上进行显示时，视频数据按12位(4×RGB)被处理。G1_CK、G2_CK、G1_CKB、G2_CKB是其周期各为12μs的时钟。在G1_CK和G1_CKB上升或下降的时刻，被输入视频数据的行发生移动。
在G1_SP下降之后的2个周期之后，写入从顶行开始顺序执行。写入220行构成了一屏的显示，但获得4个虚设周期(48μs)以便在显示下一图像之前延迟写入。如有需要，在清除写入时G2_SP被上升。
S_CK和S_CKB是周期各为200ns的时钟。在S_CK和S_CKB上升或下降的时刻，被输入视频数据的块发生移动。在G1_CLK上升或下降之后的4个周期(800ns)之后，S_LAT变成高，从而保持电荷，然后，当S_SP从高改变到低时，开始输入视频数据。由于每4个块完成输入，重复其44次就完成了一行的写入。
从振荡元件609通过PLL 610输入时钟获得了W-LOGIC 602与R-LOGIC 603之间的同步。通过PLL 610利用时钟的升高和降低，来控制对存储器A606和存储器B607写入和读出的时序。
已知的LSI以及FPGA可以被用于W-LOGIC 602和R-LOGIC 603。
本发明被用于W-LOGIC 602、R-LOGIC 603、存储器A606、存储器B607、以及选择存储器的选择器604和605。
实施方案2
在图7中，示出了具有本实施方案1的控制电路的采用OLED元件的显示器件的实例。
显示器件由平板700、控制电路701、源信号线驱动电路702、栅信号线驱动电路703和704、显示部分705、SRAM 706、FPC 707、以及连接器708构成。显示器件的每个电路形成在平板700上，或外部地附着。
现在来描述显示器件的工作。从FPC 707经过连接器708发送的数据和控制信号被输入到控制电路701，并且数据在SRAM 706中被重新安排以便输出，然后再次发送到控制电路701。控制电路701将用于数据和显示的信号发送到源信号线驱动电路702以及栅信号线驱动电路703和704，然后在采用OLED元件的显示部分705处显示图像。
源信号线驱动电路702以及栅信号线驱动电路703和704可以用已知的电路来代替。而且，根据电路的结构，栅信号线驱动电路可以减少到一个。
本发明应用于控制电路701。
实施方案3
在本实施方案中，在图13中描述了具有实施方案1的控制电路的采用OLED元件的显示器件的实例，其不同于实施方案2。
平板900由控制电路901、源信号线驱动电路902、栅信号线驱动电路903和904、显示部分905、SRAM 906、FPC 907、以及连接器908构成。显示器件的每个电路形成在平板900上或外部地附着。
现在来描述显示器件的工作。从FPC 907经连接器908发送的数据和控制信号被输入到控制电路901，且其数据被返回到FPC 907中的SRAM 906，然后被重新安排以便输出，并再次被发送到控制电路901。控制电路901将用于数据和显示的信号发送到源信号线驱动电路902以及栅信号线驱动电路903和904，然后在采用OLED元件的显示部分905处进行图像的显示。
与实施方案2的不同之处在于，SRAM 906被结合到了FPC 907中。显示器件从而能够被做得更小。
如实施方案2那样，源信号线驱动电路902以及栅信号线驱动电路903和904可以由已知的电路代替。而且，根据电路的结构，栅信号线驱动电路可以减少到一个。
本发明应用于控制电路901。
实施方案4
在本实施方案中，参照图11描述了结构不同于实施方案1到3的用来输出到采用OLED元件的显示器的控制电路的实例。
与模拟显示器相比，时间灰度法显示自然获得了更高的工作频率。为了达到高的图像质量，需要避免伪轮廓(pseudocontour)，且子帧需要增加到10个或以上。因此，工作频率也需要为10倍或以上。
为了以这样的工作频率来驱动器件，SRAM需要采用高速工作的SRAM-IC而高速工作。
但高速工作的SRAM在存储时消耗相当大的功率，致使其不适合于移动设备。为了采用低功耗的SRAM，需要进一步降低频率。
如图11所示，构造了串行-并行转换电路1702，此转换电路在将数字图像信号写入到SRAM 1703和1704之前，将数据从串行改变成并行。然后通过开关1706来进行写入。
借助于采取这种措施，能够以低的频率进行并行调用。因此，能够以低的频率使用低功耗SRAM来达到移动设备的低功耗。
实施方案5
本发明可以应用于各种电子装置，例如摄像机、数码相机、目镜式显示器(头戴显示器)、导航系统、声音再现装置(汽车音响、音频元件等)、膝上个人计算机、游戏机、个人数字助理(移动计算机、移动电话、便携式游戏机、或数字书等)、具有记录媒质的图像再现装置(具体地说是具有放映诸如数字万能碟盘(DVD)之类的记录媒质以及显示图像的的显示器的装置)等。图12示出了这些电子装置的例子。
图12(A)示出了一种液晶显示器或OLED显示器，它由机箱1001、支座1002、显示部分1003等构成。本发明能够应用于具有显示部分1003的显示器件的驱动电路。
图12(B)示出了一种摄像机，它由主体1011、显示部分1012、音频输入部分1013、操作开关1014、电池1015、图像接收部分等构成。本发明能够应用于具有显示部分1012的显示器件的驱动电路。
图12(C)示出了一种膝上个人计算机，它由主体1021、机箱1022、显示部分1023、键盘1024等构成。本发明能够应用于具有显示部分1023的显示器件的驱动电路。
图12(D)示出了一种个人数字助理，它由主体1031、触屏笔1032、显示部分1033、操作按钮1034、外部接口1035等构成。本发明能够应用于具有显示部分1033的显示器件的驱动电路。
图12(E)示出了一种音频再现装置，特别是一种安装在机动车辆中的音响装置，它由主体1041、显示部分1042、操作开关1043和1044等构成。本发明能够应用于包括显示部分1042的显示器件的驱动电路。而且，除了安装在机动车辆中的上述音响装置之外，本发明还能够应用于任何便携式或家用音响装置。
图12(F)示出了一种数码相机，它由主体1051、显示部分(A)1052、目镜部分1053、操作开关1054、显示部分(B)1055、电池1056等构成。本发明能够应用于具有显示部分(A)1052和(B)1055的显示器件的驱动电路。
图12(G)示出了一种移动电话，它由主体1061、音频输出部分1062、音频输入部分1063、显示部分1064、操作开关1065、天线1066等构成。本发明能够应用于具有显示部分1064的显示器件的驱动电路。
除了玻璃衬底之外，具有高抗热性的塑料衬底也能够应用于这些电子装置的显示器件。从而能够获得重量的进一步降低。
要指出的是，本实施方案的上述各种装置仅仅是一些例子，本发明不是排他性地应用于这些装置。
本实施方案能够与实施方案模式以及实施方案1-4中任何一个自由地组合。
在具有发光元件的显示器件的情况下，借助于利用本发明的控制电路来有效地转换写入和读出，能够防止帧频率的降低。

Claims (16)

1.一种显示器件的驱动方法，此显示器件具有发光元件并用发光时间的长度来表示灰度，
所述显示器件包含：
控制电路，它包含第一到第四信号、第一和第二存储器、以及读出装置和写入装置，
其中，所述第一信号表明所述写入装置的状态，
所述第二信号表明所述读出装置的状态，
所述第三信号选择是对所述第一存储器还是对第二存储器写入和读出的作用，且当所述第一信号和所述第二信号变成第二状态时，转换所述第一信号和所述第二信号的作用，
所述第四信号保持所述第三信号，以及
所述第一和第二存储器分别被赋予写入和读出的作用，
其中，所述第一信号被输入到所述读出装置，而所述第二信号被输入到所述写入装置，
当所述写入装置处于写入操作时，所述第一信号和所述第二信号处于第一状态，因此，所述第三信号不反转，且所述第四信号重写所述第三信号的状态，
当所述写入装置处于等待状态时，所述第一信号变成第二状态，且所述第二信号也变成第二状态以反转所述第三信号，所述第一和第二存储器的作用被转换，且所述第二信号再次回到第一状态，
所述第四信号与所述第三信号比较，且当所述第三信号的状态改变时，所述第一信号的状态返回到第一状态，所述写入装置从而开始写入，且
利用上述一系列操作，读出装置和写入装置被同步。
2.一种显示器件，它具有发光元件并用发光时间的长度来表示灰度，
所述显示器件包含：
控制电路，它对提供的数据进行转换，以便用时间灰度法来进行显示，
其中，所述控制电路包含：
用来储存所述数据的第一和第二存储器；
用来读出所述数据以及将所述数据写入到所述第一存储器或所述第二存储器的写入装置；
用来从所述第一存储器或所述第二存储器中读出所述数据以便输出所述数据的读出装置；
用来根据所述写入装置和所述读出装置的状态，而决定对所述第一存储器和所述第二存储器的写入和读出作用的装置；以及
用来选择对所述第一存储器和所述第二存储器的写入和读出的第一存储器选择器和第二存储器选择器，
其中，所述写入装置和所述读出装置从而被同步。
3.根据权利要求2的显示器件，
其中，所述存储器、所述存储器选择器、所述读出装置、以及所述写入装置一起形成在显示部分和衬底上。
4.根据权利要求2的显示器件，
其中，所述存储器实现在FPC上。
5.根据权利要求2的显示器件，
其中，所述存储器实现在衬底上。
6.一种包含权利要求2的显示器件的电子装置。
7.一种显示器件，它具有发光元件并用发光时间的长度来表示灰度，
所述显示器件包含：
控制电路，它将提供的数据转换成信号，以便用时间灰度法来进行显示，
其中，所述控制电路包含：
用来储存所述数据的第一和第二存储器；
用来读出所述数据以及将所述数据写入到所述第一存储器或所述第二存储器的写入装置；
用来从所述第一存储器或所述第二存储器中读出所述数据以便输出所述数据的读出装置；
用来根据所述写入装置和所述读出装置的状态，而决定对所述第一存储器和所述第二存储器的写入和读出作用的装置；以及
用来选择对所述第一存储器和所述第二存储器的写入和读出的写入存储器选择器和输出存储器选择器，
其中，用来决定对所述存储器的写入和读出作用的所述装置包含：
一种电路，其在所述写入装置完成写入到由所述写入选择器所选择的所述第一存储器或所述第二存储器中、以及所述读出装置完成从由所述输出选择器所选择的所述第一存储器或所述第二存储器中读出的时刻，用来转换由所述写入存储器选择器和所述输出存储器选择器所选择的所述第一存储器和所述第二存储器；以及
一种电路，其除了在所述写入装置完成从所述输出存储器选择器所选择的所述第一或第二存储器中读出之外，还在所述写入装置完成写入到由所述写入选择器所选择的所述第一或第二存储器中的时刻，用来识别由所述输出存储器选择器所选择的所述第一还是第二存储器被转换，且当所述第一和第二存储器被所述写入和输出存储器选择器转换时，使所述写入装置进入写入状态，
其中，所述写入装置和所述读出装置从而被同步。
8.根据权利要求7的显示器件，
其中，所述存储器、所述存储器选择器、所述读出装置、以及所述写入装置一起形成在显示部分和衬底上。
9.根据权利要求7的显示器件，
其中，所述存储器实现在FPC上。
10.根据权利要求7的显示器件，
其中，所述存储器实现在衬底上。
11.一种包含权利要求7的显示器件的电子装置。
12.一种显示器件，它具有发光元件并用发光时间的长度来表示灰度，
所述显示器件包含：
第一和第二存储器；
用来将视频信号从串行转换到并行的转换电路；以及
第一开关和第二开关，
其中，视频信号在被所述转换电路转换到并行之后，通过所述第一开关被输入到所述第一存储器或所述第二存储器，且
所述第一存储器或所述第二存储器的输出信号，通过所述第二开关被输入到显示器。
13.根据权利要求12的显示器件，
其中，所述存储器实现在FPC上。
14.根据权利要求12的显示器件，
其中，所述存储器实现在衬底上。
15.一种包含权利要求12的显示器件的电子装置。
16.一种显示器件的驱动方法，此显示器件包含：
控制电路，包含：
第一存储器；
第二存储器，其中所述第一和第二存储器分别被赋予写入和读出的作用；
写入装置，其中第一信号包括关于所述写入装置的状态的信息；以及
读出装置，其中第二信号包括关于所述读出装置的状态的信息，
其中，当所述写入装置处于写入操作时，所述第一信号和所述第二信号处于第一状态，且
当所述写入装置处于等待状态时，所述第一信号变成第二状态，且所述第二信号也变成第二状态，致使所述第一和第二存储器的作用被转换，且所述第二信号再次回到第一状态，且所述第一信号的状态返回到第一状态，所述写入装置开始写入。
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