CN1286080C - 显示装置及其驱动方法和显示驱动电路的控制装置 - Google Patents

显示装置及其驱动方法和显示驱动电路的控制装置 Download PDF

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Abstract

本发明的显示装置中，定时控制器ASIC利用源极驱动器开始输出显示数据前存在的期间，以数据启用信号ENAB的输入开始时刻为基准生成栅极启动脉冲信号GSP和栅极时钟信号GCK的第1脉冲CK1。将它们输入到栅极驱动器驱动虚设行线G0。

Description

显示装置及其驱动方法和显示驱动电路的控制装置
发明领域
本发明涉及矩阵型显示装置的驱动。
背景技术
作为矩阵型的显示装置，具备形成TFT(薄膜晶体管)的有源矩阵基板和用于驱动所述TFT的驱动IC(集成电路)的液晶显示装置已广为所知。
图18示出TFT有源矩阵方式的液晶显示装置101的构成。液晶显示装置101中设有栅极驱动器102作为矩阵的行驱动电路，设有源极驱动器103作为列驱动电路。
在透明的基板上，各多条的、由栅极驱动器102驱动的栅极线Gn、Gn+1、…(统称时下面用符号G表示)与由源极驱动器103驱动的源极线Sn、Sn+1、…(统称时以下用符号S表示)相互正交地形成。而且在各栅极线G与各源极线S交叉的各处形成像素PIX。像素PIX具备TFT 104、液晶105、以及辅助电容106。此外，由栅极线G与源极线S分隔的区域中，形成液晶105和辅助电容106一方的电极构成的像素电极107(参看图19)，该像素电极107连接到TFT 104的漏极。第n行、第n列的像素PIX中，所述TFT 104的源电极连接到第n列的源极线Sn，栅电极连接到第n行的栅极线Gn。
在如此形成各像素PIX的液晶显示装置101中，如从栅极线G与像素电极107的关系来看，可见图18的液晶显示装置101其第n行栅极线Gn配置于第n行的像素电极107的下侧，是所谓下栅极构造的液晶显示装置。在所述像素电极107与栅极线Gn、Gn-1之间，形成如图19所示的各寄生电容Cgd1、Cgd2。这里，如考虑第1行的像素，可知并未形成对应于所述第n行像素的栅极线Gn-1的栅极线G0，不形成所述寄生电容Cgd2。图18在第1行(G1行)的像素与第2行以后(Gn(n≠1))的像素上示出形成这些寄生电容Cgd1、Cdg2时的等效电路的差异。
另一方面，如图20所示，向栅极线依次加上振幅为Vgpp的栅极信号，用该栅极信号改变TFT 104的漏极电平。也就是说，在第n行的像素PIX上，栅极线Gn-1的栅极信号通过寄生电容Cgd2使TFT 104的漏极电平仅改变ΔV2，栅极线Gn的栅极信号通过寄生电容Cgd1使TFT 104的漏极电平仅改变ΔV1。
以C1c表示像素PIX的液晶电容量，Ccs表示辅助电容量时，则所述ΔV2、ΔV1可表示为：
ΔV1＝Vgpp×{Cgd1/(C1c+Ccs+Cgd1+Cgd2)}，
ΔV2＝Vgpp×{Cgd2/(C1c+Ccs+Cgd1+Cgd2)}。
而且，由本级的栅极线Gn的栅极信号引起的ΔV1对TFT 104的漏极电平的振幅的中心Vcom起作用，使其比源极信号的振幅的中心Vsc低ΔV1。而由前级的栅极线Gn-1的栅极信号引起的ΔV2起到增加对液晶105的施加电压的有效值的作用。
在第1行像素PIX中由于不存在上述那样形成寄存电容Cgd2的前级的栅极线G0，故不发生所述ΔV2，仅使该第1行像素对液晶105所加电压的有效值比其他行低。因该有效值差，在该ΔV2大的情况下，一旦在高温或低温等状态，显示装置的驱动条件恶化，就会发生这样的问题，即只有该第1行像素PIX与其他像素PIX相比亮度有改变，能够看到。例如作为正常白液晶的情况下，该第1行变成亮线。
为解决上述问题，在例如美国专利第5867139号(1999年2月2日公布)及日本专利公开公报平8-43793号(1996年2月16日公布)中记载了这样的结构，即对于下栅极构造的面板，在接近第1行像素而在有效显示区域之外形成补偿该第1行像素与其余像素之间的上述非对称用的虚设(dummy)行线G0。所述栅极线G1～Gm用来自输出端子OG 1～OG m的栅极信号分别驱动的同时，所增加的虚设行线G0与最后第m行的栅极线Gm并联连接同时驱动。以下将它作为现有技术1。
图21示出根据现有技术1的栅极驱动器102的构成例。这种情况的栅极驱动器102是用TAB(带自动粘接)方式装载在TCP(带载体组件)111上的驱动器IC 112多个串接连接。栅极驱动器102连接形成像素PIX…、栅极线G…、以及源极线S…的液晶板113与印刷电路板114。各驱动器IC 112具有端子OG 1～OG 256的256个输出端，图中示出该驱动器IC 112 3个相连接时的结构。
各驱动器IC 112，通过印刷电路板114将栅极启动脉冲信号GSP输入到端子GSPin，将栅极时钟信号GCK输入到端子GCKin。各驱动器IC 112中经内部的移位寄存器移位的栅极启动脉冲信号GSP从端子GSPout输出，经由印刷电路板114输入到次级的驱动器IC 112的端子GSPin。而且从最后一级的驱动器IC 112的最后线的端子OG 256不仅输出到栅极线G。还通过印刷电路板114引线回到液晶板113的最上一级。该被引到最上一级的配线是虚设线G0。利用这样的结构，形成虚设线G0以及栅线G1～G768。
图22示出图21的栅极驱动器102的信号时间图。由栅极时钟信号GCK的定时移位栅极启动脉冲信号GSP，在移位过程中依次从端子OG 1、端OG 2、…、端子OG 256输出栅极信号到栅极线G。当从某一驱动器112的端子OG 256栅极信号时，从端子GSPout输出栅极启动信号GSP，输入到下一级驱动器IC112的端子GSPin。
然而，在该现有技术1中，仅驱动最后的第m线的栅极线Gm的输出端子OGm的驱动器电路负荷大致成为2倍，存在栅极信号波形变弱的问题。又，为了图21中经由印刷电路板114布线，要连接虚设线Go与栅极线Gm的旁路线，也存在液晶板113或软性印刷电路板的构造变得复杂的问题。特别是如今为了液晶显示装置的低成本化、轻量化、薄型化，不用栅极侧的印刷电路板、软性印刷电路板和连接器等，而采用在液晶板上及栅极驱动器TCP上构成栅极驱动器侧的电源线、信号线的构造(以下称作栅极基板省略构造)。这种构造中通过从源极驱动器侧利用单层构造的布线图案形成输入到栅极驱动器的电源配线与信号配线。因此，存在不能确保如图21那样从最后第m线到虚设线G0引回布线的空间的问题。
另外，如图23所示，开发出增加输出端子数目的栅极驱动器IC，使可单独驱动所述虚设线G0，解决了上述问题。将它作为现有技术2。图23的构成例中，各TCP 121的驱动器IC 122具备比图21的驱动IC 112更多的端子OG 0～OG 257。各级的驱动器IC 122中将端子OG1-OG 256分别作为栅极线G。然而在第1级的IC 122中虚设线G0连接到端子OG0。第2级及第3级的驱动器IC122中不用端子OG 0、OG 257。栅极启动脉冲信号GSP及栅极时钟信号GCK经由印刷电路板124输入，由于使从驱动器IC 122的端子OG 0驱动虚设线G0，故不必从最后一级的驱动器IC 122经由印刷电路板124向液晶板123的最上一级引回虚设线G0用的布线。
图24示出图23的栅极驱动器102的信号时间图。最初栅极信号输出至端子OG0，栅极启动脉冲信号GSP依次被移位。从端子OG 256输出栅极信号后，栅极启动脉冲信号GSP被输入下一级的驱动器IC 122。然后从该驱动器IC的端子OG1输出栅极信号。
该现有技术2，如图25所示不使用图24那样的印刷电路板124，也可适用于仅经由TCP 121及液晶板123形成向驱动器IC 122的布线的栅极基板省略型构造。在这种情况下，由于不必引回虚设线G0用的布线，故用这种构造实现栅极基板省略型构造的液晶显示装置，实现批量生产。
然而在现有技术2中，必须将驱动虚设线G0用的输出用栅极启动脉冲信号GSP输入到栅极驱动器102。这一输入必须在生成控制栅极驱动器102及源极驱动器103的驱动用的信号的定时控制器ASIC输入输入数据信号DATA-in及数据启用信号ENAB之前进行。
利用定时控制器ASIC的控制方法，有利用垂直同步信号及水平同步信号的定时控制方式(以下称HV模式)与不用垂直同步信号及水平同步信号而仅用数据启用信号ENAB控制定时的方式(以下称V-ENAB模式)。以下用图26(a)～图26(f)及图27(a)～图27(f)说明HV模式与V-ENAB模式。
首先用图26(a)～图26(f)的时间图说明HV模式。
图26(a)示出输入到定时控制器ASIC的水平驱动用信号。这里示出1个水平期间的信号的定时。用时钟信号Ck的输入开始时刻，从水平同步信号Hs的输入起的第296个时钟数据启用信号ENAB上升，输入1个水平期间份额的数据D1、D2、…、D1024。又，图26(b)示出输入到定时控制器ASIC的垂直驱动用信号。这是示出1个垂直期间的信号的定时，从垂直同步信号Vs输入起经过35个水平期间数据启用信号ENAB就上升，对该上升的各水平期间输入输入数据信号DATAin的1个水平期间份额的数据DH1、DH2、…、DH768。
图26(c)示出定时控制器ASIC输出的水平驱动用的信号。定时控制器ASIC将输出到源极驱动器103的数据DH1、DH2、…、DH768、每个水平期间反转信号电平用的液晶驱动极性反转信号REV、使在源极驱动器103内移位的源极启动脉冲信号SSP、以及根据源极启动脉冲信号SSP的移位定时锁存采样的各数据并输出到各源极线S用的锁存选通脉冲信号LS，输出至源极驱动器103。由此，源极驱动器103的输出波形就成图26(d)那样。
图26(e)示出定时控制器ASIC输出的垂直驱动用的信号。定时控制器ASIC将输出栅极信号用的栅极启动脉冲信号GSP与使栅极启动脉冲信号GSP移位用的栅极时钟信号GCK输出到栅极驱动器102，以使源极驱动器103输出的数据DH1、DH2、…、DH 768依次写入由栅极驱动器102选择的各行的像素。
由此，如图26(f)所示，栅极驱动器102依次将脉冲的栅极信号输出到栅极线G。
这样，HV模式中，从垂直同步信号VS的输入起，有某规定期间的水平同步信号Hs被计数达到规定数目，之后，输入数据启用信号ENAB及输入数据信号DATAin。因此在HV模式时，能根据输入的垂直同步信号Vs及水平同步信号Hs在驱动栅极线G1之前用驱动虚设线G0那样的定时生成栅极启动脉冲信号GSP。
其次用图27(a)～(f)的时间图说明V-ENAB模式。
图27(a)示出输入到定时控制器ASIC的水平驱动用信号。这里示出1个水平期间的信号的定时。在不存在水平同步信号而输入时钟信号CK的状态中在某一定时输入数据启用信号ENAB，并输入1个水平期间份额D1、D2、…、D1024。图27(b)示出输入到定时时控制器ASIC的垂直驱动用信号。在不存在垂直同步信号及水平同步信号而在某一定时输入的数据启用信号ENAB的期间相当于源极驱动器103应该采样各水平期间的数据DH1、DH2、…、DH768的期间。
图27(c)～图27(f)与图26(c)～图26(f)相同，定时控制器ASIC输出信号的定时以数据启用信号ENAB的输入开始时刻为基准来决定的。
图28示出定时控制器ASIC 108的构成作为V-ENAB模式控制时的定时控制器ASIC的一例。定时控制器ASIC 108中，水平垂直分离/控制单元108从输入的数据启用信号ENAB与时钟信号CK分离水平驱动用基准定时与垂直驱动用的基准定时。水平计数器108b从水平驱动用的基准定时计数时钟信号CK的时钟数。垂直计数器108c从垂直驱动用的基准定时计数ENAB信号的上升沿。水平信号定时生成单元108d根据水平计数器108b的计数结果生成并输出栅极时钟信号GCK、锁存选通信号LS、源极时钟信号SCK以及源极启动脉冲信号SSP。垂直信号定时生成单元108e根据垂直计数器108c的计数结果生成并输出栅极启动脉冲信号GSP。液晶驱动极性反转信号生成单元108f根据水平计数器108b和垂直计数器108c的计数结果生成并输出液晶驱动极性反转信号REV。输入数据信号DATAin以时钟信号CK的定时输入到输入缓冲器108g，从输出缓冲器108h作为输出数据输出之。
这样，V-ENAB模式中，HV模式的那样垂直同步信号及水平同步信号不被输入到定时控制器ASIC。因此必须根据第1行数据DH1被输入的定时输入的数据启用信号ENAB的脉冲生成栅极启动脉冲GSP信号。
因而，要用现有技术2的构造以V-ENAB模式进行动作，就不能生成栅极启动脉冲信号GSP使在栅极线G1栅极信号之前输出驱动虚设线G0的信号。因而存在不能以V-ENAB模式进行动作的问题。特别是现今要求用V-ENAB模式的动作变多，急需寻求对策。
因此，美国专利2001-0050678 A1号(2001年12月13公布)中，通过对栅极驱动器IC内部下功失，以与端子排列不同的次序连接输出栅极信号来弥补现有技术1及现有技术2的缺点。图29示出该公布的构成。该图中的栅极驱动器102用驱动器IC 132替换图23的栅极驱动器102的驱动器IC 122。图30是驱动器IC 132的内部构成。栅极启动脉冲信号GSP以R1→R2→…→R256→R0的顺序转送内部移位寄存器。如图31所示利用栅极启动脉冲信号GSP传送到R256时的端子OG 256驱动最终栅极线G256的同时，从端子GSPout输出的栅极启动脉冲信号GSP被输入到下一级的驱动器IC 132。然后在驱动前一级的虚设线G0的定时用下一级的驱动器IC 132的端子OG 1驱动栅极线G257。以下将它作为现有技术3。
然而，现有技术3的栅极驱动器102的驱动器IC 132由于需要用特殊标准来构成以便以与最初设置在IC上的输出端子的顺序不同的顺序进行栅极输出，因此不能用以所设的输出端子的顺序进行栅极输出的现有的驱动器IC。也就是说，如果用图29来说明，则对初级的驱动IC 132就不能以端子OG 0→OG 1→OG 2…→OG 256那样的输出端子设置的顺序输出栅极信号的驱动器IC。因而，如要实施现有技术3，发生的问题是不得不从头开发与各种析像度对应的栅极驱动器IC，这将大幅度地增加开发费用与开发时间。这样，对于最初设置于驱动器IC的输出端子，要求这种以该输出端子的顺序驱动的、利用现有的驱动器IC的虚设线G0的驱动技术。
发明内容
本发明的目的在于提供作为进行在最上级设置虚设行线的显示板的行驱动的行驱动电路是一种显示板外无印刷电路板状态的配线连接的构造，并采用以所设的序号驱动输出端子的现有驱动器IC构成的驱动电路，可能进行以数据启用信号支配显示定时的模式即V-ENAB模式显示的显示装置、显示驱动电路的控制装置以及显示装置的驱动方法。
为达到上述目的，本发明的显示装置具备显示板，在其中像素对应于行线G与列线S的交叉点形成矩阵型，
行驱动电路，用于输入驱动所述显示板的所述行线G用的行驱动用定时信号，并根据所述行驱动用定时信号将驱动所述行线的行驱动信号依次输出到连接像素的各所述行线，
列驱动电路，用于输入显示数据及驱动所述显示板的列线用的列驱动用定时信号，并根据所述列驱动用定时信号将对应于所述显示数据的列驱动信号输出到连接像素的所述列线，
控制装置，用于输入所述显示数据、数据启用信号ENAB和时钟信号CK，根据所述数据启用信号ENAB和所述时钟信号CK生成所述行驱动用定时信号并输入所述行驱动电路，同时根据所述数据启用信号ENAB和所述时钟信号CK生成所述列驱动用定时信号并与所述显示数据一起输入到所述列驱动电路，
其特征在于，所述控制装置以所述数据启用信号ENAB的输入开始时刻为基准生成所述行驱动用定时信号并输入到所述行驱动电路2，使在从所述数据启用信号ENAB的输入开始时刻到所述列驱动电路开始输出1个垂直期间的最初水平期间的所述列驱动信号为止期间，将所述行驱动信号输出到所述行驱动电路的最上一级的所述行驱动信号的输出端子。
根据上述构成，控制装置以数据启用信号的输入开始时刻为基准，从数据启用信号和时钟信号生成行驱动用定时信号并输入到行驱动电路，使在列驱动电路开始输出1个垂直期间的最初水平期间的显示数据对应的列驱动信号之前的期间，行驱动电路将所述行驱动信号输出到最上级的行驱动信号的输出端子。
因而，在行驱动电路的最上一级的行驱动信号的输出端子连接到为使最上一级的有效像素的寄生电容与其他像素相等而设的虚设行线的情况下，可以做到下述的情况。行即，在以利用数据启用信号支配显示定时的模式进行显示时，可在将最初的水平期间的列驱动信号输出到列驱动线之前驱动虚设行线。也就是说，在驱动虚设行线之后，从上向下按序号驱动行线。由此，可用按所设的序号驱动输出端子的现有的驱动器IC构成行驱动电路。另外，由于虚设行线只要连接到最上级的输出端子就行，故不必像现在那样设置从驱动器IC的其他输出端子迂回地引回长长的接线。从而即使在显示板外不设向行驱动电路配线用的印刷电路板也可以驱动虚设的行线。
按照上述，可提供作为进行在最上一级设置虚设行线的显示板的行驱动的行驱动电路是一种显示板外无印刷电路板状态的配线连接的构造，并采用以所设的序号驱动输出端子的现有驱动器IC构成的驱动电路，可能进行以数据启用信号支配显示定时的模式来显示的显示装置。
又，由于不必如现有技术3那样同时驱动行线与虚设行线2条线，故不会产生行驱动波形的失真等。因此可避免显示品位的下降。而且由于可利用现有的驱动器IC，故能多售主化。
又，为达到上述目的，本发明的显示装置具备：显示板，在其中像素对应于行线G与列线S的交叉点形成矩阵型，
行驱动电路，用于输入驱动所述显示板的所述行线用的行驱动用定时信号，并根据所述行驱动用定时信号将驱动所述行线的行驱动信号依次输出到连接像素的各所述行线，
列驱动电路，用于输入显示数据及驱动所述显示板的列线用的列驱动用定时信号，并根据所述列驱动用定时信号将对应于所述显示数据的列驱动信号输出到连接像素的所述列线，
控制装置，用于输入所述显示数据、数据启用信号ENAB和时钟信号CK，根据所述数据启用信号ENAB和所述时钟信号CK生成所述驱动用定时信号并输入所述行驱动电路，同时根据所述数据启用信号ENAB和所述时钟信号CK生成所述列驱动用定时信号并与所述显示数据一起输入到所述列驱动电路，所述行驱动电路利用薄膜上系统结构来实装驱动器IC，从设于规定的驱动器IC的最终的行线对应的行驱动信号输出端子的下一个的输出端子通过驱动器IC芯片的下方引回配线，该配线延长地设于比设于显示板的最上一级的行线再上一级处作为虚设行线。
根据上述构成，利用薄膜上系统结构从设于行驱动电路的规定的驱动器IC的最终的行线对应的行驱动信号输出端子的下一个的输出端子通过驱动器IC芯片的下方引回配线。因此延伸地设于比设于显示板的最上级的行线再上一级处的虚设行线可作为为使最上级的有效像素的寄生电容与其他像素的相同用的虚设行线。从而即使在显示板外不设向行驱动电路的配线用的印刷电路板也可以设置虚设行线。
而且，该虚设行线的驱动只要在依所设的序号驱动所述规定的驱动器IC的输出端子之后进行就可。由此，在以利用数据启用信号支配显示定时的模式进行显示时，没有必要在其他行之前驱动虚设行线。这样，对于驱动器IC可以使用以所设的序号驱动输出端子的现有驱动器IC。
按照上述，可提供作为进行在最上一级设置虚设行线的显示板进行行驱动的行驱动电路是一种显示板外无印刷电路板状态的配线连接的构造，并采用以所设的序号驱动输出端子的现有驱动器IC构成的驱动电路，可能进行以数据启用信号支配显示定时的模式来显示的显示装置。而且由于可利用现有的驱动器IC，故多售主是可能的。
又，为达到上述目的，本发明的显示驱动电路的控制装置用来控制显示驱动电路，所述显示驱动电路具备
行驱动电路，用于输入驱动其像素对应于行线与列线的交叉点形成矩阵型的显示板的所述行线用的驱动用定时信号，并根据所述行驱动用定时信号将驱动所述行线的所述行驱动信号依次输出到连接于像素的各所述行线、以及
列驱动电路，用于输入显示数据与驱动显示板的列线用的列驱动用定时信号，并根据所述列驱动用定时信号将对应于所述显示数据的列驱动信号输出到连接像素的所述列线，
其特征在于，所述控制装置
输入所述显示数据、数据启用信号ENAB和时钟信号CK，根据所述数据启动信号ENAB和所述时钟信号CK生成所述行驱动用定时信号并输入行驱动电路，同时根据所述数据启用信号ENAB和所述时钟信号CK生成所述列驱动用定时信号并与所述显示数据一起输入所述列驱动电路，
以所述数据启用信号ENAB的输入开始时刻为基准生成所述行驱动用定时信号并输入到所述行驱动电路，使在从所述数据启用信号ENAB的输入开始时刻到所述列驱动电路开始输出1个垂直期间的最初水平期间的所述列驱动信号为止期间，将所述行驱动信号输出到所述行驱动电路的最上一级的所述行驱动信号的输出端子。
按照上述结构，作为进行在最上级设置虚设行线的显示板的行驱动的行驱动电路是一种显示板外无印刷电路板状态的配线连接的构造，并采用以所设的序号驱动输出端子的现有驱动器IC构成的驱动电路，可能以数据启用信号支配显示定时时的模式来进行显示。
又，为达到上述目的，本发明的显示装置的驱动方法用来驱动显示装置，所述显示装置具备
显示板，在其中像素对应于行线G与列线S的交叉点形成矩阵型，
行驱动电路，用于输入驱动所述显示板的所述行线用的行驱动用定时信号，并根据所述行驱动用定时信号将驱动所述行线的行驱动信号依次输出到连接像素的各所述行线，
列驱动电路，用于输入显示数据及驱动所述显示板的列线用的列驱动用定时信号，并根据所述列驱动用定时信号将对应于所述显示数据的列驱动信号输出到连接像素的所述列线，
控制装置，用于输入所述显示数据、数据启用信号ENAB和时钟信号CK，根据所述数据启用信号ENAB和所述时钟信号CK生成所述行驱动用定时信号并输入所述行驱动电路，同时根据所述数据启用信号ENAB和所述时钟信号CK生成所述列驱动用定时信号并与所述显示数据一起输入到所述列驱动电路，
所述显示装置的驱动方法根据所述数据启用信号ENAB和所述时钟信号CK生成所述行驱动用定时信号并输入所述行驱动回路，同时根据所述数据启用信号ENAB和所述时钟信号CK生成所述列驱动用定时信号并与所述显示数据一起输入所述列驱动电路，
其特征在于，以所述数据启用信号ENAB的输入开始时刻为基准生成所述行驱动用定时信号并输入到所述行驱动电路，使在从所述数据启用信号ENAB的输入开始时刻到所述列驱动电路开始输出1个垂直期间的最初水平期间的所述列驱动信号为止期间将所述驱动信号输出到所述行驱动电路的最上级的所述行驱动信号的输出端子。
按照上述方法，作为进行在最上级设置虚设行线的显示板的行驱动的行驱动电路是一种显示板外无印刷电路板状态的配线连接的构造，并采用以所设的序号驱动输出端子的现有驱动器IC构成的驱动电路，可能以数据启用信号支配显示定时的模式来进行显示。
本发明的其他目的、特征及优点将通过以下的描述得到充分了解。又，本发明的优点通过参照附图及以下说明将变得明白。
附图说明
图1为本发明第1实施形态的液晶显示装置的定时控制器ASIC有关的信号的时间图。
图2为本发明第1实施形态的液晶显示装置的定时控制器ASIC的结构框图。
图3为本发明第1实施形态的液晶显示装置的栅极驱动器与其周边的结构平面图。
图4为图3的栅极驱动器有关信号的时间图。
图5为本发明第2实施形态的液晶显示装置的栅极驱动器与其周边的结构平面图。
图6为本发明第2实施形态的液晶显示装置的定时控制器ASIC有关的信号的时间图。
图7为图5的栅极驱动器有关信号的时间图。
图8为本发明第3实施形态的液晶显示装置的栅极驱动器与其周边的结构平面图。
图9为本发明第3实施形态的液晶显示装置的定时控制器ASIC有关的信号的时间图。
图10为本发明第4实施形态的液晶显示装置的定时控制器ASIC的结构框图。
图11为本发明第4实施形态的液晶显示装置的定时控制器ASIC有关的信号的时间图。
图12为本发明第3实施形态的液晶显示装置的栅极驱动器与其周边的结构平面图。
图13为本发明第5实施形态的液晶显示装置的定时控制器ASIC有关的信号的时间图。
图14为图12的栅极驱动器有关信号的时间图。
图15为本发明第6实施形态的液晶显示装置的栅极驱动器与其周边的结构平面图。
图16为本发明第6实施形态的液晶显示装置的定时控制器ASIC有关的信号的时间图。
图17为图15的栅极驱动器有关信号的时间图。
图18为现有液晶显示装置构成的电路框图。
图19为说明图18的液晶显示装置产生寄生电容的像素平面图。
图20为说明由图18的液晶显示装置产生的寄生电容引起像素电极电位变动的电压波形图。
图21为现有液晶显示装置的栅极驱动器及其周边的第1结构平面图。
图22为图21的栅极驱动器有关的信号的时间图。
图23为现有液晶显示装置的栅极驱动器及其周边的第2结构平面图。
图24为图22的栅极驱动器有关的信号的时间图。
图25为现有液晶显示装置的栅极驱动器及其周边的第3结构平面图。
图26(a)为说明现有的液晶显示装置的HV模式的显示动作的信号时间图。
图26(b)为说明现有的液晶显示装置的HV模式的显示动作的信号时间图。
图26(c)为说明现有的液晶显示装置的HV模式的显示动作的信号时间图。
图26(d)为说明现有的液晶显示装置的HV模式的显示动作的信号时间图。
图26(e)为说明现有的液晶显示装置的HV模式的显示动作的信号时间图。
图26(f)为说明现有的液晶显示装置的HV模式的显示动作的信号时间图。
图27(a)为说明现有的液晶显示装置的V-ENAB模式的显示动作的信号时间图。
图27(b)为说明现有的液晶显示装置的V-ENAB模式的显示动作的信号时间图。
图27(c)为说明现有的液晶显示装置的V-ENAB模式的显示动作的信号时间图。
图27(d)为说明现有的液晶显示装置的V-ENAB模式的显示动作的信号时间图。
图27(e)为说明现有的液晶显示装置的V-ENAB模式的显示动作的信号时间图。
图27(f)为说明现有的液晶显示装置的V-ENAB模式的显示动作的信号时间图。
图28为现有液晶显示装置的定时控制器ASIC的构成框图。
图29为现有液晶显示装置的栅极驱动器及其周边的第4结构平面图。
图30为图29的栅极驱动器的驱动器IC内部结构框图。
图31为图29的栅极驱动器有关的时间图。
具体实施方式
实施形态1
根据图1至图4说明本发明的实施形态1如下。
本实施形态有关的液晶显示装置(显示装置)为具有1024×768像素的XGA的TFT有源矩阵方式的液晶显示装置。配置定时控制器ASIC(控制装置)、栅极驱动器(行驱动电路)、源极驱动器(列驱动电路)以及液晶板(显示板)的整体结构与在现有技术中说明的情况相同。像素的结构也是以现有技术说明的下栅极构造。又，该液晶显示装置为栅极基板省略型结构，用V-ENAB模式动作。
图2示出本实施形态的定时控制器ASIC(以下称控制器IC)1的结构。控制器IC1具备；水平垂直分离/控制器单元1a，水平计数器1b，垂直计数器1c，水平信号定时生成单元1d(移位时钟信号生成单元)，C0驱动信号定时生成单元1e(启动脉冲信号生成单元)，液晶驱动极性反转信号生成单元1f，输入缓冲器1g，以及输出缓冲器1h。
水平垂直分离、控制器单元1a从输入的数据启用信号ENAB与时钟信号CK中分离水平驱动用基准定时与垂直驱动用基准定时。水平计数器1b根据水平垂直分离、控制器单元1a分离出的水平驱动用基准定时，计数时钟信号CK的时钟数。垂直计数器1c根据水平垂直分离、控制器单元1a分离出的垂直驱动用基准定时，计数ENAB信号的上升沿。水平信号定时生成单元1d根据水平计数器1b的计数结果，生成并输出栅极时钟信号(行驱动用定时信号)GCK、锁存选通信号(列驱动用定时信号)LS、显示数据采样时钟即源极时钟信号(列驱动用定时信号)SCK、以及显示数据采样开始信号即源极启动脉冲信号(列驱动用定时信号)SSP。这时，作为栅极时钟信号GCK，如图1所示，在脉冲CK2、CK3、CK4、…之外，在它们之前生成脉冲CK1。这里，脉冲CK2、CK3、CK4…在从数据启用信号ENAB的输入开始时刻(上升沿定时)起计数规定时钟数后上升，并用数据启用信号ENAB的下降定时下降。另外，脉冲CK1在从1个垂直期间的最初的水平期间对应的数据启用信号ENAB的输入开始时刻起计数少量的规定时钟数后上升，并在该规定的时钟数后下降。
G0驱动信号定时生成单元1e根据水平计数器1b和垂直计数器1c的计数结果生成并输出栅极启动脉冲信号(行驱动用定时信号)GSP。这时，栅极启动脉冲信号GSP如图1所示是对应于1个垂直期间的最初的水平期间的数据启用信号ENAB的输入开始时刻上升，在所述脉冲CK1下降后下降的脉冲。
液晶驱动极性反转信号生成单元1f根据水平计数器1b和垂直计数器1c的计数结果生成并输出液晶驱动极性反转信号REV。输入缓冲器1g用时钟信号CK的定时取入输入数据信号(显示数据)。输出缓冲器1h从输入缓冲器1g接收输入数据信号并输出之。
图3示出本实施形态的栅极驱动器2的构成。栅极驱动器2驱动液晶板3的栅极线(行线)。在液晶板3上除了设置了连接有效像素的768条栅极线G1、G2、…、G768之外，还在栅极线G1的更上一级设置作为虚设的栅极线的虚设线G0。栅极驱动器2为驱动这769条线，具备由3个串接连接状态的有258个输出端子的驱动器IC。这3个驱动器IC由256个输出单位串接连接，使液晶板3的上下端不偏于剩余输出端子。如改变驱动器IC与液晶板之间的连接，对应257输出是可能的，后述的实施形态3考虑到扩展成驱动带虚设像素的虚设线的结构，取258个输出。
上述3个驱动器IC依液晶板3的最上一级侧(虚设线G0)起的顺序为驱动器IC 2a、驱动器IC 2b、驱动器IC 2c。驱动器IC 2a、2b、2c用TAB方式分别实装于载体带2d上，成为TCP。各驱动器IC 2a、2b、2c上设置可输出栅极信号(行驱动信号)的输出端子OG 0、OG 1、OG 2、…、OG 257。
驱动器IC 2a中，端子OG 0连接虚设线G0、端子OG 1、OG 2、…、OG 256依次分别连接栅线G1、G2、…、G256，端子OG 257不用。驱动器IC 2b中，端子OG 1、OG 2、…、OG 256依次分别连接栅线G257、G258、…、G512，端子OG 0、OG 257不用。驱动器IC 2C中，端子OG 1、OG 2、…OG 256依次分别连接栅线G513、G154、…G768，端子OG 0、OG 257不用。
来自控制器IC1的栅极启动脉冲信号GSP及栅极时钟信号(移位时钟信号)GCK从源极驱动器侧经由液晶板3输入到驱动器IC 2a的端子GSPin和GCKin。栅极时钟信号GCK也可经由IC芯片内的缓冲器自己传送，但因为具备SOF配线可以利用SOF(薄膜上系统)构造在IC芯片的下方传送。
栅极启动脉冲信号GSP和栅极时钟信号GCK从驱动器IC 2a的端子GSPout和GCKout输出，输入到驱动器IC2b的端子GSPin和GCKin，同样也传送到驱动器IC 2C。这样形成串接连接。
本实施形态中，对于V-ENAB模式时，利用向源极驱动器IC转送第1线的显示数据大约需要1个水平周期的事实。也就是说，为了源极驱动器IC在采样第1线的显示数据期间驱动虚设线G0，控制器IC1若输入第1线的数据启用信号ENAB就立即输出驱动虚设线G0用的栅极启动脉冲GSP和栅极时钟信号GCK。
当输入来自控制器IC1的栅极启动脉动信号GSP的脉冲为“高”时，如图4所示，就以栅极时钟信号GCK下降沿时刻进行栅极启动脉冲信号GSP的采样。然后，该采样信号由驱动器IC 2a、2b、2c的内部移位寄存器转送到各端子OGn(n＝0，1，…，256)。驱动器IC 2a的端子OG0上，在图4的栅极时钟信号GCK的脉冲CK1的下降沿时刻栅极信号开始输出，输出一直继续到脉冲CK2的上升沿时刻为止。该期间虚设线G0被驱动。
其后，如上所述在从脉冲CK2的下降沿时刻至脉冲CK3的上升沿时刻，栅极信号输出到端子OG1，在从脉冲CK3的下降沿时刻至脉冲CK4的上升沿时刻，栅极信号输出到端子OG2，栅极信号依次输出到各端子，依次驱动栅极线G。与开始输出栅极信号到端子OG1的同时，锁存选通信号LS从控制器IC1输入至源极信号器，从源极驱动器输出1个垂直期间的最初的水平期间的显示数据对应的写入信号。这样，在栅极信号的输出期间，写入信号被写入像素。然后，与栅极信号输出到驱动器IC 2a的端子OG 255的同时，从端子GSPout输出栅极启动脉冲信号GSP，栅极信号输出到驱动器IC 2a的端子OG 256的下一个即驱动器IC 2b的端子OG 1。
这样，根据本实施形态的液晶显示装置，控制器IC1以数据启用信号ENAB的输入开始时刻为基准，从数据启用信号ENAB和时钟信号CK生成栅极启动脉冲信号GSP和栅极时钟信号GCK并输入栅极驱动器2，使在源栅驱动器开始输出1个垂直期间的最初与水平期间的显示数据对应的写入信号之前的期间中，将栅极信号输出到栅极驱动器2的最上一级的栅极信号的输出端子OG 0。
从而，假定要用V-ENAB模式进行显示时，就能在将最初的水平期间的写入信号输出到源极线S之前驱动虚设线G0。也就是说，在驱动虚设线G0之后，从上而下顺序地驱动栅极线G。由此，能用以所设的顺序驱动输出端子的现有的驱动器IC 2a、2b、2c构成栅极驱动器2。而且，由于只要将虚设线G0连接到最上一级的输出端子OG 0就可，故不必如已往那样从驱动器IC的其他输出端开始设置迂回绕行的长线。因此，即使用栅极基板省略型构造也可驱动虚设线G0。
按照上面所述，作为进行在最上级设置虚设行线的显示板的行驱动的行驱动电路是一种显示板外无印刷电路板状态的配线连接的构造，并采用以所设的序号驱动输出端子的现有驱动器IC构成的驱动电路，可用数据启用信号支配显示定时的模式进行显示。而且，由于可利用现有的驱动器，故多售主是可能的。
又，根据本实施形态的液晶显示装置，控制IC1用数据启用信号ENAB输出到控制器IC1的时刻开始生成启动脉冲信号GSP。其后在计数时钟信号CK规定的时钟数的时刻生成栅极时钟信号GCK的第1时钟即脉冲CK1。栅极驱动器2变为驱动虚设线G0取入启动脉冲信号GSP。因此，配合用于栅极驱动器2的驱动器IC 2a的建立保持时间，能决定上述时钟的计数数目。然后可根据驱动器IC 2a的特性驱动虚设线G0。
用图1来说明，则虚设线G0的栅极信号波形是比栅极线Gm(m≠0)的栅极信号波形大约窄1个水平回扫期间的脉冲波形。该栅极信号变短的期间，例如在VGA析像度情况下如以VESA标准定时来规定，则与1水平周期为20.7μs相比约为5μs，然而虚设线G0的驱动期间只要适当地决定使得到由寄生电容引起的像素电极电位变动与第2行以后的像素有相同的效果就行，并不限于某特殊值。上述的数值例可适用于液晶显示装置为CS ON COM构造的情况。
此外，在对笔记本电脑用液晶显示装置等那样寻求窄边框的规格采用栅极基板省略型构造的情况下，必然地将驱动栅极驱动器IC用的电源线、信号线做得更细。结果栅极驱动电源的配线电阻变高。以现有技术3的图32的例而言，用驱动栅极线G257的定时驱动器IC同时驱动2条栅极线，流过栅极电源的电流仅该时刻成为2倍，产生栅极信号波形失真等。结果存在该栅极线的像素产生辉度不均匀的异常，显示品位下降的问题。
与此相反，本实施形态的液晶显示装置由于不必如现有技术3那样同时驱动栅极线G与虚设线G0两条线，故不会发生栅极信号波形的失真等，能避免显示品质的下降。
实施形态2
根据图5至图7说明本发明的另一实施例如下。对于与所述实施形态1中所述的构成要素有相同功能的构成要素标以相同的符号，并省略其说明。
本实施形态的液晶显示装置是将实施形态1中所述的液晶显示装置做成具有1400×1050像素的SXGA+的液晶显示装置。与之相应，具备图5所示的栅极驱动器5和液晶板6。
栅极驱动器5是利用TAB方式将263个输出的驱动器IC 5a、5b、5c、5d分别装在载体带5e上构成TCP的一种串接连接。液晶板6上形成虚设线G0、栅极线G1、G2、…、G1050。驱动器IC 5a、5b、5c的端子OG 0、Og 1、…OG 262与驱动器5d的端子OG 0、OG 1、…、OG 261连接到栅极线上。未使用的端子仅是驱动器IC 5d的端子OG 262。
这时的控制器IC1的信号示于图6。数据启动信号ENAB在1个垂直期间输入1050个，栅极启动脉冲信号GSP和栅极时钟信号GCK与图1相同。此外，栅极驱动器5的信号示于图7。从端子OG0起的依次驱动与图4相同，端子OG 262驱动时从端子GSPout输出启动脉冲信号GSP，输入到下一级的驱动器IC。
也就是说，本实施形态中为263个输出且以263个输出单位采用级联的一般的栅极驱动器IC。因此没有必要开发现有技术3中所述的特殊规格的栅极驱动器IC。
此外，如果说是采用现有技术3那样在最终端子之后驱动连接虚设线G0的端子OG0，来驱动连接有效显示的上述像素的1050条栅极线G上加虚设线G0一共1051条线，那么需要264个输出至265个输出的驱动器IC。反对，本实施形态的液晶显示装置中用具有合计263×4＝1052条的栅极信号的输出端的串接连接的驱动器IC 5a、5b、5c、5d驱动所述1051条线。因此，不使用的输出端子少，能容易实现IC芯片尺寸的缩小及最佳化，谋求实现低成本化。
实施形态3
根据图8和图9说明本发明再一个实施形态如下。对于与上述实施形态1和2所述的构成要素有相同功能的构成要素标以相同的符号并省略其说明。
本实施形态的液晶显示装置是如图8所示的驱动为提高显示板的长期可靠性而在最上一级的有效像素之上及最下一级的有效像素之下分别具备带虚设像素的虚设线G0、G769的液晶板10的型式。此外的构成与实施形态1相同。
在用现有技术3说明的虚设线G0的驱动方式中，栅极线G257的显示数据被写入连接于虚设线G0的虚设像素。因此在运动图像数据等帧间显示不同视频数据的情况下，连接于虚设线G0的虚设像素的对向DC电压电平变得不稳定。
另一方面，在本实施形态的虚设线G0的驱动方式中，在图9的斜线表示的区域的垂直回扫期间有可能以虚设线G0的驱动定时输出所采样的显示数据，因此有可能对像素施加稳定的电压。
此外，垂直回扫期间所采样的视频数据例如能在正常白显示板情况下作为白数据，在正常黑显示板情况下作为黑数据。
实施形态4
根据图10及图11说明本发明的又一实施形态如下。对于与上述实施形态1至3中所述的构成要素有相同功能的构成要素标以相同的符号并省略其说明。
本实施形态的液晶显示装置具有存储控制器IC内部1个水平期间的时钟数的电路。利用这一电路将作为液晶驱动定时信号的栅极时钟信号GCK与锁存选通信号LS的输出定时往后挪动。由此，使虚设线G0的驱动时间与其他栅极线G相等。
图10示出本实施形态的控制器IC 15的构成。控制器IC 15具备：水平垂直分离、控制单元1a，水平计数器1b，垂直计数器1c，G0驱动信号定时生成单元1e，液晶驱动极性反转信号生成单元1f，输入缓冲器1g，输出缓冲器1h，水平期间检测、存储单元15a，水平显示期间检测、存储单元15b，水平回扫期间检测、存储单元15c，水平信号定时生成第1单元15d，以及水平信号定时生成第2单元15e。
水平期间检测、存储单元15a从输入到水平垂直分离、控制器单元1a的数据启用信号ENAB的输入开始时刻计数时钟信号CK的时钟数并存储之。然后，进行通知1水平期间(如1344个时钟数)的结束定时的输出。水平显示期间检测、存储单元15b计数从数据启用信号ENAB的输入开始时刻起的时钟信号CK的时钟数并存储之。然后，进行通知将1水平期间中的写入信号写入像素的期间(如1024个时钟系数)的结束定时的输出。水平回扫期间检测、存储单元15c根据水平显示期间检测、存储单元15b输入的写入期间的结束定时，识别水平回扫期间的开始定时。然后，根据水平期间检测、存储单元15a输入的1水平期间的结束定时，识别水平回扫期间(如320时钟数)的结束定时。
水平信号定时生成第1单元15d根据水平计数器1b的计数结果与水平回扫期间检测、存储单元15c输入的水平回扫期间的开始定时及结束定时，生成栅极时钟信号GCK及锁存选通信号LS并输出之。这时，如图11所示生成栅极时钟信号GCK的脉冲CK2、CK3、…，使其在水平回扫期间内下降，这里使其在水平回扫期间的结束定时下降。然后在下一个数据启用信号ENAB输入控制器IC 15的定时生成锁存选通信号LS。由此，虚设线G0的驱动时间从实施形态1中说明的驱动时间延长到下一个数据启用信号ENAB输入控制器IC 15的定时为止的水平回扫期间部分。因此能与其他的栅极线G的驱动时间相等。写入像素的开始定时也延迟该相应部分。图11中用箭头表示定时的变化。
水平信号定时生成第2单元15e根据水平计数器1b的计数结果生成源极时钟信号SCK及源极启动脉冲信号SSP并输出之。
根据以上的构成，不必对显示数据施加延迟等的特别处理，利用对控制器IC的逻辑稍作变更可以延长虚设线G0的驱动时间。
这样的构成可用于例如CS ON GATE(栅极上的CS)那样的寄生电容引起电压变动部分ΔV2大的像素构造中。
实施形态5
根据图12至图14说明本发明又一实施形态如下。对于与上述实施形态1至4所述的构成要素有相同功能的构成要素标以相同的符号并省略其说明。
本实施形态的液晶显示装置是一种利用SOF(薄膜上系统)构造驱动虚设线G0的构成。与此相应，具备栅极驱动器21及液晶板22，如图12所示。控制器IC是图28的控制器IC 108。
栅极驱动器21是将具有端子OG 1～OG 257的驱动器IC 21a、21b、21c分别安装在薄膜21d上、以SOF构造的状态串接连接而成的。从驱动器IC 21a的端子OG 257，即设于驱动器IC 21a的最后的栅极线G256所对应的端子OG 256的下一个的端子，通过驱动器IC 21a芯片的下方引回配线。该配线从作为薄膜21d的输出端子的端子OG0延伸设置于比液晶板22上所设的的有效像素的最上一级的栅极线G1更上一级，成为虚设线G0。驱动器IC 21b、21c也同样地制造。这里，从端子OG 257引出的配线通过IC芯片下方引回延伸至端子OG 1之上，但该端子这在本实施例中未使用。
因此，驱动器IC 21a按端子OG1→OG2→…→OG256→OG0的次序输出栅极信号。
图13示出控制器IC 108的信号。由于虚设线G0在栅极线G256之后被驱动，故没有必要如实施形态1至4所述那样生成用于最初驱动虚设线G0的栅极启动信号GSP及栅极时钟信号GCK。由此成为从栅极线G1顺序驱动的通常的栅极启动脉冲信号GSP及栅极时钟信号GCK。图14示出栅极驱动器21的信号。与驱动驱动器IC 21a的端子OG 256的同时，从端子GSPout向下一级的驱动器IC 21b输入栅极启动脉冲信号GSP，同时驱动虚设线G0与栅极G257。
根据本实施形态，即使在液晶板22之外不设栅极驱动器21配线用的印刷电路板也可以设置虚设线G0。因此，该虚设线G0的驱动只要在以所设的驱动器IC 21a的输出端子的顺序驱动之后进行就可。从而，用V-ENAB模式进行显示时，没有必要在其他栅极线G之前驱动虚设线G0。由此，驱动器IC 21a、21b、21c可以使用以所设的顺序驱动输出端子的现有的驱动器。此外，让这样的驱动器IC上增加设置输出端子OG 257，利用这种现有型式的栅极驱动器IC能得到与现有技术3同样的驱动波形。
如上所述，作为进行在最上级设置虚设行线的显示板的行驱动的行驱动电路是一种显示板外无印刷电路板状态的配线连接的构造，并采用以所设序号驱动输出端子的现有驱动器IC构成的驱动电路，能够以数据启用信号支配显示定时的模式来显示。
实施形态6
下面根据图15至图17说明本发明的再一个实施形态。对于与上述实施形态1至5所述的构成要素有相同功能的构成要素标以相同的符号并省略其说明。
图15示出本实施形态的液晶显示装置的栅极驱动器25及液晶板26的构成。控制器IC(控制装置)内藏保持视频数据的行存储器(图中未示出)。
该液晶显示装置是具有1600×1200像素的UXGA的TFT有源矩阵方式，栅极驱动器25是以300个输出单位串接连接302个输出的4个驱动器IC 25a、25b、25c、25d而成的。利用4个IC的串接连接便可利用1202个输出。各驱动器IC分别用TAB方式实装在载体带25e上构成TCP。液晶板26中虚设线G0、G1201分别设置在最上一级的有效像素之上和最下一级的有效像素之下，虚设像素连接于虚设线上。
在UXGA等超高析像率的视频格式中，视频数据的数据传送速度约达160MHz，源极驱动器IC的数据传送速度往往跟不上。因此，控制器IC内部内藏行存储器，将1水平期间的视频数据临时存放于行存储器。之后重新排列视频数据，降低传送速度使源驱动器IC能采样视频数据而将数据传送到源驱动器IC。因而如图16所示，作为第1行的栅极线G0的视频数据DH1(in)在第1水平期间(ENAB(1)一旦被控制器IC采样。之后在第2水平期间(ENAB(2))由源极驱动器IC采样作为视频数据DH1(out)。采样结束后，根据锁存选通信号LS的输入，源极驱动器IC输出与视频数据DH1(out)相当的模拟电压。
为了与此一致，控制器IC生成如图16那样以从数据启用信号ENAB的ENAB(1)的输入开始时刻至ENAB(2)的输入开始时刻为止的期间作为脉冲期间的栅极启动脉冲信号GSP。而且，控制器IC生成栅极时钟信号GCK，其下降沿是在各ENAB期间的结束时刻。由此，栅极驱动器25依次输出如图17所示那样虚设行G0与各栅极行G的期间相等的栅极信号。
与实施形态1至5相比较，本实施形态中视频数据输入到源极驱动器的定时迟了1个水平期间。因此不必生成并输出实施形态1所述的那样在识别第1行的数据启用信号ENAB之后立即将栅极信号输出到虚设线G0那样的栅极启动脉冲信号GSP及栅极时钟信号GCK。而且也不必如实施形态4所述那样存储1水平期间的时钟数并将液晶驱动定时向后挪动。只要控制器IC输出的栅极启动脉冲信号GSP将栅极驱动器25取入的定时向后挪动约1个水平期间，就能驱动虚设线G0。
这样，根据本实施形态，控制器IC用行存储器使输入的视频数据延迟1水平期间再输入源极驱动器。从而能加长从数据启用信号ENAB输入到控制器IC的定时到源极驱动器开始输出1垂直期间的最初的水平期间的写入信号为止的期间。因此能容易地充分加长驱动虚设线G0的时间。
以上说明了实施形态1到6。本发明不限于液晶显示装置，也可广泛地适用于驱动行线与列线的矩阵型显示装置。而且，列驱动电路向列线的输出方法，不论以线为序或以点为序都可以。
又，本发明的显示装置中，所述行驱动用定时信号为了决定依次将所述行驱动信号输出到上述线的各线的定时，包含上述行驱动电路内被移位的1个脉冲组成的启动脉冲信号与决定使所述启动脉冲信号移位的定时的移位时钟信号，所述控制装置也可以用所述数据启用信号的输入开始时刻开始生成所述启动脉冲信号，从所述输入开始时刻起计数规定数量的时钟信号的时钟数的时刻生成所述行驱动电路取入所述启动脉冲信号用的上述移位时钟信号的第1时钟，使所述行驱动信号输出到所述行驱动电路的最上一级的所述行驱动信号的输出端子。
上述构成中，在行驱动电路是通过利用移位时钟信号使启动脉冲信号移位依次驱动行线的驱动电路的情况下，控制装置用输入数据启用信号的定时开始生成启动脉冲信号。之后可在计数时钟信号为规定时钟数的时刻生成移位时钟信号的第1时钟，为驱动虚设行线，使行驱动电路取入启动脉冲信号。从而，与用于驱动电路的驱动器IC的建立保持时间一致，就能决定上述时钟的计数数目，能根据驱动器IC的特性来驱动虚设行线。
又，本发明的显示装置中，所述控制装置也可以在将1水平期间的上述显示数据输入到列驱动电路结束之后的水平回扫期间部分的经过时间内，将决定所述列驱动电路输出所述列信号的定时的所述列驱动用定时信号即列驱动开始定时信号输入到所述列驱动电路，也可使上述移位时钟信号的所述第1时钟之后的时钟与所述列驱动开始定时信号一致并输入到所述行驱动电路。
上述构成中，水平回扫期间设在数据启用信号之间，然而控制装置并不在显示数据输入列驱动电路结束的时刻将列驱动开始定时信号输出到列驱动电路，而是在从输入结束的时刻起再经过的水平回期间内输出列驱动定时信号。因此控制装置与该输出定时一致地将移位时钟信号的第1时钟后的时钟输入行驱动电路。
因而，在用移位时钟信号的第1时钟取入驱动脉冲信号后，能延长驱动虚设的行线的时间，能和其他行线的驱动时间相同。
还有，本发明的显示装置中，上述控制装置也可使输入的上述显示数据延迟一个水平期间，再输入上述列驱动电路。
上述构成中，控制装置将输入的显示数据延迟1水平期间再输入列驱动电路。因此可以加长从数据启用信号输入控制装置的定时到列驱动电路开始输出1垂直期间的最初的水平期间的列驱动信号为止的期间。因此可容易地充分加长驱动虚设行线的时间。
又，本发明的显示装置中连接到有效显示的像素的行线是1050条，所述行驱动电路也可以将具有263个的上述行驱动信号的输出端子的驱动器IC 4个串接连接而成。
上述构成中，用合计有263×＝1052条的行驱动信号的输出端子的串接连接的驱动器IC，驱动连接于有效显示上述像素的1050条行线加虚设行线后的1051条线。因此不使用的输出端子少，容易缩小IC芯片尺寸，实现最佳化以及低成本化。
又，在本发明的显示装置中，为了决定上述行驱动信号依次输出到各行线的定时，上述行驱动用定时信号包含在上述行驱动电路内被移位的1个脉冲组成的启动脉冲信号与决定使所述启动脉冲信号移位的定时的移位定时信号，所述控制装置用所述数据启用信号输入到该控制装置的输入开始时刻开始生成所述启动脉冲信号，在从输入开始时刻起计数时钟信号达规定的时钟数的时刻生成移位时钟信号的第1时钟，为将行驱动信号输出到最上一级的行驱动信号的输出端子，所述行驱动电路也可以与所述移位时钟信号的第1时钟相对应取入启动脉冲信号。
又，本发明的显示装置也可以在显示板的最上一级行线的更上一级与最下一级行线的更下一级处分别设置带虚设像素的虚设线。
又，本发明的显示装置为使所有行线的驱动时间相等，也可以将所述移位时钟信号的第1时钟之后的时钟输入行驱动电路。
又，本发明的显示装置，具备：显示板，在其中像素对应于行线与列线的交叉点形成矩阵型；行驱动电路，用于输入驱动所述显示板的所述行线用的行驱动用定时信号，并根据所述行驱动用定时信号将驱动所述行线的行驱动信号依次输出到连接像素的各所述行线；列驱动电路，用于输入显示数据及驱动所述显示板的列线用的列驱动用定时信号，并根据所述列驱动用定时信号将对应于所述显示数据的列驱动信号输出到连接像素的所述列线，控制装置，用于输入所述显示数据、数据启用信号和时钟信号，根据所述数据启用信号和所述时钟信号生成所述行驱动用定时信号并输入所述行驱动电路，同时根据所述数据启用信号和所述时钟信号生成所述列驱动用定时信号并与所述显示数据一起输入到所述列驱动电路；所述控制装置包含启动脉冲信号生成部与移位时钟信号生成部，前者用输入到该控制装置的所述数据启用信号的输入开始时刻开始生成所述行驱动电路内被移位的1个脉冲组成启动脉冲信号，用于决定将所述行驱动信号依次输出到所述行线的各线的定时，后者在从所述输入开始时刻起计数所述时钟信号达规定数目时钟数的时刻生成移位时钟信号的第1时钟，它用于决定使所述启动脉冲信号移位的定时，所述行驱动电路的结构可以为将所述行驱动信号输出到最上一级的所述行驱动信号的输出端子，与所述移位时钟信号的第1时钟对应取入所述启动脉冲信号。
对于本发明的详述中所作的具体实施形态及实施例的说明，完全是为了了解本发明的技术内容而作的，不应仅限于这样的具体例子作狭义的解释，在本发明的精神及以下所述的权利要求项的范围内可进行各种变更并实施。

Claims (11)

1.一种显示装置，具备
与行线(G)和列线(S)的交叉点相对应地形成有矩阵型像素的显示板(3)、
输入驱动所述显示板(3)的所述行线(G)用的行驱动用定时信号，并根据所述行驱动用定时信号将驱动所述行线(G)的行驱动信号依次输出到连接像素的各所述行线(G)的行驱动电路(2)、
输入显示数据及驱动所述显示板(3)的列线(S)用的列驱动用定时信号，并根据所述列驱动用定时信号将对应于所述显示数据的列驱动信号输出到连接像素的所述列线(S)的列驱动电路、以及
输入所述显示数据、数据启用信号(ENAB)和时钟信号(CK)，根据所述数据启用信号(ENAB)和所述时钟信号(CK)生成所述行驱动用定时信号，输入到所述行驱动电路(2)，同时根据所述数据启用信号(ENAB)和所述时钟信号(CK)生成所述列驱动用定时信号并与所述显示数据一起输入到所述列驱动电路的控制装置(1)，其特征在于，
所述控制装置(1)以所述数据启用信号(ENAB)的输入开始时刻为基准，生成所述行驱动用定时信号并输入到所述行驱动电路(2)，使得在从所述数据启用信号(ENAB)的输入开始时刻，到所述列驱动电路开始输出1个垂直期间的最初的水平期间的所述列驱动信号为止的期间将所述行驱动信号输出到所述行驱动电路(2)的最上一级的所述行驱动信号的输出端子上。
2.如权利要求1所述的显示装置，其特征在于，
所述行驱动用定时信号含有，决定依次输出所述行驱动信号到各所述行线(G)的定时的、在所述行驱动电路内(2)移位的1个脉冲构成的启动脉冲信号(GSP)，以及决定使所述启动脉冲信号(GSP)移位的定时的移位时钟信号(GCK)，
所述控制装置在所述数据启用信号(ENAB)的输入开始时刻开始生成所述启动脉冲信号(GSP)，在从所述输入开始时刻起对所述时钟信号(CK)的时钟计数达规定数目的时刻，生成所述行驱动电路取入所述启动脉冲信号(GSP)用的所述移位时钟信号(GCK)的第一时钟(CK1)，以将所述行驱动信号输出到所述行驱动电路的最上一级的所述行驱动信号的输出端子上。
3.如权利要求1所述的显示装置，其特征在于，
所述行驱动用定时信号含有，决定依次输出所述行驱动信号到各所述行线(G)的定时的、在所述行驱动电路内(2)移位的1个脉冲构成的启动脉冲信号(GSP)，以及决定使所述启动脉冲信号(GSP)移位的定时的移位时钟信号(GCK)，
所述控制装置在将所述数据启用信号(ENAB)输入到该控制装置的输入开始时刻开始生成所述启动脉冲信号(GSP)，在从所述输入开始时刻起对所述时钟信号(CK)的时钟计数达规定数目的时刻，生成所述移位时钟信号(GCK)的第1时钟(CK1)，
所述行驱动电路(2)对应于所述移位时钟信号的第1时钟取入所述启动脉冲信号(GSP)，以将所述行驱动信号输出到最上一级的所述行驱动信号的输出端子。
4.如权利要求1所述的显示装置，其特征在于，在比所述显示板(10)的最上一级的所述行线(G1)再上一级与比最下一级的上述行线(G768)再下一级处分别设置带有虚设像素的虚设线(G0、G769)。
5.如权利要求2所述的显示装置，其特征在于，所述控制装置(15)在对所述列驱动电路输入1个水平期间的所述显示数据结束之后的水平回扫期间内，将决定所述列驱动电路输出所述列驱动信号的定时的所述列驱动用定时信号、即列驱动开始定时信号输入到所述列驱动电路，将所述移位时钟信号(GCK)的所述第1时钟(CK1)之后的时钟与所述列驱动开始定时信号对准，并输入到所述行驱动电路(2)。
6.如权利要求2所述的显示装置，其特征在于，所述控制装置将所述移位时钟信号(GCK)的所述第1个时钟(CK1)之后的时钟输入到所述行驱动电路(2)，以使全部行线(G)的驱动时间相等。
7.如权利要求1所述的显示装置，其特征在于，所述控制装置使所输入的所述显示数据延迟1个水平期间并输入到所述列驱动电路。
8.如权利要求1～5中任一项所述的显示装置，其特征在于，连接到显示有效的所述像素的所述行线(G)为1050条，所述行驱动电路(5)包括4个级联连接的、具有263个所述行驱动信号输出端子的驱动器IC(5a～5d)。
9.如权利要求3所述的显示装置，其特征在于，
所述控制装置包含：开始生成所述启动脉冲信号的启动脉冲信号生成部、生成所述移位时钟信号的第1时钟的移位时钟信号生成部。
10.一种显示驱动电路的控制装置(1)，用于控制显示驱动电路，所述显示驱动电路具备
输入驱动其像素对应于行线(G)与列线(S)的交叉点形成矩阵型的显示板(3)的所述行线(G)用的行驱动用定时信号，并根据所述行驱动用定时信号将驱动所述行线(G)的行驱动信号依次输出到连接像素的各所述行线(G)的行驱动电路(2)、以及
输入显示数据与驱动所述显示板(3)的列线(S)用的列驱动用定时信号，并根据所述列驱动用定时信号将对应于所述显示数据的列驱动信号输出到连接像素的所述列线(S)的列驱动电路，其特征在于，
所述控制装置
输入所述显示数据、数据启用信号(ENAB)和时钟信号(CK)，根据所述数据启用信号(ENAB)和所述时钟信号(CK)生成所述行驱动用定时信号并输入到所述行驱动电路(2)，同时根据所述数据启用信号(ENAB)和所述时钟信号(CK)生成所述列驱动用定时信号并与所述显示数据一起输入到所述列驱动电路，
以所述数据启用信号(ENAB)的输入开始时刻为基准生成所述行驱动用定时信号并输入到所述行驱动电路(2)，使得在从所述数据启用信号(ENAB)的输入开始时刻，到所述列驱动电路开始输出1个垂直期间的最初水平期间的所述列驱动信号为止的期间能够将所述行驱动信号输出到所述行驱动电路(2)的最上一级的所述行驱动信号的输出端子。
11.一种驱动显示装置的显示装置驱动方法，所述显示装置具备
与行线(G)和列线(S)的交叉点相对应地形成有矩阵型像素的显示板(3)、
输入驱动所述显示板(3)的所述行线(G)用的行驱动用定时信号，并根据所述行驱动用定时信号将驱动所述行线(G)的行驱动信号依次输出到连接像素的各所述行线的行驱动电路(2)、
输入显示数据及驱动所述显示板(3)的列线(S)用的列驱动用定时信号，并根据所述列驱动用定时信号将对应于所述显示数据的列驱动信号输出到连接像素的所述列线(S)的列驱动电路、以及
输入所述显示数据、数据启用信号(ENAB)和时钟信号(CK)，根据所述数据启用信号(ENAB)和所述时钟信号(CK)生成所述行驱动用定时信号，输入到所述行驱动电路(2)，同时根据所述数据启用信号(ENAB)和所述时钟信号(CK)生成所述列驱动用定时信号并与所述显示数据一起输入到所述列驱动电路的控制装置(1)，
所述显示装置的驱动方法根据所述数据启用信号(ENAB)和所述时钟信号(CK)生成所述行驱动用定时信号并输入到所述行驱动回路(2)，同时根据所述数据启用信号(ENAB)和所述时钟信号(CK)生成所述列驱动用定时信号并与所述显示数据一起输入所述列驱动电路，其特征在于，
以所述数据启用信号(ENAB)的输入开始时刻为基准，生成所述行驱动用定时信号并输入到所述行驱动电路(2)，以在从所述数据启用信号(ENAB)的输入开始时刻，到所述列驱动电路开始输出1个垂直期间的最初水平期间的所述显示数据为止的期间将所述行驱动信号输出到所述行驱动电路(2)的最上一级的所述行驱动信号的输出端子。
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