CN1847936A - 显示装置 - Google Patents

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Abstract

本发明提供一种显示装置，按每个显示像素配置了存储器，使存储器的误动作减少，使功耗降低。该显示装置具有显示板，该显示板包括多个显示像素、将图像数据提供给上述显示像素的图像线、以及将扫描电压施加到上述显示像素的扫描线，所述显示装置的特征在于：上述显示像素包括存储器，存储上述图像数据；像素电极；以及开关部，根据存储在上述存储器中的上述图像数据，选择第1图像电压或与上述第1图像电压不同的第2图像电压施加到上述像素电极。

Description

显示装置
技术领域
本发明涉及液晶显示装置、EL显示装置等显示装置，尤其涉及按每个显示像素配置了存储器的显示装置。
背景技术
目前，已知一种低功耗、高性能的液晶显示装置，对液晶显示板内的每个显示像素配置存储器，在该存储器中预先存储显示数据，即使在没有来自外部的输入信号时也能够在液晶显示板上显示图像。(参照下述专利文献1)
图11是表示现有的液晶显示板的1个显示像素结构的等价电路图，是表示记载于上述专利文献1中的1个显示像素结构的等价电路图。
在图11中，第1反相器电路INV1和第2反相器电路INV2构成存储器。
控制线L1为高电平，n型MOS晶体管(以下简称为n型晶体管)TR6为导通状态时，在扫描线(也称为栅极线)G上施加选择扫描电压，n型晶体管TR1导通，p型MOS晶体管(以下简称为p型晶体管)TR2截止，在节点node1上写入提供给图像线D的数据(“1”或“0”)。
接着，在扫描线G上施加非选择扫描电压，n型晶体管TR1截止，p型晶体管TR2导通，写入到节点1的数据保持在由第1反相器电路INV1和第2反相器电路INV2构成的存储器中。
例如，在上述图11所示的结构中，在常白的液晶显示板的情况下，在节点node1写入“1”  (节点node2为“0”)时为“黑”，在节点node1写入“0”(节点node2为“1”)时为“白”。
与本发明相关联的在先技术文献如下。
【专利文献1】日本特开2003-108031号公报。
发明内容
在上述图11中，在控制线L1和控制线L2施加极性相反的控制电压。
另外，在图11所示的结构中，采用公共反转驱动方法作为液晶显示板的交流驱动方法，在像素电极上施加正极性的图像电压时，在控制线L1施加高电平，在控制线L2施加低电平，使晶体管TR6导通，晶体管TR7截止；在像素电极上施加负极性的图像电压时，在控制线L1施加低电平，在控制线L2施加高电平，使晶体管TR6截止，晶体管TR7导通。
因此，在图11所示的结构中，当使施加在控制线L1和控制线L2上的控制电压的极性变化，使施加在像素电极上的图像电压的极性变化时，通过第1反相器电路INV1或第2反相器电路INV2一起在显示像素部写入图像电压。
即，当使施加在像素电极的图像电压的极性变化时，通过反相器电路INV1或反相器电路INV2，充电电流流入保持电容Cadd，或放电电流从保持电容Cadd流出。
这样，由于流入保持电容Cadd的充电电流或流出保持电容Cadd的放电电流一起流过，会出现以下的问题：不仅耗电量增加，而且有可能产生噪声，使存储器出现误动作。
本发明是为了解决上述以往技术的问题而完成的，本发明的优点在于，能够提供一项技术，在对每个显示像素设置了存储器的显示装置中，使耗电量降低并使存储器的误动作减少。
本说明书的上述优点和其他优点以及新的特征，将通过本说明书的记载和附图来得到明确。
简单说明本申请所公开的发明中代表性的内容的概要如下。
(1)一种具有显示板的显示装置，该显示板包括多个显示像素、将图像数据提供给上述显示像素的图像线、以及将扫描电压施加到上述显示像素的扫描线，所述显示装置的特征在于：
上述显示像素包括
存储器，存储上述图像数据；
像素电极；以及
开关部，根据存储在上述存储器中的上述图像数据，选择第1图像电压或与上述第1图像电压不同的第2图像电压施加上述像素电极。
(2)根据(1)的发明，
包括与上述像素电极对置的公共电极；
上述第1图像电压施加在上述公共电极上。
(3)根据(2)的发明，
以预定的周期相互交换上述第1图像电压的大小和上述第2图像电压的大小。
(4)根据(1)～(3)中任一项的发明，
在上述存储器所存储的上述图像数据的保持状态下，上述存储器包括输入端子连接在第1节点上、输出端子连接在第2节点上的第1反相器电路，和输入端子连接在第2节点上、输出端子连接在第1节点上的第2反相器电路。
(5)根据(4)的发明，包括
第1开关元件，在上述扫描线被施加了非选择扫描电压时断开，被施加了选择扫描电压时导通，将要提供给上述图像线的上述图像数据施加到上述第1节点；
第2开关元件，连接在上述第1节点和上述第2反相器电路的上述输出端子之间，在上述扫描线被施加了上述选择扫描电压时断开，被施加了上述非扫描电压时导通。
(6)根据(4)或(5)的发明，包括
上述开关部包括第3开关元件和第4开关元件，其中，所述第3开关元件，在上述第1节点的电压为第2状态时断开，为第1状态时导通，将上述第1图像电压施加到上述像素电极；所述第4开关元件，在上述第2节点的电压为第2状态时断开，为第1状态时导通，将上述第2图像电压施加到上述像素电极。
(7)根据(4)或(5)的发明，
上述开关部，包括
第3开关元件，其栅极连接在上述第1节点上，在第1端子上被提供上述第1图像电压，第2端子连接在上述像素电极上；
第4开关元件，其栅极连接在上述第2节点上，在第1端子上被提供上述第2图像电压，第2端子连接在上述像素电极上，
上述第3开关元件的导电类型和上述第4开关元件的导电类型相同。
(8)根据(1)～(7)中任一项的发明，包括
图像线移位寄存器电路，选择要提供上述图像数据的上述图像线；
扫描线移位寄存器电路，选择要提供上述扫描电压的上述扫描线。
(9)根据(8)的发明，包括
上述图像线移位寄存器电路和上述扫描线移位寄存器电路，一体地形成在与上述显示板的形成有上述存储器的基板相同的基板上。
(10)根据(1)～(7)中任一项的发明，包括
图像线地址电路，选择要写入上述图像数据的上述显示像素；
扫描线地址电路，选择要提供上述扫描电压的上述扫描线。
(11)根据(10)的发明，
上述图像线地址电路和上述扫描线地址电路，一体地形成在与上述显示板的形成有上述存储器的基板相同的基板上。
(12)根据(1)～(11)中任一项的发明，包括
反转上述第1图像电压来生成上述第2图像电压的反相器。
(13)根据(1)～(12)中任一项的发明，
由M个上述显示像素构成1个子像素。
(14)根据(13)的发明，
构成上述1个子像素的上述M个显示像素，其各自的上述像素电极的面积互不相同。
(15)根据(14)的发明，
上述图像数据是m位图像数据，其中m≥2；
上述M为上述m；
构成上述1个子像素的上述M个显示像素，其各自的上述像素电极的面积实际上按1∶2∶...∶2m-1的比例进行加权。
(16)根据(13)～(15)中任一项的发明，
给上述1个子像素提供上述图像数据的上述图像线，被分为j条，其中j≥2；
通过上述被分为j条的上述图像线，对上述1个子像素中的j个上述显示像素的每一个，分时地施加上述图像数据。
(17)根据(13)～(16)中任一项的发明，
在上述1个子像素上施加上述扫描电压的上述扫描线，被分为k条，其中k≥2；
通过上述被分为k条的上述扫描线，对上述1个子像素中的M/k个上述显示像素的每一个，分时地施加上述扫描电压。
根据(1)～(17)中任一项的发明，上述显示装置是液晶显示装置。
以上列举的构成仅是本发明的一例，本发明不限于上述构成，在不脱离本发明的主旨的范围内可以进行各种变更。
简单说明利用在本申请所公开的发明中代表性的装置而得到的效果如下。
按照本发明，在对每个显示像素配置了存储器的显示装置中，可以使存储器的误动作减少，使耗电量降低。
附图说明
图1是表示本发明的实施例1的液晶显示装置的概略结构的框图。
图2是图1所示的显示像素的等价电路的图。
图3是表示本发明的实施例1的液晶显示装置的VCOM电压与反转了VCOM电压的 VCOM电压之间的关系的图。
图4是表示本发明的实施例2的液晶显示装置的概略结构的框图。
图5是图4所示的显示像素的等价电路的图。
图6是表示本发明的实施例2的液晶显示装置的变形例的概略结构的框图。
图7是表示本发明的实施例3的液晶显示装置的概略结构的框图。
图8A、图8B是用于说明本发明的实施例3的液晶显示板的子像素和面积灰阶的图。
图9是表示图7所示的水平移位寄存器电路和数据锁存电路的内部结构的电路图。
图10是表示本发明的实施例3的液晶显示装置的驱动时序图的一例的图。
图11是表示以往的液晶显示板的1个显示像素结构的等价电路图。
具体实施方式
以下将参照附图详细说明将本发明适用于液晶显示装置的实施例。
在用于说明实施例的全部附图中，对具有相同功能的部分添加相同的标号，省略其反复的说明。
[实施例1]
图1是表示本发明的实施例1的液晶显示装置的概略结构的框图。
在图1中，100是显示部，110是水平移位寄存器电路(也称为图像线移位寄存器电路)，120是垂直移位寄存器电路(也称为扫描线移位寄存器电路)，10是显示像素。
显示部100包括：按矩阵形状配置的多个显示像素10；将显示数据提供给各个显示像素10的图像线(也称为漏极线)D(D1，D2，D3，……，Dn)；以及将扫描信号提供给各个显示像素10的扫描线(也称为栅极线)G(G1，G2，G3，……，Gn)。
在这里，图像线D为n条，扫描线G为n条，但也可以使图像线D的条数与扫描线G的条数不同。
图2是图1所示的显示像素10的等价电路的图。
在图2中，第1反相器电路INV1和第2反相器电路INV2构成存储器。
第1反相器电路INV1，其输入端子连接在第1节点(也称为节点1)node1上，输出端子连接在第2节点(也称为节点2)node2上。第2反相器电路INV2，其输入端子连接在第2节点node2上，输出端子连接在第1节点node1上。即，第1反相器电路与第2反相器电路连接成环状。第2反相器电路INV2的输出端子，通过p型晶体管TR2与第1反相器电路INV2的输入端子连接，但是，该p型晶体管TR2处于通常状态、即存储器保持动作的状态时为导通的。因此，在本说明书中，即使在通过处于存储器保持动作的状态时为导通的晶体管来进行连接的情况下，也表达为“第1反相器电路INV1与第2反相器电路INV2连接成环状”。对于  “第2反相器电路INV2的输出端子连接在第1节点node1上”这样的表达也是相同的。
在节点node1上，n型晶体管TR1(本发明的第1开关元件)的漏极与p型晶体管TR2(本发明的第2开关元件)的漏极连接，并且，n型晶体管TR1的栅极和p型晶体管TR2的栅极，与扫描线G连接。
因此，在扫描线G上施加选择扫描电压(例如为高电平)时，n型晶体管TR1导通，p型晶体管TR2截止，在节点node1上写入施加在图像线D中的数据(“1”或“0”)。即，进行写入动作。
另外，在扫描线G上施加非选择扫描电压(例如为低电平)时，n型晶体管TR1截止，p型晶体管TR2导通，写入到节点node1的数据值保持在由第1反相器电路INV1和第2反相器电路INV2组成的存储器中。即，进行保持动作。
栅极连接在第1节点node1上的n型晶体管TR3(本发明中的第3开关元件)，在第1节点node1的电压为高电平时导通，向像素电极ITO1施加第1图像电压(这里，为施加到公共电极ITO2的VCOM电压)。
栅极连接在第2节点node2上的n型晶体管TR4(本发明中的第4开关元件)，在第2节点node2的电压为高电平时导通，向像素电极ITO1施加第2图像电压(这里，为由反相器反转了施加到公共电极ITO2的VCOM电压的 VCOM电压)。
第1节点node1和第2节点node2之间的关系是信号电平反转的关系。并且，n型晶体管TR3和n型晶体管TR4的导电方式相同。由于第1节点node1的电压为高电平时，第2节点node2的电压为低电平，因此，n型晶体管TR3导通，n型晶体管TR4截止。由于第1节点node1的电压为低电平时，第2节点node2的电压为高电平，因此，n型晶体管TR3截止，n型晶体管TR4导通。
这样，开关部(例如由同一导电方式的2个晶体管TR3、TR4构成)根据存储器所存储的数据(从图像线D写入存储器的数据)，选择第1图像电压或第2图像电压施加到像素电极ITO1。
利用像素电极ITO1和与之相对配置的公共电极(公共电极，也称对置电极)ITO2之间产生的电场来驱动液晶LC。公共电极ITO2可以形成在与形成有像素电极ITO1的基板相同的基板上，也可以形成在不同的基板上。
构成反相器电路INV1、INV2的晶体管和晶体管TR1、TR2、TR3、TR4作为半导体层由采用多晶硅的薄膜晶体管构成。
图1中的水平移位寄存器电路110和垂直移位寄存器电路120是液晶显示板内的电路，这些电路与构成反相器电路INV1、INV2的晶体管及晶体管TR1、TR2、TR3、TR4相同，作为半导体层由采用多晶硅的薄膜晶体管构成，这些薄膜晶体管与反相器电路INV1、INV2等一并形成。
在本实施例中，由垂直移位寄存器电路120按每个1H期间(扫描期间)依次对各扫描线G输出扫描线选择信号。由此，栅极连接在各扫描线G上的晶体管TR1导通，晶体管TR2截止。
另外，在本实施例中，按每个图像线D设置开关晶体管SW1～SWn。这些开关晶体管SW1～SWn在1H期间(扫描期间)内，通过从水平移位寄存器110所输出的高电平的移位输出，依次被导通，连接图像线D和数据线data。
由此，在节点node1上写入施加在图像线D中的数据(“1”或“0”)，在显示部100显示图像。
另外，在扫描线G施加非选择扫描电压时，晶体管TR1截止，晶体管TR2导通，写入到节点node1的数据值被保持在由第1反相器电路INV1和第2反相器电路INV2组成的存储器中。因此，即使在没有图像输入的期间内，也能在显示部100显示图像。
例如，在本实施例中，在常白的液晶显示板的情况下，在节点node1写入“1”(节点node2写入“0”)时为“白”，在节点node1写入“0”(节点node2写入“1”)时为“黑”。
在不需要重写图像的情况下，能够停止水平移位寄存器电路110和垂直移位寄存器电路120的动作，因此，可以降低功耗。
在本实施例中，也采用公共反转驱动方法作为液晶显示板的交流驱动方法。在本实施例中，如图3所示，使VCOM电压(第1图像电压)和反转了VCOM电压的 VCOM电压(第2图像电压)随公共反转周期进行变化即可。VCOM电压按照公共反转周期，在低电平(例如0V)和高电平(例如5V)之间进行反转。能够使用反相器将VCOM电压反转来生成 VCOM电压。VCOM电压为低电平时， VCOM电压为高电平；VCOM电压为高电平时， VCOM电压为低电平。即，以预定周期相互交换VCOM电压的大小和 VCOM电压的大小。
在本实施例中，不存在这样的情况：如图11所示的结构那样，在使施加在像素电极的图像电压的极性变化时，经由反相器电路INV1或反相器电路INV2，流入保持电容Cadd的充电电流或流出保持电容Cadd的放电电流一起流过，因此，可以减少由噪声的产生引起的存储器的误动作，使功耗降低。
进而，在本实施例中，由于不需要图11所示的保持电容Cadd，所以能够增加各个显示像素的透光率。另外，由于不需要保持电容Cadd，对像素电极的写入负载小，所以能够降低功耗。
另外，在图11所示的情况下，对存储器写入数据时，控制线L1被限制为高电平，但在本实施例中，由于使数据写入与公共反转驱动方法的反转周期各自独立，能够简单的结构构成通用性高的液晶显示装置。不需要使公共反转周期与数据写入同步，因此能够任意地设定公共反转的周期或时序。例如，公共反转周期可以按1帧、1行(1扫描期间)、多行(多个扫描期间)进行设定，也可以设定为其他的任意的期间。
[实施例2]
图4是表示本发明的实施例2的液晶显示装置的概略结构的框图。
在本实施例中，使用X-地址电路(也称为图像线地址电路)210和Y-地址电路(也称为扫描线地址电路)220来替代图1所示的水平移位寄存器电路110和垂直移位寄存器电路120。以下，以与上述实施例1的不同点为中心来说明本实施例。
X-地址电路210和Y-地址电路220都由n型MOS晶体管列和p型MOS晶体管列构成。将每个晶体管的栅极与预定的地址线连接，使得与所输入的地址对应地选择扫描线G或图像线D。
XAD0B～XAD7B是XAD0～XAD7的反转脉冲，YAD0B～YAD7B是YAD0～YAD7的反转脉冲，图4表示8位的例子。因此，能够分别选择从1条至n＝28＝256条为止的扫描线G和图像线D。数据被输入到直接显示像素10的存储器。
图5是图4所示的显示像素的等价电路图。
图5所示的等价电路与图2所示的等价电路的不同点在于，n型晶体管TR1与晶体管TR5串连连接，该n型晶体管TR5的栅极与图像线D连接，n型晶体管TR5的源极与数据线data连接。
在本实施例中，Y-地址电路220根据所输入的地址(YAD0～YAD7，YAD0B～YAD7B)选择预定的扫描线G，向该所选择的扫描线输出选择扫描电压。由此，栅极与该所选择的扫描线G相连接的n型晶体管TR1导通，p型晶体管TR2截止。
并且，X-地址电路210根据所输入的地址(XAD0～XAD7，XAD0B～XAD7B)选择预定的图像线D，栅极与该所选择的图像线D相连接的n型晶体管TR5导通。
因此，在该所选择的显示像素10的节点node1上写入施加在数据线data中的数据(“1”或“0”)，在没有图像输入的期间内，也在显示部100显示图像。
在本实施例中，也能够使施加在公共电极ITO2上的VCOM电压的反转周期与数据的写入各自独立。
因此，也可以是，如图6所示，在液晶显示板内部内置由振荡电路150和分频电路151组成的公共电压生成电路，产生施加在公共电极ITO2上的VCOM电压。能够由反相器将VCOM电压反转来生成反相VCOM电压。
另外，在本实施例中，在写入数据时，不需要考虑VCOM电压为高电平或低电平，在写入数据时，只要输入数据和地址即可，能够如使用通常的SRAM存储器一样在液晶显示板上显示图像。因此，能够兼用图像的缓存器，能够减少图像存储器。
[实施例3]
图7是表示本发明的实施例3的液晶显示装置的概略结构的框图。
本实施例为采用了面积灰阶的实施例，如图8A所示，在本实施例中，由4个显示像素11～14构成1个子像素Subpix。
因此，如图8B所示，构成1个子像素Subpix的4个显示像素(11～14)，在像素电极的面积上被取为预定的权(weight)。
在图8B所示的例子中，显示数据是4位的显示数据D0、D1、D2、D3。4个显示像素11-14的像素电极ITO1的面积实际上为1(1＝20)∶2(2＝21)∶4(4＝22)∶8(8＝23)的比例。
在此，4位的显示数据D0、D1、D2、D3中的数据D0输入到显示像素11，同样地，4位的显示数据D0、D1、D2、D3中的数据D1输入到显示像素12，4位的显示数据D0、D1、D2、D3中的数据D2输入到显示像素13，4位的显示数据D0、D1、D2、D3中的数据D3输入到显示像素14。
在图8A～图8B所示的例子中，由于4个显示像素11～14的等价电路与图2所示的等价电路相同，因此省略再次的说明。
另外，如图7所示，在本实施例中，为了对构成1个子像素Subpix的4个显示像素11～14分别输入选择扫描电压和数据，将图1所示的1条图像线D分为Da和Db这2条图像线，将图1所示的1条扫描线G分为Ga和Gb这2条扫描线。
进而，在水平移位寄存器电路110和显示部100之间设有数据锁存电路130。
图9是表示图7所示的水平移位寄存器电路和数据锁存电路的内部结构的电路图。
水平移位寄存器电路110根据启动脉冲HIN和时钟HCK进行动作。
所输入的4位显示数据D0、D1、D2、D3，通过从水平移位寄存器电路110所输出的高电平的移位输出，在1H期间(扫描期间)内依次被数据锁存电路130锁存。
被数据锁存电路130锁存的数据分2次输入到存储器。控制该数据的是控制信号HCON1、HCON2、VCON1、VCON2。
当控制信号HCON1为高电平，控制信号HCON2为低电平时，门电路TG1、TG4导通，由数据锁存电路130将4位显示数据D0、D1、D2、D3中的数据D0输出到图像线D1a～Dna，另外，将4位显示数据D0、D1、D2、D3中的数据D1输出到图像线D1b～Dnb。
与此同步，当控制信号VCON1为高电平，控制信号VCON2为低电平时，来自垂直移位寄存器电路120的扫描线选择信号，经由“与”逻辑电路AND1输出到扫描G1a～Gna中的一者，4位显示数据D0、D1、D2、D3中的数据D0输入到显示像素11，4位显示数据D0、D1、D2、D3中的数据D1输入到显示像素12。
另外，当控制信号HCON1为低电平，控制信号HCON2为高电平时，门电路TG2、TG3导通，由数据锁存电路130将4位显示数据D0、D1、D2、D3中的数据D3输出到图像线D1a～Dna，另外，将4位显示数据D0、D1、D2、D3中的数据D2输出到图像线D1b～Dnb。
与此同步，当控制信号VCON1为低电平，控制信号VCON2为高电平时，来自垂直移位寄存器电路120的扫描线选择信号经由“与”逻辑电路AND2输出到扫描线G1a～Gna中的一者，4位显示数据D0、D1、D2、D3中的数据D3输入到显示像素14，4位显示数据D0、D1、D2、D3中的数据D2输入到显示像素13。
图10表示本实施例的驱动时序图的一个例子。
在控制信号HCON1为高电平、控制信号VCON1为高电平的期间，4位显示数据D0、D1、D2、D3中的数据D0输出到图像线D1a～Dna，4位显示数据D0、D1、D2、D3中的数据D1输出到图像线D1b～Dnb。这些数据输入到构成1个子像素Subpix的4个显示像素11～14中的显示像素11和显示像素12。
接着，在控制信号HCON2为高电平，控制信号VCON2为高电平的期间，4位显示数据D0、D1、D2、D3中的数据D3输出到图像线D1a～Dna，4位显示数据D0、D1、D2、D3中的数据D2输出到图像线D1b～Dnb。这些数据输入到构成1个子像素Subpix的4个显示像素11～14中的显示像素14和显示像素13。
优选的是，在从上一个1H期间的结束(图10中水平同步信号HSYNC的下降沿)到下一信号的输入为止的消隐(blanking)期间进行上述的数据传送处理。这时，在数据传送处理之后，即控制信号HCON、VCON2的下降沿之后，以未图示的定时输入下一信号(下一个4位显示数据D0、D1、D2、D3)，通过由水平移位寄存器电路110所输出的高电平的移位输出，依次在数据锁存电路130中锁存。
上述说明，是对于显示数据为4位的情况的说明，但是，在显示数据为m(m≥2)位的情况下，构成1个子像素Subpix的显示像素数为m个，此时像素电极的面积的权，实际上取为20∶21∶...∶2m-1的比例即可。扫描线G、图像线D的分配方法也可以适当变化。例如，m＝6位时，最好是将图像线D分为3条，但也可以将扫描线G分为3条。
另外，在上述的各个实施例中，对把本发明应用于液晶显示装置的情况进行了说明，但本发明并不仅限于此，不言而喻，本发明也可以应用于EL显示装置等(有机EL显示装置等)。
对于使用了实施例2所说明的地址电路的实施例，也可以使其应用实施例3所说明的面积灰阶。此时，4个显示像素11～14的等价电路使用图5所示的等价电路。
在上述各实施例中，对于将周边电路(例如，具有移位寄存器的驱动电路)内置于显示板中(一体地形成在显示板的基板上)的情况进行了说明，但本发明并不仅限于此，也可以使用半导体芯片构成周边电路的一部分功能。
在上述各实施例中，对使用MOS晶体管作为薄膜晶体管的情况进行了说明，但也可以使用比MOS晶体管概念更宽泛的MIS晶体管。
以上，基于上述实施例具体说明了本发明者所设计的发明，但本发明不限于上述实施例，在不脱离本发明的主旨的范围内可以进行各种变更。

Claims (18)

1.一种具有显示板的显示装置，该显示板包括多个显示像素、将图像数据提供给上述显示像素的图像线、以及将扫描电压施加到上述显示像素的扫描线，所述显示装置的特征在于：
上述显示像素包括
存储器，存储上述图像数据；
像素电极；以及
开关部，根据存储在上述存储器中的上述图像数据，选择第1图像电压或与上述第1图像电压不同的第2图像电压施加到上述像素电极。
2.根据权利要求1所述的显示装置，其特征在于：
包括与上述像素电极对置的公共电极；
在上述公共电极上施加上述第1图像电压。
3.根据权利要求2所述的显示装置，其特征在于：
以预定的周期相互交换上述第1图像电压的大小和上述第2图像电压的大小。
4.根据权利要求1所述的显示装置，其特征在于：
在保持上述存储器所存储的上述图像数据的状态下，上述存储器包括输入端子连接在第1节点上、输出端子连接在第2节点上的第1反相器电路，和输入端子连接在第2节点上、输出端子连接在第1节点上的第2反相器电路。
5.根据权利要求4所述的显示装置，其特征在于，包括：
第1开关元件，在上述扫描线被施加了非选择扫描电压时断开，被施加了选择扫描电压时导通，将要提供给上述图像线的上述图像数据施加到上述第1节点；
第2开关元件，连接在上述第1节点和上述第2反相器电路的上述输出端子之间，在上述扫描线被施加了上述选择扫描电压时断开，被施加了上述非扫描电压时导通。
6.根据权利要求4所述的显示装置，其特征在于：
上述开关部包括第3开关元件和第4开关元件，其中，所述第3开关元件，在上述第1节点的电压为第2状态时断开，为第1状态时导通，将上述第1图像电压施加到上述像素电极；所述第4开关元件，在上述第2节点的电压为第2状态时断开，为第1状态时导通，将上述第2图像电压施加到上述像素电极。
7.根据权利要求4所述的显示装置，其特征在于：
上述开关部，包括
第3开关元件，其栅极连接在上述第1节点上，在第1端子上被提供上述第1图像电压，第2端子连接在上述像素电极上；
第4开关元件，其栅极连接在上述第2节点上，在第1端子上被提供上述第2图像电压，第2端子连接在上述像素电极上，
上述第3开关元件的导电类型和上述第4开关元件的导电类型相同。
8.根据权利要求1所述的显示装置，其特征在于，包括：
图像线移位寄存器电路，选择要提供上述图像数据的上述图像线；
扫描线移位寄存器电路，选择要提供上述扫描电压的上述扫描线。
9.根据权利要求8所述的显示装置，其特征在于：
上述图像线移位寄存器电路和上述扫描线移位寄存器电路，一体地形成在与上述显示板的形成有上述存储器的基板相同的基板上。
10.根据权利要求1所述的显示装置，其特征在于，包括：
图像线地址电路，选择要写入上述图像数据的上述显示像素；
扫描线地址电路，选择要提供上述扫描电压的上述扫描线。
11.根据权利要求10所述的显示装置，其特征在于：
上述图像线地址电路和上述扫描线地址电路，一体地形成在与上述显示板的形成有上述存储器的基板相同的基板上。
12.根据权利要求1所述的显示装置，其特征在于，包括：
反转上述第1图像电压来生成上述第2图像电压的反相器。
13.根据权利要求1所述的显示装置，其特征在于：
由M个上述显示像素构成1个子像素。
14.根据权利要求13所述的显示装置，其特征在于：
构成上述1个子像素的上述M个上述显示像素，其各自的上述像素电极的面积互不相同。
15.根据权利要求14所述的显示装置，其特征在于：
上述图像数据是m位图像数据，其中m≥2；
上述M为上述m；
构成上述1个子像素的上述M个显示像素，其各自的上述像素电极的面积实际上按1∶2∶…∶2m-1的比例进行加权。
16.根据权利要求13所述的显示装置，其特征在于：
给上述1个子像素提供上述图像数据的上述图像线，被分为j条，其中j≥2；
通过上述被分为j条的上述图像线，对上述1个子像素中的j个上述显示像素的每一个，分时地施加上述图像数据。
17.根据权利要求13所述的显示装置，其特征在于：
在上述1个子像素上施加上述扫描电压的上述扫描线，被分为k条，其中k≥2；
通过上述被分为k条的上述扫描线，对上述1个子像素中的M/k个上述显示像素的每一个，分时地施加上述扫描电压。
18.根据权利要求1至权利要求17中任一项所述的显示装置，其特征在于：
上述显示装置是液晶显示装置。
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C56 Change in the name or address of the patentee
CP01 Change in the name or title of a patent holder

Address after: Chiba County, Japan

Co-patentee after: Panasonic Liquid Crystal Display Co.,Ltd.

Patentee after: Hitachi Displays, Ltd.

Address before: Chiba County, Japan

Co-patentee before: IPS pioneer support society

Patentee before: Hitachi Displays, Ltd.

Address after: Chiba County, Japan

Co-patentee after: IPS Pioneer Support Society

Patentee after: Hitachi Displays, Ltd.

Address before: Chiba County, Japan

Patentee before: Hitachi Displays, Ltd.

C56 Change in the name or address of the patentee

Owner name: APAN DISPLAY EAST, INC.

Free format text: FORMER NAME: HITACHI DISPLAY CO., LTD.

Owner name: JAPAN DISPLAY, INC.

Free format text: FORMER NAME: APAN DISPLAY EAST, INC.

CP01 Change in the name or title of a patent holder

Address after: Chiba County, Japan

Patentee after: Japan Display East Inc.

Patentee after: Panasonic Liquid Crystal Display Co.,Ltd.

Address before: Chiba County, Japan

Patentee before: Hitachi Displays, Ltd.

Patentee before: Panasonic Liquid Crystal Display Co.,Ltd.

CP03 Change of name, title or address

Address after: Tokyo port xixinqiao Japan three chome 7 No. 1

Patentee after: JAPAN DISPLAY Inc.

Patentee after: Panasonic Liquid Crystal Display Co.,Ltd.

Address before: Chiba County, Japan

Patentee before: Japan Display East Inc.

Patentee before: Panasonic Liquid Crystal Display Co.,Ltd.

EE01 Entry into force of recordation of patent licensing contract

Application publication date: 20061018

Assignee: BOE TECHNOLOGY GROUP Co.,Ltd.

Assignor: JAPAN DISPLAY Inc.|Panasonic Liquid Crystal Display Co.,Ltd.

Contract record no.: 2013990000688

Denomination of invention: Image display

Granted publication date: 20090506

License type: Common License

Record date: 20131016

LICC Enforcement, change and cancellation of record of contracts on the licence for exploitation of a patent or utility model
TR01 Transfer of patent right

Effective date of registration: 20231204

Address after: Tokyo, Japan

Patentee after: JAPAN DISPLAY Inc.

Patentee after: PANASONIC INTELLECTUAL PROPERTY CORPORATION OF AMERICA

Address before: Tokyo port xixinqiao Japan three chome 7 No. 1

Patentee before: JAPAN DISPLAY Inc.

Patentee before: Panasonic Liquid Crystal Display Co.,Ltd.

TR01 Transfer of patent right