CN1198279A - 保持双工信息处理单元微同步运行的方法 - Google Patents

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Abstract

互不依赖的时钟脉冲(SCLK,RXCK)对单元(CTR0,CTR1)产生影响。为了避免微同步的损失,在从一个时钟系统到另一个时钟系统的信息传输时,通过不同的错误位置,该错误位置在通过单元接收的信息上,在用于处理的接收信息转发前暂存该接收信息,或者在结果信息发出之前暂存该结果信息。在无错误接收的情况下,实现了单元的交叉同步。当同步信号消失时,在一个配合单元上由于带有错误的接收其拒绝此尽管完好的接收信息。

Description

保持双工信息处理单元微同步运行的方法
本发明涉及的是根据权利要求1的前述部分所述保持双工信息处理单元微同步运行的方法，因此，双工单元通过一公共的内部处理时钟工作，该处理时钟不依赖于此时钟，通过它接收必须处理的信息或发出信息处理结果。此外，这样的单元总是配备一个用于接收的信息或必须发出的信息处理结果的错误监控装置。
已提到的信息处理单元的双工的基础在于，努力保证一高水平的故障保护和错误保护。如果为了处理的目的，通过其它的时钟系统转交根据一个已提到的时钟系统接收的信息，在相关地通过多谐振荡电路时，每隔一重复周期可能引起信号接收的波动，因此妨碍了关于两个单元的相应部分的微同步化，并且因此不再保证力求的故障保护和错误保护。另外，为了监控必须处理的信息的完美接收，通过已提到的装置可以识别这样的传输错误，这不符合防止被干扰信息的处理，尽管因为妨碍了单元的微同步的并行工作。同样在必须发出的信息处理结果中存在错误。
本发明的任务在于：防止在这样的双工单元运行的微同步化中产生已提到的干扰。
这个任务是通过具有权利要求1特征部分中给出的特征的方法解决的。根据本发明的方法，不仅保证使单元的要处理部分时钟同步地运行，而且也保证在产生关于接收的信息和只涉及一个单元的待发出的信息处理结果的错误的情况下，维持一致的特性。
本发明的其它实施形式在从属权利要求中标明。
根据权利要求2，以此为出发点，为了识别硬件错误，在双工单元内部，信息处理单元在控制一检查结构中被复制和说明，正如在这样情况下，通过使用两级方法恰当地考虑微同步化的需求。
根据权利要求3，被互换的同步信号是由单独的内部输入接口电路和输出接口电路的单个同步信号形成的多工信号。
权利要求4涉及了在处理单元运行开始或恢复运行时的过程，因此，通过公共的由内部系统时钟得出的复位信号复原非多工的单个同步信号的再循环，该单个同步信号是由单元的处理部分发出的。
在权利要求5中指出，如果不为对于输出接口电路来说有决定性作用的时钟系统提供特有的复位信号，相反这个复位信号是由系统时钟得出的，则在运行开始或恢复运行的情况下，控制处理部分和检查处理部分的输出接口电路被复位，所以由控制处理部分的输出信号得出检查处理部分的复位信号。
下面参考附图根据实施例详细说明本发明。
图示为：
图1所示为具有处理部分的信息处理单元的可能状况，在它上面可以使用按照本发明的方法，
图2和图3以同步信号的时间关系的图解表明时序图；
图4以在复位情况下相互关系的图解表明控制处理部分和附属的检查处理部分的输出范围。
在图1中描述了二个信息处理单元CTR0和CTR1，它例如可能用于处理ATM信息。这里，这个处理单元接在连接网络上，该连接网络在所说明的情况中具有完全一样的部件SN0和SN1。这个处理单元CRT0和CRT1通过用于传输ATM信息的接收线路1r0、1r1和传送线路1t0、1t1的网络用这个方式与连接网络部件SN0和SN1相连接，从各个连接网的部件传来的ATM信息完全一样地不仅到达一个处理单元也到达另一个处理单元，由这个处理单元发出的ATM信息可能完全一样地输送给两个连接网络部件SN0和SN1。
这里，处理单元CTR0和CTR1总是具有二个处理部分C-ATM30和M-ATM30，它们在一个所谓的控制-检查结构中运行，也就是说在检查处理部分C-ATM30中，发送输出端TP0和TP1被转换为输入端，由各自所属的控制处理部分M-ATM30的发送输出端TP0和TP1发出的和在第一个通信线中为了在连接网络部分SN0和SN1上转发而确定的ATM发送信息作为输入信息接收。这里未说明的检查处理部分的内部部分比较在这个路径上接收到的信号和内部产生为输出信号的信号，并在确定不平衡的情况下发出一个相应的出错信息。
用一接收脉冲RXCK0或RXCK1接收从半个连接网络SN0和SN1传来的ATM信息。通过一个里面独立的非同步的内部系统时钟SCLK实现接收到的ATM信息的处理。通过一个穿过处理单元CTR0和CTR1的划线的传输线用图表说明接收范围和发送范围以及处理部分的处理范围的不同时钟影响。
从处理部分的一个由一个时钟系统影响的组件接收的信号在一个由其它时钟系统影响的组件上每隔一重复周期可能产生波动，因此没有特别的措施妨碍处理部分的微同步的并行工作，这导致不再保证处理单元CTR0和CTR1的并行工作。
为了保障处理部分的微同步的并行工作，以在这里没有进一步说明的方法在处理接收信息之前暂存它，或者在相应的处理结果转发前暂存该处理结果，通过转换信息信号，使转发信息处理的时刻或转发全部处理部分的信息结果的时刻互相保持同步。这时特别地采取这样措施，首先，通过发出一标明处理阶段、由内部系统时钟SCLK得出的同步信号MS0，在各自其它的处理部分上建立在控制处理部分和检查处理部分之间的同步操作，然后通过交换同步信号RS0在经由控制器LC的路径上建立从处理单元到处理单元CTR0或CTR1的处理部分的并行工作。
在图2中说明了一个这样的同步输出信号MSO，它表明了各自其它的处理部分的同步输入信号MSI。图3相应地指出了在处理单元CTR0和CTR1之间交换的同步输出信号RS0，它是各自其它的处理设备的同步输入信号。为了减少输出接口，已提出的同步信号MS0和RS0表明由用于处理部分的准并行操作部件的单个同步信号形成的多工信号。
传输错误可能在从连接网络部件SN0和SN1到处理单元CRT0和CTR1的路径上以不同的方式影响接收的ATM信息，由这里没有表明的监控装置以此结果识别这样的传输错误，即，取消被干扰的信息，也不再进行处理并且发出一个空白信息作为相应的处理结果。
此外，被干扰信息的接收带来这个结果，通过相关的处理单元在配合单元上中止同步信号RS0的发出。相反这带来这个结果，由于期待的同步信号的消失，配合单元尽管它已收到一个完好的ATM信号，同样拒绝这个信息，因此，防止了处理单元发出不同的ATM信息。
在运行开始阶段或运行恢复阶段中，通过公共的由内部系统时钟SCLK得出的复位信号恢复同步信号MS0的再循环。
为了进行与控制  检查操作有关的符合实际的结论的逐位比较，该结论可能通过输出接口电路TP0和TP1产生，那么在运行开始或恢复运行时必须恢复这个输出接口电路。对ATM信息的传输有决定作用的时钟RXCK0或RXCK1影响这个接口电路。可是仅因为提供了这个已提到的由内部系统时钟SCLK得出的复位信号，这里根据本发明的进一步改进会引起，所谓的输出接口电路的复位不是通过一个基于系统时钟的复位信号对检查处理部分复位，象控制处理部分一样，尽管提供了这个复位信号，参见图4中Reset-OUT-C信号，由于在激励器上赋值‘0’也不再传送这个信号，而是通过一个由输出信号得出的复位信号，这个输出信号是控制处理部分M-ATM30通过它的输出接口电路PAD-M转交到控制处理部分的作为输入端运行的输出接口电路PAD-C上，在C-ATM30情况下参见图4中的信号Reset-IN-M。

Claims (5)

1.保持双工信息处理单元微同步并行运行的方法，但各自内部处理时钟相互同步且不依赖于此时钟，通过这个时钟接收待处理的信息或发出处理结果，每个单元包含用于接收信息和待发出的信息结果的错误监控的装置，
其特征在于，具有以下特征：
a)在信息处理之前暂存处理单元(CRT0，CRT1)的信息，在结果信息转交之前暂存相应的结果信息，
b)当接收信息或待发出的信息处理结果无错误而接收一待处理的信息时，该单元总是给配合单元提供一个表明相应处理阶段并由内部系统时钟(SCLK)得出的同步信号(RS0)，通过此信号使相应的处理阶段的开始阶段同步，
c)当配合单元方面的同步信号消失时，在按顺序接收信息的情况下，在相关的单元上如果接收到一个干扰信息，中断信息处理，或者在存在一个未被干扰的信息处理结果的情况下，代替地发出一个空白信息。
2.根据权利要求1的方法，其特征在于：
a)为了确定硬件错误，在信息处理时，单元(CTR0，CTR1)的处理部分在控制-检查结果中复制，这时，部件(M-ATM30，C-ATM30)的信息输入端被并行运行，检查部分(C-ATM30)的输出端作为信息输入端运行，它提供控制部分(M-ATM30)的输出信号作为进行比较的输入信号，
b)当单元之间的同步信号(RS0)转换之前，通过转换同样由内部系统时钟得出的同步信号(MSD)使单元的控制部分和检查部分之间处理时钟的脉冲上升沿同步。
3.根据权利要求1或2的方法，其特征在于，
被转换的同步信号(RS0，MS0)是由用于单个的内部输入接口电路和输出接口电路的单独同步信号形成的多工信号。
4.根据权利要求3的方法，其特征在于，
在运行开始阶段，通过一个公共的由内部系统时钟(SCLK)得出的复位信号复原多工的单元同步信号(MS0)的再循环，该同步信号是由单元(CTR0，CTR1)的处理部分(M-ATM30，C-ATM30)发出的。
5.根据权利要求4的方法，其特征在于，
在这个时钟系统的复位信号出错的情况下，通过一个由控制处理部分(M-ATM30)通过它的输出接口电路发出的复位信号对检查处理部分(C-ATM30)的输出接口电路(PAD-C)同步，不仅内部系统时钟而且接收时钟和发送时钟都对该输出接口电路起决定作用。
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