CN116487413B - 一种低放大倍数变化率的功率晶体管及其制作方法 - Google Patents

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Abstract

一种低放大倍数变化率的功率晶体管及其制作方法,包括由单面抛光的单晶片形成的N+集电区,在N+集电区对应所述单晶片的抛光面设有N‑外延层,其在N‑外延层上表面设有P型外延层,在P型外延层上表面设有P+接触区,在P+接触区上表面设有二氧化硅氧化层一,在P+接触区上表面设有N+发射区,在二氧化硅氧化层一表面和N+发射区表面设有二氧化硅氧化层二,在所述P+接触区和N+发射区表面分别引出晶体管基极B、发射极E,所述N+集电区对应所述单晶片的研磨面引出集电极C。利用P型外延基区的方法替代NPN晶体管的基区硼扩散,从而避开了高温长时间的扩散,缩短了工艺时间,提高了生产效率,降低了制造成本;同时也获得了较低的放大倍数低温变化率,提高了少子寿命,器件的可靠性得到了提升。

Description

一种低放大倍数变化率的功率晶体管及其制作方法
技术领域
本发明涉及一种半导体器件,尤其涉及一种低放大倍数变化率的功率晶体管及其制作方法。
背景技术
传统的低频大功率NPN晶体管多采用三重扩散工艺,即衬底的制作、基区、发射区的制作均采用扩散方法,基区扩散通常采用离子注入或扩散源的方法,在高温下形成20-25μm的扩散区,为了得到较低的放大倍数变化率,通常基区采用较高的掺杂浓度,无论是注入法和扩散源法都无法避免高温长时间的扩散过程,因此生产效率低,制造成本也较高,且产品的放大倍数变化率往往不易满足特殊用户的实际使用要求。
发明内容
本发明要解决的技术问题是提供一种低放大倍数变化率的功率晶体管及其制作方法,既避免了高温长时间的扩散,又可获得放大倍数较小的低温变化率。
本发明的技术方案是:
一种低放大倍数变化率的功率晶体管,包括由单面抛光的单晶片形成的N+集电区,在N+集电区对应所述单晶片的抛光面设有N-外延层,其特征是:在N-外延层上表面设有P型外延层,在P型外延层上表面设有P+接触区,在P+接触区上表面设有二氧化硅氧化层一,在P+接触区上表面设有N+发射区,在二氧化硅氧化层一表面和N+发射区表面设有二氧化硅氧化层二,在所述P+接触区和N+发射区表面分别引出晶体管基极B、发射极E,所述N+集电区对应所述单晶片的研磨面引出集电极C。
进一步地,在P+接触区和集电结侧面设有玻璃钝化沟槽台面,实现对集电结的保护。
进一步地,所述N+发射区的结深大于P+接触区的结深。
进一步地,所述单面抛光的单晶片的晶向为<111>,电阻率为0.002~0.003Ω·cm,厚度为450±5μm。
进一步地,所述N-外延层的厚度为20~50μm,所述N-外延层的电阻率为7~20Ω·cm。
进一步地,所述P型外延层的厚度为20~25μm,所述P型外延层的电阻率为4~5Ω·cm。
进一步地,所述P+接触区的结深1.5~2μm,表面浓度为4~5×1018cm-3
进一步地,所述N+发射区的结深为2.1~3μm,N+发射区的表面杂质浓度为1~2×1020cm-3
如上所述的一种低放大倍数变化率的功率晶体管的制作方法,其特征是,
步骤包括:
S1、选择单面抛光的单晶片作为N+集电区;
S2、在N+集电区对应所述单晶片的抛光面通过外延工艺形成N-外延层;
S3、在N-外延层上表面通过外延工艺形成P型外延层;
S4、在P型外延层上表面扩硼形成P+接触区;同时在硅片表面形成二氧化硅氧化层一;
S5、在P+接触区表面光刻腐蚀,扩散磷形成N+发射区;同时在硅片表面形成二氧化硅氧化层二;
S6、在所述P+接触区和N+发射区表面引出金属电极B、E,在N+集成区对应N型单晶片的研磨面即集电区引出金属电极C。
进一步,步骤S5完成后,通过光刻掩蔽、利用玻璃钝化工艺在P+接触区侧面位置和集电结侧面形成内沟槽台面3,从而实现对集电结的保护。
本发明的有益效果是:利用P型外延基区的方法替代NPN晶体管的基区硼扩散,从而避开了高温长时间的扩散,缩短了工艺时间,提高了生产效率,降低了制造成本;同时也获得了较低的放大倍数低温变化率(-55℃时,△β/β≦40%),提高了少子寿命,器件的可靠性得到了提升。
附图说明
图1是本发明制作的低放大倍数变化率的功率晶体管管芯结构示意图;
图2是本发明制作的低放大倍数变化率的功率晶体管管芯版图示意图。
图中:1-二氧化硅氧化层二、2-二氧化硅氧化层一、3-内沟槽台面、4-N-外延层区、5-N+集电区、6-金属钛镍银电极、7-P型外延层、8-P+接触区、9-N+发射区、10-金属铝电极二、11-金属铝电极一。
具体实施方式
以下结合附图对本发明进行详细说明:
实施例1
如图所示,本发明涉及的一种低放大倍数变化率的功率晶体管,包括由单面抛光的N型单晶片形成的N+集电区5,在N+集电区5对应N型单晶片的抛光面设有N-外延层4,在N-外延层5上表面设有P型外延层7,在P型外延层7上表面设有P+接触区8,在P+接触区8上表面设有N+发射区9,在P+接触区8上表面设有二氧化硅氧化层一2,在二氧化硅氧化层一2表面和N+发射区9表面设有二氧化硅氧化层二1,在P+接触区和集电结周围用玻璃粉进行玻璃钝化形成内沟槽台面3,实现对集电结进行保护,在所述P+接触区8和N+发射区9对应N型单晶片的研磨面分别形成金属铝电极一11、金属铝电极二10和金属钛镍银电极6,引出对应的晶体管基极B、发射极E和集电极C。
该一种低放大倍数变化率的功率晶体管的制作方法,步骤如下:
S1、选择晶向<111>的单面抛光的N型单晶片形成N+集电区5,其电阻率为0.002~0.003Ω·cm,厚度为450±5μm;
S2、在N+集电区5对应N型的抛光面通过外延工艺形成N-外延层4,其电阻率为7~10Ω·cm,厚度20~25μm;
S3、在N-外延层4上表面通过外延工艺形成P型外延层7,其电阻率为4~5Ω·cm,厚度20~25μm;
S4、在P型外延层7表面扩硼形成P+接触区8,控制所述P+接触区8的结深1.5~2μm,表面浓度4~5×1018cm-3;在P+接触区8上表面形成二氧化硅氧化层一2;
S5、在P+接触区8表面中心处光刻腐蚀,扩散磷形成N+发射区9,表面杂质浓度为1~2×1020cm-3,结深为2.1~3μm;在二氧化硅氧化层2表面和N+发射区9表面形成二氧化硅氧化层二1;
S6、通过光刻掩蔽、利用玻璃钝化工艺在P+接触区侧面位置和集电结侧面形成内沟槽台面3,从而实现对集电结的保护;
S7、在P+接触区8、N+发射区9和N+集电区5对应N型单晶片的研磨面蒸发金属,刻蚀金属后分别形成金属铝电极一11、金属铝电极二10和金属钛镍银电极6,引出晶体管基极B、发射极E和集电极C。
实施例2
一种低放大倍数变化率的功率晶体管,结构与实施例1描述的相同。
本发明的一种低放大倍数变化率的功率晶体管的制造工艺,步骤如下:
S1、选择晶向<111>的单面抛光的N型单晶片形成N+集电区5,其电阻率为0.002~0.003Ω·cm,厚度为450±5μm;
S2、在N+集电区5对应N型单晶片的抛光面通过外延工艺形成N-外延层4,其电阻率为15~20Ω·cm,厚度40~50μm;
S3、在N-外延层4上表面通过外延工艺形成P型外延层7,其电阻率为4~5Ω·cm,厚度20~25μm;
S4、在P型外延层7表面扩硼形成P+接触区8,控制所述P+接触区8的结深1.5~2μm,表面浓度4~5×1018cm-3;在P+接触区8形成二氧化硅氧化层一2;
S5、在P+接触区8表面中心处光刻腐蚀,扩散磷形成N+发射区9,表面杂质浓度为1~2×1020cm-3,结深为2.1~3μm;在二氧化硅氧化层一2表面和N+发射区9表面形成二氧化硅氧化层二1;
S6、通过光刻掩蔽、利用玻璃钝化工艺在P+接触区侧面位置和集电结侧面形成内沟槽台面3,从而实现对集电结的保护;
S7、在P+接触区8、N+发射区9和N+集电区5对应N型单晶片的研磨面蒸发金属,刻蚀金属后分别形成金属铝电极一11、金属铝电极二10和金属钛镍银电极6,引出对应的晶体管基极B、发射极E和集电极C。
实施例3
一种低放大倍数变化率的功率晶体管,结构与实施例1描述的相同。
本发明的一种低放大倍数变化率的功率晶体管的制作方法,步骤如下:
S1、选择晶向<111>的单面抛光的N型单晶片形成N+集电区5,其电阻率为0.002~0.003Ω·cm,厚度为450±5μm;
S2、在N+集电区5对应N型单晶片的抛光面通过外延工艺形成N-外延层4,电阻率为10~15Ω·cm,厚度25~30μm;
S3、在N-外延层4上表面通过外延工艺形成P型外延层7,其电阻率为4~5Ω·cm,厚度20~25μm;
S4、在P型外延层7表面扩硼形成P+接触区8,控制所述P+接触区8的结深1.5~2μm,表面浓度4~5×1018cm-3;在P+接触区8上表面形成二氧化硅保护层一2;
S5、在P+接触区8表面中心处光刻腐蚀,扩散磷形成N+发射区9,表面杂质浓度为1~2×1020cm-3,结深为2.1~3μm;在二氧化硅保护层一2表面和N+发射区9表面形成氮化硅保护层二1;
S6、通过光刻掩蔽、利用玻璃钝化工艺在P+接触区侧面位置和集电结侧面形成内沟槽台面3,从而实现对集电结的保护;
S7、在P+接触区8、发射区9和N+集电区5对应N型单晶片的研磨面蒸发金属,刻蚀金属、氮化硅钝化后形成分别形成金属铝电极一11、金属铝电极二10和金属钛镍银电极6,引出晶体管基极B、发射极E和集电极C。
用户要求:-55℃时,△β/β≦40%;按照实施例3的工艺步骤和工艺条件,制作的器件最后的电参数测试如下表:

Claims (9)

1.一种低放大倍数变化率的功率晶体管,包括由单面抛光的单晶片形成的N+集电区,在N+集电区对应所述单晶片的抛光面设有N-外延层,其特征是,在N-外延层上表面设有P型外延层,在P型外延层上表面设有P+接触区,在P+接触区上表面设有二氧化硅氧化层一,在P+接触区上表面设有N+发射区,在二氧化硅氧化层一表面和N+发射区表面设有二氧化硅氧化层二,在所述P+接触区和N+发射区表面分别引出晶体管基极B、发射极E,所述N+集电区对应所述单晶片的研磨面引出集电极C,所述N+发射区的结深大于P+接触区的结深。
2.根据权利要求1所述的一种低放大倍数变化率的功率晶体管,其特征是,在P+接触区和集电结侧面设有玻璃钝化沟槽台面,实现对集电结的保护。
3.根据权利要求1或2所述的一种低放大倍数变化率的功率晶体管,其特征是,所述单面抛光的单晶片的晶向为<111>,电阻率为0.002~0.003Ω·cm,厚度为450±5μm。
4.根据权利要求1或2所述的一种低放大倍数变化率的功率晶体管,其特征是,所述N-外延层的厚度为20~50μm,所述N-外延层的电阻率为7~20Ω·cm 。
5.根据权利要求1或2所述的一种低放大倍数变化率的功率晶体管,其特征是,所述P型外延层的厚度为20~25μm,所述P型外延层的电阻率为4~5Ω·cm。
6.根据权利要求1或2所述的一种低放大倍数变化率的功率晶体管,其特征是,所述P+接触区的结深1.5~2μm,表面浓度为4~5×1018cm-3
7.根据权利要求1或2所述的低放大倍数变化率的功率晶体管,其特征是,所述N+发射区的结深为2.1~3μm,N+发射区的表面杂质浓度为1~2×1020cm-3
8.如权利要求1-权利要求7任一项所述的一种低放大倍数变化率的功率晶体管的制作方法,其特征是,步骤包括:
S1、选择单面抛光的单晶片作为N+集电区;
S2、在N+集电区对应所述单晶片的抛光面通过外延工艺形成N-外延层;
S3、在N-外延层上表面通过外延工艺形成P型外延层;
S4、在P型外延层上表面扩硼形成P+接触区;同时在硅片表面形成二氧化硅氧化层一;
S5、在P+接触区表面光刻腐蚀,扩散磷形成N+发射区;同时在硅片表面形成二氧化硅氧化层二;
S6、在所述P+接触区和N+发射区表面引出金属电极B、E,在N+集成区对应N型单晶片的研磨面即集电区引出金属电极C。
9.根据权利要求8所述的一种低放大倍数变化率的功率晶体管的制作方法,其特征是,步骤S5完成后,通过光刻掩蔽、利用玻璃钝化工艺在P+接触区侧面位置和集电结侧面形成内沟槽台面,从而实现对集电结的保护。
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Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
GB1309228A (en) * 1970-05-08 1973-03-07 Siemens Ag Production of semiconductor components
JPH0521719A (ja) * 1991-07-11 1993-01-29 Nec Corp 半導体集積回路装置
JP2002353231A (ja) * 2001-05-25 2002-12-06 Toshiba Corp バイポーラトランジスタ
CN103000679A (zh) * 2012-12-20 2013-03-27 清华大学 低电阻多晶连接基区全自对准双极晶体管及其制备方法
CN103035687A (zh) * 2012-12-20 2013-04-10 清华大学 外基区下具有低电阻屏蔽层的双极晶体管及其制备方法
CN205406526U (zh) * 2016-03-07 2016-07-27 无锡固电半导体股份有限公司 低压大电流硅npn型功率晶体管
CN108109916A (zh) * 2017-12-21 2018-06-01 深圳市晶特智造科技有限公司 双极晶体管及其制作方法
CN114999914A (zh) * 2022-07-01 2022-09-02 锦州辽晶电子科技有限公司 一种提高抗二次击穿耐量的功率晶体管的制作方法
CN219979571U (zh) * 2023-04-13 2023-11-07 锦州辽晶电子科技有限公司 一种低放大倍数变化率的功率晶体管

Patent Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
GB1309228A (en) * 1970-05-08 1973-03-07 Siemens Ag Production of semiconductor components
JPH0521719A (ja) * 1991-07-11 1993-01-29 Nec Corp 半導体集積回路装置
JP2002353231A (ja) * 2001-05-25 2002-12-06 Toshiba Corp バイポーラトランジスタ
CN103000679A (zh) * 2012-12-20 2013-03-27 清华大学 低电阻多晶连接基区全自对准双极晶体管及其制备方法
CN103035687A (zh) * 2012-12-20 2013-04-10 清华大学 外基区下具有低电阻屏蔽层的双极晶体管及其制备方法
CN205406526U (zh) * 2016-03-07 2016-07-27 无锡固电半导体股份有限公司 低压大电流硅npn型功率晶体管
CN108109916A (zh) * 2017-12-21 2018-06-01 深圳市晶特智造科技有限公司 双极晶体管及其制作方法
CN114999914A (zh) * 2022-07-01 2022-09-02 锦州辽晶电子科技有限公司 一种提高抗二次击穿耐量的功率晶体管的制作方法
CN219979571U (zh) * 2023-04-13 2023-11-07 锦州辽晶电子科技有限公司 一种低放大倍数变化率的功率晶体管

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