CN112562593A - 一种显示面板和显示装置 - Google Patents
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Abstract
本发明描述了一种显示面板和显示装置。显示面板包括:衬底基板、发光元件、多个像素和多条扫描信号线,第一晶体管、第二晶体管、驱动晶体管、第三晶体管、第四晶体管、第五晶体管和节点电压调节模块。通过在驱动晶体管的栅极连接节点电压调节模块,在第四晶体管将初始化电压传输给驱动晶体管的栅极对其进行电位初始化后,向驱动晶体管的栅极传输节点调节信号,以调节驱动晶体管的栅极节点电压,使得在第一晶体管将数据信号传输至像素电路进行数据写入和阈值补偿的过程中,可以在较短的充电时间内,像素电路的数据写入和阈值补偿更充分,避免高刷新频率显示面板中像素电路充电时间不足,从而可以提高显示面板的显示效果。
Description
技术领域
本发明涉及显示技术领域,特别是涉及一种显示面板和显示装置。
背景技术
有机发光二极管(Organic Light Emitting Diode,OLED)显示器是当今平板显示器研究领域的热点之一,与液晶显示器(Liquid Crystal Display,LCD)相比,OLED显示器具有低能耗、生产成本低、自发光、宽视角及响应速度快等优点。其中,用于控制发光器件发光的像素电路是OLED显示器的核心技术内容,具有重要的研究意义。然而,为了实现高频驱动提高用户体验,在一帧显示画面时间中,每行像素电路的充电时间会被大幅压缩,导致初始化之后的驱动晶体管栅极的初始化电压过低,导致像素电路的数据写入和阈值补偿不够充分,从而导致显示不良。
发明内容
有鉴于此,本发明提供一种显示面板和显示装置,用以改善高频驱动时,驱动晶体管阈值补偿不充分的问题。
本发明提供了一种显示面板,包括:衬底基板和位于衬底基板上的多个像素,像素包括像素电路和发光元件,其中像素电路包括:第一晶体管;第一开关晶体管耦接于数据线,用于响应第二扫描线信号而向所述像素电路传输数据电压信号;
第二晶体管;所述第二开关晶体管耦接于第一电源电压信号端,用于响应发光控制信号线信号而向所述像素电路传输第一电源电压信号;
驱动晶体管,所述驱动晶体管的第一极耦接于所述开关晶体管的一端;
第三晶体管,所述补偿晶体管耦接于所述驱动晶体管的栅极和所述驱动晶体管的第二极之间;所述补偿晶体管用于检测和自补偿所述驱动晶体管的阈值电压偏差;
第四晶体管;所述第四晶体管耦接于所述驱动晶体管的栅极与初始化电压端之间,用于响应第一扫描线信号而向所述驱动晶体管的栅极传输初始化电压;
第五晶体管;所述第五晶体管耦接于所述驱动晶体管和所述初始化电压端之间,用于响应其控制端信号而向所述像素电路的信号输出端传输初始化电压;
节点电压调节模块,所述节点电压调节模块的一端耦接于所述驱动晶体管的栅极,所述节点电压调节模块的第二端耦接于第一节点;所述第一节点用于在所述初始化电压传输至所述驱动晶体管的栅极之后,且所述数据信号传输至所述像素电路之前,将节点调节信号传输至所述驱动晶体管的栅极,以抬高驱动晶体管栅极的电压。
本发明还提供了一种显示装置,包括上述的显示面板。
本发明实施例中的显示面板和显示装置,通过在驱动晶体管的栅极连接节点电压调节模块,在第四晶体管将初始化电压传输给驱动晶体管的栅极对其进行电位初始化后,向驱动晶体管的栅极传输节点调节信号,以调节驱动晶体管的栅极节点电压,以使得在第一晶体管将数据信号传输至像素电路进行数据写入和阈值补偿的过程中,可以使在较短的充电时间内,像素电路的数据写入和阈值补偿更充分,避免高刷新频率显示面板中像素电路充电时间不足而造成驱动晶体管阈值补偿不充分,从而可以提高显示面板的显示效果。
附图说明
图1是本发明实施例中一种显示面板的示意图;
图2是图1的显示面板中一种像素电路的等效电路图;
图3是本发明实施例中另一种像素电路的等效电路图;
图4是本发明实施例中又一种像素电路的等效电路图;
图5是本发明实施例中又一种像素电路的等效电路图;
图6是本发明实施例中又一种像素电路的等效电路图;
图7是本发明图6中的一种像素电路结构俯视图;
图8是本发明实施例提供的一种像素电路的时序图;
图9是本发明实施例提供的像素电路在部分节点的时序信号波形仿真示意图;
图10是本发明图7中一种沿A-A1的截面剖视图;
图11是本发明实施例中又一种像素电路的等效电路图;
图12是本申请实施例中一种显示装置的结构示意图。
具体实施方式
为使本发明的上述目的、特征和优点能够更为明显易懂,下面将结合本申请附图和实施例,对本发明实施例中的技术方案进行清除、完整地描述。
在本申请实施例中使用的术语是仅仅出于描述特定实施例的目的,而非旨在限制本申请。在本申请实施例和所附权利要求书中所使用的单数形式的“一种”、“所述”和“该”也旨在包括多数形式,除非上下文清楚地表示其他含义。
需要说明的是,在以下描述中阐述了具体细节以便于充分理解本发明。但是本发明能够以多种不同于在此描述的其它方式来实施,本领域技术人员可以在不违背本发明内涵的情况下做类似推广。因此本发明不受下面公开的具体实施方式的限制。
请参考图1,图1是本发明实施例中一种显示面板100的示意图,显示面板100包括衬底基板001、位于衬底基板上的多条数据线DATA、与第一电源电压信号端连接的第一电源电压信号线PVDD、多条扫描线SCAN、多条发光控制信号线EMIT和多个像素P,其中,像素P包括像素电路D和发光元件OLED,像素电路D用于驱动发光元件OLED进行发光显示。发光元件OLED通常包括第一电极、发光层和第二电极,第一电极和第二电极可以分别为阳极和阴极,或者第一电极和第二电极可以分别为阴极和阳极,以下以第一电极,第二电极为阴极为例,对本发明实施例进行说明。
图2是图1中像素电路的等效电路图。像素电路D包括:第一晶体管M1,耦接于数据线DATA,第一晶体管M1响应于第二扫描线SCAN2的信号S2而导通或者截止,在其导通阶段向像素电路传输数据线DATA提供的数据电压信号data;第二晶体管M2,耦接于第一电源电压信号端,第二晶体管M2响应于发光控制信号线EMIT提供的发光控制信号线信号Emit而导通或者截止,在其导通阶段向像素电路传输第一电源电压信号PVDD;驱动晶体管DT的第一极耦接于第一晶体管M1的一端,根据第一晶体管M1的开关操作接收数据电压信号data,以将驱动电流Id提供给发光元件OLED;第三晶体管M3,耦接于驱动晶体管DT的栅极N2和驱动晶体管DT的第二极之间,可以理解的,第一晶体管M1和第二晶体管M2分别耦接于驱动晶体管的第一极和第二极,第一极和第二极分别为驱动晶体管源极和漏极中的一者,第三晶体管M3根据其控制端的信号被导通,而将驱动晶体管DT的栅极N2耦合至驱动晶体管的漏极而以二极管的方式耦合驱动晶体管DT,从而实现检测和自补偿驱动晶体管的阈值电压偏差;第四晶体管M4,耦接于驱动晶体管的栅极N2和初始化电压端VREF之间,响应于第一扫描线SCAN1的信号S1而导通或者截止,以将初始化电压端的初始化电压Vref传输至驱动晶体管的栅极N2,对其进行栅极节点电压初始化操作;第五晶体管M5,耦接于发光元件OLED的与阳极和初始化电压端VREF之间,第五晶体管M5还耦接于驱动晶体管的漏极,响应于其控制端的信号而将初始化电压Vref传输至发光元件OLED的阳极,以对阳极节点N4进行电压初始化。本发明实施例提供的电路,可以对驱动晶体管的栅极N2节点和发光元件OLED的阳极节点N4进行初始化,使驱动晶体管在工作时的栅极电压更准确,同时还能避免相邻的不同颜色像素之间由于发光元件OLED启亮电压不同而造成的阳极漏电流引起的像素偷亮。
本发明实施例提供的像素电路还包括节点电压调节模块X1,耦接于驱动晶体管的栅极N2和第一节点N1之间,第一节点N1用于在初始化电压Vref传输至驱动晶体管栅极N2对其进行初始化之后,且数据信号data传输至像素电路之前,将节点调节信号传输至驱动晶体管的栅极N2,以抬高驱动晶体管的栅极N2的电位,在有限较短的充电时间内,使驱动晶体管的数据写入和阈值补偿更为充分。
可选的,第四晶体管M4为P型晶体管时,由P型晶体管的特征为低电平导通、高电平截止,因此第一扫描线信号S1中的有效电平为低电平,非有效电平为高电平,也就是说第四晶体管M4响应于第一扫描线信号S1的低电平而导通,响应于第一扫描线信号S1的高电平而截止。以下以第四晶体管M4和像素电路中其他晶体管均为P型晶体管为例,对本发明实施例进行说明,在其他的可实现的实施方式中,例如,第四晶体管M4为N型晶体管,则第一扫描线信号S1的有效电平为高电平,非有效电平为低电平信号。若其他晶体管为N型晶体管,则当与其对应的晶体管控制端信号为高电平时,可以控制晶体管导通,当与其对应的晶体管控制端信号为低电平时,晶体管处于截止状态,具体的晶体管类型选择视显示面板具体情况而定,本申请对此亦不作限定。以下为了方便表述,并非是限定具体晶体管的类型,仅以所有的晶体管均为P型晶体管为例,对本发明实施例进行说明。
为了方便理解本发明实施例,请参照图8和图2来理解本发明示例性实施例的显示面板中一个像素电路在一个工作周期中的工作过程:
首先,在初始化阶段t1,第一扫描线信号S1为低电平,第二扫描线信号S2为高电平,发光控制信号线信号Emit为高电平信号,此时,第四晶体管M4响应于第一扫描信号线信号S1而导通,将初始化电压Vref传输至驱动晶体管的栅极N2,因此,实现驱动晶体管栅极N2的初始化。可以理解的,此时其他晶体管在其对应的控制端的信号控制下,均处于截止状态;
随后,在节点电压调节阶段t2,第一扫描信号线信号S1由低电平变为高电平,第四晶体管M4的控制端响应于高电平信号而控制第四晶体管M4截止。第三晶体管M3在其控制端信号的控制下,处于截止状态。此时,节点电压调节模块C1将第一节点传输的节点调节信号耦合至驱动晶体管的栅极N2(图中未示出),以抬高驱动晶体管的栅极N2的电压,换句话说,在节点电压调节阶段,驱动晶体管的栅极N2节点的电压高于初始化电压Vref;
然后,在数据写入和阈值补偿阶段t3,第一扫描线提供高电平信号,第二扫描线提供低电平信号,发光控制信号线提供高电平。第一晶体管M1响应于第二扫描线信号而导通,将数据线的数据电压信号data传输像素电路,第二晶体管和四晶体管第三晶体管均处于截止状态,在此阶段第三晶体管M3在其控制端信号的控制下导通,从而实现驱动晶体管DT通过导通的第三晶体管M3以二极管的方式耦合,数据电压信号data通过驱动晶体管的第一极经第三晶体管M3耦合至驱动晶体管的栅极N2,当驱动晶体管的栅极电压N2被充电至data-|Vth|时,驱动晶体管截止。同时,第五晶体管M5响应于其控制端信号而导通,将初始化电压端VREF提供的初始化电压Vref耦合至发光元件OLED的阳极;
随后,在发光阶段t4,发光控制信号线提供低电平,第一扫描线和第二扫描线均提供高电平,第一晶体管、第三晶体管、第四晶体管和第五晶体管均响应于其控制端信号而处于截止状态,第二晶体管M2响应与发光控制信号线信号Emit而导通,将第一电源电压端提供的第一电源电压耦合至驱动晶体管的第一极,驱动晶体管DT产生驱动电流Id流向发光元件OLED,驱动发光元件发光显示。
可以理解的是,在t3阶段中,驱动晶体管DT产生的驱动发光元件OLED发光的电流Id满足公式:Id=k(PVDD-VN2-|Vth|)2,其中,k为结构参数,VN2代表驱动晶体管栅极N2节点的电压,Vth代表驱动晶体管DT的阈值电压。可以看出驱动信号的大小与驱动晶体管栅极N2的电压相关,若VN2降低,可能会导致在有限且较短的数据写入和阈值补偿时间段内,栅极N2的节点电压无法达到理想值,从而引起电流Id的值发生偏移,影响发光元件OLED显示效果。
通常为了防止不同颜色像素阳极N4之间由于起亮电压不同而产生的漏电流通过公共层漏流至相邻的不同颜色像素而产生像素偷亮,第五晶体管用于为发光元件OLED的阳极进行电位初始化,此时初始化电压越低,则阳极N4初始化效果越好。然而在高驱动频率显示面板中,像素电路的脉宽会发幅度缩减,以120Hz刷新频率为例,SCAN信号的脉宽仅2μs左右,若此时初始化电压Vref的电压值过低,则会导致电路阈值补偿不够充分,从而引起高频显示画面亮度均一性问题,进而引起视效恶化。
在一种可能的实施方式中,如图3所示,节点电压调节模块X1可以包括调节晶体管MD,调节晶体管的第一极耦接于驱动晶体管DT的栅极N2,第二极耦接于第一节点N1,响应于其控制端信号Sx而在对应的工作阶段将第一节点N1的节点调节电压传输至驱动晶体管DT的栅极,以实现对驱动晶体管栅极的节点电压调节,用于高频驱动显示面板中,可以提高像素电路的数据写入和阈值补偿效果,在一些可变频率(高频和低频驱动切换)的显示面板中,低频的时候有足够的充电时间,因此可以选择采用较低的初始化电压对驱动晶体管的栅极进行充分复位,当采用高频进行显示时,则可通过节点电压调节模块提高像素电路的数据写入和阈值抓取效率。
在一种可能的实施方式中,如图4所示,节点电压调节模块X1可以包括第一电容C1,第一电容的第一极板11与驱动晶体管的栅极N2连接,第一电容的第二极板12与第一节点N1连接,利用第一电容的耦合作用,将第一节点N1提供的节点调节信号传输驱动晶体管的栅极N2,以在数据写入和阈值补偿之前抬高栅极N2的电压,使其适应于高频驱动电路,从而提高像素电路的充电效果。
在一种可选的实施方式中,如图5所示,第一节点N1耦接于第四晶体管M4的控制端,即,第一节点N1连接第一扫描线SCAN1,接收第一扫描线信号S1,复用第一扫描线信号S1为节点调节信号。当第四晶体管在其控制端的第一扫描线信号S1的控制下,将初始化信号Vref传输至N2节点后,第一扫描线信号由低电平变为高电平,第四晶体管M4截止,此时,N1节点的电压由低电平跳变为高电平,利用第一电容的耦合作用,将节点调节信号提供给驱动晶体管的栅极N2,以抬高栅极N2的电位,同时利用显示面板现有的布线和信号即可实现节点电压调节的目的,可以无需在驱动芯片上增加响应的信号引脚同时也无需额外设置信号走线,节省显示面板布线空间,可节省成本和提高空间利用率。对于高频显示面板而言,通常像素密度也高,本实施例提供的实施方式,还可以避免严重压缩像素电路的布线空间,缓解走线过密增加线路之间的耦合串扰问题,提高显示效果。
可选的,请参考图5和图9理解本发明的技术方案。图9为本发明实施例提供的像素电路在部分节点的时序信号波形仿真示意图。以第一电容为50fF为例进行示意。当像素电路中第四晶体管M4在第一扫描线信号S1的控制下,将初始化信号耦合至驱动晶体管的栅极N2后,第一扫描线信号S1由低电平变为高电平,并且由于第一电容的自身特性,驱动晶体管的栅极N2节点电压随之被抬高,从图中可以看出,栅极N2的节点电压值随着初始化阶段t1中初始化信号的写入而大幅降低以完成对栅极N2的初始化,当初始化阶段结束的瞬间,第一扫描线信号S1跳变后,N2节点的电位也随之被抬高,从而可以使得在较短的数据写入和阈值补偿阶段t3中像素电路的数据信号data写入更充分,阈值补偿更准确。并且,从图中可以发现,虽然第一电容的信号耦合太高了N2节点的电位,但是对于同样需要依赖初始化电压Vref进行复位的发光元件OLED的阳极N4节点而言,在第五晶体管响应于第二扫描线信号S2而导通,对阳极N4节点进行初始化后,N4节点的电压值并无明显变化,不会影响N4节点的正常初始化过程。此外,发明人研究发现,当第一电容由0fF增加至50fF过程中,驱动晶体管的栅极N2节点电位可以由0.43V增加至0.66V,具有明显是阈值补偿改善效果,且经过仿真发现与之对应的,阳极节点N4的低电平复位信号基本没有变化,即,不会影响阳极的低电平初始化过程。因此,本发明提供的实施例可以在不提高发光元件OLED的阳极N4节点初始化电压的情况下,提高驱动晶体管栅极N2节点在数据写入和阈值补偿阶段开始前的起始电压值,从而可以应用于高频驱动的显示面板中,无需额外增加初始化信号线即可保证像素电路的充电效率,提高显示效果。
在一种可选的实施方式中,如图6所示,第三晶体管M3的控制端与第二扫描线SCAN2连接,接收第二扫描线信号S2,第五晶体管的控制端与第二扫描线SCAN2电连接,接收第二扫描线信号S2,如此设置,可以使第一晶体管和第三晶体管共用一根扫描线,同时导通与截止,实现数据写入和阈值补偿,无需额外为第三晶体管M3单独设置扫描线为其控制端提供控制信号,可以节省面板走线数量,提高显示面板100的布线空间,有利于实现高PPI显示。同时,第五晶体管M5的控制端与第二扫描线SCAN2连接,在像素电路的数据写入和阈值补偿阶段可以同时对发光元件OLED的阳极进行电位初始化,节省空间,无需额外为第五晶体管设置信号端子。
可选的,像素电路还包括第二电容Cst和第六晶体管M6,第二电容串联耦合与第一电源电压信号端PVDD和驱动晶体管DT的栅极之间,用于维持阈值补偿完成后驱动晶体管栅极N2的电位。第六晶体管耦接于驱动晶体管的第二极与发光元件OLED的第一电极之间,可以理解的,发光元件的第一电极通常为发光元件的阳极,第六晶体管的控制端与发光控制信号线EMIT电连接,响应于发光控制信号线信号Emit的有效电平而将驱动晶体管产生的驱动信号传输至发光元件。
在一种可选的实施方式中,请参照图7,图7示例性示出了本发明实施例公开的一种像素电路的多个晶体管和电容的俯视图。像素电路还包括连接结构41,连接结构41连接第三晶体管M3的半导体层13和驱动晶体管DT的栅极2D,即,第三晶体管M3的漏极与驱动晶体管的栅极2D之间通过连接结构耦接,实现信号的传递。可以理解的,连接结构41与像素等效电路图中的驱动晶体管的栅极N2节点是对应的。连接结构41可以通过连接孔,穿过第二电容的第一基板Cst1的开口,耦合至驱动晶体管DT的栅极2D。当节点调节电压模块为第一电容时,可以将第一电容的第一极板C11耦接于驱动晶体管DT的栅极,第一电容的第二极板C12耦接于第四晶体管的栅极,可以理解的,第四晶体管的栅极与第一扫描线SCAN1耦接,响应于第一扫描线信号S1,即,此时第二极板C12耦接于第一扫描线SCAN1。在节点电压调节阶段t2,由于将第一电容的第二极板C12耦接于第一扫描线SCAN1,即,在初始化阶段t1后,且数据写入和阈值补偿阶段t3前,此时第一扫描信号线会由低电平跳变为高电平,即第二极板C12的信号由低电平变为高电平,利用电容自身的特性,可以将第二极板C12的信号变化耦合至第一极板C11,从而耦接至驱动晶体管DT栅极2D,调节其栅极的电压信号。通过显示面板现有的信号,即可实现抬高驱动晶体管栅极2D的电位,从而避免充电时间不足造成的像素电路数据写入和阈值补偿补充分的问题,无需额外在IC端为节电压调节模块设置信号端子,同时也无需在显示面板上额外为第一节点预留信号走线空间,避免复杂绕线,节省空间,简化面板布局,简单有效的提升了显示效果。
在一种可选的实施方式中。为了更好的理解像素电路不同结构之间的关系,请参见图10,图10为图7中一种沿A-A1的截面剖视图。显示面板包括依次叠层设置的衬底基板100、半导体层500、栅极金属层200、电容金属层300、源漏极金属层400,其中第四晶体管的栅极M4-G和第一扫描线SCAN1与栅极金属层200同层、第四晶体管的半导体层M4-P与半导体层500同层,数据线DATA和连接结构41均与源漏极金属层400同层。需要说明的是,显示面板还可以包括:位于半导体层500与栅极金属层200之间的栅绝缘层910,位于栅极金属层200与电容金属层300之间的层间介质层920,以及位于电容金属层300与源漏极金属层400之间的层间绝缘层930。进一步地,显示面板还可以包括:位于第四晶体管M4的半导体层与衬底基板100之间的缓冲层940,即缓冲层940位于半导体层与衬底基板100之间,以提高半导体层500的附着力。连接结构41包括第一延伸部,第一扫描线SCAN1包括第二延伸部,沿着垂直于衬底基板所在平面的方向上,即,沿着图10中膜层堆叠的方向上,第一延伸部与第二延伸部至少部分交叠,其中第一延伸部复用为第一电容的第一极板C11,第二延伸部复用为第一电容的第二极板C12。如此设计,无需额外在显示面板中打过孔以实现信号的传输,可以减小显示面板的过孔数量,避免复杂绕线,简化面板布局,提高显示面板的走线布局空间,简单有效的提升像素电路功能,提升显示效果。
在一种可选的实施方式中,请参照图11和图8理解,第三晶体管M3可以包括第一子晶体管M31和第二子晶体管M32,第一子晶体管和第二子晶体管连接于第二节点N3,且二者的控制端均与第二扫描信号线SCAN2连接。需要说明的是,在理想状态下,在第三晶体管M3的控制端信号由有效电平切换为非有效电平时,以第三晶体管为P型晶体管为例进行说明,当像素电路的数据写入和阈值补偿完成之后,即当第二扫描信号线信号S2由低电平信号切换为高电平信号,此时第一子晶体管M31、第二子晶体管M32可以处于关闭状态,理想状态下第二节点N3的电压应保持不变。然而,在实际应用中,由于第二节点N3此时处于悬浮状态,由于耦合等因素影响,第二节点N3的电压会变高,使得第一子晶体管M31源漏极之间的压差较大,导致子晶体管M31、M32并不会立刻截止,这样使得节点N3和N2通过子晶体管M31进行导通,从而会有存储在第二节点N3的电荷注入到晶体管栅极节点N2,抬高了驱动晶体管栅极的电位,使其电压发光偏移,在实际的仿真中,在数据写入和阈值补偿完成之后,栅极节点N2的电压值为0.62V,节点N3的电压值为5.5V,第二子晶体管的源极的电压值为1.8V,压差较大,漏电流会影响驱动晶体管的栅极电位。由于栅极电位直接影响到驱动电流值,因此直接导致像素电路的驱动信号产生偏移,影响显示效果。因此,像素电路还包括第三电容C3,第三电容的第一极板与第二节点N3连接,第三电容的第二极板与第二晶体管M2的控制端连接,第二晶体管M2的控制端与发光控制信号线EMIT连接,在数据写入和发光阶段t3结束后,第三节点的电位会被抬高,由于第三电容的第二极板与发光控制信号线EMIT连接,接收发光控制信号,此时发光控制信号Emit会由高电平跳变为低电平,由于电容的特性,会拉低第三节点N3的电位,从而保证在发光阶段时间内,第三节点N3的电压稳定维持在一个较低的电压条件下,从而可以减小第三晶体管漏流对驱动晶体管栅极电位的影响,提高显示效果,且无需额外设置其他的信号端和走线,节省成本和显示面板布线空间。
基于同一发明构思,如图12所示,本发明实施例还提供了一种显示装置,包括本发明实施例提供的上述显示面板100。其中,显示装置解决问题的原理与前述显示面板相似,因此该显示装置的实施可以参见前述显示面板的实施,重复之处在此不再赘述。显示装置可以是例如触摸显示屏、手机、平板计算机、笔记本电脑、电子屏幕或电视机等任何具有显示功能的电子设备。
以上内容是结合具体的优选实施方式对本发明所作的进一步详细说明,不能认定本发明的具体实施只局限于这些说明。对于本发明所属技术领域的普通技术人员来说,在不脱离本发明构思的前提下,还可以做出若干简单推演或替换,都应当视为属于本发明的保护范围。
Claims (10)
1.一种显示面板,其特征在于,包括:衬底基板和位于所述衬底基板上的多个像素,所述像素包括像素电路和发光元件,所述像素电路包括:
第一晶体管,耦接于数据线,所述第一晶体管用于响应第二扫描线信号而向所述像素电路传输数据电压信号;
第二晶体管,耦接于第一电源电压信号端,所述第二晶体管用于响应发光控制信号线信号而向所述像素电路传输第一电源电压信号;
驱动晶体管,所述驱动晶体管的第一极耦接于所述第一晶体管的一端;
第三晶体管,所述第三晶体管耦接于所述驱动晶体管的栅极和所述驱动晶体管的第二极之间;所述第三晶体管用于检测和自补偿所述驱动晶体管的阈值电压偏差;
第四晶体管;所述第四晶体管耦接于所述驱动晶体管的栅极与初始化电压端之间,用于响应第一扫描线信号而向所述驱动晶体管的栅极传输初始化电压;
第五晶体管;所述第五晶体管M5耦接于所述发光元件和所述初始化电压端之间,用于响应其控制端信号而向所述发光元件的阳极传输初始化电压;
节点电压调节模块,所述节点电压调节模块的第一端耦接于所述驱动晶体管的栅极,所述节点电压调节模块的第二端耦接于第一节点;所述第一节点用于在所述初始化电压传输至所述驱动晶体管的栅极之后,且所述数据信号传输至所述像素电路之前,将节点调节信号传输至所述驱动晶体管的栅极,以抬高所述驱动晶体管的栅极电压。
2.如权利要求1所述的显示面板,其特征在于,
所述节点电压调节模块包括调节晶体管,所述调节晶体管的第一极耦接所述驱动晶体管的栅极,所述调节晶体管的第二极耦接于所述第一节点,所述调节晶体管用于响应其控制端信号而将所述节点调节电压传输至所述驱动晶体管的栅极;其中,所述节点调节电压值大于所述初始化电压值。
3.如权利要求1所述的显示面板,其特征在于,
所述节点电压调节模块包括第一电容,所述电容的第一极板与所述驱动晶体管的栅极连接,所述电容的第二极板与所述第一节点连接。
4.如权利要求3所述的显示面板,其特征在于,
所述第一节点耦接于所述第四晶体管的控制端,所述第四晶体管的控制端耦接于所述第一扫描线S1,所述第一扫描线信号复用为所述节点调节信号。
5.如权利要求3所述的显示面板,其特征在于,
所述第三晶体管的控制端与所述第二扫描线连接;
所述第五晶体管的控制端接收所述第二扫描线信号;
所述像素电路还包括:
第二电容,所述第二电容串联耦接于所述第一电源电压信号端和所述驱动晶体管DT的栅极之间;
第六晶体管,所述第六晶体管耦接于所述驱动晶体管的第二极与所述发光元件的第一电极之间,用于响应所述发光控制信号线信号emit而将所述驱动晶体管产生的驱动信号传输至所述发光元件的第一电极。
6.如权利要求4所述的显示面板,其特征在于,还包括:
连接结构,所述连接结构连接所述第三晶体管M3的半导体层和所述驱动晶体管的栅极;
所述第一电容的第一极板耦接于所述驱动晶体管的栅极,所述第一电容的第二极耦接于所述第四晶体管的栅极,所述第四晶体管的栅极耦接于所述第一扫描线。
7.如权利要求5所述的显示面板,其特征在于,还包括:
所述第四晶体管的栅极位于所述第四晶体管的半导体层的远离所述衬底基板的一侧,所述数据线位于所述第四晶体管的栅极远离所述半导体层的一侧;
所述栅极与所述第一扫描信号线同层;所述连接结构与所述数据线同层;
所述连接结构包括第一延伸部,且所述第一扫描线包括第二延伸部;沿垂直于所述衬底基板所在平面方向上,所述第一延伸部与所述第二延伸部交叠,所述第一延伸部和所述第二延伸部分别复用为所述第一电容的第一极板和第二极板。
8.如权利要求1所述的显示面板,其特征在于,
所述第四晶体管包括P型晶体管。
9.如权利要求1所述的显示面板,其特征在于,
所述第三晶体管包括第第一子晶体管和第二子晶体管,所述第一子晶体管和所述第二子晶体管连接于第二节点;
所述像素电路还包括第三电容,所述第三电容的第一极板与所述第二节点连接,所述第三电容的第二极板与所述第二晶体管M2的控制端连接,所述第二晶体管M2的控制端与所述发光控制信号线连接。
10.一种显示装置,其特征在于,包括权利要求1~9任一项所述的显示面板。
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---|---|---|---|
PB01 | Publication | ||
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SE01 | Entry into force of request for substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
GR01 | Patent grant | ||
GR01 | Patent grant |