CN112785961A - 像素驱动电路及显示面板 - Google Patents
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Abstract
本申请提供一种像素驱动电路及显示面板。所述像素驱动电路包括第一开关单元、第二开关单元、补偿单元、第一驱动单元、第二驱动单元以及发光单元。其中，当所述补偿单元将所述第一偏压信号输出至所述第一节点时，所述第二驱动单元驱动所述发光单元发光；当所述补偿单元将所述第二偏压信号输出至所述第二节点时，所述第一驱动单元驱动所述发光单元发光。本申请能够缓解像素驱动电路中的驱动晶体管的阈值电压偏移程度，同时对驱动晶体管进行有效的阈值电压偏移补偿，提高显示面板的显示均匀性。
Description
技术领域
本申请涉及显示技术领域，具体涉及一种像素驱动电路及显示面板。
背景技术
近年来，Micro-LED(Micro Light-Emitting Diode，微发光二极管)、Mini-LED(Mini Light-Emitting Diode，次毫米发光二极管)及OLED(Organic Light-EmittingDiode，有机发光二极管)因其高色域、高对比度和低功耗等优点，逐渐成为显示领域的热门研究对象。从驱动方式来讲主要分为有源驱动和无源驱动，有源驱动因为瞬态电流小，容易实现高分辨率等优势受到了大量关注。然而，Mini-LED、Micro-LED及OLED普遍存在的问题是像素驱动电路中的驱动晶体管在长时间的工作偏压下会发生阈值电压的偏移，从而造成发光器件亮度衰减及显示不均。目前，人们为了补偿驱动晶体管阈值电压的偏移进行了大量的研究，主要分为外部补偿方式与内部补偿方式。
但是，无论是外部补偿方式还是内部补偿方式，如果驱动晶体管的阈值电压偏移过大，超出像素驱动电路的补偿范围，那么补偿将难以进行。
因此，像素补偿电路中的驱动晶体管长时间处于工作状态，阈值电压偏移过大造成显示不均的问题亟需解决。
发明内容
本申请提供一种像素驱动电路及显示面板，以解决像素驱动电路中的驱动晶体管长时间处于工作状态，使阈值电压偏移过大，造成显示不均的技术问题。
本申请提供一种像素驱动电路，其包括：
第一开关单元，所述第一开关单元接入第一扫描信号和第一数据信号，并电性连接于第一节点，所述第一开关单元用于在所述第一扫描信号的控制下，将所述第一数据信号输出至所述第一节点；
第二开关单元，所述第二开关单元接入第二扫描信号和第二数据信号，并电性连接于第二节点，所述第二开关单元用于在所述第二扫描信号的控制下，将所述第二数据信号输出至所述第二节点；
补偿单元，所述补偿单元接入第一控制信号、第二控制信号、第一偏压信号以及第二偏压信号，所述补偿单元用于在所述第一控制信号和所述第二控制信号的控制下，将所述第一偏压信号输出至所述第一节点或将所述第二偏压信号输出至所述第二节点；
第一驱动单元，所述第一驱动单元接入电源电压，并电性连接于所述第一节点和第三节点；
第二驱动单元，所述第二驱动单元接入所述电源电压，并电性连接于所述第二节点和所述第三节点；以及
发光单元，所述发光单元电性连接于所述第三节点和接地端；
其中，当所述补偿单元将所述第一偏压信号输出至所述第一节点时，所述第二驱动单元驱动所述发光单元发光；当所述补偿单元将所述第二偏压信号输出至所述第二节点时，所述第一驱动单元驱动所述发光单元发光。
可选的，在本申请提供的像素驱动电路中，所述第一开关单元包括第一晶体管；
所述第一晶体管的栅极接入所述第一扫描信号，所述第一晶体管的源极接入所述第一数据信号，所述第一晶体管的漏极电性连接于所述第一节点。
可选的，在本申请提供的像素驱动电路中，所述第二开关单元包括第二晶体管；
所述第二晶体管的栅极接入所述第二扫描信号，所述第二晶体管的源极接入所述第二数据信号，所述第二晶体管的漏极电性连接于所述第二节点。
可选的，在本申请提供的像素驱动电路中，所述补偿单元包括第三晶体管和第四晶体管；
所述第三晶体管的栅极接入所述第一控制信号，所述第三晶体管的源极接入所述第一偏压信号，所述第三晶体管的漏极电性连接于所述第一节点；
所述第四晶体管的栅极接入所述第二控制信号，所述第四晶体管的源极接入所述第二偏压信号，所述第四晶体管的漏极电性连接于所述第二节点。
可选的，在本申请提供的像素驱动电路中，所述第一驱动单元包括第五晶体管和第一电容；
所述第五晶体管的栅极和所述第一电容的第一端均电性连接于所述第一节点，所述第五晶体管的源极接入所述电源电压，所述第五晶体管的漏极和所述第一电容的第二端均电性连接于所述第三节点。
可选的，在本申请提供的像素驱动电路中，所述第二驱动单元包括第六晶体管和第二电容；
所述第六晶体管的栅极和所述第二电容的第一端均电性连接于所述第二节点，所述第六晶体管的源极接入所述电源电压，所述第六晶体管的漏极和所述第二电容的第二端均电性连接于所述第三节点。
可选的，在本申请提供的像素驱动电路中，所述像素驱动电路还包括外部补偿单元，所述外部补偿单元包括第七晶体管、第一开关、第二开关以及模数转换器；
所述第七晶体管的栅极接入感测信号，所述第七晶体管的源极电性连接于所述第三节点，所述第七晶体管的漏极通过所述第一开关接入重置信号，或所述第七晶体管的漏极通过所述第二开关与所述模数转换器电性连接。
可选的，在本申请提供的像素驱动电路中，当所述补偿单元将所述第二偏压信号输出至所述第二节点时，所述第一驱动单元驱动所述发光单元发光时，所述像素驱动电路的驱动时序包括：
复位阶段，对所述第三节点的电位进行复位；
阈值电压探测阶段，利用所述外部补偿单元提取阈值电压；
发光阶段，将所述第一数据信号写入所述第一节点，所述第一驱动单元在所述第一节点的电位的控制下驱动所述发光单元发光。
可选的，在本申请提供的像素驱动电路中，在所述复位阶段，所述第二控制信号和所述感测信号均为高电平信号，所述第一扫描信号、所述第二扫描信号以及所述第一控制信号均为低电平信号，所述第一开关打开，所述第二开关关闭；
在所述阈值电压探测阶段，所述第一扫描信号、所述第二控制信号以及所述感测信号均为高电平信号，所述第二扫描信号和所述第一控制信号均为低电平信号，所述第一开关关闭，所述第二开关打开；
在所述发光阶段，所述第一扫描信号和所述第二控制信号均为高电平信号，所述感测信号、所述第二扫描信号以及所述第一控制信号均为低电平信号。
可选的，在本申请提供的像素驱动电路中，所述第一控制信号和所述第二控制信号均为低频交流信号；
所述第一控制信号和所述第二控制信号保持反相。
相应的，本申请还提供一种显示面板，其包括多个呈阵列排布的子像素单元和如权利要求1-10任一项所述的像素驱动电路，所述像素驱动电路用于驱动所述多个子像素单元。
本申请提供一种像素驱动电路及显示面板。所述像素驱动电路包括第一开关单元、第二开关单元、补偿单元、第一驱动单元、第二驱动单元以及发光单元。其中，当所述补偿单元将所述第一偏压信号输出至所述第一节点时，所述第二驱动单元驱动所述发光单元发光；当所述补偿单元将所述第二偏压信号输出至所述第二节点时，所述第一驱动单元驱动所述发光单元发光。本申请能够缓解像素驱动电路中的驱动晶体管的阈值电压偏移程度，同时对驱动晶体管进行有效的阈值电压偏移补偿，提高显示面板的显示均匀性。
附图说明
为了更清楚地说明本申请实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本申请的一些实施例，对于本领域技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是本申请提供的像素驱动电路的第一结构示意图；
图2是图1所示的像素驱动电路的电路结构示意图；
图3是本申请提供的第一控制信号和第二控制信号的时序图；
图4是图2所示的像素驱动电路的信号时序示意图；
图5是本申请提供的像素驱动电路的第二结构示意图；
图6是图5所示的像素驱动电路的电路结构示意图；
图7是图6所示的像素驱动电路的信号时序示意图；
图8是本申请提供的显示面板的平面结构示意图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
在本申请的描述中，需要理解的是，术语“第一”和“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”和“第二”等的特征可以明示或者隐含地包括一个或者更多个所述特征，因此不能理解为对本申请的限制。
本申请以下各实施例中采用的晶体管可以为薄膜晶体管或场效应管或其他特性相同的器件，由于这里采用的晶体管的源极、漏极是对称的，所以其源极、漏极是可以互换的。在本申请实施例中，为区分晶体管除栅极之外的两极，将其中一极称为源极，另一极称为漏极。按附图中的形态规定开关晶体管的中间端为栅极、信号输入端为源极、输出端为漏极。此外本申请实施例所采用的晶体管可以包括P型晶体管和/或N型晶体管两种，其中，P型晶体管在栅极为低电平时导通，在栅极为高电平时截止，N型晶体管为在栅极为高电平时导通，在栅极为低电平时截止。
需要说明的是，本申请以下各实施例均以晶体管为N型晶体管为例进行说明，但不能理解为对本申请的限定。
请参阅图1，图1是本申请提供的像素驱动电路100的第一结构示意图。
本申请提供的像素驱动电路100包括第一开关单元101、第二开关单元102、补偿单元103、第一驱动单元104、第二驱动单元105以及发光单元106。
具体的，第一开关单元101接入第一扫描信号G1和第一数据信号D1，并电性连接于第一节点Q1。第一开关单元101用于在第一扫描信号G1的控制下，将第一数据信号D1输出至第一节点Q1。
具体的，第二开关单元102接入第二扫描信号G2和第二数据信号D2，并电性连接于第二节点Q2。第二开关单元102用于在第二扫描信号G2的控制下，将第二数据信号D2输出至第二节点Q2。
具体的，补偿单元103接入第一控制信号G3、第二控制信号G4、第一偏压信号D3以及第二偏压信号D4。补偿单元103用于在第一控制信号G3和第二控制信号G4的控制下，将第一偏压信号D3输出至第一节点Q1或将第二偏压信号D4输出至第二节点Q2。
具体的，第一驱动单元104接入电源电压VDD，并电性连接于第一节点Q1和第三节点P。
具体的，第二驱动单元105接入电源电压VDD，并电性连接于第二节点Q2和第三节点P。
具体的，发光单元106电性连接于第三节点P和接地端VSS。
其中，当补偿单元103将第一偏压信号D3输出至第一节点Q1时，第二驱动单元105驱动发光单元106发光；当补偿单元103将第二偏压信号D4输出至第二节点Q2时，第一驱动单元104驱动发光单元106发光。
在申请实施例提供的像素驱动单元100中，通过第一开关单元101和第二开关单元102控制第一驱动单元104和第二驱动单元105交替工作，可以减少像素驱动电路100中的驱动晶体管处于工作状态的时长，使得每一驱动晶体管受到偏压的时间降低50％，进而减缓阈值电压的偏移程度。同时，当第二驱动单元105驱动发光单元106发光时，补偿单元103将第一偏压信号D3输出至第一节点Q1，当第一驱动单元104驱动发光单元106发光时，补偿单元103将第二偏压信号D4输出至第二节点Q2，可进一步的通过补偿单元103对处于关闭状态的第一驱动单元104或第二驱动单元105中的驱动晶体管施加反向偏压，从而对阈值电压偏移进行校正，有效缓解阈值电压的偏移程度。
需要说明的是，反向偏压可以理解为相对于驱动晶体管正常工作的Vgs(栅源电压差)为正值时的定义。比如，当Vgs为0V时，驱动晶体管刚好关断，则驱动晶体管的正向偏压对应的电压区间为Vgs>0V，反向偏压对应的电压区间即为Vgs<0V。可以理解的是，N型晶体管正常工作时，其处于正向偏压；P型晶体管正常工作时，其处于反向偏压。因此，可根据实际晶体管的类型设置第一偏压信号D3和第二偏压信号D4的电压值。
在本申请一实施例中，第一偏压信号D3和第二偏压信号D4可以为同一电压信号，从而简化显示面板中的电路。当然，第一偏压信号D3和第二偏压信号D4也可以不同，具体可根据相应的驱动晶体管的阈值电压偏移程度进行设计，本申请对此不作具体限定。
请参阅图2，图2是图1所示的像素驱动电路100的电路结构示意图。
第一开关单元101包括第一晶体管T1。第一晶体管T1的栅极接入第一扫描信号G1。第一晶体管T1的源极接入第一数据信号D1。第一晶体管T1的漏极电性连接于第一节点Q1。
其中，第二开关单元102包括第二晶体管T2。第二晶体管T2的栅极接入第二扫描信号G2。第二晶体管T2的源极接入第二数据信号D2。第二晶体管T2的漏极电性连接于第二节点Q2。
其中，补偿单元103包括第三晶体管T3和第四晶体管T4。第三晶体管T3的栅极接入第一控制信号G3。第三晶体管T3的源极接入第一偏压信号D3。第三晶体管T3的漏极电性连接于第一节点Q1。第四晶体管T4的栅极接入第二控制信号G4。第四晶体管T4的源极接入第二偏压信号D4。第四晶体管T4的漏极电性连接于第二节点Q2。
其中，第一驱动单元104包括第五晶体管T5和第一电容C1。第五晶体管T5的栅极和第一电容C1的第一端均电性连接于第一节点Q1。第五晶体管T5的源极接入电源电压VDD。第五晶体管T5的漏极和第一电容C1的第二端均电性连接于第三节点P。
其中，第二驱动单元105包括第六晶体管T6和第二电容C2。第六晶体管T6的栅极和第二电容C2的第一端均电性连接于第二节点Q2。第六晶体管T6的源极接入电源电压VDD。第六晶体管T6的漏极和第二电容C2的第二端均电性连接于第三节点P。
其中，发光单元106包括一发光器件D。发光器件D的一端电性连接于第三节点P。发光器件D的另一端连接于接地端VSS。发光器件D可以是发光二极管。则发光二极管的阳极电性连接于第三节点P，发光二极管的阴极连接于接地端VSS。
需要说明的是，第五晶体管T5即为第一驱动单元104的驱动晶体管。第六晶体管T6即为第二驱动单元105的驱动晶体管。补偿单元103将第一偏压信号D3输出至第一节点Q1，即向第五晶体管T5的栅极提供反向偏压，以对第五晶体管T5的阈值电压偏移进行校正补偿。同理，补偿单元103将第二偏压信号D4输出至第二节点Q2，即向第六晶体管T6的栅极提供反向偏压，以对第六晶体管T6的阈值电压偏移进行校正补偿。
具体的，请参阅图3和图4，图3是本申请提供的第一控制信号G3和第二控制信号G4的时序图，图4是图2所示的像素驱动电路100的信号时序图。
在本申请实施例中，第一控制信号G3和第二控制信号G4均为低频交流信号。第一控制信号G3和第二控制信号G4保持反相，以使得补偿单元103交替向第五晶体管T5和第六晶体管T6提供反向偏压，以对第五晶体管T5或第六晶体管T6的阈值电压偏移进行校正。
其中，第一控制信号G3和第二控制信号G4可按照一定的周期进行相位翻转。比如，每间隔100帧，第一控制信号G3由低电平转换为高电平，第二控制信号G4由高电平转换为低电平，具体可根据实际器件及工作需求调节切换频率，实用性强。
进一步的，本申请实施例以第一控制信号G3为低电平信号，第二控制信号G4为高电平信号为例进行说明。此时，第一驱动单元104用于驱动发光单元106发光，补偿单元103对第二驱动单元105的驱动晶体管进行反向偏压校正。
具体的，当第一控制信号G3为低电平信号，第二控制信号G4为高电平信号时，第三晶体管T3关闭，第四晶体管T4打开。则第四晶体管T4将第二偏压信号D4传输至第二节点Q2。其中，第二偏压信号D4为低电平信号，以使得第六晶体管T6处于反向偏压状态，进而对第六晶体管T6的阈值电压进行校正。
同时，第二扫描信号G2为低电平信号，第二晶体管T2关闭，第二驱动单元105关闭。第一扫描信号G1为高电平信号，第一晶体管T1打开，第一开关单元101通过第一晶体管T1将第一数据信号D1传输至第一节点Q1。第一节点Q1的电位被拉高，第五晶体管T5打开。电源电压VDD通过第五晶体管T5拉高第三节点P的电位，进而驱动发光器件D发光。
在一实施例中，第一扫描信号G1可以早于第一数据信号D1升为高电平信号，以保证第一晶体管T1充分打开。此外，第一扫描信号G1也可以早于第一数据信号D1降为低电平信号。将第一扫描信号G1提前降为低电平的时间(1us左右)主要考虑实际工作中线路RC-loading(阻容负载)造成的错充。也即，避免第一数据信号D1已经改变，而第一扫描信号G1还没有关断所造成的信号互相干扰。
请参阅图5，图5是本申请提供的像素驱动电路100的第二结构示意图。与图1所示的像素驱动电路100的不同之处在于，本申请实施例提供的像素驱动电路100还包括外部补偿单元107。
具体的，请继续参阅图6，图6是图5所示的像素驱动电路100的电路结构示意图。其中，外部补偿单元107包括第七晶体管T7、第一开关S1、第二开关S2以及模数转换器ADC。
第七晶体管T7的栅极接入感测信号Se。第七晶体管T7的源极电性连接于第三节点P。第七晶体管T7的漏极通过第一开关S1接入重置信号Ref，且第七晶体管T7的漏极通过第二开关S2与模数转换器ADC电性连接。
可以理解的是，本申请实施例提供的像素驱动电路100属于外部补偿电路。一方面，在补偿单元103对驱动晶体管的阈值电压进行校正补偿的同时，可通过外部补偿单元107进一步对驱动晶体管的阈值电压偏移进行补偿，从而提高显示均一性；第二方面，补偿单元103的设置可避免驱动晶体管的阈值电压偏移程度超过外部补偿单元107可补偿范围的问题。
进一步的，请参阅图3和图7，图7是图6所示的像素驱动电路100的信号时序图。
具体的，本申请实施例以第一控制信号G3为低电平信号，第二控制信号G4为高电平信号为例进行说明。
当第一控制信号G3为低电平信号，第二控制信号G4为高电平信号时，第三晶体管T3关闭，第四晶体管T4打开。则第四晶体管T4将第二偏压信号D4传输至第二节点Q2。其中，第二偏压信号D4为低电平信号，以使得第六晶体管T6处于反向偏压状态，进而对第六晶体管T6的阈值电压进行校正。
进一步的，当补偿单元103将第二偏压信号D4输出至第二节点Q2，第一驱动单元104驱动发光单元106发光时，像素驱动电路100的驱动时序包括探测阶段和发光阶段。
具体的，探测阶段包括复位阶段t1和阈值电压探测阶段t2。
在复位阶段t1，第二控制信号G4和感测信号Se均为高电平信号，第一扫描信号G1、第二扫描信号G2以及第一控制信号G3均为低电平信号，第一开关S1打开，第二开关S2关闭。此时，第四晶体管T4打开，补偿单元103向第六晶体管T6提供反向偏压；第二晶体管T2关闭，第二驱动单元105处于关闭状态；第七晶体管T7打开，重置信号Ref通过第一开关S1和第七晶体管T7对第三节点P的电位进行复位。
在阈值电压探测阶段t2，第二控制信号G4以及感测信号Se仍保持为高电平信号，第一扫描信号G1由低电平转换为高电平。第二扫描信号G2和第一控制信号G3均保持为低电平信号，第一开关S1关闭。此时，第二晶体管T2和第六晶体管T6保持关闭。第一晶体管T1、第五晶体管T5以及第七晶体管T7均打开。电源电压VDD开始对第三节点P进行充电，第一节点Q1的电位由于第一电容C1耦合上升。然后，打开第二开关S2，当第三节点P的电位由重置信号Ref变化至第一节点Q1的电位与第五晶体管T5的阈值电压Vth之间的差值时，第五晶体管T5关闭，模数转换器ADC提取到第五晶体管T5的阈值电压，并将需要调整的电压值发送至第一数据信号D1。
在发光阶段，第一扫描信号G1和第二控制信号G4均为高电平信号，感测信号Se、第二扫描信号G2以及第一控制信号G3均为低电平信号。此时，第一晶体管T1打开，将调整后的第一数据信号D1写入第一节点Q1，第一驱动单元104在第一节点Q1的电位的控制下驱动发光单元106发光。
在本申请中，第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6以及第七晶体管T7均为低温多晶硅薄膜晶体管、氧化物半导体薄膜晶体管或非晶硅薄膜晶体管。且本申请提供的像素驱动电路100中的上述晶体管均为同一种类型的晶体管，从而避免不同类型的晶体管之间的差异性对像素驱动电路造成的影响。
本申请实施例还提供一种显示面板，其包括上述实施例所述的像素驱动电路，具体可参照以上对该像素驱动电路的描述，在此不做赘述。
其中，本申请提供的显示面板可以是LCD(Liquid Crystal Display,液晶显示面板)、OLCD(Organic Liquid Crystal Display,有机液晶显示面板)、有机发光二极管显示面板、发光二极管显示面板、Mini-LED面板或Mirco-LED面板。
请参阅图8，图8是本申请提供的显示面板1000的平面结构示意图。在本实施例中，显示面板1000还包括多个呈阵列排布的子像素单元200。像素驱动电路用于驱动相应的子像素单元200发光。其中，在一实施例中，每一子像素单元200均对应设有一像素驱动电路(图中未标示)。
具体的，显示面板1000中的多个子像素单元200可以按照多种像素结构进行排列，如传统的RGB排列方式，即每个像素单元均由红、绿和蓝三色子像素单元200构成；也可以是新型的像素单元之间共用子像素单元200的排列方式，如delta类型和pentile类型等；此外，每个像素单元也可以由红、绿、蓝和白色子像素单元200构成；本申请对此不作具体限定。
需要说明的是，显示面板1000还可以包括其他装置，例如GOA电路、封装层等。显示面板1000的其他装置是本领域技术人员所熟知的技术手段，在此不再赘述。
本申请实施例提供的显示面板1000包括像素驱动电路和多个呈阵列排布的子像素单元200，像素驱动电路用于驱动子像素单元200。该像素驱动电路通过第一开关单元和第二开关单元控制第一驱动单元和第二驱动单元交替工作，可以减少像素驱动电路中的驱动晶体管处于工作状态的时长，使得每一驱动晶体管受到偏压的时间降低50％，进而减缓阈值电压的偏移；同时当第二驱动单元驱动发光单元发光时，补偿单元将第一偏压信号输出至第一节点，当第一驱动单元驱动发光单元发光时，补偿单元将第二偏压信号输出至第二节点，可进一步的通过补偿单元对处于关闭状态的第一驱动单元或第二驱动单元中的驱动晶体管进行反向偏压，从而对阈值电压偏移进行校正补偿，有效缓解阈值电压的偏移程度。
此外，显示面板1000还可以应用于电子设备中。电子设备可以为智能手机、平板电脑、移动电话、视频电话机、电子书阅读器、台式计算机、手提电脑、上网本、工作站、服务器、个人数字助理、便携式媒体播放器、MP3播放器、移动医疗机器、照相机、游戏机、数码相机、车载导航仪、电子广告牌、自动取款机或可穿戴设备中的至少一个。
以上对本申请提供的像素驱动电路及显示面板进行了详细介绍，本文中应用了具体个例对本申请的原理及实施方式进行了阐述，以上实施例的说明只是用于帮助理解本申请的方法及其核心思想；同时，对于本领域的一般技术人员，依据本申请的思想，在具体实施方式及应用范围上均会有改变之处，综上所述，本说明书内容不应理解为对本申请的限制。
Claims (11)
1.一种像素驱动电路，其特征在于，包括：
第一开关单元，所述第一开关单元接入第一扫描信号和第一数据信号，并电性连接于第一节点，所述第一开关单元用于在所述第一扫描信号的控制下，将所述第一数据信号输出至所述第一节点；
第二开关单元，所述第二开关单元接入第二扫描信号和第二数据信号，并电性连接于第二节点，所述第二开关单元用于在所述第二扫描信号的控制下，将所述第二数据信号输出至所述第二节点；
补偿单元，所述补偿单元接入第一控制信号、第二控制信号、第一偏压信号以及第二偏压信号，所述补偿单元用于在所述第一控制信号和所述第二控制信号的控制下，将所述第一偏压信号输出至所述第一节点或将所述第二偏压信号输出至所述第二节点；
第一驱动单元，所述第一驱动单元接入电源电压，并电性连接于所述第一节点和第三节点；
第二驱动单元，所述第二驱动单元接入所述电源电压，并电性连接于所述第二节点和所述第三节点；以及
发光单元，所述发光单元电性连接于所述第三节点和接地端；
其中，当所述补偿单元将所述第一偏压信号输出至所述第一节点时，所述第二驱动单元驱动所述发光单元发光；当所述补偿单元将所述第二偏压信号输出至所述第二节点时，所述第一驱动单元驱动所述发光单元发光。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述第一开关单元包括第一晶体管；
所述第一晶体管的栅极接入所述第一扫描信号，所述第一晶体管的源极接入所述第一数据信号，所述第一晶体管的漏极电性连接于所述第一节点。
3.根据权利要求1所述的像素驱动电路，其特征在于，所述第二开关单元包括第二晶体管；
所述第二晶体管的栅极接入所述第二扫描信号，所述第二晶体管的源极接入所述第二数据信号，所述第二晶体管的漏极电性连接于所述第二节点。
4.根据权利要求1所述的像素驱动电路，其特征在于，所述补偿单元包括第三晶体管和第四晶体管；
所述第三晶体管的栅极接入所述第一控制信号，所述第三晶体管的源极接入所述第一偏压信号，所述第三晶体管的漏极电性连接于所述第一节点；
所述第四晶体管的栅极接入所述第二控制信号，所述第四晶体管的源极接入所述第二偏压信号，所述第四晶体管的漏极电性连接于所述第二节点。
5.根据权利要求1所述的像素驱动电路，其特征在于，所述第一驱动单元包括第五晶体管和第一电容；
所述第五晶体管的栅极和所述第一电容的第一端均电性连接于所述第一节点，所述第五晶体管的源极接入所述电源电压，所述第五晶体管的漏极和所述第一电容的第二端均电性连接于所述第三节点。
6.根据权利要求1所述的像素驱动电路，其特征在于，所述第二驱动单元包括第六晶体管和第二电容；
所述第六晶体管的栅极和所述第二电容的第一端均电性连接于所述第二节点，所述第六晶体管的源极接入所述电源电压，所述第六晶体管的漏极和所述第二电容的第二端均电性连接于所述第三节点。
7.根据权利要求1所述的像素驱动电路，其特征在于，所述像素驱动电路还包括外部补偿单元，所述外部补偿单元包括第七晶体管、第一开关、第二开关以及模数转换器；
所述第七晶体管的栅极接入感测信号，所述第七晶体管的源极电性连接于所述第三节点，所述第七晶体管的漏极通过所述第一开关接入重置信号，且所述第七晶体管的漏极通过所述第二开关与所述模数转换器电性连接。
8.根据权利要求7所述的像素驱动电路，其特征在于，当所述补偿单元将所述第二偏压信号输出至所述第二节点，所述第一驱动单元驱动所述发光单元发光时，所述像素驱动电路的驱动时序包括：
复位阶段，对所述第三节点的电位进行复位；
阈值电压探测阶段，利用所述外部补偿单元提取阈值电压；
发光阶段，将所述第一数据信号写入所述第一节点，所述第一驱动单元在所述第一节点的电位的控制下驱动所述发光单元发光。
9.根据权利要求8所述的像素驱动电路，其特征在于，在所述复位阶段，所述第二控制信号和所述感测信号均为高电平信号，所述第一扫描信号、所述第二扫描信号以及所述第一控制信号均为低电平信号，所述第一开关打开，所述第二开关关闭；
在所述阈值电压探测阶段，所述第一扫描信号、所述第二控制信号以及所述感测信号均为高电平信号，所述第二扫描信号和所述第一控制信号均为低电平信号，所述第一开关关闭，所述第二开关打开；
在所述发光阶段，所述第一扫描信号和所述第二控制信号均为高电平信号，所述感测信号、所述第二扫描信号以及所述第一控制信号均为低电平信号。
10.根据权利要求1所述的像素驱动电路，其特征在于，所述第一控制信号和所述第二控制信号均为低频交流信号；
所述第一控制信号和所述第二控制信号保持反相。
11.一种显示面板，其特征在于，包括多个呈阵列排布的子像素单元和如权利要求1-10任一项所述的像素驱动电路，所述像素驱动电路用于驱动所述多个子像素单元。
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