CN112382235A - 一种像素电路及其控制方法、显示面板 - Google Patents

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Abstract

本发明实施例公开了一种像素电路及其控制方法、显示面板。像素电路包括：数据写入模块，数据写入模块用于将数据电压写入驱动模块的控制端；阈值补偿模块，连接于驱动模块控制端和第二端之间，阈值补偿模块包括双栅晶体管，用于对驱动模块的阈值电压进行补偿；漏电抑制模块，漏电抑制模块连接于双栅晶体管的双栅节点和初始化信号线之间，用于导通后将初始化信号线上的电压写入双栅节点，并通过阈值补偿模块对驱动模块的控制端以及存储模块进行初始化。本实施例的技术方案将初始化信号线上的电压写入双栅节点，从而抑制了双栅晶体管的漏电，避免了存储模块和驱动模块控制端的数据电压经阈值补偿模块漏电，保证了显示面板的低频显示效果。

Description

一种像素电路及其控制方法、显示面板
技术领域
本发明实施例涉及显示技术领域，尤其涉及一种像素电路及其控制方法、显示面板。
背景技术
在显示技术的不断发展中，显示面板的刷新频率范围是制约显示面板应用范围的重要因素之一。更高的刷新频率能够让显示面板的动画显示效果更加流畅，特别适合用户观看影片或者玩游戏，而更低的刷新频率更有利于节省显示面板在息屏显示期间的功耗，从而延长显示装置的待机时间。
目前，在显示面板的有机发光二极管(Organic Light-Emitting Diode，OLED)像素电路中，连接于驱动晶体管栅极以及存储电容的晶体管容易发生漏电，导致显示面板很难适应更低的刷新频率，即显示面板往往在低频刷新时出现显示效果不佳的现象。
发明内容
本发明实施例提供一种像素电路及其控制方法、显示面板，以抑制像素电路中连接于驱动模块的晶体管的漏电特性，保证显示面板的低频显示效果。
第一方面，本发明实施例提供了一种像素电路，所述像素电路包括：
驱动模块，所述驱动模块包括控制端、第一端以及第二端，所述驱动模块用于根据控制端的电压产生驱动电流；
发光元件，所述发光元件用于响应所述驱动模块产生的驱动电流发光；
数据写入模块，所述数据写入模块用于将数据电压写入所述驱动模块的控制端；
存储模块，连接所述驱动模块的控制端，用于存所述驱动模块控制端的电压；
阈值补偿模块，连接于所述驱动模块控制端和第二端之间，所述阈值补偿模块包括双栅晶体管，用于对驱动模块的阈值电压进行补偿；
漏电抑制模块，所述漏电抑制模块连接于所述双栅晶体管的双栅节点和初始化信号线之间，用于导通后将所述初始化信号线上的电压写入所述双栅节点，并通过所述阈值补偿模块对所述驱动模块的控制端以及所述存储模块进行初始化。
可选地，像素电路还包括第一发光控制模块和第二发光控制模块；
所述第一发光控制模块的第一端连接第一电源线，所述第一发光控制模块的第二端连接所述驱动模块的第一端，所述第一发光控制模块的控制端连接发光控制信号线；
所述第二发光控制模块的第一端连接所述驱动模块的第二端，所述第二发光控制模块的第二端连接所述发光元件的第一端，所述第二发光控制模块的控制端连接所述发光控制信号线；
所述发光元件的第二端连接第二电源线。
可选地，所述阈值补偿模块的控制端连接第一扫描线，所述漏电抑制模块的控制端连接第二扫描线；
所述第一扫描线上的信号上的电平与所述发光控制信号线上的电平相反。
可选地，所述阈值补偿模块的控制端连接第一扫描线，所述漏电抑制模块的控制端连接第二扫描线；所述数据写入模块的控制端连接第三扫描线；
所述像素电路还包括初始化模块，所述初始化模块连接于所述初始化信号线与所述发光元件的第一端之间，所述初始化模块的控制端连接所述第二扫描线，所述初始化模块用于响应于所述第二扫描线上的信号将初始化信号传输至所述发光元件的第一端。
可选地，在一帧内，所述第三扫描线上的脉冲在所述第二扫描线上的脉冲之后；
所述第二扫描线上的脉冲时间周期和所述第三扫描线上的脉冲时间周期均在所述第一扫描线上的脉冲的时间周期内。
可选地，所述驱动模块包括第一晶体管、所述数据写入模块包括第二晶体管、所述存储模块包括第一电容、所述双栅晶体管作为第三晶体管、所述漏电抑制模块包括第四晶体管、所述第一发光控制模块包括第五晶体管、所述第二发光控制模块包括第六晶体管以及所述初始化模块包括第七晶体管；
所述第一晶体管的第一极作为所述驱动模块的第一端，所述第一晶体管的第二极作为所述驱动模块的第二端，所述第一晶体管的栅极作为所述驱动模块的控制端；
所述第二晶体管的第一极连接数据线，所述第二晶体管的第二极与所述驱动模块的第一端连接，所述第二晶体管的栅极作为所述数据写入模块的控制端；
所述第三晶体管的第一极连接所述驱动模块的控制端，所述第三晶体管的第二极连接所述驱动模块的第二端，所述第三晶体管的栅极作为所述阈值补偿模块的控制端；
所述第四晶体管的第一极连接于所述第三晶体管的双栅节点，所述第四晶体管的第二极连接所述初始化信号线；
所述第五晶体管的第一极作为所述第一发光控制模块的第一端，所述第五晶体管的第二极作为所述第一发光控制模块的第二端，所述第五晶体管的栅极作为所述第一发光控制模块的控制端；
所述第六晶体管的第一极作为所述第二发光控制模块的第一端，所述第六晶体管的第二极作为所述第二发光控制模块的第二端，所述第六晶体管的栅极作为所述第二发光控制模块的控制端；
所述第七晶体管的第一极连接所述初始化信号线，所述第七晶体管的第二极连接所述发光元件的第一端，所述第七晶体管的栅极作为所述初始化模块的控制端；
所述第一电容的第一极连接所述驱动模块的控制端，所述第一电容的第二极连接所述第一发光控制模块的第一端。
第二方面，本发明实施例还提供了一种显示面板，所述显示面板包括如第一方面所述的像素电路。
可选地，所述像素电路还包括第一发光控制模块和第二发光控制模块；
所述第一发光控制模块的第一端连接第一电源线，所述第一发光控制模块的第二端连接所述驱动模块的第一端，所述第一发光控制模块的控制端连接发光控制信号线；
所述第二发光控制模块的第一端连接所述驱动模块的第二端，所述第二发光控制模块的第二端连接所述发光元件的第一端，所述第二发光控制模块的控制端连接所述发光控制信号线；所述阈值补偿模块的控制端连接第一扫描线，所述漏电抑制模块的控制端连接第二扫描线；
所述显示面板还包括扫描驱动电路和发光控制电路；
所述发光控制信号线连接于所述发光控制电路；所述发光控制电路通过反相器与所述第一扫描线连接。
第三方面，本发明实施例还提供了一种像素电路的控制方法，所述方法应用于第一方面所述的像素电路，所述方法包括：
在初始化阶段，控制所述阈值补偿模块导通、所述漏电抑制模块导通、所述初始化模块导通、所述数据写入模块关断，以及控制所述第一发光控制模块和所述第二光控制模块均关断；
在数据写入阶段，控制所述阈值补偿模块导通、所述漏电抑制模块关断、所述初始化模块关断、所述数据写入模块导通，以及控制所述第一发光控制模块和所述第二光控制模块均关断。
可选地，在数据写入阶段之后还包括发光阶段；在所述发光阶段，控制所述阈值补偿模块关断、所述漏电抑制模块关断、所述初始化模块关断、所述数据写入模块关断，以及控制所述第一发光控制模块和所述第二发光控制模块均导通。
本发明实施例提供的像素电路包括阈值补偿模块，阈值补偿模块连接于驱动模块的控制端和第二端之间，用于对驱动模块的阈值电压进行补偿；进而，在设置阈值补偿模块包括双栅晶体管，以避免驱动模块控制端和存储模块的数据电压经阈值补偿模块漏电的基础上，还设置漏电抑制模块，漏电抑制模块在导通后将初始化信号线上的电压写入阈值补偿模块中双栅晶体管的双栅节点，从而保证了双栅节点的电位不受周围各种电信号(例如Scan信号)、耦合电容效应等影响而发生浮动，也有效地老化处理了双栅晶体管的双栅节点，从而抑制了与驱动模块的控制端以及存储电容连接的双栅晶体管的漏电；即本实施例不仅设置阈值补偿模块包括双栅晶体管，以抑制驱动模块控制端和存储电容经阈值补偿模块漏电，还通过设置漏电抑制模块，以将初始化信号线上的电压写入阈值补偿模块双栅晶体管的双栅节点，据此降低了双栅晶体管的漏电特性，从而进一步抑制了驱动模块控制端和存储模块的数据电压经阈值补偿模块漏电，特别是极大地避免了显示面板低频显示时驱动晶体管控制端和存储模块的数据电压而影响显示效果，保证了显示面板的低频显示效果，也使得显示面板能够更易于适应更低的刷新频率；此外，在漏电抑制模块将初始化信号线上的电压写入阈值补偿模块双栅晶体管双栅节点的同时，该电压还将通过阈值补偿模块的双栅晶体管而被写入驱动模块的控制端，从而初始化驱动模块的控制端，有利于驱动模块的控制端和存储模块的数据电压的写入。
附图说明
图1是本发明实施例提供的一种像素电路的结构示意图；
图2是本发明实施例提供的一种像素电路的结构示意图；
图3是本发明实施例提供的一种像素电路的结构示意图；
图4是本发明实施例提供的一种像素电路对应的驱动时序图；
图5是本发明实施例提供的一种显示面板的结构示意图；
图6是本发明实施例提供的一种像素电路的驱动方法流程图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。
正如背景技术中提到的，现有显示面板的像素电路因连接于驱动晶体管栅极以及存储电容的晶体管容易发生漏电，导致显示面板的低频显示效果不佳。具体来说，驱动晶体管栅极连接有用于存储数据电压的电容和用于阈值电压补偿的阈值补偿晶体管，如果阈值补偿晶体管发生漏电，则电容存储的数据电压将沿着从驱动晶体管栅极至阈值补偿模块的路径漏电，即导致写入电容和驱动晶体管栅极的数据电压降低，从而影响显示效果。进一步地，显示面板以高频显示时，例如刷新频率为60赫兹，从第一行到最后一行完成整个屏幕刷新需要16毫秒，而显示面板以低频显示时，例如刷新频率为6赫兹，从第一行到最后一行完成整个屏幕刷新则需要160毫秒，低频显示相较于高频显示时，驱动晶体管栅极电位保持时间增大了10倍，由此可见，在阈值补偿晶体管的漏电程度恒定的情况下，相较于高频显示，由于低频显示时完成整个屏幕刷新需要的时间更长，从而导致在低频显示时通过阈值补偿晶体管漏掉的数据电压将更多，进而更严重地影响显示效果，即导致显示面板很难适应更低的刷新频率，显示面板在低频显示时显示效果不佳。
有鉴于此，本发明实施例提供一种像素电路，图1是本发明实施例提供的一种像素电路的结构示意图，参见图1，该像素电路包括：
驱动模块1，驱动模块1包括控制端c、第一端a以及第二端b，驱动模块1用于根据控制端c的电压产生驱动电流；
发光元件D，发光元件D用于响应驱动模块1产生的驱动电流发光；
数据写入模块2，数据写入模块2用于将数据电压DATA写入驱动模块1的控制端c；存储模块8，连接驱动模块1的控制端c，用于存驱动模块1控制端c的电压；
阈值补偿模块3，连接于驱动模块1控制端c和第二端b之间，阈值补偿模块3包括双栅晶体管，用于对驱动模块1的阈值电压Vth进行补偿；
漏电抑制模块4，漏电抑制模块4连接于双栅晶体管的双栅节点X和初始化信号线VREF之间，用于导通后将初始化信号线VREF上的电压写入双栅节点X，并通过阈值补偿模块3对驱动模块1的控制端c以及存储模块8进行初始化。
具体地，发光元件D可以是有机发光二极管，其包括阳极和阴极。
数据写入模块2将数据电压DATA依次通过驱动模块1的第一端a和第二端b写入驱动模块1的控制端c，进而驱动模块1根据控制端c的数据电压DATA产生驱动电流，发光元件D响应于驱动电流发光。另外，存储模块8可包括存储电容，存储模块8将经过数据写入模块2写入的数据电压DATA进行存储，以在发光元件D的发光阶段维持驱动模块1的控制端c的电位，从而保证发光元件D在发光阶段的稳定发光。
阈值补偿模块3能够对驱动模块1的阈值电压Vth进行补偿。具体来说，驱动模块1可以是驱动晶体管，驱动模块1的阈值电压Vth即为驱动晶体管的阈值电压，设置了阈值补偿模块3之后，在数据写入模块2的配合下，使得驱动模块1的控制端c的电压可以被写至(DATA+Vth)，从而驱动模块1所产生的驱动电流的计算公式为Id＝K(DATA-VDD)2，K一般为常数，即消除驱动模块1的阈值电压Vth对驱动电流的影响，保证发光元件D的发光效果。
在此基础上，参见图1，阈值补偿模块3包括双栅晶体管。双栅晶体管相较于单栅晶体管而言具备更小的漏电特性，从而阈值补偿模块3不仅对驱动模块1的阈值电压Vth的进行补偿，还因具有较小的漏电特性而避免了写入驱动模块1控制端c和存储模块8的数据电压DATA沿控制端c至阈值补偿模块3的路径漏电，从而也能够较好地避免在显示面板低频显示时数据电压通过阈值补偿模块3漏电而降低，保持存储模块8存储的电压以及驱动模块1控制端c电压的稳定，保证显示面板的低频显示效果，并且也有利于实现显示面板的更低频显示。
进一步地，参见图1，对于像素电路中的双栅晶体管而言，其双栅节点X的电位受周围各种电信号(例如扫描线上的信号)、耦合电容效应等影响很容易发生浮动，这种浮动将使双栅晶体管的漏电特性增大，从而容易引发存储模块8存储的电压以及驱动模块1控制端c通过双栅晶体管漏电；而且，对像素电路中的各个晶体管进行老化处理(aging)的时候，双栅节点X不易直接施加电压而进行有效aging，双栅节点X没有被有效aging时，双栅节点X处的电压也容易因周围各电信号的耦合干扰出现浮动，致使双栅晶体管的漏电特性增大。
对此，本实施例中设置漏电抑制模块4，漏电抑制模块4连接于双栅晶体管的双栅节点X和初始化信号线VREF之间，以将初始化信号线VREF上的电压写入双栅节点X，从而稳定双栅节点X的电位使其不发生浮动，以降低双栅晶体管的漏电特性；而且，漏电抑制模块4将初始化信号线VREF上的电压写入双栅节点X也便于对双栅节点X进行有效aging，即能够直接对该双栅节点X施加电压以对其进行有效aging，从而更好地抑制阈值补偿模块3中的双栅晶体管的漏电特性；据此，本实施例中设置漏电抑制模块4进一步降低了双栅晶体管的漏电特性，从而进一步抑制了阈值补偿模块3的漏电特性，进而进一步避免了写入驱动模块1控制端c和存储模块8的数据电压DATA沿控制端c至阈值补偿模块3的路径漏电，也避免在显示面板低频显示时数据电压通过阈值补偿模块3漏电更多，保证显示面板的低频显示效果，利于实现显示面板的更低频显示。其中，通过漏电抑制模块4对双栅晶体管的双栅节点aging过程，可通过调整初始化信号线VREF上的电压和双栅晶体管的栅极电压的大小达到理想的aging效果，使双栅晶体管的漏电流更小。
另外，本实施例中，在漏电抑制模块4将初始化信号线VREF上的电压写入双栅节点X，以利用初始化信号线VREF上的电压稳定双栅节点X的电位的同时，该初始化信号线VREF上的该电压还被通过阈值补偿模块3写入驱动模块1的控制端c，即对驱动模块1的控制端c进行了初始化。由此可见，本实施例中无需引入额外电信号或者说额外的信号线，通过漏电抑制模块4而直接利用像素电路中原有的初始化信号线VREF，即可同时降低双栅晶体管漏电特性以避免数据电压漏电保证显示效果，以及实现对驱动模块1的控制端c的初始化，也更利于对双栅节点X的aging处理。
可选地，继续参见图1，像素电路还包括第一发光控制模块5和第二发光控制模块6；第一发光控制模块5的第一端连接第一电源线VDD，第一发光控制模块5的第二端连接驱动模块1的第一端a，第一发光控制模块5的控制端连接发光控制信号线EM；第二发光控制模块6的第一端连接驱动模块1的第二端b，第二发光控制模块6的第二端连接发光元件D的第一端，第二发光控制模块6的控制端连接发光控制信号线EM；发光元件D的第二端连接第二电源线VSS。
具体地，第一电源线VDD和第二电源线VSS为发光元件D的发光提供电源。第一发光控制模块5和第二发光控制模块6响应发光控制信号线EM上的信号以控制第一电源线VDD和第二电源线VSS之间路径的通断。在发光元件D的非发光阶段，第一发光控制模块5和第二发光控制模块6响应发光控制信号线EM上的信号以控制第一电源线VDD和第二电源线VSS之间的路径不导通，从而发光元件D不能够发光；在发光元件D的发光阶段，第一发光控制模块5和第二发光控制模块6响应发光控制信号线EM上的信号以控制第一电源线VDD和第二电源线VSS之间的路径导通，从而发光元件D能够发光。
可选地，继续参见图1，阈值补偿模块3的控制端连接第一扫描线Scan1，漏电抑制模块4的控制端连接第二扫描线Scan2；第一扫描线Scan1上的信号上的电平与发光控制信号线EM上的电平相反。
具体地，阈值补偿模块3中双栅晶体管的双栅节点X的电压是通过漏电抑制模块4而写入的初始化信号线VREF上的电压，设置阈值补偿模块3中双栅晶体管的控制端和漏电抑制模块4被不同的扫描信号控制，从而更便于将初始化信号线VREF上的电压写入双栅节点X，以保证双栅节点X的电位不受周围各种电信号(例如Scan信号)、耦合电容效应等影响而发生浮动，从而抑制双栅晶体管的漏电，即抑制阈值补偿模块3的漏电，避免数据电压经阈值补偿模块3漏电，而且，也更便于利用双栅晶体管的栅极的电压和初始化信号线VREF上的电压对双栅晶体管中的每个单栅晶体管进行有效aging，以此进一步抑制双栅晶体管的漏电特性；例如连接于双栅晶体管的栅极的第一扫描线Scan1上的信号为高电平，初始化信号线VREF上的信号为低电平，从而双栅晶体管中靠近驱动模块1的控制端c的单栅晶体管的栅源(漏)电压之间具有电压差，通过调节第一扫描线Scan1上的电压和初始化信号线VREF上的电压即可对该单栅晶体管进行有效aging，从而实现对双栅节点X的有效aging。
第一扫描线Scan1上的信号上的电平与发光控制信号线EM上的电平相反。也就是说，在发光阶段，像素电路已完成数据电压DATA的写入，阈值补偿模块3关断，无需对驱动模块1的控制端c进行初始化；而在非发光阶段，像素电路未完成数据电压DATA的写入，阈值补偿模块3导通，从而能够通过阈值补偿模块3对驱动模块1的控制端c进行初始化，以及将初始化信号线VREF上的电压写入双栅节点X以稳定双栅节点X的电位，也能够对双栅节点X进行aging，降低双栅晶体管的漏电特性，进而避免驱动模块1的控制端c和存储模块8的数据电压DATA沿驱动模块1的控制端c漏电至阈值补偿模块3。
可选地，图2是本发明实施例提供的一种像素电路的结构示意图，参见图2，阈值补偿模块3的控制端连接第一扫描线Scan1，漏电抑制模块4的控制端连接第二扫描线Scan2；数据写入模块2的控制端连接第三扫描线Scan3；像素电路还包括初始化模块7，初始化模块7连接于初始化信号线VREF与发光元件D的第一端之间，初始化模块7的控制端连接第二扫描线Scan2，初始化模块7用于响应于第二扫描线Scan2上的信号将初始化信号传输至发光元件D的第一端。
具体地，阈值补偿模块3、漏电抑制模块4以及数据写入模块2分别以第一扫描线Scan1、第二扫描线Scan2以及第三扫描线Scan3上的扫描信号控制，除了有利于驱动发光元件D发光之外，也便于对像素电路中各晶体管进行aging处理。发光元件D的第一端可以是发光二极管的阳极，第二端是发光二极管的阴极。驱动模块1的控制端c能够被初始化信号线VREF上的初始化信号初始化，发光元件D的第一端也能够被初始化信号线VREF上的初始化信号初始化，因而，可将初始化模块7连接于初始化信号线VREF与发光元件D的第一端之间，并且使得初始化模块7的控制端和漏电抑制模块4的控制端均连接第二扫描线Scan2，以同时实现驱动模块1控制端c和发光元件D第一端的初始化，以及简化像素电路的布线。
可选地，本实施例提供的像素电路，在一帧内，第三扫描线Scan3上的脉冲在第二扫描线Scan2上的脉冲之后；第二扫描线Scan2上的脉冲时间周期和第三扫描线Scan3上的脉冲时间周期均在第一扫描线Scan1上的脉冲的时间周期内。
具体地，示例性地以图2所示意的像素电路来说，第二扫描线Scan2上的脉冲在第三扫描线Scan3上的脉冲之前，并且第二扫描线Scan2上的脉冲时间周期在第一扫描线Scan1上的脉冲的时间周期内，以在数据电压DATA被写入像素电路之前通过漏电抑制模块4对驱动模块1的控制端c进行初始化，以及初始化信号线VREF上的电压写入双栅节点X稳定双栅节点X的电位，也可通过漏电抑制模块4对阈值补偿模块3中双栅晶体管的双栅节点X进行aging处理。第三扫描线Scan3上的脉冲时间周期在第一扫描线Scan1上的脉冲的时间周期内，以通过数据写入模块2和阈值补偿模块3将数据电压DATA写入像素电路，即写入驱动模块1的控制端c。
可选地，图3是本发明实施例提供的一种像素电路的结构示意图，参见图3，驱动模块1包括第一晶体管T1、数据写入模块2包括第二晶体管T2、存储模块8包括第一电容C1、双栅晶体管作为第三晶体管T3、漏电抑制模块4包括第四晶体管T4、第一发光控制模块5包括第五晶体管T5、第二发光控制模块6包括第六晶体管T6以及初始化模块7包括第七晶体管T7；
第一晶体管T1的第一极作为驱动模块1的第一端a，第一晶体管T1的第二极作为驱动模块1的第二端b，第一晶体管T1的栅极作为驱动模块1的控制端c；
第二晶体管T2的第一极连接数据线，第二晶体管T2的第二极与驱动模块1的第一端a连接，第二晶体管T2的栅极作为数据写入模块2的控制端；
第三晶体管T3的第一极连接驱动模块1的控制端c，第三晶体管T3的第二极连接驱动模块1的第二端b，第三晶体管T3的栅极作为阈值补偿模块3的控制端；
第四晶体管T4的第一极连接于第三晶体管T3的双栅节点X，第四晶体管T4的第二极连接初始化信号线VREF；
第五晶体管T5的第一极作为第一发光控制模块5的第一端，第五晶体管T5的第二极作为第一发光控制模块5的第二端，第五晶体管T5的栅极作为第一发光控制模块5的控制端；
第六晶体管T6的第一极作为第二发光控制模块6的第一端，第六晶体管T6的第二极作为第二发光控制模块6的第二端，第六晶体管T6的栅极作为第二发光控制模块6的控制端；
第七晶体管T7的第一极连接初始化信号线VREF，第七晶体管T7的第二极连接发光元件D的第一端，第七晶体管T7的栅极作为初始化模块7的控制端；
第一电容C1的第一极连接驱动模块1的控制端c，第一电容C1的第二极连接第一发光控制模块5的第一端。
图4是本发明实施例提供的一种像素电路对应的驱动时序图，该时序图可应用于本发明实施例上述任一技术方案中的像素电路的驱动中，下面对应图3所提供的像素电路进行说明，其中，第一至第七晶体管T7均为P型晶体管且双栅晶体管中的两个单栅晶体管也均为P型晶体管：
初始化阶段(T1时段)：第一扫描线Scan1置低(电位为低电平)、第二扫描线Scan2置低、第三扫描线Scan3置高(电位为高电平)以及发光控制信号线EM置高，从而第二晶体管T2截止、第三晶体管T3导通、第四晶体管T4导通、第五晶体管T5截止、第六晶体管T6截止以及第七晶体管T7导通。第四晶体管T4将初始化信号线VREF上的电压通过第三晶体管T3写入第一晶体管T1的控制端，以对第一晶体管T1的控制端进行初始化，以及将初始化信号线VREF上的电压写入双栅节点X稳定双栅节点X的电位，初始化信号线VREF上的电压通过第七晶体管T7写入发光元件D的第一端以初始化发光元件D的第一端。
数据写入阶段(T2时段)：第一扫描线Scan1置低、第二扫描线Scan2置高、第三扫描线Scan3置高以及发光控制线置高，从而第二晶体管T2导通、第三晶体管T3导通、第四晶体管T4截止、第五晶体管T5截止、第六晶体管T6截止以及第七晶体管T7截止。第二晶体管T2将数据线上的数据电压DATA依次通过第一晶体管T1的第一极、第一晶体管T1的第二极以及第三晶体管T3而写入第一晶体管T1的栅极，数据电压DATA写入完成时，第一晶体管T1的栅极电压为(DATA+Vth)。
发光阶段(T3时段)：第一扫描线Scan1置高、第二扫描线Scan2置高、第三扫描线Scan3置高以及发光控制线置低，从而第二晶体管T2截止、第三晶体管T3截止、第四晶体管T4截止、第五晶体管T5导通、第六晶体管T6导通以及第七晶体管T7截止。驱动模块1根据控制端的数据电压DATA产生驱动电流，发光元件D响应于驱动电流发光。
对第三晶体管T3中的双栅节点X的aging处理是在像素电路制备完成后通过调节第一扫描线Scan1、第二扫描线Scan2、第三扫描线Scan3、发光控制信号线EM、第一电源线VDD、第二电源线VSS、数据线以及初始化信号线VREF上的电压以对双栅节点X进行aging处理。例如，第一扫描线Scan1置高、第二扫描线Scan2置高、第三扫描线Scan3置低、提供数据电压的数据线置低以及初始化信号线VREF置低，使得双栅节点X处的电压与第三晶体管T3的栅极电压形成电压差，从而对第三晶体管T3中靠近第一晶体管T1的控制端的单栅晶体管进行有效aging，从而实现对双栅节点X的有效aging，进而提升第三晶体管T3的漏电特性，避免了第一晶体管T1控制端和第一电容C1的数据电压DATA沿第一晶体管T1的控制端漏电至第三晶体管T3，保证低频显示效果，以及利于实现更低频的显示。
本发明实施例还提供了一种显示面板，图5是本发明实施例提供的一种显示面板的结构示意图，参见图5，显示面板包括本发明实施例上述任一技术方案中的像素电路100。
可选地，像素电路100还包括第一发光控制模块5和第二发光控制模块6；第一发光控制模块5的第一端连接第一电源线VDD，第一发光控制模块5的第二端连接驱动模块1的第一端a，第一发光控制模块5的控制端连接发光控制信号线EM；第二发光控制模块6的第一端连接驱动模块1的第二端b，第二发光控制模块6的第二端连接发光元件D的第一端，第二发光控制模块6的控制端连接发光控制信号线EM；阈值补偿模块3的控制端连接第一扫描线Scan1，漏电抑制模块4的控制端连接第二扫描线Scan2；
继续参见图5，显示面板还包括扫描驱动电路200和发光控制电路300；发光控制信号线EM连接于发光控制电路300；发光控制电路300通过反相器400与第一扫描线Scan1连接。
具体地，扫描驱动电路200用于向第一扫描线Scan1、第二扫描线Scan2以及第三扫描线Scan3提供扫描信号，发光控制电路300用于向发光控制信号线EM提供发光控制信号，参考图4的驱动时序图，本发明实施例提供的像素电路100中，在一帧内，第一扫描线Scan1上的脉冲和发光控制信号线EM上的脉冲相反，这样，将发光控制电路300与第一扫描线Scan1通过反相器400连接，从而将输出至发光控制信号线EM上的发光控制信号通过反相器400复用为第一扫描线Scan1上的扫描信号，无须为第一扫描线单独设置驱动电路，减少显示面板边框区的电路元件，利于实现窄边框。
本发明实施例提供的显示面板与本发明实施例上述任一技术方案中的像素电路属于相同的发明构思，且显示面板中包括像素电路，因而显示面板能够实现与上述任一技术方案中的像素电路相同的技术效果，重复内容此处不再赘述。
本发明实施例还提供了一种像素电路的控制方法，该方法应用于本发明实施例上述任一技术方案中的像素电路，图6是本发明实施例提供的一种像素电路的驱动方法流程图，参见图6，该方法包括：
S10，在初始化阶段，控制阈值补偿模块导通、漏电抑制模块导通、初始化模块导通、数据写入模块关断，以及控制第一发光控制模块和第二光控制模块均关断。
S11，在数据写入阶段，控制阈值补偿模块导通、漏电抑制模块关断、初始化模块关断、数据写入模块导通，以及控制第一发光控制模块和第二光控制模块均关断。
可选地，本发明实施例提供的一种像素电路的控制方法在数据写入阶段之后还包括发光阶段；在发光阶段，控制阈值补偿模块关断、漏电抑制模块关断、初始化模块关断、数据写入模块关断，以及控制第一发光控制模块和第二发光控制模块均导通。
本发明实施例提供的像素电路的驱动方法与本发明实施例上述任一技术方案中的像素电路属于相同的发明构思，且像素电路的驱动方法可由上述任一技术方案中的像素电路执行，因而上述任一技术方案中的能够实现与上述任一技术方案中的像素电路相同的技术效果，重复内容此处不再赘述。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (10)

1.一种像素电路，其特征在于，包括：
驱动模块，所述驱动模块包括控制端、第一端以及第二端，所述驱动模块用于根据控制端的电压产生驱动电流；
发光元件，所述发光元件用于响应所述驱动模块产生的驱动电流发光；
数据写入模块，所述数据写入模块用于将数据电压写入所述驱动模块的控制端；
存储模块，连接所述驱动模块的控制端，用于存所述驱动模块控制端的电压；
阈值补偿模块，连接于所述驱动模块控制端和第二端之间，所述阈值补偿模块包括双栅晶体管，用于对驱动模块的阈值电压进行补偿；
漏电抑制模块，所述漏电抑制模块连接于所述双栅晶体管的双栅节点和初始化信号线之间，用于导通后将所述初始化信号线上的电压写入所述双栅节点，并通过所述阈值补偿模块对所述驱动模块的控制端以及所述存储模块进行初始化。
2.根据权利要求1所述的像素电路，其特征在于，还包括第一发光控制模块和第二发光控制模块；
所述第一发光控制模块的第一端连接第一电源线，所述第一发光控制模块的第二端连接所述驱动模块的第一端，所述第一发光控制模块的控制端连接发光控制信号线；
所述第二发光控制模块的第一端连接所述驱动模块的第二端，所述第二发光控制模块的第二端连接所述发光元件的第一端，所述第二发光控制模块的控制端连接所述发光控制信号线；
所述发光元件的第二端连接第二电源线。
3.根据权利要求2所述的像素电路，其特征在于，所述阈值补偿模块的控制端连接第一扫描线，所述漏电抑制模块的控制端连接第二扫描线；
所述第一扫描线上的信号上的电平与所述发光控制信号线上的电平相反。
4.根据权利要求2所述的像素电路，其特征在于，所述阈值补偿模块的控制端连接第一扫描线，所述漏电抑制模块的控制端连接第二扫描线；所述数据写入模块的控制端连接第三扫描线；
所述像素电路还包括初始化模块，所述初始化模块连接于所述初始化信号线与所述发光元件的第一端之间，所述初始化模块的控制端连接所述第二扫描线，所述初始化模块用于响应于所述第二扫描线上的信号将初始化信号传输至所述发光元件的第一端。
5.根据权利要求4所述的像素电路，其特征在于，在一帧内，所述第三扫描线上的脉冲在所述第二扫描线上的脉冲之后；
所述第二扫描线上的脉冲时间周期和所述第三扫描线上的脉冲时间周期均在所述第一扫描线上的脉冲的时间周期内。
6.根据权利要求4所述的像素电路，其特征在于，所述驱动模块包括第一晶体管、所述数据写入模块包括第二晶体管、所述存储模块包括第一电容、所述双栅晶体管作为第三晶体管、所述漏电抑制模块包括第四晶体管、所述第一发光控制模块包括第五晶体管、所述第二发光控制模块包括第六晶体管以及所述初始化模块包括第七晶体管；
所述第一晶体管的第一极作为所述驱动模块的第一端，所述第一晶体管的第二极作为所述驱动模块的第二端，所述第一晶体管的栅极作为所述驱动模块的控制端；
所述第二晶体管的第一极连接数据线，所述第二晶体管的第二极与所述驱动模块的第一端连接，所述第二晶体管的栅极作为所述数据写入模块的控制端；
所述第三晶体管的第一极连接所述驱动模块的控制端，所述第三晶体管的第二极连接所述驱动模块的第二端，所述第三晶体管的栅极作为所述阈值补偿模块的控制端；
所述第四晶体管的第一极连接于所述第三晶体管的双栅节点，所述第四晶体管的第二极连接所述初始化信号线；
所述第五晶体管的第一极作为所述第一发光控制模块的第一端，所述第五晶体管的第二极作为所述第一发光控制模块的第二端，所述第五晶体管的栅极作为所述第一发光控制模块的控制端；
所述第六晶体管的第一极作为所述第二发光控制模块的第一端，所述第六晶体管的第二极作为所述第二发光控制模块的第二端，所述第六晶体管的栅极作为所述第二发光控制模块的控制端；
所述第七晶体管的第一极连接所述初始化信号线，所述第七晶体管的第二极连接所述发光元件的第一端，所述第七晶体管的栅极作为所述初始化模块的控制端；
所述第一电容的第一极连接所述驱动模块的控制端，所述第一电容的第二极连接所述第一发光控制模块的第一端。
7.一种显示面板，其特征在于，包括如权利要求1-6任一项所述的像素电路。
8.根据权利要求7所述的显示面板，其特征在于，所述像素电路还包括第一发光控制模块和第二发光控制模块；
所述第一发光控制模块的第一端连接第一电源线，所述第一发光控制模块的第二端连接所述驱动模块的第一端，所述第一发光控制模块的控制端连接发光控制信号线；
所述第二发光控制模块的第一端连接所述驱动模块的第二端，所述第二发光控制模块的第二端连接所述发光元件的第一端，所述第二发光控制模块的控制端连接所述发光控制信号线；所述阈值补偿模块的控制端连接第一扫描线，所述漏电抑制模块的控制端连接第二扫描线；
所述显示面板还包括扫描驱动电路和发光控制电路；
所述发光控制信号线连接于所述发光控制电路；所述发光控制电路通过反相器与所述第一扫描线连接。
9.一种像素电路的控制方法，其特征在于，应用于权利要求1-6任一项所述的像素电路，所述方法包括：
在初始化阶段，控制所述阈值补偿模块导通、所述漏电抑制模块导通、所述初始化模块导通、所述数据写入模块关断，以及控制所述第一发光控制模块和所述第二光控制模块均关断；
在数据写入阶段，控制所述阈值补偿模块导通、所述漏电抑制模块关断、所述初始化模块关断、所述数据写入模块导通，以及控制所述第一发光控制模块和所述第二光控制模块均关断。
10.根据权利要求9所述的像素电路的控制方法，其特征在于，在数据写入阶段之后还包括发光阶段；
在所述发光阶段，控制所述阈值补偿模块关断、所述漏电抑制模块关断、所述初始化模块关断、所述数据写入模块关断，以及控制所述第一发光控制模块和所述第二发光控制模块均导通。
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