CN111986623B - 一种具有多路行扫描信号输出的goa电路 - Google Patents

一种具有多路行扫描信号输出的goa电路 Download PDF

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Abstract

本发明公开了一种具有多路行扫描信号输出的GOA电路，该电路包括有下拉模块、反相模块、第一输出模块以及第二输出模块；下拉模块的输入端接入负电源输入VGL，其输出端接入反相模块；第一输出模块设置至少一个，第一输出模块的输入端接入正电源输入VGH与第一交流窄脉冲时钟信号，且第一输出模块与下拉模块连接，第一输出模块的输出端输出第一驱动信号；第二输出模块与第一输出模块连接，第二输出模块的接入正电源输入VGH与第二交流窄脉冲时钟信号，第二输出模块的输出端输出第二驱动信号。与现有技术相比，本发明提供的GOA电路具有驱动能力强、具有多路输出能力、控制能力强、利于AMOLED显示面板窄边化的有益效果。

Description

一种具有多路行扫描信号输出的GOA电路
技术领域
本发明属于AMOLED制造技术领域，特别涉及一种GOA电路。
背景技术
AMOLED显示面板的核心为像素电路和驱动电路。
若干个像素电路以矩阵的形式阵列组合，形成有效显示面。围绕有效显示面，AMOLED显示面板通常沿其水平方向铺设扫描线，沿竖直方向铺设数据线。其像素电路一般包括有OLED、存储电容以及至少一个开关器件，开关器件普遍采用至少一个薄膜晶体管(Thin Film Transistor，TFT)组成，每一个开关器件的柵极均连接至水平扫描线，其漏极均连接至垂直方向的数据线,其源极则与OLED连接。存储电容在这其中起到存储数据、维持发光的作用。
对应其像素电路，AMOLED显示面板需要在相应的背板上设置栅极驱动电路来对像素电路进行显示驱动。驱动电路一般集成在有效显示面的两侧边框中。为解决传统的芯片驱动方式带来的边框较大的问题，现有技术中出现了GOA(Gate Drive On Array)电路，GOA电路将栅极驱动电路制作在薄膜晶体管阵列背板上，在其输出端输出行扫描信号，像素电路中的TFT管的栅极接收该行扫描信号对应导通或截止，GOA得以实现扫描驱动。
受制于TFT管的制造技术，应用在AMOLED显示面板像素电路中的TFT管不可避免地存在阈值电压漂移、迁移率低、OLED老化等问题，为克服上述问题对最终的显示效果带来的影响，现有技术中一般采用多个TFT管受对应控制时序控制协同作用、对TFT阈值电压进行内部补偿的方法构建像素电路。
请参阅图1和图2。
以图1为例。图1为典型的4T1C型像素电路的电路原理图。在该像素电路中包括有三个开关TFT(T1、T2、T3)、一个驱动TFT(T4)、一个存储电容(Cs)以及一个OLED。VDATA为数据信号，而SCAN1、SCAN2以及EM则为三路不同的控制信号。
如图2为施加在图1所示像素电路上的三路控制信号的时序图，以该时序对应驱动像素电路工作，则该像素电路将能有效补偿TFT管的阈值电压漂移，解决AMOLED显示面板使用过程中OLED老化问题。
为实现像素电路的内部补偿，则应对应设置能输出三路不同的控制信号SCAN1、SCAN2以及EM的GOA电路，但现有技术中，单个GOA电路仅能输出一路行扫描信号，对应三路不同的控制信号SCAN1、SCAN2以及EM，需对应设置三路GOA电路，三路GOA电路均集中布置在有效显示面的两侧，这无疑增加了边框的厚度，不利于AMOLED显示面板窄边化。
发明内容
为解决上述问题，本发明的目的在于提供一种GOA电路，该电路应用于AMOLED显示面板中，从上层控制器中获得多路交流窄脉冲控制信号后，将其转换成为适于驱动像素电路工作的多路行扫描信号，驱动具有对应多管结构的像素电路工作。
为实现上述目的，本发明的技术方案如下：
一种具有多路行扫描信号输出的GOA电路，该电路包括有下拉模块、反相模块、第一输出模块以及第二输出模块；
下拉模块的输入端接入负电源输入VGL，其输出端接入反相模块；
第一输出模块设置至少一个，第一输出模块的输入端接入正电源输入VGH与第一交流窄脉冲时钟信号，且第一输出模块与下拉模块连接，第一输出模块的输出端输出第一驱动信号；
第二输出模块与第一输出模块连接，第二输出模块的接入正电源输入VGH与第二交流窄脉冲时钟信号，第二输出模块的输出端输出第二驱动信号。
进一步地，第一输出模块包括有第一上拉单元、第一输出单元以及第一下拉单元；
第一上拉单元接入正电源输入VGH和第一交流窄脉冲时钟信号，且第一上拉单元与第一输出单元连接，第一输出单元引出输出端，输出第一驱动信号；第一下拉单元与第一输出单元连接，且第一下拉单元还与反相模块连接。
进一步地，第一上拉单元包括有第一TFT管和第二TFT管，第一TFT管的栅极接入前1级的级传信号Cout(n-1)，第一TFT管的漏极连接正电源输入VGH，第一TFT管的源极连接第二TFT管的栅极，第二TFT管漏极连接第一交流窄脉冲时钟信号，第二TFT管的源极连接第一输出单元；第一TFT管与第二TFT管的公共端与下拉单元连接。
进一步地，下拉模块包括有第三TFT管，第三TFT管的栅极接入后4级的反馈信号Cout(n+4)，第三TFT管的漏极连接第一TFT管的漏极，第三TFT管的源极接入负电源输入VGL。
进一步地，反相模块包括有第四TFT管、第五TFT管、第六TFT管和第七TFT管；
第四TFT管的栅极与漏极均与正电源输入VGH连接，第四TFT管的源极连接第五TFT管漏极连接，第五TFT管漏极的源极连接负电源输入VGL；
第四TFT管与第五TFT管的公共端引出，第六TFT管的栅极与该公共端连接，第六TFT管的源极连接第七TFT管漏极连接，第七TFT管漏极的源极连接负电源输入VGL。
进一步地，第一输出单元包括有第一电容，第一电容其中一极与第一TFT管与第二TFT管的公共端连接，第一电容的另一极与第二TFT管的源极连接；
第一电容与第二TFT管的公共端引出输出端，该输出端输出第一驱动信号。
进一步地，第一下拉单元包括有第八TFT管和第九TFT管；
第八TFT管的栅极连接第六TFT管与第七TFT管的公共端，第八TFT管的漏极与第二TFT管和第一电容的公共端连接，第八TFT管的源极连接负电源输入VGL；第九TFT管的栅极连接第六TFT管与第七TFT管的公共端，第九TFT管的漏极连接第二TFT管和第一电容的公共端，第九TFT管的源极连接负电源输入VGL。
进一步地，第二输出模块包括有第二上拉单元、第二输出单元以及第二下拉单元；
第二上拉单元接入正电源输入VGH和第二交流窄脉冲时钟信号；第二上拉单元与第二输出单元连接，第二输出单元引出输出端，输出第二驱动信号；第二下拉单元接入正电源输入VGH，且第二下拉单元与第二输出单元连接，第二下拉维持单元还与反相模块连接。
进一步地，第二上拉单元包括有第十TFT管和第十一TFT管，第二输出单元包括有第二电容；
第一TFT管的栅极接入前1级的级传信号Cout(n-1)，第十TFT管的漏极连接正电源输入VGH，第十一TFT管的源极连接第十一TFT管的栅极，第十一TFT管漏极连接第二交流窄脉冲时钟信号，第十一TFT管的源极连接第二输出单元；第十TFT管与第十一TFT管的公共端连接第二电容的其中一极，第十一TFT管的源极连接第二电容的另一极。
进一步地，第二下拉单元包括有第十二TFT管和第十三TFT管；
第十二TFT管的栅极连接第六TFT管与第七TFT管的公共端，第十二TFT管的漏极连接第十TFT管与第二电容的公共端，第十二TFT管连接负电源输入VGL；第十三TFT管的栅极连接第六TFT管与第七TFT管的公共端，第十三TFT管的连接第十一TFT管和第二电容的公共端，第十三TFT管的漏极连接正电源输入VGH。
本发明的有益效果为：驱动能力强：从上层控制器中获得第一交流窄脉冲时钟信号与第二交流窄脉冲时钟信号后，本发明提供的GOA电路将其转换成为第一驱动信号与第二驱动信号分别发出，驱动其对应行上排布的像素电路工作。
具有多路输出能力：发明提供的技术方案中，第一输出电路至少设置一个，则该GOA电路至少可输出一路第一驱动信号以及一路第二驱动信号，方便应对像素电路中为对TFT管电压阈值做出内部补偿而设置的多管结构。
控制能力强：该GOA电路中的多路输出之间互相独立互不干扰，可分别驱动与其连接的TFT管的独立工作相对独立。
利于AMOLED显示面板窄边化：区别于现有技术中GOA电路仅能输出一路驱动信号，本发明提供的GOA电路能输出多路驱动信号，GOA电路的规模得以大幅减小，AMOLED的边框也可由此做到更窄。
附图说明
图1是现有技术中典型的4T1C型像素电路的电路原理图。
图2是施加在图1所示电路图中SCAN1、SCAN2以及EM三路控制信号的时序图。
图3是具体实施方式中所实现的具有一路级传信号以及三路行扫描信号输出的GOA电路的电路原理图。
图4是施加在图3所示的具有一路级传信号以及三路行扫描信号输出的GOA电路上的Cout(n-1)、CK1、CK2、CK3、VGH以及VGL的时序图。
图5是具体实施方式中所实现的具有一路级传信号以及三路行扫描信号输出的整体GOA电路S1～S6过程的电平变化示意图。
具体实施方式
为了使本发明的目的、技术方案及优点更加清楚明白，以下结合附图及实施例，对本发明进行进一步详细说明。应当理解，此处所描述的具体实施例仅仅用以解释本发明，并不用于限定本发明。
为实现上述目的，本发明的技术方案如下：
请参阅图3。
在本具体实施方式中提供一种具有多路行扫描信号输出的GOA电路，该电路包括有下拉模块、反相模块、第一输出模块以及第二输出模块；
下拉模块的输入端接入负电源输入VGL，其输出端接入反相模块；
第一输出模块设置三个，每一个第一输出模块的输入端接入正电源输入VGH与第一交流窄脉冲时钟信号，且第一输出模块与下拉模块连接，第一输出模块的输出端输出第一驱动信号；
第二输出模块与第一输出模块连接，第二输出模块的接入正电源输入VGH与第二交流窄脉冲时钟信号，第二输出模块的输出端输出第二驱动信号。
在本具体实施方式中，每一个第一输出模块包括有第一上拉单元、第一输出单元以及第一下拉单元；
第一上拉单元接入正电源输入VGH和第一交流窄脉冲时钟信号，且第一上拉单元与第一输出单元连接，第一输出单元引出输出端，输出第一驱动信号；第一下拉单元与第一输出单元连接，且第一下拉单元还与反相模块连接。
在本具体实施方式中，第一上拉单元包括有第一TFT管(T11/T12/T13)和第二TFT管(T21/T22/T23)，每一个第一TFT管(T11/T12/T13)的栅极均接入前1级的级传信号Cout(n-1)，每一个第一TFT管(T11/T12/T13)的漏极均连接正电源输入VGH，每一个第一TFT管(T11/T12/T13)的漏极分别连接与其对应的第二TFT管(T21/T22/T23)的栅极，每一个第二TFT管(T21/T22/T23)漏极分别连接对应的第一交流窄脉冲时钟信号(CK3/CK1/CK2)，每一个第二TFT管(T21/T22/T23)的源极分别连接与其对应的第一输出单元；每一个第一TFT管(T11/T12/T13)与其对应的第二TFT管(T21/T22/T23)的公共端还与下拉单元连接。
在本具体实施方式中，每一个下拉模块包括有第三TFT管T3，第三TFT管T3的栅极接入后两级的反馈信号Cout(n+2)，第三TFT管T3的漏极连接第一个第一TFT管T11的源极，第三TFT管T3的源极接入负电源输入VGL。
在本具体实施方式中，反相模块包括有第四TFT管T51、第五TFT管T52、第六TFT管T53和第七TFT管T54；
第四TFT管T51的栅极与漏极均与正电源输入VGH连接，第四TFT管T51的源极连接第五TFT管T52漏极连接，第五TFT管T52漏极的源极连接负电源输入VGL；
第四TFT管T51与第五TFT管T52的公共端引出，第六TFT管T53的栅极与该公共端连接，第六TFT管T53的源极连接第七TFT管T54漏极连接，第七TFT管T54漏极的源极连接负电源输入VGL。
在本具体实施方式中，每一个第一输出单元包括有第一电容(C1/C2/C3)，每一个第一电容(C1/C2/C3)其中一极与其对应的第二TFT管(T21/T22/T23)的源极连接，每一个第一电容(C1/C2/C3)的另一极与均与其对应的第二TFT管(T21/T22/T23)的源极连接；
每一个第一电容(C1/C2/C3)与其对应的第二TFT管(T21/T22/T23)的公共端分别引出输出端，分别输出第一驱动信号(Cout(n+2)/SCAN1(n)/SCAN2(n))。
在本具体实施方式中，每一个第一下拉单元中均包括有第八TFT管(T41/T43/T45)和第九TFT管(T42/T44/T46)；
每一个第八TFT管(T41/T43/T45)的栅极连接第六TFT管T53与第七TFT管T54的公共端，每一个第八TFT管(T41/T43/T45)的漏极与第二TFT管(T21/T22/T23)和第一电容(C1/C2/C3)的公共端连接，每一个第八TFT管(T41/T43/T45)的源极连接负电源输入VGL；每一个第九TFT管(T42/T44/T46)的栅极连接第六TFT管T53与第七TFT管T54的公共端，每一个第九TFT管(T42/T44/T46)的漏极连接与其对应的第二TFT管(T21/T22/T23)和对应的第一电容(C1/C2/C3)的公共端，每一个第九TFT管(T42/T44/T46)的源极连接负电源输入VGL。
在本具体实施方式中，第二输出模块包括有第二上拉单元、第二输出单元以及第二下拉单元；
第二上拉单元接入正电源输入VGH和第二交流窄脉冲时钟信号；第二上拉单元与第二输出单元连接，第二输出单元引出输出端，输出第二驱动信号；第二下拉单元接入正电源输入VGH，且第二下拉单元与第二输出单元连接，第二下拉维持单元还与反相模块连接。
在本具体实施方式中，第二上拉单元包括有第十TFT管T14和第十一TFT管T24，第二输出单元包括有第二电容C4；
第十TFT管T14的栅极接入前1级的级传信号Cout(n-1)，第十TFT管T14的漏极连接正电源输入VGH，第十一TFT管T24漏极连接第二交流窄脉冲时钟信号，第十一TFT管T24的源极连接第二输出单元；第十TFT管T14与第十一TFT管T24的公共端连接第二电容C4的其中一极，第十一TFT管T24的源极连接第二电容C4的另一极。
在本具体实施方式中，第二下拉单元包括有第十二TFT管T47和第十三TFT管T48；
第十二TFT管T47的栅极连接第六TFT管与第七TFT管的公共端，第十二TFT管T47的漏极连接第十TFT管T14与第二电容C4的公共端，第十二TFT管T47连接负电源输入VGL；第十三TFT管T48的栅极连接第六TFT管T53与第七TFT管T54，第十三TFT管的源极T48连接第十一TFT管T24和第二电容C4的公共端，第十三TFT管T48的漏极连接正电源输入VGH。
请参阅图4-5。
按照Cout(n+4)、Cout(n-1)、CK1、CK2、CK3、VGH以及VGL的输入的时序，则Cout(n+2)、SCAN1(n)、SCAN2(n)以及EM(n)对应输出，按照输入信号的电平变化情况，将整个电路的工作周期分为S1～S6阶段，各个阶段内电路的工作情况如下：
S1阶段：Cout(n-1)升为高电位，第一个第一TFT管T11打开，Q1点被拉升至高电位，第五TFT管T52，第七TFT管T54，第二TFT管T21打开，由于Q1点与QB点之间连接反相器模块，Q1点与QB点之间电位反相，因此，QB处于低电位，第八TFT管(T41/T43/T45)、第九TFT管(T42/T44/T46)、第十二TFT管T47和第十三TFT管T48均关闭，同时，第二个第一TFT管T12，第三个第一TFT管T13，第二TFT管T14均打开，Q2，Q3，Q4升为高电位，第二个第二TFT管、第三个第一TFT管T23、第十一TFT管T24均打开，由于此时CK1～CK3均为低电位，则对于下两级的级传信号Cout(n+2)，行扫描信号Scan1(n)，scan2(n)，EM(n)均为低电位。
S2阶段：Cout(n-1)降为低电位，第一TFT管(T11/T12/T13)关闭，Q1～Q4点维持高电位，CK1及CK2波形由低电位变为高电位，Scan1(n)及Scan2(n)输出高电位，由于第二个第一电容C2和第三个第一点融C3的存在，Q2及Q3被耦合至更高电位，Cout(n+2)及EM(n)输出低电位。
S3阶段：CK2降为低电位，Scan1(n)输出低电位，Q3点电位被耦合至与S1阶段相同电位。
S4阶段：CK2由低电位升为高电位，Scan1(n)输出高电位，Q3点被耦合至更高电位；CK1由高电位降至低电位，Scan2(n)输出低电位，Q2被耦合至与S1阶段相同高电位；CK3由低电位升至高电位，Cout(n+2)输出高电位，Q1被耦合至更高电位，Q4被耦合至更高电位。
S5阶段：CK3由高电位降至低电位，EM(n)输出低电位，Q4被耦合至与S1相同高电位。
S6阶段：后四级级传信号Cout(n+4)升为高电位，T3打开，Q1点电位被拉低至低电位，由于反相器的存在，QB点被拉至高电位，第八TFT管(T41/T43/T45)、第九TFT管(T42/T44/T46)、第十二TFT管T47和第十三TFT管T48开启，Cout(n+2)，Scan1(n)及Scan2(n)降为低电位，EM(n)输出高电位。
以上仅为本发明的较佳实施例而已，并不用以限制本发明，凡在本发明的精神和原则之内所作的任何修改、等同替换和改进等，均应包含在本发明的保护范围之内。

Claims (1)

1.一种具有多路行扫描信号输出的GOA电路，其特征在于，该电路包括有下拉模块、反相模块、第一输出模块以及第二输出模块；
所述下拉模块的输入端接入负电源输入VGL，其输出端接入所述反相模块；
所述第一输出模块设置至少一个，所述第一输出模块的输入端接入正电源输入VGH与第一交流窄脉冲时钟信号，且所述第一输出模块与所述下拉模块连接，所述第一输出模块的输出端输出第一驱动信号；
所述第二输出模块与第一输出模块连接，所述第二输出模块的输入端接入正电源输入VGH与第二交流窄脉冲时钟信号，所述第二输出模块的输出端输出第二驱动信号；
所述第一输出模块包括有第一上拉单元、第一输出单元以及第一下拉单元；
所述第一上拉单元接入正电源输入VGH和第一交流窄脉冲时钟信号，且所述第一上拉单元与所述第一输出单元连接，所述第一输出单元引出输出端，输出第一驱动信号；所述第一下拉单元与所述第一输出单元连接，且所述第一下拉单元还与所述反相模块连接；
所述第一上拉单元包括有第一TFT管和第二TFT管，所述第一TFT管的栅极接入前1级的级传信号Cout(n-1)，所述第一TFT管的漏极连接正电源输入VGH，所述第一TFT管的源极连接第二TFT管的栅极，所述第二TFT管漏极连接第一交流窄脉冲时钟信号，所述第二TFT管的源极连接第一输出单元；所述第一TFT管与所述第二TFT管的公共端与所述第一下拉单元连接；
所述下拉模块包括有第三TFT管，所述第三TFT管的栅极接入后两级的反馈信号Cout(n+4)，所述第三TFT管的漏极连接所述第一TFT管的漏极，所述第三TFT管的源极接入负电源输入VGL；
所述反相模块包括有第四TFT管、第五TFT管、第六TFT管和第七TFT管；
所述第四TFT管的栅极与漏极均与正电源输入VGH连接，所述第四TFT管的源极连接所述第五TFT管漏极连接，所述第五TFT管漏极的源极连接负电源输入VGL；
所述第四TFT管与所述第五TFT管的公共端引出，所述第六TFT管的栅极与该公共端连接，所述第六TFT管的源极连接所述第七TFT管漏极连接，所述第七TFT管漏极的源极连接负电源输入VGL；
所述第一输出单元包括有第一电容，所述第一电容其中一极与所述第二TFT管的栅极连接，所述第一电容的另一极与所述第二TFT管的源极连接；
所述第一电容与所述第二TFT管的公共端引出输出端，该输出端输出第一驱动信号；
所述第一下拉单元包括有第八TFT管和第九TFT管；
所述第八TFT管的栅极连接第六TFT管与第七TFT管的公共端，所述第八TFT管的漏极与所述第二TFT管和第一电容的公共端连接，所述第八TFT管的源极连接负电源输入VGL；所述第九TFT管的栅极连接第六TFT管与第七TFT管的公共端，所述第九TFT管的漏极连接所述第二TFT管和第一电容的公共端，所述第九TFT管的源极连接负电源输入VGL；
所述第二输出模块包括有第二上拉单元、第二输出单元以及第二下拉单元；
所述第二上拉单元接入正电源输入VGH和第二交流窄脉冲时钟信号；所述第二上拉单元与所述第二输出单元连接，所述第二输出单元引出输出端，输出第二驱动信号；所述第二下拉单元接入正电源输入VGH，且所述第二下拉单元与所述第二输出单元连接，所述第二下拉维持单元还与所述反相模块连接；
所述第二上拉单元包括有第十TFT管和第十一TFT管，所述第二输出单元包括有第二电容；
所述第十TFT管的栅极接入前1级的级传信号Cout(n-1)，所述第十TFT管的漏极连接正电源输入VGH，所述第十TFT管的源极连接第十一TFT管的栅极，所述第十一TFT管漏极连接第二交流窄脉冲时钟信号，所述第十一TFT管的源极连接第二输出单元；所述第十TFT管与所述第十一TFT管的公共端连接所述第二电容的其中一极，所述第十一TFT管的源极连接所述第二电容的另一极；
所述第二下拉单元包括有第十二TFT管和第十三TFT管；
所述第十二TFT管的栅极连接第六TFT管与第七TFT管的公共端，所述第十二TFT管的漏极连接所述第十TFT管与所述第二电容的公共端，所述第十二TFT管连接负电源输入VGL；所述第十三TFT管的栅极连接所述第六TFT管与第七TFT管的公共端，所述十三TFT管的源极连接所述第十一TFT管和第二电容的公共端，所述第十三TFT管的漏极连接正电源输入VGH。
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