CN107680537B - 一种像素电路的驱动方法 - Google Patents

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Abstract

本发明公开了一种像素电路的驱动方法，包括：显示的一帧时间内，在发光阶段之前包括N次初始化阶段、N次数据信号电压写入阶段；其中，第i次数据信号电压写入阶段在第i次初始化阶段之后，并在第i+1次初始化阶段之前，第N次数据信号电压写入阶段在第N次初始化阶段之后，其中，1≤i≤N‑1，i为整数，N为大于1的整数；在初始化阶段，初始化模块将初始化电压写入驱动晶体管的栅极；在数据信号电压写入阶段，数据信号电压写入模块将数据信号电压写入驱动晶体管的栅极；存储模块用于保持驱动晶体管的栅极电压；在发光阶段，驱动晶体管产生驱动电流驱动发光元件发光。本发明实施例提供的技术方案，改善了晶体管的迟滞效应，提高了显示效果。

Description

一种像素电路的驱动方法
技术领域
本发明实施例涉及显示技术领域，尤其涉及一种像素电路的驱动方法。
背景技术
有机发光显示器相比于液晶显示器，有机发光显示器具有生产成本低、能耗低、自发光、视角宽及响应速度快等优点，目前广泛应用于手机、PDA和数码相机等显示领域。有机发光显示器面板中设置有多个像素电路。
像素电路一般包括驱动晶体管、若干个开关晶体管和存储电容，驱动晶体管产生的驱动电流驱动有机发光元件发光显示。在像素显示很多帧黑色画面时，驱动晶体管较长时间处于截止状态，此时由于驱动晶体管栅极电位较高，使驱动晶体管较长时间处于正偏压下，阈值电压发生漂移；然后切换到白画面，由于驱动晶体管的阈值电压无法及时回复，即驱动晶体管的迟滞效应导致第一帧白画面时显示亮度偏低，显示效果较差。
发明内容
本发明提供一种像素电路的驱动方法，以改善驱动晶体管的迟滞效应，解决显示过程中出现的黑白画面切换时初始时间段亮度无法达到目标亮度值的问题，提高显示效果。
有鉴于此，本发明实施例提供了一种像素电路的驱动方法，其中，所述像素电路包括发光元件、驱动晶体管、初始化模块、数据信号电压写入模块和存储模块；
所述驱动方法包括：
显示的一帧时间内，在发光阶段之前包括N次初始化阶段、N次数据信号电压写入阶段；其中，第i次所述数据信号电压写入阶段在第i次所述初始化阶段之后，并在第i+1次所述初始化阶段之前，第N次所述数据信号电压写入阶段在第N次所述初始化阶段之后，其中，1≤i≤N-1，i为整数，N为大于1的整数；
在所述初始化阶段，所述初始化模块将初始化电压写入所述驱动晶体管的栅极；
在所述数据信号电压写入阶段，所述数据信号电压写入模块将数据信号电压写入所述驱动晶体管的栅极；
所述存储模块用于保持所述驱动晶体管的栅极电压；
在所述发光阶段，所述驱动晶体管产生驱动电流驱动所述发光元件发光。
本发明通过设置显示的一帧时间内，在发光阶段之前包括N次初始化阶段、 N次数据信号电压写入阶段，其中，第i次数据信号电压写入阶段在第i次初始化阶段之后，并在第i+1次初始化阶段之前，第N次数据信号电压写入阶段在第N次初始化阶段之后；在初始化阶段，初始化模块将初始化电压写入驱动晶体管的栅极，在数据信号电压写入阶段，数据信号电压写入模块将数据信号电压写入驱动晶体管的栅极，即在显示的每一帧时间内，在发光阶段之前重复N 次先初始化再写入数据信号电压，使得驱动晶体管有N次大电流流过，改善了驱动晶体管阈值电压漂移导致的迟滞效应，解决了显示过程中出现的黑白画面切换时初始时间段亮度无法达到目标亮度值的问题，提高显示效果。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图做一简单地介绍，显而易见地，下面描述中的附图是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是本发明实施例提供的一种驱动周期的示意图；
图2是现有技术提供的一种像素电路的电路图；
图3是现有像素电路的驱动方法由黑画面切换为白画面时亮度变化示意图；
图4是本发明实施例提供的像素电路的驱动方法由黑画面切换为白画面时的亮度变化示意图；
图5是本发明实施例提供的另一种驱动周期的示意图；
图6是本发明实施例提供的一种驱动时序图；
图7是本发明实施例提供的一种像素电路的电路图；
图8是本发明实施例提供的另一种驱动时序图；
图9是本发明实施例提供的另一种像素电路的电路图；
图10是本发明实施例提供的另一种驱动时序图；
图11是本发明实施例提供的另一种像素电路的电路图；
图12是本发明实施例提供的另一种驱动时序图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。
本发明实施例提供一种像素电路的驱动方法，其中，像素电路包括发光元件、驱动晶体管、初始化模块、数据信号电压写入模块和存储模块；
参考像素电路的驱动方法包括：
显示的一帧时间内，在发光阶段之前包括N次初始化阶段、N次数据信号电压写入阶段；其中，第i次数据信号电压写入阶段在第i次初始化阶段之后，并在第i+1次初始化阶段之前，第N次数据信号电压写入阶段在第N次初始化阶段之后，其中，1≤i≤N-1，i为整数，N为大于1的整数；
在初始化阶段，初始化模块将初始化电压写入驱动晶体管的栅极；
在数据信号电压写入阶段，数据信号电压写入模块将数据信号电压写入驱动晶体管的栅极；
存储模块用于保持驱动晶体管的栅极电压；
在发光阶段，驱动晶体管产生驱动电流驱动发光元件发光。
示例性地，参考图1，图1是本发明实施例提供的一种驱动周期的示意图，在一帧时间内，在发光阶段Emit之前包括N次初始化阶段Ref1-RefN、N次数据信号电压写入阶段Data1-DataN；其中，第i次数据信号电压写入阶段Datai在第i次初始化阶段Refi之后，并在第i+1次初始化阶段Refi+1之前，第N次数据信号电压写入阶段DataN在第N次初始化阶段RefN之后。其中，1≤i≤N-1，i 为整数，N为大于1的整数，也就是，N最小为2，即在发光阶段之前至少包括两次初始化阶段、两次数据信号电压写入阶段；在发光阶段之前可以包括多次初始化阶段以及多次数据信号电压写入阶段，可根据像素电路的实际需求设置初始化阶段和数据信号电压写入阶段的次数，在此不做限制。
在初始化阶段，初始化模块将初始化电压写入驱动晶体管的栅极；在数据信号电压写入阶段，数据信号电压写入模块将数据信号电压写入驱动晶体管的栅极；在发光阶段，驱动晶体管根据其栅极写入的数据信号电压产生相应的驱动电流，驱动电流驱动发光元件发光显示。同时，存储模块保持驱动晶体管的栅极电压，驱动晶体管产生驱动电流以驱动发光元件持续发光。
示例性的，参考图2，图2是现有技术提供的一种像素电路的电路图。数据信号电压写入模块13的第一极与数据线Vdata电连接，第二极与驱动晶体管 T1的第一极电连接；第一发光控制模块14的第一极与第一电源电压信号线 PVDD电连接，第二极与驱动晶体管T1的第一极电连接；初始化模块16的第一极与初始化电压信号线Vint电连接，第二极与驱动晶体管T1的栅极电连接；存储模块17的第一极与驱动晶体管T1的栅极电连接，第二极与第一电源电压信号线PVDD电连接；发光元件11的第一极与驱动晶体管T1的第二极电连接，第二极与第二电源电压信号线PVEE电连接。该像素电路的每一帧只包括一个初始化阶段和一个数据信号电压写入阶段，针对该像素电路进行仿真模拟，第 n-1帧为0灰阶，第n帧为255灰阶，第n+1帧为255灰阶，对第一节点N1和第二节点N2在不同时段的电位进行检测，检测结果如下表所示。
表1
由上述表1可以看出，在初始化阶段，第n帧时，第二节点N2的电位与第n+1帧时第二节点N2的电位不同。这是由于在初始化阶段时，第n帧时，第一节点N1的电位-3V是由3.44V(第n-1帧的发光阶段第一节点N1的电位) 过来；而第n+1帧的第一节点N1的电位-3V是由1.5V切换过来的，由于像素电路中第一节点N1和第二节点N2之间存在寄生电容，而第二节点N2在初始化阶段处于悬空状态，因此第一节点N1的电压变化量△V不一致，导致第n帧初始化阶段时第二节点N2的电位与第n+1帧初始化阶段第二节点N2的电位不同。进而导致在数据写入阶段时，第n帧时第一节点N1的电位与第n+1帧时第一节点N1的电位不同，从而造成第n帧亮度与第n+1帧亮度不一致的问题。例如，第n-1帧可对应像素显示的黑画面，第n帧可对应像素显示的白画面，可为开始显示的第一帧，这样将造成第一帧的亮度不一致。并且该像素电路驱动发光元件发光一段时间后，由于偏压应力会使驱动晶体管的阈值电压发生偏压，受偏移变化不同影响，出现迟滞效应，进而导致残影现象出现，影响显示效果。
针对图2所示的像素电路使用本发明实施例提供的像素电路的驱动方法，在显示的一帧时间内，在发光阶段进行N次初始化阶段和N次数据信号电压写入阶段；在初始化阶段，初始化模块16将初始化电压写入驱动晶体管T1的栅极；在数据信号电压写入阶段，数据信号电压写入模块13 将数据信号电压写入驱动晶体管的栅极，具体地，数据信号电压写入模块13 将数据信号电压写入驱动晶体管T1的第一极(源极)，该数据信号电压经过驱动晶体管T1、阈值补偿模块14而写入驱动晶体管T1的栅极。如此，先经过初始化阶段再经过写入数据信号电压，并且进行N次初始化阶段和和数据信号电压写入阶段，即在每一帧的最后一次数据信号电压写入阶段之前，对第一节点N1进行多次初始化，而且将第二节点N2的电压强制为数据信号电压，可以使每一帧经过N次初始化阶段和N-1次数据信号电压写入阶段后，第一节点N1的电位均一致，而且第二节点N2的电位也均一致，解决了显示过程中出现的黑白画面切换时初始时间段亮度无法达到目标亮度的问题，改善亮度不一致现象，提高显示的均一性。而且每一次驱动晶体管T1的栅极写入的初始化电压，以及驱动晶体管T1 的源极写入的数据信号电压使驱动晶体管T1中有一次大电流流过，经N次初始化电压和N次数据信号电压写入驱动晶体管，驱动晶体管中有N次大电流流过，可以恢复驱动晶体管T1因偏压引起的性能漂移，改善了驱动晶体管T1的迟滞效应，提高显示效果。
图3是现有像素电路的驱动方法由黑画面切换为白画面时亮度变化示意图，图4是本发明实施例提供的像素电路的驱动方法由黑画面切换为白画面时的亮度变化示意图。参考图3和图4，横轴X代表标识时间的测量点，纵轴Y代表亮度，比较图3中亮度变化曲线111和图4中亮度变化曲线121，其中，110表示图3中的第一帧白画面的亮度，120表示图4中第一帧白画面的亮度。对于一目标灰阶的白画面，采用现有像素电路的驱动方法，由黑画面切换到该目标灰阶的白画面时，第一帧白画面的亮度值Y只能达到160左右，低于正常目标亮度值210；而采用本发明实施例提供的像素电路的驱动方法，由黑画面切换到该目标灰阶白画面时，第一帧白画面的亮度值接近在200-210范围内，与正常目标亮度值210相当。由此，采用本发明实施里提供的像素电路的驱动方法，有效改善了由黑画面切换为白画面时，第一帧白画面的亮度偏低的问题，而且改善了驱动晶体管的迟滞效应，提高了显示效果。
本发明实施例提供的像素电路还包括第一发光控制模块，用于控制发光元件发光；在N次初始化阶段和N次数据信号电压写入阶段，第一发光控制模块截止。如果初始化阶段和数据信号电压写入阶段，第一发光控制模块导通，数据信号电压无法有效写入驱动晶体管的栅极。例如参考图2，在初始化阶段和数据信号电压写入阶段，如果将第一发光控制模块14导通，可能将数据线Vdata 和第一电源电压信号线PVDD短路。图2中的第二发光控制模块15可以作为第一发光控制模块14，在N次初始化阶段和N次数据信号电压写入阶段，如果第二发光控制模块15导通，驱动晶体管T1产生的驱动电流流经发光元件，驱动发光元件11发光，而此时驱动晶体管栅极电位是产生变化的，产生的驱动电流也将变化，有可能引起闪烁。因此需要在在N次初始化阶段和N次数据信号电压写入阶段，控制第一发光控制模块14截止。
图5是本发明实施例提供的另一种驱动周期的示意图，参考图5，本发明实施例提供的像素电路的驱动方法中N＝3。即，显示的一帧时间内，在发光阶段之前包括3次初始化阶段、3次数据信号电压写入阶段，各阶段依序排列为：第1次初始化阶段Ref1、第1次数据信号电压写入阶段Data1、第2次初始化阶段Ref2、第2次数据信号电压写入阶段Data2、第3次初始化阶段Ref3、第3次数据信号电压写入阶段Data3和发光阶段Emit。
如此，本发明实施例提供的像素电路的驱动方法，显示的一帧时间内，在发光阶段之前，通过重复3次初始化阶段和3次数据信号电压写入阶段，使驱动晶体管中有3次大电流流过，改善了驱动晶体管阈值电压漂移导致的迟滞效应，解决了显示过程中出现的黑白画面切换时初始时间段亮度无法达到目标亮度值的问题，提高了显示效果。如果初始化阶段和数据信号电压写入阶段的次数较少，将不能有效改善驱动晶体管的迟滞效应。另外，由于每一次初始化阶段和数据信号电压写入阶段都需要一定的时间，设置过多次数的初始化阶段和数据信号电压写入阶段会导致发光阶段的时长相对减少，从而使显示画面闪烁，影响显示效果。因此，显示的一帧时间内，在发光阶段之前包括3次初始化阶段和3次数据信号电压写入阶段，既可以有效改善了驱动晶体管阈值电压漂移导致的迟滞效应，又避免了发光阶段间隔时间过长导致的显示画面闪烁的问题，从而进一步提高了显示效果。
进一步地，本发明实施例提供的像素电路的驱动方法，在第1～第N-1次数据信号电压写入阶段，数据信号电压写入模块写入0灰阶电压或者255灰阶电压，在第N次数据信号电压写入阶段，数据信号电压写入模块写入数据信号电压，数据信号电压为0～255灰阶电压中一个。
其中，对于一些类型显示面板，0灰阶电压对应的是黑画面，255灰阶电压对应的是白画面，对于另外一些类型的显示面板，0灰阶电压对应的是白画面， 255灰阶电压对应的是黑画面。在本发明实施例中，0灰阶电压或者255灰阶电压对应针对的是不同产品的显示的白画面，即在第1～第N-1次数据信号电压写入阶段，数据信号电压写入模块将对应最大亮度的数据信号电压写入驱动晶体管的栅极。驱动晶体管在此情况下流过的电流最大，最大程度地减小驱动晶体管的阈值电压漂移问题，最大程度地改善驱动晶体管的迟滞效应；而第N次数据信号电压写入阶段，需要写入该帧对应的目标灰阶电压，因此，在第N次数据信号电压写入阶段，数据信号电压写入模块写入数据信号电压，数据信号电压为0～255灰阶电压中一个。
进一步地，本发明实施例提供的像素电路的驱动方法，任意相邻的两次初始化阶段时间间隔相同，任意相邻的两次数据信号电压写入阶段的时间间隔相同。这样，简化了初始化阶段和数据信号电压写入阶段的程序设计；由于初始化阶段和数据信号电压写入阶段一般均在扫描线输出扫描信号期间，可以有扫描提供相应的控制信号，控制相邻的两次初始化阶段时间间隔，以及相邻的两次数据信号电压写入阶段的时间间隔。因此，相邻两行像素电路可以共用一条扫描线，一方面，节省了第一扫描线和第二扫描线的用料成本；另一方面，减少了第一扫描线和第二扫描线在阵列基板上占用的面积，而且减小了为扫描线提供扫描信号的驱动电路，而驱动电路一般设置于显示面板的边框区域，便于实现阵列基板的窄边框设计。
图6是本发明实施例提供的一种驱动时序图，参考图6参考和图2，本发明实施例提供的像素电路的驱动方法，初始化模块16的控制端与第一扫描线 S1电连接，数据信号电压写入模块13的控制端与第二扫描线S2电连接，第一发光控制模块14的控制端与第一发光信号线Emit1电连接；第一扫描线S1、第二扫描线S2均包括N个扫描信号脉冲，第一发光信号线Emit1包括至少一个扫描信号脉冲，第一发光信号线Emit1的至少一个扫描信号脉冲覆盖第一扫描线S1、第二扫描线S2的N个扫描信号脉冲。
此时，第一扫描线S1控制初始化模块16向驱动晶体管T1写入初始化电压，第二扫描线S2控制数据信号电压写入模块13向驱动晶体管T1写入数据信号电压。第一扫描信号线S1和第二扫描信号线S2均包括N个扫描信号脉冲，也就是初始化模块16向驱动晶体管T1写入N次初始化电压，以及数据信号电压写入模块13向驱动晶体管T1写入N次数据信号电压。这样，重复N次先初始化再写入数据信号电压，驱动晶体管栅极的初始化电压和驱动晶体管源极的初始化电压使驱动晶体管中有N次大电流流过，改善了驱动晶体管阈值电压漂移导致的迟滞效应，解决了显示过程中出现的黑白画面切换时初始时间段亮度无法达到目标亮度值的问题，提高显示效果。
此外，第一发光信号线Emit1控制第一发光控制模块14的导通与截止。示例性地，参考图6，第一发光信号线Emit1的1个脉冲信号覆盖第一扫描信号线 S1和第二扫描信号线S2的N个扫描脉冲信号。这样，在驱动晶体管11重复N 次先初始化再写入数据信号电压阶段，第一发光控制模块14截止。如果初始化阶段和数据信号电压写入阶段，第一发光控制模块14导通，驱动晶体管栅极电位是产生变化的，有可能引起闪烁。因此，此阶段第一发光控制模块截止，可有效抑制闪烁，进一步提高显示效果。
进一步地，本发明实施例提供的像素电路的驱动方法，发光阶段Emit包括至少一个发光子阶段和至少一个截止阶段；在发光子阶段，第一发光控制模块导通；在截止阶段，第一发光控制模块截止。发光阶段Emit包括至少一个发光子阶段和至少一个截止阶段，通过设置发光子阶段和截止阶段的个数，并提供相应的驱动信号，可以方便实现调整对显示面板亮度的调节。
下面以三种不同的像素电路为示例，说明本发明实施例提供的像素电路的驱动方法的实施过程。
图7是本发明实施例提供的一种像素电路的电路图，参考图7，像素电路还包括阈值补偿模块12，阈值补偿模块12包括第二晶体管T2，数据信号电压写入模块13包括第三晶体管T3，第一发光控制模块14包括第四晶体管T4和第五晶体管T5，初始化模块16包括第六晶体管T6，存储模块17包括第一电容Cst1；
第二晶体管T2的第一极与驱动晶体管T1的第二极电连接，第二极与驱动晶体管T1的栅极电连接，栅极与第二扫描线S2电连接；
第三晶体管T3的第一极与数据线Vdata电连接，第二极与驱动晶体管T1 的第一极电连接，栅极与第二扫描线S2电连接；
第四晶体管T4的第一极与第一电源电压信号线PVDD电连接，第二极与驱动晶体管T1的第一极，也即第二节点N2电连接，栅极与第一发光信号线 Emit1电连接；
第五晶体管T5的第一极与驱动晶体管T1的第二极电连接，第二极与发光元件11的第一极电连接，栅极与第一发光信号线Emit1电连接；
第六晶体管T6的第一极与初始化电压信号线Vint电连接，第二极与驱动晶体管T1的栅极电连接，栅极与第一扫描线S1电连接；
第一电容Cst1的第一极与驱动晶体管T1的栅极，也即第一节点N1电连接，第一电容Cst1的第二极与第一电源电压信号线PVDD电连接；
发光元件11的第二极与第二电源电压信号线PVEE电连接。
示例性地，图8是本发明实施例提供的另一种驱动时序图，以N＝3为例，但并不是对本发明实施例提供的像素电路的驱动方法的限定。下面结合图7和图8，以驱动晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5和第六晶体管T6为P型晶体管为例，示例性的说明本发明实施例提供的像素电路的驱动方法的具体工作过程。
在Ref1阶段，Ref1阶段也即第1次初始化阶段，第一扫描线S1上的信号为低电平，第六晶体管T6导通，初始化电压信号线Vint上的初始化电压通过导通的第六晶体管T6写入驱动晶体管T1的栅极，初始化电压可以是为低电平，对驱动晶体管T1的栅极和第一电容Cst1的第一极的电压进行初始化，保证下一阶段驱动晶体管T1导通，数据信号电压能够写入驱动晶体管T1的栅极。
在Data1阶段，Data1阶段也即第1次数据信号电压写入阶段，第二扫描线S2上的信号为低电平，第二晶体管T2和第三晶体管T3导通，数据线Vdata上的数据信号电压依次通过第三晶体管T3、驱动晶体管T1和第二晶体管T2写入驱动晶体管T1的栅极和第一电容Cst1的第一极，驱动晶体管T1的栅极电压逐渐升高，直至驱动晶体管T1的栅极电压和源极电压的电压差小于等于驱动晶体管T1的阈值电压时，驱动晶体管T1截止，驱动晶体管T1的栅极电压保持不变，此时，驱动晶体管T1的栅极电压，即第一节点N1的电压V1＝Vdata-|Vth|，其中，Vdata为数据线Vdata上的数据信号电压值，Vth为驱动晶体管T1的阈值电压。
在Ref2阶段和Data2阶段，各晶体管的状态变化和电压写入情况与Ref1阶段和Data1阶段类似。Ref3阶段和Data3阶段，各晶体管的状态变化和电压写入情况与Ref1阶段和Data1阶段类似。需要说明的是，Data1阶段和Data2阶段数据信号线上的数据信号电压，与Data3阶段数据信号线上的数据信号电压可相同也可以不同，只要保证Data1阶段和Data2阶段数据信号线上的数据信号电压可以使驱动晶体管导通有电流流过即可。而Data3阶段数据信号线上的数据信号电压为该帧需要写入的灰阶电压。在Data1阶段和Data2阶段，第二节点N2的电压被强制为数据信号电压，在置Ref1阶段、Ref2阶段、Ref3阶段，第一节点N1 的电压被强制为初始化电压，可以使每一帧经过N次初始化阶段和N-1次数据信号电压写入阶段后，第一节点N1的电位均一致，而且第二节点N2的电位也均一致，解决了显示过程中出现的黑白画面切换时初始时间段亮度无法达到目标亮度值的问题，改善亮度不一致现象，提高显示的均一性。而且在每一次数据信号电压写入阶段，驱动晶体管T1栅极的初始化电压和驱动晶体管T1源极电压使驱动晶体管T1中有3次大电流流过，改善了驱动晶体管T1阈值电压Vth漂移情况，改善了驱动晶体管T1的迟滞效应，提高了显示效果。
在Data3之后的阶段，也称发光阶段，第一发光信号线Emit1上的信号为低电平，第四晶体管T4和第五晶体管T5导通，第一扫描线S1和第二扫描线S2 上的信号为高电平，第六晶体管T6、第二晶体管T2和第三晶体管T3截止。驱动晶体管T1的第一极(源极)的电压为VPVDD，驱动晶体管源极和栅极电压差Vsg＝VPVDD-V1＝VPVDD-Vdata-|Vth|，驱动晶体管T1的漏电流，即驱动晶体管T1产生的驱动电流驱动发光元件11发光，驱动电流Id满足以下公式：
其中，μ为驱动晶体管T1的载流子迁移率，W、L为驱动晶体管T1沟道的宽度和长度，Cox为驱动晶体管T1单位面积的栅氧化层电容量。VPVDD为第一电源电压信号线PVDD上的电压值，也为第二节点N2的电压值。可以看到，驱动晶体管T1产生的驱动电流Id与驱动晶体管T1的阈值电压Vth无关。解决了驱动晶体管T1阈值电压漂移引起的显示异常问题。
此外，第一发光信号线Emit1的1个脉冲信号覆盖第一扫描信号线S1和第二扫描信号线S2的3个扫描脉冲信号。这样，在驱动晶体管T1重复3次先初始化再写入数据信号电压阶段，第四晶体管T4和第五晶体管T5截止。如果初始化阶段和数据信号电压写入阶段，第四晶体管T4和第五晶体管T5导通，数据信号电压将无法有效写入驱动晶体管T1的栅极，驱动晶体管T1栅极电位是产生变化的，有可能引起闪烁。因此，此阶段，第四晶体管T4和第五晶体管 T5截止，即第一发光控制模块14截止，可有效抑制闪烁，进一步提高显示效果。
图9是本发明实施例提供的另一种像素电路的电路图，参考图9，像素电路还包括阈值补偿模块12和第二发光控制模块15，阈值补偿模块12包括第二晶体管T2，数据信号电压写入模块13包括第三晶体管T3，第一发光控制模块 14包括第四晶体管T4，第二发光控制模块15包括第五晶体管T5，初始化模块 16包括第六晶体管T6，存储模块17包括第一电容Cst1；
驱动晶体管T1的第一极与第一电源电压信号线PVDD电连接；第一电容 Cst1的第一极与驱动晶体管T1的栅极，也即第一节点N1电连接；
第二晶体管T2的第一极与与驱动晶体管T1的第二极电连接，第二极与驱动晶体管T1的栅极电连接，栅极与第二扫描线S2电连接；
第三晶体管T3的第一极与数据线Vdata电连接，第二极与第一电容Cst1 的第二极，也即第二节点N2电连接，栅极与第二扫描线S2电连接；
第四晶体管T4的第一极与第一电源电压信号线PVDD或者第一参考电压信号线Vref电连接，第二极与第一电容Cst1的第二极，也即第二节点N2电连接，栅极与第一发光信号线Emit1电连接；
第五晶体管T5的第一极与驱动晶体管T1的第二极电连接，第二极与发光元件11的第一极电连接，栅极与第一发光信号线Emit1电连接；
发光元件11的第二极与第二电源电压信号线PVEE电连接；
第六晶体管T6的第一极与初始化电压信号线Vint电连接，第二极与驱动晶体管T1的栅极电连接，栅极与第一扫描线S1电连接。
示例性地，图10是本发明实施例提供的另一种驱动时序图，以N＝3为例，但并不是对本发明实施例提供的像素电路的驱动方法的限定。下面结合图9和图10，以驱动晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5和第六晶体管T6为P型晶体管为例，示例性的说明本发明实施例提供的像素电路的驱动方法的具体工作过程。
参考图9和图10，在Ref1阶段，也即第1次初始化阶段，第一扫描线S1 上的信号为低电平，第六晶体管T6导通；第二扫描线S2上的信号为高电平，第二晶体管T2和第三晶体管T3截止；第一发光信号线Emit1上的信号为高电平，第四晶体管T4截止；第二发光信号线Emit2上的信号为高电平，第五晶体管T5截止。初始化电压信号线Vint上的初始化电压通导通的第六晶体管T6写入驱动晶体管T1的栅极和第一电容Cst1的第一极，也即第一节点N1；初始化电压信号线Vint上的初始化电压通过导通的第七晶体管T7写入发光元件11的第一极，初始化电压可以为低电平，经过初始化阶段，使第一节点N1和发光元件11的第一极的电位均为低电位。且在初始化阶段，第五晶体管T5截止，驱动晶体管T1与发光元件断开，使得初始化过程中发光二极管OLED几乎不流过电流，降低暗态的亮度，提高产品的对比度。
在Data1阶段，也即数据信号电压写入阶段，第一扫描线S1上的信号为高电平，第六晶体管T6截止；第二扫描线S2上的信号为低电平，第二晶体管T2 和第三晶体管T3，驱动晶体管T1也导通；由于在Ref1阶段，驱动晶体管T1 的栅极为低电位，使得驱动晶体管T1处于导通状态，则在驱动晶体管T1和第二晶体管T2之间形成一条电流通路，第一电源电压信号线PVDD上的电压通过上述电流通路达到第一节点N1，第一节点N1的电位逐渐被第一电源电压信号线PVDD上的电压拉高。当驱动晶体管T1的栅极电压被拉高到和其源极的电压差小于等于驱动晶体管T1的阈值电压Vth时，驱动晶体管T1将处于截止状态。由于驱动晶体管T1的源极和第一电源电压信号线连接而保持电位VPVDD不变，所以当驱动晶体管T1截止时，驱动晶体管T1的栅极电位为VPVDD-|Vth|，其中，VPVDD为第一电源电压信号线PVDD上的电压的值，|Vth|为驱动晶体管T1的阈值电压。
此时，第一电容Cst1的第一极和第二极的电压差Vc为：
Vc＝V1-V2＝VPVDD-|Vth|-Vdata
其中,V1代表第一节点N1的电位，V2代表第二节点N2的电位其中，Vdata为数据线Vdata上的数据信号电压值。
在数据信号电压写入阶段，第一电容Cst1的第一极和第二极的电压差Vc 中包含有驱动晶体管T1的阈值电压Vth，也就是说在数据信号电压写入阶段、侦测出了驱动晶体管T1的阈值电压Vth，并将其存储在第一电容Cst1上。
在Ref2和Data2阶段，以及Ref3和Data3阶段各晶体管的状态变化和电压写入情况与Ref1阶段和Data1类似。需要说明的是，Data1阶段和Data2阶段数据信号线上的数据信号电压，与Data3阶段数据信号线上的数据信号电压可相同也可以不同，只要保证Data1阶段和Data2阶段数据信号线上的数据信号电压可以使驱动晶体管导通有电流流过即可。而Data3阶段数据信号线上的数据信号电压为该帧需要写入的灰阶电压。在每一次数据信号电压写入阶段，驱动晶体管T1 栅极的初始化电压和驱动晶体管T1源极电压使驱动晶体管T1中有3次大电流流过，改善了驱动晶体管T1阈值电压Vth漂移情况，改善了驱动晶体管T1的迟滞效应，提高了显示效果。
在Data3阶段之后，并在发光阶段之前，第一扫描线S1上的信号为高电平，第六晶体管T6和第七晶体管T7截止；第二扫描线S2上的信号为高电平，第二晶体管T2和第三晶体管T3截止，驱动晶体管也截止；初始化电压信号线Vint 上的初始化电压通过第四晶体管T4传输至第二节点N2，也即所第一电容Cst1 的第二极，同时第二晶体管T2、第三晶体管T3、第四晶体管M4和驱动晶体管 T1都处于截止状态，即第一电容Cst1的第二极相当于被断开，第一电容Cst1 的第一极和第二极的电压差Vc将保持不变。但是由于第二节点N2的电位变化为VVref，所以相应地第一节点N1的电位变化为：
V2＇＝Vc+V1＇＝VPVDD-|Vth|-Vdata+VVref
也就是说，数据信号电压通过第一电容Cst1耦合至第一电容Cst1的第一极。
在发光阶段，第一扫描线S1上的信号为高电平，第六晶体管T6和第七晶体管T7截止；第二扫描线S2上的信号为高电平，第二晶体管T2和第三晶体管T3截止，驱动晶体管T1也截止；第一发光信号线Emit1上的信号为低电平，第四晶体管T4导通；第二发光信号线Emit2上的信号为低电平，第五晶体管 T5导通。此时，驱动晶体管T1的源极和栅极之间的电压Vsg为：
Vsg＝VPVDD-V2＇＝|Vth|+Vdata-VVref
由于驱动晶体管T1工作在饱和区，所以流经其沟道的驱动电流由其栅极和源极的电压差决定，根据晶体管在饱和区的电学特性，可以得到驱动电流：
I＝K(Vsg-|Vth|)2＝K(Vdata-VVref)2
其中，I为驱动晶体管T1产生的驱动电流，K为常数，μ为驱动晶体管T1的载流子迁移率，W、L为驱动晶体管T1沟道的宽度和长度，Cox为驱动晶体管T1单位面积的栅氧化层电容量。VVref为初始化电压信号Vref线上的电压的值。产生的驱动电路驱动发光元件发光。
需要说明的是，图10中所示的第一发光信号线Emit1上的信号和第二发光信号线Emit2上的信号可以相同。如此，图9中所示的像素电路中的第四晶体管T4和第五晶体管T5可以共用一条发光信号线，可以节省发光信号线的数量和提供发光信号线的驱动电路。
图11是本发明实施例提供的另一种像素电路的电路图，参考图11，像素电路还包括阈值补偿模块12和第二发光控制模块15，阈值补偿模块12包括至少一个第二晶体管T2，数据信号电压写入模块13包括第三晶体管T3，第一发光控制模块14包括第四晶体管T4，第二发光控制模块15包括第五晶体管T5，初始化模块16包括第六晶体管T6，存储模块17包括第一电容Cst1；
第二晶体管T2的第一极与驱动晶体管T1的第二极电连接，第二极与驱动晶体管T1的栅极，也即第一节点N1电连接，栅极与第一扫描线S1电连接；
第三晶体管T3的第一极与数据线Vdata电连接，第二极与驱动晶体管T1 的第一极电连接，栅极与第二扫描线S2电连接；
第四晶体管T4的第一极与第一电源电压信号线PVDD电连接，第二极与驱动晶体管T1的第一极电连接，栅极与第一发光信号线Emit1电连接；
第五晶体管T5的第一极与驱动晶体管T1的第二极电连接，第二极与发光元件11的第一极电连接，栅极与第二发光信号线Emit2电连接；
第六晶体管T6的第一极与第一参考电压信号线Vref电连接，第二极与发光元件11的第一极电连接，栅极与第一扫描信号线S1电连接；
第一电容Cst1的第一极与驱动晶体管T1的栅极电连接，第一电容Cst1的第二极与第一电源电压信号线PVDD电连接；
发光元件11的第二极与第二电源电压信号线PVEE电连接。
示例性地，图12是本发明实施例提供的另一种驱动时序图，以N＝3为例，但并不是对本发明实施例提供的像素电路的驱动方法的限定。下面结合图11和图12，以驱动晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5和第六晶体管T6为P型晶体管为例，示例性的说明本发明实施例提供的像素电路的驱动方法的具体工作过程。
在Ref1阶段，也即第一次初始化阶段，第一扫描线S1上的信号为低电平，第二晶体管T2和第六晶体管T6导通；第二扫描线S2上的信号为高电平，第三晶体管T3截止；第一发光信号线Emit1上的信号为高电平，第四晶体管T4 截止；第二发光信号线Emit2上的信号为低电平，第五晶体管T5导通；初始化电压信号线Vint上的初始化电压通过第六晶体管T6、第五晶体管T5和第二晶体管T2写入驱动晶体管T1的栅极和第一电容Cst1的第一极，即第一节点N1，对第一节点N1的电位进行初始化。在Data1阶段内的前一阶段，第一扫描线S1 上的信号为低电平，第二晶体管T2和第六晶体管T6导通；第二扫描线S2上的信号为低电平，第三晶体管T3导通；第一发光信号线Emit1上的信号为高电平，第四晶体管T4截止；第二发光信号线Emit2上的信号为高电平，第五晶体管T5截止；数据线Vdata上的数据信号电压依次通过第三晶体管T3、驱动晶体管T1和第二晶体管T2写入驱动晶体管T1，驱动晶体管T1的栅极和第一电容Cst1的第一极，驱动晶体管T1的栅极电压逐渐升高，直至驱动晶体管T1的栅极电压和源极电压的电压差小于等于驱动晶体管T1的阈值电压时，驱动晶体管T1截止，驱动晶体管T1的栅极电压保持不变，此时，驱动晶体管T1的栅极电压，即第一节点N1的电压V1＝Vdata-|Vth|，其中，Vdata为数据线Vdata上的数据信号电压值，Vth为驱动晶体管T1的阈值电压。在Data1阶段内的后一阶段驱动晶体管T1截止，第四晶体管T4也截止，第二节点N2的电位不变。
在Ref2和Data2阶段，以及Ref3和Data3阶段各晶体管的状态变化和电压写入情况与Ref1阶段和Data1阶段类似。需要说明的是，Data1阶段和Data2阶段数据信号线上的数据信号电压，与Data3阶段数据信号线上的数据信号电压可相同也可以不同，只要保证Data1阶段和Data2阶段数据信号线上的数据信号电压可以使驱动晶体管导通有电流流过即可。而Data3阶段数据信号线上的数据信号电压为该帧需要写入的灰阶电压。在Data1阶段和Data2阶段，第二节点N2的电压被强制为数据信号电压，在Ref1阶段、Ref2阶段、Ref3阶段，第一节点N1 的电压被强制为初始化电压，可以使每一帧经过N次初始化阶段和N-1次数据信号电压写入阶段后，第一节点N1的电位均一致，而且第二节点N2的电位也均一致，解决了显示过程中出现的黑白画面切换时初始时间段亮度无法达到目标亮度值的问题，改善亮度不一致现象，提高显示的均一性。而且在每一次数据信号电压写入阶段，驱动晶体管T1栅极的初始化电压和驱动晶体管T1源极电压使驱动晶体管T1中有3次大电流流过，改善了驱动晶体管T1阈值电压Vth漂移情况，改善了驱动晶体管的迟滞效应，提高了显示效果。
在Data3之后的阶段，也称发光阶段，第一发光信号线Emit1上的信号为低电平，第四晶体管T4，第一扫描线S1和第二扫描线S2上的信号为高电平，第六晶体管T6、第二晶体管T2和第三晶体管T3截止。驱动晶体管T1的第一极 (源极)的电压为VPVDD，驱动晶体管T1源极和栅极电压差Vsg＝VPVDD-V1＝VPVDD- Vdata+|Vth|，驱动晶体管T1的漏电流，驱动晶体管T1的漏电流，即驱动晶体管 T1产生的驱动电流驱动发光元件11发光，驱动电流Id满足以下公式：
其中，μ为驱动晶体管T1的载流子迁移率，W、L为驱动晶体管T1沟道的宽度和长度，Cox为驱动晶体管T1单位面积的栅氧化层电容量。VPVDD为第一电源电压信号线PVDD上的电压值，也为第二节点N2的电压值。可以看到，驱动晶体管T1产生的驱动电流Id与驱动晶体管T1的阈值电压Vth无关。解决了驱动晶体管T1阈值电压漂移引起的显示异常问题。
此外，参见图6、图8、图10和图12，第一发光信号线Emit1的1个脉冲信号覆盖第一扫描信号线S1和第二扫描信号线S2的3个扫描脉冲信号。这样，在驱动晶体管T1重复3次先初始化再写入数据信号电压阶段，第四晶体管T4 和第五晶体管T5截止。如果初始化阶段和数据信号电压写入阶段，第四晶体管 T4和第五晶体管T5导通，无法有效进行初始化阶段和数据信号电压写入阶段，例如在数据信号电压写入阶段，驱动晶体管T1栅极电位是产生变化的，如果此阶段第五晶体管导通，驱动晶体管T1产生的驱动电路流经发光元件，有可能引起闪烁。
进一步地，继续参考图7或图9，本发明实施例提供的像素电路还包括复位模块19；
复位模块19包括第七晶体管T7；第七晶体管T7的栅极与第一扫描线S1 电连接，第一极与初始化电压信号线Vint电连接，第二极与发光元件11的第一极电连接。第七晶体管T7在初始化阶段，将初始化电压信号线Vint上的电压写入发光元件11的第一极，对发光元件11的第一极电位进行初始化，降低上一帧发光元件11第一极的电压对后一帧发光元件11第一极电压的影响，进一步提高显示均一性。
参见图6、图8、图10和图12，可以看到，任意相邻的两次初始化阶段时间间隔相同，任意相邻的两次数据信号电压写入阶段的时间间隔相同。因此，可以实现相邻两行像素电路共用扫描线，即对于相邻两行像素电路，前一行像素电路电连接的第二扫描线S2复用为下一行像素电路电连接的第一扫描线S1。这样，可以减少扫描线布线的数量，一方面，节省了第一扫描线和第二扫描线的用料成本；另一方面，减少了第一扫描线和第二扫描线在阵列基板上占用的面积，而且节省为扫描线提供扫描信号的驱动电路，便于实现阵列基板的窄边框设计。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (10)

1.一种像素电路的驱动方法，其特征在于，所述像素电路包括发光元件、驱动晶体管、初始化模块、数据信号电压写入模块和存储模块；
所述驱动方法包括：
显示的一帧时间内，在发光阶段之前包括N次初始化阶段、N次数据信号电压写入阶段；其中，第i次所述数据信号电压写入阶段在第i次所述初始化阶段之后，并在第i+1次所述初始化阶段之前，第N次所述数据信号电压写入阶段在第N次所述初始化阶段之后，其中，1≤i≤N-1，i为整数，N为大于1的整数；
在所述初始化阶段，所述初始化模块将初始化电压写入所述驱动晶体管的栅极；
在所述数据信号电压写入阶段，所述数据信号电压写入模块将数据信号电压写入所述驱动晶体管的栅极；
所述存储模块用于保持所述驱动晶体管的栅极电压；
在所述发光阶段，所述驱动晶体管产生驱动电流驱动所述发光元件发光；
所述像素电路还包括第一发光控制模块，用于控制所述发光元件发光；
在所述N次初始化阶段和所述N次数据信号电压写入阶段，所述第一发光控制模块截止；
所述初始化模块的控制端与第一扫描线电连接，所述数据信号电压写入模块的控制端与第二扫描线电连接，所述第一发光控制模块的控制端与第一发光信号线电连接；
所述第一扫描线、第二扫描线均包括N个扫描信号脉冲，所述第一发光信号线包括至少1个扫描信号脉冲，所述第一发光信号线的至少1个扫描信号脉冲覆盖所述第一扫描线、第二扫描线的N个扫描信号脉冲。
2.根据权利要求1所述的像素电路的驱动方法，其特征在于，N＝3。
3.根据权利要求1所述的像素电路的驱动方法，其特征在于，在第1～第N-1次数据信号电压写入阶段，所述数据信号电压写入模块写入0灰阶电压或者255灰阶电压，在第N次数据信号电压写入阶段，所述数据信号电压写入模块写入数据信号电压，所述数据信号电压为0～255灰阶电压中一个。
4.根据权利要求1所述的像素电路的驱动方法，其特征在于，任意相邻的两次所述初始化阶段时间间隔相同，任意相邻的两次所述数据信号电压写入阶段的时间间隔相同。
5.根据权利要求1所述的像素电路的驱动方法，其特征在于，所述发光阶段包括至少一个发光子阶段和至少一个截止阶段；
在所述发光子阶段，所述第一发光控制模块导通；在所述截止阶段，所述第一发光控制模块截止。
6.根据权利要求1所述的像素电路的驱动方法，其特征在于，还包括阈值补偿模块，所述阈值补偿模块包括第二晶体管，所述数据信号电压写入模块包括第三晶体管，所述第一发光控制模块包括第四晶体管和第五晶体管，所述初始化模块包括第六晶体管，所述存储模块包括第一电容；
所述第二晶体管的第一极与所述驱动晶体管的第二极电连接，第二极与所述驱动晶体管的栅极电连接，栅极与第二扫描线电连接；
所述第三晶体管的第一极与数据线电连接，第二极与所述驱动晶体管的第一极电连接，栅极与所述第二扫描线电连接；
所述第四晶体管的第一极与第一电源电压信号线电连接，第二极与所述驱动晶体管的第一极电连接，栅极与所述第一发光信号线电连接；
所述第五晶体管的第一极与所述驱动晶体管的第二极电连接，第二极与所述发光元件的第一极电连接，栅极与所述第一发光信号线电连接；
所述第六晶体管的第一极与初始化电压信号线电连接，第二极与所述驱动晶体管的栅极电连接，栅极与第一扫描线电连接；
所述第一电容的第一极与所述驱动晶体管的栅极电连接，所述第一电容的第二极与所述第一电源电压信号线电连接；
所述发光元件的第二极与第二电源电压信号线电连接。
7.根据权利要求1所述的像素电路的驱动方法，其特征在于，还包括阈值补偿模块和第二发光控制模块，所述阈值补偿模块包括第二晶体管，所述数据信号电压写入模块包括第三晶体管，所述第一发光控制模块包括第四晶体管，所述第二发光控制模块包括第五晶体管，所述初始化模块包括第六晶体管，所述存储模块包括第一电容；
所述驱动晶体管的第一极与第一电源电压信号线电连接；所述第一电容的第一极与所述驱动晶体管的栅极电连接；
所述第二晶体管的第一极与所述驱动晶体管的第二极电连接，第二极与所述驱动晶体管的栅极电连接，栅极与第二扫描线电连接；
所述第三晶体管的第一极与数据线电连接，第二极与所述第一电容的第二极电连接，栅极与所述第二扫描线电连接；
所述第四晶体管的第一极与所述第一电源电压信号线或者第一参考电压信号线电连接，第二极与所述第一电容的第二极电连接，栅极与第一发光信号线电连接；
所述第五晶体管的第一极与所述驱动晶体管的第二极电连接，第二极与所述发光元件的第一极电连接，栅极与第二发光信号线电连接；
所述发光元件的第二极与第二电源电压信号线电连接；
所述第六晶体管的第一极与初始化电压信号线电连接，第二极与所述驱动晶体管的栅极电连接，栅极与第一扫描线电连接。
8.根据权利要求1所述的像素电路的驱动方法，其特征在于，还包括阈值补偿模块和第二发光控制模块，所述阈值补偿模块包括第二晶体管，所述数据信号电压写入模块包括第三晶体管，所述第一发光控制模块包括第四晶体管，所述第二发光控制模块包括第五晶体管，所述初始化模块包括第六晶体管，所述存储模块包括第一电容；
所述第二晶体管的第一极与所述驱动晶体管的第二极电连接，第二极与所述驱动晶体管的栅极电连接，栅极与第二扫描线电连接；
所述第三晶体管的第一极与数据线电连接，第二极与所述驱动晶体管的第一极电连接，栅极与所述第二扫描线电连接；
所述第四晶体管的第一极与第一电源电压信号线电连接，第二极与所述驱动晶体管的第一极电连接，栅极与第一发光信号线电连接；
所述第五晶体管的第一极与所述驱动晶体管的第二极电连接，第二极与所述发光元件的第一极电连接，栅极与第二发光信号线电连接；
所述第六晶体管的第一极与初始化电压信号线电连接，第二极与所述发光元件的第一极电连接，栅极与第一扫描信号线电连接；
所述第一电容的第一极与所述驱动晶体管的栅极电连接，所述第一电容的第二极与第一电源电压信号线电连接；
所述发光元件的第二极与第二电源电压信号线电连接。
9.根据权利要求6或7所述的像素电路的驱动方法，其特征在于，所述像素电路还包括复位模块；
所述复位模块包括第七晶体管；所述第七晶体管的栅极与所述第一扫描线电连接，第一极与所述初始化电压线电连接，第二极与所述发光元件的第一极电连接。
10.根据权利要求5-8任一项所述的像素电路的驱动方法，其特征在于，对于相邻两行所述像素电路，前一行所述像素电路电连接的所述第二扫描线复用为下一行所述像素电路电连接的所述第一扫描线。
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