CN107665675B - 显示装置、栅极驱动器和驱动栅极驱动器的方法 - Google Patents

显示装置、栅极驱动器和驱动栅极驱动器的方法 Download PDF

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Abstract

提供了显示装置、栅极驱动器和驱动栅极驱动器的方法，其通过以下操作使得Q节点的电压电平能够在空白区段中稳定地保持：通过用于复位栅极驱动器集成电路的Q节点的复位信号的复位信号输入端将直接提供高电平的时钟信号输入到Q节点；针对帧之间的每个空白区段输入复位信号；或提供较高的栅极高电压和较低的栅极低电压。可以提供一种栅极驱动器集成电路及其驱动方法，该栅极驱动器集成电路具有高可靠性的鲁棒结构，并且通过在空白区段中保持Q节点的电压电平稳定来避免扫描信号的误差。

Description

显示装置、栅极驱动器和驱动栅极驱动器的方法
相关申请的交叉引用
本申请要求于2016年7月29日提交的韩国专利申请第10-2016-0096816号的优先权，出于所有目的通过引用将其并入本文，如同在本文中完全阐述一样。
技术领域
实施方式涉及显示装置、包括在显示装置中的栅极驱动器以及驱动栅极驱动器的方法。
背景技术
随着面向信息的社会的发展，对用于显示图像的各种类型的显示装置的需求增加。因此，已经使用了各种类型的显示装置，诸如液晶显示装置、等离子体显示装置、有机发光显示装置等。
显示装置包括：显示面板，其中设置有多个栅极线和多个数据线，并且在栅极线和数据线交叉的交叉处限定多个像素；栅极驱动器，其被配置为驱动栅极线；数据驱动器，其被配置为驱动数据线；控制器，其被配置为控制栅极驱动器和数据驱动器；等。
栅极驱动器通过向多个栅极线输出扫描信号来顺序地驱动多个栅极线。数据驱动器在由栅极驱动器输出扫描信号的定时处将数据电压输出到数据线，并且驱动每个像素。
因此，栅极驱动器需要高可靠性来驱动显示装置。然而，当显示装置具有高规格并且设置为大尺寸时，栅极驱动器随着栅极驱动器长时间驱动而发生故障，这是缺点。
发明内容
本公开内容的实施方式的一个方面是提供一种具有高可靠性并且即使栅极驱动器长时间驱动也不会发生故障的栅极驱动器以及驱动该栅极驱动器的方法。
本公开内容的实施方式的另一方面是提供一种保持栅极驱动器的Q节点和QB节点的电压稳定的栅极驱动器的结构以及驱动该栅极驱动器的方法。
根据本公开内容的一个方面，提供了一种栅极驱动器，包括：第一晶体管，其与Q节点连接，并且被配置为基于Q节点的电压进行操作；以及第二晶体管，其与QB节点连接，并且被配置为基于QB节点的电压进行操作。
栅极驱动器根据第一晶体管和第二晶体管的操作将扫描信号输出至设置在显示面板中的栅极线。
栅极驱动器包括：控制电路单元，其控制Q节点和QB节点的电压电平，其中被输入用于复位Q节点的复位信号的信号线与向Q节点直接提供高电平的时钟信号的时钟信号输入端连接。
时钟信号可以是用于控制连接在栅极低电压输入端与QB节点之间的晶体管的信号，并且可以通过经由被输入复位信号的信号线提供时钟信号来使Q节点的电压在空白区段期间保持常规。
晶体管可以与被输入复位信号的信号线连接，并且与信号线连接的晶体管的漏极节点和栅极节点可以彼此连接。
此外，还可以包括连接在栅极高电压输入端与Q节点之间的电容器。
在这种情况下，可以向栅极高电压输入端提供比基准栅极高电压高的预定电压的栅极高电压，并且可以同时向栅极低电压输入端提供比基准栅极低电压低的预定电压的栅极低电压。
根据本公开内容的另一方面，提供了一种栅极驱动器，包括：第一晶体管，其与Q节点连接，并且被配置为基于Q节点的电压电平进行操作；第二晶体管，其与QB节点连接，并且被配置为基于QB节点的电压电平进行操作；以及控制电路单元，被配置为控制Q节点和QB节点的电压电平，其中，控制电路单元针对帧之间的每个空白区段提供用于复位Q节点的复位信号。
通过针对每个空白区段提供用于复位Q节点的复位信号，使得Q节点和QB节点的电压在空白区段中保持稳定。
根据本公开内容的另一方面，提供了一种显示装置，包括：显示面板，其中布置有多个栅极线和多个数据线；被配置为驱动多个栅极线的栅极驱动器；以及被配置为驱动多个数据线的数据驱动器，其中栅极驱动器被配置为基于Q节点的电压电平和QB节点的电压电平输出栅极信号，并且被输入用于复位Q节点的复位信号的信号线与向Q节点直接提供高电平的时钟信号的时钟信号输入端连接。
根据本公开内容的另一方面，提供一种驱动栅极驱动器的方法，该方法包括：输出栅极起始信号；基于Q节点的电压电平和QB节点的电压电平输出栅极信号(扫描信号)；以及针对帧之间的每个空白区段输出用于复位Q节点的复位信号。
根据本公开内容的一个或更多个实施方式，通过将被输入用于复位Q节点的复位信号的信号线与向Q节点直接提供高电平的时钟信号的时钟信号输入端连接，可以使Q节点的电压在空白区段期间保持稳定。
根据本公开内容的一个或更多个实施方式，通过以下操作使Q节点的电压在空白区段期间保持稳定：针对每个空白区段输出用于复位Q节点的复位信号；或提供比基准栅极高电压高的栅极高电压，并且同时提供比基准栅极低电压低的栅极低电压。
根据本公开内容的一个或更多个实施方式，Q节点的电压在空白区段期间保持稳定，因而，提供了即使在长时间驱动时也是高度可靠的栅极驱动器以及驱动栅极驱动器的方法。
附图说明
根据以下结合附图的详细描述，本公开内容的上述和其它目的、特征和优点将更加明显，其中：
图1是示出根据本公开内容的实施方式的显示装置的示意性配置的图；
图2和图3是示出根据本公开内容的实施方式的栅极驱动器的示意性配置的图；
图4是示出根据本公开内容的实施方式的栅极驱动器的电路的结构的示例的图；
图5是示出根据本公开内容的实施方式的栅极驱动器中的Q节点的电压电平和QB节点的电压电平的示例的图；
图6和图7是示出根据本公开内容的实施方式的栅极驱动器的电路的结构的图；
图8和图9是示出根据本公开内容的实施方式的驱动栅极驱动器的方法的图；
图10是示出根据本公开内容的实施方式的驱动栅极驱动器的方法的图；以及
图11是示出在根据本公开内容的实施方式的栅极驱动器中改进的扫描信号的图。
具体实施方式
在下文中，将参照附图对本公开内容的实施方式进行描述。在通过附图标记指定附图的元件时，即使在不同的附图中示出，相同的元件可以由相同的附图标记指定。此外，在本公开内容的以下描述中，当并入本文中的已知功能和配置的详细描述可能使得本公开内容的主题不清楚时，可以省略并入本文中的已知功能和配置的详细描述。
此外，在描述本公开内容的部件时，本文中可以使用诸如第一、第二、A、B、(a)、(b)等术语。这些术语仅用于将一个部件与其它部件区分开，并且相应部件的性质、次序、顺序等不受相应术语的限制。在某一结构元件“连接至”、“耦合至”另一结构元件或与另一结构元件“接触”的情况下，应当理解为另一结构元件可以“连接至”、“耦合至”结构元件或与结构元件“接触”以及该特定结构元件直接连接至另一结构元件或与另一结构元件直接接触。
图1是示出根据本公开内容的实施方式的显示装置100的示意性配置的图。
参照图1，根据本公开内容的实施方式的显示装置100包括：显示面板110，其中布置有多个栅极线(GL)和多个数据线(DL)，并且多个像素布置在栅极线(GL)与数据线(DL)交叉的交叉处；栅极驱动器120，其驱动多个栅极线(GL)；数据驱动器130，其向多个数据线(DL)提供数据电压；以及控制器140，其控制栅极驱动器120和数据驱动器130的驱动。
栅极驱动器120向多个栅极线(GL)顺序地提供扫描信号，从而顺序地驱动多个栅极线(GL)。
数据驱动器130向多个数据线(DL)提供数据电压，并且驱动多个数据线(DL)。
控制器140向栅极驱动器120和数据驱动器130提供各种控制信号，并且控制栅极驱动器120和数据驱动器130。
控制器140根据在每个帧中实现的定时开始扫描，将从外部输入的图像数据转换为适合于由数据驱动器130使用的数据信号格式，输出经转换的图像数据，并且基于扫描在适当时间控制数据的驱动。
栅极驱动器120基于控制器140的控制向多个栅极线(GL)顺序地提供导通电压(on-voltage)或关断电压(off-voltage)的扫描信号，并且顺序地驱动多个栅极线(GL)。
根据驱动方案，栅极驱动器120可以位于显示面板110的一侧，或者可以位于两侧。
此外，栅极驱动器120可以包括一个或更多个栅极驱动器集成电路。
每个栅极驱动器集成电路可以基于带式自动接合(TAB)方案或玻璃上芯片(COG)方案连接至显示面板110的接合焊盘，或者可以被实现为板内栅极(GIP)型并且可以直接布置在显示面板110上。
此外，栅极驱动器集成电路可以通过与显示面板110集成来布置，或者可以基于膜上芯片(COF)方案来实施，使得栅极驱动器集成电路安装在与显示面板110连接的膜上。
在下文中，为了便于描述，将通过假设栅极驱动器120中所包括的一个或更多个栅极驱动器集成电路是GIP类型来提供描述，并且栅极驱动器集成电路可以被写为板内栅极驱动器IC(GIP)。
在这种情况下，如其中示出了栅极驱动器120的示例的图2所示，实施为GIP型的多个栅极驱动器集成电路被布置在显示面板110中，并且驱动布置在显示面板110中的多个栅极线(GL)。
栅极驱动器集成电路接收诸如栅极起始信号(VST)、时钟信号(CLK)、复位信号(RST)等的输入，并且基于所输入的信号生成扫描信号。
栅极驱动器集成电路将生成的扫描信号顺序地输出至多个栅极线(GL)，并且驱动栅极线(GL)。
在图2中，示出了栅极驱动器集成电路的数目为n，其与栅极线(GL)(n)的数目n相同。然而，根据栅极驱动器120的驱动方案，栅极驱动器集成电路的数目可以与栅极线(GL)的数目n不同(例如，栅极线的数目可以为2n)。
当预定的栅极线(GL)打开时，数据驱动器130将从控制器140接收的图像数据转换为模拟类型的数据电压，将经转换的电压提供至多个数据线(DL)，并且驱动多个数据线(DL)。
数据驱动器130可以包括至少一个源极驱动器集成电路，并且可以驱动多个数据线(DL)。
每个源极驱动器集成电路可以基于带式自动接合(TAB)方案或玻璃上芯片(COG)方案连接至显示面板110的接合焊盘，可以直接布置在显示面板110中，或者可以通过与显示面板110集成来布置。
此外，每个源极驱动器集成电路可以基于膜上芯片(COF)方案来实现。在这种情况下，每个源极驱动器集成电路的一端可以接合至至少一个源极印刷电路板，并且另一端可以接合至显示面板110。
控制器140可以从外部(例如，主机系统)接收各种定时信号，包括垂直同步信号(Vsync)、水平同步信号(Hsync)、输入数据使能(DE)信号、时钟信号(CLK)等，以及输入图像数据。
控制器140将从外部输入的图像数据转换为适合于数据驱动器130使用的数据信号格式，并且输出经转换的图像数据。此外，为了控制栅极驱动器120和数据驱动器130，控制器140可以：接收诸如垂直同步信号(Vsync)、水平同步信号(Hsync)、输入数据使能信号(DE)、时钟信号(CLK)等的定时信号；生成各种控制信号；以及将其输出至栅极驱动器120和数据驱动器130。
例如，为了控制栅极驱动器120，控制器140可以输出包括栅极起始脉冲(GSP)、栅极移位时钟(GSC)、栅极输出使能(GOE)信号等的各种栅极控制信号(GCS)。
此处，GSP控制形成栅极驱动器120的一个或更多个栅极驱动器集成电路的操作开始定时。GSC是通常输入至一个或更多个栅极驱动器集成电路的时钟信号，并且可以控制扫描信号的移位定时。GOE信号指定一个或更多个栅极驱动器集成电路的定时信息。
此外，为了控制数据驱动器130，控制器140可以输出包括源极起始脉冲(SSP)、源极采样时钟(SSC)、源极输出使能(SOE)信号等的各种数据控制信号(DCS)。
此处，SSP控制形成数据驱动器130的一个或更多个源极驱动器集成电路的数据采样起始定时。SSC是控制每个源极驱动器集成电路中的数据的采样定时的时钟信号。SOE控制数据驱动器130的输出定时。
控制器140可以布置在控制印刷电路板中，该控制印刷电路板通过诸如柔性平板电缆(FFC)或柔性印刷电路(FPC)的连接介质与结合至源极驱动器集成电路的源极印刷电路板连接。
在控制印刷电路板中，还可以布置电源控制器(未示出)，其向显示面板110、栅极驱动器120、数据驱动器130等提供各种电压或电流，或者控制待提供的各种电压或电流。电源控制器也称为电源管理集成电路(IC)。
图3是示出栅极驱动器120中包括的栅极驱动器集成电路的示例的图。
参照图3，栅极驱动器120中包括的栅极驱动器集成电路可以包括下拉晶体管121、上拉晶体管122、控制电路单元123等。
尽管图3将下拉晶体管121和上拉晶体管122示出为P型晶体管，但是N型晶体管可以替代地应用于一个或更多个实施方式中。
下拉晶体管121电连接在时钟信号输入端与扫描信号输出端之间，可以被控制电路单元123的Q节点的电压导通，并且当导通时可以输出作为扫描信号的具有低电平电压的时钟信号。
下拉晶体管121的栅极节点与Q节点电连接。下拉晶体管121的源极节点或漏极节点与时钟信号输入端电连接，并且接收具有低电平电压的时钟信号CLK(n)。此外，下拉晶体管的漏极节点或源极节点与扫描信号Vout(n)输出至的扫描信号输出端连接。
下拉晶体管121被Q节点的电压导通，输出时钟信号的低电平区段中的低电平电压作为低电平的扫描信号，并且将低电平的扫描信号提供至与扫描信号输出端电连接的栅极线(GL)。
上拉晶体管122电连接在扫描信号输出端与栅极高电压(VGH)之间，被控制电路单元123的QB节点的电压导通，并且当导通时将高电平的扫描信号输出至扫描信号输出端。
上拉晶体管122的栅极节点与QB节点电连接。上拉晶体管122的源极节点或漏极节点与基极电压输入端电连接，并且接收对应于恒定电压的栅极高电压(VGH)。此外，上拉晶体管122的漏极节点或源极节点与扫描信号Vout(n)输出至的扫描信号输出端电连接。
上拉晶体管122被QB节点的电压导通，输出高电平的扫描信号，并且将高电平的扫描信号提供至与扫描信号输出端电连接的栅极线(GL)。此处，高电平的扫描信号例如可以是栅极高电压(VGH)。
控制电路单元123可以包括包含两个或更多个晶体管等的内部电路，并且内部电路还包括诸如Q节点、QB节点、置位(set)节点(S节点，也称为起始节点)等的主节点。根据各种实现方式，控制电路单元123的内部电路还可以包括：复位信号被输入至的复位节点；诸如驱动电压等的各种电压被输入至的输入节点；等。
控制电路单元123的Q节点与下拉晶体管121的栅极节点电连接，并且被重复地充电和放电。
控制电路单元123的QB节点与上拉晶体管122的栅极节点电连接，并且被重复地充电和放电。
控制电路单元123中的置位节点设置有指示开始驱动相应栅极驱动器集成电路的栅极的栅极起始信号(VST)。此处，栅极起始信号(VST)可以是通过以下方式提供的信号：基于时钟信号的相位数目，反馈从相对于当前栅极线(GL)1、2或4个栅极线之前的栅极驱动器集成电路输出的扫描信号。
图4示出了图3的栅极驱动器集成电路的详细配置的示例。
参照图4，晶体管T6对应于下拉晶体管121，并且晶体管T7对应于上拉晶体管122。电路的其余部分对应于控制电路单元123。
与下拉晶体管121相对应的晶体管T6的栅极节点与Q节点连接，并且基于Q节点的电压而导通。晶体管T6的源极节点或漏极节点与第一时钟信号输入端连接，并且晶体管T6的漏极节点或源极节点与扫描信号输出端连接。
当晶体管T6基于Q节点的电压而导通时，晶体管T6将第一时钟信号CLK1输出至扫描信号输出端。
对应于上拉晶体管122的晶体管T7的栅极节点与QB节点连接，并且基于QB节点的电压而导通。当晶体管T7基于QB节点的电压而导通时，晶体管T7将高电平的扫描信号(例如，栅极高电压(VGH))输出至扫描信号输出端。
控制电路单元123接收诸如栅极起始信号(VST)、用于复位Q节点的复位信号(QRST)、栅极高电压(VGH)、栅极低电压(VGL)、一个或更多个时钟信号(CLK)等的输入，并且基于输入信号控制Q节点和QB节点的电压电平。
通过控制Q节点和QB节点的电压电平，对晶体管T6和晶体管T7的操作进行控制，并且将扫描信号Scanout(n)输出至与扫描信号输出端连接的栅极线(GL)。
在栅极驱动器集成电路的结构中，在空白结构(例如，帧之间的空白区段)期间Q节点和QB节点的电压电平可能变得不稳定，并且可能影响输出扫描信号。
图5示出了栅极驱动器集成电路(例如，如图4所示)中的Q节点和QB节点的电压电平的示例。
参照图5，在帧之间的空白区段期间由于QB节点的泄漏QB节点的电压可能增加。
随着QB节点的电压增加，Q节点可能不能保持高电平并且变得不稳定。由于Q节点的电压的不稳定性，第一时钟信号被输出至扫描信号输出端，并且可以产生多扫描。
根据各种实施方式，提供了一种栅极驱动器集成电路的结构，其通过在空白区段期间保持Q节点和QB节点的电压稳定来防止发生扫描信号的误差，并且提供了其驱动方法。
图6和图7是示出根据本公开内容的第一实施方式的栅极驱动器集成电路的结构的图。
参照图6，根据本公开内容的第一实施方式的栅极驱动器集成电路包括：对应于下拉晶体管121的晶体管T6；对应于上拉晶体管122的晶体管T7；以及对应于控制电路单元123的该电路的其余部分，其通过控制Q节点和QB节点的电压电平来控制扫描信号的输出。
在控制电路单元123中，向Q节点提供高电平的第三时钟信号CLK3的第三时钟信号输入端与被输入用于复位Q节点的复位信号(QRST)的信号线连接，如601所示。
晶体管可以与被输入复位信号(QRST)的信号线连接，并且晶体管的漏极节点和栅极节点可以彼此连接。
由于通过被输入复位信号(QRST)的信号线提供第三时钟信号，所以在空白区段中Q节点可以保持高电平。
当通过复位信号(QRST)输入端提供第三时钟信号时，Q节点的电压可以保持稳定。因此，不产生扫描信号的误差，并且可以正常地输出扫描信号。
也就是说，向Q节点提供高电平的第三时钟信号被输入至复位信号(QRST)输入端。图6的连接601示出了示例性实施方式，并且本实施方式包括向复位信号(QRST)输入端提供第三时钟信号的所有结构。
此外，如将参照图7说明的，电容器可以施加在图6的电路结构中的Q节点与栅极高电压(VGH)输入端之间。
图7示出根据本公开内容的一个或更多个实施方式的栅极驱动器集成电路的另一结构的示例。
参照图7，其是从图6的电路结构中去除了晶体管T3(其可以包括三个分离的晶体管的分组，如图6所示)的结构，晶体管T3连接在栅极高电压(VGH)输入端与Q节点之间，并且其栅极节点与QB节点连接。
在被去除的晶体管T3的位置处布置有代替被去除的晶体管T3的电容器CQ。因此，通过将电容器CQ施加在栅极高电压(VGH 与Q节点之间，Q节点的电压电平保持稳定，因而，栅极驱动器集成电路可以正常地输出扫描信号。
因此，根据一个或更多个实施方式的栅极驱动器集成电路的电路结构被配置为通过被输入用于复位Q节点的复位信号(QRST)的信号线来提供第三时钟信号，因而，可以保持Q节点的电压电平稳定，并且可以正常地输出扫描信号。
此外，通过去除连接在栅极高电压(VGH)输入端与Q节点之间的晶体管T3，并且连接电容器CQ，在空白区段内Q节点的电压电平可以保持稳定。
除了通过复位信号(QRST)输入端提供第三时钟信号的结构之外，本实施方式提供了一种通过改变栅极驱动器集成电路的驱动方案来保持Q节点和QB节点的电压电平稳定的方案。
图8和图9是示出根据本公开内容的实施方式的驱动栅极驱动器集成电路的方法的图。
参照图8，可以针对帧之间的每个空白输出用于复位Q节点的复位信号(QRST)。
虽然复位信号(QRST)是在驱动用于复位Q节点的屏幕之前输出一次的信号，但是在本公开内容的一个或更多个实施方式中可以针对在初始帧之后的每个空白区段输出复位信号(QRST)。
当针对帧之间的每个空白区段输出复位信号(QRST)并且Q节点被复位时，在空白区段中Q节点的电压保持稳定。
通过在空白区段中保持Q节点的电压电平稳定，防止在空白区段之后的后续帧中错误地输出扫描信号的故障，并且栅极驱动器集成电路正常地生成扫描信号。
图9示出根据本公开内容的实施方式的驱动栅极驱动器集成电路的方法。
参照图9，栅极驱动器集成电路接收栅极起始信号(VST)，并且在操作S900中开始操作。
此处，栅极起始信号(VST)可以是通过反馈从先前的栅极驱动器集成电路输出的扫描信号而提供的信号。
在操作S920中，栅极驱动器集成电路接收栅极起始信号(VST)并开始操作，并且基于Q节点和QB节点的电压电平输出扫描信号(栅极信号)。
作为下拉晶体管121的晶体管T6基于Q节点的电压电平操作，并且输出第一时钟信号。作为上拉晶体管122的晶体管T7基于QB节点的电压电平操作，并且输出高电平(例如，栅极高电压(VGH))的扫描信号。
在操作S940中，针对帧之间的每个空白区段，栅极驱动器集成电路输出扫描信号，并且输出用于复位Q节点的复位信号(QRST)。
通过针对每个空白区段输出用于复位Q节点的复位信号(QRST)，在空白区段中Q节点的电压电平可以保持为稳定。通过在空白区段中保持Q节点的电压电平稳定，可以防止发生在后续帧中错误地输出扫描信号的故障。
除了使用第三时钟信号或复位信号(QRST)的方案之外，本实施方式提供了通过调整栅极高电压(VGH)和栅极低电压(VGL)来避免扫描信号的误差的方案。
图10是示出根据本公开内容的实施方式的驱动栅极驱动器集成电路的方法的图。
参照图10，将比基准栅极高电压(VGH_ref)高的栅极高电压(VGH)提供至栅极高电压(VGH)输入端，并且同时将比基准栅极低电压(VGL_ref)低的栅极低电压(VGL)提供至栅极低电压(VGL)输入端。
也就是说，通过调整输入至栅极驱动器集成电路的功率，Q节点和QB节点的电压电平保持稳定，并且可以防止扫描信号的误差。
下面提供的表1和表2是测试当调整栅极高电压(VGH)和栅极低电压(VGL)时是否输出正常波形的结果。
表1
电压(V) 驱动GIP 注释
13.5 NG
14.5 NG VGH_ref
15.5 OK
表2
电压(V) 驱动GIP 注释
-8.2 NG
-8.8 NG VGL_ref
-9.4 NG
-10.0 OK
这是当提供比基准栅极高电压(VGH_ref)高的15.5V的栅极高电压(VGH)以及提供比基准栅极低电压(VGL_ref)低的-10.0V的栅极低电压(VGL)时确定输出正常波形(即，由“OK”指示的驱动GIP输出)的结果。作为比较，结果示出当提供基准栅极高电压(VGH_ref)或基准栅极低电压(VGL_ref)时不输出正常波形(即，由“NG”表示的驱动GIP输出)。
因此，根据本实施方式，通过调整输入至栅极驱动器集成电路中的信号或电源，在空白区段中Q节点和QB节点的电压电平保持稳定。
通过上述，防止在空白区段的后续帧中发生扫描信号的误差，并且提供正常输出扫描信号的栅极驱动器集成电路。
图11示出当应用根据上述实施方式的栅极驱动器集成电路的结构或驱动方案时改善扫描信号的波形的结果。
参照图11，当栅极驱动器集成电路的Q节点和QB节点的电压电平没有被稳定地控制时，确定从Scan2中产生多扫描。
根据本公开内容的实施方式，当通过用于复位Q节点的复位信号(QRST)输入端提供第三时钟信号时，当针对帧之间的每个空白区段提供复位信号(QRST)时，或者当提供较高的栅极高电压(VGH)和较低的栅极低电压(VGL)时，与多扫描相反，确定输出正常波形。
根据本公开内容的实施方式，通过调整输入至栅极驱动器集成电路中的信号或电源，在空白区段中Q节点和QB节点的电压电平保持稳定。
通过在空白区段中保持Q节点和QB节点的电压电平稳定，在空白区段之后的后续帧中可以不产生诸如多扫描的故障。
通过栅极驱动器集成电路的改进，Q节点和QB节点保持稳定，并且防止故障。因此，可以提供具有高可靠性的鲁棒结构的栅极驱动器集成电路及其驱动方法。
虽然为了说明的目的描述了本公开内容的优选实施方式，但是本领域技术人员将理解，在不脱离如所附权利要求所公开的本公开内容的范围和精神的情况下，各种修改、添加和替换是可能的。因此，为了简洁和清楚起见，已经描述了本公开内容的示例性实施方式。本公开内容的范围应基于所附权利要求来解释，使得包括在与权利要求等同的范围内的所有技术思想属于本公开内容。
可以组合上述各种实施方式以提供另外的实施方式。根据上述详细描述，可以对这些实施方式进行这些和其它改变。一般来说，在所附权利要求中，所使用的术语不应被解释为将权利要求限制于说明书和权利要求中公开的具体实施方式，而是应被解释为包括所有可能的实施方式以及这些权利要求所授权的等同内容的全部范围内。因此，权利要求不受本公开内容限制。

Claims (19)

1.一种栅极驱动器，包括：
第一晶体管，其与Q节点连接，并且被配置为基于所述Q节点的电压电平进行操作以及控制第一时钟信号的输出；
第二晶体管，其与QB节点连接，并且被配置为基于所述QB节点的电压电平进行操作；以及
控制电路单元，其包括所述Q节点和所述QB节点，并且被配置为控制所述Q节点和所述QB节点的电压电平，所述控制电路单元还包括信号线，用于复位所述Q节点的复位信号被输入至所述信号线，所述信号线与向所述Q节点提供高电平的另一时钟信号的输入端电连接，
其中，所述控制电路单元包括：第三晶体管，其与被输入所述复位信号的所述信号线连接，
其中，所述信号线直接连接至所述第三晶体管的栅极节点，
其中，所述控制电路单元还包括：连接在栅极低电压输入端与所述QB节点之间的第四晶体管，并且所述第四晶体管与所述另一时钟信号的输入端连接。
2.根据权利要求1所述的栅极驱动器，其中，所述第三晶体管的漏极节点和栅极节点彼此连接。
3.根据权利要求1所述的栅极驱动器，其中，所述控制电路单元包括连接在栅极高电压输入端与所述Q节点之间的电容器。
4.根据权利要求1所述的栅极驱动器，其中，所述第四晶体管被所述另一时钟信号控制。
5.根据权利要求1所述的栅极驱动器，其中，所述控制电路单元通过经由被输入所述复位信号的所述信号线输入的所述另一时钟信号，使所述Q节点的电压在空白区段期间保持稳定。
6.根据权利要求1所述的栅极驱动器，其中，所述控制电路单元提供栅极高电压，并且同时提供栅极低电压，其中所述栅极高电压是比基准栅极高电压高的预定电压，所述栅极低电压是比基准栅极低电压低的预定电压。
7.根据权利要求6所述的栅极驱动器，其中，所述栅极高电压等于或大于15.5V，并且所述栅极低电压等于或小于-10V。
8.一种栅极驱动器，包括：
第一晶体管，其与Q节点连接，并且被配置为基于所述Q节点的电压电平进行操作以及控制第一时钟信号的输出；
第二晶体管，其与QB节点连接，并且被配置为基于所述QB节点的电压电平进行操作；以及
控制电路单元，其包括所述Q节点和所述QB节点，并且被配置为控制所述Q节点和所述QB节点的电压电平以及针对帧之间的每个空白区段输出用于复位所述Q节点的复位信号，以在所述空白区段期间使所述Q节点的电压和所述QB节点的电压保持稳定。
9.根据权利要求8所述的栅极驱动器，其中，所述控制电路单元提供栅极高电压，并且同时提供栅极低电压，其中所述栅极高电压是比基准栅极高电压高的预定电压，所述栅极低电压是比基准栅极低电压低的预定电压。
10.根据权利要求9所述的栅极驱动器，其中，所述栅极高电压等于或大于15.5V，并且所述栅极低电压等于或小于-10V。
11.一种显示装置，包括：
显示面板，其中布置有多个栅极线和多个数据线；
栅极驱动器，被配置为驱动所述多个栅极线；以及
数据驱动器，被配置为驱动所述多个数据线，
其中，所述栅极驱动器被配置为基于Q节点的电压电平和QB节点的电压电平来输出栅极线扫描信号，并且信号线与向所述Q节点提供高电平的时钟信号的时钟信号输入端电连接，其中用于复位所述Q节点的复位信号被输入至所述信号线，
其中，所述栅极驱动器包括与被输入所述复位信号的所述信号线连接的晶体管，
其中，所述信号线直接连接至所述晶体管的栅极节点，
其中，所述栅极驱动器还包括连接在栅极低电压输入端与所述QB节点之间的另一晶体管，并且所述另一晶体管与所述时钟信号的时钟信号输入端连接。
12.根据权利要求11所述的显示装置，其中，所述晶体管的漏极节点和栅极节点彼此连接。
13.根据权利要求11所述的显示装置，其中，所述栅极驱动器包括连接在栅极高电压输入端与所述Q节点之间的电容器。
14.根据权利要求11所述的显示装置，其中，所述栅极驱动器通过经由被输入所述复位信号的所述信号线提供的所述时钟信号，使所述Q节点的电压在空白区段期间保持稳定。
15.一种驱动栅极驱动器的方法，包括：
向所述栅极驱动器提供栅极起始信号；
由所述栅极驱动器基于Q节点的电压电平和QB节点的电压电平来输出栅极信号；以及
针对帧之间的每个空白区段，通过在每个空白区段施加的复位信号重置所述Q节点，
其中，所述栅极驱动器提供被输入用于复位所述Q节点的复位信号的信号线，所述信号线与向所述Q节点提供高电平的时钟信号的输入端连接，
其中，所述栅极驱动器包括连接在栅极低电压输入端与所述QB节点之间的第一晶体管，并且所述第一晶体管与所述时钟信号的输入端连接，
其中，所述栅极驱动器还包括与被输入所述复位信号的所述信号线连接的第二晶体管，
其中，所述信号线直接连接至所述第二晶体管的栅极节点。
16.根据权利要求15所述的方法，其中，向所述栅极驱动器提供栅极起始信号包括：
通过反馈由另一栅极驱动器输出的另一栅极信号来向所述栅极驱动器提供所述栅极起始信号。
17.根据权利要求15所述的方法，其中，针对帧之间的每个空白区段重置所述Q节点包括：
向耦合在所述Q节点与栅极高电压节点之间的一个或更多个晶体管提供所述复位信号。
18.根据权利要求17所述的方法，其中，向所述一个或更多个晶体管提供所述复位信号包括：
通过向所述一个或更多个晶体管的控制端提供时钟信号来提供所述复位信号。
19.根据权利要求17所述的方法，还包括：
在帧之间的所述空白区段期间保持所述Q节点的电压电平和所述QB节点的电压电平稳定。
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