CN107305759B - 发射控制驱动器 - Google Patents

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Abstract

一种发射控制驱动器，包括被配置为分别输出多个发射控制信号的多个级。每一级包括：输入电路，用于接收来自先前级中的一个的先前发射控制信号或接收垂直启动信号，并且被配置为响应于第一时钟信号而控制第一节点的电压和第二节点的电压；稳定电路，用于响应于第二节点的电压以及第二时钟信号而稳定第一节点的电压；电压调整电路，连接在第二节点与第三节点之间，被配置为用于对第二节点的电压升压并且控制第二节点的升压电压；以及输出电路，被配置为响应于第一节点的电压以及第三节点的电压而控制发射控制信号。

Description

发射控制驱动器
技术领域
本发明构思的示例性实施方式总体涉及显示设备。更具体地，本发明构思的示例性实施方式涉及发射控制驱动器以及具有该发射控制驱动器的显示设备。
背景技术
通常，传统平板显示设备包括显示面板和面板驱动器。显示面板包括多条数据线、多条扫描线、多条发射控制线以及多个像素。面板驱动器包括向数据线提供数据信号的数据驱动器、向扫描线提供扫描信号的扫描驱动器以及向发射控制线提供发射控制信号的发射控制驱动器。
发射控制驱动器包括分别向发射控制线输出发射控制信号的多个级。每一级包括多个晶体管和电容器。当施加至发射控制驱动器的电源电压的电压电平增加以驱动大型显示设备时，晶体管的阈值电压随时间显著改变。最终，发射控制信号不可再被输出。
发明内容
示例性实施方式提供能够更稳定地输出发射控制信号的发射控制驱动器。
示例性实施方式提供具有该发射控制驱动器的显示设备。
根据一些示例性实施方式，发射控制驱动器可包括被配置为分别输出多个发射控制信号的多个级。每一级可包括：输入电路，被配置为接收来自先前级中的一个的先前发射控制信号或接收垂直启动信号，并且被配置为响应于第一时钟信号而控制第一节点的电压和第二节点的电压；稳定电路，被配置为响应于第二节点的电压以及第二时钟信号而稳定第一节点的电压；电压调整电路，连接在第二节点与第三节点之间，该电压调整电路被配置为对第二节点的电压升压并且被配置为控制第二节点的升压电压；以及输出电路，被配置为响应于第一节点的电压以及第三节点的电压而控制发射控制信号。
在示例性实施方式中，电压调整电路可包括：节点晶体管，包括被配置为接收第一电源电压的栅电极、连接至第二节点的第一电极以及连接至第四节点的第二电极；第一电压调整晶体管，包括连接至第四节点的栅电极、被配置为接收第三时钟信号的第一电极以及连接至第五节点的第二电极；电压调整电容器，包括连接至第四节点的第一电极以及连接至第五节点的第二电极；以及第二电压调整晶体管，包括被配置为接收第二时钟信号的栅电极、连接至第五节点的第一电极以及连接至第三节点的第二电极。
在示例性实施方式中，第三时钟信号可与第二时钟信号基本相同。
在示例性实施方式中，第三时钟信号的对应于第一逻辑电平的电压可低于第二时钟信号的对应于第一逻辑电平的电压。
在示例性实施方式中，每一级可进一步包括负载降低电路，该负载降低电路包括节点电容器，节点电容器具有被配置为接收第一时钟信号的第一电极以及连接至第二节点的第二电极。
在示例性实施方式中，稳定电路可包括：第一稳定晶体管，包括连接至第二节点的栅电极、被配置为接收第二电源电压的第一电极以及连接至第六节点的第二电极；第二稳定晶体管，包括连接至第二节点的栅电极、连接至第六节点的第一电极、以及第二电极；以及第三稳定晶体管，包括被配置为接收第二时钟信号的栅电极、连接至第二稳定晶体管的第二电极的第一电极以及连接至第一节点的第二电极。
在示例性实施方式中，每一级可进一步包括第一漏电流阻挡电路，该第一漏电流阻挡电路被配置为响应于第一节点的电压而将第六节点的电压控制为第一逻辑电平。
在示例性实施方式中，输出电路可包括：第一输出电路，被配置为响应于第一节点的电压而将发射控制信号控制为第一逻辑电平；以及第二输出电路，被配置为响应于第三节点的电压而将发射控制信号控制为第二逻辑电平。
在示例性实施方式中，每一级可进一步包括：第一保持电路，被配置为响应于第一时钟信号而使第二节点的电压维持处于第一逻辑电平；以及第二保持电路，被配置为响应于第一节点的电压而使第三节点的电压维持处于第二逻辑电平。
在示例性实施方式中，第二保持电路可包括：第一保持晶体管，包括连接至第一节点的栅电极、被配置为接收第二电源电压的第一电极以及连接至第七节点的第二电极；以及第二保持晶体管，包括连接至第一节点的栅电极、连接至第七节点的第一电极以及连接至第三节点的第二电极。
在示例性实施方式中，每一级可进一步包括第二漏电流阻挡电路，该第二漏电流阻挡电路被配置为响应于第三节点的电压而将第七节点的电压控制为第一逻辑电平。
在示例性实施方式中，第一输出电路可包括：第一输出晶体管，该第一输出晶体管包括连接至第一节点的栅电极、被配置为接收第一电源电压的第一电极以及连接至发射控制信号输出至的输出端子的第二电极。第二输出电路可包括第二输出晶体管，该第二输出晶体管包括连接至第三节点的栅电极、被配置为接收第三电源电压的第一电极以及连接至输出端子的第二电极。
在示例性实施方式中，第三电源电压可高于第二电源电压。
在示例性实施方式中，第一输出晶体管的第一宽长比可小于第二输出晶体管的第二宽长比。
在示例性实施方式中，电压调整电路可包括：第一电压调整晶体管，包括连接至第二节点的栅电极、被配置为接收第三时钟信号的第一电极以及连接至第五节点的第二电极；电压调整电容器，包括连接至第二节点的第一电极以及连接至第五节点的第二电极；以及第二电压调整晶体管，包括被配置为接收第二时钟信号的栅电极、连接至第五节点的第一电极以及连接至第三节点的第二电极。
在示例性实施方式中，第三时钟信号的对应于第一逻辑电平的电压可低于第二时钟信号的对应于第一逻辑电平的电压。
在示例性实施方式中，输入电路可包括：第一输入电路，被配置为响应于第一时钟信号而向第一节点施加先前发射控制信号或垂直启动信号；以及第二输入电路，被配置为响应于第一节点的电压而向第二节点施加第一时钟信号。
根据一些示例性实施方式，发射控制驱动器可包括被配置为输出多个发射控制信号和多个进位信号的多个级。每一级可包括：输入电路，被配置为接收来自先前级中的一个的先前进位信号或接收垂直启动信号，并且被配置为响应于第一时钟信号而控制第一节点的电压和第二节点的电压；稳定电路，被配置为响应于第二节点的电压以及第二时钟信号而稳定第一节点的电压；电压调整电路，连接在第二节点与第三节点之间，该电压调整电路被配置为对第二节点的电压升压，并且被配置为控制第二节点的升压电压；输出电路，被配置为响应于第一节点的电压以及第三节点的电压而控制发射控制信号；以及进位输出电路，被配置为响应于第一节点的电压以及第三节点的电压而控制进位信号。
在示例性实施方式中，稳定电路可包括：第一稳定晶体管，包括连接至第二节点的栅电极、被配置为接收第二电源电压的第一电极以及连接至第六节点的第二电极；第二稳定晶体管，包括连接至第二节点的栅电极、连接至第六节点的第一电极、以及第二电极；以及第三稳定晶体管，包括被配置为接收第二时钟信号的栅电极、连接至第二稳定晶体管的第二电极的第一电极以及连接至第一节点的第二电极。
在示例性实施方式中，每一级可进一步包括第三漏电流阻挡电路，该第三漏电流阻挡电路被配置为响应于进位信号而向第六节点施加进位信号。
在示例性实施方式中，输出电路可包括：第一输出电路，被配置为响应于第一节点的电压而将发射控制信号控制为第一逻辑电平；以及第二输出电路，被配置为响应于第三节点的电压而将发射控制信号控制为第二逻辑电平。第二输出电路可包括：第三输出晶体管，包括连接至第三节点的栅电极、接收第二电源电压的第一电极以及连接至第八节点的第二电极；以及第四输出晶体管，包括连接至第三节点的栅电极、连接至第八节点的第一电极以及连接至发射控制信号输出至的输出端子的第二电极。
在示例性实施方式中，进位输出电路可包括：第一进位输出电路，被配置为响应于第一节点的电压而将进位信号控制为第一逻辑电平；以及第二进位输出电路，被配置为响应于第三节点的电压而将进位信号控制为第二逻辑电平。
在示例性实施方式中，每一级可进一步包括第三漏电流阻挡电路，该第三漏电流阻挡电路被配置为响应于进位信号而向第八节点施加进位信号。
根据一些示例性实施方式，显示设备可包括：显示面板，包括多条扫描线、多条发射控制线、多条数据线以及多个像素；数据驱动器，被配置为经由数据线向像素提供数据信号；扫描驱动器，被配置为经由扫描线向像素提供扫描信号；发射控制驱动器，包括多个级，该多个级被配置为分别输出多个发射控制信号并且被配置为经由发射控制线向像素提供发射控制信号；以及控制器，被配置为控制数据驱动器、扫描驱动器和发射控制驱动器。发射控制驱动器的每一级可包括：输入电路，被配置为接收来自先前级中的一个的先前发射控制信号或接收垂直启动信号，并且被配置为响应于第一时钟信号而控制第一节点的电压和第二节点的电压；稳定电路，被配置为响应于第二节点的电压以及第二时钟信号而稳定第一节点的电压；电压调整电路，连接在第二节点与第三节点之间，该电压调整电路被配置为对第二节点的电压升压，并且被配置为控制第二节点的升压电压；以及输出电路，被配置为响应于第一节点的电压和第三节点的电压而控制发射控制信号。
在示例性实施方式中，电压调整电路可包括：第一电压调整晶体管，包括连接至第二节点的栅电极、被配置为接收第三时钟信号的第一电极以及连接至第五节点的第二电极；电压调整电容器，包括连接至第二节点的第一电极以及连接至第五节点的第二电极；以及第二电压调整晶体管，包括被配置为接收第二时钟信号的栅电极、连接至第五节点的第一电极以及连接至第三节点的第二电极。
在示例性实施方式中，第三时钟信号的对应于第一逻辑电平的电压可低于第二时钟信号的对应于第一逻辑电平的电压。
在示例性实施方式中，控制器可被配置为感测通过发射控制驱动器的电力端子流动的电流的大小，并且基于感测的大小调整第三时钟信号的电压。
在示例性实施方式中，发射控制驱动器的每一级可进一步包括负载降低电路，该负载降低电路包括节点电容器，节点电容器具有被配置为接收第一时钟信号的第一电极以及连接至第二节点的第二电极。
因此，根据示例性实施方式的发射控制驱动器包括电压调整电路，该电压调整电路将每一级中的节点的电压控制为高电平电压，由此降低晶体管的负载。在发射控制驱动器中，彼此串联连接的两个晶体管位于每一级的其中出现漏电流的部分中，并且随后高电平电压施加至两个晶体管之间的节点，由此防止或降低漏电流。因此，发射控制驱动器可稳定地维持每一级中的节点的电压，并且防止由晶体管的阈值电压的变化或偏差而造成的发射控制信号的异常脉冲。
此外，大型显示设备可通过包括改善可靠性的发射控制驱动器而被更稳定地驱动。
附图说明
在下文中将参考附图更完全地描述示例性实施方式，在附图中示出各种实施方式。
图1是示出根据一个示例性实施方式的显示设备的框图。
图2是示出包括在图1的显示设备中的像素的实例的电路图。
图3是示出包括在图1的显示设备中的发射控制驱动器的一个实例的框图。
图4是示出包括在图3的发射控制驱动器中的级的一个实例的电路图。
图5是用于描述图4的级的操作的时序图。
图6是示出包括在图3的发射控制驱动器中的级的另一实例的电路图。
图7是用于描述图6的级的操作的时序图。
图8是示出包括在图1的显示设备中的发射控制驱动器的另一实例的框图。
图9是示出包括在图8的发射控制驱动器中的级的一个实例的电路图。
图10是示出包括在图1的显示设备中的发射控制驱动器的又一实例的框图。
图11是示出包括在图10的发射控制驱动器中的级的一个实例的电路图。
图12A和图12B是用于描述图11的级的效果的波形。
图13是示出包括在图1的显示设备中的发射控制驱动器的又一实例的框图。
图14是示出包括在图13的发射控制驱动器中的级的一个实例的电路图。
图15A和图15B是用于描述图14的级的效果的波形。
图16是示出包括在图13的发射控制驱动器中的级的另一实例的电路图。
图17是示出包括在图1的显示设备中的发射控制驱动器的又一实例的框图。
图18是示出包括在图17的发射控制驱动器中的级的一个实例的电路图。
图19A和图19B是用于描述图18的级的效果的波形。
图20是示出包括在图17的发射控制驱动器中的级的另一实例的电路图。
具体实施方式
在下文中将参考附图更完全地描述示例性实施方式，在附图中示出各种实施方式。各个附图不必按比例绘制。所有数值都是近似的，并且可改变。特定材料和组合物的所有实例都是非限制性的，并且仅是示例性的。可使用其他合适的材料和组合物来代替。
图1是示出根据一个示例性实施方式的显示设备的框图。
参考图1，显示设备1000可包括显示面板100、扫描驱动器200、发射控制驱动器300、数据驱动器400以及控制器500。
显示面板100可显示图像。显示面板100可包括多条扫描线SL1至SLn、多条数据线DL1至DLm、多条发射控制线EM1至EMn以及多个像素PX。例如，显示面板100可包括n*m个像素PX，因为像素PX布置在与扫描线SL1至SLn和数据线DL1至DLm的交点相对应的位置处。
扫描驱动器200可基于第一控制信号CNT1经由扫描线SL1至SLn向像素PX提供扫描信号。
发射控制驱动器300可基于第二控制信号CNT2经由发射控制线EM1至EMn向像素PX提供发射控制信号。发射控制驱动器300可包括分别输出发射控制信号的多个级。
发射控制驱动器300的每一级可包括第一输入电路、第二输入电路、第一输出电路、稳定电路、电压调整电路以及第二输出电路。每一级的电压调整电路可控制节点的升压电压以降低该级中的晶体管的负载。在一个示例性实施方式中，发射控制驱动器300的每一级也可包括降低节点的升压电压的负载降低电路。另外，在发射控制驱动器300的每一级中，彼此串联连接的两个晶体管位于每一级的其中出现漏电流的部分中，并且随后高电平电压施加在两个晶体管之间以防止或降低漏电流。
因此，发射控制驱动器300可通过降低这些晶体管的负载来防止其晶体管的阈值电压的改变，并且因此可更稳定地输出发射控制信号。在下文中，将参考图4、图6、图9、图11、图14、图16、图18以及图20更详细地描述发射控制驱动器300的级的结构。
数据驱动器400可接收第三控制信号CTL3并且输出图像数据ODATA。数据驱动器400可将输出图像数据ODATA转换为模拟式数据信号，并且基于第三控制信号CTL3经由数据线DL1至DLm向像素PX提供数据信号。
控制器500可控制扫描驱动器200、发射控制驱动器300以及数据驱动器400。控制器500可从显示设备1000外部或之外的源(例如，系统板)接收输入图像数据IDATA和控制信号CNT。控制器500可生成第一控制信号CTL1至第三控制信号CTL3以控制扫描驱动器200、发射控制驱动器400以及数据驱动器500。更具体地，用于控制扫描驱动器200的第一控制信号CTL1以及用于控制发射控制驱动器300的第二控制信号CTL2可分别包括垂直启动信号、时钟信号等。用于控制数据驱动器400的第三控制信号CTL3可包括水平启动信号、负载信号等。控制器500可基于输入图像数据IDATA而生成适于显示面板100的操作条件的输出图像数据ODATA，并且可向数据驱动器400提供输出图像数据ODATA。
在一个示例性实施方式中，控制器500可感测通过发射控制驱动器300的电力端子流动的电流的大小，并且可基于感测的电流大小来调整提供至发射控制驱动器300的发射控制时钟信号的电压电平。例如，控制器500可使用查询表(LUT)来确定发射控制时钟信号的电压，在该查询表中，存储有通过电力端子流动的电流的大小与发射控制时钟信号的电压电平之间的关系。控制器500可以在嵌入式电源管理集成电路(PMIC)中调整发射控制时钟信号的电压，并且向发射控制驱动器300提供发射控制时钟信号。
图2是示出包括在图1的显示设备中的像素的实例的电路图。
参考图2，像素PXij可包括有机发光二极管OLED、驱动晶体管T1、电容器CST、开关晶体管T2以及发射控制晶体管T3。
驱动晶体管T1可包括连接至开关晶体管T2的第二电极的栅电极、连接至发射控制晶体管T3的第二电极的第一电极以及连接至OLED的第一电极的第二电极。
开关晶体管T2可包括连接至扫描线SLi的栅电极、连接至数据线DLi的第一电极以及连接至驱动晶体管T1的栅电极的第二电极。因此，开关晶体管T2可响应于扫描信号而向驱动晶体管T1的栅电极提供数据信号。
电容器CST可包括连接至驱动晶体管T1的栅电极的第一电极以及连接至驱动晶体管T1的第二电极的第二电极。电容器CST可向施加至驱动晶体管T1的栅电极的数据信号充电，并且可在开关晶体管T2断开之后维持驱动晶体管T1的栅电极的充电电压。
发射控制晶体管T3可包括连接至发射控制线EMi的栅电极、接收第一发射电压ELVDD的第一电极以及连接至驱动晶体管T1的第一电极的第二电极。因此，发射控制晶体管T3可响应于来自发射控制线EMi的发射控制信号而控制通过驱动晶体管T1流动的驱动电流的流动。
OLED可包括连接至驱动晶体管T1的第二电极的第一电极以及接收第二发射电压ELVSS的第二电极。OLED可基于驱动电流而发光。
尽管图2的示例性实施方式描述了像素PXij包括三个晶体管和一个电容器，但是像素PXij可利用各种结构以各种方式来实现。例如，像素可进一步包括用于响应于初始化控制信号而初始化驱动晶体管和电容器的电极的晶体管。
图3是示出包括在图1的显示设备中的发射控制驱动器的一个实例的框图。
参考图3，发射控制驱动器300A可包括多个级STG1至STGn。级STG1至STGn中的每一个可输出发射控制信号。级STG1至STGn中的每一个可包括输入端子IN、第一时钟端子CT1、第二时钟端子CT2、第一电力端子VT1、第二电力端子VT2以及输出端子OUT。
具有不同定时的第一发射控制时钟信号GCK1和第二发射控制时钟信号GCK2可施加至每一级的第一时钟端子CT1和第二时钟端子CT2。例如，第二发射控制时钟信号GCK2可以是与第一发射控制时钟信号GCK1反相的信号。在相邻级中，第一发射控制时钟信号GCK1和第二发射控制时钟信号GCK2可以相反顺序施加。例如，在奇数级(例如，STG1、STG3等)中，第一发射控制时钟信号GCK1可施加至第一时钟端子CT1作为第一时钟信号，并且第二发射控制时钟信号GCK2可施加至第二时钟端子CT2作为第二时钟信号。相对地，在偶数级(例如，STG2、STG4等)中，第二发射控制时钟信号GCK2可施加至第一时钟端子CT1作为第一时钟信号，并且第一发射控制时钟信号GCK1可施加至第二时钟端子CT2作为第二时钟信号。
垂直启动信号STV或从先前级中的一个输出的先前发射控制信号可施加至输入端子IN。例如，垂直启动信号STV施加至第一级STG1的输入端子IN。先前发射控制信号可分别施加至紧接后续级SRC2至SRCn的每个输入端子IN。发射控制信号可分别经由级STG1至STGn的输出端子OUT而输出至发射控制线。
对应于第一逻辑电平的第一电源电压VGH可提供至级STG1至STGn的第一电力端子VT1。例如，第一电源电压VGH可对应于高电平电压。对应于第二逻辑电平的第二电源电压VGL可提供至级STG1至STGn的第二电力端子VT2。例如，第二电源电压VGL可对应于低电平电压。
图4是示出包括在图3的发射控制驱动器中的级的一个实例的电路图。
参考图4，发射控制驱动器的级STGA可包括第一输入电路310、第二输入电路315、第一输出电路320、第二输出电路325、稳定电路330、电压调整电路340、第一保持电路350以及第二保持电路355。
第一输入电路310可响应于第一时钟信号CLK1而将先前发射控制信号EM(i-1)或垂直启动信号STV施加至第一节点N1。在一个示例性实施方式中，第一输入电路310可包括第一输入晶体管M1。第一输入晶体管M1可包括连接至第一时钟端子的栅电极、连接至输入端子的第一电极以及连接至第一节点N1的第二电极。此处，施加至第一时钟端子的第一时钟信号CLK1与奇数级中的第一发射控制时钟信号GCK1相对应并且与偶数级中的第二发射控制时钟信号GCK2相对应。
第二输入电路315可响应于第一节点N1的电压而向第二节点N2施加第一时钟信号CLK1。在一个示例性实施方式中，第二输入电路315可包括彼此串联连接以降低漏电流并降低晶体管的负载的第二输入晶体管M4-1和第三输入晶体管M4-2。第二输入晶体管M4-1可包括连接至第一节点N1的栅电极、连接至第一时钟端子的第一电极以及连接至第三输入晶体管M4-2的第一电极的第二电极。第三输入晶体管M4-2可包括连接至第一节点N1的栅电极、连接至第二输入晶体管M4-1的第二电极的第一电极以及连接至第二节点N2的第二电极。当第二节点N2的电压对应于高电平电压时，第二输入电路315可降低从第二节点N2流动至第一时钟端子的漏电流。
第一输出电路320可响应于第一节点N1的电压而将发射控制信号EM(i)控制为第一逻辑电平。在一个示例性实施方式中，第一输出电路320可包括第一输出晶体管M10。第一输出晶体管M10可包括连接至第一节点N1的栅电极、接收第一电源电压VGH的第一电极以及连接至发射控制信号EM(i)输出至的输出端子的第二电极。
第二输出电路325可响应于第三节点N3的电压而将发射控制信号EM(i)控制为第二逻辑电平。在一个示例性实施方式中，第二输出电路325可包括第二输出晶体管M9。第二输出晶体管M9可包括连接至第三节点N3的栅电极、接收第二电源电压VGL的第一电极以及连接至输出端子的第二电极。
稳定电路330可响应于第二节点N2的电压以及第二时钟信号CLK2而将第一节点N1的电压稳定为第二逻辑电平。因此，发射控制信号EM(i)可被稳定。此处，第二时钟信号CLK2与奇数级中的第二发射控制时钟信号GCK2相对应并且与偶数级中的第一发射控制时钟信号GCK1相对应。稳定电路330可包括彼此串联连接的第一稳定晶体管M2和第三稳定晶体管M3。第一稳定晶体管M2可包括连接至第二节点N2的栅电极、接收第二电源电压VGL的第一电极以及连接至第三稳定晶体管M3的第一电极的第二电极。第三稳定晶体管M3可包括接收第二时钟信号CLK2的栅电极、连接至第一稳定晶体管M2的第二电极的第一电极以及连接至第一节点N1的第二电极。
电压调整电路340可连接在第二节点N2与第三节点N3之间，以便对第二节点N2的电压升压并且控制第二节点N2的升压电压。在一个示例性实施方式中，电压调整电路340可包括节点晶体管M11、第一电压调整晶体管M7、第二电压调整晶体管M6以及电压调整电容器C2。节点晶体管M11可包括接收第一电源电压VGH的栅电极、连接至第二节点N2的第一电极以及连接至第四节点N4的第二电极。节点晶体管M11可位于第二节点N2与第四节点N4之间，该第四节点的电压通过电压调整电容器C2升压以降低第二节点N2的电压。第一电压调整晶体管M7可包括连接至第四节点N4的栅电极、接收第二时钟信号CLK2的第一电极以及连接至第五节点N5的第二电极。电压调整电容器C2可包括连接至第四节点N4的第一电极以及连接至第五节点N5的第二电极。第二电压调整晶体管M6可包括接收第二时钟信号CLK2的栅电极、连接至第五节点N5的第一电极以及连接至第三节点N3的第二电极。
第一保持电路350可响应于第一时钟信号CLK1而使第二节点N2的电压维持处于第一逻辑电平。在一个示例性实施方式中，第一保持电路350可包括第三保持晶体管M5。第三保持晶体管M5可包括接收第一时钟信号CLK1的栅电极、接收第一电源电压VGH的第一电极以及连接至第二节点N2的第二电极。
第二保持电路355可响应于第一节点N1的电压而使第三节点N3的电压维持处于第二逻辑电平。在一个示例性实施方式中，第二保持电路355可包括第四保持晶体管M8。第四保持晶体管M8可包括连接至第一节点N1的栅电极、接收第二电源电压VGL的第一电极以及连接至第三节点N3的第二电极。
此外，级STGA可进一步包括用于维持第一输出晶体管M10的栅电极的电压的第一电容器360以及用于维持第二输出晶体管M9的栅电极的电压的第二电容器365。
图5是用于描述图4的级的操作的时序图。
参考图4和图5，包括在电压调整电路340中的节点晶体管M11可位于第二节点N2与第四节点N4之间，以降低第二节点N2的电压并且降低连接至第二节点N2的晶体管的负载(即，第一稳定晶体管M2、第三保持晶体管M5、第二输入晶体管M4-1以及第三输入晶体管M4-2)。
在第一周期P1期间，从先前级输出的先前发射控制信号EM(i-1)可处于高电平。第一输入电路310可响应于第一时钟信号CLK1而将设定为处于其高电平的先前发射控制信号EM(i-1)施加至第一节点N1。因此，第一节点N1的电压可被设为处于高电平。另外，发射控制信号EM(i)可通过第一输出电路320而维持处于高电平。
在第二周期P2期间，先前发射控制信号EM(i-1)可从其高电平转换为低电平。第一输入电路310可响应于时钟信号CLK1而将低电平的先前发射控制信号EM(i-1)施加至第一节点N1。因此，节点N1的电压可被设为处于低电平。第二节点N2和第四节点N4的电压可被第一保持晶体管350设为高电平。因为第一电压调整晶体管M7向第五节点N5施加低电平的第二时钟信号CLK2，所以第五节点N5的电压可被设为处于低电平。因为第二电压调整晶体管M6通过第二时钟信号CLK2的低电平而断开，所以第三节点N3的电压可被设为处于低电平。因此，第二输出晶体管M9可断开，并且发射控制信号EM(i)可维持处于高电平。
在第三周期P3期间，第二时钟信号CLK2可从高电平转换为低电平，并且此后再次从低电平转换为高电平。因此，由于电压调整电容器C2的耦合，第四节点N4的电压通过第二时钟信号CLK2的电位的变化而自举升压(boot-strap)。此时，第四节点N4的电压对应于升压高电平。然而，因为高电平电压施加至节点晶体管M11的栅电极并且升压高电平电压施加至节点晶体管M11的第二电极，所以第二节点N2的电压可不增加。此后，当第二时钟信号CLK2从高电平转换为低电平时，因为第一调整晶体管M7向第五节点N5施加第二时钟信号CLK2，所以第四节点N4的升压电压可降低。第三节点N3的电压可以是高电平，因为第二电压调整晶体管M6响应于第二时钟信号CLK2而向第三节点N3施加第五节点N5的电压。因此，第二输出晶体管M9可向输出端子施加第二电源电压VGL，并且因此发射控制信号EM(i)可在第三周期P3期间维持处于低电平。
在第四周期P4期间，第一节点N1的电压维持处于高电平并且第三节点N3的电压维持处于低电平。因此，发射控制信号EM(i)可维持处于高电平。
图6是示出包括在图3的发射控制驱动器中的级的另一实例的电路图。
参考图6，发射控制驱动器的级STGB可包括第一输入电路310、第二输入电路315、第一输出电路320、第二输出电路325、稳定电路330、电压调整电路341、第一保持电路350、第二保持电路355以及负载降低电路370。根据本示例性实施方式的级STGB与在图4中描述的示例性实施方式的级基本相同，除了添加负载降低电路370以外(对应地，省去晶体管M11)。因此，相同参考标号将用于指代与在图4的先前示例性实施方式中描述的那些相同或相似的部件，并且将省去与以上元件有关的任何重复说明。
电压调整电路341可连接在第二节点N2与第三节点N3之间，以便对第二节点N2的电压升压并且控制第二节点N2的升压电压。在一个示例性实施方式中，电压调整电路341可包括第一电压调整晶体管M7-1、第二电压调整晶体管M6以及电压调整电容器C2-1。第一电压调整晶体管M7-1可包括连接至第二节点N2的栅电极、接收第二时钟信号CLK2的第一电极以及连接至第五节点N5的第二电极。电压调整电容器C2-1可包括连接至第二节点N2的第一电极以及连接至第五节点N5的第二电极。第二电压调整晶体管M6可包括接收第二时钟信号CLK2的栅电极、连接至第五节点N5的第一电极以及连接至第三节点N3的第二电极。
负载降低电路370可降低第二节点N2的负载。负载降低电路370可包括节点电容器C4。节点电容器C4可包括接收第一时钟信号CLK1的第一电极以及连接至第二节点N2的第二电极。在包括串联电容器的电路中，跨每个电容器的电压降可取决于每个电容器的电容而不同。因此，第二节点N2的升压电压的大小可通过节点电容器C4的电容与电压调整电容器C2-1的电容的比值来确定。
图7是用于描述图6的级的操作的时序图。
参考图6和图7，包括在负载降低电路370中的节点电容器C4可降低第二节点N2的电压，由此降低连接至第二节点N2的晶体管(即，第一稳定晶体管M2、第三保持晶体管M5、第二输入晶体管M4-1以及第三输入晶体管M4-2)的负载。根据本示例性实施方式的级STGB的操作与在图5中描述的示例性实施方式的级的操作基本相同，除了因为级不包括节点晶体管，升压电压通过电压调整电容器施加至第二节点以外。因此，相同参考标号将用于指代与在图5的先前示例性实施方式中描述的那些相同或相似的部件，并且将省去与以上元件有关的任何重复说明。
第一时钟信号CLK1和第二时钟信号CLK2以及第一电源电压VGH的高电平电压被设为38V，并且第一时钟信号CLK1和第二时钟信号CLK2以及第二电源电压VGL的低电平电压被设为-2V。在这种情况下，根据节点电容器C4的电容与电压调整电容器C2-1的电容的比值，施加至第二节点N2的升压电压从第一升压电压2H降低至第二升压电压2H'。具体地，在级不包括节点电容器C4的情况下，施加至第二节点N2的第一升压电压2H测量为72V。另一方面，在节点电容器C4的电容等于电压调整电容器C2-1的电容的情况下，施加至第二节点N2的第二升压电压2H'测量为50.1V。在节点电容器C4的电容是电压调整电容器C2-1的电容的两倍的情况下，施加至第二节点N2的第二升压电压2H'测量为42.1V。[表1]表示节点电容器C4的电容与电压调整电容器C2-1的电容的比值与第二节点的升压电压之间的关系。
[表1]
比值(C4/C2) 2H'
0.2 58.9
1 50.1
1.5 45.8
2 42.1
因此，考虑到第二节点N2的升压电压，节点电容器C4可实现为具有适当尺寸/电容。例如，第二节点N2的升压电压可确定为使得当第一节点N1的电压对应于低电平时稳定电路正常操作，以便基本上消除发射控制信号EM(i)中的波动。此外，施加至第二节点N2的升压电压可确定为使得连接至第二节点N2的晶体管的负载足够小。
图8是示出包括在图1的显示设备中的发射控制驱动器的另一实例的框图。
参考图8，发射控制驱动器300C可包括多个级STG1至STGn。级STG1至STGn中的每一个可输出发射控制信号。级STG1至STGn中的每一个可包括输入端子IN、第一时钟端子CT1、第二时钟端子CT2、第三时钟端子CT3、第一电力端子VT1、第二电力端子VT2以及输出端子OUT。根据本示例性实施方式的发射控制驱动器300C与在图3中描述的示例性实施方式的驱动器300A基本相同，除了添加第三时钟端子CT3以外。因此，相同参考标号将用于指代与在图3的先前示例性实施方式中描述的那些相同或相似的部件，并且将省去与以上元件有关的任何重复说明。
具有不同定时的第一发射控制时钟信号GCK1和第二发射控制时钟信号GCK2可施加至每一级的第一时钟端子CT1和第二时钟端子CT2。例如，第二发射控制时钟信号GCK2可以是与第一发射控制时钟信号GCK1反相的信号。在相邻级中，第一发射控制时钟信号GCK1和第二发射控制时钟信号GCK2可以相反顺序施加。例如，在奇数级(例如，STG1、STG3等)中，第一发射控制时钟信号GCK1可施加至第一时钟端子CT1作为第一时钟信号，并且第二发射控制时钟信号GCK2可施加至第二时钟端子CT2作为第二时钟信号。相对地，在偶数级(例如，STG2、STG4等)中，第二发射控制时钟信号GCK2可施加至第一时钟端子CT1作为第一时钟信号，并且第一发射控制时钟信号GCK1可施加至第二时钟端子CT2作为第二时钟信号。
具有不同定时的第三发射控制信号GCK3和第四发射控制时钟信号GCK4中的一个可施加至每一级的第三时钟端子CT3。第三发射控制时钟信号GCK3的波形可与第一发射控制时钟信号GCK1的波形基本相同。第三发射控制时钟信号GCK3的高电平电压可低于第一发射控制时钟信号GCK1的高电平电压。第四发射控制时钟信号GCK4的波形可与第二发射控制时钟信号GCK2的波形基本相同。第四发射控制时钟信号GCK4的高电平电压可低于第二发射控制时钟信号GCK2的高电平电压。此外，在奇数级(例如，STG1、STG3等)中，第四发射控制时钟信号GCK4可施加至第三时钟端子CT3作为第三时钟信号。相对地，在偶数级(例如，STG2、STG4等)中，第三发射控制时钟信号GCK3可施加至第三时钟端子CT3作为第三时钟信号。
图9是示出包括在图8的发射控制驱动器中的级的一个实例的电路图。
参考图9，发射控制驱动器300C的级STGC可包括第一输入电路310、第二输入电路315、第一输出电路320、第二输出电路325、稳定电路330、电压调整电路342、第一保持电路350以及第二保持电路355。根据本示例性实施方式的级STGC与在图4中描述的示例性实施方式的级STGA基本相同，除了包括在电压调整电路342中的第一电压调整晶体管M7-2连接至第三时钟端子以外。因此，相同参考标号将用于指代与在图4的先前示例性实施方式中描述的那些相同或相似的部件，并且将省去与以上元件有关的任何重复说明。
电压调整电路342可连接在第二节点N2与第三节点N3之间，以由此对第二节点N2的电压升压并且控制第二节点N2的升压电压。在一个示例性实施方式中，电压调整电路342可包括第一电压调整晶体管M7-2、第二电压调整晶体管M6以及电压调整电容器C2-2。第一电压调整晶体管M7-2可包括连接至第二节点N2的栅电极、接收第三时钟信号CLK3的第一电极以及连接至第五节点N5的第二电极。电压调整电容器C2-1可包括连接至第二节点N2的第一电极以及连接至第五节点N5的第二电极。第二电压调整晶体管M6可包括接收第二时钟信号CLK2的栅电极、连接至第五节点N5的第一电极以及连接至第三节点N3的第二电极。第三时钟信号CLK3的波形可与第二时钟信号CLK2的波形基本相同。第三时钟信号CLK3的高电平电压可低于第二时钟信号CLK2的高电平电压。
由于电压调整电容器C2-2的耦合，第二节点N2的电压可通过第三时钟信号CLK3的电位的变化而自举升压。因此，第二节点N2的升压电压电平可通过第三时钟信号CLK3的电压电平调整。
在一个示例性实施方式中，可感测通过发射控制驱动器的第二电力端子流动的电流的大小，并且可基于电流的大小来调整第三时钟信号CLK3的电压。包括在级中的晶体管的特性(例如，阈值电压)可随时间改变，改变通过电力端子流动的电流的大小。因此，可基于感测电流的大小来调整第三时钟信号CLK3的电压，以改进级的可靠性。例如，如果感测电流的大小相对大，则第三时钟信号CLK3的电压可被设为相对低电压，因为晶体管的阈值电压下降。另一方面，如果感测电流的大小相对小，则第三时钟信号CLK3的电压可被设为相对高电压，因为晶体管的阈值电压增加。
尽管图9的示例性实施方式描述电压调整电路包括第一电压调整晶体管、第二电压调整晶体管和电压调整电容器，但是电压调整电路进一步包括节点晶体管。
图10是示出包括在图1的显示设备中的发射控制驱动器的又一实例的框图。
参考图10，发射控制驱动器300D可包括多个级STG1至STGn。级STG1至STGn中的每一个可输出发射控制信号。级STG1至STGn中的每一个可包括输入端子IN、第一时钟端子CT1、第二时钟端子CT2、第一电力端子VT1、第二电力端子VT2、第三电力端子VT3以及输出端子OUT。根据本示例性实施方式的发射控制驱动器300D与在图3中描述的示例性实施方式的驱动器300A基本相同，除了第三电力端子VT3添加至每一级以外。因此，相同参考标号将用于指代与在图3的先前示例性实施方式中描述的那些相同或相似的部件，并且将省去与以上元件有关的任何重复说明。
对应于第一逻辑电平的第一电源电压VGH可提供至级STG1至STGn的第一电力端子VT1。例如，第一电源电压VGH可对应于高电平电压。对应于第二逻辑电平的第二电源电压VGL1可提供至级STG1至STGn的第二电力端子VT2。例如，第二电源电压VGL1可对应于第一低电平电压。对应于第二逻辑电平的第三电源电压VGL2可提供至级STG1至STGn的第三电力端子VT3。例如，第三电源电压VGL2可与高于第一低电平的第二低电平相对应。
图11是示出包括在图10的发射控制驱动器中的级的一个实例的电路图。
参考图11，发射控制驱动器300D的级STGD可包括第一输入电路310、第二输入电路315、第一输出电路320、第二输出电路326、稳定电路331、电压调整电路340、第一保持电路350、第二保持电路356、第一漏电流阻挡电路381以及第二漏电流阻挡电路382。根据本示例性实施方式的第一输入电路310、第二输入电路315、电压调整电路340以及第一保持电路350与在图4中描述的示例性实施方式的第一输入电路、第二输入电路、电压调整电路以及第一保持电路基本相同。因此，相同参考标号将用于指代与在图4的先前示例性实施方式中描述的那些相同或相似的部件，并且将省去与以上元件有关的任何重复说明。
第一输出电路320可响应于第一节点N1的电压而将发射控制信号EM(i)控制为第一逻辑电平。在一个示例性实施方式中，第一输出电路320可包括第一输出晶体管M10。第一输出晶体管M10可包括连接至第一节点N1的栅电极、接收第一电源电压VGH的第一电极以及连接至发射控制信号EM(i)输出至的输出端子的第二电极。
第二输出电路326可响应于第三节点N3的电压而将发射控制信号EM(i)控制为第二逻辑电平。在一个示例性实施方式中，第二输出电路326可包括第二输出晶体管M9。第二输出晶体管M9可包括连接至第三节点N3的栅电极、接收第三电源电压VGL2的第一电极以及连接至输出端子的第二电极。
级STGD可接收都与第二逻辑电平相对应的第二电源电压VGL1和第三电源电压VGL2以防止漏电流。在一个示例性实施方式中，第三电源电压VGL2可高于第二电源电压VGL1。稳定电路331和第二保持电路356可将第一节点N1和第三节点N3的电压设为第二电源电压VGL1。相对地，第二输出电路326可将发射控制信号EM(i)设为第三电源电压VGL2。因此，当第二电源电压VGL1(即，第一低电平电压)施加至第一输出晶体管M10的栅电极时，高于第二电源电压VGL1的第三电源电压VGL2(即，第二低电平电压)施加至第一输出晶体管M10的第二电极。因此，从第一电极流动至第一输出晶体管M10的第二电极的漏电流可降低。此外，当第二电源电压VGL1施加至第二输出晶体管M9的栅电极时，大于第二电源电压VGL1的第三电源电压VGL2施加至第二输出晶体管M9的第一电极。因此，从第二电极流动至第二输出晶体管M9的第一电极的漏电流可降低。
在一个示例性实施方式中，第一输出晶体管M10的第一宽长比可小于第二输出晶体管M9的第二宽长比。第二电源电压VGL1可施加至稳定电路331和第二保持电路356，并且第三电源电压VGL2可施加至第二输出电路326以防止或降低通过第一输出晶体管M10流动的漏电流。因此，第一输出晶体管M10可实现为小尺寸。例如，第一输出晶体管M10的第一宽长比可等于或小于第二输出晶体管M9的第二宽长比的30％。更具体地，第一输出晶体管M10的宽度可大约为120微米，并且第二输出晶体管M9的宽度可大约为450微米。
稳定电路331可响应于第二节点N2的电压和第二时钟信号CLK2而稳定发射控制信号EM(i)。在一个示例性实施方式中，稳定电路331可包括第一稳定晶体管M2-1、第二稳定晶体管M2-2以及第三稳定晶体管M3。第一稳定晶体管M2-1可包括连接至第二节点N2的栅电极、接收第二电源电压VGL1的第一电极以及连接至第六节点N6的第二电极。第二稳定晶体管M2-2可包括连接至第二节点N2的栅电极、连接至第六节点N6的第一电极、以及第二电极。第三稳定晶体管M3可包括接收第二时钟信号CLK2的栅电极、连接至第二稳定晶体管M2-2的第二电极的第一电极以及连接至第一节点N1的第二电极。
第一漏电流阻挡电路381可响应于第一节点N1的电压而将第六节点N6的电压控制为第一逻辑电平。在一个示例性实施方式中，第一漏电流阻挡电路381可包括第一阻挡晶体管M13。第一阻挡晶体管M13可包括连接至第一节点N1的栅电极、接收第一电源电压VGH的第一电极以及连接至第六节点N6的第二电极。
从以上内容，稳定电路331包括彼此串联连接的多个晶体管。因此，当第一节点N1的电压对应于高电平电压时，稳定电路331可降低从第一节点N1流动至第二电源电压VGL1提供至的第二电力端子的漏电流。此外，当第一节点N1的电压对应于高电平电压时，第一漏电流阻挡电路381可将第六节点N6的电压设为高电平电压以防止漏电流从第一节点N1流动至第二电力端子。
第二保持电路356可响应于第一节点N1的电压而使第三节点N3的电压维持为第二逻辑电平。在一个示例性实施方式中，第二保持电路356可包括第一保持晶体管M8-1和第二保持晶体管M8-2。第一保持晶体管M8-1可包括连接至第一节点N1的栅电极、接收第二电源电压VGL1的第一电极以及连接至第七节点N7的第二电极。第二保持晶体管M8-2可包括连接至第一节点N1的栅电极、连接至第七节点N7的第一电极以及连接至第三节点N3的第二电极。
第二漏电流阻挡电路382可响应于第三节点N3的电压而将第七节点N7的电压控制为第一逻辑电平。在一个示例性实施方式中，第二漏电流阻挡电路382可包括第二阻挡晶体管M12。第二阻挡晶体管M12可包括连接至第三节点N3的栅电极、接收第一电源电压VGH的第一电极以及连接至第七节点N7的第二电极。
如可看到的，第二保持电路356包括彼此串联连接的多个晶体管。因此，当第三节点N3的电压对应于高电平电压时，第二保持电路356可降低从第三节点N3流动至第二电源电压VGL1提供至的第二电力端子的漏电流。此外，当第三节点N3的电压对应于高电平电压时，第二漏电流阻挡电路382可将第二保持电路356中的第七节点N7的电压设为高电平电压以防止漏电流从第三节点N3流动至第二电力端子。
尽管图11的示例性实施方式描述了漏电流阻挡电路向稳定电路或/和保持电路施加高电平电压，但是实施方式不限于此。例如，级的其中出现漏电流的每个部分可包括彼此串联连接的两个晶体管，其中，漏电流阻挡电路向每个部分中的两个晶体管之间的节点施加高电平电压。
图12A和图12B是用于描述图11的级的效果的波形。
参考图12A和图12B，彼此串联连接的两个晶体管位于级的其中出现漏电流的每个部分(例如，稳定电路、第二保持电路)中，并且随后漏电流阻挡电路向两个晶体管之间的节点施加高电平电压，由此防止或降低漏电流。
如图12A所示，对于级不包括漏电流阻挡电路的情况，当晶体管的阈值电压小于或等于0V时，发射控制信号有波动或者发射控制信号被异常输出。因此，当晶体管的阈值电压在反方向上移动时，发射控制信号有波动或者发射控制信号被异常输出。因此，由显示设备显示的图像有斑点或者显示设备异常显示图像。
另一方面，如图12B所示，对于稳定电路和第二保持电路中的每一个包括彼此串联连接的两个晶体管并且漏电流阻挡电路向两个相应晶体管之间的节点施加高电平电压的情况，当晶体管的阈值电压小于或等于-3V时，发射控制信号有波动。因此，如[表2]所示，当晶体管的阈值电压大于或等于-2V时，发射控制信号被稳定输出。
[表2]
Figure BDA0001256842540000231
此处，REF表示不包括漏电流阻挡电路的级，STGD表示在图11中描述的级，Vth表示级中的晶体管的阈值电压，EM High表示发射控制信号的对应于高电平的电压，并且EM Low表示发射控制信号的对应于低电平的电压。
图13是示出包括在图1的显示设备中的发射控制驱动器的又一实例的框图。
参考图13，发射控制驱动器300E可包括多个级STG1至STGn。级STG1至STGn中的每一个可输出发射控制信号。级STG1至STGn中的每一个可包括输入端子IN、第一时钟端子CT1、第二时钟端子CT2、第一电力端子VT1、第二电力端子VT2、输出端子OUT以及进位端子CARRY。根据本示例性实施方式的发射控制驱动器300E与在图3中描述的示例性实施方式的驱动器300A基本相同，除了添加进位端子CARRY以外。因此，相同参考标号将用于指代与在图3的先前示例性实施方式中描述的那些相同或相似的部件，并且将省去与以上元件有关的任何重复说明。
垂直启动信号STV或从先前级中的一个输出的先前进位信号可施加至级STG1至STGn的输入端子IN。例如，垂直启动信号STV施加至第一级STG1的输入端子IN。紧接先前发射控制信号可分别施加至其他级SRC2至SRCn的每个输入端子IN。
发射控制信号可分别经由级STG1至STGn的输出端子OUT而输出至发射控制线。每个进位信号可经由进位端子CARRY而输出至下一级。
图14是示出包括在图13的发射控制驱动器300E中的级的一个实例的电路图。
参考图14，发射控制驱动器的级STGE可包括第一输入电路310、第二输入电路315、第一输出电路320、第二输出电路325、稳定电路331、电压调整电路340、第一保持电路350、第二保持电路356、第一进位输出电路390、第二进位输出电路395以及第三漏电流阻挡电路383。根据本示例性实施方式的第一输入电路310、第二输入电路315、第一输出电路320、第二输出电路325、电压调整电路340以及第一保持电路350与在图4中描述的示例性实施方式的第一输入电路、第二输入电路、第一输出电路、第二输出电路、电压调整电路以及第一保持电路基本相同。因此，相同参考标号将用于指代与在图4的先前示例性实施方式中描述的那些相同或相似的部件，并且将省去与以上元件有关的任何重复说明。
第一进位输出电路390可响应于第一节点N1的电压而将进位信号CR(i)控制为第一逻辑电平。在一个示例性实施方式中，第一进位输出电路390可包括第一进位晶体管M14。第一进位晶体管M14可包括连接至第一节点N1的栅电极、接收第一电源电压VGH的第一电极以及连接至进位信号CR(i)输出至的进位端子的第二电极。
第二进位输出电路395可响应于第三节点N3的电压而将进位信号CR(i)控制为第二逻辑电平。在一个示例性实施方式中，第二进位输出电路395可包括第二进位晶体管M15。第二进位晶体管M15可包括连接至第三节点N3的栅电极、接收第二电源电压VGL的第一电极以及连接至进位端子的第二电极。
级STGE可输出发射控制信号EM(i)和进位信号CR(i)。级STGE可向紧接后续级输出进位信号CR(i)作为输入信号而不是当前级的发射控制信号EM(i)或反馈信号，由此降低发射控制信号的上升时间和下降时间并且更稳定地输出发射控制信号EM(i)。在这种情况下，第一进位晶体管M14和第二进位晶体管M15的尺寸可小于第一输出晶体管M10和第二输出晶体管M9的尺寸，因为进位信号CR(i)用作下一级的输入信号或反馈信号。例如，第一进位输出晶体管M14和第二进位输出晶体管M15的宽度可大约为90微米。
稳定电路331可响应于第二节点N2的电压和第二时钟信号CLK2而稳定发射控制信号EM(i)。在一个示例性实施方式中，稳定电路331可包括第一稳定晶体管M2-1、第二稳定晶体管M2-2以及第三稳定晶体管M3。第一稳定晶体管M2-1可包括连接至第二节点N2的栅电极、接收第二电源电压VGL1的第一电极以及连接至第六节点N6的第二电极。第二稳定晶体管M2-2可包括连接至第二节点N2的栅电极、连接至第六节点N6的第一电极、以及第二电极。第三稳定晶体管M3可包括接收第二时钟信号CLK2的栅电极、连接至第二稳定晶体管M2-2的第二电极的第一电极以及连接至第一节点N1的第二电极。
第三漏电流阻挡电路383可响应于进位信号CR(i)而向第六节点N6施加进位信号CR(i)。在一个示例性实施方式中，第三漏电流阻挡电路383可包括第三阻挡晶体管M16。第三阻挡晶体管M16可包括连接至进位端子的栅电极、连接至进位端子的第一电极以及连接至第六节点N6的第二电极。
因此，稳定电路331包括彼此串联连接的多个晶体管。因此，当第一节点N1的电压对应于高电平电压时，稳定电路331可降低从第一节点N1流动至第二电源电压VGL1提供至的第二电力端子的漏电流。此外，当进位信号的电压对应于高电平电压时，第三漏电流阻挡电路383可将稳定电路331中的第六节点N6的电压设为高电平电压，以降低或防止漏电流从第一节点N1流动至第二电力端子。
第二保持电路356可响应于第一节点N1的电压而将第三节点N3的电压维持为第二逻辑电平。在一个示例性实施方式中，第二保持电路356可包括第一保持晶体管M8-1和第二保持晶体管M8-2。第一保持晶体管M8-1可包括连接至第一节点N1的栅电极、接收第二电源电压VGL的第一电极、以及第二电极。第二保持晶体管M8-2可包括连接至第一节点N1的栅电极、连接至第一保持晶体管M8-1的第二电极的第一电极以及连接至第三节点N3的第二电极。第二保持电路356包括彼此串联连接的两个晶体管，以降低当第三节点N3的电压对应于高电平时，从第三节点N3流动至第二电力端子的漏电流。
图15A和图15B是用于描述图14的级的效果的波形。
参考图15A和图15B，彼此串联连接的两个晶体管位于其中出现漏电流的稳定电路中，并且随后漏电流阻挡电路向两个晶体管之间的节点施加高电平电压，由此防止或降低漏电流。
如图15A所示，对于其中级不包括第三漏电流阻挡电路的情况，当晶体管的阈值电压小于或等于0V时，发射控制信号有波动或者发射控制信号被异常输出。因此，当晶体管的阈值电压在反方向上移动时，发射控制信号有波动或者发射控制信号被异常输出。因此，由显示设备显示的图像有斑点或者显示设备异常显示图像。
另一方面，如图15B所示，对于其中稳定电路包括彼此串联连接的两个晶体管并且漏电流阻挡电路向两个晶体管之间的第六节点施加高电平电压的情况，当晶体管的阈值电压大于或等于-4V时，发射控制信号被稳定输出。
图16是示出包括在图13的发射控制驱动器300E中的级的另一实例的电路图。
参考图16，发射控制驱动器的级STGF可包括第一输入电路310、第二输入电路315、第一输出电路320、第二输出电路327、稳定电路331、电压调整电路340、第一保持电路350、第二保持电路356、第一进位输出电路390、第二进位输出电路395以及第三漏电流阻挡电路384。根据本示例性实施方式的级STGF与在图14中描述的示例性实施方式的级STGE基本相同，除了第二输出电路327的结构以外。因此，相同参考标号将用于指代与在图14的先前示例性实施方式中描述的那些相同或相似的部件，并且将省去与以上元件有关的任何重复说明。
第二输出电路327可响应于第三节点N3的电压而将发射控制信号EM(i)控制为第二逻辑电平。在一个示例性实施方式中，第二输出电路327可包括第三输出晶体管M9-1和第四输出晶体管M9-2。第三输出晶体管M9-1可包括连接至第三节点N3的栅电极、接收第二电源电压VGL的第一电极以及连接至第八节点N8的第二电极。第四输出晶体管M9-2可包括连接至第三节点N3的栅电极、连接至第八节点N8的第一电极以及连接至发射控制信号EM(i)输出至的输出端子的第二电极。
第三漏电流阻挡电路384可响应于进位信号CR(i)而向第八节点N8施加进位信号CR(i)。在一个示例性实施方式中，第三漏电流阻挡电路384可包括第三阻挡晶体管M16。第三阻挡晶体管M16可包括连接至进位端子的栅电极、连接至进位端子的第一电极以及连接至第八节点N8(以及第六节点N6)的第二电极。
因此，当第三节点N3的电压对应于低电平电压并且发射控制信号的电压对应于高电平电压时，第三漏电流阻挡电路384可将第二输出电路327中的第八节点N8的电压设为高电平电压，以防止漏电流从输出端子流动至第二电源电压VGL提供至的第二电力端子。
图17是示出包括在图1的显示设备中的发射控制驱动器的又一实例的框图。
参考图17，发射控制驱动器300G可包括多个级STG1至STGn。级STG1至STGn中的每一个可输出发射控制信号。级STG1至STGn中的每一个可包括输入端子IN、第一时钟端子CT1、第二时钟端子CT2、第一电力端子VT1、第二电力端子VT2、第三电力端子VT3、输出端子OUT以及进位端子CARRY。根据本示例性实施方式的发射控制驱动器300G与在图13中描述的示例性实施方式的驱动器300E基本相同，除了添加第三电力端子VT3以外。因此，相同参考标号将用于指代与在图13的先前示例性实施方式中描述的那些相同或相似的部件，并且将省去与以上元件有关的任何重复说明。
对应于第一逻辑电平的第一电源电压VGH可提供至级STG1至STGn的第一电力端子VT1。例如，第一电源电压VGH可对应于高电平电压。对应于第二逻辑电平的第二电源电压VGL可提供至级STG1至STGn的第二电力端子VT2。例如，第二电源电压VGL1可对应于第一低电平。对应于第二逻辑电平的第三电源电压VGL2可提供至级STG1至STGn的第三电力端子VT3。例如，第三电源电压VGL2可与高于第一低电平的第二低电平相对应。
图18是示出包括在图17的发射控制驱动器中的级的一个实例的电路图。
参考图18，发射控制驱动器的级STGG可包括第一输入电路310、第二输入电路315、第一输出电路320、第二输出电路326、稳定电路331、电压调整电路340、第一保持电路350、第二保持电路356、第一进位输出电路390、第二进位输出电路395以及第三漏电流阻挡电路383。根据本示例性实施方式的级STGG与在图14中描述的示例性实施方式的级STGE基本相同，除了第二输出电路326连接至第三电源电压VGL2提供至的第三电力端子以外。因此，相同参考标号将用于指代与在图14的先前示例性实施方式中描述的那些相同或相似的部件，并且将省去与以上元件有关的任何重复说明。
级STGG可接收都与第二逻辑电平相对应的第二电源电压VGL1和第三电源电压VGL2以防止漏电流。在一个示例性实施方式中，第三电源电压VGL2可高于第二电源电压VGL1。因此，稳定电路331和第二保持电路356可将第一节点N1和第三节点N3的电压设为第二电源电压VGL1(即，第一低电平)。相对地，第二输出电路326可将发射控制信号EM(i)设为第三电源电压VGL2(即，第二低电平)。因此，当第二电源电压VGL1(即，第一低电平)施加至第一输出晶体管M10的栅电极时，高于第二电源电压VGL1的第三电源电压VGL2(即，第二低电平)施加至第一输出晶体管M10的第二电极。因此，从第一电极流动至第一输出晶体管M10的第二电极的漏电流可降低。此外，当第二电源电压VGL1施加至第二输出晶体管M9的栅电极时，大于第二电源电压VGL1的第三电源电压VGL2施加至第二输出晶体管M9的第一电极。因此，从第二电极流动至第二输出晶体管M9的第一电极的漏电流可降低。
在一个示例性实施方式中，第一输出晶体管M10的第一宽长比可小于第二输出晶体管M9的第二宽长比。由于以上描述了第一输出晶体管M10和第二输出晶体管M9的尺寸，所以将省略冗余描述。
图19A和图19B是用于描述图18的级的效果的波形。
参考图19A和图19B，彼此串联连接的两个晶体管位于其中出现漏电流的稳定电路中，并且随后漏电流阻挡电路向两个晶体管之间的节点施加高电平进位信号，由此防止或降低漏电流。
如图19A所示，对于其中级不包括第三漏电流阻挡电路的情况，当晶体管的阈值电压小于或等于-1V时，发射控制信号有波动或者发射控制信号被异常输出。
另一方面，如图19B所示，对于其中稳定电路包括彼此串联连接的两个晶体管并且漏电流阻挡电路向两个晶体管之间的节点施加高电平电压的情况，当晶体管的阈值电压大于或等于-3V时，发射控制信号被稳定输出。因此，如[表3]所示，当晶体管的阈值电压大于或等于-2V时，发射控制信号被稳定输出。
[表3]
Figure BDA0001256842540000301
此处，REF表示不包括漏电流阻挡电路的级，STGG表示在图18中描述的级，Vth表示级中的晶体管的阈值电压，EM High表示高电平电压的发射控制信号，并且EM Low表示低电平电压的发射控制信号。
图20是示出包括在图17的发射控制驱动器中的级的另一实例的电路图。
参考图20，发射控制驱动器的级STGH可包括第一输入电路310、第二输入电路315、第一输出电路320、第二输出电路326、稳定电路331、电压调整电路340、第一保持电路350、第二保持电路356、第一进位输出电路390、第二进位输出电路395、第二漏电流阻挡电路382以及第三漏电流阻挡电路383。根据本示例性实施方式的级STGH与在图18中描述的示例性实施方式的级STGG基本相同，除了添加第二漏电流阻挡电路382以外。因此，相同参考标号将用于指代与在图18的先前示例性实施方式中描述的那些相同或相似的部件，并且将省去与以上元件有关的任何重复说明。
第二漏电流阻挡电路382可响应于第三节点N3的电压而将第七节点N7的电压控制为第一逻辑电平。在一个示例性实施方式中，第二漏电流阻挡电路382可包括第二阻挡晶体管M12。第二阻挡晶体管M12可包括连接至第三节点N3的栅电极、接收第一电源电压VGH的第一电极以及连接至第七节点N7的第二电极。当第三节点N3的电压对应于高电平电压时，第二漏电流阻挡电路382可将第二保持电路356中的第七节点N7的电压设为高电平电压以防止漏电流从第三节点N3流动至第二电力端子VGL2。
尽管已参考图描述了根据示例性实施方式的发射控制驱动器以及具有该发射控制驱动器的显示设备，但是本领域技术人员将容易了解，在本质上不偏离本发明构思的新颖教导和优势的情况下，可对示例性实施方式进行多种修改。例如，尽管示例性实施方式描述了每一级包括n沟道金属氧化物半导体(NMOS)类型的晶体管，但是各种实施方式不限于该类型的晶体管。例如，每一级可代替地包括p沟道金属氧化物半导体(PMOS)类型的晶体管。
本发明构思可应用至具有显示设备的电子设备。例如，本发明构思可应用至蜂窝电话、智能电话、智能平板电脑、个人数字助理(PDA)等。
以上是对示例性实施方式的说明，而不应解释为限制性的。尽管已描述了几个示例性实施方式，但本领域技术人员将容易理解，在本质上不背离本发明构思的新颖教导和优点的前提下，可对示例性实施方式进行多种修改。因此，所有这种修改旨在包括在由权利要求所限定的本发明构思的范围内。因此，应理解，上述是各种示例性实施方式的说明，且不被解释为限于所公开的具体示例性实施方式，并且对所公开的示例性实施方式以及其他示例性实施方式的修改旨在包括在所附权利要求的范围内。因此，以上描述的实施方式以及其他实施方式的各种特征能以任何方式混合和匹配，以得到与本发明相符的另外的实施方式。

Claims (30)

1.一种发射控制驱动器，包括被配置为分别输出多个发射控制信号的多个级，其中，每一级包括：
输入电路，被配置为接收来自先前级中的一个的先前发射控制信号或接收垂直启动信号，并且被配置为响应于第一时钟信号而控制第一节点的电压和第二节点的电压；
稳定电路，被配置为响应于所述第二节点的电压以及第二时钟信号而稳定所述第一节点的电压；
电压调整电路，连接在所述第二节点与第三节点之间，所述电压调整电路被配置为对所述第二节点的电压升压并且被配置为控制所述第二节点的升压电压；以及
输出电路，被配置为响应于所述第一节点的电压以及所述第三节点的电压而控制发射控制信号，并且
其中，所述电压调整电路包括：
节点晶体管，包括被配置为接收第一电源电压的栅电极、连接至所述第二节点的第一电极以及连接至第四节点的第二电极；
第一电压调整晶体管，包括连接至所述第四节点的栅电极、被配置为接收第三时钟信号的第一电极以及连接至第五节点的第二电极；
电压调整电容器，包括连接至所述第四节点的第一电极以及连接至所述第五节点的第二电极；以及
第二电压调整晶体管，包括被配置为接收所述第二时钟信号的栅电极、连接至所述第五节点的第一电极以及连接至所述第三节点的第二电极。
2.根据权利要求1所述的发射控制驱动器，其中，所述第三时钟信号的对应于第一逻辑电平的电压低于所述第二时钟信号的对应于所述第一逻辑电平的电压。
3.根据权利要求1所述的发射控制驱动器，其中，每一级进一步包括：
负载降低电路，包括节点电容器，所述节点电容器具有被配置为接收所述第一时钟信号的第一电极以及连接至所述第二节点的第二电极。
4.根据权利要求1所述的发射控制驱动器，其中，所述稳定电路包括：
第一稳定晶体管，包括连接至所述第二节点的栅电极、被配置为接收第二电源电压的第一电极以及连接至第六节点的第二电极；
第二稳定晶体管，包括连接至所述第二节点的栅电极、连接至所述第六节点的第一电极、以及第二电极；以及
第三稳定晶体管，包括被配置为接收所述第二时钟信号的栅电极、连接至所述第二稳定晶体管的所述第二电极的第一电极以及连接至所述第一节点的第二电极，
其中，每一级进一步包括：
第一漏电流阻挡电路，被配置为响应于所述第一节点的电压而将所述第六节点的电压控制为第一逻辑电平。
5.根据权利要求1所述的发射控制驱动器，其中，所述输出电路包括：
第一输出电路，被配置为响应于所述第一节点的电压而将所述发射控制信号控制为第一逻辑电平；以及
第二输出电路，被配置为响应于所述第三节点的电压而将所述发射控制信号控制为第二逻辑电平，
其中，每一级进一步包括：
第一保持电路，被配置为响应于所述第一时钟信号而使所述第二节点的电压维持处于所述第一逻辑电平；以及
第二保持电路，被配置为响应于所述第一节点的电压而使所述第三节点的电压维持处于所述第二逻辑电平，并且
其中，所述第二保持电路包括：
第一保持晶体管，包括连接至所述第一节点的栅电极、被配置为接收第二电源电压的第一电极以及连接至第七节点的第二电极；以及
第二保持晶体管，包括连接至所述第一节点的栅电极、连接至所述第七节点的第一电极以及连接至所述第三节点的第二电极。
6.根据权利要求5所述的发射控制驱动器，其中，每一级进一步包括：
第二漏电流阻挡电路，被配置为响应于所述第三节点的电压而将所述第七节点的电压控制为所述第一逻辑电平。
7.根据权利要求5所述的发射控制驱动器，其中，所述第一输出电路包括：第一输出晶体管，所述第一输出晶体管包括连接至所述第一节点的栅电极、被配置为接收第一电源电压的第一电极以及连接至所述发射控制信号输出至的输出端子的第二电极，并且
其中，所述第二输出电路包括第二输出晶体管，所述第二输出晶体管包括连接至所述第三节点的栅电极、被配置为接收第三电源电压的第一电极以及连接至所述输出端子的第二电极，
其中，所述第三电源电压高于所述第二电源电压，并且
其中，所述第一输出晶体管的第一宽长比小于所述第二输出晶体管的第二宽长比。
8.一种发射控制驱动器，包括被配置为输出多个发射控制信号和多个进位信号的多个级，其中，每一级包括：
输入电路，被配置为接收来自先前级中的一个的先前进位信号或接收垂直启动信号，并且被配置为响应于第一时钟信号而控制第一节点的电压和第二节点的电压；
稳定电路，被配置为响应于所述第二节点的电压以及第二时钟信号而稳定所述第一节点的电压；
电压调整电路，连接在所述第二节点与第三节点之间，所述电压调整电路被配置为对所述第二节点的电压升压，并且被配置为控制所述第二节点的升压电压；
输出电路，被配置为响应于所述第一节点的电压以及所述第三节点的电压而控制发射控制信号；以及
进位输出电路，被配置为响应于所述第一节点的电压以及所述第三节点的电压而控制进位信号，并且
其中，所述电压调整电路包括：
节点晶体管，包括被配置为接收第一电源电压的栅电极、连接至所述第二节点的第一电极以及连接至第四节点的第二电极；
第一电压调整晶体管，包括连接至所述第四节点的栅电极、被配置为接收第三时钟信号的第一电极以及连接至第五节点的第二电极；
电压调整电容器，包括连接至所述第四节点的第一电极以及连接至所述第五节点的第二电极；以及
第二电压调整晶体管，包括被配置为接收所述第二时钟信号的栅电极、连接至所述第五节点的第一电极以及连接至所述第三节点的第二电极。
9.一种发射控制驱动器，包括被配置为分别输出多个发射控制信号的多个级，其中，每一级包括：
输入电路，被配置为接收来自先前级中的一个的先前发射控制信号或接收垂直启动信号，并且被配置为响应于第一时钟信号而控制第一节点的电压和第二节点的电压；
稳定电路，被配置为响应于所述第二节点的电压以及第二时钟信号而稳定所述第一节点的电压；
电压调整电路，连接在所述第二节点与第三节点之间，所述电压调整电路被配置为对所述第二节点的电压升压并且被配置为控制所述第二节点的升压电压；以及
输出电路，被配置为响应于所述第一节点的电压以及所述第三节点的电压而控制发射控制信号，
其中，所述电压调整电路包括：
节点晶体管，包括被配置为接收第一电源电压的栅电极、连接至所述第二节点的第一电极以及连接至第四节点的第二电极；
第一电压调整晶体管，包括连接至所述第四节点的栅电极、被配置为接收第三时钟信号的第一电极以及连接至第五节点的第二电极；
电压调整电容器，包括连接至所述第四节点的第一电极以及连接至所述第五节点的第二电极；以及
第二电压调整晶体管，包括被配置为接收所述第二时钟信号的栅电极、连接至所述第五节点的第一电极以及连接至所述第三节点的第二电极，并且
其中，所述输入电路包括：
第一输入电路，被配置为响应于所述第一时钟信号而向所述第一节点施加所述先前发射控制信号或所述垂直启动信号；以及
第二输入电路，被配置为响应于所述第一节点的电压而向所述第二节点施加所述第一时钟信号。
10.根据权利要求9所述的发射控制驱动器，其中，所述第三时钟信号与所述第二时钟信号相同。
11.根据权利要求9所述的发射控制驱动器，其中，所述第三时钟信号的对应于第一逻辑电平的电压低于所述第二时钟信号的对应于所述第一逻辑电平的电压。
12.根据权利要求9所述的发射控制驱动器，其中，所述稳定电路包括：
第一稳定晶体管，包括连接至所述第二节点的栅电极、被配置为接收第二电源电压的第一电极以及连接至第六节点的第二电极；
第二稳定晶体管，包括连接至所述第二节点的栅电极、连接至所述第六节点的第一电极、以及第二电极；以及
第三稳定晶体管，包括被配置为接收所述第二时钟信号的栅电极、连接至所述第二稳定晶体管的所述第二电极的第一电极以及连接至所述第一节点的第二电极。
13.根据权利要求12所述的发射控制驱动器，其中，每一级进一步包括：
第一漏电流阻挡电路，被配置为响应于所述第一节点的电压而将所述第六节点的电压控制为第一逻辑电平。
14.根据权利要求9所述的发射控制驱动器，其中，所述输出电路包括：
第一输出电路，被配置为响应于所述第一节点的电压而将所述发射控制信号控制为第一逻辑电平；以及
第二输出电路，被配置为响应于所述第三节点的电压而将所述发射控制信号控制为第二逻辑电平。
15.根据权利要求14所述的发射控制驱动器，其中，每一级进一步包括：
第一保持电路，被配置为响应于所述第一时钟信号而使所述第二节点的电压维持处于所述第一逻辑电平；以及
第二保持电路，被配置为响应于所述第一节点的电压而使所述第三节点的电压维持处于所述第二逻辑电平。
16.根据权利要求15所述的发射控制驱动器，其中，所述第二保持电路包括：
第一保持晶体管，包括连接至所述第一节点的栅电极、被配置为接收第二电源电压的第一电极以及连接至第七节点的第二电极；以及
第二保持晶体管，包括连接至所述第一节点的栅电极、连接至所述第七节点的第一电极以及连接至所述第三节点的第二电极。
17.根据权利要求16所述的发射控制驱动器，其中，每一级进一步包括：
第二漏电流阻挡电路，被配置为响应于所述第三节点的电压而将所述第七节点的电压控制为所述第一逻辑电平。
18.根据权利要求16所述的发射控制驱动器，其中，所述第一输出电路包括第一输出晶体管，所述第一输出晶体管包括连接至所述第一节点的栅电极、被配置为接收所述第一电源电压的第一电极以及连接至所述发射控制信号输出至的输出端子的第二电极，并且
其中，所述第二输出电路包括第二输出晶体管，所述第二输出晶体管包括连接至所述第三节点的栅电极、被配置为接收第三电源电压的第一电极以及连接至所述输出端子的第二电极。
19.根据权利要求18所述的发射控制驱动器，其中，所述第三电源电压高于所述第二电源电压。
20.根据权利要求18所述的发射控制驱动器，其中，所述第一输出晶体管的第一宽长比小于所述第二输出晶体管的第二宽长比。
21.一种发射控制驱动器，包括被配置为分别输出多个发射控制信号的多个级，其中，每一级包括：
输入电路，被配置为接收来自先前级中的一个的先前发射控制信号或接收垂直启动信号，并且被配置为响应于第一时钟信号而控制第一节点的电压和第二节点的电压；
稳定电路，被配置为响应于所述第二节点的电压以及第二时钟信号而稳定所述第一节点的电压；
电压调整电路，连接在所述第二节点与第三节点之间，所述电压调整电路被配置为对所述第二节点的电压升压并且被配置为控制所述第二节点的升压电压；以及
输出电路，被配置为响应于所述第一节点的电压以及所述第三节点的电压而控制发射控制信号，并且
其中，所述电压调整电路包括：
第一电压调整晶体管，包括连接至所述第二节点的栅电极、被配置为接收第三时钟信号的第一电极以及连接至第五节点的第二电极；
电压调整电容器，包括连接至所述第二节点的第一电极以及连接至所述第五节点的第二电极；以及
第二电压调整晶体管，包括被配置为接收所述第二时钟信号的栅电极、连接至所述第五节点的第一电极以及连接至所述第三节点的第二电极。
22.根据权利要求21所述的发射控制驱动器，其中，所述第三时钟信号的对应于第一逻辑电平的电压低于所述第二时钟信号的对应于所述第一逻辑电平的电压。
23.根据权利要求21所述的发射控制驱动器，其中，每一级进一步包括：
负载降低电路，包括节点电容器，所述节点电容器具有被配置为接收所述第一时钟信号的第一电极以及连接至所述第二节点的第二电极。
24.一种发射控制驱动器，包括被配置为输出多个发射控制信号和多个进位信号的多个级，其中，每一级包括：
输入电路，被配置为接收来自先前级中的一个的先前进位信号或接收垂直启动信号，并且被配置为响应于第一时钟信号而控制第一节点的电压和第二节点的电压；
稳定电路，被配置为响应于所述第二节点的电压以及第二时钟信号而稳定所述第一节点的电压；
电压调整电路，连接在所述第二节点与第三节点之间，所述电压调整电路被配置为对所述第二节点的电压升压，并且被配置为控制所述第二节点的升压电压；
输出电路，被配置为响应于所述第一节点的电压以及所述第三节点的电压而控制发射控制信号；以及
进位输出电路，被配置为响应于所述第一节点的电压以及所述第三节点的电压而控制进位信号，
其中，所述稳定电路包括：
第一稳定晶体管，包括连接至所述第二节点的栅电极、被配置为接收第二电源电压的第一电极以及连接至第六节点的第二电极；
第二稳定晶体管，包括连接至所述第二节点的栅电极、连接至所述第六节点的第一电极、以及第二电极；以及
第三稳定晶体管，包括被配置为接收所述第二时钟信号的栅电极、连接至所述第二稳定晶体管的所述第二电极的第一电极以及连接至所述第一节点的第二电极，
其中，每一级进一步包括：
第三漏电流阻挡电路，被配置为响应于所述进位信号而向所述第六节点施加所述进位信号，并且
其中，所述电压调整电路包括：
节点晶体管，包括被配置为接收第一电源电压的栅电极、连接至所述第二节点的第一电极以及连接至第四节点的第二电极；
第一电压调整晶体管，包括连接至所述第四节点的栅电极、被配置为接收第三时钟信号的第一电极以及连接至第五节点的第二电极；
电压调整电容器，包括连接至所述第四节点的第一电极以及连接至所述第五节点的第二电极；以及
第二电压调整晶体管，包括被配置为接收所述第二时钟信号的栅电极、连接至所述第五节点的第一电极以及连接至所述第三节点的第二电极。
25.根据权利要求24所述的发射控制驱动器，其中，所述进位输出电路包括：
第一进位输出电路，被配置为响应于所述第一节点的电压而将所述进位信号控制为第一逻辑电平；以及
第二进位输出电路，被配置为响应于所述第三节点的电压而将所述进位信号控制为第二逻辑电平。
26.根据权利要求24所述的发射控制驱动器，其中，所述输出电路包括：
第一输出电路，被配置为响应于所述第一节点的电压而将所述发射控制信号控制为第一逻辑电平；以及
第二输出电路，被配置为响应于所述第三节点的电压而将所述发射控制信号控制为第二逻辑电平，
其中，所述第二输出电路包括：
第三输出晶体管，包括连接至所述第三节点的栅电极、接收所述第二电源电压的第一电极以及连接至第八节点的第二电极；以及
第四输出晶体管，包括连接至所述第三节点的栅电极、连接至所述第八节点的第一电极以及连接至所述发射控制信号输出至的输出端子的第二电极。
27.根据权利要求26所述的发射控制驱动器，其中，
所述第三漏电流阻挡电路进一步被配置为响应于所述进位信号而向所述第八节点施加所述进位信号。
28.一种显示设备，包括：
显示面板，包括多条扫描线、多条发射控制线、多条数据线以及多个像素；
数据驱动器，被配置为经由所述数据线向所述像素提供数据信号；
扫描驱动器，被配置为经由所述扫描线向所述像素提供扫描信号；
发射控制驱动器，包括多个级，所述多个级被配置为分别输出多个发射控制信号并且被配置为经由所述发射控制线向所述像素提供所述发射控制信号；以及
控制器，被配置为控制所述数据驱动器、所述扫描驱动器和所述发射控制驱动器，
其中，所述发射控制驱动器的每一级包括：
输入电路，被配置为接收来自先前级中的一个的先前发射控制信号或接收垂直启动信号，并且被配置为响应于第一时钟信号而控制第一节点的电压和第二节点的电压；
稳定电路，被配置为响应于所述第二节点的电压以及第二时钟信号而稳定所述第一节点的电压；
电压调整电路，连接在所述第二节点与第三节点之间，所述电压调整电路被配置为对所述第二节点的电压升压，并且被配置为控制所述第二节点的升压电压；以及
输出电路，被配置为响应于所述第一节点的电压和所述第三节点的电压而控制发射控制信号，并且
其中，所述电压调整电路包括：
节点晶体管，包括被配置为接收第一电源电压的栅电极、连接至所述第二节点的第一电极以及连接至第四节点的第二电极；
第一电压调整晶体管，包括连接至所述第四节点的栅电极、被配置为接收第三时钟信号的第一电极以及连接至第五节点的第二电极；
电压调整电容器，包括连接至所述第四节点的第一电极以及连接至所述第五节点的第二电极；以及
第二电压调整晶体管，包括被配置为接收所述第二时钟信号的栅电极、连接至所述第五节点的第一电极以及连接至所述第三节点的第二电极。
29.根据权利要求28所述的显示设备，其中，所述第三时钟信号的对应于第一逻辑电平的电压低于所述第二时钟信号的对应于所述第一逻辑电平的电压。
30.根据权利要求28所述的显示设备，其中，所述控制器被配置为感测通过所述发射控制驱动器的电力端子流动的电流的大小，并且基于感测的大小调整所述第三时钟信号的电压。
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