CN105632560A - 移位寄存器单元、驱动方法、栅极驱动电路及显示装置 - Google Patents

移位寄存器单元、驱动方法、栅极驱动电路及显示装置 Download PDF

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Abstract

本发明公开了一种移位寄存器单元、驱动方法、栅极驱动电路及显示装置，属于显示技术领域。该移位寄存器单元包括：控制模块、第一输出模块和第二输出模块，该第一输出模块分别与第一信号端、第一节点和输出端连接；该第二输出模块分别与该输出端、第二节点和第一时钟信号端连接；该控制模块分别与该第一节点、该第二节点、该第一信号端、第二信号端、第二时钟信号端、第三时钟信号端、输入信号端和复位信号端连接，用于控制该第一节点和该第二节点的电位。本发明公开的移位寄存单元解决了相关技术中移位寄存器单元的电路结构复杂，控制过程较为繁琐的问题，达到了电路结构简单且输出端输出电压稳定的效果。本发明用于显示图像。

Description

移位寄存器单元、驱动方法、栅极驱动电路及显示装置
技术领域
本发明涉及显示技术领域，特别涉及一种移位寄存器单元、驱动方法、栅极驱动电路及显示装置。
背景技术
显示装置在显示图像时，需要利用移位寄存器对像素单元进行扫描，移位寄存器包括多个移位寄存单元，每个移位寄存单元对应一行像素单元，由多个移位寄存器单元实现对显示装置的像素单元的逐行扫描驱动，以显示图像。
但随着像素数目的提高，移位寄存器(栅极开关电路)在一帧时间内所需扫描的行数增加，这就要求移位寄存器单元的版图面积要更小，电路结构需要更简单。相关技术中有一种移位寄存器单元，它通常通过多个晶体管和电容器来控制电路输出信号的电位的高低。
但是，由于每个移位寄存器单元的电路结构通常较为复杂，控制过程较为繁琐，电路输出信号的波形的稳定性较低。
发明内容
为了解决相关技术中移位寄存器单元电路结构较为复杂的问题，本发明实施例提供了一种移位寄存器单元、驱动方法、栅极驱动电路及显示装置。所述技术方案如下：
第一方面，提供了一种移位寄存器单元，所述移位寄存器单元包括：
控制模块、第一输出模块和第二输出模块，
所述第一输出模块分别与第一信号端、第一节点和输出端连接，用于在所述第一节点的控制下，向所述输出端输入来自所述第一信号端的第一控制信号；
所述第二输出模块分别与所述输出端、第二节点和第一时钟信号端连接，用于在所述第二节点的控制下，向所述输出端输入来自所述第一时钟信号端的第一时钟信号；
所述控制模块分别与所述第一节点、所述第二节点、所述第一信号端、第二信号端、第二时钟信号端、第三时钟信号端、输入信号端和复位信号端连接，用于在来自所述第一信号端的所述第一控制信号、所述第二信号端的第二控制信号、所述第二时钟信号端的第二时钟信号、所述第三时钟信号端的第三时钟信号、所述输入信号端的输入控制信号和所述复位信号端的复位信号的控制下，控制所述第一节点和所述第二节点的电位。
可选的，所述控制模块，包括：第一控制子模块、第二控制子模块、复位子模块、上拉子模块和分压子模块；
所述第一控制子模块分别与所述输入信号端、所述第二时钟信号端、所述第二信号端和第三节点连接，用于在来自所述输入信号端的所述输入控制信号和所述第二时钟信号端的所述第二时钟信号的控制下，向所述第三节点输入所述第二信号端的所述第二控制信号；
所述第二控制子模块分别与所述第三时钟信号端、所述第一信号端、所述第二信号端、所述第一节点和所述第三节点连接，用于在来自所述第三时钟信号端的所述第三时钟信号的控制下，向所述第一节点输入所述第二信号端的所述第二控制信号，向所述第三节点输入所述第一信号端的所述第一控制信号；
所述复位子模块分别与所述复位信号端、所述第一信号端和所述第三节点连接，用于在来自所述复位信号端的所述复位信号的控制下，向所述第三节点输入所述第一信号端的所述第一控制信号；
所述上拉子模块分别与所述第三节点、所述第一信号端、所述输入信号端和所述第一节点连接，用于在来自所述输入信号端的所述输入控制信号和所述第三节点的控制下，向所述第一节点输入所述第一信号端的所述第一控制信号；
所述分压子模块分别与所述第二信号端、所述第三节点和所述第二节点连接，用于在来自所述第二信号端的所述第二控制信号的控制下，向所述第二节点输入所述第三节点的电位。
可选的，所述第一控制子模块包括：第一晶体管和第二晶体管；
所述第一晶体管的第一极与所述第二信号端连接，所述第一晶体管的第二极与所述第二晶体管的第一级连接，所述第一晶体管的第三极与所述输入信号端连接；
所述第二晶体管的第一极与所述第一晶体管的第二极连接，所述第二晶体管的第二极与所述第三节点连接，所述第二晶体管的第三极与所述第二时钟信号端连接。
可选的，所述第二控制子模块包括：第三晶体管和第四晶体管；
所述第三晶体管的第一极与所述第二信号端连接，所述第三晶体管的第二极分别与所述第一节点和所述第四晶体管的第三极连接，所述第三晶体管的第三极与所述第三时钟信号端连接。
所述第四晶体管的第一极与所述第一信号端连接，所述第四晶体管的第二极与所述第三节点连接，所述第四晶体管的第三极与所述第三晶体管的第二极连接。
可选的，所述复位子模块包括：第五晶体管；
所述第五晶体管的第一极与所述第一信号端连接，所述第五晶体管的第二极与所述第三节点连接，所述第五晶体管的第三极与所述复位信号端连接。
可选的，所述上拉子模块包括：第六晶体管和第七晶体管；
所述第六晶体管的第一极与所述第一信号端连接，所述第六晶体管的第二极与所述第一节点连接，所述第六晶体管的第三极与所述输入信号端连接；
所述第七晶体管的第一极与所述第一信号端连接，所述第七晶体管的第二极与所述第一节点连接，所述第七晶体管的第三极与所述第三节点连接。
可选的，所述分压子模块包括：第八晶体管；
所述第八晶体管的第一极与所述第三节点连接，所述第八晶体管的第二极与所述第二节点连接，所述第八晶体管的第三极与所述第二信号端连接。
可选的，所述第一输出模块包括：第九晶体管和第一电容器；
所述第九晶体管的第一极与所述第一信号端连接，所述第九晶体管的第二极与所述输出端连接，所述第九晶体管的第三极与所述第一节点连接；
所述第一电容器的第一极与所述第九晶体管的第一极连接，所述第一电容器的第二极与所述第九晶体管的第三极连接。
可选的，所述第二输出模块包括：第十晶体管和第二电容器；
所述第十晶体管的第一极与所述第一时钟信号端连接，所述第十晶体管的第二极与所述输出端连接，所述第十晶体管的第三极与所述第二节点连接；
所述第二电容器的第一极与所述第十晶体管的第二极连接，所述第二电容器的第二极与所述第十晶体管的第三极连接。
可选的，所述晶体管均为P型晶体管。
第二方面，提供了一种移位寄存器单元驱动方法，用于驱动第一方面任一所述的移位寄存器单元，所述移位寄存器单元包括：第一输出模块、第二输出模块和控制模块，所述方法包括：
第一阶段：复位信号端输入的复位信号为第二电位，所述控制模块向第二节点输入来自第一信号端的第一控制信号，所述第一控制信号为第一电位；
第二阶段：第一时钟信号端输入的第一时钟信号为第一电位，输入信号端输入的输入控制信号为第二电位，第二时钟信号端输入的第二时钟信号为第二电位，控制所述控制模块向第一节点输入所述第一控制信号，向第二节点输入来自第二信号端的第二控制信号，所述第二控制信号为第二电位，在所述第二节点的控制下，所述第二输出模块向输出端输入来自所述第一时钟信号端的所述第一时钟信号；
第三阶段：所述第二节点保持第二电位，所述第一时钟信号端输入的所述第一时钟信号为第二电位，在所述第二节点的控制下，所述第二输出模块向输出端输入所述第一时钟信号；
第四阶段：第三时钟信号端输入的第三时钟信号为第二电位，所述控制模块在来自所述第三时钟信号端的所述第三时钟信号的控制下向所述第一节点输入来自所述第二信号端的所述第二控制信号，在所述第一节点的控制下，所述第一输出模块向所述输出端输入来自所述第一信号端的所述第一控制信号。
可选的，所述控制模块，包括：第一控制子模块、第二控制子模块、复位子模块、上拉子模块和分压子模块；
所述第二阶段中，所述第二时钟信号端输入的所述第二时钟信号为第二电位，所述输入信号端输入的所述输入控制信号为第二电位，控制所述第一控制子模块向第三节点输入来自所述第二信号端的所述第二控制信号；
所述第四阶段中，所述第三时钟信号端输入的所述第三时钟信号为第二电位，控制所述第二控制子模块向所述第一节点输入来自所述第二信号端的所述第二控制信号，向所述第三节点输入来自所述第一信号端的所述第一控制信号；
所述第一阶段中，所述复位信号端输入的所述复位信号为第二电位，控制所述复位子模块向所述第二节点输入所述第一控制信号；
所述第二阶段中，所述输入信号端输入的所述输入控制信号为第二电位，所述第三节点为第二电位，控制所述上拉子模块向所述第一节点输入来自所述第一信号端的所述第一控制信号；
所述第一至第四阶段中，所述第二信号端的所述第二控制信号为第二电位，控制所述分压子模块向所述第二节点输入所述第三节点的电位。
可选的，所述第一控制子模块包括：第一晶体管和第二晶体管；
所述第二阶段中，所述第二时钟信号端输入的所述第二时钟信号为第二电位，所述输入信号端输入的所述输入控制信号为第二电位，所述第一晶体管和所述第二晶体管开启，所述第二信号端向所述第三节点输入所述第二控制信号。
可选的，所述第二控制子模块包括：第三晶体管和第四晶体管；
所述第四阶段中，所述第三时钟信号端输入的第三时钟信号为第二电位，所述第三晶体管开启，所述第二信号端分别向所述第一节点和所述第四晶体管的第三极输入所述第二控制信号，所述第二控制信号为第二电位，所述第四晶体管开启，所述第一信号端向所述第三节点输入所述第一控制信号。
可选的，所述复位子模块包括：第五晶体管；
所述第一阶段中，所述复位信号端输入的所述复位信号为第二电位，所述第五晶体管开启，所述第一信号端向所述第三节点输入所述第一控制信号。
可选的，所述上拉子模块包括：第六晶体管和第七晶体管；
所述第二阶段中，所述输入信号端输入的所述输入控制信号为第二电位，所述第三节点为第二电位，所述第六晶体管和所述第七晶体管开启，所述第一信号端向所述第一节点输入所述第一控制信号。
可选的，所述分压子模块包括：第八晶体管；
所述第一至第四阶段中，所述第二信号端的所述第二控制信号为第二电位，所述第八晶体管开启，所述第三节点向所述第二节点输入所述第三节点的电位。
可选的，所述第一输出模块包括：第九晶体管和第一电容器；
所述第四阶段中，所述控制模块向所述第一节点输入来自所述第二信号端的所述第二控制信号，所述第二控制信号为第二电位，所述第九晶体管开启，所述第九晶体管向所述输出端输入来自所述第一信号端的所述第一控制信号；
所述第二阶段中，所述控制模块向所述第一节点输入来自所述第一信号端的所述第一控制信号，所述第九晶体管关断。
可选的，所述第二输出模块包括：第十晶体管和第二电容器；
所述第一阶段中，所述控制模块向所述第二节点输入所述第一控制信号，所述第一控制信号为第一电位，所述第十晶体管关断；
所述第二阶段中，所述控制模块向第二节点输入来自第二信号端的第二控制信号，所述第二控制信号为第二电位，所述第十晶体管开启，所述第十晶体管向所述输出端输入来自所述第一时钟信号端的所述第一时钟信号；
所述第三阶段中，所述第二节点保持第二电位，所述第十晶体管开启，所述第十晶体管向所述输出端输入来自所述第一时钟信号端的所述第一时钟信号。
可选的，所述晶体管均为P型晶体管。
可选的，所述第一电位相对于所述第二电位为高电位。
第三方面，提供了一种栅极驱动电路，该栅极驱动电路包括至少两个级联的如第一方面任一所述的移位寄存器单元。
第四方面，提供了一种显示装置，该显示装置包括第三方面所述的栅极驱动电路。
本发明实施例提供的技术方案带来的有益效果是：
本发明实施例提供了一种移位寄存器单元、驱动方法、栅极驱动电路及显示装置，该移位寄存器单元包括：控制模块、第一输出模块和第二输出模块，通过该控制模块、第一输出模块和第二输出模块来控制输出端输出的电位高低，解决了相关技术中移位寄存器单元的电路结构通常较为复杂，控制过程较为繁琐的问题，达到了电路结构简单且输出端输出电压稳定的效果。
附图说明
为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是本发明实施例提供的一种移位寄存器单元的结构示意图；
图2是本发明实施例提供的另一种移位寄存器单元的结构示意图；
图3是本发明实施例提供的又一种移位寄存器单元的结构示意图；
图4是本发明实施例提供的一种移位寄存器单元的驱动方法的流程图；
图5是本发明各个实施例中的第一时钟信号端、第二时钟信号端、第三时钟信号端、信号输入端、复位信号端和输出端的电位变化示意图。
具体实施方式
为使本发明的目的、技术方案和优点更加清楚，下面将结合附图对本发明实施方式作进一步地详细描述。
本发明所有实施例中采用的晶体管均可以为薄膜晶体管或场效应管或其他特性相同的器件，根据在电路中的作用本发明的实施例所采用的晶体管主要为开关晶体管。由于这里采用的开关晶体管的源极、漏极是对称的，所以其源极、漏极是可以互换的。在本发明实施例中，将其中源极称为第一级，漏极称为第二级，栅极称为第三极。按附图中的形态规定晶体管的中间端为栅极、信号输入端为源极、信号输出端为漏极。此外，本发明实施例所采用的开关晶体管包括P型开关晶体管和N型开关晶体管两种，其中，P型开关晶体管在栅极为低电平时导通，在栅极为高电平时截止，N型开关晶体管为在栅极为高电平时导通，在栅极为低电平时截止。此外，本发明各个实施例中的多个信号都对应有第一电位和第二电位。第一电位和第二电位仅代表该信号的电位有2个状态量。不代表全文中第一电位或第二电位具有特定的数值。第一控制信号可以为高电位信号，第二控制信号可以为低电位信号。
图1是本发明实施例提供的一种移位寄存器单元的结构示意图。该移位寄存器单元可以包括：控制模块110、第一输出模块120和第二输出模块130，
该第一输出模块120分别与第一信号端VGH、第一节点A和输出端OUT连接，用于在该第一节点A的控制下，向该输出端OUT输出来自该第一信号端VGH的第一控制信号。
该第二输出模块130分别与该输出端OUT、第二节点B和第一时钟信号端CK1连接，用于在该第二节点B的控制下，向该输出端OUT输出来自该第一时钟信号端CK1的第一时钟信号。
该控制模块110分别与该第一节点A、该第二节点B、该第一信号端VGH、第二信号端VGL、第二时钟信号端CK2、第三时钟信号端CK3、输入信号端IN和复位信号端RST连接，用于在来自该第一信号端VGH的第一控制信号、该第二信号端VGL的第二控制信号、该第二时钟信号端CK2的第二时钟信号、该第三时钟信号端CK3的第三时钟信号、输入信号端IN的输入控制信号和复位信号端RST的复位信号控制下，控制第一节点A和第二节点B的电位。
综上所述，本发明实施例提供的一种移位寄存器单元，该移位寄存器单元包括：控制模块、第一输出模块和第二输出模块，通过该控制模块、第一输出模块和第二输出模块来控制输出端输出的电位高低，解决了相关技术中移位寄存器单元的电路结构通常较为复杂，控制过程较为繁琐的问题，达到了电路结构简单且输出端输出电压稳定的效果。
进一步的，请参考图2，其为本发明实施例提供的另一种移位寄存器单元的结构示意图，该移位寄存器单元在图1所示的移位寄存器单元的基础上增加了更优选的部件，从而使得本发明实施例提供的移位寄存器单元具有更好的性能。如图2所示，该控制模块110，包括：第一控制子模块111、第二控制子模块112、复位子模块113、上拉子模块114和分压子模块115；
该第一控制子模块111分别与输入信号端IN、第二时钟信号端CK2、第二信号端VGL和第三节点C连接，用于在来自该输入信号端IN的输入控制信号和第二时钟信号端CK2的第二时钟信号的控制下，向该第三节点C输入第二信号端VGL的第二控制信号；
该第二控制子模块112分别与第三时钟信号端CK3、第一信号端VGH、第二信号端VGL、第一节点A和第三节点C连接，用于在来自第三时钟信号端CK3的第三时钟信号的控制下，向第一节点A输入该第二信号端VGL的第二控制信号，向第三节点C输入第一信号端VGH的第一控制信号；
该复位子模块113分别与复位信号端RST、第一信号端VGH和第三节点C连接，用于在来自该复位信号端RST的复位信号的控制下，向该第三节点C输入来自第一信号端VGH的第一控制信号；
该上拉子模块114分别与第三节点C、第一信号端VGH、输入信号端IN和第一节点A连接，用于在来自输入信号端IN的输入控制信号和第三节点C的控制下，向该第一节点A输入来自第一信号端VGH的第一控制信号；
该分压子模块115分别与第二信号端VGL、第三节点C和第二节点B连接，用于在来自该第二信号端VGL的第二控制信号的控制下，向第二节点B输入该第三节点C的电位。
图3是本发明实施例提供的又一种移位寄存器单元的结构示意图，如图3所示，该第一控制子模块111可以包括：第一晶体管M1和第二晶体管M2；
该第一晶体管M1的第一极与该第二信号端VGL连接，该第一晶体管M1的第二极与该第二晶体管M2的第一级连接，该第一晶体管M1的第三极与该输入信号端IN连接；
该第二晶体管M2的第一极与该第一晶体管M1的第二极连接，该第二晶体管M2的第二极与该第三节点C连接，该第二晶体管M2的第三极与该第二时钟信号端CK2连接。
可选的，如图3所示，该第二控制子模块112可以包括：第三晶体管M3和第四晶体管M4；
该第三晶体管M3的第一极与该第二信号端VGL连接，该第三晶体管M3的第二极分别与该第一节点A和该第四晶体管M4的第三极连接，该第三晶体管M3的第三极与该第三时钟信号端CK3连接。
该第四晶体管M4的第一极与该第一信号端VGH连接，该第四晶体管M4的第二极与该第三节点C连接，该第四晶体管M4的第三极与该第三晶体管M3的第二极连接。
可选的，如图3所示，该复位子模块113可以包括：第五晶体管M5；
该第五晶体管M5的第一极与该第一信号端VGH连接，该第五晶体管M5的第二极与该第三节点C连接，该第五晶体管M5的第三极与该复位信号端RST连接。
可选的，如图3所示，该上拉子模块114包括：第六晶体管M6和第七晶体管M7；
该第六晶体管M6的第一极与该第一信号端VGH连接，该第六晶体管M6的第二极与该第一节点A连接，该第六晶体管M6的第三极与该输入信号端IN连接；
该第七晶体管M7的第一极与该第一信号端VGH连接，该第七晶体管M7的第二极与该第一节点A连接，该第七晶体管M7的第三极与该第三节点C连接。
可选的，如图3所示，该分压子模块115可以包括：第八晶体管M8；
该第八晶体管M8的第一极与该第三节点C连接，该第八晶体管M8的第二极与该第二节点B连接，该第八晶体管M8的第三极与该第二信号端VGL连接。该分压子模块115中的第八晶体管M8能够分担该第一控制子模块111中第二晶体管M2第二级的电压，避免第二晶体管M2第一级和第二级之间电压差过大，导致该第二晶体管M2发生漏电。
可选的，如图3所示，该第一输出模块120可以包括：第九晶体管M9和第一电容器C1；
该第九晶体管M9的第一极与该第一信号端VGH连接，该第九晶体管M9的第二极与该输出端OUT连接，该第九晶体管M9的第三极与该第一节点A连接；
该第一电容器C1的第一极与该第九晶体管M9的第一极连接，该第一电容器C1的第二极与该第九晶体管M9的第三极连接。
进一步的，如图3所示，该第二输出模块130可以包括：第十晶体管M10和第二电容器C2；
该第十晶体管M10的第一极与该第一时钟信号端CK1连接，该第十晶体管M10的第二极与该输出端OUT连接，该第十晶体管M10的第三极与该第二节点B连接；
该第二电容器C2的第一极与该第十晶体管M10的第二极连接，该第二电容器C2的第二极与该第十晶体管M10的第三极连接。
本发明实施例提供的移位寄存器单元，通过十个晶体管和两个电容器即完成了对输出端电位高低的控制，简化了移位寄存器单元结构，达到了减小移位寄存器版图面积的效果，有利于高分辨率显示装置的制造。
综上所述，本发明实施例提供的一种移位寄存器单元包括：控制模块、第一输出模块和第二输出模块，通过该控制模块、第一输出模块和第二输出模块来控制输出端输出的电位高低，解决了相关技术中移位寄存器单元的电路结构通常较为复杂，控制过程较为繁琐的问题，达到了电路结构简单且输出端输出电压稳定的效果。
图4是本发明实施例提供的一种移位寄存器单元驱动方法的流程图。移位寄存器单元的结构可以如图1所示，包括：控制模块110、第一输出模块120和第二输出模块130，该移位寄存器单元驱动方法包括：
步骤401，第一阶段：复位信号端RST输入的复位信号为第二电位，该控制模块110向第二节点B输入来自第一信号端VGH的第一控制信号，该第一控制信号为第一电位。
步骤402，第二阶段：第一时钟信号端CK1输入的第一时钟信号为第一电位，输入信号端IN输入的输入控制信号为第二电位，第二时钟信号端CK2输入的第二时钟信号为第二电位，控制该控制模块110向第一节点A输入该第一控制信号，向第二节点B输入来自第二信号端VGL的第二控制信号，该第二控制信号为第二电位，在该第二节点B的控制下，该第二输出模块130向输出端OUT输入来自该第一时钟信号端CK1的该第一时钟信号。
步骤403，第三阶段：该第二节点B保持第二电位，该第一时钟信号端CK1输入的该第一时钟信号为第二电位，在该第二节点B的控制下，该第二输出模块130向输出端OUT输入该第一时钟信号。
步骤404，第四阶段：第三时钟信号端CK3输入的第三时钟信号为第二电位，该控制模块110在来自该第三时钟信号端CK3的该第三时钟信号的控制下向该第一节点A输入来自该第二信号端VGL的该第二控制信号，在该第一节点A的控制下，该第一输出模块120向该输出端OUT输入来自该第一信号端VGH的第一控制信号。
综上所述，本发明实施例提供的一种移位寄存器单元驱动方法，该方法能够通过移位寄存器单元中的控制模块、第一输出模块和第二输出模块来控制输出端输出的电位高低，解决了相关技术中移位寄存器单元的电路结构通常较为复杂，控制过程较为繁琐的问题，达到了电路结构简单且输出端输出电压稳定的效果。
可选的，如图2所示，该控制模块110，包括：第一控制子模块111、第二控制子模块112、复位子模块113、上拉子模块114和分压子模块115；
此时，步骤402可以包括：第二阶段中，该第二时钟信号端CK2输入的第二时钟信号为第二电位，该输入信号端IN输入的输入控制信号为第二电位，控制该第一控制子模块111向第三节点C输入来自该第二信号端VGL的第二控制信号。
步骤404可以包括：第四阶段中，该第三时钟信号端CK3输入的第三时钟信号为第二电位，控制该第二控制子模块112向第一节点A输入来自该第二信号端VGL的第二控制信号，向该第三节点C输入来自该第一信号端VGH的第一控制信号。
步骤401可以包括：第一阶段中，该复位信号端RST输入的该复位信号为第二电位，控制该复位子模块113向该第二节点B输入该第一控制信号。
步骤402还可以包括：第二阶段中，该输入信号端IN输入的该输入控制信号为第二电位，该第三节点C为第二电位，控制该上拉子模块114向该第一节点A输入来自该第一信号端VGH的该第一控制信号。
该第一至第四阶段中，该第二信号端VGL的该第二控制信号为第二电位，控制该分压子模块115向该第二节点B输入该第三节点C的电位。
可选的，如图3所示，该第一控制子模块111包括：第一晶体管M1和第二晶体管M2；
此时，步骤402可以包括：第二阶段中，该第二时钟信号端CK2输入的第二时钟信号为第二电位，该输入信号端IN输入的输入控制信号为第二电位，该第一晶体管M1和该第二晶体管M2开启，该第二信号端VGL向该第三节点C输入第二控制信号。
可选的，该第二控制子模块112包括：第三晶体管M3和第四晶体管M4；
步骤404可以包括：第四阶段中，该第三时钟信号端CK3输入的第三时钟信号为第二电位，第三晶体管M3开启，第二信号端VGL分别向该第一节点A和该第四晶体管M4的第三极输入第二控制信号，由于第二控制信号为第二电位，因此此时第四晶体管M4开启，第一信号端VGH向该第三节点C输入第一控制信号。
可选的，该复位子模块113包括：第五晶体管M5；
步骤401可以包括：第一阶段中，该复位信号端RST输入的该复位信号为第二电位，该第五晶体管M5开启，该第一信号端VGH向该第三节点C输入该第一控制信号。此时，第十晶体管M10关断，输出端OUT无输出信号。
可选的，该上拉子模块114包括：第六晶体管M6和第七晶体管M7；
此时，步骤402可以包括：第二阶段中，输入信号端IN输入的输入控制信号为第二电位，由于第二阶段中，第二时钟信号端CK2输入的第二时钟信号也为第二电位，因此第一控制子模块111可以向第三节点C输入来自第二信号端VGL的第二控制信号，此时第三节点C为第二电位，第六晶体管M6和第七晶体管M7开启，该第一信号端VGH向第一节点A输入第一控制信号，该第一控制信号为第一电位，此时第一电容器C1能够存储该第一电位。由于该上拉子模块114中包括两个晶体管：第六晶体管M6和第七晶体管M7，在第二阶段中，该两个晶体管均向该第一节点A输入来自第一信号端的第一控制信号，保证该第一节点A的电压能够稳定在第一电位，使得第一输出端120中的第九晶体管M9关断，进而保证输出端OUT能够稳定的输出来自第一时钟信号端CK1的第一时钟信号，提高了该移位寄存单元输出端输出电压的稳定性。
可选的，如图3所示，该分压子模块115可以包括：第八晶体管M8；
上述步骤401至步骤404可以包括：在第一至第四阶段中，该第二信号端VGL的第二控制信号为第二电位，该第八晶体管M8开启，该第三节点C向该第二节点B输入该第三节点C的电位。在本发明实施例中，该分压子模块115中的第八晶体管M8主要用于为第一控制子模块111中的第二晶体管M2的第二级分压，避免该第二晶体管M2发生漏电。
可选的，如图3所示，该第一输出模块120可以包括：第九晶体管M9和第一电容器C1；
步骤404可以包括：第四阶段中，该控制模块110向该第一节点A输入来自该第二信号端VGL的第二控制信号，该第二控制信号为第二电位，第九晶体管M9开启，该第九晶体管M9向输出端OUT输入来自该第一信号端VGH的第一控制信号。
步骤402可以包括：第二阶段中，该控制模块110向该第一节点A输入来自该第一信号端VGH的第一控制信号，该第九晶体管M9关断。
可选的，如图3所示，该第二输出模块130可以包括：第十晶体管M10和第二电容器C2；
步骤401可以包括：第一阶段中，该控制模块110向该第二节点B输入第一控制信号，该第一控制信号为第一电位，第十晶体管M10关断，此时输出端OUT无输出信号，该移位寄存单元处于复位阶段。
步骤402可以包括：第二阶段中，该控制模块110向第二节点B输入来自第二信号端VGL的第二控制信号，该第二控制信号为第二电位，该第十晶体管M10开启，同时第二电容器C2存储该第二控制信号的第二电位，该第十晶体管M10向该输出端OUT输入来自该第一时钟信号端CK1的第一时钟信号。
步骤403可以包括：第三阶段中，由于该第二电容器C2在第二阶段中存储有第二控制信号的第二电位，使得该第二节点B可以在第三阶段中保持第二电位，此时该第十晶体管M10开启，该第十晶体管M10向该输出端OUT输入来自该第一时钟信号端CK1的第一时钟信号，并且由于该第一电容器C1在第二阶段中存储有第一控制信号的第一电位，使得第一节点A可以在第三阶段中继续保持第一电位，此时第一输出端120中的第九晶体管M9关断，进而保证输出端OUT能够稳定的输出来自第一时钟信号端CK1的第一时钟信号。
此外，本发明各个实施例中涉及的第一时钟信号端CK1、第二时钟信号端CK2、第三时钟信号端CK3、输入信号端IN、复位信号端RST和输出端OUT在第一阶段T1、第二阶段T2、第三阶段T3和第四阶段T4的电位变化可以参照图5。
需要说明的是，在上述实施例中，均是以第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7、第八晶体管M8、第九晶体管M9和第十晶体管M10为P型晶体管，且第一电位为高电位，第二电位为低电位为例进行的说明。当然，该第一至第十晶体管还可以采用N型晶体管，当该第一至第十晶体管采用N型晶体管时，该第一电位为低电位，该第二电位为高电位，且该第一时钟信号端CK1、第二时钟信号端CK2、第三时钟信号端CK3、输入信号端IN和复位信号端RST的电位变化可以与图5所示的电位变化相反(即二者的相位差为180度)。
综上所述，本发明实施例提供的一种移位寄存器单元驱动方法，该方法能够通过移位寄存器单元中的控制模块、第一输出模块和第二输出模块来控制输出端输出的电位高低，解决了相关技术中移位寄存器单元的电路结构通常较为复杂，控制过程较为繁琐的问题，达到了电路结构简单且输出端输出电压稳定的效果。
本发明提供一种栅极驱动电路，该栅极驱动电路可以包括至少两个级联的如图1、图2或图3所示的移位寄存器单元。
另外，本发明还提供一种显示装置，显示装置包括栅极驱动电路，该栅极驱动电路可以包括至少两个级联的如图1、图2或图3所示的移位寄存器单元。该显示装置可以为：液晶面板、电子纸、OLED面板、AMOLED面板、手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
以上所述仅为本发明的较佳实施例，并不用以限制本发明，凡在本发明的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本发明的保护范围之内。

Claims (23)

1.一种移位寄存器单元，其特征在于，所述移位寄存器单元包括：控制模块、第一输出模块和第二输出模块，
所述第一输出模块分别与第一信号端、第一节点和输出端连接，用于在所述第一节点的控制下，向所述输出端输入来自所述第一信号端的第一控制信号；
所述第二输出模块分别与所述输出端、第二节点和第一时钟信号端连接，用于在所述第二节点的控制下，向所述输出端输入来自所述第一时钟信号端的第一时钟信号；
所述控制模块分别与所述第一节点、所述第二节点、所述第一信号端、第二信号端、第二时钟信号端、第三时钟信号端、输入信号端和复位信号端连接，用于在来自所述第一信号端的所述第一控制信号、所述第二信号端的第二控制信号、所述第二时钟信号端的第二时钟信号、所述第三时钟信号端的第三时钟信号、所述输入信号端的输入控制信号和所述复位信号端的复位信号的控制下，控制所述第一节点和所述第二节点的电位。
2.根据权利要求1所述的移位寄存器单元，其特征在于，所述控制模块，包括：第一控制子模块、第二控制子模块、复位子模块、上拉子模块和分压子模块；
所述第一控制子模块分别与所述输入信号端、所述第二时钟信号端、所述第二信号端和第三节点连接，用于在来自所述输入信号端的所述输入控制信号和所述第二时钟信号端的所述第二时钟信号的控制下，向所述第三节点输入所述第二信号端的所述第二控制信号；
所述第二控制子模块分别与所述第三时钟信号端、所述第一信号端、所述第二信号端、所述第一节点和所述第三节点连接，用于在来自所述第三时钟信号端的所述第三时钟信号的控制下，向所述第一节点输入所述第二信号端的所述第二控制信号，向所述第三节点输入所述第一信号端的所述第一控制信号；
所述复位子模块分别与所述复位信号端、所述第一信号端和所述第三节点连接，用于在来自所述复位信号端的所述复位信号的控制下，向所述第三节点输入所述第一信号端的所述第一控制信号；
所述上拉子模块分别与所述第三节点、所述第一信号端、所述输入信号端和所述第一节点连接，用于在来自所述输入信号端的所述输入控制信号和所述第三节点的控制下，向所述第一节点输入所述第一信号端的所述第一控制信号；
所述分压子模块分别与所述第二信号端、所述第三节点和所述第二节点连接，用于在来自所述第二信号端的所述第二控制信号的控制下，向所述第二节点输入所述第三节点的电位。
3.根据权利要求2所述的移位寄存器单元，其特征在于，所述第一控制子模块包括：第一晶体管和第二晶体管；
所述第一晶体管的第一极与所述第二信号端连接，所述第一晶体管的第二极与所述第二晶体管的第一级连接，所述第一晶体管的第三极与所述输入信号端连接；
所述第二晶体管的第一极与所述第一晶体管的第二极连接，所述第二晶体管的第二极与所述第三节点连接，所述第二晶体管的第三极与所述第二时钟信号端连接。
4.根据权利要求2所述的移位寄存器单元，其特征在于，所述第二控制子模块包括：第三晶体管和第四晶体管；
所述第三晶体管的第一极与所述第二信号端连接，所述第三晶体管的第二极分别与所述第一节点和所述第四晶体管的第三极连接，所述第三晶体管的第三极与所述第三时钟信号端连接。
所述第四晶体管的第一极与所述第一信号端连接，所述第四晶体管的第二极与所述第三节点连接，所述第四晶体管的第三极与所述第三晶体管的第二极连接。
5.根据权利要求2所述的移位寄存器单元，其特征在于，所述复位子模块包括：第五晶体管；
所述第五晶体管的第一极与所述第一信号端连接，所述第五晶体管的第二极与所述第三节点连接，所述第五晶体管的第三极与所述复位信号端连接。
6.根据权利要求2所述的移位寄存器单元，其特征在于，所述上拉子模块包括：第六晶体管和第七晶体管；
所述第六晶体管的第一极与所述第一信号端连接，所述第六晶体管的第二极与所述第一节点连接，所述第六晶体管的第三极与所述输入信号端连接；
所述第七晶体管的第一极与所述第一信号端连接，所述第七晶体管的第二极与所述第一节点连接，所述第七晶体管的第三极与所述第三节点连接。
7.根据权利要求2所述的移位寄存器单元，其特征在于，所述分压子模块包括：第八晶体管；
所述第八晶体管的第一极与所述第三节点连接，所述第八晶体管的第二极与所述第二节点连接，所述第八晶体管的第三极与所述第二信号端连接。
8.根据权利要求1所述的移位寄存器单元，其特征在于，所述第一输出模块包括：第九晶体管和第一电容器；
所述第九晶体管的第一极与所述第一信号端连接，所述第九晶体管的第二极与所述输出端连接，所述第九晶体管的第三极与所述第一节点连接；
所述第一电容器的第一极与所述第九晶体管的第一极连接，所述第一电容器的第二极与所述第九晶体管的第三极连接。
9.根据权利要求1所述的移位寄存器单元，其特征在于，所述第二输出模块包括：第十晶体管和第二电容器；
所述第十晶体管的第一极与所述第一时钟信号端连接，所述第十晶体管的第二极与所述输出端连接，所述第十晶体管的第三极与所述第二节点连接；
所述第二电容器的第一极与所述第十晶体管的第二极连接，所述第二电容器的第二极与所述第十晶体管的第三极连接。
10.根据权利要求3至9任一所述的移位寄存器单元，其特征在于，
所述晶体管均为P型晶体管。
11.一种移位寄存器单元驱动方法，用于驱动权利要求1至10任一所述的移位寄存器单元，其特征在于，所述移位寄存器单元包括：第一输出模块、第二输出模块和控制模块，所述方法包括：
第一阶段：复位信号端输入的复位信号为第二电位，所述控制模块向第二节点输入来自第一信号端的第一控制信号，所述第一控制信号为第一电位；
第二阶段：第一时钟信号端输入的第一时钟信号为第一电位，输入信号端输入的输入控制信号为第二电位，第二时钟信号端输入的第二时钟信号为第二电位，控制所述控制模块向第一节点输入所述第一控制信号，向第二节点输入来自第二信号端的第二控制信号，所述第二控制信号为第二电位，在所述第二节点的控制下，所述第二输出模块向输出端输入来自所述第一时钟信号端的所述第一时钟信号；
第三阶段：所述第二节点保持第二电位，所述第一时钟信号端输入的所述第一时钟信号为第二电位，在所述第二节点的控制下，所述第二输出模块向所述输出端输入所述第一时钟信号；
第四阶段：第三时钟信号端输入的第三时钟信号为第二电位，所述控制模块在来自所述第三时钟信号端的所述第三时钟信号的控制下向所述第一节点输入来自所述第二信号端的所述第二控制信号，在所述第一节点的控制下，所述第一输出模块向所述输出端输入来自所述第一信号端的所述第一控制信号。
12.根据权利要求11所述的移位寄存器单元，其特征在于，所述控制模块，包括：第一控制子模块、第二控制子模块、复位子模块、上拉子模块和分压子模块；
所述第二阶段中，所述第二时钟信号端输入的所述第二时钟信号为第二电位，所述输入信号端输入的所述输入控制信号为第二电位，控制所述第一控制子模块向第三节点输入来自所述第二信号端的所述第二控制信号；
所述第四阶段中，所述第三时钟信号端输入的所述第三时钟信号为第二电位，控制所述第二控制子模块向所述第一节点输入来自所述第二信号端的所述第二控制信号，向所述第三节点输入来自所述第一信号端的所述第一控制信号；
所述第一阶段中，所述复位信号端输入的所述复位信号为第二电位，控制所述复位子模块向所述第二节点输入所述第一控制信号；
所述第二阶段中，所述输入信号端输入的所述输入控制信号为第二电位，所述第三节点为第二电位，控制所述上拉子模块向所述第一节点输入来自所述第一信号端的所述第一控制信号；
所述第一至第四阶段中，所述第二信号端的所述第二控制信号为第二电位，控制所述分压子模块向所述第二节点输入所述第三节点的电位。
13.根据权利要求12所述的移位寄存器单元，其特征在于，所述第一控制子模块包括：第一晶体管和第二晶体管；
所述第二阶段中，所述第二时钟信号端输入的所述第二时钟信号为第二电位，所述输入信号端输入的所述输入控制信号为第二电位，所述第一晶体管和所述第二晶体管开启，所述第二信号端向所述第三节点输入所述第二控制信号。
14.根据权利要求12所述的移位寄存器单元，其特征在于，所述第二控制子模块包括：第三晶体管和第四晶体管；
所述第四阶段中，所述第三时钟信号端输入的第三时钟信号为第二电位，所述第三晶体管开启，所述第二信号端分别向所述第一节点和所述第四晶体管的第三极输入所述第二控制信号，所述第二控制信号为第二电位，所述第四晶体管开启，所述第一信号端向所述第三节点输入所述第一控制信号。
15.根据权利要求12所述的移位寄存器单元，其特征在于，所述复位子模块包括：第五晶体管；
所述第一阶段中，所述复位信号端输入的所述复位信号为第二电位，所述第五晶体管开启，所述第一信号端向所述第三节点输入所述第一控制信号。
16.根据权利要求12所述的移位寄存器单元，其特征在于，所述上拉子模块包括：第六晶体管和第七晶体管；
所述第二阶段中，所述输入信号端输入的所述输入控制信号为第二电位，所述第三节点为第二电位，所述第六晶体管和所述第七晶体管开启，所述第一信号端向所述第一节点输入所述第一控制信号。
17.根据权利要求12所述的移位寄存器单元，其特征在于，所述分压子模块包括：第八晶体管；
所述第一至第四阶段中，所述第二信号端的所述第二控制信号为第二电位，所述第八晶体管开启，所述第三节点向所述第二节点输入所述第三节点的电位。
18.根据权利要求11所述的移位寄存器单元，其特征在于，所述第一输出模块包括：第九晶体管和第一电容器；
所述第四阶段中，所述控制模块向所述第一节点输入来自所述第二信号端的所述第二控制信号，所述第二控制信号为第二电位，所述第九晶体管开启，所述第九晶体管向所述输出端输入来自所述第一信号端的所述第一控制信号；
所述第二阶段中，所述控制模块向所述第一节点输入来自所述第一信号端的所述第一控制信号，所述第一控制信号为第一电位，所述第九晶体管关断。
19.根据权利要求11所述的移位寄存器单元，其特征在于，所述第二输出模块包括：第十晶体管和第二电容器；
所述第一阶段中，所述控制模块向所述第二节点输入所述第一控制信号，所述第一控制信号为第一电位，所述第十晶体管关断；
所述第二阶段中，所述控制模块向第二节点输入来自第二信号端的第二控制信号，所述第二控制信号为第二电位，所述第十晶体管开启，所述第十晶体管向所述输出端输入来自所述第一时钟信号端的所述第一时钟信号；
所述第三阶段中，所述第二节点保持第二电位，所述第十晶体管开启，所述第十晶体管向所述输出端输入来自所述第一时钟信号端的所述第一时钟信号。
20.根据权利要求13至19任一所述的方法，其特征在于，
所述晶体管均为P型晶体管。
21.根据权利要求11至19任一所述的方法，其特征在于，
所述第一电位相对于所述第二电位为高电位。
22.一种栅极驱动电路，其特征在于，所述栅极驱动电路包括至少两个级联的如权利要求1至10任一所述的移位寄存器单元。
23.一种显示装置，其特征在于，所述显示装置包括权利要求22所述的栅极驱动电路。
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