CN105470236B - 半导体装置 - Google Patents

半导体装置 Download PDF

Info

Publication number
CN105470236B
CN105470236B CN201510622733.3A CN201510622733A CN105470236B CN 105470236 B CN105470236 B CN 105470236B CN 201510622733 A CN201510622733 A CN 201510622733A CN 105470236 B CN105470236 B CN 105470236B
Authority
CN
China
Prior art keywords
metallic
heat radiating
radiating plate
face
ceramic substrate
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
CN201510622733.3A
Other languages
English (en)
Other versions
CN105470236A (zh
Inventor
大坪义贵
高桥卓也
宫泽雅臣
山下哲生
稗田智宏
田畑光晴
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Publication of CN105470236A publication Critical patent/CN105470236A/zh
Application granted granted Critical
Publication of CN105470236B publication Critical patent/CN105470236B/zh
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Classifications

    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00—Details of semiconductor or other solid state devices
    • H01L23/16—Fillings or auxiliary members in containers or encapsulations, e.g. centering rings
    • H01L23/18—Fillings characterised by the material, its physical or chemical properties, or its arrangement within the complete device
    • H01L23/24—Fillings characterised by the material, its physical or chemical properties, or its arrangement within the complete device solid or gel at the normal operating temperature of the device
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00—Details of semiconductor or other solid state devices
    • H01L23/02—Containers; Seals
    • H01L23/04—Containers; Seals characterised by the shape of the container or parts, e.g. caps, walls
    • H01L23/053—Containers; Seals characterised by the shape of the container or parts, e.g. caps, walls the container being a hollow construction and having an insulating or insulated base as a mounting for the semiconductor body
    • H01L23/057—Containers; Seals characterised by the shape of the container or parts, e.g. caps, walls the container being a hollow construction and having an insulating or insulated base as a mounting for the semiconductor body the leads being parallel to the base
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00—Details of semiconductor or other solid state devices
    • H01L23/34—Arrangements for cooling, heating, ventilating or temperature compensation ; Temperature sensing arrangements
    • H01L23/36—Selection of materials, or shaping, to facilitate cooling or heating, e.g. heatsinks
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00—Details of semiconductor or other solid state devices
    • H01L23/34—Arrangements for cooling, heating, ventilating or temperature compensation ; Temperature sensing arrangements
    • H01L23/36—Selection of materials, or shaping, to facilitate cooling or heating, e.g. heatsinks
    • H01L23/373—Cooling facilitated by selection of materials for the device or materials for thermal expansion adaptation, e.g. carbon
    • H01L23/3735—Laminates or multilayers, e.g. direct bond copper ceramic substrates
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00—Details of semiconductor or other solid state devices
    • H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
    • H01L23/49811—Additional leads joined to the metallisation on the insulating substrate, e.g. pins, bumps, wires, flat leads
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29099—Material
    • H01L2224/291—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/29101—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321—Disposition
    • H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001—Core members of the connector
    • H01L2224/45099—Material
    • H01L2224/451—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H01L2224/45117—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 400°C and less than 950°C
    • H01L2224/45124—Aluminium (Al) as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805—Shape
    • H01L2224/4809—Loop shape
    • H01L2224/48091—Arched
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481—Disposition
    • H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/48227—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/49—Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • H01L2224/491—Disposition
    • H01L2224/4911—Disposition the connectors being bonded to at least one common bonding area, e.g. daisy chain
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/49—Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • H01L2224/491—Disposition
    • H01L2224/4911—Disposition the connectors being bonded to at least one common bonding area, e.g. daisy chain
    • H01L2224/49113—Disposition the connectors being bonded to at least one common bonding area, e.g. daisy chain the connectors connecting different bonding areas on the semiconductor or solid-state body to a common bonding area outside the body, e.g. converging wires
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732—Location after the connecting process
    • H01L2224/73251—Location after the connecting process on different surfaces
    • H01L2224/73265—Layer and wire connectors
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L24/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L24/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L24/31—Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L24/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42—Wire connectors; Manufacturing methods related thereto
    • H01L24/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L24/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42—Wire connectors; Manufacturing methods related thereto
    • H01L24/47—Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/49—Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/73—Means for bonding being of different types provided for in two or more of groups H01L24/10, H01L24/18, H01L24/26, H01L24/34, H01L24/42, H01L24/50, H01L24/63, H01L24/71
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10—Details of semiconductor or other solid state devices to be connected
    • H01L2924/11—Device type
    • H01L2924/13—Discrete devices, e.g. 3 terminal devices
    • H01L2924/1304—Transistor
    • H01L2924/1305—Bipolar Junction Transistor [BJT]
    • H01L2924/13055—Insulated gate bipolar transistor [IGBT]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10—Details of semiconductor or other solid state devices to be connected
    • H01L2924/11—Device type
    • H01L2924/13—Discrete devices, e.g. 3 terminal devices
    • H01L2924/1304—Transistor
    • H01L2924/1306—Field-effect transistor [FET]
    • H01L2924/13091—Metal-Oxide-Semiconductor Field-Effect Transistor [MOSFET]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181—Encapsulation
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/19—Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
    • H01L2924/191—Disposition
    • H01L2924/19101—Disposition of discrete passive components
    • H01L2924/19107—Disposition of discrete passive components off-chip wires

Abstract

半导体装置具有：半导体元件(4)；以及陶瓷电路基板(10)，其安装有半导体元件。陶瓷电路基板(10)包含：陶瓷基板(11)，其具有彼此相对的一个面和另一个面；金属电路板(12)，其与陶瓷基板(11)的一个面接合，且与半导体元件电连接；以及金属散热板(13)，其与陶瓷基板(11)的另一个面接合。金属电路板(12)的厚度大于金属散热板(13)的厚度。金属散热板(13)的与陶瓷基板(11)相反侧的面的表面积大于金属电路板(12)的与陶瓷基板(11)相反侧的面的表面积。由此，能够得到可抑制陶瓷基板的翘曲的半导体装置。

Description

半导体装置
技术领域
本发明涉及半导体装置，特别是涉及具有陶瓷电路基板的半导体装置。
背景技术
当前，在GTO(Gate Turn Off Thyristor)、IGBT(Insulated Gate BipolarTransistor)等功率半导体装置中，使用陶瓷电路基板。在该陶瓷电路基板中，陶瓷基板的一个面与金属电路板接合，另一个面与金属散热板接合。并且，在金属电路板处安装半导体元件，使散热器与金属散热板接合。
由于金属电路板的热膨胀率大于陶瓷基板的热膨胀率，因此由于半导体元件的使用时的热量，金属电路板比陶瓷基板更为膨胀。因此，在陶瓷基板处发生翘曲。
例如，在日本特开平10－200219号公报中，公开了下述电路基板，即，在陶瓷基板的一个面形成有金属电路板，在相反面形成有金属散热板。在该公报记载的电路基板中，金属电路板的厚度和金属散热板的厚度之比、以及陶瓷基板的外周缘与金属电路及金属散热板各自的外周缘之间的余量宽度设定于规定的数值范围。由此，在陶瓷基板处发生裂纹的情况减少。
在上述公报记载的电路基板中，未考虑金属电路板的电路图案。如果不考虑金属电路板的电路图案，单纯地使金属电路板的厚度变厚，则金属电路板由于半导体元件的使用时的热量而膨胀的量变大。因此，在陶瓷基板发生较大的翘曲。由此，有时陶瓷基板破损。
发明内容
本发明就是鉴于上述课题而提出的，其目的在于，提供一种能够抑制陶瓷基板的翘曲的半导体装置。
本发明的半导体装置具有：半导体元件；以及陶瓷电路基板，其安装有半导体元件。陶瓷电路基板包含：陶瓷基板，其具有彼此相对的一个面和另一个面；金属电路板，其与陶瓷基板的一个面接合，且与半导体元件电连接；以及金属散热板，其与陶瓷基板的另一个面接合。金属电路板的厚度大于金属散热板的厚度。金属散热板的与陶瓷基板相反侧的面的表面积大于金属电路板的与陶瓷基板相反侧的面的表面积。
根据本发明的半导体装置，形成电路图案的金属电路板的厚度大于金属散热板的厚度。并且，金属散热板的与陶瓷基板相反侧的面的表面积大于金属电路板的与陶瓷基板相反侧的面的表面积。因此，能够在金属电路板的体积和金属散热板的体积之间取得平衡。由此，能够抑制由在陶瓷基板处产生的热应力导致的陶瓷基板的翘曲。因此，能够抑制陶瓷基板破损。
通过结合附图进行理解的、与本发明相关的以下的详细说明，使本发明的上述及其它目的、特征、方案以及优点变得明确。
附图说明
图1是概略地表示本发明的实施方式1的半导体装置的俯视图。
图2是表示卸下图1所示的半导体装置的盖后的状态的俯视图。
图3是沿图2的III－III线的剖视图。
图4是概略地表示本发明的实施方式1的半导体装置的仰视图。
图5是概略地表示本发明的实施方式2的半导体装置的剖视图。
图6是概略地表示本发明的实施方式2的半导体装置的仰视图。
图7是概略地表示本发明的实施方式3的半导体装置的剖视图。
图8是概略地表示将散热器与本发明的实施方式4的半导体装置接合后的状态的剖视图。
图9是概略地表示对比例的半导体装置的剖视图。
图10是概略地表示现有的半导体装置的剖视图。
图11是表示现有技术以及实施例的半导体装置的热阻的图。
图12是表示金属电路板以及金属散热板的厚度和热阻之间的关系的图。
图13是概略地表示实施例的陶瓷电路基板的结构的图。
图14是表示金属电路板和金属散热板的体积比与翘曲量之间的关系的图。
图15是表示现有技术以及实施例的半导体装置的热阻的图。
具体实施方式
下面，基于附图，对本发明的实施方式进行说明。
(实施方式1)
首先，参照图1～图4，对本发明的实施方式1的半导体装置的结构进行说明。
参照图1～图3，本实施方式的半导体装置例如是功率模块。本实施方式的半导体装置主要具有：壳体1；盖2；电极端子3；半导体元件4；焊料5；配线6；封装树脂7；以及陶瓷电路基板10。此外，在图2中，为了易于观察，封装树脂7未图示。
主要参照图1，在壳体1的一个面侧安装有盖2。盖2是为了进行防尘及防水的结构。在壳体1的与一个面相对的另一个面侧，安装有陶瓷电路基板10。壳体1在陶瓷电路基板10的周围形成。壳体1例如由树脂形成。作为该树脂，例如使用PPS(聚苯硫醚)。
在壳体1安装有电极端子3。电极端子3从壳体1的一个面侧露出。另外，电极端子3从壳体1的内周侧露出。电极端子3包含：多个负极输入端子(N)；正极输入端子(P)；栅极端子(Pg)；接地端子(Pe)；交流电极端子(AC)。
主要参照图2及图3，半导体元件4安装于陶瓷电路基板10。半导体元件4经由焊料5与陶瓷电路基板10接合。半导体元件4例如是功率用半导体元件。具体地说，半导体元件4是IGBT(Insulated Gate Bipolar Transistor)、GTO(Gate Turn Off Thyristor)、MOSFET(Metal Oxide Semiconductor Field Effect Transistor)等。
半导体元件4优选由宽带隙材料形成。即，半导体元件4包含能带隙大于或等于2eV的材料。具体地说，半导体元件4是使用了碳化硅、氮化镓、金刚石等材料的半导体芯片。此外，碳化硅的能带隙是2.20～3.02eV，氮化镓的能带隙是3.39eV，金刚石的能带隙是5.47eV。
主要参照图3及图4，陶瓷电路基板10包含陶瓷基板11、金属电路板12、以及金属散热板13。陶瓷基板11具有彼此相对的一个面11a和另一个面11b。陶瓷基板11的一个面11a和另一个面11b之间的厚度例如大于或等于0.25mm而小于或等于0.635mm。具体地说，陶瓷基板11的厚度例如能够设为0.25mm、0.32mm、0.635mm。另外，陶瓷基板11的外形例如是长度80mm及宽度55mm。
陶瓷基板11例如由氮化硅材料、氮化铝材料、氧化铝材料形成。优选陶瓷基板11由氮化硅材料形成。即，优选陶瓷基板11包含氮化硅。
金属电路板12与陶瓷基板11的一个面11a接合。金属电路板12与半导体元件4电连接。金属电路板12经由焊料5与半导体元件4接合。金属电路板12具有电路图案。
金属电路板12的厚度能够与陶瓷基板11的厚度相应地进行变更。例如，在陶瓷基板11的厚度为0.25mm的情况下，能够将金属电路板12的厚度设为大于或等于0.6mm而小于或等于0.8mm。另外，例如在陶瓷基板11的厚度为0.32mm的情况下，能够将金属电路板12的厚度设为大于或等于0.8mm而小于或等于1.0mm。另外，例如在陶瓷基板11的厚度为0.635mm的情况下，能够将金属电路板12的厚度设为大于或等于1.0mm而小于或等于2.0mm。另外，金属电路板12的外形例如是长度74mm及宽度49mm。该金属电路板12的外形是除了电路图案以外的金属电路板12的外缘所形成的形状。
金属电路板12例如由铜、铝、银以及它们的合金形成。优选金属电路板12由铜形成。即，优选金属电路板12含有铜。
金属散热板13与陶瓷基板11的另一个面11b接合。金属散热板13例如由实心金属板形成。在该情况下，金属散热板13不具有图案。
金属散热板13的厚度能够与陶瓷基板11的厚度相应地进行变更。例如在陶瓷基板11的厚度为0.25mm的情况下，能够将金属散热板13的厚度设为大于或等于0.5mm而小于或等于0.7mm。另外，例如在陶瓷基板11的厚度为0.32mm的情况下，能够将金属散热板13的厚度设为大于或等于0.6mm而小于或等于0.9mm。另外，例如在陶瓷基板11的厚度为0.635mm的情况下，能够将金属散热板13的厚度设为大于或等于1.0mm而小于或等于2.0mm。另外，金属散热板13的外形例如是宽度78.4mm及长度53.4mm。该金属散热板13的外形是金属散热板13的外缘所形成的形状。
金属散热板13例如由铜、铝、银以及它们的合金形成。优选金属散热板13由铜形成。即，优选金属散热板13含有铜。
金属电路板12的厚度大于金属散热板13的厚度。金属散热板13的与陶瓷基板11相反侧的面的表面积大于金属电路板12的与陶瓷基板11相反侧的面的表面积。
优选金属电路板12的体积相对于金属散热板13的体积的比率大于或等于70％而小于或等于130％。另外，优选金属电路板12的体积大于金属散热板13的体积。另外，优选金属电路板12的厚度相对于金属散热板13的厚度的比率大于或等于6/5而小于或等于4/3。
在本实施方式中，壳体1支撑陶瓷基板11。壳体1包含伸出部1a。伸出部1a伸出至陶瓷基板11的一个面11a的正上方。伸出部1a搭载在一个面11a处。伸出部1a例如利用粘结剂固定于一个面11a。金属散热板13的至少一部分配置为，在从一个面11a和另一个面11b相对的方向观察时，与伸出部1a重叠。即，陶瓷基板11夹持在金属散热板13和伸出部1a之间。由金属散热板13经由陶瓷基板11支撑伸出部1a。伸出部1a也可以隔着半导体元件1设置在壳体1的两侧。金属散热板13也可以在壳体的两侧支撑伸出部1a。
再次主要参照图2及图3，配线6与金属电路板12和半导体元件4连接。另外，配线6与半导体元件4和电极端子3连接。另外，配线6与电极端子3和金属电路板12连接。因此，通过配线6，半导体元件4、电极端子3、金属电路板12彼此电连接。配线6例如由铝形成。
在由壳体1、盖2、陶瓷电路基板10包围的内部空间中，收容有半导体元件4、焊料5、配线6以及封装树脂7。在内部空间内，利用封装树脂7，对半导体元件4、焊料5以及配线6进行覆盖。封装树脂7例如是硅凝胶。
下面，对本实施方式的半导体装置的作用效果进行说明。
根据本实施方式的半导体装置，形成电路图案的金属电路板12的厚度大于金属散热板13的厚度。并且，金属散热板13的与陶瓷基板11相反侧的面的表面积大于金属电路板12的与陶瓷基板11相反侧的面的表面积。因此，能够在金属电路板12的体积和金属散热板13的体积之间取得平衡。即，通过对形成电路图案的金属电路板12的体积进行补偿，能够使金属散热板13的体积与金属散热板13的体积接近。由此，能够抑制由在陶瓷基板11处产生的热应力导致的陶瓷基板11的翘曲。因此，能够抑制陶瓷基板11破损。
另外，在本实施方式中，能够将金属电路板12及金属散热板13各自的厚度设为大于或等于0.6mm。由于现有的金属电路板12及金属散热板13各自的厚度为0.3mm左右，因此与它们相比，在本实施方式中，能够提高金属电路板12及金属散热板13各自的散热性。
另外，根据本实施方式的半导体装置，金属电路板12的体积相对于金属散热板13的体积的比率大于或等于70％而小于或等于130％。由此，能够抑制陶瓷基板11的翘曲。
另外，根据本实施方式的半导体装置，金属电路板12的体积大于金属散热板13的体积。由此，即使金属散热板13的与陶瓷基板11相反侧的面的表面积大于金属电路板12的与陶瓷基板11相反侧的面的表面积，也能够对陶瓷基板11向金属散热板13侧翘曲的情况进行抑制。
另外，根据本实施方式的半导体装置，金属电路板12的厚度相对于金属散热板13的厚度的比率大于或等于6/5而小于或等于4/3。由此，能够抑制陶瓷基板11的翘曲。
另外，根据本实施方式的半导体装置，陶瓷基板11含有氮化硅。由此，能够使陶瓷基板11难以破裂。
另外，根据本实施方式的半导体装置，金属电路板12及金属散热板13各自含有铜。由于铜的热传导率比铁的热传导率(80W/mK)高，因此能够提高金属电路板12及金属散热板13的散热性。另外，由于铜比银便宜，因此能够抑制金属电路板12及金属散热板13的成本。另外，由于铜加工性良好，因此能够提高金属电路板12及金属散热板13的生产率。
另外，根据本实施方式的半导体装置，半导体元件4能够含有能带隙大于或等于2eV的材料。在本实施方式的半导体装置中，通过使金属电路板12的厚度变厚，从而电感变小。因此，能够在高速通断时，降低在半导体元件4动作时产生的电涌电压。
另外，根据本实施方式的半导体装置，金属散热板13的至少一部分配置为，在从陶瓷基板11的一个面11a和另一个面11b相对的方向观察时，与伸出部1a重叠。由此，能够由金属散热板13对伸出部1a进行支撑。由此，能够降低由壳体1导致的向陶瓷基板11的应力。另外，壳体1向陶瓷基板11的安装变得容易。
(实施方式2)
对本发明的实施方式2的半导体装置进行说明。下面，只要不特别地进行说明，对与实施方式相同的结构标注相同的标号，不重复说明。这在下面的实施方式3及4中也是同样的。
参照图5及图6，实施方式2的半导体装置主要在金属散热板13具有凹部HP这一点上与实施方式1的半导体装置不同。金属散热板13具有第1面13a和第2面13b。第1面13a与陶瓷基板11接合。第2面13b与第1面13a相对。金属散热板13具有形成于第2面13b的凹部HP。
在本实施方式中，凹部HP是槽。另外，凹部HP贯穿金属散热板13的第1面13a和第2面13b。此外，凹部HP也可以不贯穿金属散热板13的第1面13a和第2面13b，只要通过凹部HP而使金属散热板13的体积减小即可。由此，能够抑制金属散热板13的热膨胀。
另外，在本实施方式中，凹部HP沿金属散热板13的外缘而形成。此外，凹部HP也可以不沿金属散热板13的外缘而形成，只要在金属散热板13的第2面13b的某部分处形成即可。
另外，在本实施方式中，凹部HP在金属散热板13的外缘的整周形成。此外，凹部HP也可以不在金属散热板13的外缘的整周形成，只要沿金属散热板13的外缘的一部分而形成即可。
另外，在本实施方式中，凹部HP在俯视观察时形成为直线状。此外，凹部HP也可以在俯视观察时不形成为直线状，可以在俯视观察时形成为曲线状。另外，凹部HP也可以是孔。
根据本实施方式的半导体装置，金属散热板13具有形成于第2面13b的凹部HP。因此，能够通过凹部HP而抑制金属散热板13的热膨胀。由此，能够抑制陶瓷基板11的翘曲。
(实施方式3)
对本发明的实施方式3的半导体装置进行说明。
参照图7，实施方式3的半导体装置的金属电路板及金属散热板各自主要在含有铜材料和铝材料这一点上与实施方式1的半导体装置不同。本实施方式的半导体装置的金属电路板及金属散热板各自是所谓的包层材料。
金属电路板12及金属散热板13各自含有铜材料CP和铝材料AP。铝材料AP将铜材料CP覆盖。即，铜材料CP和铝材料AP层叠。铝材料AP的厚度例如是大于或等于0.1mm而小于或等于0.5mm。陶瓷基板11与金属电路板12的铝材料AP及金属散热板13的铝材料AP两者接合。
根据本实施方式的半导体装置，陶瓷基板11与铝材料AP接合。由于铝较柔软，因此相比于与铜接合的情况，能够使接合部分的应力得到缓和。
(实施方式4)
对本发明的实施方式4的半导体装置进行说明。
参照图8，实施方式4的半导体装置主要在还具有散热器20这一点上与实施方式1的半导体装置不同。散热器20具有散热片。散热器的材料例如是铝。散热器20覆盖金属散热板13的整个面。散热器20隔着脂状物21安装于金属散热板13。在金属散热板13和散热器20之间涂敷有脂状物21。脂状物21的热传导率大于或等于2W/mK。
下面，对本实施方式的半导体装置的作用效果，与对比例的半导体装置进行对比并说明。参照图9，对比例的半导体装置主要在具有基底板30这一点上与本实施方式的半导体装置不同。此外，在图9中，为了容易观察，散热器未图示。
在对比例的半导体装置中，如图9中虚线所示，半导体元件4的使用时的热量向陶瓷电路基板10及基底板30扩散。由于对比例的半导体装置具有基底板30，因此在半导体元件4处产生的热量从半导体元件4朝向散热器扩散至基底板30。因此，由于半导体元件4和散热器之间的距离变大，所以在半导体元件4处产生的热量在较大的范围内扩散，直至到达散热器为止。
与此相对，在本实施方式的半导体装置中，由于不具有基底板30，因此如图8中虚线所示，与对比例相比，在半导体元件4处产生的热量从半导体元件4朝向散热器20扩散的范围小。因此，脂状物21对在半导体元件4处产生的热量的散热施加的影响变大。在本实施方式的半导体装置中，由于脂状物21的热传导率大于或等于2W/mK，因此脂状物21的散热性较高。因此，能够提高在半导体元件4处产生的热量的散热性。
【实施例】
下面，对本发明的实施例进行说明。
首先，通过模拟，对本发明的实施例以及现有的半导体装置的热阻进行了测定。参照图10，以现有的半导体装置为例，对半导体装置的热阻进行说明。现有的半导体装置具有基底板30。对图10所示的点Tj、Tc、Tf、Ta各点之间的热阻、以及点Tj和点Ta之间的热阻进行了测定。点Tj位于半导体芯片的上表面。点Tc位于基底板30和脂状物21之间的接点处。点Tf位于脂状物21和散热器20之间的接点处。点Ta位于散热器的下表面。另外，本发明的实施例不具有基底板。在本发明的实施例中，点Tf位于金属散热板13和脂状物21之间的接点处。
参照图11及图12，Rth(j－a)是点Tj和点Ta之间的热阻。Rth(j－c)是点Tj和点Tc之间的热阻。Rth(c－f)是点Tc和点Tf之间的热阻。Rth(f－a)是点Tf和点Ta之间的热阻。另外，图11中的符号t是金属电路板及金属散热板的厚度。可知，金属电路板及金属散热板的厚度大于或等于0.6mm的情况下的热阻是比现有的半导体装置的热阻低的值。由此可知，通过将金属电路板及金属散热板的厚度设为大于或等于0.6mm，即使没有如现有技术那样具有基底板，也能够实现和现有技术相同的热阻。
然后，通过模拟，对本发明的实施例及现有的半导体装置的翘曲进行了测定。参照图13，对本发明的实施例的陶瓷电路基板10的翘曲量进行了测定。此外，在图13中，为了易于观察，电路图案未图示。将向金属电路板12侧凸出的翘曲定义为负翘曲，将向金属散热板13侧凸出的翘曲定义为正翘曲。另外，对在图13中示出的xyz轴进行定义，陶瓷电路基板10的四角中的1个固定z，另1个固定y、z，还有1个固定x、y、z。在该条件下，对于TypeA及TypeB这2种类型的陶瓷电路基板10，对翘曲量进行了测定。
TypeA是金属电路板12的电路图案的面积较小的形状。TypeA的陶瓷基板11的外形尺寸是长度为79mm、宽度为58.1mm。金属电路板12的外形尺寸是长度为70mm、宽度为49.1mm。金属散热板13的外形尺寸是长度为77.4mm、宽度为56.5mm。TypeB是与TypeA相比金属电路板12的电路图案的面积较大的形状。TypeB的陶瓷基板11的外形尺寸是长度为79mm、宽度为58.1mm。金属电路板12的外形尺寸是长度为73mm、宽度为52.1mm。金属散热板13的外形尺寸是长度为77mm、宽度为56.1mm。另外，对于TypeA及TypeB，金属散热板13均为实心金属板。
参照图14、表1及表2，研究了金属电路板12的体积Vm1和金属散热板13的体积Vm2的比率、与陶瓷电路基板10的翘曲量之间的关系。
表1中示出TypeA的翘曲量等，表2中示出TypeB的翘曲量等。表1及表2的表面图案表示金属电路板12，背面图案表示金属散热板13。体积比表示金属电路板12的体积Vm1相对于金属散热板13的体积Vm2的比。
[表1]
[表2]
通常存在下述问题，即，由于脂状物的厚度为0.1mm，因此如果陶瓷电路基板的翘曲量超过0.1mm，则不能确保脂状物的散热性。即，由于在负翘曲的情况下，金属散热板从散热器远离，因此在脂状物中产生空隙。另外，在正翘曲的情况下，由于金属散热板接近散热器，因此将脂状物推开，在翘曲恢复时，有时在脂状物中产生空隙。如上所述，由于如果陶瓷电路基板的翘曲量超过0.1mm，则在脂状物中产生空隙，因此难以确保散热性。因此，优选使陶瓷电路基板的翘曲量小于或等于0.1mm。此外，关于正翘曲，由于金属散热板接近散热器，因此有时在脂状物中不产生空隙。如上所述可知，优选金属电路板12的体积Vm1相对于金属散热板13的体积Vm2的比率大于或等于70％而小于或等于130％。
另外可知，在金属电路板的体积大于金属散热板的体积的情况下，翘曲量变为零。具体地说，可知，在金属电路板的体积Vm1相对于金属散热板的体积Vm2的比率约为110％时，翘曲量变为零。如上所述可知，优选金属电路板的体积大于金属散热板的体积。
另外可知，优选金属电路板的厚度相对于金属散热板的厚度的比率大于或等于6/5而小于或等于4/3。
下面，通过模拟，对变更了脂状物的情况下的本发明的实施例以及现有的半导体装置的热阻进行了测定。
参照图15可知，与现有的陶瓷基板是氧化铝、脂状物的热传导率为0.9W/mK的半导体装置相比，使用了热传导率为0.9W/mK的脂状物的、本发明的实施例的半导体装置的热阻变小。另外可知，与现有的陶瓷基板是氮化铝、脂状物的热传导率为0.9W/mK的半导体装置相比，使用了热传导率为2.0W/mK的脂状物的、本发明的实施例的半导体装置的热阻变小。并且可知，在本发明的实施例中，由于脂状物的热传导率为2.0W/mK，因此热阻大幅度地变小。
对本发明进行了详细说明，但这只是例示，而非限定，明显应当理解为发明的范围是由随附的权利要求书进行解释的。

Claims (10)

1.一种半导体装置，其具有：
半导体元件；以及
陶瓷电路基板，其安装有所述半导体元件，
所述陶瓷电路基板包含：
陶瓷基板，其具有彼此相对的一个面和另一个面；
金属电路板，其与所述陶瓷基板的所述一个面接合，且与所述半导体元件电连接；以及
金属散热板，其与所述陶瓷基板的所述另一个面接合，
所述金属电路板的厚度大于所述金属散热板的厚度，
所述金属散热板的与所述陶瓷基板相反侧的面的表面积大于所述金属电路板的与所述陶瓷基板相反侧的面的表面积，
所述金属电路板的体积大于所述金属散热板的体积，
所述半导体装置具有覆盖所述金属散热板而设置的散热器。
2.根据权利要求1所述的半导体装置，其中，
所述散热器隔着脂状物安装于所述金属散热板，
所述脂状物的热传导率大于或等于2W/mK。
3.一种半导体装置，其具有：
半导体元件；以及
陶瓷电路基板，其安装有所述半导体元件，
所述陶瓷电路基板包含：
陶瓷基板，其具有彼此相对的一个面和另一个面；
金属电路板，其与所述陶瓷基板的所述一个面接合，且与所述半导体元件电连接；以及
金属散热板，其与所述陶瓷基板的所述另一个面接合，
所述金属散热板的厚度相对于所述金属电路板的厚度的比率大于或等于6/5而小于或等于4/3，
所述金属散热板的与所述陶瓷基板相反侧的面的表面积大于所述金属电路板的与所述陶瓷基板相反侧的面的表面积，
所述金属电路板的体积大于所述金属散热板的体积。
4.根据权利要求1或2所述的半导体装置，其中，
所述金属电路板的体积相对于所述金属散热板的体积的比率小于或等于130％。
5.根据权利要求1或2所述的半导体装置，其中，
所述陶瓷基板含有氮化硅。
6.根据权利要求1或2所述的半导体装置，其中，
所述金属电路板及所述金属散热板各自含有铜。
7.根据权利要求1或2所述的半导体装置，其中，
所述金属电路板及所述金属散热板各自含有：铜材料；以及铝材料，其将所述铜材料覆盖，
所述陶瓷基板与所述金属电路板的所述铝材料接合，并且所述陶瓷基板与所述金属散热板的所述铝材料接合。
8.根据权利要求1或2所述的半导体装置，其中，
所述半导体元件含有能带隙大于或等于2eV的材料。
9.根据权利要求1或2所述的半导体装置，其中，
还具有壳体，该壳体支撑所述陶瓷基板，
所述壳体包含伸出部，该伸出部伸出至所述陶瓷基板的所述一个面的正上方，且搭载于所述一个面，
所述金属散热板的至少一部分配置为，在从所述一个面和所述另一个面相对的方向观察时，与所述伸出部重叠。
10.根据权利要求1或2所述的半导体装置，其中，
所述金属散热板包含：
第1面，其与所述陶瓷基板接合；以及
第2面，其与所述第1面相对，
所述金属散热板具有形成于所述第2面的凹部。
CN201510622733.3A 2014-09-26 2015-09-25 半导体装置 Active CN105470236B (zh)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2014-196742 2014-09-26
JP2014196742A JP6341822B2 (ja) 2014-09-26 2014-09-26 半導体装置

Publications (2)

Publication Number Publication Date
CN105470236A CN105470236A (zh) 2016-04-06
CN105470236B true CN105470236B (zh) 2018-12-21

Family

ID=55486029

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201510622733.3A Active CN105470236B (zh) 2014-09-26 2015-09-25 半导体装置

Country Status (4)

Country Link
US (1) US9721861B2 (zh)
JP (1) JP6341822B2 (zh)
CN (1) CN105470236B (zh)
DE (1) DE102015215133B4 (zh)

Families Citing this family (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP3493253A4 (en) * 2016-07-28 2020-05-06 Kabushiki Kaisha Toshiba PCB AND SEMICONDUCTOR MODULE
JP7042217B2 (ja) * 2016-12-27 2022-03-25 ヌヴォトンテクノロジージャパン株式会社 半導体装置
JP6755197B2 (ja) * 2017-01-19 2020-09-16 三菱電機株式会社 半導体装置およびその製造方法
JP6594556B1 (ja) 2018-01-17 2019-10-23 新電元工業株式会社 電子モジュール
JP7172471B2 (ja) * 2018-11-09 2022-11-16 住友電装株式会社 基板構造体
JP7415486B2 (ja) 2019-11-28 2024-01-17 三菱マテリアル株式会社 ヒートシンク付絶縁回路基板及びその製造方法
KR102536643B1 (ko) * 2022-11-28 2023-05-30 제엠제코(주) 반도체 패키지

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20070075715A1 (en) * 1993-11-16 2007-04-05 Formfactor, Inc. Contact Carriers (Tiles) For Populating Larger Substrates With Spring Contacts
US20090008757A1 (en) * 2005-07-01 2009-01-08 Wan-Shun Chou Method of fabricating substrate for package of semiconductor light-emitting device
US20110057303A1 (en) * 2005-05-18 2011-03-10 Texas Instruments Incorported Package for an Integrated Circuit
US20120273799A1 (en) * 2011-04-28 2012-11-01 Kabushiki Kaisha Toshiba Semiconductor device and fabrication method for the same
US20130029031A1 (en) * 2009-09-14 2013-01-31 Samsung Electro-Mechanics Co., Ltd. Method for manufacturing interposer

Family Cites Families (41)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH10200219A (ja) 1997-01-08 1998-07-31 Denki Kagaku Kogyo Kk 回路基板
JPH11330283A (ja) * 1998-05-15 1999-11-30 Toshiba Corp 半導体モジュール及び大型半導体モジュール
JP3070579B2 (ja) * 1998-06-10 2000-07-31 日本電気株式会社 半導体装置の実装構造および実装方法
JP2001053404A (ja) 1999-08-09 2001-02-23 Denki Kagaku Kogyo Kk 回路基板
US6703707B1 (en) * 1999-11-24 2004-03-09 Denso Corporation Semiconductor device having radiation structure
JP4969738B2 (ja) * 2001-06-28 2012-07-04 株式会社東芝 セラミックス回路基板およびそれを用いた半導体モジュール
JP2003078086A (ja) * 2001-09-04 2003-03-14 Kubota Corp 半導体素子モジュール基板の積層構造
JP2003168769A (ja) * 2001-11-30 2003-06-13 Mitsubishi Electric Corp 電力用半導体装置
EP1394857A3 (en) * 2002-08-28 2004-04-07 Matsushita Electric Industrial Co., Ltd. Semiconductor device
US7523617B2 (en) * 2004-10-22 2009-04-28 Nextreme Thermal Solutions, Inc. Thin film thermoelectric devices for hot-spot thermal management in microprocessors and other electronics
US7269017B2 (en) * 2004-11-19 2007-09-11 Delphi Technologies, Inc. Thermal management of surface-mount circuit devices on laminate ceramic substrate
US7365273B2 (en) * 2004-12-03 2008-04-29 Delphi Technologies, Inc. Thermal management of surface-mount circuit devices
JP2006344770A (ja) * 2005-06-09 2006-12-21 Mitsubishi Electric Corp 半導体モジュールおよび半導体装置
US20070031684A1 (en) * 2005-08-03 2007-02-08 Anderson Jeffrey T Thermally conductive grease
WO2007026547A1 (ja) * 2005-08-29 2007-03-08 Hitachi Metals, Ltd. 回路基板及びこれを用いた半導体モジュール、回路基板の製造方法
WO2007037306A1 (ja) * 2005-09-28 2007-04-05 Ngk Insulators, Ltd. ヒートシンクモジュール及びその製造方法
JP4759384B2 (ja) * 2005-12-20 2011-08-31 昭和電工株式会社 半導体モジュール
JP2008010520A (ja) 2006-06-28 2008-01-17 Sumitomo Metal Electronics Devices Inc パワーモジュール用基板及びその製造方法
JP4436843B2 (ja) * 2007-02-07 2010-03-24 株式会社日立製作所 電力変換装置
JP5227532B2 (ja) * 2007-04-02 2013-07-03 日立オートモティブシステムズ株式会社 インバータ回路用の半導体モジュール
KR100825766B1 (ko) * 2007-04-26 2008-04-29 한국전자통신연구원 Ｌｔｃｃ 패키지 및 그 제조방법
JP2008294280A (ja) * 2007-05-25 2008-12-04 Showa Denko Kk 半導体装置
KR101448849B1 (ko) * 2007-11-16 2014-10-14 페어차일드코리아반도체 주식회사 전력 모듈 및 그 제조 방법
US8076773B2 (en) * 2007-12-26 2011-12-13 The Bergquist Company Thermal interface with non-tacky surface
JP2009283741A (ja) * 2008-05-23 2009-12-03 Fuji Electric Device Technology Co Ltd 半導体装置
JP5566289B2 (ja) * 2008-06-12 2014-08-06 三菱電機株式会社 電力半導体回路装置およびその製造方法
US8472193B2 (en) * 2008-07-04 2013-06-25 Kabushiki Kaisha Toyota Jidoshokki Semiconductor device
US8929071B2 (en) * 2008-12-22 2015-01-06 General Electric Company Low cost manufacturing of micro-channel heatsink
JP5120284B2 (ja) * 2009-02-04 2013-01-16 株式会社豊田自動織機 半導体装置
CN102439719B (zh) * 2009-05-14 2015-06-24 高通股份有限公司 系统级封装
DE102009033029A1 (de) 2009-07-02 2011-01-05 Electrovac Ag Elektronische Vorrichtung
CN102498564B (zh) * 2009-09-09 2015-08-26 三菱综合材料株式会社 带散热器的功率模块用基板的制造方法、带散热器的功率模块用基板及功率模块
JP5392272B2 (ja) * 2011-01-13 2014-01-22 株式会社豊田自動織機 両面基板、半導体装置、半導体装置の製造方法
US20120235293A1 (en) * 2011-03-15 2012-09-20 Infineon Technologies Ag Semiconductor device including a base plate
US8963321B2 (en) * 2011-09-12 2015-02-24 Infineon Technologies Ag Semiconductor device including cladded base plate
US8519532B2 (en) * 2011-09-12 2013-08-27 Infineon Technologies Ag Semiconductor device including cladded base plate
US8962393B2 (en) * 2011-09-23 2015-02-24 Stats Chippac Ltd. Integrated circuit packaging system with heat shield and method of manufacture thereof
JP5370460B2 (ja) * 2011-10-28 2013-12-18 日立金属株式会社 半導体モジュール
US8872332B2 (en) * 2012-04-30 2014-10-28 Infineon Technologies Ag Power module with directly attached thermally conductive structures
KR101388781B1 (ko) * 2012-06-22 2014-04-23 삼성전기주식회사 전력 모듈용 방열 시스템
WO2014034245A1 (ja) * 2012-08-31 2014-03-06 三菱マテリアル株式会社 パワーモジュール用基板及びパワーモジュール

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20070075715A1 (en) * 1993-11-16 2007-04-05 Formfactor, Inc. Contact Carriers (Tiles) For Populating Larger Substrates With Spring Contacts
US20110057303A1 (en) * 2005-05-18 2011-03-10 Texas Instruments Incorported Package for an Integrated Circuit
US20090008757A1 (en) * 2005-07-01 2009-01-08 Wan-Shun Chou Method of fabricating substrate for package of semiconductor light-emitting device
US20130029031A1 (en) * 2009-09-14 2013-01-31 Samsung Electro-Mechanics Co., Ltd. Method for manufacturing interposer
US20120273799A1 (en) * 2011-04-28 2012-11-01 Kabushiki Kaisha Toshiba Semiconductor device and fabrication method for the same

Also Published As

Publication number Publication date
JP2016072281A (ja) 2016-05-09
US20160095213A1 (en) 2016-03-31
CN105470236A (zh) 2016-04-06
JP6341822B2 (ja) 2018-06-13
US9721861B2 (en) 2017-08-01
DE102015215133B4 (de) 2020-04-23
DE102015215133A1 (de) 2016-03-31

Similar Documents

Publication Publication Date Title
CN105470236B (zh) 半导体装置
US8455987B1 (en) Electrically isolated power semiconductor package with optimized layout
US9362192B2 (en) Semiconductor device comprising heat dissipating connector
Dietrich Trends in automotive power semiconductor packaging
US20130328200A1 (en) Direct bonded copper substrate and power semiconductor module
TW200541085A (en) Packaged integrated circuit with MLP leadframe and method of making same
CN109599383A (zh) 半导体装置
CN107039374A (zh) 功能化的接合结构
CN106373947B (zh) 鲁棒高性能半导体封装
US9768092B2 (en) Carrier package and carrier with plural heat conductors
US20200075455A1 (en) Circuit Cooled on Two Sides
US9443784B2 (en) Semiconductor module including plate-shaped insulating members having different thickness
CN104037152B (zh) 芯片载体结构、芯片封装及其制造方法
US11955450B2 (en) Method for producing a semiconductor arrangement
CN110098178A (zh) 半导体器件
JP6303776B2 (ja) 半導体装置
US20050285260A1 (en) Bottom heat spreader
CN109346449A (zh) 一种大功率高电压ltcc模块散热封装
CN106992157B (zh) 半导体装置
US11107755B2 (en) Packaging for lateral high voltage GaN power devices
US20160021780A1 (en) Carrier, Semiconductor Module and Fabrication Method Thereof
CN112687640A (zh) 散热板，其制造方法，以及包括其的半导体封装
CN112310029A (zh) 衬板和基体集成的功率半导体器件及其制造方法
JP2015119116A (ja) 半導体装置
US11532534B2 (en) Semiconductor module

Legal Events

Date Code Title Description
C06 Publication
PB01 Publication
C10 Entry into substantive examination
SE01 Entry into force of request for substantive examination
GR01 Patent grant
GR01 Patent grant