CN103377986B - 接触孔的制作方法 - Google Patents
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Abstract
本发明公开了一种接触孔的制作方法。首先提供衬底,衬底上包括层间介质层;在层间介质层上形成抗反射层;在抗反射层上涂布光刻胶层;进行光刻工艺,在光刻胶层中形成第一开口;进行第一次干蚀刻工艺,经由所述第一开口蚀刻抗反射层及层间介质层,形成具有第一深度的沟槽;将所述光刻胶层中的第一开口缩小成为第二开口;以及进行第二次干蚀刻工艺,经由所述第二开口蚀刻所述层间介质层,形成具有第二深度的通孔。优点在于:仅需要进行单次的光刻工艺,配合一次的RELACS光刻胶扩大以及两次干蚀刻工艺,就可以形成接触孔,因此步骤上较为简单,而且省略了一道光掩膜,成本因此降低许多。
Description
技术领域
本发明涉及半导体制造领域,特别涉及一种接触孔(contacthole)的制作方法。
背景技术
在半导体集成电路的制作过程中常伴随通孔或沟槽的制作,例如,铜金属互连工艺即需要先形成嵌入式线槽及通孔,又称双大马士革工艺(dualdamascene),又例如,于层间介质层中形成接触孔。其中,由于接触孔常被用来导通晶体管的栅极、源极或漏极等位于半导体衬底上的重要电路器件,因此至关重要。
随着半导体集成电路关键尺寸的不断缩小,半导体制程工艺对减少接触孔阻值的需求也是越来越高。传统的接触孔制作方法通常需要进行两次的光刻工艺,搭配两次的光刻胶涂布及两次的干蚀刻工艺才能于层间介质层中形
发明内容
本发明于是提供一种接触孔的制作方法,以解决上述问题。
本发明披露了一种接触孔的制作方法,其特征在于,包括:提供衬底,衬底上包括层间介质层;在层间介质层上形成抗反射层;在抗反射层上涂布光刻胶层;进行光刻工艺,在光刻胶层中形成第一开口;进行第一次干蚀刻工艺,经由所述第一开口蚀刻抗反射层及层间介质层,形成具有第一深度的沟槽;将所述光刻胶层中的第一开口缩小成为第二开口;以及进行第二次干蚀刻工艺,经由所述第二开口蚀刻所述层间介质层,形成具有第二深度的通孔。
为让本发明上述目的、特征及优点能更明显易懂,下文特举优选实施方式,并配合所附图式,作详细说明如下。然而如下的优选实施方式与图式仅供参考与说明用,并非用来对本发明加以限制。
附图说明
图1至图5例示本发明一优选实施例。
其中,附图标记说明如下:
10衬底12层间介质层
12a沟槽12b通孔
14抗反射层16光刻胶层
16a开口16b开口
18高分子材料层120接触孔
具体实施方式
图1至图5例示本发明一优选实施例。如图1所示,首先提供衬底10,衬底10上已经形成了半导体器件,例如MOS晶体管。衬底10可以是单晶硅、多晶硅、非晶硅、砷化镓或硅锗化合物;衬底10亦可以是其它半导体材料,这里不再一一列举。
在衬底10上形成层间介质层12,层间介质层12的材料可以是掺杂硅玻璃、二氧化硅或低介电常数材料等等,其形成方法可以是化学气相沉积法(CVD)或旋转涂布法(SOC)。接着,在层间介质层12上形成抗反射层(ARC)14,该层的材料可以是氮氧化硅(SiON)或氮化硅等。接着,在抗反射层14上涂布光刻胶层16,接着进行光刻工艺,包括:对光刻胶层16进行烘烤后置于曝光设备中,通过曝光工艺对光刻胶层16进行曝光,将掩模板上的图案转移到光刻胶层中;接着对曝光后的光刻胶层16进行曝光后烘烤,并通过显影工艺进行显影,在光刻胶层16中形成开口16a。
如图2所示,接着进行第一次干蚀刻工艺,包括以光刻胶层16作为掩膜,经由开口16a干蚀刻抗反射层14及层间介质层12,形成具有第一深度的沟槽12a,其中,第一次干蚀刻工艺不会蚀穿层间介质层12的全部厚度,而是仅仅蚀刻掉层间介质层12的部分厚度。此部分厚度可以透过控制干蚀刻的时间来达成,或者在层间介质层12中增加蚀刻停止层。
如图3所示,在第一次干蚀刻工艺之后,通过由化学微缩辅助的分辨率增强光刻(ResolutionEnhancementLithographyAssistedbyChemicalShrink,RELACS)的光刻胶扩大工艺,在光刻胶层16的表面及侧壁上形成能与光刻胶层16产生交联反应(cross-linkingreaction)的高分子材料层18,将原本的光刻胶层16中的开口16a缩小成为开口16b。
如图4所示,接着进行第二次干蚀刻工艺,包括以光刻胶层16以及高分子材料层18作为掩膜,经由开口16b以及沟槽12a继续干蚀刻层间介质层12,形成具有第二深度的通孔12b,其中,第二次干蚀刻工艺蚀穿层间介质层12的剩余厚度,显露出衬底10的表面。
如图5所示,在第二次干蚀刻工艺后,去除剩余的光刻胶层16、高分子材料层18以及抗反射层14,即完成接触孔120的制作。根据此优选实施例,接触孔120包括第一深度的沟槽12a以及第二深度的通孔12b,其中通孔12b的尺寸小于沟槽12a的尺寸。此外,沟槽12a以及通孔12b可以是线条的沟槽图案或者是局部的孔洞图案。本发明的优点在于:仅需要进行单次的光刻工艺,配合一次的RELACS光刻胶扩大以及两次干蚀刻工艺,就可以形成接触孔120,因此步骤上较为简单,而且省略了一道光掩膜,成本因此降低许多。
以上所述仅为本发明的优选实施例而已,并不用于限制本发明,对于本领域的技术人员来说,本发明可以有各种更改和变化。凡在本发明的精神和原则之内,所作的任何修改、等同替换、改进等,均应包含在本发明的保护范围之内。
Claims (3)
1.一种接触孔的制作方法,其特征在于,包括:
提供衬底,所述衬底上包括层间介质层;
在所述层间介质层上形成抗反射层;
在所述抗反射层上涂布光刻胶层;
进行光刻工艺,在所述光刻胶层中形成第一开口;
进行第一次干蚀刻工艺,经由所述第一开口蚀刻所述抗反射层及所述层间介质层,形成具有第一深度的沟槽,所述第一次干蚀刻工艺不会蚀穿所述层间介质层的全部厚度;
通过由化学微缩辅助的分辨率增强光刻的光刻胶的扩大工艺,在不移除所述光刻胶层的情况下,将所述光刻胶层中的所述第一开口缩小成为第二开口,所述光刻胶的扩大工艺包括:在所述光刻胶层的表面及侧壁上形成能与所述光刻胶层产生交联反应的高分子材料层;以及
进行第二次干蚀刻工艺,经由所述第二开口蚀刻所述层间介质层,形成具有第二深度的通孔,所述第二次干蚀刻工艺蚀穿层间介质层的剩余厚度,显露出所述衬底的表面。
2.根据权利要求1所述的接触孔的制作方法,其特征在于:所述层间介质层的材料包括掺杂硅玻璃、二氧化硅或低介电常数材料。
3.根据权利要求1所述的接触孔的制作方法,其特征在于:所述通孔的尺寸小于所述沟槽的尺寸。
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Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6319809B1 (en) * | 2000-07-12 | 2001-11-20 | Taiwan Semiconductor Manfacturing Company | Method to reduce via poison in low-k Cu dual damascene by UV-treatment |
CN101266941A (zh) * | 2007-03-15 | 2008-09-17 | 台湾积体电路制造股份有限公司 | 双镶嵌制造工艺 |
Family Cites Families (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3348786B2 (ja) * | 2000-01-11 | 2002-11-20 | 日本電気株式会社 | フォトマスク、パターン形成方法、半導体集積回路 |
JP3787271B2 (ja) * | 2000-11-20 | 2006-06-21 | 東京応化工業株式会社 | 微細レジストホールパターン形成方法 |
-
2012
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Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6319809B1 (en) * | 2000-07-12 | 2001-11-20 | Taiwan Semiconductor Manfacturing Company | Method to reduce via poison in low-k Cu dual damascene by UV-treatment |
CN101266941A (zh) * | 2007-03-15 | 2008-09-17 | 台湾积体电路制造股份有限公司 | 双镶嵌制造工艺 |
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