CH660102A5 - Einrichtung zur erzeugung von pseudozufalls-bitfolgen. - Google Patents

Einrichtung zur erzeugung von pseudozufalls-bitfolgen. Download PDF

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CH660102A5
CH660102A5 CH171/83A CH17183A CH660102A5 CH 660102 A5 CH660102 A5 CH 660102A5 CH 171/83 A CH171/83 A CH 171/83A CH 17183 A CH17183 A CH 17183A CH 660102 A5 CH660102 A5 CH 660102A5
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CH
Switzerland
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output
input
inputs
gate
blocks
Prior art date
Application number
CH171/83A
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Inventor
Maurizio Pioli
Original Assignee
Int Standard Electric Corp
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Publication date
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    • G06F7/582Pseudo-random number generators
    • G06F7/584Pseudo-random number generators using finite field arithmetic, e.g. using a linear feedback shift register
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F2207/00Indexing scheme relating to methods or arrangements for processing data by operating upon the order or content of the data handled
    • G06F2207/58Indexing scheme relating to groups G06F7/58 - G06F7/588
    • G06F2207/581Generating an LFSR sequence, e.g. an m-sequence; sequence may be generated without LFSR, e.g. using Galois Field arithmetic
    • GPHYSICS
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    • G06F2207/58Indexing scheme relating to groups G06F7/58 - G06F7/588
    • G06F2207/583Serial finite field implementation, i.e. serial implementation of finite field arithmetic, generating one new bit or trit per step, e.g. using an LFSR or several independent LFSRs; also includes PRNGs with parallel operation between LFSR and outputs

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IT19147/82A IT1153414B (it) 1982-01-15 1982-01-15 Dispositivo per la generazione di sequenze pseudo casuali di cifre binarie

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AU557654B2 (en) 1987-01-08
FR2520136B1 (fr) 1990-09-14
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IT8219147A0 (it) 1982-01-15
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