WO2013035841A1 - Ga2O3系HEMT - Google Patents

Ga2O3系HEMT Download PDF

Info

Publication number
WO2013035841A1
WO2013035841A1 PCT/JP2012/072896 JP2012072896W WO2013035841A1 WO 2013035841 A1 WO2013035841 A1 WO 2013035841A1 JP 2012072896 W JP2012072896 W JP 2012072896W WO 2013035841 A1 WO2013035841 A1 WO 2013035841A1
Authority
WO
WIPO (PCT)
Prior art keywords
single crystal
type
crystal film
substrate
film
Prior art date
Application number
PCT/JP2012/072896
Other languages
English (en)
French (fr)
Inventor
公平 佐々木
東脇 正高
藤田 静雄
大友 明
孝仁 大島
Original Assignee
株式会社タムラ製作所
独立行政法人情報通信研究機構
国立大学法人京都大学
国立大学法人東京工業大学
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 株式会社タムラ製作所, 独立行政法人情報通信研究機構, 国立大学法人京都大学, 国立大学法人東京工業大学 filed Critical 株式会社タムラ製作所
Publication of WO2013035841A1 publication Critical patent/WO2013035841A1/ja

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/66007Multistep manufacturing processes
    • H01L29/66075Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
    • H01L29/66227Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
    • H01L29/66409Unipolar field-effect transistors
    • H01L29/66446Unipolar field-effect transistors with an active layer made of a group 13/15 material, e.g. group 13/15 velocity modulation transistor [VMT], group 13/15 negative resistance FET [NERFET]
    • H01L29/66462Unipolar field-effect transistors with an active layer made of a group 13/15 material, e.g. group 13/15 velocity modulation transistor [VMT], group 13/15 negative resistance FET [NERFET] with a heterojunction interface channel or gate, e.g. HFET, HIGFET, SISFET, HJFET, HEMT
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02367Substrates
    • H01L21/0237Materials
    • H01L21/02414Oxide semiconducting materials not being Group 12/16 materials, e.g. ternary compounds
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02367Substrates
    • H01L21/02433Crystal orientation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02436Intermediate layers between substrates and deposited layers
    • H01L21/02439Materials
    • H01L21/02483Oxide semiconducting materials not being Group 12/16 materials, e.g. ternary compounds
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02518Deposited layers
    • H01L21/02521Materials
    • H01L21/02565Oxide semiconducting materials not being Group 12/16 materials, e.g. ternary compounds
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02518Deposited layers
    • H01L21/0257Doping during depositing
    • H01L21/02573Conductivity type
    • H01L21/02576N-type
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02612Formation types
    • H01L21/02617Deposition types
    • H01L21/02631Physical deposition at reduced pressure, e.g. MBE, sputtering, evaporation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/12Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/15Structures with periodic or quasi periodic potential variation, e.g. multiple quantum wells, superlattices
    • H01L29/157Doping structures, e.g. doping superlattices, nipi superlattices
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/778Field effect transistors with two-dimensional charge carrier gas channel, e.g. HEMT ; with two-dimensional charge-carrier layer formed at a heterojunction interface
    • H01L29/7786Field effect transistors with two-dimensional charge carrier gas channel, e.g. HEMT ; with two-dimensional charge-carrier layer formed at a heterojunction interface with direct single heterostructure, i.e. with wide bandgap layer formed on top of active layer, e.g. direct single heterostructure MIS-like HEMT
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/12Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/20Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only AIIIBV compounds
    • H01L29/201Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only AIIIBV compounds including two or more compounds, e.g. alloys
    • H01L29/205Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only AIIIBV compounds including two or more compounds, e.g. alloys in different semiconductor regions, e.g. heterojunctions

Definitions

  • the present invention relates to a Ga 2 O 3 -based HEMT.
  • Ga 2 O 3 based semiconductor device using a Ga 2 O 3 crystal film formed on a sapphire substrate is known (e.g., see Non-Patent Documents 1 and 2) .
  • Ga 2 O 3 crystals and sapphire crystals have completely different crystal structures, it is very difficult to heteroepitaxially grow Ga 2 O 3 crystals on a sapphire substrate. For this reason, it is difficult to form a high-quality Ga 2 O 3 based semiconductor element using a Ga 2 O 3 crystal film on a sapphire substrate.
  • an object of the present invention is to provide a high quality Ga 2 O 3 based semiconductor device.
  • one embodiment of the present invention provides Ga 2 O 3 -based HEMTs (High Electron Mobility Transistors) [1] to [6].
  • the average concentration of the group IV element in the n-type ⁇ - (Al x Ga 1-x ) 2 O 3 crystal film is 1 ⁇ 10 14 to 1 ⁇ 10 20 / cm 3 .
  • According to the present invention can provide a Ga 2 O 3 based HEMT is Ga 2 O 3 based semiconductor device with high quality.
  • Sectional view of the Ga 2 O 3 based HEMT according to the embodiment Configuration diagram schematically showing a configuration of an MBE apparatus according to an embodiment Sectional drawing of high resistance ⁇ -Ga 2 O 3 substrate, i-type ⁇ -Ga 2 O 3 single crystal film, and n-type ⁇ - (Al x Ga 1 -x ) 2 O 3 single crystal film according to the embodiment Sectional drawing of high resistance ⁇ -Ga 2 O 3 substrate, i-type ⁇ -Ga 2 O 3 single crystal film, and n-type ⁇ - (Al x Ga 1 -x ) 2 O 3 single crystal film according to the embodiment
  • a high-quality n-type ⁇ - (Al x Ga 1-x ) 2 O 3 crystal film is formed using a heteroepitaxial growth method, and the high-quality n-type ⁇ - (Al A high-quality Ga 2 O 3 -based HEMT can be formed using the x Ga 1-x ) 2 O 3 crystal film.
  • Al x Ga 1-x ) 2 O 3 crystal film is formed using a heteroepitaxial growth method, and the high-quality n-type ⁇ - (Al A high-quality Ga 2 O 3 -based HEMT can be formed using the x Ga 1-x ) 2 O 3 crystal film.
  • FIG. 1 is a cross-sectional view of a Ga 2 O 3 -based HEMT 20 according to the embodiment.
  • the Ga 2 O 3 HEMT 20 includes an i-type ⁇ -Ga 2 O 3 single crystal film 3 formed on a high resistance ⁇ -Ga 2 O 3 substrate 2 and an i-type ⁇ -Ga 2 O 3 single crystal film 3.
  • the high resistance ⁇ -Ga 2 O 3 substrate 2 includes Mg, H, Li, Na, K, Rb, CS, Fr, Be, Ca, Sr, Ba, Ra, Mn, Fe, Co, Ni, Pd, Cu, This is a ⁇ -Ga 2 O 3 substrate whose resistance is increased by adding Ag, Au, Zn, Cd, Hg, Tl, Pb, N, P or the like.
  • the main surface of the high resistance ⁇ -Ga 2 O 3 substrate 2 is preferably a surface rotated by an angle of 50 ° or more and 90 ° or less from the (100) plane. That is, the angle ⁇ (0 ⁇ ⁇ 90 °) formed by the main surface and the (100) plane in the high resistance ⁇ -Ga 2 O 3 substrate 2 is preferably 50 ° or more.
  • (010) plane, (001) plane, ( ⁇ 201) plane, (101) plane, and (310) plane exist as planes rotated from 50 ° to 90 ° from (100) plane.
  • the main surface of the high resistance ⁇ -Ga 2 O 3 substrate 2, (100) if a surface which is rotated by an angle of less than 50 ° or 90 ° from the plane, beta on the high-resistance ⁇ -Ga 2 O 3 substrate 2
  • re-evaporation of the raw material of the ⁇ -Ga 2 O 3 -based crystal from the high-resistance ⁇ -Ga 2 O 3 substrate 2 can be effectively suppressed.
  • the main surface of the high resistance ⁇ -Ga 2 O 3 substrate 2 when the ratio of the raw material re-evaporated when the ⁇ -Ga 2 O 3 based crystal is grown at a growth temperature of 500 ° C. is 0%.
  • the ratio of the re-evaporated raw material can be suppressed to 40% or less. Therefore, it is possible to use more than 60% of the raw material supplied to the formation of ⁇ -Ga 2 O 3 system crystal, from the viewpoint of the growth rate and production cost of the ⁇ -Ga 2 O 3 system crystal.
  • the (100) plane when the (100) plane is rotated 52.5 ° about the c axis, it coincides with the (310) plane, and when it is rotated 90 °, it coincides with the (010) plane.
  • the (100) plane is rotated 53.8 ° about the b axis, it coincides with the (101) plane or the ( ⁇ 201) plane depending on the rotation direction, and the (100) plane is rotated 53.8 °.
  • it is rotated 76.3 ° in the rotation direction in which the (101) plane appears, it coincides with the (001) plane.
  • the main surface of the high resistance ⁇ -Ga 2 O 3 substrate 2 may be a surface rotated by an angle of 37.5 ° or less from the (010) plane.
  • the interface between the high resistance ⁇ -Ga 2 O 3 substrate 2 and the i-type ⁇ -Ga 2 O 3 single crystal film 3 can be made sharp, and the i-type ⁇ -Ga 2 O 3 single crystal film 3 Can be controlled with high accuracy.
  • the i-type ⁇ -Ga 2 O 3 single crystal film 3 is an intrinsic semiconductor single crystal film formed on the high resistance ⁇ -Ga 2 O 3 substrate 2 by a method described later.
  • the thickness of the i-type ⁇ -Ga 2 O 3 single crystal film 3 is, for example, about 10 to 1000 nm.
  • the n-type ⁇ - (Al x Ga 1-x ) 2 O 3 single crystal film 4 is an n-type conductive film formed on the i-type ⁇ -Ga 2 O 3 single crystal film 3 by a method described later. It is a type ⁇ - (Al x Ga 1-x ) 2 O 3 (0 ⁇ x ⁇ 0.6) single crystal film.
  • the thickness of the n-type ⁇ - (Al x Ga 1 -x ) 2 O 3 single crystal film 4 is, for example, about 10 to 1000 nm.
  • the source region 24 and the drain region 25 are impurity high concentration regions formed in the n-type ⁇ - (Al x Ga 1 -x ) 2 O 3 single crystal film 4, and the source electrode 22 and the drain electrode 23 are connected to each other. Is done. Note that the source region 24 and the drain region 25 may not be included in the Ga 2 O 3 -based HEMT 20.
  • the gate electrode 21 is, for example, a metal such as Au, Al, Ti, Sn, Ge, In, Ni, Co, Pt, W, Mo, Cr, Cu, Pb, or an alloy containing two or more of these metals. It consists of a conductive compound such as ITO, or a conductive polymer.
  • a conductive polymer a polythiophene derivative (PEDOT: poly (3,4) -ethylenedioxythiophene) doped with polystyrene sulfonic acid (PSS) or a polypyrrole derivative doped with TCNA is used.
  • the gate electrode 21 may have a two-layer structure made of two different metals, such as Al / Ti, Au / Ni, and Au / Co.
  • the interface between the gate electrode 21 and the n-type ⁇ - (Al x Ga 1-x ) 2 O 3 single crystal film 4 forms a Schottky junction, and the n-type ⁇ - (Al x Ga 1-x ) 2 O 3 single crystal
  • a depletion layer is formed under the gate electrode 31 in the film 4.
  • the interface between the n-type ⁇ - (Al x Ga 1-x ) 2 O 3 single crystal film 4 and the i-type ⁇ -Ga 2 O 3 single crystal film 3 forms a heterojunction, and the i-type ⁇ in the vicinity of the interface is formed.
  • a two-dimensional electron layer is formed on the surface of the —Ga 2 O 3 single crystal film 3 and functions as a channel.
  • the production method of ⁇ -Ga 2 O 3 single crystal film and n-type ⁇ - (Al x Ga 1 -x ) 2 O 3 single crystal film includes PLD (Pulsed Laser Deposition) method, CVD (Chemical Vapor Deposition) method, There are a sputtering method, a molecular beam epitaxy (MBE) method, and the like.
  • a thin film growth method using the MBE method is employed.
  • the MBE method is a crystal growth method in which a simple substance or a compound solid is heated by an evaporation source called a cell, and vapor generated by heating is supplied as a molecular beam to a substrate surface.
  • FIG. 2 is a block diagram showing an example of an MBE apparatus used for forming a ⁇ -Ga 2 O 3 single crystal film.
  • the MBE apparatus 1 includes a vacuum chamber 10, a substrate holder 11 that is supported in the vacuum chamber 10 and holds the high resistance ⁇ -Ga 2 O 3 substrate 2, and a high resistance ⁇ -Ga that is held by the substrate holder 11.
  • the substrate holder 11 is configured to be rotatable by a motor (not shown) via a shaft 110.
  • the first cell 13a is filled with a Ga raw material of a ⁇ -Ga 2 O 3 single crystal film such as Ga powder. As for the purity of Ga of this powder, it is desirable that it is 6N or more.
  • the second cell 13b is filled with a raw material powder of a group IV element to be doped as a donor (for example, Sn powder as a raw material of Sn).
  • the third cell 13c is filled with Al raw material of a ⁇ - (Al x Ga 1 -x ) 2 O 3 single crystal film such as Al powder. Shutters are provided at the openings of the first cell 13a, the second cell 13b, and the third cell 13c.
  • a high resistance ⁇ -Ga 2 O 3 substrate 2 prepared in advance is attached to the substrate holder 11, and ⁇ -Ga 2 O 3 crystal is homoepitaxially grown on the high resistance ⁇ -Ga 2 O 3 substrate 2. Then, the i-type ⁇ -Ga 2 O 3 single crystal film 3 is formed. Further, the ⁇ - (Al x Ga 1-x ) 2 O 3 crystal is heteroepitaxially grown while adding a group IV element, whereby the n-type ⁇ - (Al x Ga 1-x ) 2 O 3 single crystal film 4 is formed.
  • the high-resistance ⁇ -Ga 2 O 3 substrate 2 is produced by the following procedure, for example.
  • a semi-insulating ⁇ -Ga 2 O 3 single crystal ingot doped with Mg is manufactured by the EFG method.
  • the element to be doped is not limited to Mg.
  • the raw material powder is mixed with MgO powder.
  • 0.05 mol% or more of MgO may be added.
  • a semi-insulating ⁇ -Ga 2 O 3 single crystal ingot may be produced by the FZ method. The produced ingot is sliced into a thickness of about 1 mm, for example, so that the desired plane orientation becomes the main surface, and is made into a substrate. Then, it is processed to a thickness of about 300 to 600 ⁇ m in a grinding and polishing process.
  • the high resistance ⁇ -Ga 2 O 3 substrate 2 manufactured by the above procedure is attached to the substrate holder 11 of the MBE apparatus 1.
  • the vacuum pump 16 is operated, and the pressure in the vacuum chamber 10 is reduced to about 1 ⁇ 10 ⁇ 8 Pa.
  • the high resistance ⁇ -Ga 2 O 3 substrate 2 is heated by the heating device 12.
  • the heating of the high resistance ⁇ -Ga 2 O 3 substrate 2 is such that the radiant heat of a heat source such as a graphite heater of the heating device 12 is conducted to the high resistance ⁇ -Ga 2 O 3 substrate 2 through the substrate holder 11. Is done.
  • an oxygen-based gas is supplied from the gas supply pipe 15 into the vacuum chamber 10.
  • the first heater 14 a rotates the substrate holder 11 and the first heater 14 a rotates.
  • One cell 13a is heated to evaporate Ga and irradiate the surface of the high resistance ⁇ -Ga 2 O 3 substrate 2 as a molecular beam.
  • the first cell 13 a is heated to 900 ° C., and the beam equivalent pressure (BEP; Beam Equivalent Pressure) of Ga vapor is 1 ⁇ 10 ⁇ 4 Pa.
  • BEP Beam Equivalent Pressure
  • ⁇ -Ga 2 O 3 crystal is homoepitaxially grown on the main surface ((100) plane) of the high-resistance ⁇ -Ga 2 O 3 substrate 2, and an i-type ⁇ -Ga 2 O 3 single crystal film is formed.
  • An i-type ⁇ -Ga 2 O 3 single crystal film 3 is formed.
  • the growth temperature of the ⁇ -Ga 2 O 3 crystal is 700 ° C., for example.
  • the second cell 13b and the third cell 13c are heated, and Ga, Al and IV group elements are evaporated to form an i-type ⁇ -Ga 2 O 3 single crystal as a molecular beam. Irradiate the surface of the film 3.
  • the beam equivalent pressure of the group IV element vapor is controlled by the temperature of the second cell 13b because the group IV element of any concentration is added to the ⁇ - (Al x Ga 1 -x ) 2 O 3 crystal.
  • ⁇ - (Al x Ga 1-x ) 2 O 3 crystal is heteroepitaxially grown on the i-type ⁇ -Ga 2 O 3 single crystal film 3 while adding a group IV element, and n-type ⁇ - (Al x A Ga 1-x ) 2 O 3 single crystal film 4 is formed.
  • the i-type ⁇ -Ga 2 O 3 single crystal film 3 and the n-type ⁇ - (Al x Ga 1 -x ) 2 O 3 single crystal film 4 are formed by a PLD (Pulsed Laser Deposition) method, a CVD (Chemical Vapor Deposition) method. It may be formed by a method or the like.
  • 3A and 3B show the high resistance ⁇ -Ga 2 O 3 substrate 2, the i-type ⁇ -Ga 2 O 3 single crystal film 3 and the n-type ⁇ - (Al x Ga 1-x ) 2 according to the present embodiment.
  • 3 is a cross-sectional view of an O 3 single crystal film 4.
  • FIG. 3A shows an n-type ⁇ - (Al x Ga 1-x ) formed by continuously adding group IV elements during heteroepitaxial growth of ⁇ - (Al x Ga 1-x ) 2 O 3 crystal.
  • the 2 O 3 single crystal film 4 is represented.
  • the average concentration of the group IV element in the n-type ⁇ - (Al x Ga 1 -x ) 2 O 3 single crystal film 4 is, for example, 1 ⁇ 10 14 to 1 ⁇ 10 20 / cm 3 , and in particular, 1 ⁇ 10 6. It is preferably 17 to 1 ⁇ 10 18 / cm 3 .
  • the concentration of the group IV element can be controlled by the temperature of the second cell 13b during film formation.
  • FIG. 3B shows n-type ⁇ - (Al x Ga 1) formed by intermittently adding a group IV element at a constant period during heteroepitaxial growth of ⁇ - (Al x Ga 1-x ) 2 O 3 crystal. -x ) 2 O 3 single crystal film 4 is represented. In this case, Sn is used as a group IV element.
  • Sn vapor is intermittently generated from the second cell 13b, and Sn is intermittently generated by ⁇ - (Al x Ga 1-x ) 2 O.
  • the addition of Sn is preferably carried out intermittently once or more. In this case, electric conductivity corresponding to the amount of Sn added can be imparted to the n-type ⁇ - (Al x Ga 1 -x ) 2 O 3 single crystal film 4 without annealing.
  • Sn is intermittently added at the time of film formation, so the first layer 5 grown during the time when Sn is not added. (5a, 5b, 5c) and the second layer 6 (6a, 6b, 6c) grown at the time of adding Sn.
  • the Sn concentration of the second layer 6 can be controlled by the temperature of the second cell 13b during film formation.
  • the first layer 5 ideally does not contain Sn, but only contains a small amount of Sn diffused from the second layer 6. Therefore, the Sn concentration of the first layer 5 is lower than the Sn concentration of the second layer 6.
  • the average Sn concentration in the n-type ⁇ - (Al x Ga 1 -x ) 2 O 3 single crystal film 4 is, for example, 1 ⁇ 10 14 to 3 ⁇ 10 18 / cm 3 , and in particular, 1 ⁇ 10 17 to It is preferably 1 ⁇ 10 18 / cm 3 .
  • the thickness of the first layers 5a, 5b, and 5c is 3 to 20 nm
  • the thickness of the second layers 6a, 6b, and 6c is 0.2 to 1 nm.
  • the thickness of the first layers 5a, 5b, and 5c is larger than 20 nm
  • the distance between the second layers 6a, 6b, and 6c is too large, and the effect of Sn addition may be reduced.
  • the thickness of the second layers 6a, 6b, 6c is larger than 1 nm, the amount of Sn diffusion from the second layers 6a, 6b, 6c to the first layers 5a, 5b, 5c is too large. Therefore, the effect of intermittent Sn addition may be reduced.
  • the lowermost layer of the n-type ⁇ - (Al x Ga 1-x ) 2 O 3 single crystal film 4 (the layer in contact with the i-type ⁇ -Ga 2 O 3 single crystal film 3) is the first layer 5.
  • the second layer 6 may be used. Further, the number of layers of the first layer 5 and the second layer 6 is not limited.
  • the source region 24 and the drain region 25 are formed.
  • the ions to be implanted are not limited to Sn.
  • Ga sites when substituting Ga sites, use Ti, ZR, Hf, V, Nb, Ta, Mo, W, Ru, Rh, Ir, C, Si, Ge, Pb, Mn, As, Sb, Bi. Can do.
  • oxygen site F, Cl, Br, or I can be used.
  • the implantation concentration is, for example, 1 ⁇ 10 18 / cm 3 or more and 5 ⁇ 10 19 / cm 3 or less.
  • the implantation depth is 30 nm or more.
  • the surface of the implantation region is etched by about 10 nm with hydrofluoric acid. Sulfuric acid, nitric acid, hydrochloric acid or the like may be used.
  • annealing treatment is performed at 800 ° C. or more for 30 minutes or more in a nitrogen atmosphere to recover implantation damage.
  • the treatment temperature may be 800 ° C. or more and 950 ° C. or less, and the treatment time may be 30 minutes or more.
  • the method for forming the source region 24 and the drain region 25 is not limited to ion implantation, and a thermal diffusion method may be used.
  • a metal film such as an Sn film is brought into contact with a region where the source region 24 and the drain region 25 of the n-type ⁇ - (Al x Ga 1 -x ) 2 O 3 single crystal film 4 are to be formed, and heat treatment is performed.
  • impurities such as Sn are diffused in the n-type ⁇ - (Al x Ga 1 -x ) 2 O 3 single crystal film 4.
  • the source region 24 and the drain region 25 may not be formed.
  • the source electrode 22, the drain electrode 23, and the gate electrode 21 are formed.
  • high-quality i-type ⁇ -Ga 2 O 3 single crystal film 3 and n-type ⁇ - (Al x Ga 1-x ) 2 O 3 single crystal film 4 are formed using an epitaxial growth method. These can be used to form a high-quality Ga 2 O 3 -based HEMT 20.
  • a Ga 2 O 3 -based HEMT that is a high-quality Ga 2 O 3 -based semiconductor element is provided.
  • 1 MBE apparatus, 2 ... high resistance ⁇ -Ga 2 O 3 substrate, 3 ... i-type ⁇ -Ga 2 O 3 single crystal film, 4 ... n-type ⁇ - (Al x Ga 1-x ) 2 O 3 single crystal film, 5 (5a, 5b, 5c ) ... first layer, 6 (6a, 6b, 6c ) ... second layer, 20 ... Ga 2 O 3 system HEMT, 21 ... gate electrode, 22 ... source electrode, 23 ... Drain electrode

Abstract

 高品質のGa23系半導体素子であるGa23系HEMTを提供する。 i型β-Ga23単結晶膜3と、i型β-Ga23単結晶膜3上に形成された、IV族元素を含むβ-(AlxGa1-x23(0<x≦0.6)結晶からなるn型β-(AlxGa1-x23単結晶膜4と、n型β-(AlxGa1-x23単結晶膜4上に形成されたソース電極22及びドレイン電極23と、ソース電極22とドレイン電極23との間のn型β-(AlxGa1-x23単結晶膜4上に形成されたゲート電極21と、を含むGa23系HEMT20を提供する。

Description

Ga2O3系HEMT
 本発明は、Ga23系HEMTに関する。
 従来のGa23系半導体素子として、サファイア基板上に形成されたGa23結晶膜を用いたGa23系半導体素子が知られている(例えば、非特許文献1、2参照)。
K. Matsuzaki et al. Thin Solid Films 496, 2006, pp.37-41. K. Matsuzaki et al. Appl. Phys. Lett. 88, 092106, 2006.
 しかしながら、Ga23結晶とサファイア結晶は結晶構造がまったく異なるため、サファイア基板上にGa23結晶をヘテロエピタキシャル成長させることは非常に困難である。このため、サファイア基板上のGa23結晶膜を用いて高品質のGa23系半導体素子を形成することは困難である。
 したがって、本発明の目的は、高品質のGa23系半導体素子を提供することにある。
 本発明の一態様は、上記目的を達成するために、[1]~[6]のGa23系HEMT(High Electron Mobility Transistor)を提供する。
[1]i型β-Ga23単結晶膜と、前記i型β-Ga23単結晶膜上に形成された、IV族元素を含むβ-(AlxGa1-x23(0<x≦0.6)結晶からなるn型β-(AlxGa1-x23単結晶膜と、前記n型β-(AlxGa1-x23単結晶膜上に形成されたソース電極及びドレイン電極と、前記ソース電極と前記ドレイン電極との間の前記n型β-(AlxGa1-x23単結晶膜上に形成されたゲート電極と、を含むGa23系HEMT。
[2]前記n型β-(AlxGa1-x23結晶膜中のIV族元素の平均濃度は1×1014~1×1020/cm3である、前記[1]に記載のGa23系HEMT。
 本発明によれば、高品質のGa23系半導体素子であるGa23系HEMTを提供することができる。
実施の形態に係るGa23系HEMTの断面図 実施の形態に係るMBE装置の構成を概略的に示す構成図 実施の形態に係る高抵抗β-Ga23基板、i型β-Ga23単結晶膜、及びn型β-(AlxGa1-x23単結晶膜の断面図 実施の形態に係る高抵抗β-Ga23基板、i型β-Ga23単結晶膜、及びn型β-(AlxGa1-x23単結晶膜の断面図
 本発明の実施の形態によれば、ヘテロエピタキシャル成長法を用いて高品質なn型β-(AlxGa1-x23結晶膜を形成し、その高品質のn型β-(AlxGa1-x23結晶膜を用いて、高品質のGa23系HEMTを形成することができる。以下、その実施の形態の一例について詳細に説明する。
〔実施の形態〕
(Ga23系HEMTの構成)
 図1は、実施の形態に係るGa23系HEMT20の断面図である。Ga23系HEMT20は、高抵抗β-Ga23基板2上に形成されたi型β-Ga23単結晶膜3と、i型β-Ga23単結晶膜3上に形成されたIV族元素を含むn型β-(AlxGa1-x23単結晶膜4と、n型β-(AlxGa1-x23単結晶膜4上に形成されたソース電極22及びドレイン電極23と、ソース電極22とドレイン電極23の間のn型β-(AlxGa1-x23単結晶膜4上に形成されたゲート電極21を含む。
 高抵抗β-Ga23基板2は、Mg、H、Li、Na、K、Rb、CS、Fr、Be、Ca、Sr、Ba、Ra、Mn、Fe、Co、Ni、Pd、Cu、Ag、Au、Zn、Cd、Hg、Tl、Pb、N、又はP等を添加することにより高抵抗化したβ-Ga23基板である。
 高抵抗β-Ga23基板2の主面は、(100)面から50°以上90°以下の角度だけ回転させた面であることが好ましい。すなわち、高抵抗β-Ga23基板2において主面と(100)面のなす角θ(0<θ≦90°)が50°以上であることが好ましい。(100)面から50°以上90°以下回転させた面として、例えば、(010)面、(001)面、(-201)面、(101)面、及び(310)面が存在する。
 高抵抗β-Ga23基板2の主面が、(100)面から50°以上90°以下の角度だけ回転させた面である場合、高抵抗β-Ga23基板2上にβ-Ga23系結晶をエピタキシャル成長させるときに、β-Ga23系結晶の原料の高抵抗β-Ga23基板2からの再蒸発を効果的に抑えることができる。具体的には、β-Ga23系結晶を成長温度500℃で成長させたときに再蒸発する原料の割合を0%としたとき、高抵抗β-Ga23基板2の主面が、(100)面から50°以上90°以下回転させた面である場合、再蒸発する原料の割合を40%以下に抑えることができる。そのため、供給する原料の60%以上をβ-Ga23系結晶の形成に用いることができ、β-Ga23系結晶の成長速度や製造コストの観点から好ましい。
 β-Ga23結晶は単斜晶系の結晶構造を有し、その典型的な格子定数はa=12.23Å、b=3.04Å、c=5.80Å、α=γ=90°、β=103.7°である。β-Ga23結晶においては、c軸を軸として(100)面を52.5°回転させると(310)面と一致し、90°回転させると(010)面と一致する。また、b軸を軸として(100)面を53.8°回転させると、回転方向によって(101)面又は(-201)面と一致し、(100)面を53.8°回転させたときに(101)面が現れる回転方向へ76.3°回転させると(001)面と一致する。
 また、高抵抗β-Ga23基板2の主面は、(010)面から37.5°以下の角度だけ回転させた面であってもよい。この場合、高抵抗β-Ga23基板2とi型β-Ga23単結晶膜3との界面を急峻にすることができると共に、i型β-Ga23単結晶膜3の厚みを高精度に制御することができる。
 i型β-Ga23単結晶膜3は、後述される方法により高抵抗β-Ga23基板2上に形成された真性半導体単結晶膜である。i型β-Ga23単結晶膜3の厚さは、例えば、10~1000nm程度である。
 n型β-(AlxGa1-x23単結晶膜4は、後述される方法によりi型β-Ga23単結晶膜3上に形成された、電気伝導性を有するn型β-(AlxGa1-x23(0<x≦0.6)単結晶膜である。n型β-(AlxGa1-x23単結晶膜4の厚さは、例えば、10~1000nm程度である。
 ソース領域24とドレイン領域25は、n型β-(AlxGa1-x23単結晶膜4中に形成される不純物高濃度領域であり、それぞれソース電極22とドレイン電極23が接続される。なお、ソース領域24とドレイン領域25はGa23系HEMT20に含まれなくてもよい。
 ゲート電極21は、例えば、Au、Al、Ti、Sn、Ge、In、Ni、Co、Pt、W、Mo、Cr、Cu、Pb等の金属、これらの金属のうちの2つ以上を含む合金、ITO等の導電性化合物、又は導線性ポリマーからなる。導線性ポリマーとしては、ポリチオフェン誘導体(PEDOT:ポリ(3,4)-エチレンジオキシチオフェン)にポリスチレンスルホン酸(PSS)をドーピングしたものや、ポリピロール誘導体にTCNAをドーピングしたものなどが用いられる。また、ゲート電極21は、異なる2つの金属からなる2層構造、例えばAl/Ti、Au/Ni、Au/Co、を有してもよい。
 ゲート電極21とn型β-(AlxGa1-x23単結晶膜4の界面はショットキー接合を形成し、n型β-(AlxGa1-x23単結晶膜4中のゲート電極31下に空乏層が形成される。また、n型β-(AlxGa1-x23単結晶膜4とi型β-Ga23単結晶膜3の界面はヘテロ接合を形成し、この界面近傍のi型β-Ga23単結晶膜3の表面に二次元的な電子層が形成され、チャネルとして働く。
(β-Ga23単結晶膜及びn型β-(AlxGa1-x23単結晶膜の製造方法)
 β-Ga23単結晶膜及びn型β-(AlxGa1-x23単結晶膜の製造方法としては、PLD(Pulsed Laser Deposition)法、CVD(Chemical Vapor Deposition)法、スパッタリング法、分子線エピタキシー(MBE;Molecular Beam Epitaxy)法等があるが、本実施の形態では、MBE法を用いた薄膜成長法を採用する。MBE法は、単体あるいは化合物の固体をセルと呼ばれる蒸発源で加熱し、加熱により生成された蒸気を分子線として基板表面に供給する結晶成長方法である。
 図2は、β-Ga23系単結晶膜の形成に用いられるMBE装置の一例を示す構成図である。このMBE装置1は、真空槽10と、この真空槽10内に支持され、高抵抗β-Ga23基板2を保持する基板ホルダ11と、基板ホルダ11に保持された高抵抗β-Ga23基板2を加熱するための加熱装置12と、薄膜を構成する原子又は分子ごとに設けられた複数のセル13(13a,13b、13c)と、複数のセル13を加熱するためのヒータ14(14a,14b、14c)と、真空槽10内に酸素系ガスを供給するガス供給パイプ15と、真空槽10内の空気を排出するための真空ポンプ16とを備えている。基板ホルダ11は、シャフト110を介して図示しないモータにより回転可能に構成されている。
 第1のセル13aには、Ga粉末等のβ-Ga23系単結晶膜のGa原料が充填されている。この粉末のGaの純度は、6N以上であることが望ましい。第2のセル13bには、ドナーとしてドーピングされるIV族元素の原料の粉末(例えば、Snの原料としてSn粉末)が充填されている。第3のセル13cには、Al粉末等のβ-(AlxGa1-x23単結晶膜のAl原料が充填されている。第1のセル13a、第2のセル13b、及び第3のセル13cの開口部にはシャッターが設けられている。
 基板ホルダ11には、予め作製された高抵抗β-Ga23基板2が取り付けられ、この高抵抗β-Ga23基板2上にβ-Ga23結晶をホモエピタキシャル成長させることにより、i型β-Ga23単結晶膜3を形成する。さらに、IV族元素を添加しつつβ-(AlxGa1-x23結晶をヘテロエピタキシャル成長させることにより、n型β-(AlxGa1-x23単結晶膜4を形成する。
 この高抵抗β-Ga23基板2は、例えば、次のような手順で作製される。まず、EFG法により、Mgをドーピングした半絶縁性β-Ga23単結晶インゴットを作製する。なお、ドーピングする元素はMgに限られない。例えば、Gaサイトを置換する場合は、H、Li、Na、K、Rb、CS、Fr、Be、Ca、Sr、Ba、Ra、Mn、Fe、Co、Ni、Pd、Cu、Ag、Au、Zn、Cd、Hg、Tl、又はPbを用いることができる。また、酸素サイトを置換する場合は、N、又はPを用いることができる。Mgをドーピングする場合は、原料粉末にMgO粉末を混合することにより行う。高抵抗β-Ga23基板2に良好な絶縁性を持たせるためには、MgOを0.05mol%以上添加すればよい。また、FZ法により半絶縁性β-Ga23単結晶インゴットを作製してもよい。作製したインゴットを所望の面方位が主面となるように、例えば1mm程度の厚さにスライス加工して基板化する。そして、研削研磨工程にて300~600μm程度の厚さに加工する。
 次に、上記の手順によって作製された高抵抗β-Ga23基板2をMBE装置1の基板ホルダ11に取り付ける。次に、真空ポンプ16を作動させ、真空槽10内の気圧を1×10-8Pa程度まで減圧する。そして、加熱装置12によって高抵抗β-Ga23基板2を加熱する。なお、高抵抗β-Ga23基板2の加熱は、加熱装置12の黒鉛ヒータ等の発熱源の輻射熱が基板ホルダ11を介して高抵抗β-Ga23基板2に熱伝導することにより行われる。
 高抵抗β-Ga23基板2が所定の温度に加熱された後、ガス供給パイプ15から真空槽10内に、酸素系ガスを供給する。
 真空槽10内に酸素系ガスを供給した後、真空槽10内のガス圧が安定するのに必要な時間(例えば5分間)経過後、基板ホルダ11を回転させながら第1のヒータ14aにより第1のセル13aを加熱し、Gaを蒸発させて分子線として高抵抗β-Ga23基板2の表面に照射する。
 例えば、第1のセル13aは900℃に加熱され、Ga蒸気のビーム等価圧力(BEP;Beam Equivalent Pressure)は1×10-4Paである。
 これにより、高抵抗β-Ga23基板2の主面((100)面)上にβ-Ga23結晶がホモエピタキシャル成長し、i型のβ-Ga23系単結晶膜であるi型β-Ga23単結晶膜3が形成される。β-Ga23結晶の成長温度は、例えば、700℃である。
 続けて、第1のセル13aに加えて第2のセル13b及び第3のセル13cを加熱し、Ga、Al及びIV族元素を蒸発させて分子線としてi型β-Ga23単結晶膜3の表面に照射する。IV族元素の蒸気のビーム等価圧力は、任意の濃度のIV族元素をβ-(AlxGa1-x23結晶に添加するため、第2のセル13bの温度により制御される。
 これにより、i型β-Ga23単結晶膜3上にβ-(AlxGa1-x23結晶がIV族元素を添加されながらヘテロエピタキシャル成長し、n型β-(AlxGa1-x23単結晶膜4が形成される。
 なお、i型β-Ga23単結晶膜3及びn型β-(AlxGa1-x23単結晶膜4は、PLD(Pulsed Laser Deposition)法、CVD(Chemical Vapor Deposition)法等により形成されてもよい。
 図3A及び図3Bは、本実施の形態に係る高抵抗β-Ga23基板2、i型β-Ga23単結晶膜3及びn型β-(AlxGa1-x23単結晶膜4の断面図である。
 図3Aは、β-(AlxGa1-x23結晶をヘテロエピタキシャル成長させる間、IV族元素を連続的に添加することにより形成されるn型β-(AlxGa1-x23単結晶膜4を表す。
 n型β-(AlxGa1-x23単結晶膜4のIV族元素の平均濃度は、例えば、1×1014~1×1020/cm3であり、特に、1×1017~1×1018/cm3であることが好ましい。このIV族元素の濃度は、成膜時の第2のセル13bの温度により制御することができる。
 図3Bは、β-(AlxGa1-x23結晶をヘテロエピタキシャル成長させる間、一定周期で間欠的にIV族元素を添加することにより形成されるn型β-(AlxGa1-x23単結晶膜4を表す。この場合、IV族元素としてSnが用いられる。
 具体的には、第2のセル13bのシャッターを操作することにより、Sn蒸気を第2のセル13bから間欠的に発生させ、Snを間欠的にβ-(AlxGa1-x23結晶に添加する。Snの添加は、間欠的に1回以上実施されることが好ましい。この場合、アニール処理を施さなくても、n型β-(AlxGa1-x23単結晶膜4にSn添加量に応じた電気伝導性を付与することができる。
 図3Bのn型β-(AlxGa1-x23単結晶膜4は、成膜時に間欠的にSnが添加されるため、Snを添加しない時間に成長した第1の層5(5a、5b、5c)と、Snを添加する時間に成長した第2の層6(6a、6b、6c)を有する。
 第2の層6のSn濃度は、成膜時の第2のセル13bの温度により制御することができる。第1の層5は、理想的にはSnを含まず、第2の層6から拡散した微量のSnを含むのみである。そのため、第1の層5のSn濃度は、第2の層6のSn濃度よりも低い。n型β-(AlxGa1-x23単結晶膜4中の平均Sn濃度は、例えば、1×1014~3×1018/cm3であり、特に、1×1017~1×1018/cm3であることが好ましい。
 例えば、第1の層5a、5b、5cの厚さは3~20nm、第2の層6a、6b、6cの厚さは0.2~1nmである。第1の層5a、5b、5cの厚さが20nmよりも大きい場合は、第2の層6a、6b、6cの間隔が大きすぎてSn添加の効果が薄くなるおそれがある。一方、第2の層6a、6b、6cの厚さが1nmよりも大きい場合は、第2の層6a、6b、6cから第1の層5a、5b、5cへのSnの拡散量が多すぎて間欠的なSn添加の効果が薄くなるおそれがある。
 なお、n型β-(AlxGa1-x23単結晶膜4の最下層(i型β-Ga23単結晶膜3に接する層)は、第1の層5であっても第2の層6であってもよい。また、第1の層5及び第2の層6の層数は限定されない。
 n型β-(AlxGa1-x23単結晶膜4を形成した後、n型β-(AlxGa1-x23単結晶膜4にSnをイオン注入することでソース領域24及びドレイン領域25を形成する。注入するイオンはSnに限られない。例えば、Gaサイトを置換する場合は、Ti、ZR、Hf、V、Nb、Ta、Mo、W、Ru、Rh、Ir、C、Si、Ge、Pb、Mn、As、Sb、Biを用いることができる。また、酸素サイトを置換する場合は、F、Cl、Br、Iを用いることができる。注入濃度は、例えば、1×1018/cm3以上5×1019/cm3以下である。注入深さは30nm以上である。注入後、注入領域の表面をフッ酸にて10nm程度エッチングする。硫酸や硝酸、塩酸などを用いて行ってもよい。その後、窒素雰囲気下で800℃以上30min以上のアニール処理を施し、注入ダメージを回復させる。アニール処理を酸素雰囲気で行う場合は、処理温度を800℃以上950℃以下、処理時間を30min以上とすればよい。
 なお、ソース領域24及びドレイン領域25の形成方法はイオン注入に限られず、熱拡散法を用いてもよい。この場合、n型β-(AlxGa1-x23単結晶膜4のソース領域24及びドレイン領域25を形成したい領域上にSn膜等の金属膜を接触させ、熱処理を施すことによりn型β-(AlxGa1-x23単結晶膜4中にSn等の不純物を拡散させる。また、ソース領域24及びドレイン領域25は形成されなくてもよい。
 その後、ソース電極22、ドレイン電極23、ゲート電極21を形成する。
(実施の形態の効果)
 本実施の形態によれば、エピタキシャル成長法を用いて高品質なi型β-Ga23単結晶膜3及びn型β-(AlxGa1-x23単結晶膜4を形成し、これらを用いて、高品質のGa23系HEMT20を形成することができる。
 以上、本発明の実施の形態を説明したが、上記に記載した実施の形態は特許請求の範囲に係る発明を限定するものではない。また、実施の形態の中で説明した特徴の組合せの全てが発明の課題を解決するための手段に必須であるとは限らない点に留意すべきである。
 高品質のGa23系半導体素子であるGa23系HEMTを提供する。
1…MBE装置、2…高抵抗β-Ga23基板、3…i型β-Ga23単結晶膜、4…n型β-(AlxGa1-x23単結晶膜、5(5a、5b、5c)…第1の層、6(6a、6b、6c)…第2の層、20…Ga23系HEMT、21…ゲート電極、22…ソース電極、23…ドレイン電極

Claims (2)

  1.  i型β-Ga23単結晶膜と、
     前記i型β-Ga23単結晶膜上に形成された、IV族元素を含むβ-(AlxGa1-x23(0<x≦0.6)結晶からなるn型β-(AlxGa1-x23単結晶膜と、
     前記n型β-(AlxGa1-x23単結晶膜上に形成されたソース電極及びドレイン電極と、
     前記ソース電極と前記ドレイン電極との間の前記n型β-(AlxGa1-x23単結晶膜上に形成されたゲート電極と、
     を含むGa23系HEMT。
  2.  前記n型β-(AlxGa1-x23結晶膜中のIV族元素の平均濃度は1×1014~1×1020/cm3である、
     請求項1に記載のGa23系HEMT。
PCT/JP2012/072896 2011-09-08 2012-09-07 Ga2O3系HEMT WO2013035841A1 (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2011-196436 2011-09-08
JP2011196436 2011-09-08

Publications (1)

Publication Number Publication Date
WO2013035841A1 true WO2013035841A1 (ja) 2013-03-14

Family

ID=47832280

Family Applications (1)

Application Number Title Priority Date Filing Date
PCT/JP2012/072896 WO2013035841A1 (ja) 2011-09-08 2012-09-07 Ga2O3系HEMT

Country Status (2)

Country Link
JP (1) JPWO2013035841A1 (ja)
WO (1) WO2013035841A1 (ja)

Cited By (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2016031633A1 (ja) * 2014-08-29 2016-03-03 株式会社タムラ製作所 半導体素子及び結晶積層構造体
JP2016051795A (ja) * 2014-08-29 2016-04-11 株式会社タムラ製作所 半導体素子及びその製造方法、並びに結晶積層構造体
JP2017218334A (ja) * 2016-06-03 2017-12-14 株式会社タムラ製作所 Ga2O3系結晶膜の成長方法及び結晶積層構造体
US10580648B2 (en) 2017-09-04 2020-03-03 Flosfia Inc. Semiconductor device and method of manufacturing semiconductor device
JP2020100560A (ja) * 2020-03-31 2020-07-02 株式会社タムラ製作所 結晶積層構造体
US11088242B2 (en) 2019-03-29 2021-08-10 Flosfia Inc. Crystal, crystalline oxide semiconductor, semiconductor film containing crystalline oxide semiconductor, semiconductor device including crystal and/or semiconductor film and system including semiconductor device
US11152208B2 (en) 2016-09-15 2021-10-19 Flosfia Inc. Semiconductor film, method of forming semiconductor film, complex compound for doping, and method of doping

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2005340308A (ja) * 2004-05-24 2005-12-08 Koha Co Ltd 半導体素子の製造方法

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2005340308A (ja) * 2004-05-24 2005-12-08 Koha Co Ltd 半導体素子の製造方法

Non-Patent Citations (2)

* Cited by examiner, † Cited by third party
Title
K.MATSUZAKI ET AL.: "Field-induced current modulation in epitaxial film on deep- ultraviolet transparent oxide semiconductor Ga203", APPLIED PHYSICS LETTERS, vol. 88, 1 March 2006 (2006-03-01), pages 092106 *
R.KUMARAN ET AL.: "Epitaxial Nd-doped alpha-(All- xGax)203 films on sapphire for solid-state waveguide lasers", OPTICS LETTERS, vol. 35, no. 22, 15 November 2010 (2010-11-15), pages 3793 - 3795 *

Cited By (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2016031633A1 (ja) * 2014-08-29 2016-03-03 株式会社タムラ製作所 半導体素子及び結晶積層構造体
JP2016051794A (ja) * 2014-08-29 2016-04-11 株式会社タムラ製作所 半導体素子及び結晶積層構造体
JP2016051795A (ja) * 2014-08-29 2016-04-11 株式会社タムラ製作所 半導体素子及びその製造方法、並びに結晶積層構造体
CN107078063A (zh) * 2014-08-29 2017-08-18 株式会社田村制作所 半导体元件和晶体层叠结构体
US10861945B2 (en) 2014-08-29 2020-12-08 Tamura Corporation Semiconductor element and crystalline laminate structure
CN107078063B (zh) * 2014-08-29 2021-03-23 株式会社田村制作所 半导体元件和晶体层叠结构体
JP2017218334A (ja) * 2016-06-03 2017-12-14 株式会社タムラ製作所 Ga2O3系結晶膜の成長方法及び結晶積層構造体
US11152208B2 (en) 2016-09-15 2021-10-19 Flosfia Inc. Semiconductor film, method of forming semiconductor film, complex compound for doping, and method of doping
US10580648B2 (en) 2017-09-04 2020-03-03 Flosfia Inc. Semiconductor device and method of manufacturing semiconductor device
US11088242B2 (en) 2019-03-29 2021-08-10 Flosfia Inc. Crystal, crystalline oxide semiconductor, semiconductor film containing crystalline oxide semiconductor, semiconductor device including crystal and/or semiconductor film and system including semiconductor device
JP2020100560A (ja) * 2020-03-31 2020-07-02 株式会社タムラ製作所 結晶積層構造体

Also Published As

Publication number Publication date
JPWO2013035841A1 (ja) 2015-03-23

Similar Documents

Publication Publication Date Title
JP6108366B2 (ja) Ga2O3系半導体素子
JP5807282B2 (ja) Ga2O3系半導体素子
JP5948581B2 (ja) Ga2O3系半導体素子
JP6142358B2 (ja) Ga2O3系半導体素子
JP5952360B2 (ja) Ga含有酸化物層成長用β−Ga2O3系単結晶基板
JP5975466B2 (ja) Ga2O3系半導体素子
WO2013035841A1 (ja) Ga2O3系HEMT
JP6082700B2 (ja) Ga2O3系結晶膜の製造方法
JP6216978B2 (ja) Ga2O3系半導体素子

Legal Events

Date Code Title Description
121 Ep: the epo has been informed by wipo that ep was designated in this application

Ref document number: 12830280

Country of ref document: EP

Kind code of ref document: A1

ENP Entry into the national phase

Ref document number: 2013532669

Country of ref document: JP

Kind code of ref document: A

NENP Non-entry into the national phase

Ref country code: DE

122 Ep: pct application non-entry in european phase

Ref document number: 12830280

Country of ref document: EP

Kind code of ref document: A1